CN107665683A - 时钟信号输出电路及时钟信号输出方法 - Google Patents
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Abstract
本发明提供一种时钟信号输出电路及时钟信号输出方法。该时钟信号输出电路包括第一比较器、第二比较器、D锁存器、第一开关、第二开关、第三开关、电流源、及电容，在利用该时钟信号输出电路向液晶显示面板的GOA电路输出时钟信号时，搭配特定的时钟信号及起始信号的时序，使在起始信号的高电平到来之后才向液晶显示面板的GOA电路输入时钟信号，避免在起始信号高电平到来之前液晶显示面板的GOA电路接收到脉冲波形的时序信号而使正常显示时液晶显示面板的时序错乱。
Description
技术领域
本发明涉及液晶显示领域，尤其涉及一种时钟信号输出电路及时钟信号输出方法。
背景技术
随着显示技术的发展，液晶显示装置(Liquid Crystal Display，LCD)等平面显示装置因具有高画质、省电、机身薄及应用范围广等优点，而被广泛地应用于手机、电视、个人数字助理、数字相机、笔记本电脑、台式计算机等各种消费性电子产品，成为显示装置中的主流。
主动式液晶显示装置中，每个像素电性连接一个薄膜晶体管(TFT)，薄膜晶体管的栅极(Gate)连接至水平扫描线，源极(Source)连接至垂直方向的数据线，漏极(Drain)则连接至像素电极。在水平扫描线上施加足够的电压，会使得电性连接至该条水平扫描线上的所有TFT打开，从而数据线上的信号电压能够写入像素，控制液晶的不同透光度进而达到控制色彩与亮度的效果。目前主动式液晶显示面板水平扫描线的驱动主要由外接的集成电路板(Integrated Circuit，IC)来完成，外接的IC可以控制各级水平扫描线的逐级充电和放电。
而GOA技术(Gate Driver on Array)即阵列基板行驱动技术，是可以运用液晶显示面板的阵列制程将栅极驱动电路制作在TFT阵列基板上，实现对栅极逐行扫描的驱动方式。GOA电路中一般需要接入若干时钟信号，以实现其栅极逐行扫描的功能。现有技术中，通常利用时序控制器(Tcon)产生时序信号输入液晶显示面板的GOA电路中。现有的时序控制器在开始驱动液晶显示面板之前，需要从闪存(flash)中读取参数(code)，在时序控制器读取参数的过程中，其一般会输出时钟信号，而在完成参数的读取后才会输出控制GOA电路开始逐行扫描的起始信号，这样会造成GOA内部时序错乱，无法正常显示。
发明内容
本发明的目的在于提供一种时钟信号输出电路，在起始信号的高电平到来之后才向液晶显示面板的GOA电路输入时钟信号，避免液晶显示面板时序错乱无法正常显示。
本发明的另一目的在于提供一种时钟信号输出方法，在起始信号的高电平到来之后才向液晶显示面板的GOA电路输入时钟信号，避免液晶显示面板时序错乱无法正常显示。
为实现上述目的，本发明首先提供一种时钟信号输出电路，包括：第一比较器、第二比较器、D锁存器、第一开关、第二开关、第三开关、电流源、及电容；
所述第一比较器的同相输入端接入第一参考电压，反相输入端接入时钟信号，输出端电性连接第一开关的控制端；
所述第一开关的第一端电性连接电流源的输出端，第二端电性连接第二比较器的同相输入端；
所述第二开关的控制端接入时钟信号，第一端电性连接第二比较器的同相输入端，第二端接地；
所述电容的第一端电性连接第二比较器的同相输入端，第二端接地；
所述第二比较器的反相输入端接入第二参考电压，输出端电性连接D锁存器的E输入端；
所述D锁存器的D输入端接入起始信号，输出端电性连接第三开关的控制端；
所述第三开关的第一端接入时钟信号，第二端电性连接液晶显示面板的GOA电路。
所述第一比较器的反相输入端、第二开关的控制端、及第三开关的第一端均电性连接时序控制器的时钟信号输出端，所述D锁存器的D输入端电性连接时序控制器的起始信号输出端；所述时钟信号、及起始信号均由时序控制器提供。
所述第一开关、第二开关、第三开关均在其控制端接入高电位时闭合，在其控制端接入低电位时断开。
所述时钟信号及起始信号相组合先后对应于一消隐阶段、一启动阶段、及一时钟信号输出阶段；
在消隐阶段中，所述时钟信号为低电位，且所述时钟信号的低电位的电压小于第一参考电压，所述第一开关闭合，电流源为电容充电使第二比较器同相输入端的电压大于第二参考电压，第二比较器的输出端输出高电位，所述起始信号为低电位，D锁存器的输出端为低电位，第三开关断开；
在启动阶段中，所述时钟信号保持低电位，第二比较器的输出端保持高电位，所述起始信号为高电位，D锁存器的输出端为高电位，第三开关闭合，时钟信号输入液晶显示面板的GOA电路；
在时钟信号输出阶段中，所述时钟信号为高电位与低电位交替的脉冲信号，且在时钟信号除第一个上升沿以外的上升沿到来之前第二比较器同相输入端的电压均小于第二参考电压，第二比较器的输出端为低电位，D锁存器的输出端保持高电位，第三开关保持闭合，时钟信号输入液晶显示面板的GOA电路。
在时钟信号输出阶段中，所述起始信号由高电位变为低电位。
所述时钟信号的高电位的电压大于第一参考电压。
本发明还提供一种时钟信号输出方法，应用于上述时钟信号输出电路，包括如下步骤：
步骤S10、进入消隐阶段；
所述时钟信号为低电位，且所述时钟信号的低电位的电压小于第一参考电压，所述第一开关闭合，电流源为电容充电使第二比较器同相输入端的电压大于第二参考电压，第二比较器的输出端输出高电位，所述起始信号为低电位，D锁存器的输出端为低电位，第三开关断开；
步骤S20、进入启动阶段；
所述时钟信号保持低电位，第二比较器的输出端保持高电位，所述起始信号为高电位，D锁存器的输出端为高电位，第三开关闭合，时钟信号输入液晶显示面板的GOA电路；
步骤S30、进入时钟信号输出阶段；
所述时钟信号为高电位与低电位交替的脉冲信号，且在时钟信号除第一个上升沿以外的上升沿到来之前第二比较器同相输入端的电压均小于第二参考电压，第二比较器的输出端为低电位，D锁存器的输出端保持高电位，第三开关保持闭合，时钟信号输入液晶显示面板的GOA电路。
在时钟信号输出阶段中，所述起始信号由高电位变为低电位。
所述时钟信号的高电位的电压大于第一参考电压。
本发明的有益效果：本发明提供的一种时钟信号输出电路，该时钟信号输出电路包括第一比较器、第二比较器、D锁存器、第一开关、第二开关、第三开关、电流源、及电容，在利用该时钟信号输出电路向液晶显示面板的GOA电路输出时钟信号时，搭配特定的时钟信号及起始信号的时序，使在起始信号的高电平到来之后才向液晶显示面板的GOA电路输入时钟信号，避免在起始信号高电平到来之前液晶显示面板的GOA电路接收到脉冲波形的时序信号而使正常显示时液晶显示面板的时序错乱。本发明提供的一种时钟信号输出方法，利用上述时钟信号输出电路向液晶显示面板的GOA电路输出时钟信号，使在起始信号的高电平到来之后才向液晶显示面板的GOA电路输入时钟信号，避免在起始信号高电平到来之前液晶显示面板的GOA电路接收到脉冲波形的时序信号而使正常显示时液晶显示面板的时序错乱。
附图说明
为了能更进一步了解本发明的特征以及技术内容，请参阅以下有关本发明的详细说明与附图，然而附图仅提供参考与说明用，并非用来对本发明加以限制。
附图中，
图1为本发明的时钟信号输出电路的电路图；
图2为本发明的时钟信号输出电路的工作时序图；
图3为本发明的时钟信号输出方法的流程图。
具体实施方式
为更进一步阐述本发明所采取的技术手段及其效果，以下结合本发明的优选实施例及其附图进行详细描述。
请参阅图1及图2，本发明提供一种时钟信号输出电路，包括：第一比较器TP1、第二比较器TP2、D锁存器100、第一开关S1、第二开关S2、第三开关S3、电流源I、及电容C1；
具体各元件的连接关系如下：所述第一比较器TP1的同相输入端接入第一参考电压VREF1，反相输入端接入时钟信号CK，输出端电性连接第一开关S1的控制端；所述第一开关S1的第一端电性连接电流源I的输出端，第二端电性连接第二比较器TP2的同相输入端；所述第二开关S2的控制端接入时钟信号CK，第一端电性连接第二比较器TP2的同相输入端，第二端接地；所述电容C1的第一端电性连接第二比较器TP2的同相输入端，第二端接地；所述第二比较器TP2的反相输入端接入第二参考电压VREF2，输出端电性连接D锁存器100的E输入端E；所述D锁存器100的D输入端D接入起始信号STV，输出端Q电性连接第三开关S3的控制端；所述第三开关S3的第一端接入时钟信号CK，第二端电性连接液晶显示面板20的GOA电路21。
具体地，所述第一比较器TP1的反相输入端、第二开关S2的控制端、及第三开关S3的第一端均电性连接时序控制器10的时钟信号输出端，所述D锁存器100的D输入端D电性连接时序控制器10的起始信号输出端；所述时钟信号CK、及起始信号STV均由时序控制器10提供。具体地，所述第一开关S1、第二开关S2、第三开关S3均在其控制端接入高电位时闭合，在其控制端接入低电位时断开。
进一步地，请参阅图2，并结合图1，所述时钟信号CK及起始信号STV相组合先后对应于一消隐阶段1、一启动阶段2、及一时钟信号输出阶段3；
在消隐阶段1中，所述时钟信号CK为低电位，且所述时钟信号CK的低电位的电压小于第一参考电压VREF1，第一比较器TP1的输出端为高电位，第一开关S1闭合，第二开关S2断开，电流源I经闭合的第一开关S1为第一为电容C1充电使第二比较器TP2同相输入端的电压大于第二参考电压VREF2，第二比较器TP2的输出端输出高电位，所述起始信号STV为低电位，D锁存器100的输出端Q为低电位，第三开关S3断开，此阶段中，由于第三开关S3断开，时钟信号CK并不输入到液晶显示面板20的GOA电路21中；
在启动阶段2中，所述时钟信号CK保持低电位，第一比较器TP1的输出端保持高电位，第一开关S1保持闭合，第二开关S2保持断开，第二比较器TP2的同相输入端的电压保持大于第二参考电压VREF2，第二比较器TP2的输出端保持高电位，此时所述起始信号STV切换为高电位并保持高电位，D锁存器100的输出端Q为高电位，第三开关S3闭合，此时，时钟信号CK经闭合的第三开关S3输入液晶显示面板20的GOA电路21；
在时钟信号输出阶段3中，所述时钟信号CK为高电位与低电位交替的脉冲信号，当时钟信号CK第一次切换为高电位后，第二开关S2关闭使第二比较器TP2同相输入端接地，第二比较器TP2输出端输出低电位，且通过对电流源I输出电流的大小、第二参考电压VREF2电压值、以及时钟信号CK为脉冲信号时上升沿及下降沿之间的时长进行具体的选取，使在时钟信号CK除第一个上升沿以外的上升沿到来之前第二比较器TP2同相输入端的电压均小于第二参考电压VREF2，第二比较器TP2的输出端为低电位，D锁存器100的输出端Q保持高电位，第三开关S3保持闭合，时钟信号CK输入液晶显示面板20的GOA电路21。
具体地，在时钟信号输出阶段3中，所述起始信号STV由高电位变为低电位。
具体地，所述时钟信号CK的高电位的电压大于第一参考电压VREF1，使在时钟信号输出阶段3中第一开关S1断开，将第二比较器TP2的同相输入端与电流源I断开。
需要说明的是，本发明的时钟信号输出电路，在起始信号STV的高电平到来之后才向液晶显示面板20的GOA电路21输入时钟信号CK，避免在起始信号高电平到来之前液晶显示面板的GOA电路接收到脉冲波形的时序信号而使正常显示时液晶显示面板的时序错乱，提升产品的品质。
请参阅图3，并结合图1及图2，基于同一发明构思，本发明还提供一种时钟信号输出方法，应用于上述时钟信号输出电路，包括如下步骤：
步骤S10、进入消隐阶段1；
所述时钟信号CK为低电位，且所述时钟信号CK的低电位的电压小于第一参考电压VREF1，第一比较器TP1的输出端为高电位，第一开关S1闭合，第二开关S2断开，电流源I经闭合的第一开关S1为第一为电容C1充电使第二比较器TP2同相输入端的电压大于第二参考电压VREF2，第二比较器TP2的输出端输出高电位，所述起始信号STV为低电位，D锁存器100的输出端Q为低电位，第三开关S3断开，此阶段中，由于第三开关S3断开，时钟信号CK并不输入到液晶显示面板20的GOA电路21中。
步骤S20、进入启动阶段2；
所述时钟信号CK保持低电位，第一比较器TP1的输出端保持高电位，第一开关S1保持闭合，第二开关S2保持断开，第二比较器TP2的同相输入端的电压保持大于第二参考电压VREF2，第二比较器TP2的输出端保持高电位，此时所述起始信号STV切换为高电位并保持高电位，D锁存器100的输出端Q为高电位，第三开关S3闭合，此时，时钟信号CK经闭合的第三开关S3输入液晶显示面板20的GOA电路21。
步骤S30、进入时钟信号输出阶段3；
所述时钟信号CK为高电位与低电位交替的脉冲信号，当时钟信号CK第一次切换为高电位后，第二开关S2关闭使第二比较器TP2同相输入端接地，第二比较器TP2输出端输出低电位，且通过对电流源I输出电流的大小、第二参考电压VREF2电压值、以及时钟信号CK为脉冲信号时上升沿及下降沿之间的时长进行具体的选取，使在时钟信号CK除第一个上升沿以外的上升沿到来之前第二比较器TP2同相输入端的电压均小于第二参考电压VREF2，第二比较器TP2的输出端为低电位，D锁存器100的输出端Q保持高电位，第三开关S3保持闭合，时钟信号CK输入液晶显示面板20的GOA电路21。
具体地，在时钟信号输出阶段3中，所述起始信号STV由高电位变为低电位。
具体地，所述时钟信号CK的高电位的电压大于第一参考电压VREF1，使在时钟信号输出阶段3中第一开关S1断开，将第二比较器TP2的同相输入端与电流源I断开。
需要说明的是，本发明的时钟信号输出方法，在起始信号STV的高电平到来之后才向液晶显示面板20的GOA电路21输入时钟信号CK，避免在起始信号高电平到来之前液晶显示面板的GOA电路21接收到脉冲波形的时序信号而使正常显示时液晶显示面板的时序错乱，提升产品的品质。
综上所述，本发明的时钟信号输出电路，包括第一比较器、第二比较器、D锁存器、第一开关、第二开关、第三开关、电流源、及电容，在利用该时钟信号输出电路向液晶显示面板的GOA电路输出时钟信号时，搭配特定的时钟信号及起始信号的时序，使在起始信号的高电平到来之后才向液晶显示面板的GOA电路输入时钟信号，避免在起始信号高电平到来之前液晶显示面板的GOA电路接收到脉冲波形的时序信号而使正常显示时液晶显示面板的时序错乱。本发明的时钟信号输出方法，利用上述时钟信号输出电路向液晶显示面板的GOA电路输出时钟信号，使在起始信号的高电平到来之后才向液晶显示面板的GOA电路输入时钟信号，避免在起始信号高电平到来之前液晶显示面板的GOA电路接收到脉冲波形的时序信号而使正常显示时液晶显示面板的时序错乱。
以上所述，对于本领域的普通技术人员来说，可以根据本发明的技术方案和技术构思作出其他各种相应的改变和变形，而所有这些改变和变形都应属于本发明后附的权利要求的保护范围。
Claims (9)
1.一种时钟信号输出电路，其特征在于，包括：第一比较器(TP1)、第二比较器(TP2)、D锁存器(100)、第一开关(S1)、第二开关(S2)、第三开关(S3)、电流源(I)、及电容(C1)；
所述第一比较器(TP1)的同相输入端接入第一参考电压(VREF1)，反相输入端接入时钟信号(CK)，输出端电性连接第一开关(S1)的控制端；
所述第一开关(S1)的第一端电性连接电流源(I)的输出端，第二端电性连接第二比较器(TP2)的同相输入端；
所述第二开关(S2)的控制端接入时钟信号(CK)，第一端电性连接第二比较器(TP2)的同相输入端，第二端接地；
所述电容(C1)的第一端电性连接第二比较器(TP2)的同相输入端，第二端接地；
所述第二比较器(TP2)的反相输入端接入第二参考电压(VREF2)，输出端电性连接D锁存器(100)的E输入端(E)；
所述D锁存器(100)的D输入端(D)接入起始信号(STV)，输出端(Q)电性连接第三开关(S3)的控制端；
所述第三开关(S3)的第一端接入时钟信号(CK)，第二端电性连接液晶显示面板(20)的GOA电路(21)。
2.如权利要求1所述的时钟信号输出电路，其特征在于，所述第一比较器(TP1)的反相输入端、第二开关(S2)的控制端、及第三开关(S3)的第一端均电性连接时序控制器(10)的时钟信号输出端，所述D锁存器(100)的D输入端(D)电性连接时序控制器(10)的起始信号输出端；所述时钟信号(CK)、及起始信号(STV)均由时序控制器(10)提供。
3.如权利要求2所述的时钟信号输出电路，其特征在于，所述第一开关(S1)、第二开关(S2)、第三开关(S3)均在其控制端接入高电位时闭合，在其控制端接入低电位时断开。
4.如权利要求3所述的时钟信号输出电路，其特征在于，所述时钟信号(CK)及起始信号(STV)相组合先后对应于一消隐阶段(1)、一启动阶段(2)、及一时钟信号输出阶段(3)；
在消隐阶段(1)中，所述时钟信号(CK)为低电位，且所述时钟信号(CK)的低电位的电压小于第一参考电压(VREF1)，所述第一开关(S1)闭合，电流源(I)为电容(C1)充电使第二比较器(TP2)同相输入端的电压大于第二参考电压(VREF2)，第二比较器(TP2)的输出端输出高电位，所述起始信号(STV)为低电位，D锁存器(100)的输出端(Q)为低电位，第三开关(S3)断开；
在启动阶段(2)中，所述时钟信号(CK)保持低电位，第二比较器(TP2)的输出端保持高电位，所述起始信号(STV)为高电位，D锁存器(100)的输出端(Q)为高电位，第三开关(S3)闭合，时钟信号(CK)输入液晶显示面板(20)的GOA电路(21)；
在时钟信号输出阶段(3)中，所述时钟信号(CK)为高电位与低电位交替的脉冲信号，且在时钟信号(CK)除第一个上升沿以外的上升沿到来之前第二比较器(TP2)同相输入端的电压均小于第二参考电压(VREF2)，第二比较器(TP2)的输出端为低电位，D锁存器(100)的输出端(Q)保持高电位，第三开关(S3)保持闭合，时钟信号(CK)输入液晶显示面板(20)的GOA电路(21)。
5.如权利要求4所述的时钟信号输出电路，其特征在于，在时钟信号输出阶段(3)中，所述起始信号(STV)由高电位变为低电位。
6.如权利要求4所述的时钟信号输出电路，其特征在于，所述时钟信号(CK)的高电位的电压大于第一参考电压(VREF1)。
7.一种时钟信号输出方法，应用于如权利要求1至6任一项所述的时钟信号输出电路，其特征在于，包括如下步骤：
步骤S10、进入消隐阶段(1)；
所述时钟信号(CK)为低电位，且所述时钟信号(CK)的低电位的电压小于第一参考电压(VREF1)，所述第一开关(S1)闭合，电流源(I)为电容(C1)充电使第二比较器(TP2)同相输入端的电压大于第二参考电压(VREF2)，第二比较器(TP2)的输出端输出高电位，所述起始信号(STV)为低电位，D锁存器(100)的输出端(Q)为低电位，第三开关(S3)断开；
步骤S20、进入启动阶段(2)；
所述时钟信号(CK)保持低电位，第二比较器(TP2)的输出端保持高电位，所述起始信号(STV)为高电位，D锁存器(100)的输出端(Q)为高电位，第三开关(S3)闭合，时钟信号(CK)输入液晶显示面板(20)的GOA电路(21)；
步骤S30、进入时钟信号输出阶段(3)；
所述时钟信号(CK)为高电位与低电位交替的脉冲信号，且在时钟信号(CK)除第一个上升沿以外的上升沿到来之前第二比较器(TP2)同相输入端的电压均小于第二参考电压(VREF2)，第二比较器(TP2)的输出端为低电位，D锁存器(100)的输出端(Q)保持高电位，第三开关(S3)保持闭合，时钟信号(CK)输入液晶显示面板(20)的GOA电路(21)。
8.如权利要求7所述的时钟信号输出方法，其特征在于，在时钟信号输出阶段(3)中，所述起始信号(STV)由高电位变为低电位。
9.如权利要求7所述的时钟信号输出方法，其特征在于，所述时钟信号(CK)的高电位的电压大于第一参考电压(VREF1)。
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