CN107527599B - 扫描驱动电路、阵列基板与显示面板 - Google Patents

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Abstract

本发明公开一种扫描驱动电路以及具有所述扫描驱动电路的阵列基板与显示面板。所述扫描驱动电路包括设置于基底表面的上拉单元与自举单元，所述上拉单元包括用于输出扫描驱动信号的上拉薄膜晶体管，所述自举单元包括电性连接于所述上拉薄膜晶体管用于维持所述扫描驱动信号稳定的自举电容。上拉薄膜晶体管包括自基底表面依次层叠设置的栅极、第一绝缘层、源极与漏极。自举电容包括第一导电电极与第二导电电极，所述第一导电电极与所述源极在同一层设置且相互电性连接。所述第二导电电极与所述第二电极之间设置有第二绝缘层。所述第二导电电极通过第一过孔与所述栅极电性连接，所述第一过孔贯穿所述第二绝缘层与所述第一绝缘层。

Description

扫描驱动电路、阵列基板与显示面板
技术领域
本发明涉及显示器领域，尤其涉及显示器图像显示扫描驱动领域。
背景技术
为了提高显示器的显示效果，无论是应用于户外的大型显示屏幕或者应用于消费性电子的小型显示屏幕，越来越多的人开始将注意力投向显示装置的窄边框设计，窄边框显示装置可以有效降低拼接屏中非显示区域的面积，有效提高屏占比，显著提高整体的显示效果。由此，窄边框成为目前显示器领域中亟待解决的问题。
发明内容
为解决窄边框的问题，本发明提供一种占据面积较小的扫描驱动电路。
进一步地，本发明还提供具有前述扫描驱动电路的阵列基板与显示面板。
一种扫描驱动电路，所述扫描驱动电路包括设置于基底表面的上拉单元与自举单元，所述上拉单元包括用于输出扫描驱动信号的上拉薄膜晶体管，所述自举单元包括电性连接于所述上拉薄膜晶体管用于维持所述扫描驱动信号稳定的自举电容，所述自举电容具有第一电容值。上拉薄膜晶体管包括自基底表面依次层叠设置的栅极、第一绝缘层、源极与漏极。自举电容包括第一导电电极与第二导电电极，所述第一导电电极与所述源极在同一层设置且相互电性连接。所述第二导电电极与所述第一导电电极之间设置有第二绝缘层，所述第二导电电极通过第一过孔与所述栅极电性连接，所述第一过孔贯穿所述第二绝缘层与所述第一绝缘层。
一种阵列基板包括显示区与非显示区，所述显示区多条扫描线与数据线，其中，所述扫描线沿着所述第一方向延伸并且沿着第二方向间隔预定距离相互绝缘排列设置，所述数据线沿所述第二方向延伸并且沿着第一方向间隔预定距离相互绝缘排列设置，所述多条扫描线与所述数据线交叉处形成像素单元，所述非显示区设置有前述扫描驱动电路，所述扫描驱动电路电性连接所述扫描线，用于输出所述扫描驱动信号至所述像素单元，所述第一方向、所述第二方向以及所述第三方向相互垂直。
一种显示面板包括相对设置的对向基板与前述的阵列基板，且所述对向基板与所述阵列基板之间夹设有显示介质。
相较于现有技术，第一导电电极与第二导电电极构成的自举电容结构由平坦化层作为绝缘介质，由于平坦化层的厚度相对较薄，因此能够有效缩小自举电容两个电极之间的距离，对应地则可以减小自举电容沿着第一方向的尺寸，二第一方向为阵列基板的宽度方向，进而有效缩小了阵列基板中非显示区域在第一方向的尺寸，达到窄边框的目的。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明一实施例所述的显示装置的立体结构图。
图2为图1所示显示面板中阵列基板的平面结构示意图。
图3为如图2所示显示面板中扫描驱动电路与扫描线的连接示意图。
图4为如图3所示其中一个扫描驱动单元的电路框图。
图5为如图4所示上拉薄膜晶体管与自举电容在阵列基板上平面结构示意图。
图6为如图5所示沿着VI-VI线的剖面结构示意图。
图7本发明第一实施例中如图4所示上拉薄膜晶体管与自举电容在阵列基板10c上平面结构示意图。
图8为如图7所示沿着VIII-VIII线的剖面结构示意图。
图9为本发明第二实施例中如图4所示上拉薄膜晶体管与自举电容在阵列基板10c上平面结构示意图。
图10为如图9所示沿着X-X线的剖面结构示意图。
图11本发明第三实施例中如图4所示上拉薄膜晶体管与自举电容在阵列基板10c上平面结构示意图。
图12为如图11所示沿着XII-XII线的剖面结构示意图。
图13本发明第四实施例中如图4所示上拉薄膜晶体管与自举电容在阵列基板10c上平面结构示意图。
图14为如图13所示沿着XIV-XIV线的剖面结构示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
图1为本发明一实施例中所述的显示装置立体结构示意图。如图1所示，显示装置100包括显示器面板10与作为光学模组的背光模组，其中，显示面板10包括图像用显示区10a与非显示区10b。显示区10a用作图像显示，非显示区10b环绕设置于显示区10a周围并作为非出光区域，并不用作图像显示。其中，显示面板10还包括有阵列基板10c与对向基板10d，以及夹设于阵列基板10c与对向基板10d的液晶层10e。本实施例中，显示装置100中的显示面板10以液晶材料作为显示介质。当然，在本发明其他变更实施例中，显示装置100中的显示面板10可以有机发光半导体材料(Organic Electroluminescence Diode，OLED)作为显示介质，并不以此为限。为了便于说明，先定义由相互垂直的第一方向X、第二方向Y以及第三方向Z构成的三维直角坐标系。其中，显示装置100沿着第三方向Z为其厚度方向。
请参阅图2，其为图1所示显示面板10阵列基板10c的平面结构示意图。如图2所示，阵列基板10c中对应图像显示区10a的第一区域(未标示)包括多个呈矩阵排列的m*n像素单元(Pixel)110、m条(Data Line)数据线(Scan Line)120以及n条扫描线130，m、n为大于1的自然数。
其中，该多条数据线120沿第一方向Y间隔第一预定距离相互绝缘且平行排列，该多条扫描线130沿第二方向X亦间隔第二预定距离相互绝缘且平行排列，并且所该多条扫描线130与该多条数据线120相互绝缘，所述第一方向X与第二方向Y相互垂直。为便于说明，所述m条数据线120分别定义为D1、D2、……，Dm-1、Dm；所述n条扫描线130分别定义为G1、G2、……，Gn-1、Gn。多个所述像素单元110分别位于该多条数据线120、扫描线130构成的矩阵中，并且与对应的其中数据线120以及扫描线130电性连接。
对应显示面板10的非显示区10b，显示装置100(图1)进一步包括设置于非显示区10b的用于驱动多个矩阵排列的像素单元110进行图像显示的控制电路101、数据驱动电路(Data Driver)102以及扫描驱动电路(Scan Driver)103，设置于阵列基板11c的第二区域(未标示)。其中，数据驱动电路102与该多条数据线120电性连接，用于将待显示用的图像数据通过该多条数据线120以数据电压的形式传输至该多个像素单元110。扫描驱动电路103用于与该多条扫描线130电性连接，用于通过该多条扫描线130输出扫描信号用于控制像素单元110何时接收图像数据进行图像显示。控制电路101分别与数据驱动电路102和扫描驱动电路103电性连接，用于控制数据驱动电路102与扫描驱动电路103的工作时序，也即是输出对应的时序控制信号至数据驱动电路102以及扫描驱动电路103。
本实施例中，扫描驱动电路103直接设置于显示面板11的非显示区10b，控制电路101与数据驱动电路102则独立于阵列基板11c设置于其他的承载电路板板上。本实施例中，扫描驱动电路103中的电路元件与显示面板11中的像素单元110同一制程制作于显示面板11中，也即是GOA(Gate on Array)技术。另外，像素单元110对应包括的薄膜晶体管、像素电极等可采用低温多晶硅(Low Temperature Poly-Silicon，LTPS)制程形成，当然，扫描驱动电路103也均一并采用LTPS制程形成。
可以理解，显示面板10还包括有其他辅助电路用于共同完成图像的显示，例如图像接收处理电路(Graphics Processing Unit，GPU)、电源电路等，本实施例中不再对其进行赘述。
请参阅图3，其为如图2所示显示面板10中扫描驱动电路103与扫描线130的连接示意图。
所述扫描驱动电路103对应包括有n个依次级联的扫描驱动SD1～SDn，n个扫描驱动单元SD1～Dn分别与n条扫描线130电性连接，且按照时序输出对应的n个扫描信号Sc至对应的扫描线130，进而控制与其电性连接的像素单元110处于可接收数据电压的状态。为便于制作，通常将多个扫描驱动单元SD分为一组。为便于所说明，本实施例中，如图3所示，将8个扫描驱动单元SD分为一组。如图3所示，扫描驱动单元SD1～SD8定义为一组扫描驱动单元，其分别对应于扫描线G1～G8，用于分别为G1～G8输出扫描驱动信号。其中，每一个扫描驱动单元SD均沿着第一方向X作为长度方向延伸，沿着第二方向Y作为宽度方向延伸。
请参阅图4，其为如图3所示其中一个扫描驱动单元SDi的电路框图。
每一个扫描驱动单元SDi均包括有上拉控制单元41、上拉单元42、自举单元43、下拉单元44、下拉维持单元45以及下传单元46。
其中，上拉控制单元41用于接收驱动信号STV，并且在驱动信号STV控制下输出控制信号至上拉单元42，上拉单元42在控制信号控制下依据时钟信号CK输出扫描驱动信号。本实施例中，上拉控制单元41采用薄膜晶体管T11来实现，而上拉单元42包括上拉薄膜晶体管T21，其中，上拉薄膜晶体管T21的栅极G电性连接上拉控制单元41，用于接收控制信号；上拉薄膜晶体管T21的源极S电性连接扫描输出端O，用于输出扫描驱动信号；上拉薄膜晶体管T21的漏极D电性连接时钟信号端C，用于接收时钟信号CK。自举单元43包括自举电容Cb构成，电性连接于栅极G与源极S之间，用于维持扫描输出信号的波形。其中，自居电容Cb具有第一电容值。
下拉单元44有两个镜像连接的薄膜晶体管T31与T41构成实现，且分别电性连接上拉单元42。下拉维持单元45电性连接上拉控制单元41与扫描输出端O，用于维持扫描输出端O在非扫描期间控制扫描输出端O处于非扫描驱动信号输出状态，保证扫描输出的O正确输出信号。下传单元46电性连接上拉控制单元与时钟信号端C之间，用于在控制扫描输出端O输出完成扫描驱动信号后将扫描驱动信号传输至与扫描驱动单元SDi邻近的下一个扫描驱动单元SDi+1，以驱动扫描驱动单元SDi+1在下一个扫描时刻输出扫描驱动信号。
请参阅图5，其为如图4所示上拉薄膜晶体管与自举电容在阵列基板10c上平面结构示意图。
如图5所示，上拉薄膜晶体管T21与自举电容Cb沿着第一方向X相互平行设置。其中，自举电容Cb在第一方向X具有第一尺寸L1。上拉薄膜晶体管T21的栅极G与自举电容Cb的其中一个电极沿着第一方向X同层设置，上拉薄膜晶体管T21的源极S与自举电容Cb的另外一个电极沿着第一方向X同层设置。
进一步，请参阅图6，其为如图5所示沿着VI-VI线的剖面结构示意图。如图6所示，上拉薄膜晶体管21与自举电容Cb沿着第三方向Z层叠设置于阵列基板10c的基底GL表面。具体地，对上拉薄膜晶体管21而言，自基底GL表面开始，依次设置栅极G、栅极绝缘层GI、半导体层As、源极S与漏极D以及平坦化层PV，其中，源极S与漏极D间隔预定距离沿着第一方向X同层设置于对应半导体层As以及栅极绝缘层GI的表面。对自举电容Cb而言，其中一个电极P1由栅极G在第一方向X延伸形成，而另外一个电极P2则由源极S在栅极绝缘层GI表面沿着第一方向X延伸形成，栅极绝缘层GI作为自举电容Cb电极件的绝缘材料。
经过研究发现，自举电容Cb的电容值是保证扫描驱动信号正确输出的关键，这是因为自举电容Cb的电容值越大，结合电容不会不会突变的性能，自举电容Cb越能够保证扫描驱动信号的波形收到外部信号的干扰以及衰减，从而使得扫描驱动信号的波形接近理状态。但是，依据电容量的计算公式，自举电容Cb所具有的第一电容量C1＝Aε/d，其中，ε为两个电极之间介质的介电常数，A为极板面积，也即是为w1*L1，d为极板间的距离，也即是源极S与栅极D之间栅极绝缘层GI沿着第三方向Z的第一尺寸d1。为了使得自举电容Cb的电容值尽可能的大，就要求作为自举电容Cb的两个电极的面积A尽可能大以及电极之间的距离d尽可能小。另外，为了保证制程稳定性，使得上拉薄膜晶体管T21的工作性能较为稳定可靠，上拉薄膜晶体管T21的源极与栅极之间绝缘层就需要尽量大。如此，为了使得自举电容Cb的电容值尽可能大，就需要将自举电容Cb的两个电极的面积A做的更大，当电容在阵列基板10c沿着第二方向Y的尺寸固定时，就是的自举电容Cb沿着第一方向X的尺寸增大，从而导致了目前阵列基板10c与显示面板10非显示区域沿着第一方向X的尺寸无法减小，更无法满足窄边框的需求。
请一并参阅图7与图8，其为本发明第一实施例中如图4所示上拉薄膜晶体管与自举电容在阵列基板10c上平面结构示意图，图8为如图7所示沿着VIII-VIII线的剖面结构示意图。
如图7所示，上拉薄膜晶体管T21与自举电容Cb沿着第一方向X平行设置。其中，阵列基板10c对应上拉薄膜晶体管T21与电容自举Cb分别定义为第一区域A1与第二区域A2，第一区域A1与第二区域A2分别沿着第一方向X与第二方向Y延伸，并且第一区域A1与第二区域A2沿着垂直于基底GL方向在基底GL的投影基本无重叠。
对应第一区域A1，上拉薄膜晶体管T21沿着第三方向Z自基底GL表面依次层叠设置。对应第二区域A2，电容Cb沿着第三方向Z自基底GL表面依次层叠设置。
具体地，请参阅图8，对应第一区域A1，自基底GL表面开始，上拉薄膜晶体管T21的栅极G、栅极绝缘层GI、依次设置栅极G、作为第一绝缘层的栅极绝缘层GI、半导体层As、源极S与漏极D以及作为第二绝缘层的平坦化层PV，源极S与漏极D间隔预定距离同层设置于对应半导体层As的表面。其中，栅极绝缘层GI沿着第三方向Z具有第一尺寸d1。
对应第二区域A2，自基底GL表面开始，依次为栅极绝缘层GI、第一导电电极Pa，平坦化层PV以及第二导电电极Pb。其中，第一导电电极Pa与源极S同一层设置，也即是均设置于栅极绝缘层GI表面。第二导电电极Pb与第一导电电极Pa之间的平坦化层PV沿着第三方向Z具有第二尺寸d2，其中，d2＝1/2d1。第二导电电极Pb通过第一过孔H1与栅极G电性连接。对应源极S与第一导电电极Pa之间的位置，所述过孔H1自平坦化层PV表面开始贯穿平坦化层PV、栅极绝缘层GI直至抵达栅极G的表面。
进一步，第二导电电极Pb与第一导电电极Pa沿着第三方向Z在基底GL的投影重合，且第二导电电极Pb在基底GLI的投影面积大于第一导电电极Pa在基底GL的投影面积。另外，第二导电电极Pb与源极S与D漏极沿着第三方向Z在基底GL的投影无交叠。第一导电电极Pa与栅极G沿着第一方向X在基底GL的投影无交叠，也即本实施例中栅极G仅设置于第一区域A内，并不会延伸至第二区域A2中。
本实施例中，第一导电电极Pa的材料与源极S的材料相同，二者在同一制程中制作完成且相互电性连接。第二导电电极Pb的材料为氧化铟锡(Indium tin oxide，ITO)。栅极绝缘层GI与平坦化层PV均为绝缘材料构成。
第一导电电极Pa与第二导电电极Pb构成的电容结构具有第一电容值C1，且依据电容计算公式可知，C1＝A1ε/d2，由于A2＝w1*L2，d2＝1/2d1，在保证第一电容值C1不变的情况下，在每一个驱动单元SDi沿着第二方向Y的尺寸不变从而使得构成自举电容Cb沿着第二方向Y的尺寸w1保持固定尺寸时，每一个驱动单元SDi中自举电容Cb沿着第一方向X的尺寸L2为L1的1/2。由于第一方向X为阵列基板10c的宽度方向，从而有效缩小了阵列基板10c中非显示区域在第一方向X的尺寸，达到窄边框的目的。
可以理解，虽然本实施例中d2＝1/2d1，但是，可变更地，仅需保证平坦化层PV的第二尺寸d2小于栅极绝缘层GI的第一尺寸d1即可保证自举电容Cb沿着第一方向X的尺寸减小，进而达到窄边框的目的。
请一并参阅图9与图10，图9为本发明第二实施例中如图4所示上拉薄膜晶体管与自举电容在阵列基板10c上平面结构示意图，图10为如图9所示沿着X-X线的剖面结构示意图。
本实施例中，上拉薄膜晶体管T21与自举电容Cb的结构与第一实施例所示结构基本相同，区别仅在于栅极G的结构。具体地，栅极G自第一区域A1延伸至第二区域A2，并且第一导电电极Pa与栅极G沿着第三方向Z在基底GL的投影重合，且栅极G沿着第三方向Z在基底GL的投影完全覆盖第一导电电极Pa沿着第三方向Z在基底GL的投影。
此时，对于第二区域A2中的自举电容Cb而言，第一电容电极Pa与栅极G在第三方向Z构成第一子电容Ca，所述第一子电容的电容量为1/2C1；第二导电电极Pb与第一导电电极Pa在所述第三方向Z构成第二子电容Cb，所述第一子电容与所述第二子电容在所述第三方向Z并联，所述第二子电容Cb的电容量如第一实施方式所述为C1；且Ca+Cb＝3/2C1。如此可见，在本实施例中，在减小了自举电容Cb沿第一方向X的尺寸同时还提高了电容量，也即是在达成减小非显示区域的面积同时还能够有效保证扫描驱动信号的驱动特性。
请一并参阅图11与图12，图11为本发明第三实施例中如图4所示上拉薄膜晶体管与自举电容在阵列基板10c上平面结构示意图，图12为如图11所示沿着XII-XII线的剖面结构示意图。
本实施例中，上拉薄膜晶体管T21与自举电容Cb的结构与第一实施例基本相同，区别仅在于上拉薄膜晶体管T21与自举电容Cb在第一区域A1层叠设置，完全省略了先前技术以及第一实施例、第二实施例中的第二区域A2。
具体地，源极S同时作为所述第一导电电极Pa。第二导电电极Pb对应源极S、漏极D的位置设置于平坦化层PV的表面，也即是，第二导电电极Pb沿着第三方向Z在基底GL的投影覆盖源极S、漏极G以及栅极G沿着所述第三方向在基底GL的投影。其中，源极S与所述第二导电电极Pb构成的电容结构具有第一电容值C1。
本实施例中，上拉薄膜晶体管T21与自举电容Cb公用一个区域，也即是相较于图5中的阵列基板10c而言，完全省略了自举电容Cb所占用的区域，更大程度地减小了自举电容Cb所占用的阵列基板10c的非显示区的沿着第一方向的尺寸，从而使得阵列基板更容易实现窄边框的目标。
请一并参阅图13与图14，图13为本发明第四实施例中如图4所示上拉薄膜晶体管与自举电容在阵列基板10c上平面结构示意图，图14为如图11所示沿着XIV-XIV线的剖面结构示意图。
本实施例中，上拉薄膜晶体管T21与自举电容Cb的结构与第三实施例中基本相同，区别仅在于第二导电电极Pb的结构。
具体地，源极S同时作为所述第一导电电极Pa。第二导电电极Pb仅对应源极S的位置设置于平坦化层PV的表面，而并未延伸至漏极D对应的平坦化层PV的表面。也即是，第二导电电极Pb、源极S以及栅极G沿着第三方向Z在基底GL的投影重合，并且，第二导电电极Pb与漏极D沿着第三方向Z在基底GL的投影无交叠。其中，源极S与所述第二导电电极Pb构成的电容结构具有第一电容值C1。
本实施例中，第二导电电极Pb并未在第三方向覆盖上拉薄膜晶体管T21的漏极D，从而能够有效减小第二导电电极Pb与漏极D之间的电容，以避免增加上拉薄膜晶体管T21的额外功耗，增加上拉薄膜晶体管T21的工作稳定性。
以上所述的实施方式，并不构成对该技术方案保护范围的限定。任何在上述实施方式的精神和原则之内所作的修改、等同替换和改进等，均应包含在该技术方案的保护范围之内。

Claims (8)

1.一种扫描驱动电路，所述扫描驱动电路包括设置于基底表面的上拉单元与自举单元，所述上拉单元包括用于输出扫描驱动信号的上拉薄膜晶体管，所述自举单元包括电性连接于所述上拉薄膜晶体管，且用于维持所述扫描驱动信号稳定的自举电容，其特征在于：
上拉薄膜晶体管包括自基底表面依次层叠设置的栅极、第一绝缘层、源极与漏极，所述源极与所述漏极沿着第一方向间隔预定距离设置；
自举电容包括第一导电电极与第二导电电极，所述上拉薄膜晶体管与所述自举电容沿着第三方向层叠设置于所述基底上，所述第一方向与所述第三方向相互垂直，且所述第三方向与所述基底所在平面垂直，所述上拉薄膜晶体管的所述源极与所述自举电容的所述第一导电电极为同一个导电电极，且所述上拉薄膜晶体管的所述源极同时作为所述自举电容的第一导电电极；
所述第二导电电极与所述第一导电电极之间设有第二绝缘层，所述第二绝缘层覆盖于所述第一导电电极表面，所述第二导电电极通过第一过孔与所述栅极电性连接，所述第一过孔贯穿所述第二绝缘层与所述第一绝缘层，且所述第二导电电极直接部分覆盖并设置于所述第二绝缘层表面。
2.根据权利要求1所述的扫描驱动电路，其特征在于，所述栅极与所述源极之间的所述第一绝缘层沿着第三方向具有第一尺寸，所述第一导电电极与所述第二导电电极之间的所述第二绝缘层沿着第三方向具有第二尺寸，所述第二尺寸小于所述第一尺寸。
3.根据权利要求2所述的扫描驱动电路，其特征在于，所述第一导电电极与所述栅极在第三方向构成第一子电容，所述第二导电电极与所述第一导电电极在所述第三方向构成第二子电容，所述第一子电容与所述第二子电容在所述第三方向并联。
4.根据权利要求2所述的扫描驱动电路，其特征在于，所述第二导电电极沿着第三方向在所述基底的投影覆盖所述源极、所述漏极以及所述栅极沿着所述第三方向在所述基底的投影。
5.根据权利要求2所述的扫描驱动电路，其特征在于，所述第二导电电极、所述源极以及所述栅极沿着所述第三方向在所述基底的投影重合，所述第二导电电极与所述漏极沿着第三方向在所述基底的投影无交叠。
6.根据权利要求2-5任意一项所述的扫描驱动电路，其特征在于，所述第二尺寸为所述第一尺寸的1/2。
7.一种阵列基板，其特征在于，包括显示区与非显示区，所述显示区包括多条扫描线与数据线，其中，所述扫描线沿着所述第一方向延伸并且沿着第二方向间隔预定距离相互绝缘排列设置，所述数据线沿所述第二方向延伸并且沿着第一方向间隔预定距离相互绝缘排列设置，所述多条扫描线与所述数据线交叉处形成像素单元，所述非显示区设置有权利要求6所述的扫描驱动电路，所述扫描驱动电路电性连接所述扫描线，用于输出所述扫描驱动信号至所述像素单元，所述第一方向、所述第二方向以及所述第三方向相互垂直。
8.一种显示面板，其特征在于，包括相对设置的对向基板与权利要求7所述的阵列基板，且所述对向基板与所述阵列基板之间夹设有显示介质。
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