CN107068560A - 可重构环形天线中基于台状有源区pin二极管串的制备方法 - Google Patents
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- 238000002360 preparation method Methods 0.000 title claims abstract description 27
- 238000000034 method Methods 0.000 claims abstract description 78
- 239000000758 substrate Substances 0.000 claims abstract description 52
- 239000000463 material Substances 0.000 claims abstract description 40
- 238000001259 photo etching Methods 0.000 claims abstract description 27
- 230000015572 biosynthetic process Effects 0.000 claims abstract description 24
- 238000011065 in-situ storage Methods 0.000 claims abstract description 19
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims abstract description 14
- 238000005530 etching Methods 0.000 claims abstract description 7
- 239000011241 protective layer Substances 0.000 claims description 43
- 239000010410 layer Substances 0.000 claims description 38
- 238000005516 engineering process Methods 0.000 claims description 21
- 239000002184 metal Substances 0.000 claims description 15
- 238000001039 wet etching Methods 0.000 claims description 13
- 239000004065 semiconductor Substances 0.000 claims description 9
- 238000004544 sputter deposition Methods 0.000 claims description 6
- 239000012535 impurity Substances 0.000 claims description 5
- 238000002161 passivation Methods 0.000 claims description 5
- 229910021332 silicide Inorganic materials 0.000 claims description 4
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 claims description 4
- 238000000137 annealing Methods 0.000 claims description 3
- 239000007769 metal material Substances 0.000 claims description 3
- 230000003647 oxidation Effects 0.000 claims description 3
- 238000007254 oxidation reaction Methods 0.000 claims description 3
- 229920005591 polysilicon Polymers 0.000 claims description 3
- 239000007787 solid Substances 0.000 abstract description 12
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 11
- 229910052581 Si3N4 Inorganic materials 0.000 description 7
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 7
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 6
- 238000005229 chemical vapour deposition Methods 0.000 description 6
- 238000010586 diagram Methods 0.000 description 6
- 229910052710 silicon Inorganic materials 0.000 description 6
- 239000010703 silicon Substances 0.000 description 6
- 238000011160 research Methods 0.000 description 5
- 238000004891 communication Methods 0.000 description 4
- 238000009826 distribution Methods 0.000 description 4
- 239000000377 silicon dioxide Substances 0.000 description 4
- 238000000151 deposition Methods 0.000 description 3
- 150000002500 ions Chemical class 0.000 description 3
- 238000012545 processing Methods 0.000 description 3
- 230000004913 activation Effects 0.000 description 2
- 230000009286 beneficial effect Effects 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 2
- 229910052681 coesite Inorganic materials 0.000 description 2
- 229910052906 cristobalite Inorganic materials 0.000 description 2
- 230000007812 deficiency Effects 0.000 description 2
- 230000008021 deposition Effects 0.000 description 2
- 238000013461 design Methods 0.000 description 2
- 238000001459 lithography Methods 0.000 description 2
- 229910052752 metalloid Inorganic materials 0.000 description 2
- 150000002738 metalloids Chemical class 0.000 description 2
- 239000000203 mixture Substances 0.000 description 2
- 230000011514 reflex Effects 0.000 description 2
- 235000012239 silicon dioxide Nutrition 0.000 description 2
- 229910052682 stishovite Inorganic materials 0.000 description 2
- 229910052905 tridymite Inorganic materials 0.000 description 2
- 230000006978 adaptation Effects 0.000 description 1
- 230000002411 adverse Effects 0.000 description 1
- 238000005275 alloying Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- 230000005670 electromagnetic radiation Effects 0.000 description 1
- 238000003384 imaging method Methods 0.000 description 1
- 238000002513 implantation Methods 0.000 description 1
- 238000002347 injection Methods 0.000 description 1
- 239000007924 injection Substances 0.000 description 1
- 239000012212 insulator Substances 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66083—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by variation of the electric current supplied or the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched, e.g. two-terminal devices
- H01L29/6609—Diodes
-
- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/86—Types of semiconductor device ; Multistep manufacturing processes therefor controllable only by variation of the electric current supplied, or only the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched
- H01L29/861—Diodes
- H01L29/868—PIN diodes
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01Q—ANTENNAS, i.e. RADIO AERIALS
- H01Q1/00—Details of, or arrangements associated with, antennas
- H01Q1/12—Supports; Mounting means
- H01Q1/22—Supports; Mounting means by structural association with other equipment or articles
- H01Q1/2283—Supports; Mounting means by structural association with other equipment or articles mounted in or on the surface of a semiconductor substrate as a chip-type antenna or integrated with other components into an IC package
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- H01—ELECTRIC ELEMENTS
- H01Q—ANTENNAS, i.e. RADIO AERIALS
- H01Q1/00—Details of, or arrangements associated with, antennas
- H01Q1/36—Structural form of radiating elements, e.g. cone, spiral, umbrella; Particular materials used therewith
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- H01—ELECTRIC ELEMENTS
- H01Q—ANTENNAS, i.e. RADIO AERIALS
- H01Q7/00—Loop antennas with a substantially uniform current distribution around the loop and having a directional radiation pattern in a plane perpendicular to the plane of the loop
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- Engineering & Computer Science (AREA)
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- Power Engineering (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Physics & Mathematics (AREA)
- Ceramic Engineering (AREA)
- Computer Hardware Design (AREA)
- Manufacturing & Machinery (AREA)
- Element Separation (AREA)
- Semiconductor Integrated Circuits (AREA)
- Variable-Direction Aerials And Aerial Arrays (AREA)
- Waveguide Aerials (AREA)
Abstract
本发明涉及一种可重构环形天线中基于台状有源区PIN二极管串的制备方法。该制备方法包括：(a)选取SOI衬底；(b)刻蚀SOI衬底形成台状有源区；(c)对所述台状有源区四周利用原位掺杂工艺分别淀积P型Si材料和N型Si材料形成P区和N区；(d)在所述台状有源区四周淀积多晶Si材料；(e)在所述多晶Si材料表面制作引线并光刻PAD以形成所述PIN二极管。本发明实施例利用原位掺杂工艺能够制备并提供适用于形成固态等离子天线的高性能基于台状有源区的PIN二极管串。
Description
技术领域
本发明涉及半导体器件制造技术领域，特别涉及一种可重构环形天线中基于台状有源区PIN二极管串的制备方法。
背景技术
传统金属天线由于其重量和体积都相对较大，设计制作不灵活，自重构性和适应性较差，严重制约了雷达与通信系统的发展和性能的进一步提高。因此，近年来，研究天线宽频带、小型化、以及重构与复用的理论日趋活跃。
在这种背景下，研究人员提出了一种新型天线概念-等离子体天线，该天线是一种将等离子体作为电磁辐射导向媒质的射频天线。等离子体天线的可利用改变等离子体密度来改变天线的瞬时带宽、且具有大的动态范围；还可以通过改变等离子体谐振、阻抗以及密度等，调整天线的频率、波束宽度、功率、增益和方向性动态参数；另外，等离子体天线在没有激发的状态下，雷达散射截面可以忽略不计，而天线仅在通信发送或接收的短时间内激发，提高了天线的隐蔽性，这些性质可广泛的应用于各种侦察、预警和对抗雷达，星载、机载和导弹天线，微波成像天线，高信噪比的微波通信天线等领域，极大地引起了国内外研究人员的关注，成为了天线研究领域的热点。
但是当前绝大多数的研究只限于气态等离子体天线，对固态等离子体天线的研究几乎还是空白。而固态等离子体一般存在于半导体器件中，无需像气态等离子那样用介质管包裹，具有更好的安全性和稳定性。经理论研究发现，PIN二极管在加直流偏压时，直流电流会在其表面形成自由载流子(电子和空穴)组成的固态等离子体，该等离子体具有类金属特性，即对电磁波具有反射作用，其反射特性与表面等离子体的微波传输特性、浓度及分布密切相关。
因此，如何制作一种PIN二极管来应用于可重构环形天线就变得尤为重要。
发明内容
因此，为解决现有技术存在的技术缺陷和不足，本发明提出一种可重构环形天线中基于台状有源区PIN二极管串的制备方法。
具体地，本发明实施例提出的一种可重构环形天线中基于台状有源区PIN二极管串的制备方法，所述PIN二极管用于制作可重构环形天线，所述环形天线包括：半导体基片(1)；介质板(2)；第一PIN二极管环(3)、第二PIN二极管环(4)、第一直流偏置线(5)及第二直流偏置线(6)，均设置于所述半导体基片(1)上；耦合式馈源(7)，设置于所述介质板(2)上。
所述制备方法包括步骤：
(a)选取SOI衬底；
(b)刻蚀SOI衬底形成台状有源区；
(c)对所述台状有源区四周利用原位掺杂工艺分别淀积P型Si材料和N型Si材料形成P区和N区；
(d)利用CVD工艺，在所述台状有源区四周淀积所述多晶Si材料；
(e)利用CVD工艺，在整个衬底表面淀积第四保护层；
(f)利用退火工艺激活所述P区和所述N区中的杂质；
(g)在所述多晶Si材料表面制作引线并光刻PAD以形成所述PIN二极管串。
在本发明的一个实施例中，步骤(b)包括：
(b1)利用CVD工艺，在所述SOI衬底表面形成第一保护层；
(b2)采用第一掩膜版，利用光刻工艺在所述第一保护层上形成有源区图形；
(b3)利用干法刻蚀工艺，对所述有源区图形的指定位置四周刻蚀所述第一保护层及所述SOI衬底的顶层Si层从而形成有所述台状有源区。
在本发明的一个实施例中，步骤(b)之后，还包括：
(x1)利用氧化工艺，对所述台状有源区的侧壁进行氧化以在所述台状有源区侧壁形成氧化层；
(x2)利用湿法刻蚀工艺刻蚀所述氧化层以完成对所述台状有源区侧壁的平整化处理。
在本发明的一个实施例中，步骤(c)包括：
(c1)在整个衬底表面淀积第二保护层；
(c2)采用第二掩膜板，利用光刻工艺在所述第二保护层表面形成P区图形；
(c3)利用湿法刻蚀工艺去除P区图形上的所述第二保护层；
(c4)利用原位掺杂工艺，在所述台状有源区侧壁淀积P型Si材料形成所述P区；
(c5)在整个衬底表面淀积第三保护层；
(c6)采用第三掩膜板，利用光刻工艺在所述第三保护层表面形成N区图形；
(c7)利用湿法刻蚀工艺去除N区图形上的所述第三保护层；
(c8)利用原位掺杂工艺，在所述台状有源区侧壁淀积N型Si材料形成所述N区。
在本发明的一个实施例中，步骤(c4)包括：
(c41)利用原位掺杂工艺，在所述台状有源区侧壁淀积P型Si材料；
(c42)采用第四掩膜版，利用干法刻蚀工艺刻蚀所述P型Si材料以在所述台状有源区的侧壁形成所述P区；
(c43)利用选择性刻蚀工艺去除整个衬底表面的所述第二保护层。
在本发明的一个实施例中，步骤(c8)包括：
(c81)利用原位掺杂工艺，在所述台状有源区侧壁淀积N型Si材料；
(c82)采用第五掩膜版，利用干法刻蚀工艺刻蚀所述N型Si材料以在所述台状有源区的另一侧壁形成所述N区；
(c83)利用选择性刻蚀工艺去除整个衬底表面的所述第三保护层。
在本发明的一个实施例中，步骤(g)包括：
(g1)采用第六掩膜版，利用光刻工艺在所述第四保护层表面形成引线孔图形；
(g2)利用各向异性刻蚀工艺刻蚀所述第四保护层漏出部分所述多晶Si材料以形成所述引线孔；
(g3)对所述引线孔溅射金属材料以形成金属硅化物；
(g4)钝化处理并光刻PAD，最终互连以形成所述PIN二极管串。
在本发明的一个实施例中，所述第一等离子PIN二极管环(3)包括第一等离子PIN二极管串(8)，所述第二等离子PIN二极管环(4)包括第二等离子PIN二极管串(9)，且所述第一等离子PIN二极管环(3)及所述第二等离子PIN二极管环(4)的周长等于其所要接收信号的电磁波波长。
在本发明的一个实施例中，在所述第一等离子PIN二极管串(8)及所述第二等离子PIN二极管串(9)两端设置有第一直流偏置线(5)及第二直流偏置线(6)，所述第一直流偏置线(5)及所述第二直流偏置线(6)采用重掺杂多晶硅制作在所述半导体基片上 (1)。
在本发明的一个实施例中，所述耦合式馈源(7)制作在所述介质板(2)上且其上表面为金属微带贴片(10)，下表面为金属接地板(11)，所述金属微带贴片(10)包括主枝节(12)、第一分枝节(13)及第二分枝节(14)。
由上可知，本发明实施例通过采用原位掺杂能够避免离子注入等方式带来的不利影响，且能够通过控制气体流量来控制材料的掺杂浓度，更有利于获得陡峭的掺杂界面，从而获得更好的器件性能。该PIN二极管等离子可重构天线可以是由SOI基PIN 二极管按阵列排列组合而成，利用外部控制阵列中的PIN二极管选择性导通，使该阵列形成动态固态等离子体条纹、具备天线的功能，对特定电磁波具有发射和接收功能，并且该天线可通过阵列中PIN二极管的选择性导通，改变固态等离子体条纹形状及分布，从而实现天线的重构，在国防通讯与雷达技术方面具有重要的应用前景。
通过以下参考附图的详细说明，本发明的其它方面和特征变得明显。但是应当知道，该附图仅仅为解释的目的设计，而不是作为本发明的范围的限定，这是因为其应当参考附加的权利要求。还应当知道，除非另外指出，不必要依比例绘制附图，它们仅仅力图概念地说明此处描述的结构和流程。
附图说明
下面将结合附图，对本发明的具体实施方式进行详细的说明。
图1为本发明实施例的一种可重构环形天线的结构示意图；
图2为本发明实施例的一种可重构环形天线中基于台状有源区的PIN二极管串的制作方法流程图；
图3为本发明实施例提供的一种可重构环形天线的半导体基片结构示意图；
图4为本发明实施例提供的一种环形天线的介质板结构示意图；
图5为本发明实施例提供的一种可重构环形天线中基于台状有源区的PIN二极管的结构示意图；
图6为本发明实施例提供的一种可重构环形天线中基于台状有源区的PIN二极管串的结构示意图；
图7a-图7s为本发明实施例的另一种可重构环形天线中基于台状有源区的PIN 二极管的制备方法示意图；
图8为本发明实施例的另一种可重构环形天线中基于台状有源区的PIN二极管的器件结构示意图。
具体实施方式
为使本发明的上述目的、特征和优点能够更加明显易懂，下面结合附图对本发明的具体实施方式做详细的说明。
本发明提出了一种适用于形成可重构环形天线的基于台状有源区的PIN二极管的制备方法。该PIN二极管可以是基于绝缘衬底上的硅(Silicon-On-Insulator，简称 SOI)形成横向PIN二极管，其在加直流偏压时，直流电流会在其表面形成自由载流子(电子和空穴)组成的固态等离子体，该等离子体具有类金属特性，即对电磁波具有反射作用，其反射特性与表面等离子体的微波传输特性、浓度及分布密切相关。
以下，将对本发明制备的可重构环形天线中基于台状有源区的PIN二极管串的工艺流程作进一步详细描述。在图中，为了方便说明，放大或缩小了层和区域的厚度，所示大小并不代表实际尺寸。
实施例一
请参见图2，图2为本发明实施例的一种可重构环形天线中基于台状有源区的 PIN二极管串的制作方法流程图，该方法适用于制备基于SOI横向PIN二极管，且该基于台状有源区的PIN二极管主要用于制作可重构环形天线。该方法包括如下步骤：
(a)选取SOI衬底；
其中，对于步骤(a)，采用SOI衬底的原因在于，对于固态等离子天线由于其需要良好的微波特性，而PIN二极管为了满足这个需求，需要具备良好的载流子即固态等离子体的限定能力，而二氧化硅(SiO2)能够将载流子即固态等离子体限定在顶层硅中，所以优选采用SOI作为PIN二极管的衬底。
(b)刻蚀SOI衬底形成台状有源区；
(c)对所述台状有源区四周利用原位掺杂工艺分别淀积P型Si材料和N型Si材料形成P区和N区；
(d)利用CVD工艺，在所述台状有源区四周淀积所述多晶Si材料；
(e)利用CVD工艺，在整个衬底表面淀积第四保护层；
(f)利用退火工艺激活所述P区和所述N区中的杂质；
(g)在所述多晶Si材料表面制作引线并光刻PAD以形成所述PIN二极管串。
在本发明的一个实施例中，步骤(b)包括：
(b1)利用CVD工艺，在所述SOI衬底表面形成第一保护层；
(b2)采用第一掩膜版，利用光刻工艺在所述第一保护层上形成有源区图形；
(b3)利用干法刻蚀工艺，对所述有源区图形的指定位置四周刻蚀所述第一保护层及所述SOI衬底的顶层Si层从而形成有所述台状有源区。
在本发明的一个实施例中，步骤(b)之后，还包括：
(x1)利用氧化工艺，对所述台状有源区的侧壁进行氧化以在所述台状有源区侧壁形成氧化层；
(x2)利用湿法刻蚀工艺刻蚀所述氧化层以完成对所述台状有源区侧壁的平整化处理。
这样做的好处在于：可以防止沟槽侧壁的突起形成电场集中区域，造成Pi和Ni 结击穿。
在本发明的一个实施例中，步骤(c)包括：
(c1)在整个衬底表面淀积第二保护层；
(c2)采用第二掩膜板，利用光刻工艺在所述第二保护层表面形成P区图形；
(c3)利用湿法刻蚀工艺去除P区图形上的所述第二保护层；
(c4)利用原位掺杂工艺，在所述台状有源区侧壁淀积P型Si材料形成所述P区；
(c5)在整个衬底表面淀积第三保护层；
(c6)采用第三掩膜板，利用光刻工艺在所述第三保护层表面形成N区图形；
(c7)利用湿法刻蚀工艺去除N区图形上的所述第三保护层；
(c8)利用原位掺杂工艺，在所述台状有源区侧壁淀积N型Si材料形成所述N区。
需要说明的是：常规制作PIN二极管的P区与N区的制备工艺中，均采用注入工艺形成，此方法要求注入剂量和能量较大，对设备要求高，且与现有工艺不兼容；而采用扩散工艺，虽结深较深，但同时P区与N区的面积较大，集成度低，掺杂浓度不均匀，影响PIN二极管的电学性能，导致固态等离子体浓度和分布的可控性差。
采用原位掺杂能够避免离子注入等方式带来的不利影响，且能够通过控制气体流量来控制材料的掺杂浓度，更有利于获得陡峭的掺杂界面，从而获得更好的器件性能。
在本发明的一个实施例中，步骤(c4)包括：
(c41)利用原位掺杂工艺，在所述台状有源区侧壁淀积P型Si材料；
(c42)采用第四掩膜版，利用干法刻蚀工艺刻蚀所述P型Si材料以在所述台状有源区的侧壁形成所述P区；
(c43)利用选择性刻蚀工艺去除整个衬底表面的所述第二保护层。
在本发明的一个实施例中，步骤(c8)包括：
(c81)利用原位掺杂工艺，在所述台状有源区侧壁淀积N型Si材料；
(c82)采用第五掩膜版，利用干法刻蚀工艺刻蚀所述N型Si材料以在所述台状有源区的另一侧壁形成所述N区；
(c83)利用选择性刻蚀工艺去除整个衬底表面的所述第三保护层。
在本发明的一个实施例中，步骤(g)包括：
(g1)采用第六掩膜版，利用光刻工艺在所述第四保护层表面形成引线孔图形；
(g2)利用各向异性刻蚀工艺刻蚀所述第四保护层漏出部分所述多晶Si材料以形成所述引线孔；
(g3)对所述引线孔溅射金属材料以形成金属硅化物；
(g4)钝化处理并光刻PAD，最终互连以形成所述PIN二极管串。
本发明实施例利用原位掺杂工艺能够制备并提供适用于形成固态等离子天线的高性能基于台状有源区的PIN二极管。
实施例二
请参见图7a-图7s，图7a-图7s为本发明实施例的另一种可重构环形天线中基于台状有源区的PIN二极管的制备方法示意图，在上述实施例一的基础上，以制备固态等离子区域长度为100微米的基于台状有源区的PIN二极管为例进行详细说明，具体步骤如下：
S10、选取SOI衬底。
请参见图7a，该SOI衬底101的晶向为(100)，另外，该SOI衬底101的掺杂类型为p型，掺杂浓度为1014cm-3的，顶层Si的厚度例如为20μm。
S20、在所述SOI衬底表面淀积一层氮化硅。
请参见图7b，采用化学气相沉积(Chemical vapor deposition，简称CVD)的方法，在SOI衬底101上淀积氮化硅层201。
S30、刻蚀SOI衬底形成有源区沟槽。
请参见图7c-1，利用光刻工艺在所述氮化硅层上形成台面有源区图形，利用干法刻蚀工艺在所述有源区图形的指定位置处刻蚀所述保护层及顶层硅从而形成台面有源区301，俯视图请参见图7c-2。
S40、台面的有源区四周平坦化处理。
请参见图7d-1，氧化所述台面有源区的四周侧壁以使所述台面有源区的四周侧壁形成氧化层401，俯视图请参见图7d-2；
请参见图7e-1，利用湿法刻蚀工艺刻蚀所述台面有源区的四周侧壁氧化层以完成所述台面有源区的四周侧壁平坦化，俯视图请参见7e-2。
S50、在所述衬底表面淀积一层SiO2。
请参见图7f，利用CVD方法在所述衬底上淀积一层二氧化硅601。
S60、光刻所述SiO2层。
请参见图7g，利用光刻工艺在所述SiO2层上形成P区图形，利用湿法刻蚀工艺去除P区图形上的SiO2层。
S70、形成P区。
请参见图7h，具体做法可以是：利用原位掺杂的方法，在所述SOI衬底表面的 P区图形上淀积p型硅形成P区801，通过控制气体流量来控制P区的掺杂浓度。
S80、平整化衬底表面。
请参见图7i，具体做法可以是：先利用干法刻蚀工艺使P区表面平整化，再利用湿法刻蚀工艺去除衬底表面的SiO2层。
S90、在所述衬底表面淀积一层SiO2。
请参见图7j，具体做法可以是：利用CVD方法在所述衬底表面淀积二氧化硅层1001。
S100、光刻所述SiO2层。
请参见图7k，利用光刻工艺在所述SiO2层上形成N区图形；利用湿法刻蚀工艺去除N区上的SiO2层。
S110、形成N区。
请参见图7l，利用原位掺杂的方法，在所述SOI衬底表面的N区图形上淀积n 型硅形成N区1201，通过控制气体流量来控制N区的掺杂浓度。
S120、平整化衬底表面。
请参见图7m，先利用干法刻蚀工艺使N区表面平整化，再利用湿法刻蚀工艺去除衬底表面的SiO2层。
S130、淀积多晶硅层。
请参见图7n，可以利用CVD的方法，在沟槽里溅射金属层1401。
S140、在表面形成二氧化硅(SiO2)层。
请参照图7o，可以利用CVD的方法，在表面淀积二氧化硅(SiO2)层1501，厚度为500nm。
S150、平整表面。
请参照图7p，可以采用CMP方法去除表面二氧化硅与氮化硅(SiN)层，使表面平整。
S160、杂质激活。
在950-1150℃，退火0.5～2分钟，使离子注入的杂质激活、并且推进有源区中杂质。
S170、光刻引线孔。
请参照图7q，在二氧化硅(SiO2)层上光刻引线孔1701。
S180、形成引线。
请参照图7r，可以在衬底表面溅射金属，合金化形成金属硅化物，并刻蚀掉表面的金属；再在衬底表面溅射金属1801，光刻引线。
S190、钝化处理，光刻PAD。
请参照图7s，可以通过淀积氮化硅(SiN)形成钝化层1901，光刻PAD。最终形成 PIN二极管，作为制备固态等离子天线材料。
实施例三
请参照图8，图8为本发明实施例的另一种可重构环形天线中基于台状有源区的PIN二极管的器件结构示意图。该PIN二极管采用上述如图2所示的制备方法制成。具体地，该PIN二极管在SOI衬底301上制备形成，且PIN二极管的P区303、N 区304以及横向位于该P区303和该N区304之间的I区均位于该SOI衬底的顶层硅302内。
综上所述，本文中应用了具体个例对本发明PIN二极管及其制备方法的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本发明的方法及其核心思想；同时，对于本领域的一般技术人员，依据本发明的思想，在具体实施方式及应用范围上均会有改变之处，综上所述，本说明书内容不应理解为对本发明的限制，本发明的保护范围应以所附的权利要求为准。
Claims (10)
1.一种可重构环形天线中基于台状有源区PIN二极管串的制备方法，其特征在于，所述PIN二极管用于制作可重构环形天线，所述环形天线包括：半导体基片(1)；介质板(2)；第一PIN二极管环(3)、第二PIN二极管环(4)、第一直流偏置线(5)及第二直流偏置线(6)，均设置于所述半导体基片(1)上；耦合式馈源(7)，设置于所述介质板(2)上。
所述制备方法包括步骤：
(a)选取SOI衬底；
(b)刻蚀SOI衬底形成台状有源区；
(c)对所述台状有源区四周利用原位掺杂工艺分别淀积P型Si材料和N型Si材料形成P区和N区；
(d)利用CVD工艺，在所述台状有源区四周淀积所述多晶Si材料；
(e)利用CVD工艺，在整个衬底表面淀积第四保护层；
(f)利用退火工艺激活所述P区和所述N区中的杂质；
(g)在所述多晶Si材料表面制作引线并光刻PAD以形成所述PIN二极管串。
2.如权利要求1所述的制备方法，其特征在于，步骤(b)包括：
(b1)利用CVD工艺，在所述SOI衬底表面形成第一保护层；
(b2)采用第一掩膜版，利用光刻工艺在所述第一保护层上形成有源区图形；
(b3)利用干法刻蚀工艺，对所述有源区图形的指定位置四周刻蚀所述第一保护层及所述SOI衬底的顶层Si层从而形成有所述台状有源区。
3.如权利要求1所述的制备方法，其特征在于，步骤(b)之后，还包括：
(x1)利用氧化工艺，对所述台状有源区的侧壁进行氧化以在所述台状有源区侧壁形成氧化层；
(x2)利用湿法刻蚀工艺刻蚀所述氧化层以完成对所述台状有源区侧壁的平整化处理。
4.如权利要求1所述的制备方法，其特征在于，步骤(c)包括：
(c1)在整个衬底表面淀积第二保护层；
(c2)采用第二掩膜板，利用光刻工艺在所述第二保护层表面形成P区图形；
(c3)利用湿法刻蚀工艺去除P区图形上的所述第二保护层；
(c4)利用原位掺杂工艺，在所述台状有源区侧壁淀积P型Si材料形成所述P区；
(c5)在整个衬底表面淀积第三保护层；
(c6)采用第三掩膜板，利用光刻工艺在所述第三保护层表面形成N区图形；
(c7)利用湿法刻蚀工艺去除N区图形上的所述第三保护层；
(c8)利用原位掺杂工艺，在所述台状有源区侧壁淀积N型Si材料形成所述N区。
5.如权利要求4所述的制备方法，其特征在于，步骤(c4)包括：
(c41)利用原位掺杂工艺，在所述台状有源区侧壁淀积P型Si材料；
(c42)采用第四掩膜版，利用干法刻蚀工艺刻蚀所述P型Si材料以在所述台状有源区的侧壁形成所述P区；
(c43)利用选择性刻蚀工艺去除整个衬底表面的所述第二保护层。
6.如权利要求4所述的制备方法，其特征在于，步骤(c8)包括：
(c81)利用原位掺杂工艺，在所述台状有源区侧壁淀积N型Si材料；
(c82)采用第五掩膜版，利用干法刻蚀工艺刻蚀所
述N型Si材料以在所述台状有源区的另一侧壁形成所述N区；
(c83)利用选择性刻蚀工艺去除整个衬底表面的所述第三保护层。
7.如权利要求7所述的制备方法，其特征在于，步骤(g)包括：
(g1)采用第六掩膜版，利用光刻工艺在所述第四保护层表面形成引线孔图形；
(g2)利用各向异性刻蚀工艺刻蚀所述第四保护层漏出部分所述多晶Si材料以形成所述引线孔；
(g3)对所述引线孔溅射金属材料以形成金属硅化物；
(g4)钝化处理并光刻PAD，最终互连以形成所述PIN二极管串。
8.如权利要求1所述的制备方法，其特征在于，所述第一等离子PIN二极管环(3)包括第一等离子PIN二极管串(8)，所述第二等离子PIN二极管环(4)包括第二等离子PIN二极管串(9)，且所述第一等离子PIN二极管环(3)及所述第二等离子PIN二极管环(4)的周长等于其所要接收信号的电磁波波长。
9.如权利要求1所述的制备方法，其特征在于，在所述第一等离子PIN二极管串(8)及所述第二等离子PIN二极管串(9)两端设置有第一直流偏置线(5)及第二直流偏置线(6)，所述第一直流偏置线(5)及所述第二直流偏置线(6)采用重掺杂多晶硅制作在所述半导体基片上(1)。
10.根据权利要求1所述的环形天线，其特征在于，所述耦合式馈源(7)制作在所述介质板(2)上且其上表面为金属微带贴片(10)，下表面为金属接地板(11)，所述金属微带贴片(10)包括主枝节(12)、第一分枝节(13)及第二分枝节(14)。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201611184336.3A CN107068560B (zh) | 2016-12-20 | 2016-12-20 | 可重构环形天线中基于台状有源区pin二极管串的制备方法 |
| JP2019534816A JP2020503683A (ja) | 2016-12-20 | 2017-12-09 | リファクタリングが可能な環状アンテナの台状アクティブリージョンによるｐｉｎダイオード組の製造方法 |
| PCT/CN2017/115358 WO2018113542A1 (zh) | 2016-12-20 | 2017-12-09 | 可重构环形天线中基于台状有源区pin二极管串的制备方法 |
| US15/854,054 US10665689B2 (en) | 2016-12-20 | 2017-12-26 | Preparation method for platform-shaped active region based P-I-N diode string in reconfigurable loop antenna |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201611184336.3A CN107068560B (zh) | 2016-12-20 | 2016-12-20 | 可重构环形天线中基于台状有源区pin二极管串的制备方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| CN107068560A true CN107068560A (zh) | 2017-08-18 |
| CN107068560B CN107068560B (zh) | 2018-11-27 |
Family
ID=59619132
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| CN201611184336.3A Active CN107068560B (zh) | 2016-12-20 | 2016-12-20 | 可重构环形天线中基于台状有源区pin二极管串的制备方法 |
Country Status (3)
| Country | Link |
|---|---|
| JP (1) | JP2020503683A (zh) |
| CN (1) | CN107068560B (zh) |
| WO (1) | WO2018113542A1 (zh) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2018113542A1 (zh) * | 2016-12-20 | 2018-06-28 | 西安科锐盛创新科技有限公司 | 可重构环形天线中基于台状有源区pin二极管串的制备方法 |
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| CN102956993A (zh) * | 2012-11-14 | 2013-03-06 | 华南理工大学 | 基于s-pin二极管的方向图可重构圆盘型微带天线 |
| CN103682610A (zh) * | 2013-12-06 | 2014-03-26 | 中国科学院深圳先进技术研究院 | 可重构天线及其系统 |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN107068560B (zh) * | 2016-12-20 | 2018-11-27 | 西安科锐盛创新科技有限公司 | 可重构环形天线中基于台状有源区pin二极管串的制备方法 |
-
2016
- 2016-12-20 CN CN201611184336.3A patent/CN107068560B/zh active Active
-
2017
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| Publication number | Priority date | Publication date | Assignee | Title |
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| US20010049180A1 (en) * | 2000-03-20 | 2001-12-06 | Taylor Gordon C. | Surface pin device |
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| CN102956993A (zh) * | 2012-11-14 | 2013-03-06 | 华南理工大学 | 基于s-pin二极管的方向图可重构圆盘型微带天线 |
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| Publication number | Publication date |
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| JP2020503683A (ja) | 2020-01-30 |
| CN107068560B (zh) | 2018-11-27 |
| WO2018113542A1 (zh) | 2018-06-28 |
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| PB01 | Publication | ||
| PB01 | Publication | ||
| SE01 | Entry into force of request for substantive examination | ||
| SE01 | Entry into force of request for substantive examination | ||
| GR01 | Patent grant | ||
| GR01 | Patent grant | ||
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