CN106782272A - 像素电路及其驱动方法、显示装置 - Google Patents

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Abstract

本发明公开了一种像素电路及其驱动方法、显示装置，所述像素电路包括感光器件、重置单元、充电单元、补偿单元、输出单元以及发光器件，重置单元根据第一信号端和第二信号端的输入信号控制第一节点和第二节点的电位，充电单元根据第三信号端的输入信号控制第二节点的电位，补偿单元根据第四信号端和第五信号端的输入信号以及第二节点的电位控制第一节点和第三节点的电位，输出单元根据第六信号端和第七信号端的输入信号以及第三节点的电位控制发光器件的第一极和读取端的输出信号。本发明将补偿电路和像素电路整合在一起，通过驱动信号和扫描信号的共用方式，实现两者的功能整合，不仅满足高分辨率的硅基显示功能，还具备环境影像和监测功能。

Description

像素电路及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素电路及其驱动方法、显示装置。
背景技术
CMOS(Complementary Metal-Oxide Semiconductor，互补性金属氧化物半导体)图像传感器可以将纯粹逻辑运算的功能转变为接收外界光线后转变为电能并传递出去。作为最常见的CMOS图像传感器的检测电路，有源式像素传感器(Active Pixel Sensor，简称APS)电路在感光器件光电转换过程中，由于源极跟随薄膜晶体管(Thin Film Transistor，TFT)自身工艺差异所导致的末端输出电流不均一，源极跟随薄膜晶体管的输出电流会受到其自身的阈值电压的影响，从而使得显示画面失真。
发明内容
为解决上述问题，本发明提供一种像素电路及其驱动方法、显示装置，至少部分解决现有的源极跟随薄膜晶体管的末端输出电流不均一，导致显示画面失真的问题。
为此，本发明提供一种像素电路，包括感光器件、重置单元、充电单元、补偿单元、输出单元以及发光器件，所述感光器件的第一极接地，所述感光器件的第二极与所述充电单元连接，所述发光器件的第一极与所述输出单元连接，所述发光器件的第二极接地；
所述重置单元分别与第一信号端、第一电压端、第二信号端、第一节点以及第二节点连接，用于根据所述第一信号端和所述第二信号端的输入信号控制所述第一节点和所述第二节点的电位；
所述充电单元分别与所述第三信号端和所述第二节点连接，用于根据所述第三信号端的输入信号控制所述第二节点的电位；
所述补偿单元分别与所述第二节点、所述第一节点、第一电压端、第四信号端、第三节点、第二电压端以及第五信号端连接，用于根据所述第四信号端和所述第五信号端的输入信号以及所述第二节点的电位控制所述第一节点和所述第三节点的电位；
所述输出单元分别与所述第三节点、第七信号端、读取端以及第六信号端连接，用于根据所述第六信号端和所述第七信号端的输入信号以及所述第三节点的电位控制所述发光器件的第一极和所述读取端的输出信号。
可选的，所述输出单元包括：
读取模块，分别与所述第三节点、所述读取端以及所述第六信号端连接，用于根据所述第六信号端的输入信号以及所述第三节点的电位控制所述读取端的输出信号；
发光模块，分别与所述第三节点、所述第七信号端以及所述发光器件的第一极连接，用于根据所述第七信号端的输入信号以及所述第三节点的电位控制所述发光器件的第一极的输出信号。
可选的，所述重置单元包括第四晶体管和第一晶体管；
所述第四晶体管的栅极与所述第一信号端连接，所述第四晶体管的第一极与所述第一电压端连接，所述第四晶体管的第二极与所述第二节点连接；
所述第一晶体管的栅极与所述第二信号端连接，所述第一晶体管的第一极接地，所述第一晶体管的第二极与所述第一节点连接。
可选的，所述充电单元包括第五晶体管和第二电容；
所述第五晶体管的栅极与所述第三信号端连接，所述第五晶体管的第一极与所述感光器件的第二极连接，所述第五晶体管的第二极与所述第二节点连接；
所述第二电容的第一极接地，所述第二电容的第二极与所述第二节点连接。
可选的，所述补偿单元包括第六晶体管、第三晶体管、第二晶体管以及第一电容；
所述第六晶体管的栅极与所述第五信号端连接，所述第六晶体管的第一极与所述第二节点连接，所述第六晶体管的第二极与所述第二电压端连接；
所述第三晶体管的栅极与所述第一节点连接，所述第三晶体管的第一极与所述第二节点连接，所述第三晶体管的第二极与所述第三节点连接；
所述第二晶体管的栅极与所述第四信号端连接，所述第二晶体管的第一极与所述第一节点连接，所述第二晶体管的第二极与所述第三节点连接；
所述第一电容的第一极与所述第一节点连接，所述第一电容的第二极与所述第一电压端连接。
可选的，所述读取模块包括第七晶体管，所述第七晶体管的栅极与所述第六信号端连接，所述第七晶体管的第一极与所述第三节点连接，所述第七晶体管的第二极与所述读取端连接。
可选的，所述输出单元包括第八晶体管，所述第八晶体管的栅极与所述第七信号端连接，所述第八晶体管的第一极与所述第三节点连接，所述第八晶体管的第二极与所述发光器件的第一极连接。
可选的，所述晶体管全部为N型晶体管或者P型晶体管。
可选的，所述感光器件包括光电二极管。
本发明还提供一种显示装置，包括任一所述的像素电路。
本发明还提供一种像素电路的驱动方法，所述像素电路包括任一所述的像素电路，所述第一电压端为高电平，所述第二电压端为数据信号电压；
所述像素电路的驱动方法包括：
第一阶段，所述第一信号端的输入信号为低电平，所述第二信号端的输入信号为低电平，所述第三信号端的输入信号为低电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第二阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为低电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第三阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为低电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第四阶段，所述第一信号端的输入信号为低电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为低电平，所述第七信号端的输入信号为高电平。
可选的，还包括：
第五阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为低电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第六阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为低电平，所述第五信号端的输入信号为低电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第七阶段，所述第一信号端的输入信号为低电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为低电平。
本发明具有下述有益效果：
本发明提供的像素电路及其驱动方法、显示装置之中，所述像素电路包括感光器件、重置单元、充电单元、补偿单元、输出单元以及发光器件，重置单元用于根据第一信号端和第二信号端的输入信号控制第一节点和第二节点的电位，充电单元用于根据第三信号端的输入信号控制第二节点的电位，补偿单元用于根据第四信号端和第五信号端的输入信号以及第二节点的电位控制第一节点和第三节点的电位，输出单元用于根据第六信号端和第七信号端的输入信号以及第三节点的电位控制发光器件的第一极和读取端的输出信号。本发明提供的技术方案将补偿电路和像素电路整合在一起，通过驱动信号和扫描信号的共用方式，实现两者的功能整合，不仅满足高分辨率的硅基显示功能，还具备环境影像和监测功能。另外，本发明提供的技术方案通过对像素电路的源极跟随晶体管进行补偿，解决了由于源极跟随晶体管自身差异导致的输出电流不均一的问题，避免输出电流受到偏移电压的影响。
附图说明
图1为本发明实施例一提供的一种像素电路的结构示意图；
图2为本发明实施例一提供的另一种像素电路的结构示意图；
图3为图2所示像素电路的具体结构示意图；
图4为本发明实施例三提供的一种像素电路的驱动方法的流程图；
图5为本发明实施例三提供的一种像素电路的工作时序图；
图6为实施例三中像素电路在第一阶段的电流流向示意图；
图7为实施例三中像素电路在第二阶段的电流流向示意图；
图8为实施例三中像素电路在第三阶段的电流流向示意图；
图9为实施例三中像素电路在第四阶段的电流流向示意图；
图10为实施例三中像素电路在第五阶段的电流流向示意图；
图11为实施例三中像素电路在第六阶段的电流流向示意图；
图12为实施例三中像素电路在第七阶段的电流流向示意图。
具体实施方式
为使本领域的技术人员更好地理解本发明的技术方案，下面结合附图对本发明提供的像素电路及其驱动方法、显示装置进行详细描述。
实施例一
图1为本发明实施例一提供的一种像素电路的结构示意图。如图1所示，所述像素电路包括感光器件PD、重置单元101、充电单元102、补偿单元103、输出单元104以及发光器件OLED，所述感光器件PD的第一极接地，所述感光器件PD的第二极与所述充电单元102连接，所述发光器件OLED的第一极与所述输出单元104连接，所述发光器件OLED的第二极接地。本实施例中，所述感光器件PD包括光电二极管，所述发光器件OLED为有机电致发光器件。本实施例提供的技术方案将补偿电路和像素电路整合在一起，通过驱动信号和扫描信号的共用方式，实现两者的功能整合，不仅满足高分辨率的硅基显示功能，还具备环境影像和监测功能。另外，本实施例提供的技术方案通过对像素电路的源极跟随晶体管进行补偿，解决了由于源极跟随晶体管自身差异导致的输出电流不均一的问题，避免输出电流受到偏移电压的影响。
参见图1，所述重置单元101分别与第一信号端Reset、第一电压端Vdd、第二信号端Reset1、第一节点N1以及第二节点N2连接，用于根据所述第一信号端Reset和所述第二信号端Reset1的输入信号控制所述第一节点N1和所述第二节点N2的电位。所述充电单元102分别与所述第三信号端Scan1和所述第二节点N2连接，用于根据所述第三信号端Scan1的输入信号控制所述第二节点N2的电位。所述补偿单元103分别与所述第二节点N2、所述第一节点N1、第一电压端Vdd、第四信号端Scan2、第三节点N3、第二电压端Vdata以及第五信号端Scan3连接，用于根据所述第四信号端Scan2和所述第五信号端Scan3的输入信号以及所述第二节点N2的电位控制所述第一节点N1和所述第三节点N3的电位。所述输出单元104分别与所述第三节点N3、第七信号端EM2、读取端ReadLine以及第六信号端EM1连接，用于根据所述第六信号端EM1和所述第七信号端EM2的输入信号以及所述第三节点N3的电位控制所述发光器件OLED的第一极和所述读取端ReadLine的输出信号。
图2为本发明实施例一提供的另一种像素电路的结构示意图。如图2所示，所述输出单元104包括读取模块和发光模块，所述读取模块分别与所述第三节点N3、所述读取端ReadLine以及所述第六信号端EM1连接，用于根据所述第六信号端EM1的输入信号以及所述第三节点N3的电位控制所述读取端ReadLine的输出信号。所述发光模块分别与所述第三节点N3、所述第七信号端EM2以及所述发光器件OLED的第一极连接，用于根据所述第七信号端EM2的输入信号以及所述第三节点N3的电位控制所述发光器件OLED的第一极的输出信号。
图3为图2所示像素电路的具体结构示意图。如图3所示，所述重置单元101包括第四晶体管M4和第一晶体管M1，所述第四晶体管M4的栅极与所述第一信号端Reset连接，所述第四晶体管M4的第一极与所述第一电压端Vdd连接，所述第四晶体管M4的第二极与所述第二节点N2连接，所述第一晶体管M1的栅极与所述第二信号端Reset1连接，所述第一晶体管M1的第一极接地，所述第一晶体管M1的第二极与所述第一节点N1连接。
参见图3，所述充电单元102包括第五晶体管M5和第二电容C2，所述第五晶体管M5的栅极与所述第三信号端Scan1连接，所述第五晶体管M5的第一极与所述感光器件PD的第二极连接，所述第五晶体管M5的第二极与所述第二节点N2连接，所述第二电容C2的第一极接地，所述第二电容C2的第二极与所述第二节点N2连接。
参见图3，所述补偿单元103包括第六晶体管M6、第三晶体管M3、第二晶体管M2以及第一电容C1，所述第六晶体管M6的栅极与所述第五信号端Scan3连接，所述第六晶体管M6的第一极与所述第二节点N2连接，所述第六晶体管M6的第二极与所述第二电压端Vdata连接，所述第三晶体管M3的栅极与所述第一节点N1连接，所述第三晶体管M3的第一极与所述第二节点N2连接，所述第三晶体管M3的第二极与所述第三节点N3连接，所述第二晶体管M2的栅极与所述第四信号端Scan2连接，所述第二晶体管M2的第一极与所述第一节点N1连接，所述第二晶体管M2的第二极与所述第三节点N3连接，所述第一电容C1的第一极与所述第一节点N1连接，所述第一电容C1的第二极与所述第一电压端Vdd连接。
参见图3，所述读取模块包括第七晶体管M7，所述第七晶体管M7的栅极与所述第六信号端EM1连接，所述第七晶体管M7的第一极与所述第三节点N3连接，所述第七晶体管M7的第二极与所述读取端ReadLine连接。所述输出单元104包括第八晶体管M8，所述第八晶体管M8的栅极与所述第七信号端EM2连接，所述第八晶体管M8的第一极与所述第三节点N3连接，所述第八晶体管M8的第二极与所述发光器件OLED的第一极连接。
本实施例提供的像素电路之中，第一晶体管M1、第二晶体管M2、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7、第八晶体管M8为开关晶体管(Switching TFT)，第三晶体管M3为源极跟随驱动晶体管(Driving TFT)。本实施例提供的技术方案将补偿电路和像素电路整合在一起，通过驱动信号和扫描信号的共用方式，实现两者的功能整合，不仅满足高分辨率的硅基显示功能，还具备环境影像和监测功能。另外，本实施例提供的技术方案通过对像素电路的源极跟随晶体管进行补偿，解决了由于源极跟随晶体管自身差异导致的输出电流不均一的问题，避免输出电流受到偏移电压的影响。
实施例二
本实施例提供一种显示装置，包括实施例一提供的像素电路，具体内容可参照实施例一的描述，此处不再赘述。
本实施例提供的显示装置之中，所述像素电路包括感光器件、重置单元、充电单元、补偿单元、输出单元以及发光器件，重置单元用于根据第一信号端和第二信号端的输入信号控制第一节点和第二节点的电位，充电单元用于根据第三信号端的输入信号控制第二节点的电位，补偿单元用于根据第四信号端和第五信号端的输入信号以及第二节点的电位控制第一节点和第三节点的电位，输出单元用于根据第六信号端和第七信号端的输入信号以及第三节点的电位控制发光器件的第一极和读取端的输出信号。本实施例提供的技术方案将补偿电路和像素电路整合在一起，通过驱动信号和扫描信号的共用方式，实现两者的功能整合，不仅满足高分辨率的硅基显示功能，还具备环境影像和监测功能。另外，本实施例提供的技术方案通过对像素电路的源极跟随晶体管进行补偿，解决了由于源极跟随晶体管自身差异导致的输出电流不均一的问题，避免输出电流受到偏移电压的影响。
实施例三
图4为本发明实施例三提供的一种像素电路的驱动方法的流程图，图5为本发明实施例三提供的一种像素电路的工作时序图。如图4和图5所示，所述像素电路包括实施例一提供的像素电路，所述第一电压端Vdd为高电平，所述第二电压端Vdata为数据信号电压。
所述像素电路的驱动方法包括：
步骤1001、第一阶段，所述第一信号端的输入信号为低电平，所述第二信号端的输入信号为低电平，所述第三信号端的输入信号为低电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平。
图6为实施例三中像素电路在第一阶段的电流流向示意图。如图6所示，图中箭头方向代表电流流向。在第一阶段之中，所述第一信号端Reset的输入信号为低电平，所述第二信号端Reset1的输入信号为低电平，所述第三信号端Scan1的输入信号为低电平，所述第四信号端Scan2的输入信号为高电平，所述第五信号端Scan3的输入信号为高电平，所述第六信号端EM1的输入信号为高电平，所述第七信号端EM2的输入信号为高电平。此时，第一晶体管M1、第四晶体管M4以及第五晶体管M5导通，其他晶体管断开，从而将第一节点N1重置接地，电势为0V。当然，也可以将第一节点N1重置为负压，第二节点N2的电势为Vdd，同时将之前的电压信号进行重置。
步骤1002、第二阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为低电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平。
图7为实施例三中像素电路在第二阶段的电流流向示意图。如图7所示，感光器件PD上的箭头代表光电反应。在第二阶段之中，所述第一信号端Reset的输入信号为高电平，所述第二信号端Reset1的输入信号为高电平，所述第三信号端Scan1的输入信号为低电平，所述第四信号端Scan2的输入信号为高电平，所述第五信号端Scan3的输入信号为高电平，所述第六信号端EM1的输入信号为高电平，所述第七信号端EM2的输入信号为高电平。此时只有第五晶体管M5导通，其他晶体管关闭，当二极管PN结上有入射光照射时，光量子激发在PN结上产生电子空穴对，使得PN结电容上的电荷发生复合，第二节点N2的电势降为Vdata1，并将Vdata1存储在第二电容C2的两端，为下一阶段做准备。
步骤1003、第三阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为低电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平。
图8为实施例三中像素电路在第三阶段的电流流向示意图。如图8所示，图中箭头方向代表电流流向。在第三阶段之中，所述第一信号端Reset的输入信号为高电平，所述第二信号端Reset1的输入信号为高电平，所述第三信号端Scan1的输入信号为高电平，所述第四信号端Scan2的输入信号为低电平，所述第五信号端Scan3的输入信号为高电平，所述第六信号端EM1的输入信号为高电平，所述第七信号端EM2的输入信号为高电平。此时第二晶体管M2和第三晶体管M3导通，其他的晶体管断开，由于之前第一节点N1的电位为0V，因此第三晶体管M3打开，Vdata1信号通过第三晶体管M3和第二晶体管M2开始对第一节点N1点进行充电，直到将第一节点N1充电至Vdata1-Vth为止，第三晶体管M3的栅源两极之间的电压差为Vth。充电完成之后，第一节点N1的电位将一直维持在Vdata1-Vth。
步骤1004、第四阶段，所述第一信号端的输入信号为低电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为低电平，所述第七信号端的输入信号为高电平。
图9为实施例三中像素电路在第四阶段的电流流向示意图。如图9所示，图中箭头方向代表电流流向。在第四阶段之中，所述第一信号端Reset的输入信号为低电平，所述第二信号端Reset1的输入信号为高电平，所述第三信号端Scan1的输入信号为高电平，所述第四信号端Scan2的输入信号为高电平，所述第五信号端Scan3的输入信号为高电平，所述第六信号端EM1的输入信号为低电平，所述第七信号端EM2的输入信号为高电平。此时第三晶体管M3的源极接入Vdd，第二节点N2的电位为Vdd，电流通过第四晶体管M4和第三晶体管M3流向第七晶体管M7，再由读取端Readline输出。由晶体管的饱和电流公式可以得到：
I＝K(Vgs-Vth)2＝K[Vdd-(Vdata1-Vth)-Vth]2＝K(Vdd-Vdata1)2
通过上述公式可以看出，此时的工作电流I已经不受源极跟随晶体管的阈值电压Vth的影响，只与Vdd和Vdata1有关，其中Vdata1直接由二极管PN结的光照产生，从而彻底解决了源极跟随晶体管由于工艺和操作造成阈值电压Vth的漂移问题，保证了信号数据的准确性。
步骤1005、第五阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为低电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平。
图10为实施例三中像素电路在第五阶段的电流流向示意图。如图10所示，图中箭头方向代表电流流向。在第五阶段之中，所述第一信号端Reset的输入信号为高电平，所述第二信号端Reset1的输入信号为低电平，所述第三信号端Scan1的输入信号为高电平，所述第四信号端Scan2的输入信号为高电平，所述第五信号端Scan3的输入信号为高电平，所述第六信号端EM1的输入信号为高电平，所述第七信号端EM2的输入信号为高电平。此时第一晶体管M1导通，其它晶体管断开，从而将第一节点N1重置接地，电势为0V。当然，也可以将第一节点N1重置为负压。
步骤1006、第六阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为低电平，所述第五信号端的输入信号为低电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平。
图11为实施例三中像素电路在第六阶段的电流流向示意图。如图11所示，图中箭头方向代表电流流向。在第六阶段之中，所述第一信号端Reset的输入信号为高电平，所述第二信号端Reset1的输入信号为高电平，所述第三信号端Scan1的输入信号为高电平，所述第四信号端Scan2的输入信号为低电平，所述第五信号端Scan3的输入信号为低电平，所述第六信号端EM1的输入信号为高电平，所述第七信号端EM2的输入信号为高电平。此时第二晶体管M2、第三晶体管M3以及第六晶体管M6导通，由于之前第一节点N1的电位为0V，因此可以对第三晶体管M3进行第二次充电补偿，Vdata2信号通过第六晶体管M6、第三晶体管M3以及第二晶体管M2开始对第一节点N1进行充电，直到将第一节点N1充电至Vdata2-Vth为止，第三晶体管M3的栅源两极之间的电压差为Vth。充电完成之后，第一节点N1的电位将一直维持在Vdata2-Vth。
步骤1007、第七阶段，所述第一信号端的输入信号为低电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为低电平。
图12为实施例三中像素电路在第七阶段的电流流向示意图。如图12所示，图中箭头方向代表电流流向。在第七阶段之中，所述第一信号端Reset的输入信号为低电平，所述第二信号端Reset1的输入信号为高电平，所述第三信号端Scan1的输入信号为高电平，所述第四信号端Scan2的输入信号为高电平，所述第五信号端Scan3的输入信号为高电平，所述第六信号端EM1的输入信号为高电平，所述第七信号端EM2的输入信号为低电平。
此时第三晶体管M3的源极接入Vdd，第二节点N2的电位为Vdd，电流通过第四晶体管M4和第三晶体管M3流向第八晶体管M8，使得发光器件OLED发光。由晶体管的饱和电流公式可以得到：
I＝K(Vgs-Vth)2＝K[Vdd-(Vdata2-Vth)-Vth]2＝K(Vdd-Vdata2)2
通过上述公式可以看出，此时的电流IOLED已经不受阈值电压Vth的影响，只与Vdata2有关，从而彻底解决了驱动随晶体管由于工艺和操作造成阈值电压Vth的漂移问题，消除了其对IOLED的影响，从而能够保证发光器件OLED的正常工作。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (12)

1.一种像素电路，其特征在于，包括感光器件、重置单元、充电单元、补偿单元、输出单元以及发光器件，所述感光器件的第一极接地，所述感光器件的第二极与所述充电单元连接，所述发光器件的第一极与所述输出单元连接，所述发光器件的第二极接地；
所述重置单元分别与第一信号端、第一电压端、第二信号端、第一节点以及第二节点连接，用于根据所述第一信号端和所述第二信号端的输入信号控制所述第一节点和所述第二节点的电位；
所述充电单元分别与第三信号端和所述第二节点连接，用于根据所述第三信号端的输入信号控制所述第二节点的电位；
所述补偿单元分别与所述第二节点、所述第一节点、第一电压端、第四信号端、第三节点、第二电压端以及第五信号端连接，用于根据所述第四信号端和所述第五信号端的输入信号以及所述第二节点的电位控制所述第一节点和所述第三节点的电位；
所述输出单元分别与所述第三节点、第七信号端、读取端以及第六信号端连接，用于根据所述第六信号端和所述第七信号端的输入信号以及所述第三节点的电位控制所述发光器件的第一极和所述读取端的输出信号。
2.根据权利要求1所述的像素电路，其特征在于，所述输出单元包括：
读取模块，分别与所述第三节点、所述读取端以及所述第六信号端连接，用于根据所述第六信号端的输入信号以及所述第三节点的电位控制所述读取端的输出信号；
发光模块，分别与所述第三节点、所述第七信号端以及所述发光器件的第一极连接，用于根据所述第七信号端的输入信号以及所述第三节点的电位控制所述发光器件的第一极的输出信号。
3.根据权利要求1所述的像素电路，其特征在于，所述重置单元包括第四晶体管和第一晶体管；
所述第四晶体管的栅极与所述第一信号端连接，所述第四晶体管的第一极与所述第一电压端连接，所述第四晶体管的第二极与所述第二节点连接；
所述第一晶体管的栅极与所述第二信号端连接，所述第一晶体管的第一极接地，所述第一晶体管的第二极与所述第一节点连接。
4.根据权利要求1所述的像素电路，其特征在于，所述充电单元包括第五晶体管和第二电容；
所述第五晶体管的栅极与所述第三信号端连接，所述第五晶体管的第一极与所述感光器件的第二极连接，所述第五晶体管的第二极与所述第二节点连接；
所述第二电容的第一极接地，所述第二电容的第二极与所述第二节点连接。
5.根据权利要求1所述的像素电路，其特征在于，所述补偿单元包括第六晶体管、第三晶体管、第二晶体管以及第一电容；
所述第六晶体管的栅极与所述第五信号端连接，所述第六晶体管的第一极与所述第二节点连接，所述第六晶体管的第二极与所述第二电压端连接；
所述第三晶体管的栅极与所述第一节点连接，所述第三晶体管的第一极与所述第二节点连接，所述第三晶体管的第二极与所述第三节点连接；
所述第二晶体管的栅极与所述第四信号端连接，所述第二晶体管的第一极与所述第一节点连接，所述第二晶体管的第二极与所述第三节点连接；
所述第一电容的第一极与所述第一节点连接，所述第一电容的第二极与所述第一电压端连接。
6.根据权利要求2所述的像素电路，其特征在于，所述读取模块包括第七晶体管，所述第七晶体管的栅极与所述第六信号端连接，所述第七晶体管的第一极与所述第三节点连接，所述第七晶体管的第二极与所述读取端连接。
7.根据权利要求2所述的像素电路，其特征在于，所述输出单元包括第八晶体管，所述第八晶体管的栅极与所述第七信号端连接，所述第八晶体管的第一极与所述第三节点连接，所述第八晶体管的第二极与所述发光器件的第一极连接。
8.根据权利要求2-7任一所述的像素电路，其特征在于，所述晶体管全部为N型晶体管或者P型晶体管。
9.根据权利要求1-7任一所述的像素电路，其特征在于，所述感光器件包括光电二极管。
10.一种显示装置，其特征在于，包括权利要求1-9任一所述的像素电路。
11.一种像素电路的驱动方法，其特征在于，所述像素电路包括权利要求1-9任一所述的像素电路，所述第一电压端为高电平，所述第二电压端为数据信号电压；
所述像素电路的驱动方法包括：
第一阶段，所述第一信号端的输入信号为低电平，所述第二信号端的输入信号为低电平，所述第三信号端的输入信号为低电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第二阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为低电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第三阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为低电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第四阶段，所述第一信号端的输入信号为低电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为低电平，所述第七信号端的输入信号为高电平。
12.根据权利要求11所述的驱动方法，其特征在于，还包括：
第五阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为低电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第六阶段，所述第一信号端的输入信号为高电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为低电平，所述第五信号端的输入信号为低电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为高电平；
第七阶段，所述第一信号端的输入信号为低电平，所述第二信号端的输入信号为高电平，所述第三信号端的输入信号为高电平，所述第四信号端的输入信号为高电平，所述第五信号端的输入信号为高电平，所述第六信号端的输入信号为高电平，所述第七信号端的输入信号为低电平。
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