CN106471621A - 堆叠半导体芯片rgbz传感器 - Google Patents

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Abstract

本发明描述了一种装置,其包括具有第一像素阵列的第一半导体芯片。第一像素阵列具有可见光敏感像素。该装置包括具有第二像素阵列的第二半导体芯片。第一半导体芯片堆叠在第二半导体芯片上,使得第二像素阵列位于第一像素阵列下方。第二像素阵列具有用于基于飞行时间的深度检测的IR光敏像素。

Description

堆叠半导体芯片RGBZ传感器
技术领域
本发明的领域整体上涉及电子领域,更具体地,涉及堆叠半导体芯片RGBZ传感器。
背景技术
诸多现有计算系统包括一个或多个传统图像采集相机作为集成的外围设备。当前的趋势是通过将深度采集集成到其成像组件中来增强计算系统的成像能力。深度采集可以用于例如执行各种智能对象识别功能,如面部识别(例如用于安保系统解锁)或手部姿势识别(例如用于非接触式用户界面功能)。
一种被称为“飞行时间”成像的深度信息采集方法将光从系统发射到物体上,并且对于图像传感器的多个像素中的每一个,测量光的发射和反射图像的接收之间的时间。由飞行时间像素产生的图像对应于物体的三维轮廓,其表征为在不同像素位置中的每一个处(x,y)的特定深度测量值(z)。
由于诸多具有成像能力的计算系统(例如膝上型计算机、平板计算机、智能电话等)本质上是可移动的,飞行时间操作与传统图像采集的集成呈现出许多设计挑战,如成本挑战和封装挑战。
发明内容
本发明描述了一种装置,其包括具有第一像素阵列的第一半导体芯片。第一像素阵列具有可见光敏感像素。该装置包括具有第二像素阵列的第二半导体芯片。第一半导体芯片堆叠在第二半导体芯片上,使得第二像素阵列位于第一像素阵列下方。第二像素阵列具有用于基于飞行时间的深度检测的IR光敏像素。
本发明描述了一种装置,其包括用于在第一像素阵列的表面处接收可见光和IR光的器件。该装置还包括用于利用第一像素阵列感测可见光但不感测IR光的器件,其中IR光穿过第一像素阵列。该装置还包括利用位于第一像素阵列下方的第二像素阵列感测IR光的器件。
附图说明
以下说明和附图用于说明本发明的实施例。在附图中:
图1a和1b示出了堆叠半导体芯片RGBZ传感器的实施例;
图2示出了堆叠半导体芯片RGBZ传感器的操作的图示;
图3a至3i示出了制造堆叠半导体芯片RGBZ传感器的方法;
图4a至4d示出了不同的图像传感器电路分布;
图5示出了由堆叠半导体芯片RGBZ传感器执行的方法;
图6示出了2D/3D相机系统的实施例。
图7示出了具有2D/3D相机系统的计算系统的实施例。
具体实施方式
“RGBZ”图像传感器是用于在同一相机封装体内实现传统图像采集和飞行时间深度分析二者的有吸引力的解决方案。RGBZ图像传感器是包括不同种类的像素的图像传感器,其中一些像素(RGB像素)对可见光敏感,而其它像素(飞行时间像素或“Z”像素)用于测量深度信息。
在通常的实施方式中,飞行时间像素被设计为对IR光敏感,因为如上所述,IR光用于飞行时间测量,使得飞行时间测量不干扰传统的RGB像素的成像功能。飞行时间像素还具有特殊的相关时钟和/或定时电路,以测量在像素处接收到光的时间。然而,因为飞行时间像素对IR光敏感,所以它们也可以被构想为用作(例如在第二模式中)IR像素而不是飞行时间像素(即IR信息被采集,但是不进行飞行时间测量)。
与将RGB像素和Z像素包括在分开的封装中的解决方案相比,将RGB像素和Z像素二者集成到同一封装中会减小尺寸并降低成本。图1a和1b示出了“堆叠”RGBZ图像传感器100,其中,第一类型的像素阵列101(例如RGB像素阵列)堆叠在第二类型的像素阵列102(例如IR或Z像素阵列)的顶部上。这里,堆叠结构100包括堆叠在第二类型的功能像素108(Z)的下层上的与单纯滤光器相反的第一类型的功能像素107(RGB)。如将在下面进一步详细讨论的,在操作中,上像素阵列101被实施为背侧照明像素阵列,下像素阵列102被实施为前侧照明像素阵列。
如图1a和1b的实施例中所示,背侧互连金属化层109、RGB滤光层110和微透镜阵列112位于上像素阵列101的半导体晶片104的背侧上。背侧金属化层109有助于支持在像素阵列对101、102之间的芯片到芯片的过孔116。RGB滤光层110包括不同颜色滤光器111_1、111_2,以限定上像素阵列101的RGB像素。微透镜阵列112与引线结合焊盘118一起形成在整个结构100的上表面上。形成在引线结合焊盘118上的引线结合件可以布置在封装基体上。在一些实施例中,下基体114对应于封装基体,而在其它实施例中,下基体114对应于安装在封装基体上的另一半导体芯片(在后者的实施例中,封装基体在图1b中未示出)。
上像素阵列101还包括前侧金属化层103,以形成晶体管部件(如栅极和源极/漏极电极)和对应的互连层(一个或多个),其一起形成集成在上像素阵列101上的电路。特别地,上像素阵列101包括延伸穿过上像素阵列101的半导体基体104的贯穿基体过孔115,以将金属化层103的节点连接到金属化层109的节点。
下像素阵列102包括前侧互连金属化层106,其面对上像素阵列101的前侧互连金属化层103。前侧金属化层106用于形成晶体管部件(如栅极和源极/漏极电极)和对应的互连层(一个或多个),其一起形成集成在下像素阵列102上的电路。下像素阵列102的前侧金属化层106还包括连接到过孔116的节点,过孔116连接至上像素阵列101的背侧金属化层109的节点。这些过孔116,如过孔115那样,也被实施为上像素阵列101的贯穿基体过孔。
下像素阵列102的前侧金属化层106还包括连接到过孔117的附加节点,过孔117连接到结合焊盘118。类似于过孔115和116,过孔117也被实施为上像素阵列101的贯穿基体过孔。虽然图1b显示,到/来自上像素阵列101的所有输入/输出信号必须通过下像素阵列102的前侧金属化层106,但是在各个实施例中,上像素阵列101的背侧金属化层109可以支持直接连接到接合焊盘118的过孔,从而允许信号在接合焊盘和上像素阵列101之间传递,而不必横穿下像素阵列102的金属化层106。
注意,图1b示出了沿着特定剖切面的堆叠RGBZ图像传感器的实施例,示出了RGB像素阵列的第一水平轴线。例如,如果对同一结构的描绘沿着更接近或更远离图1b的GBGB...轴线的下一水平轴线示出,则上像素阵列101的可见像素将替代地示出为以例如GRGR...样式替代GBGB...样式。还要注意,在图1b的实施例中,Z像素108比RGB像素大,因为例如,与可见光相比,硅具有较低的IR光灵敏度,和/或,Z像素需要更大的阱电容(wellcapacitance)。上和下像素阵列101、102的前侧金属化层103、106还可以包括相应的光导结构113、114,以将流过上像素阵列101的RGB像素的入射光耦合到下像素阵列102的Z像素中。
图2描绘了图1a和1b的堆叠像素阵列结构的操作方法。如图2所示,由可见光和IR光组成的光210入射在上RGB像素阵列201的(例如背侧)表面上。如本领域中已知的,形成在上像素阵列201上的RGB滤光层110(一个或多个)包括单独瓦状(tile-like)的绿色滤光器111_1和蓝色滤光器111_2,通常以如拜耳(Bayer)图案的图案布置。每个单独的RGB滤光器不仅使具有其自身特定颜色的可见光(例如在R像素的情况下为红色,在B像素的情况下为蓝色等)通过,而且也使IR光通过。特定颜色的可见光和IR光照射在上像素阵列201的半导体基体104(例如背侧)上。上像素阵列201的像素107_1、107_2吸收可见光,并且相应于此吸收而产生针对它们相应的颜色的相应的检测信号。
与被上像素阵列201吸收的可见光不同,相比而言,IR光穿过上像素阵列201。这里,作为物理学的通常情况,相对于IR光,可见光倾向于强烈地多地被半导体吸收。因此,通过使上像素阵列201层的半导体晶片104做得足够薄,可以使上像素阵列201吸收入射的可见光并对其做出反应,同时基本上使入射的IR光穿过。
因此,理想地,入射在上像素阵列201上的IR光211大部分穿过上像素阵列201到下像素阵列202。在实施例中,下像素阵列202的半导体晶片105被制成比上像素阵列201的半导体晶片104更厚,使得与上像素阵列201不同,其吸收入射的IR光211而不是使其穿过。因此,下像素阵列202的像素吸收IR光并且响应于此产生相应的检测信号。通过吸收IR光,下像素阵列202下方的任何电路(例如在下基体114被实施为半导体芯片的情况下)不受干扰。
在各个实施方式中,下像素阵列202的Z像素通过根据在闪烁“开”IR照明器的光和在下像素阵列202处接收该闪烁的反射光之间的时间而产生电荷,从而有效地执行“3D”飞行时间深度测量。Z像素通常接收时钟信号,该时钟信号的每一个与照明器的时钟信号具有已知的相位关系。在一个实施例中,存在提供至下像素阵列的每个Z像素的四种这样的时钟信号(例如0°、90°、180°和270°正交臂)。
这里,利用具有不同相位的时钟(例如通过4个连续的曝光时间)对Z像素进行计时,将针对同一光闪烁收集到不同的电荷量。来自不同时钟的收集的电荷信号可以被组合,以产生该节点所在的区域的特定的飞行时间值。在一个实施方式中,这样的组合由图像信号处理器(例如集成在诸如处理器或应用处理器半导体芯片的主机系统上)来进行。
注意,图2的堆叠像素阵列结构自然地使其本身能够同时利用上RGB像素阵列201检测可见光图像,并利用下Z像素阵列202检测用于飞行时间测量的IR光。
图3a到3i示出了用于制造堆叠像素阵列结构的示例性工艺。如图3a所示,上像素阵列301(例如根据第一晶圆制造工艺)形成有前侧金属化层303,其包括每个在可见光像素区域组上形成的相应的光导314,所述可见光像素区域组的尺寸与和下像素阵列相关联的Z像素相称(例如,包括一对R像素、G像素和B像素的RGB像素的4×4平方)。
如本领域中已知的,前侧金属化层303包括导电迹线层303,其中,在中间的相应的电介质层形成在半导体基体304上方。对于每个像素,电互连特征通常包括一个或多个触头,其接触下面的硅(例如,用以偏压像素和/或拾取像素的光学感应电信号),并且向/从位于有源像素阵列的外围周围的支持像素阵列的操作的其它电路(例如感测放大器、行解码器等)布线(wiring)。实施这些电路的晶体管电极通常形成在最下方的金属化层。为了便于绘制,未示出晶体管电极。
在金属化层303的布局中需小心操作,以尽可能地沿着像素边界的边缘延伸导电迹线,而不是在像素本身的上方(以使得迹线不阻挡入射光)。一个或多个金属化层可以用于在电路上方形成屏蔽层,其阻止入射光到达下面的晶体管并干扰晶体管的操作。
在实施例中,光导314通过蚀刻穿过堆叠的电介质层而形成,该堆叠的电介质层位于要布置单个光导的相应的RGB像素的组的上方。该堆叠的电介质层可以对应于层303的不具有任何金属迹线的普通电介质层。在蚀刻适当定位的沟槽之后,采用对IR光透明的高折射率材料填充(例如通过沉积)沟槽。采用高折射率材料对光导区域的填充基本上强迫IR光在光导内发生内反射,并且防止内部光串扰传输到相邻的光导和/或相邻的像素。用于形成光导的其它方法包括在光导特征部的边界周围蚀刻“环带”或类似结构,并且用金属填充蚀刻区域(以再次强迫光导内的内部反射)或将蚀刻区域留作气隙。
参考图3b,另外形成下像素阵列302(例如根据第二晶圆制造工艺)。前侧金属化层306类似于上像素阵列的前侧金属化层303而形成,包括在每个Z像素区域上方形成单独的光导313。前侧金属化层306还包括附加的外周特征部319,以支持连接到上像素阵列或接合焊盘的过孔连接。如图3b所示,注意到,上像素阵列301相对于图3a中的图示被倒置,以准备将上像素阵列301放置在下像素阵列302上。
如图3c所示,根据晶圆在晶圆上(wafer-on-water)的半导体芯片附接工艺,或晶片在晶片上(die-on-die)的半导体芯片附接工艺,将倒置的上像素阵列301降低到下像素阵列302上。
参考图3d,在上像素阵列301的背侧上沉积背侧金属化层109的下电介质层321。然后蚀刻电介质层321以形成穿过上像素阵列的半导体基体304的贯穿基体过孔322。基体过孔322具有不同的深度,如图3d所示。第一深度仅延伸到上像素阵列的前侧金属化层303中。第二深度更深地延伸到下像素阵列的前侧金属化层306中。
在实施例中,通过彼此掩蔽来控制两个不同的蚀刻深度。即,当正在蚀刻所述蚀刻深度中的一个时,通过掩蔽层覆盖将要被蚀刻的另一个蚀刻深度的区域。如此,使用两种不同的掩模序列来形成两个蚀刻深度。这允许不同的蚀刻工艺(例如用于较深蚀刻的较长蚀刻时间)。可以例如用反应离子蚀刻(RIE)或深反应离子蚀刻(DRIE)进行蚀刻。
如图3e所示,完成上像素阵列301的背侧金属化层309,包括用导电材料(例如金属)填充蚀刻区域,以及形成将上和下像素阵列301、302彼此电连接的特征部。在一种方法中,用导电材料填充蚀刻区域首先包括用绝缘材料(例如二氧化硅)填充蚀刻区域以在沟槽内形成绝缘内衬,然后以类似于该区域最初被蚀刻的方式蚀刻绝缘材料以形成开口。再次,这些蚀刻可以采用不同的相应掩模来进行。在区域被再蚀刻之后,它们用金属填充。
图3f示出了在背侧金属化层309上方形成滤光层310。滤光层可以通过在背侧金属化层310的表面上形成媒染(mordent)或透明层来形成。然后,通过在媒介或透明层中的合适区域中使该层染色成适当的颜色(绿色“G”)而在媒介或透明层中形成第一类型的可见光滤光器311_1(例如绿色“G”滤光器)。染色可以通过以下方式实现:通过光抗蚀剂掩模而将媒染染料热传送到媒染层中,然后剥离掩模;或者,通过光抗蚀剂掩模而将染料吸入透明层,然后剥离掩模。这里,光抗蚀剂和掩模被图案化,以便暴露感兴趣的区域(G像素区域)并且阻挡其它区域(R和B区域)。然后,该工艺适当地对于其它区域和颜色进行重复(例如R区域311_2和B区域(图3f中未示出))。
如图3g所示,蚀刻滤光层310以形成蚀刻区域324。根据实施方式的不同,蚀刻区域324可以具有相同的深度或具有不同的深度。再次,单独掩蔽可以用于形成不同的蚀刻深度。如图3g所示,在实施例中,至少一些蚀刻深度延伸穿过上像素阵列半导体基体304并且延伸到下像素阵列302的前侧金属化层306中。下文将会更加明显,这些蚀刻区域支持贯穿基体过孔,该过孔连接到堆叠RGBZ像素阵列的I/O接合焊盘。其它蚀刻深度(未示出)可以仅延伸到上像素阵列301的背侧金属化层309中,使得I/O接合焊盘可以直接连接到在该层内的特征部。
图3h示出了在蚀刻区域324中形成贯穿基体过孔,并且在其上布置结合焊盘325之后的结构。过孔可以类似于图3e的过孔形成。
图3i示出了在滤光层310上形成微透镜阵列312之后的完成的堆叠RGBZ像素阵列。微透镜可以通过以下多种不同工艺中的任何一种形成,如:1)在下层结构上涂覆和烘烤一个或多个光抗蚀剂层,将光抗蚀剂层图案化成例如代表微透镜阵列的圆/圆柱体,然后将光抗蚀剂的圆/圆柱体熔化成微透镜的形状;2)在透明层(例如熔融石英)上的层上执行上述1)工艺,并且使用熔融的光抗蚀剂作为到透明层中的RIE蚀刻的掩模(其完成到透明层中的更完整的微透镜的形成);3)微喷射液滴,其瞄准阵列图案中的下层结构并且固化液滴。
图4a至4d示出了用于上述堆叠像素阵列结构的不同的架构可能。理解到存在一系列不同的架构可能,图4a示出了朝向范围(spectrum)的一端的实施例,而图4b示出了朝向范围的另一端的实施例。依据除了像素阵列之外有多少图像传感器功能集成在堆叠半导体晶片结构上而对范围端进行分类。
回想到晶体管可以例如在两个像素阵列的外围形成,这样的晶体管通常是用于形成执行图像传感器功能的电路。在更多的图像传感器功能被集成在具有有源像素阵列的晶片的一个上的情况下,这样的晶体管的数量(以及它们占用的相应的半导体表面面积)将增加;并且,在更少的图像传感器功能被集成在具有有源像素阵列的晶片上的情况下,这样的晶体管的数量(以及它们占用的相应的半导体表面面积)将减少。
如本领域中所理解的,图像传感器通常可以被视为不仅包括有源像素阵列,而且还包括像素阵列电路、模数转换电路以及定时和控制电路。像素阵列电路通常包括直接与有源像素阵列本身通信的电路。示例包括感测放大器、行和列地址解码器,并且在用于飞行时间测量的Z像素的情况下,还包括用于执行飞行时间测量的每个Z像素的至少一个时钟信号。模数电路负责将从入射光信号检测的模拟信号转换为数字值。定时和控制电路负责向像素阵列电路和模数转换器电路提供适当的时钟信号和控制信号。
朝向范围的一端,如图4a所示,几乎没有这样的功能被放置在任一像素阵列晶片上,使得大部分这样的功能被放置在被实施为半导体芯片的第三下基体上。朝向范围的另一端,如图4b所示,大量这样的功能被放置在两个像素阵列晶片上。在图4b的特定实施例中,上晶片对应于整个RGB图像传感器,下晶片对应于整个飞行时间图像传感器。在这种情况下,下基体可以实施为封装基体。
在这两个范围端区域之间存在大量的架构可能性。例如,如图4c所示,像素阵列电路仅在其各自的像素阵列晶片上实施,留下用于两个图像传感器的定时和控制电路以及模数电路在最下方的半导体芯片晶片上实施。
作为另一示例,如图4d所示,下像素阵列晶片包括用于上像素阵列和下像素阵列的定时和控制电路和ADC电路。注意到,在下像素阵列晶片包括支持上像素阵列的电路的情况下,下像素阵列的顶表面应具有连接到下像素阵列晶片内部电路的焊盘(pad)/地线(land),而不是下像素阵列晶片的贯穿基体过孔。从图4a到4d,普通技术人员将认识到,存在大量的架构可能性,其中,用于图像传感器对或其部分的各个电路可以位于上像素阵列晶片、下像素阵列晶片和下基体半导体芯片(如果有的话)中的任一者上。
图5示出了由上述RGBZ图像传感器实施例执行的方法。如图5所示,在第一像素阵列的表面处接收入射可见光和IR光501。采用第一像素阵列感测可见光但不感测IR光,并且IR光穿过第一像素阵列502。采用位于第一像素阵列下方的第二像素阵列感测IR光503。
图6示出了集成传统相机和飞行时间成像的系统600。系统600具有连接器601,其用于例如与较大系统/母板(如膝上型计算机的系统/母板、平板电脑或智能手机)进行电接触。根据布局和实施方式,连接器601可以连接到柔性电缆,例如实体连接到系统/母板,或者连接器601可以直接接触系统/母板。
连接器601固定到平面板602,平面板602可以实施为交替导电层和绝缘层的多层结构,其中导电层被图案化以形成支持系统600的内部电连接的电迹线。通过连接器601,来自较大的主机系统的命令被接收,如向/从相机系统600内的配置寄存器的写入/读取配置信息的配置命令。
“RGBZ”图像传感器位于安装到平面板602的半导体芯片封装体603内,所述“RGBZ”图像传感器包括RGB像素阵列组,该RGB像素阵列组在堆叠在具有IR像素以例如实施飞行时间像素的第二半导体晶片上的第一半导体晶片上实施。堆叠RGBZ图像传感器包括具有对可见光敏感的不同种类的像素的上RGB像素阵列(具体地,对可见红光敏感的R像素子集,对可见绿光敏感的G像素子集和对可见蓝光敏感的B像素子集)。下Z像素阵列具有对IR光敏感的像素。RGB像素用于支持传统的“2D”可见图像采集(传统图像采集)功能。IR敏感像素用于支持使用飞行时间技术的3D深度轮廓成像。尽管基本实施例包括用于可见图像采集的RGB像素,但是其它实施例可以使用不同颜色的像素方案(例如青色、品红色和黄色)。RGBZ图像传感器还可以包括用于两个像素阵列的ADC电路以及定时和控制电路。
平面板602同样可以包括信号迹线,以将由ADC电路提供的数字信息传送到连接器601,以由计算系统的高端部件处理,如图像信号处理管线(例如集成在应用处理器上的)。注意到,在其它实施例中,对ADC输出像素流操作的图像信号处理管线或至少某些形式的数字信号处理可以利用在集成到相机系统600中的半导体芯片上的数字逻辑电路执行。
相机透镜模块604集成在RGBZ图像传感器603的像素阵列上方。相机模块604包括具有一个或多个透镜的系统,以聚焦通过RGBZ图像传感器封装体603的光阑所接收的光。
由在光阑606下方的光源阵列组成的照明器607也安装在平面板602上。光源阵列可以实施为垂直腔侧发射激光器(VCSEL)或发光二极管(LED)的阵列,其实施为在安装到平面板601的半导体芯片上。可替代地,可以使用单个光源(例如与阵列相对的单个VCSEL或LED)。光源驱动器联接到光源阵列以使其发射具有特定强度和调制波形的光。
在实施例中,图6的集成系统600支持三种操作模式:1)2D模式;3)3D模式;以及,3)2D/3D模式。在2D模式的情况下,系统表现为传统相机。如此,照明器607被禁用,并且图像传感器用于通过其RGB像素接收可见图像。在3D模式的情况下,系统采集照明器607和相机透镜模块604的视场中的物体的飞行时间深度信息。因此,启用照明器并且发射IR光(例如,以开-关-开-关...的序列)到对象上。IR光从物体反射,通过相机透镜模块604接收,并且由图像传感器的飞行时间像素感测。在2D/3D模式的情况下,上述2D和3D模式同时有效。
图7示出了示例性计算系统700的描绘,如个人计算系统(例如台式机或膝上型计算机)或移动或手持计算系统(例如平板设备或智能电话)。如图7所示,基本计算系统可以包括中央处理单元701(其可以包括例如多个通用处理核)和设置在应用处理器或多核处理器750上的主内存控制器717、系统内存702、显示器703(例如触摸屏、平板),本地有线点对点链路(例如USB)接口704、各个网络I/O功能705(例如以太网接口和/或蜂窝调制解调器子系统)、无线局域网(例如WiFi)接口706、无线点对点链路(例如蓝牙)接口707和全球定位系统接口708、各个传感器709_1至709_N、一个或多个相机710、电池711、电源管理控制单元712、扬声器和麦克风713以及音频编码器/解码器714。
应用处理器或多核处理器750可以包括在其CPU 701内的一个或多个通用处理核715、一个或多个图形处理单元716、主内存控制器717、I/O控制功能718和一个或多个图像信号处理器管线719。通用处理核715通常执行计算系统的操作系统和应用软件。图形处理单元716通常执行图形密集函数以例如产生呈现在显示器703上的图形信息。内存控制功能717与系统内存702接口连接。图像信号处理管线719从相机接收图像信息并且处理原始图像信息以供下游使用。功率管理控制单元712通常控制系统700的功率消耗。
触摸屏显示器703、通信接口704-707、GPS接口708、传感器709、相机710和扬声器/麦克风编解码器713、714中的每一个都可以被视为相对于整体计算系统的各种形式的I/O(输入和/或输出),在适当时也包括集成外围设备(例如一个或多个相机710)。根据实施方式,这些I/O组件中的各个可以集成在应用处理器/多核处理器750上,或者可以位于晶片外或应用处理器/多核处理器750的封装之外。
在一个实施例中,一个或多个相机710包括集成传统可见图像采集和飞行时间深度测量的系统,如上面参照图6所述的系统600。在应用处理器或其它处理器的通用CPU核(或具有用以执行程序代码的指令执行管线的其它功能块)上执行的应用软件、操作系统软件、设备驱动器软件和/或固件可以将命令引导到相机系统并且从相机系统接收图像数据。在命令的情况下,命令可以包括进入或退出上述2D、3D或2D/3D系统状态中的任一个。
本发明的实施例可以包括如上所述的各种过程。过程可以体现在机器可执行指令中。指令可以用于使通用或专用处理器执行某些处理。可替代地,这些过程可以由包括用于执行过程的硬连线逻辑的特定硬件组件或由编程的计算机组件和定制硬件组件的任何组合来执行。
本发明的元件还可以被提供为用于存储机器可执行指令的机器可读介质。机器可读介质可以包括但不限于软盘、光盘、CD-ROM和磁光盘、FLASH内存、ROM、RAM、EPROM、EEPROM、磁卡或光卡、传播介质或其它适合于存储电子指令的媒体类型/机器可读介质。例如,本发明可以作为计算机程序被下载,该计算机程序可以通过在载波或其它传播介质中体现的数据信号经由通信链路(例如调制解调器或网络连接)从远程计算机(例如服务器)传送到请求计算机(例如客户端)
在前述说明书中,已经参考本发明的具体示例性实施例描述了本发明。然而,将显而易见的是,在不脱离如所附权利要求中阐述的本发明的更广泛的精神和范围的情况下,可以对其进行各种修改和改变。因此,说明书和附图被认为是说明性的而不是限制性的。

Claims (21)

1.一种装置,包括:
第一半导体芯片,其具有第一像素阵列,所述第一像素阵列具有可见光敏感像素;以及
第二半导体芯片,其具有第二像素阵列,所述第一半导体芯片堆叠在所述第二半导体芯片上,使得所述第二像素阵列位于所述第一像素阵列下方,所述第二像素阵列具有用于基于飞行时间的深度检测的IR光敏感像素。
2.如权利要求1所述的装置,其中,所述第一半导体芯片比所述第二半导体芯片薄。
3.如权利要求1所述的装置,其中,所述第二半导体芯片堆叠在第三半导体芯片上。
4.如权利要求3所述的装置,其中,所述第三半导体芯片包括以下中的任意项:
联接到所述第一像素阵列的像素阵列电路;
联接到所述第二像素阵列的像素阵列电路;
联接到所述第一像素阵列的ADC电路;
联接到所述第二像素阵列的ADC电路;
联接到所述第一像素阵列的定时和控制电路;
联接到所述第二像素阵列的定时和控制电路。
5.如权利要求1所述的装置,其中,所述第一半导体芯片包括以下中的任意项:
联接到所述第一像素阵列的像素阵列电路;
联接到所述第一像素阵列的ADC电路;
联接到所述第一像素阵列的定时和控制电路。
6.如权利要求1所述的装置,其中,所述第二半导体芯片包括以下中的任意项:
联接到所述第二像素阵列的像素阵列电路;
联接到所述第二像素阵列的ADC电路;
联接到所述第二像素阵列的定时和控制电路。
7.如权利要求1所述的装置,其中,所述第二半导体芯片安装在封装基体上。
8.如权利要求1所述的装置,其中,所述第一半导体芯片包括贯穿基体过孔。
9.如权利要求1所述的装置,还包括形成在所述第一半导体芯片上的微透镜阵列。
10.如权利要求9所述的装置,其中,所述第二半导体芯片不具有形成在其上的微透镜阵列。
11.一种方法,包括:
在第一像素阵列的表面处接收可见光和IR光;
利用所述第一像素阵列感测所述可见光但不感测所述IR光,所述IR光穿过所述第一像素阵列;
利用位于所述第一像素阵列下方的第二像素阵列感测所述IR光。
12.如权利要求11所述的方法,其中,所述感测IR光还包括感测飞行时间深度信息。
13.如权利要求11所述的方法,其中,所述方法还包括通过所述第二像素阵列的半导体基体向/从所述第一像素阵列运转信号。
14.如权利要求11所述的方法,其中,所述感测所述可见光和所述感测所述IR光同时进行。
15.如权利要求11所述的方法,还包括利用所述第二像素的半导体芯片堆叠在其上的半导体芯片执行用于所述第一像素阵列和所述第二像素阵列中的任一个或两个的模数转换和/或定时和控制功能。
16.一种装置,包括:
应用处理器,其具有多个处理核和联接到所述多个处理核的内存控制器;
相机系统,其联接到所述应用处理器,所述相机系统包括:
第一半导体芯片,其具有第一像素阵列,所述第一像素阵列具有可见光敏感像素;以及
第二半导体芯片,其具有第二像素阵列,所述第一半导体芯片堆叠在所述第二半导体芯片上,使得所述第二像素阵列位于所述第一像素阵列下方,所述第二像素阵列具有用于基于飞行时间的深度检测的IR光敏感像素。
17.如权利要求16所述的装置,其中,所述第一半导体芯片比所述第二半导体芯片薄。
18.如权利要求16所述的装置,其中,所述第二半导体芯片堆叠在第三半导体芯片上。
19.如权利要求18所述的装置,其中,所述第三半导体芯片包括以下中的任意项:
联接到所述第一像素阵列的像素阵列电路;
联接到所述第二像素阵列的像素阵列电路;
联接到所述第一像素阵列的ADC电路;
联接到所述第二像素阵列的ADC电路;
联接到所述第一像素阵列的定时和控制电路;
联接到所述第二像素阵列的定时和控制电路。
20.如权利要求18所述的装置,其中,所述第一半导体芯片包括以下中的任意项:
联接到所述第一像素阵列的像素阵列电路;
联接到所述第一像素阵列的ADC电路;
联接到所述第一像素阵列的定时和控制电路。
21.如权利要求18所述的装置,其中,所述第二半导体芯片包括以下中的任意项:
联接到所述第二像素阵列的像素阵列电路;
联接到所述第二像素阵列的ADC电路;
联接到所述第二像素阵列的定时和控制电路。
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