CN105303127A - 一种基于三态反相器的物理不可克隆函数电路结构及其应用 - Google Patents
一种基于三态反相器的物理不可克隆函数电路结构及其应用 Download PDFInfo
- Publication number
- CN105303127A CN105303127A CN201510720177.3A CN201510720177A CN105303127A CN 105303127 A CN105303127 A CN 105303127A CN 201510720177 A CN201510720177 A CN 201510720177A CN 105303127 A CN105303127 A CN 105303127A
- Authority
- CN
- China
- Prior art keywords
- tristate inverter
- circuit structure
- clone
- physics
- matrixes
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F21/00—Security arrangements for protecting computers, components thereof, programs or data against unauthorised activity
- G06F21/70—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer
- G06F21/71—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer to assure secure computing or processing of information
- G06F21/72—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer to assure secure computing or processing of information in cryptographic circuits
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Theoretical Computer Science (AREA)
- Mathematical Physics (AREA)
- Computer Security & Cryptography (AREA)
- Software Systems (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Semiconductor Integrated Circuits (AREA)
- Logic Circuits (AREA)
Abstract
本发明公开了一种基于三态反相器的物理不可克隆函数电路结构及其应用,该电路包括两个相同的交叉耦合三态反相器矩阵,其利用两个三态反相器矩阵制造工艺偏差导致的竞争冒险来产生随机响应值。本发明提供的新型的低成本的物理不可克隆函数电路结构,适用于可编程逻辑器件和专用数字集成电路,功耗低,安全性高。
Description
技术领域
本发明涉及信息安全硬件加密技术领域,特别是涉及物理不可克隆函数。
背景技术
物理不可克隆函数是一种新兴的,利用集成电路制造工艺不可预测的偏差来对其进行加密的技术。对每个芯片来说,工艺偏差都是其独有的并且在相同的激励下能够产生不同的随机序列。物理不可克隆函数能够利用这些独特的加密信息进行加密认证和识别。
目前已提出多种物理不可克隆函数的电路结构。例如基于仲裁器的物理不可克隆函数、基于环形振荡器的物理不可克隆函数以及基于随机静态存储器的物理不可克隆函数等。基于仲裁器的物理不可克隆函数是在电路中设置两天完全对称的信号传输路径,通过比较两条路径中信号到达的先后顺序来决定输出的高低电平。基于环形振荡器的物理不可克隆函数是通过比较环形振荡器之间频率的差异来实现响应输出。而基于静态随机存储器的物理不可克隆函数是利用静态随机存储单元在上电时的瞬态特性而建立的物理不可克隆函数结构,是一种低成本的实现技术。一个静态随机存储器单元是由两个交叉耦合的反相器组成。上电后,一个微小的电压差就会使得其输出电压稳定在状态0或者1。但是这种物理不可克隆函数需要后置处理电路来增强其安全性能,增加了系统的复杂性和成本。
发明内容
为了克服上述现有技术中的不足,本发明提供了一种基于三态反相器的增强型类静态随机存储器物理不可克隆函数,这种新型的物理不可克隆函数结构能够在没有后处理电路的情况下产生足够的激励响应对。
本发明所采取的技术方案是:一种基于三态反相器的物理不可克隆函数电路结构,它的基本单元包括两个相同的交叉耦合的三态反相器矩阵,它利用两个三态反相器矩阵制造工艺偏差导致的竞争冒险来产生随机响应值,每个矩阵中包含n(n>0)个平行的三态反相器,每个三态反相器的使能端分别为激励组I和激励组II。
上述三态反相器,当没有任何激励信号时,电路输出为高阻态。当激励信号中包含一个或多个使能信号时,两个矩阵中的三态反相器便会形成一个高效的静态随机存储器物理不可克隆函数。
进一步地,所述的三态反相器单元由两个PMOS和两个NMOS组成。当输入使能信号激励时,三态反相器单元便会随之输出相应的1-bit响应。
当两个矩阵中分别只有一个三态反相器单元工作时,其工作流程就像基于静态随机存储器的物理不可克隆函数;当两矩阵中分别有两个及以上的三态反相器使能工作时,附加电流会增加响应的唯一性。同时工作的三态反相器数量由使能信号来决定,与传统结构相比这种可重构型结构能够在没有后置处理电路的情况下产生足够的激励响应对。
本发明具有如下有益效果:
(1)与传统的电路结构相比,本发明采用两个相同的交叉耦合的三态反相器矩阵,使用了数量最少的门电路来产生一个比特的响应,大大提高了资源的利用率;
(2)本发明提供的物理不可克隆函数电路结构经过验证,具有较好的唯一性与可靠性,适用于低功耗、低成本的应用;
(3)在专用数字集成电路和可编程逻辑器件上的实现表示了本发明在不同平台上的实用性和其优越性。
附图说明
以下将结合附图对本发明作进一步说明:
图1为本发明的基于三态反相器的物理不可克隆函数电路结构;
图2为三态反相器的原理图;
图3为五级三态随机存储器单元的工作过程;
图4为五级三态随机存储器单元的蒙特卡罗仿真结果;
图中,c1[n]、c2[n]对应为两个交叉耦合三态反相器矩阵钟的三态反相器。
具体实施方式
本发明提供一种基于三态反相器的物理不可克隆函数电路结构,为使本发明的目的,技术方案及效果更加清楚和明确,参照附图并举实例对本发明进一步详细说明。应当理解,此处所描述的具体实施仅用以解释本发明,并不用于限定本发明。
本发明提供的这种种基于三态反相器的物理不可克隆函数电路结构的通用结构如图1所示,包括两个相同的交叉耦合三态反相器矩阵,每个矩阵中包含n(n>0)个平行的三态反相器单元,两个三态反相器的使能端分别为激励组I和激励组II。它利用两个三态反相器矩阵制造工艺偏差导致的竞争冒险来产生随机响应值。
每个三态反相器单元由两个PMOS和两个NMOS组成,其原理如图2所示,每个三态反相器由两个PMOS和两个NMOS组成,其原理如图2所示:PM1的源极与电源电压相连,其漏极与PM2的源极相连;PM2的漏极与NM1的漏极相连,并与电路的输出端口(Out)相接;而NM2的漏极和源极分别与NM1的源极以及地端相连;PM1和NM2的栅极相连,并与数据输入端口(In)相接;NM1和PM2的栅极分别连接使能信号(En)与其取反的值(/En),保证了电路在无使能信号时输出呈高阻态,而在有使能信号时将输入信号取反。当没有任何激励信号时,电路输出为高阻态;当激励信号中包含一个或多个使能信号时,两个三态反相器矩阵中的三态反相器便会形成一个高效的静态随机存储器物理不可克隆函数。
以一个五级的三态反相器电路结构为例,如图2所示,其包括两个相同的交叉耦合三态反相器矩阵,每个矩阵中包含5个平行的三态反相器,每个三态反相器单元由两个PMOS和两个NMOS组成,每个三态反相器单元的使能端分别为激励组I和激励组II。如果在整个电路中设置128个这样的电路结构,统一输入两组激励信号,分别是激励组一[11000],激励组二[10001],如图2所示,在反相器矩阵C1中只有C1[1]和C1[2]处于使能状态,C1[3],C1[4]和C1[5]均处于高阻抗状态。同样的在反相器矩阵C2中的C2[1]和C2[5]处于使能状态,C1[2],C1[3]和C1[4]处于高阻抗状态。于是这四个使能的三态反相器便组成了一个亚稳态环路,相应的1—bit响应由它们之间的竞争来随机产生。
整个电路将会产生128bit的随机响应值,形成了一个高效的静态随机存储器物理不可克隆函数电路结构。
在蒙特卡罗仿真中,在图3中可以清晰看到在40ps内电路随机稳定在低电平或者高电平并且在不同激励下产生不同的响应。
以上实施例仅为说明本发明的技术思想,不能以此限定本发明的保护范围,凡是按照本发明提出的技术思想,在技术方案基础上所做的任何改动,均落入本发明保护范围之内。
Claims (4)
1.一种基于三态反相器的物理不可克隆函数电路结构,其特征在于:该电路包括两个相同的交叉耦合三态反相器矩阵,其利用两个三态反相器矩阵制造工艺偏差导致的竞争冒险来产生随机响应值。
2.根据权利要求1所述的一种基于三态反相器的物理不可克隆函数电路结构,其特征在于:每个矩阵中均包含n个平行的三态反相器单元,n为正整数,两个矩阵的使能端分别为激励组I和激励组II。
3.根据权利要求2所述的一种基于三态反相器的物理不可克隆函数电路结构,其特征在于:所述的三态反相器单元由两个PMOS和两个NMOS组成。
4.一种物理不可克隆函数电路结构在数字集成电路中的应用,其特征在于,将所述电路结构运用到数字集成电路中,形成多组基于三态反相器的物理不可克隆函数电路,其激励信号共用激励组I和激励组II的输入信号,当没有任何激励信号时,电路输出为高阻态;当激励信号中包含一个或多个使能信号时,所述三态反相器单元形成一个高效的静态随机存储器物理不可克隆函数。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201510720177.3A CN105303127B (zh) | 2015-10-30 | 2015-10-30 | 基于三态反相器的物理不可克隆函数电路结构及其应用 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201510720177.3A CN105303127B (zh) | 2015-10-30 | 2015-10-30 | 基于三态反相器的物理不可克隆函数电路结构及其应用 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN105303127A true CN105303127A (zh) | 2016-02-03 |
CN105303127B CN105303127B (zh) | 2018-05-22 |
Family
ID=55200381
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201510720177.3A Active CN105303127B (zh) | 2015-10-30 | 2015-10-30 | 基于三态反相器的物理不可克隆函数电路结构及其应用 |
Country Status (1)
Country | Link |
---|---|
CN (1) | CN105303127B (zh) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN109460681A (zh) * | 2018-10-22 | 2019-03-12 | 南京航空航天大学 | 一种基于延时链的可配置物理不可克隆函数电路 |
CN110034934A (zh) * | 2019-03-26 | 2019-07-19 | 中国计量大学上虞高等研究院有限公司 | 基于瞬态的can总线安全鉴定方法 |
CN111490758A (zh) * | 2020-04-15 | 2020-08-04 | 芯峰科技(广州)有限公司 | 基于仲裁器puf的可靠性增强结构及增强方法 |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2002052782A1 (fr) * | 2000-12-26 | 2002-07-04 | Stmicroelectronics Sa | Circuit logique a polarites internes variables |
CN102710252A (zh) * | 2012-05-28 | 2012-10-03 | 宁波大学 | 一种高稳态多端口puf电路 |
CN102710251A (zh) * | 2012-05-28 | 2012-10-03 | 宁波大学 | 一种puf电路单元 |
CN103198268A (zh) * | 2013-03-18 | 2013-07-10 | 宁波大学 | 一种可重构多端口物理不可克隆函数电路 |
CN103198267A (zh) * | 2013-03-18 | 2013-07-10 | 宁波大学 | 一种可重构多端口puf电路单元 |
CN104168264A (zh) * | 2014-07-11 | 2014-11-26 | 南京航空航天大学 | 一种低成本、高安全性物理不可克隆函数 |
CN104283549A (zh) * | 2014-09-15 | 2015-01-14 | 宁波大学 | 一种基于mosfet零温度系数点的puf电路 |
-
2015
- 2015-10-30 CN CN201510720177.3A patent/CN105303127B/zh active Active
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2002052782A1 (fr) * | 2000-12-26 | 2002-07-04 | Stmicroelectronics Sa | Circuit logique a polarites internes variables |
CN102710252A (zh) * | 2012-05-28 | 2012-10-03 | 宁波大学 | 一种高稳态多端口puf电路 |
CN102710251A (zh) * | 2012-05-28 | 2012-10-03 | 宁波大学 | 一种puf电路单元 |
CN103198268A (zh) * | 2013-03-18 | 2013-07-10 | 宁波大学 | 一种可重构多端口物理不可克隆函数电路 |
CN103198267A (zh) * | 2013-03-18 | 2013-07-10 | 宁波大学 | 一种可重构多端口puf电路单元 |
CN104168264A (zh) * | 2014-07-11 | 2014-11-26 | 南京航空航天大学 | 一种低成本、高安全性物理不可克隆函数 |
CN104283549A (zh) * | 2014-09-15 | 2015-01-14 | 宁波大学 | 一种基于mosfet零温度系数点的puf电路 |
Non-Patent Citations (1)
Title |
---|
张学龙: ""物理不可克隆函数电路研究"", 《中国优秀硕士学位论文全文数据库信息科技辑》 * |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN109460681A (zh) * | 2018-10-22 | 2019-03-12 | 南京航空航天大学 | 一种基于延时链的可配置物理不可克隆函数电路 |
CN109460681B (zh) * | 2018-10-22 | 2021-09-17 | 南京航空航天大学 | 一种基于延时链的可配置物理不可克隆函数电路 |
CN110034934A (zh) * | 2019-03-26 | 2019-07-19 | 中国计量大学上虞高等研究院有限公司 | 基于瞬态的can总线安全鉴定方法 |
CN111490758A (zh) * | 2020-04-15 | 2020-08-04 | 芯峰科技(广州)有限公司 | 基于仲裁器puf的可靠性增强结构及增强方法 |
CN111490758B (zh) * | 2020-04-15 | 2023-08-15 | 芯峰科技(广州)有限公司 | 基于仲裁器puf的可靠性增强结构及增强方法 |
Also Published As
Publication number | Publication date |
---|---|
CN105303127B (zh) | 2018-05-22 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US10498544B2 (en) | Security device having physical unclonable function | |
Liu et al. | XOR-based low-cost reconfigurable PUFs for IoT security | |
CN104318181B (zh) | 基于阈值偏差延迟的物理不可克隆函数电路 | |
CN103198268A (zh) | 一种可重构多端口物理不可克隆函数电路 | |
CN107145804B (zh) | 一种基于fpga的低开销的ro puf电路结构 | |
CN103198267B (zh) | 一种可重构多端口puf电路单元 | |
Mansouri et al. | Ring oscillator physical unclonable function with multi level supply voltages | |
CN104168264B (zh) | 一种低成本、高安全性物理不可克隆函数电路 | |
CN109460681A (zh) | 一种基于延时链的可配置物理不可克隆函数电路 | |
CN106850227A (zh) | 一种采用cnfet实现的三值puf单元及电路 | |
CN105303127A (zh) | 一种基于三态反相器的物理不可克隆函数电路结构及其应用 | |
CN112713894B (zh) | 一种强弱混合型puf电路 | |
Zhou et al. | FPGA‐based RO PUF with low overhead and high stability | |
KR102122457B1 (ko) | Puf를 갖는 보안 장치 | |
CN104320246A (zh) | 一种可配置型的多位密钥输出TVD-PUFs电路 | |
CN109167664A (zh) | 一种基于异或门的可重构环形振荡器puf电路 | |
CN113946882B (zh) | 基于施密特触发器的超低功耗弱物理不可克隆函数电路 | |
US11303461B2 (en) | Security device having physical unclonable function | |
CN104300508A (zh) | 级联电池保护电路和系统 | |
CN105404739B (zh) | 一种基于非对称天线效应的cmos片上恒稳定id产生电路 | |
Sahoo et al. | Fault tolerant implementations of delay-based physically unclonable functions on FPGA | |
Lang et al. | Design of ternary clock generator | |
CN109086631B (zh) | 一种抗模型攻击的强/弱混合型puf电路 | |
Chiou et al. | A reliable delay-based physical unclonable function with dark-bit avoidance | |
CN204230871U (zh) | 级联电池保护电路和系统 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
C06 | Publication | ||
PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
GR01 | Patent grant | ||
GR01 | Patent grant |