CN105118465B - 一种goa电路及其驱动方法、液晶显示器 - Google Patents

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Abstract

本发明公开了一种GOA电路及其驱动方法、液晶显示器,该GOA电路包括多个级联的GOA子电路,设定N为正整数,其中,第N级GOA子电路包括第N级级传电路、第N级Q点控制电路、第N级P点控制电路、第N级输出电路以及开关电路;开关电路连接第N级扫描线G(N),用于在液晶显示器显示前向第N级扫描线G(N)通入一开启信号,以使第N级扫描线G(N)连接的像素中的薄膜晶体管导通。通过上述方式,本发明能够在显示器黑屏唤醒时打开各个像素的gate端,向各级像素接入低电平信号,防止显示器在黑屏唤醒时漏电的情况,同时提高电路的稳定性。

Description

一种GOA电路及其驱动方法、液晶显示器
技术领域
[0001] 本发明涉及显示技术领域,特别是涉及一种G0A电路及其驱动方法、液晶显示器。
背景技术
[0002] 阵列基板行驱动(G0A,Gate Driver On Array或Gate On Array)电路,是利用现 有薄膜晶体管显示装置(TFT-LCD)阵列(Array)制程将栅线(Gate)行扫描驱动信号电路制 作在阵列基板上,以实现对栅线逐行扫描的驱动方式的一项技术。其与传统的柔性电路板 (C0F)和玻璃电路板(C0G)工艺相比,不仅节省了制作成本,而且还可以省去栅极方向邦定 (Bonding)的工艺,对提升产能极为有利,并提尚了显不装置的集成度。
[0003] 在实际使用时,由于显示装置通常需要搭配触摸屏(Touch Panel)功能进行使用, 因此G0A电路需要实现信号中停以配合触摸屏的功能,如配合触摸屏的扫描。通常情况下, G0A电路在实现信号中停后,需将显示装置进行黑屏唤醒,此时G0A电路需要在一段时间内 将所有的栅线均设置为导通状态,通过向数据线施加黑电压以清空像素电容中残留的电 平,以使得显示装置的显示效果良好,此段时间称为栅线全开(All Gate On)阶段。但是现 有技术中的G0A电路在实现All Gate On时会存在功能失效风险,进而不能稳定的实现All Gate On功能。
发明内容
[0004] 本发明主要解决的技术问题是提供一种G0A电路及其驱动方法、液晶显示器,能够 在显示器黑屏唤醒时打开各个像素的gate端,向各级像素入低电平信号,防止显示器在黑 屏唤醒时漏电的情况,同时提高电路的稳定性。
[0005] 为解决上述技术问题,本发明采用的一个技术方案是:提供一种G0A电路,用于液 晶显示器,该G0A电路包括多个级联的G0A子电路,第N级G0A子电路包括第N级级传电路、第N 级Q点控制电路、第N级P点控制电路、第N级输出电路以及开关电路;其中,第N级级传电路、 第N级Q点控制电路、第N级P点控制电路以及第N级输出电路连接于Q点,第N级Q点控制电路、 第N级P点控制电路以及第N级输出电路连接于P点,第N级输出电路连接第N级扫描线G(N); 开关电路连接第N级扫描线G (N),用于在液晶显示器显示前向第N级扫描线G 通入一开启 信号,以使第N级扫描线G⑼连接的像素中的薄膜晶体管导通。
[0006] 其中,开关电路包括第一薄膜晶体管T1,其源极连接第N级扫描线G (N),其漏极连 接其栅极并接入一开启信号Gas,在液晶显示器显示前,开启信号Gas为低电平信号,以使第 N级扫描线G (N)通入低电平信号,从而使第N级扫描线G (N)连接的像素中的薄膜晶体管导 通。
[0007] 其中,第N级级传电路包括第二薄膜晶体管T2、第三薄膜晶体管T3以及第四薄膜晶 体管T4;第二薄膜晶体管T2的栅极接入第N-2级G0A子电路的输出信号G(N_2),漏极接入正 向扫描信号U2D;第三薄膜晶体管T3的栅极接入第N+2级G0A子电路的输出信号G (N+2),漏极 接入反向扫描信号D2U;第四薄膜晶体管T4的栅极接入第一时钟信号XCK(N),漏极连接第二 薄膜晶体管T2和第三薄膜晶体管T3的源极,源极连接Q点。
[000S] 其中,第N级P点控制电路包括第五薄膜晶体管T5以及第六薄膜晶体管T6;第五薄 膜晶体管T5的栅极连接Q点,漏极接入第一时钟信号XCK(N),源极连接P点;第六薄膜晶体管 T6的栅极接入第一时钟信号XCK (N),漏极接入一低电平信号,源极连接P点。
[0009] 其中,第N级Q点控制电路包括第七薄膜晶体管T7以及第八薄膜晶体管T8;第七薄 膜晶体管17的栅极接入第二时钟信号CK (N),漏极连接Q点;第八薄膜晶体管T8的栅极连接P 点,漏极连接第七薄膜晶体管T7的源极,源极接入一高电平信号。
[0010]其中,第N级输出电路包括第九薄膜晶体管T9以及第十薄膜晶体管H0;第九薄膜 晶体管T9的栅极连接Q点,漏极接入第二时钟信号CK(N),源极连接第N级扫描线G(N);第十 薄膜晶体管H0的栅极连接P点,漏极连接第N级扫描线G(N),源极接入一高电平信号。
[0011] 其中,第N级扫描驱动电路还包括P点上拉电路;P点上拉电路包括第十一薄膜晶体 管T11,其栅极接入开启信号Gas,漏极连接P点,源极接入一高电平信号。
[0012]其中,第N级扫描驱动电路还包括复位电路;复位电路包括第十二薄膜晶体管T12, 其栅极和源极接入复位信号Reset,漏极连接P点。
[0013]为解决上述技术问题,本发明采用的另一个技术方案是:提供一种G0A电路的驱动 方法,应用于如上述的G0A电路,该方法包括:打开每一级G0A子电路的开关电路,向每一级 的扫描线通入一开启信号,以使每一级的扫描线连接的像素中的薄膜晶体管导通;关闭每 一级G0A子电路的开关电路,从第一级G0A子电路或最后一级G0A子电路开始扫描。
[0014]为解决上述技术问题,本发明采用的另一个技术方案是:提供一种液晶显示器,该 液晶显不器包括上述的G0A电路。
[0015]本发明的有益效果是:区别于现有技术的情况,本发明在G0A电路的每级G0A子电 路的第N级扫描线G 上增加一开关电路,用于在显示面板显示前,即黑屏唤醒或信号中停 时,向每级G0A子电路的第N级扫描线G(N)通入一开启信号以使每个像素的TFT打开,并对每 个像素通入低电平信号,以清除像素电容中的残留的电荷,进而实现All Gate On功能,有 利于防止显示器在黑屏唤醒时漏电的情况,同时提高电路的稳定性。
附图说明
[0016] 图1是本发明G0A电路第一实施方式的电路结构示意图;
[0017] 图2是本发明G0A电路第一实施方式中G0A子电路的电路示意图;
[0018] 图3是本发明G0A电路第二实施方式的电路结构示意图;
[0019] 图4是本发明G0A电路第二实施方式的电路图;
[0020] 图5是本发明G0A电路第二实施方式的电路时序图;
[0021]图6是本发明G0A电路的驱动方法一实施方式的流程图;
[0022] 图7是本发明液晶显示器一实施方式的结构示意图。
具体实施方式
[0023] 参阅图1,本发明G0A电路第一实施方式的电路结构示意图,该G0A电路包括多个级 联的G0A子电路,设定N为正整数,第N级G0A子电路100包括第N级扫描驱动电路101,用于驱 动显示区域的第N级扫描线G(N),第N级G0A子电路100还包括开关电路102,开关电路102连 接第N级扫描线G (N),用于在液晶显示器显示前响应一开启信号而导通,向第N级扫描线G ⑽通入低电平信号。可以理解的,第N级GOA子电路100包括开关电路1〇2即为每级的GOA子 电路均包括开关电路102。
[0024]其中,图1只示出了连续的三个G0A子电路,仅为举例,并不限制本实施方式中G0A 子电路的数量,而在具体应用中,显示面板中G0A电路的每级G0A子电路的gate端(即第N级 扫描线G(N))均连接该开关电路102,用于在显示面板黑屏唤醒或者信号中停时,向gate端 通入一开启信号以使每个像素的gate端打开。
[0025]参阅图2,在一具体的实施方式中,开关电路102包括第一薄膜晶体管H,其源极连 接第N级扫描线G(N),其漏极连接其栅极并接入一开启信号Gas,在液晶显示器显示前,开启 信号Gas为低电平信号,以使第N级扫描线G (N)通入低电平信号,在该实施方式中,每个像素 中的TFT也均为P型。
[0026]可以理解的是,第一薄膜晶体管T1为P型,当开启信号Gas为低电平时,第一晶体管 T1导通,将其漏极的开启信号Gas传递至源极,即第N级扫描线G(N)也为低电平,进而将该级 水平扫描线打开并通入低电平信号。同理在All Gate On阶段时通过控制该开启信号Gas将 全部G0A子电路对应的所有水平扫描线均打开并通入低电平信号,以在此时通过向数据线 上施加黑电压而将像素电容中的残留电平清除,进而实现All Gate On功能。
[0027]在其他实施方式中,若第一晶体管T1为N型,则其漏极连接第N级扫描线G(N),源极 通入一低电平信号,当All Gate On阶段时,向第一晶体管II的栅极加上高电平,则第N级扫 描线G〇^)就会通入低电平信号。同理,以下各个实施方式或各个电路中的薄膜晶体管的P型 或N型均可以替换,以下不再赘述。
[0028]区别于现有技术,本实施方式中在G0A电路的每级G0A子电路的第N级扫描线G (N) 上增加一开关电路,用于在显示面板显示前,即黑屏唤醒或信号中停时,向每级G0A子电路 的第N级扫描线G〇^)—开启信号以使每个像素的TFT打开,并对每个像素通入低电平信号, 以清除像素电容中的残留的电荷,进而实现All Gate On功能,有利于防止显示器在黑屏唤 醒时漏电的情况,同时提高电路的稳定性。
[0029] 参阅图3,本发明G0A电路第二实施方式的电路结构示意图,其中,第N级扫描驱动 电路包括第N级级传电路3〇1、第N级Q点控制电路302、第N级P点控制电路303以及第N级输出 电路304。
[0030] 其中,第N级级传电路301、第N级Q点控制电路302、第N级P点控制电路303以及第N 级输出电路连接于0点,第N级Q点控制电路302、第N级P点控制电路303以及第N级输出电路 304连接于P点。
[0031] 第N级级传电路301用于在正向扫描时接收第N-2级G0A子电路的输出信号G(N-2), 或在反向扫描时接收第N+2级G0A子电路的输出信号G(N+2),以使第N级扫描驱动电路开始 驱动第N级扫描线G (N)进行扫描;
[0032] 第N级P点控制电路303用于使输出电路304在扫描期间输出高电平的扫描信号; [0033] 第N级Q点控制电路3〇2用于使输出电路304在非扫描期间输出级传信号。
[0034] 参阅图4,本发明G0A电路第二实施方式的电路图,在一具体的电路中:
[0035]第N级级传电路301包括第二薄膜晶体管T2、第三薄膜晶体管T3以及第四薄膜晶体 管T4;第二薄膜晶体管T2的栅极接入第N-2级G0A子电路的输出信号G (N-2),漏极接入正向 扫描彳目弟三薄I吴晶体管了3的栅极接入第N+2级G〇A子电路的输出信号G (N+2),漏极接 入反向扫描信号D2U;第四薄膜晶体管T4的栅极接入第一时钟信号XCK⑽,漏极连接第二薄 膜晶体管T2和第三薄膜晶体管T3的源极,源极连接Q点。
[0036]另外,在其他实施方式中,第N级级传电路3〇1也可以在正向扫描时接收第.丨级的 级传信号,或在方向扫描时接收第N+1级的级传信号。
[0037]第N级P点控制电路3〇3包括第五薄膜晶体管T5以及第六薄膜晶体管T6;第五薄膜 晶体管T5的栅极连接Q点,漏极接入第一时钟信号XCK (N),源极连接p点;第六薄膜晶体管阳 的栅极接入第一时钟信号XCK (N),漏极接入一低电平信号,源极连接p点。
[0038]第N级Q点控制电路302包括第七薄膜晶体管17以及第八薄膜晶体管T8;第七薄膜 晶体管17的栅极接入第二时钟信号CK (N),漏极连接Q点;第八薄膜晶体管抑的栅极连接p 点,漏极连接第七薄膜晶体管17的源极,源极接入一高电平信号。
[0039]第N级输出电路304包括第九薄膜晶体管T9以及第十薄膜晶体管T10;第九薄膜晶 体管T9的栅极连接Q点,漏极接入第二时钟信号CK(N),源极连接第N级扫描线6(的;第十薄 膜晶体管T10的栅极连接P点,漏极连接第N级扫描线G(N),源极接入一高电平信号。
[0040]第N级开关电路305,与上述实施方式中的开关电路相同,这里不再赘述。
[0041]在其他实施方式中,第N级扫描驱动电路还可以包括:
[0042] P点上拉电路306,P点上拉电路3〇6包括第十一薄膜晶体管T11,其栅极接入开启信 号Gas,漏极连接P点,源极接入一高电平信号。
[0043]复位电路307,复位电路307包括第十二薄膜晶体管T12,其栅极和源极接入复位信 号Reset,漏极连接P点。
[0044]在图4中,H表示高电平信号,L表示低电平信号。
[0045]同时参阅图5,本发明G0A电路第二实施方式的电路时序图,下面以正向扫描为例, 对本电路的实施方式进行具体说明:
[0046]在正向扫描期间,U2D为低电平,D2U为高电平,以使第N-2级扫描线G(N-2)和第一 时钟信号XCK (N)为低电平时,向Q点通入U2D信号,即低电平信号。在其他实施方式中,例如 反向扫描期间,U2D为高电平,D2U为低电平,以使第N+2级扫描线G (N+2)和第一时钟信号XCK ⑽为低电平时,向Q点通入D2U信号,即低电平信号。
[0047] 在第一作用区间,即all gate on作用期间,在all gate on作用期间的开始阶段, Gas信号为低电平,导通第一薄膜晶体管T1,则向第N级扫描线G(N)输入低电平信号,从而使 每个像素中的TFT打开,在该阶段中,像素的信号线通入触摸信号,以便随时对显示屏进行 黑屏唤醒,唤醒后,向像素的信号线通入低电平(即黑电压),以像素点进行放电,以消除像 素点的残留电荷。具体地,在all gate on作用期间,由于Gas信号直接通入第N级扫描线G (N),则无论第N级扫描驱动电路如何工作,第N级扫描线G (N)均输出低电平信号。
[0048]在第二作用区间,即复位区间,复位信号Reset为低电平,十二薄膜晶体管T12导 通,从而P点为低电平,继而第七薄膜晶体管T7导通,由于第七薄膜晶体管T7导通,第N级扫 描线G (N)直接连接一高电平信号,从而上拉第N级扫描线G (N)的电平,因此第N级扫描线G ⑽输出高电平信号,实现第N级扫描线G (N)输出信号的复位。具体地,在复位区间,由于高 电平信号直接通入第N级扫描线G(N),则无论第N级扫描驱动电路如何工作,第N级扫描线G (N)均输出高电平信号。
[0049]在第三作用区间,即正常显示区间,则根据级传信号G (N-2)、第一时钟信号XCK (N) 和第二时钟信号CK (N)的作用,正常逐级扫描,第N级GOA子电路扫描期间,第N级扫描线G⑽ 输出与第二时钟信号CK⑽相同电平的信号。
[0050]具体地,当级传信号G (N-2)为低电平、第一时钟信号XCK (N)为低电平时,第四薄膜 晶体管T4导通,Q点为低电平,继而第九薄膜晶体管T9导通,第二时钟信号CK (N)直接通入第 N级扫描线G (N),从而第N级扫描线G⑽输出与第二时钟信号CK (N)电平相同的信号,即高电 平信号。同时,由于P点此时为低电平,第十薄膜晶体管H0导通,高电平信号通入第N级扫描 线G(N),保证了第N级扫描线G(N)的稳定输出。
[0051]当第一时钟信号XCIUN)为高电平时,第四薄膜晶体管T4、第六薄膜晶体管T6截止, Q点保持低电平,因此第五薄膜晶体管T5导通,所以P点则在第一时钟信号XCK⑽的作用下 变为高电平。因此,第二时钟信号CK (N)直接通入第N级扫描线G (N),从而第N级扫描线G (N) 输出与第二时钟信号CK⑽电平相同的信号。在第四作用区间,即信号中停区间,g卩,当显示 画面停止或有触摸信号接触显示屏以使显示画面暂停时,所有端口以及节点的电平均保持 高电平,从而使显示画面保持不变。
[0052] 值得说明的是,相邻两级G0A子电路中的第一时钟信号XCK⑻和第二时钟信号CK (N)是不同,在一种实施方式中,第N-1级的第一时钟信号为XCK,第二时钟信号CK;第N级的 第一时钟信号为CK,第二时钟信号XCK;第N+1级的第一时钟信号为XCK,第二时钟信号CK;其 中,XCK和CK的电平可以如图5所示,以此类推。
[0053]区别于现有技术,本实施方式中在G0A电路的每级G0A子电路的第N级扫描线G(N) 上增加一开关电路,用于在显示面板显示前,即黑屏唤醒或信号中停时,向每级GOA子电路 的第N级扫描线G(N)通入低电平信号,以清除像素电容中的残留的电荷,进而实现All Gate On功能,有利于防止显示器在黑屏唤醒时漏电的情况;另一方面,本实施方式的GOA电路增 加了 P点下拉电路以及复位电路,降低了信号中停期间Q点漏电的风险,提高了电路的稳定 性。
[0054] 参阅图6,本发明G0A电路的驱动方法一实施方式的流程图,该方法包括:
[0055] 步骤601:打开每一级G0A子电路的开关电路,向每一级的扫描线通入一开启信号, 以使每一级的扫描线连接的像素中的薄膜晶体管导通。
[0056] 步骤602:关闭每一级G0A子电路的开关电路,从第一级G0A子电路或最后一级G0A 子电路开始扫描。
[0057] 该实施方式是基于上述各个G0A电路的一驱动方法,其实施方式参照上述各个实 施方式,这里不再赘述。
[0058] 参阅图7,本发明液晶显示器一实施方式的结构示意图,该液晶显示器包括显示面 板701及背光702,显示面板701中包括G0A电路,其中,该G0A电路是如上述各个实施方式的 G0A电路,其具体实施方式类似,这里不再赘述。
[0059]以上所述仅为本发明的实施方式,并非因此限制本发明的专利范围,凡是利用本 发明说明书及附图内容所作的等效结构或等效流程变换,或直接或间接运用在其他相关的 技术领域,均同理包括在本发明的专利保护范围内。

Claims (9)

1. 一种GOA电路,用于液晶显示器,其特征在于,所述GOA电路包括多个级联的GOA子电 路,设定N为正整数,其中,第N级G0A子电路包括第N级级传电路、第N级Q点控制电路、第N级P 点控制电路、第N级输出电路以及开关电路; 其中,所述第N级级传电路、第N级Q点控制电路、第N级P点控制电路以及第N级输出电路 连接于Q点,所述第N级Q点控制电路、第N级P点控制电路以及第N级输出电路连接于P点,所 述第N级输出电路连接第N级扫描线(G (N)); 所述开关电路包括第一薄膜晶体管(T1),其源极连接所述第N级扫描线(G(N)),其漏极 连接其栅极并接入一开启信号(Gas),在所述液晶显示器显示前,所述开启信号(Gas)为低 电平信号,以使所述第N级扫描线(G (N))通入所述低电平信号,从而使所述第N级扫描线(G ⑽)连接的像素中的薄膜晶体管导通。
2. 根据权利要求1所述的电路,其特征在于,所述第N级级传电路包括第二薄膜晶体管 (T2)、第三薄膜晶体管(T3)以及第四薄膜晶体管(T4); 所述第二薄膜晶体管(T2)的栅极接入第N-2级G0A子电路的输出信号(G (N-2)),漏极接 入正向扫描信号(U2D); 所述第三薄膜晶体管(T3)的栅极接入第N+2级G0A子电路的输出信号(G(N+2)),漏极接 入反向扫描信号(D2U); 所述第四薄膜晶体管(T4)的栅极接入第一时钟信号(XCK (N)),漏极连接所述第二薄膜 晶体管(T2)和所述第三薄膜晶体管(T3)的源极,源极连接所述Q点。
3. 根据权利要求1所述的电路,其特征在于,所述第N级P点控制电路包括第五薄膜晶体 管(T5)以及第六薄膜晶体管(T6); 所述第五薄膜晶体管(T5)的栅极连接所述Q点,漏极接入第一时钟信号(XCK (N)),源极 连接所述P点; 所述第六薄膜晶体管(T6)的栅极接入所述第一时钟信号(XCK(N)),漏极接入一低电平 信号,源极连接所述P点。
4. 根据权利要求1所述的电路,其特征在于,所述第N级Q点控制电路包括第七薄膜晶体 管(T7)以及第八薄膜晶体管(T8); 所述第七薄膜晶体管(T7)的栅极接入第二时钟信号(CK⑽),漏极连接所述Q点; 所述第八薄膜晶体管(T8)的栅极连接所述P点,漏极连接所述第七薄膜晶体管(T7)的 源极,源极接入一高电平信号。
5. 根据权利要求1所述的电路,其特征在于,所述第N级输出电路包括第九薄膜晶体管 (T9)以及第十薄膜晶体管(T10); 所述第九薄膜晶体管(T9)的栅极连接所述Q点,漏极接入第二时钟信号(CK (N)),源极 连接所述第N级扫描线(G (N)); 所述第十薄膜晶体管(T10)的栅极连接所述P点,漏极连接所述第N级扫描线(G (N)),源 极接入一高电平信号。
6. 根据权利要求1所述的电路,其特征在于,所述第N级扫描驱动电路还包括P点上拉电 路; 所述P点上拉电路包括第十一薄膜晶体管(T11),其栅极接入开启信号(Gas),漏极连接 所述P点,源极接入一高电平信号。
7. 根据权利要求1所述的电路,其特征在于,所述第N级扫描驱动电路还包括复位电路; 所述复位电路包括第十二薄膜晶体管(T12),其栅极和源极接入复位信号(Reset),漏 极连接所述P点。
8. —种GOA电路的驱动方法,应用于如权利要求1-7任一项的GOA电路,其特征在于,包 括: 打开每一级GOA子电路的开关电路,向每一级的扫描线通入一开启信号,以使所述每一 级的扫描线连接的像素中的薄膜晶体管导通; 关闭每一级GOA子电路的所述开关电路,从第一级GOA子电路或最后一级G〇A子电路开 始扫描。
9.一种液晶显示器,其特征在于,所述液晶显示器包括如权利要求1_7任一项所述的 GOA电路。
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