CN104700776B - 像素电路及其驱动方法、显示装置 - Google Patents

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Abstract

本发明公开了一种像素电路及其驱动方法、显示装置，属于显示领域。所述像素电路包括:复位模块、补偿模块、储能模块、驱动模块、驱动控制模块、供电模块和发光模块，第三电源信号端的输入电压大于数据信号端的输入电压与驱动模块的阈值电压之差，且小于第二电源信号端的输入电压。本发明解决了在保证驱动晶体管放电完全的情况下，无法实现驱动晶体管短时间放电至Vth电位的问题，实现了在保证驱动晶体管放电完全的情况下，驱动晶体管短时间放电至Vth电位的效果，用于像素电路的驱动。

Description

像素电路及其驱动方法、显示装置
技术领域
本发明涉及显示领域，特别涉及一种像素电路及其驱动方法、显示装置。
背景技术
随着显示技术的发展，有机发光二极管(英文：Organic Light Emitting Diode；简称：OLED)作为一种电流型发光器件，因其所具有的自发光、快速响应、宽视角和可制作在柔性衬底上等特点而越来越多地被应用于高性能显示领域当中。
OLED像素电路结构是一种通过驱动晶体管进行放电补偿阈值电压均匀性的电路结构，应用在显示装置中，该OLED像素电路结构包括OLED和多个驱动晶体管，OLED像素电路结构通过复位阶段、补偿电位写入阶段和发光阶段实现OLED像素的补偿，在补偿电位写入阶段中，与OLED相连的驱动晶体管通过该OLED的发光放电至关断，实现驱动晶体管放电至Vth(阈值电压)电位。
但是，随着分辨率的提高，要求驱动晶体管在较短的时间内进行放电，而驱动晶体管的Vth电位的写入与时间存在函数关系，放电时间较短会出现驱动晶体管放电不完全的现象，因此无法实现驱动晶体管短时间放电至Vth电位。
发明内容
为了解决在保证驱动晶体管放电完全的情况下，无法实现驱动晶体管短时间放电至Vth电位的问题，本发明提供了一种像素电路及其驱动方法、显示装置。所述技术方案如下：
第一方面，提供了一种像素电路，所述像素电路包括:复位模块、补偿模块、储能模块、驱动模块、驱动控制模块、供电模块和发光模块，
所述复位模块分别连接第一电源信号端、第二电源信号端、第一控制信号端、第一控制点和第二控制点，用于根据所述第一控制信号端输入的控制信号，将所述第一电源信号端的输入电压写入所述第二控制点，将所述第二电源信号端的输入电压写入所述第一控制点；
所述补偿模块分别连接所述第一控制信号端、第三电源信号端和第三控制点，用于根据所述第一控制信号端输入的控制信号，将所述第三电源信号端的输入电压写入所述第三控制点；
所述驱动控制模块分别连接所述第一电源信号端、第二控制信号端、第三控制信号端、数据信号端、所述第二控制点和第四控制点，用于根据所述第三控制信号端输入的控制信号，将所述数据信号端的输入电压写入所述第四控制点；
所述供电模块分别连接所述第二电源信号端、所述第二控制信号端和所述第一控制点，用于根据所述第二控制信号端输入的控制信号，向所述第一控制点提供所述第二电源信号端的电压；
所述驱动模块分别连接所述第一控制点、所述第三控制点和所述第四控制点，用于在所述第一控制点的电压、所述第三控制点的电压和所述第四控制点的电压的控制下放电；
所述储能模块分别连接所述第一控制点和所述第二控制点，用于存储所述第一控制点和第二控制点的电压；
所述发光模块分别连接所述第三控制点和第四电源信号端，用于在所述第三控制点电压和所述第四电源信号端电压的控制下发光；
其中，所述第三电源信号端的输入电压大于所述数据信号端的输入电压与所述驱动模块的阈值电压之差，且小于所述第二电源信号端的输入电压。
可选的，所述复位模块包括：第一晶体管和第二晶体管，
所述第一晶体管的第一级连接所述第一电源信号端，所述第一晶体管的第二级连接所述第二控制点，所述第一晶体管的栅极连接所述第一控制信号端；
所述第二晶体管的第一级连接所述第二电源信号端，所述第二晶体管的第二级连接所述第一控制点，所述第二晶体管的栅极连接所述第一控制信号端。
可选的，所述补偿模块包括：第三晶体管，
所述第三晶体管的第一级连接所述第三电源信号端，所述第三晶体管的第二级连接所述第三控制点，所述第三晶体管的栅极连接所述第一控制信号端。
可选的，所述驱动控制模块包括：第四晶体管、第五晶体管和第六晶体管，
所述第四晶体管的第一级连接所述第一电源信号端，所述第四晶体管的第二级连接所述第二控制点，所述第四晶体管的栅极连接所述第三控制信号端；
所述第五晶体管的第一级连接所述第二控制点，所述第五晶体管的第二级连接所述第四控制点，所述第五晶体管的栅极连接所述第二控制信号端；
所述第六晶体管的第一级连接所述第四控制点，所述第六晶体管的第二级连接数据信号端，所述第六晶体管的栅极连接所述第三控制信号端。
可选的，所述供电模块包括：第七晶体管，
所述第七晶体管的第一级连接所述第二电源信号端，所述第七晶体管的第二级连接所述第一控制点，所述第七晶体管的栅极连接所述第二控制信号端。
可选的，所述驱动模块包括：第八晶体管，所述驱动模块的阈值电压包括：所述第八晶体管的阈值电压，
所述第八晶体管的第一级连接所述第一控制点，所述第八晶体管的第二级连接所述第三控制点，所述第八晶体管的栅极连接所述第四控制点。
可选的，所述储能模块包括：电容，
所述电容的一端连接所述第一控制点，所述电容的另一端连接所述第二控制点。
可选的，所述发光模块包括：有机发光二极管，
所述有机发光二极管的一端连接所述第三控制点，所述有机发光二极管的另一端连接所述第四电源信号端。
可选的，所述第一电源信号端接地。
可选的，所述晶体管均为N型晶体管；或者所述晶体管均为P型晶体管。
可选的，当所述晶体管为P型晶体管时，所述晶体管的第一极为源极，所述晶体管的第二极为漏极。
第二方面，提供了一种像素电路驱动方法，用于如第一方面所述的像素电路，所述像素电路包括:复位模块、补偿模块、储能模块、驱动模块、驱动控制模块、供电模块和发光模块，所述像素电路驱动方法包括：
第一控制信号端输入导通控制信号，第一电源信号端输入第一电压，第二电源信号端输入第二电压，第三电源信号端输入第三电压，使得所述第一电压写入第二控制点，所述第二电压写入第一控制点，所述第三电压写入第三控制点；
所述第一控制信号端输入关闭控制信号，第三控制信号端输入导通控制信号，数据信号端输入数据电压，所述第一电源信号端输入所述第一电压，使得所述数据电压写入第四控制点，所述第一电压写入所述第二控制点，所述驱动模块在所述第一控制点电压和所述第四控制点电压的控制下通过所述发光模块进行放电；
所述第三控制信号端输入关闭控制信号，第二控制信号端输入导通控制信号，所述第二电源信号端输入所述第二电压，使得所述第二电压写入所述第一控制点，通过所述驱动模块的电流驱动所述发光模块发光；
其中，所述第三电压大于所述数据电压与所述驱动模块的阈值电压之差，且小于所述第二电压。
可选的，所述复位模块包括：第一晶体管和第二晶体管，所述补偿模块包括：第三晶体管，所述驱动控制模块包括：第四晶体管、第五晶体管和第六晶体管，所述供电模块包括：第七晶体管，所述驱动模块包括：第八晶体管，所述驱动模块的阈值电压包括：所述第八晶体管的阈值电压，所述储能模块包括：电容，所述发光模块包括：有机发光二极管，
当所述第一控制信号端输入导通控制信号时，所述第一晶体管、所述第二晶体管和所述第三晶体管导通；
当所述第一控制信号端输入关闭控制信号时，所述第一晶体管、所述第二晶体管和所述第三晶体管关闭；
当所述第三控制信号端输入导通控制信号时，所述第四晶体管和所述第六晶体管导通；
当所述第三控制信号端输入关闭控制信号时，所述第四晶体管和所述第六晶体管关闭；当所述第二控制信号端输入导通控制信号时，所述第五晶体管和所述第七晶体管导通。
可选的，所述第一电源信号端接地。
可选的，所述晶体管均为N型晶体管；或者所述晶体管均为P型晶体管。
可选的，当所述晶体管均为P型晶体管时，所述晶体管的第一极均为源极，所述晶体管的第二极均为漏极。
可选的，当所述晶体管均为P型晶体管时，控制信号的时序包括：
第一阶段：所述第一控制信号端输入低电平，所述第二控制信号端和所述第三控制信号端输入高电平，所述第一电源信号端输入所述第一电压，所述第二电源信号端输入所述第二电压，所述第三电源信号端输入所述第三电压，所述第三电压大于所述第八晶体管的阈值电压，且小于所述第二电压；
第二阶段：所述第三控制信号端输入低电平，所述第一控制信号端和所述第二控制信号端输入高电平，所述数据信号端输入所述数据电压，所述第一电源信号端输入所述第一电压；
第三阶段：所述第二控制信号端输入低电平，所述第一控制信号端和所述第三控制信号端输入高电平，所述第二电源信号端输入所述第二电压。
第三方面，提供了一种显示装置，包括第一方面所述的像素电路。
本发明提供了一种像素电路及其驱动方法、显示装置，通过复位模块将第二电源信号端的输入电压写入第一控制点，补偿模块将第三电源信号端的输入电压写入第三控制点，驱动控制模块将数据信号端的输入电压写入第四控制点，使得该驱动模块在第一控制点的电压、第三控制点的电压和第四控制点的电压的控制下放电，由于第三电源信号端的输入电压大于数据信号端的输入电压与驱动模块的阈值电压之差，且小于第二电源信号端的输入电压，所以，根据电压预补偿原理对驱动模块的电压进行了预补偿，可以加快驱动模块放电到Vth电位的速度，减小了驱动模块放电至Vth电位的时间，在保证放电完全的情况下，驱动晶体管短时间内放电至Vth电位。
应当理解的是，以上的一般描述和后文的细节描述仅是示例性和解释性的，并不能限制本发明。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明实施例提供的一种像素电路的结构示意图；
图2是本发明实施例提供的另一种像素电路的结构示意图；
图3为本发明实施例提供的一种像素电路驱动方法的方法流程图；
图4是本发明实施例提供的一种控制信号的时序图；
图5是本发明实施例提供的一种像素电路的等效电路图；
图6是本发明实施例提供的另一种像素电路的等效电路图；
图7为本发明实施例提供的又一种像素电路等效电路图。
通过上述附图，已示出本发明明确的实施例，后文中将有更详细的描述。这些附图和文字描述并不是为了通过任何方式限制本发明构思的范围，而是通过参考特定实施例为本领域技术人员说明本发明的概念。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚，下面将结合附图对本发明实施方式作进一步地详细描述。
本发明所有实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件，根据在电路中的作用本发明的实施例所采用的晶体管主要为开关晶体管。由于这里采用的开关晶体管的源极、漏极是对称的，所以其源极、漏极是可以互换的。在本发明实施例中，为区分晶体管除栅极之外的两极，将其中源极称为第一级，漏极称为第二级。按附图中的形态规定晶体管的中间端为栅极、信号输入端为源极、信号输出端为漏极。此外本发明实施例所采用的开关晶体管包括P型开关晶体管和N型开关晶体管两种，其中，P型开关晶体管在栅极为低电平时导通，在栅极为高电平时截止，N型开关晶体管为在栅极为高电平时导通，在栅极为低电平时截止；驱动晶体管包括P型和N型，其中P型驱动晶体管在栅极电压为低电平(栅极电压小于源极电压)，且栅极源极的压差的绝对值大于阈值电压时处于放大状态或饱和状态；其中N型驱动晶体管的栅极电压为高电平(栅极电压大于源极电压)，且栅极源极的压差的绝对值大于阈值电压时处于放大状态或饱和状态。
如图1所示，本发明实施例提供了一种像素电路00，该像素电路00可以包括:复位模块001、补偿模块002、储能模块003、驱动模块004、驱动控制模块005、供电模块006和发光模块007。
该复位模块001分别连接第一电源信号端VREF、第二电源信号端VDD、第一控制信号端Gn-1、第一控制点A和第二控制点B，用于根据该第一控制信号端Gn-1输入的控制信号，将第一电源信号端VREF的输入电压写入第二控制点B，将第二电源信号端VDD的输入电压写入第一控制点A。
该补偿模块002分别连接第一控制信号端Gn-1、第三电源信号端VINI和第三控制点C，用于根据第一控制信号端Gn-1输入的控制信号，将第三电源信号端VINI的输入电压写入第三控制点C。
该驱动控制模块005分别连接第一电源信号端VREF、第二控制信号端EM、第三控制信号端Gn、数据信号端DATA、第二控制点B和第四控制点D，用于根据第三控制信号端Gn输入的控制信号，将数据信号端DATA的输入电压写入第四控制点D。
该供电模块006分别连接第二电源信号端VDD、第二控制信号端EM和第一控制点A，用于根据第二控制信号端EM输入的控制信号，向第一控制点A提供第二电源信号端VDD的电压。
该驱动模块004分别连接第一控制点A、第三控制点C和第四控制点D，用于在第一控制点A的电压、第三控制点C的电压和第四控制点D的电压的控制下放电。
该储能模块003分别连接第一控制点A和第二控制点B，用于存储第一控制点A和第二控制点B的电压。
该发光模块007分别连接第三控制点C和第四电源信号端VSS，用于在第三控制点C电压和第四电源信号端VSS电压的控制下发光。
需要说明的是，该第三电源信号端VINI的输入电压可以大于数据信号端DATA的输入电压与驱动模块004的阈值电压之差，且小于第二电源信号端VDD的输入电压。
电压预补偿原理指的是高压端口向低压端口放电，使得该高压端口的电压变为预设电压，假设在该高压端口电压放电之前，在该低压端口设置一个大于预设电压且小于高压端口电压的电压，在该高压端口电压放电时，该高压端口电压放电至预设电压的速度就会加快。在本发明实施例中，第一控制点A的电压为第二电源信号端VDD的输入电压，若驱动模块004放电至阈值电压，第一控制点A的电压需放电至数据信号端DATA的输入电压与驱动模块004的阈值电压之差。将该第三电源信号端VINI的输入电压写入该第三控制点C，该第三电源信号端VINI的输入电压大于数据信号端DATA的输入电压与驱动模块004的阈值电压之差，且小于第二电源信号端VDD的输入电压。
根据电压预补偿原理，该第一控制点A为高压端口，该第三控制点C为低压端口，数据信号端DATA的输入电压与驱动模块004的阈值电压之差为该第一控制点A放电的预设电压，该第三控制点C上的电压大于该预设电压，且小于高压端口电压。所以，在该驱动模块004放电至阈值电压时，该第一控制点A放电至预设电压的速度就会加快，即加快了该驱动模块004放电到阈值电压的速度，减小了驱动模块放电至阈值电压的时间。
综上所述，本发明实施例提供的像素电路中，通过复位模块将第二电源信号端的输入电压写入第一控制点，补偿模块将第三电源信号端的输入电压写入第三控制点，驱动控制模块将数据信号端的输入电压写入第四控制点，使得该驱动模块在第一控制点的电压、第三控制点的电压和第四控制点的电压的控制下放电，由于第三电源信号端的输入电压大于数据信号端的输入电压与驱动模块的阈值电压之差，且小于第二电源信号端的输入电压，所以，根据电压预补偿原理对驱动模块的电压进行了预补偿，可以加快驱动模块放电到Vth电位的速度，减小了驱动模块放电至Vth电位的时间，在保证放电完全的情况下，驱动晶体管短时间内放电至Vth电位。
进一步的，如图2所示，本发明实施例提供了另一种像素电路00，该复位模块001可以包括：第一晶体管M1和第二晶体管M2。具体的，该第一晶体管M1的第一级连接第一电源信号端VREF，该第一晶体管M1的第二级连接第二控制点B，该第一晶体管M1的栅极连接第一控制信号端Gn-1。第二晶体管M2的第一级连接第二电源信号端VDD，第二晶体管M2的第二级连接第一控制点A，第二晶体管M2的栅极连接第一控制信号端Gn-1。
该补偿模块002可以包括：第三晶体管M3。示例的，该第三晶体管M3的第一级连接第三电源信号端VINI，该第三晶体管M3的第二级连接第三控制点C，该第三晶体管M3的栅极连接第一控制信号端Gn-1。
该驱动控制模块005可以包括：第四晶体管M4、第五晶体管M5和第六晶体管M6。具体的，该第四晶体管M4的第一级连接第一电源信号端VREF，该第四晶体管M4的第二级连接第二控制点B，该第四晶体管M4的栅极连接第三控制信号端Gn。该第五晶体管M5的第一级连接第二控制点B，该第五晶体管M5的第二级连接第四控制点D，该第五晶体管M5的栅极连接第二控制信号端EM。该第六晶体管M6的第一级连接第四控制点D，该第六晶体管M6的第二级连接数据信号端DATA，该第六晶体管M6的栅极连接第三控制信号端Gn。
该供电模块006可以包括：第七晶体管M7。该第七晶体管M7的第一级连接第二电源信号端VDD，该第七晶体管M7的第二级连接第一控制点A，该第七晶体管M7的栅极连接第二控制信号端EM。
该驱动模块004可以包括：第八晶体管M8，此时，该驱动模块004的阈值电压可以包括：该第八晶体管M8的阈值电压Vth。具体的，该第八晶体管M8的第一级连接第一控制点A，该第八晶体管M8的第二级连接第三控制点C，该第八晶体管M8的栅极连接第四控制点D。
该储能模块003可以包括：电容CST，该电容CST的一端连接第一控制点A，该电容CST的另一端连接第二控制点B。
该发光模块007可以包括：有机发光二极管D1，该有机发光二极管D1的一端连接第三控制点C，该有机发光二极管D1的另一端连接第四电源信号端VSS。
需要说明的是，该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8可以均为N型晶体管，或者均为P型晶体管，当该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8均为P型晶体管时，该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8的第一极为源极，该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8的第二极为漏极。
可选的，可以将该第一电源信号端VREF接地，此时，该第一电源信号端VREF的输入电压为0伏，
综上所述，本发明实施例提供的像素电路中，通过复位模块将第二电源信号端的输入电压写入第一控制点，补偿模块将第三电源信号端的输入电压写入第三控制点，驱动控制模块将数据信号端的输入电压写入第四控制点，使得该驱动模块在第一控制点的电压、第三控制点的电压和第四控制点的电压的控制下放电，由于第三电源信号端的输入电压大于数据信号端的输入电压与驱动模块的阈值电压之差，且小于第二电源信号端的输入电压，所以，根据电压预补偿原理对驱动模块的电压进行了预补偿，可以加快驱动模块放电到Vth电位的速度，减小了驱动模块放电至Vth电位的时间，在保证放电完全的情况下，驱动晶体管短时间内放电至Vth电位。
如图3所示，本发明实施例提供了一种像素电路驱动方法，该像素电路驱动方法可以用于驱动图1或图2所示的像素电路00，该像素电路00可以包括:复位模块001、补偿模块002、储能模块003、驱动模块004、驱动控制模块005、供电模块006和发光模块007，该像素电路驱动方法可以包括：
步骤301、第一控制信号端Gn-1输入导通控制信号，第一电源信号端VREF输入第一电压，第二电源信号端VDD输入第二电压，第三电源信号端VINI输入第三电压，使得第一电压写入第二控制点B，第二电压写入第一控制点A，第三电压写入第三控制点C。其中，第三电压大于数据电压与驱动模块004的阈值电压之差，且小于第二电压。
步骤302、第一控制信号端Gn-1输入关闭控制信号，第三控制信号端Gn输入导通控制信号，数据信号端DATA输入数据电压，第一电源信号端VREF输入第一电压，使得数据电压写入第四控制点D，第一电压写入第二控制点B，驱动模块004在第一控制点A电压和第四控制点D电压的控制下通过发光模块007进行放电。
步骤303、第三控制信号端Gn输入关闭控制信号，第二控制信号端EM输入导通控制信号，第二电源信号端VDD输入第二电压，使得第二电压写入第一控制点A，通过驱动模块004的电流驱动发光模块007发光。
综上所述，本发明实施例提供的像素电路驱动方法中，通过复位模块将第二电源信号端的输入电压写入第一控制点，补偿模块将第三电源信号端的输入电压写入第三控制点，驱动控制模块将数据信号端的输入电压写入第四控制点，使得该驱动模块在第一控制点的电压、第三控制点的电压和第四控制点的电压的控制下放电，由于第三电源信号端的输入电压大于数据信号端的输入电压与驱动模块的阈值电压之差，且小于第二电源信号端的输入电压，所以，根据电压预补偿原理对驱动模块的电压进行了预补偿，可以加快驱动模块放电到Vth电位的速度，减小了驱动模块放电至Vth电位的时间，在保证放电完全的情况下，驱动晶体管短时间内放电至Vth电位。
示例的，如图2所示，该复位模块001可以包括：第一晶体管M1和第二晶体管M2，该补偿模块002可以包括：第三晶体管M3，该驱动控制模块005可以包括：第四晶体管M4、第五晶体管M5和第六晶体管M6，该供电模块006可以包括：第七晶体管M7，该驱动模块004可以包括：第八晶体管M8，此时，该驱动模块004的阈值电压可以包括：第八晶体管M8的阈值电压Vth，该储能模块003可以包括：电容CST，该发光模块007可以包括：有机发光二极管D1。
当该第一控制信号端Gn-1输入导通控制信号时，该第一晶体管M1、该第二晶体管M2和该第三晶体管M3导通。当该第一控制信号端Gn-1输入关闭控制信号时，该第一晶体管M1、该第二晶体管M2和该第三晶体管M3关闭。当该第三控制信号端Gn输入导通控制信号时，该第四晶体管M4和第六晶体管M6导通。当该第三控制信号端Gn输入关闭控制信号时，该第四晶体管M4和第六晶体管M6关闭。当该第二控制信号端EM输入导通控制信号时，该第五晶体管M5和第七晶体管M7导通。
需要说明的是，该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8可以均为N型晶体管，或者均为P型晶体管，当该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8均为P型晶体管时，该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8的第一极为源极，该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8的第二极为漏极。
当该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8均为P型晶体管时，该控制信号的时序可以包括：
第一阶段：第一控制信号端Gn-1输入低电平，第二控制信号端EM和第三控制信号端Gn输入高电平，第一电源信号端VREF输入第一电压，第二电源信号端VDD输入第二电压，第三电源信号端VINI输入第三电压，第三电压大于第八晶体管M8的阈值电压，且小于第二电压。
第二阶段：第三控制信号端Gn输入低电平，第一控制信号端Gn-1和第二控制信号端EM输入高电平，数据信号端DATA输入数据电压，第一电源信号端VREF输入第一电压。
第三阶段：第二控制信号端EM输入低电平，第一控制信号端Gn-1和第三控制信号端Gn输入高电平，第二电源信号端VDD输入第二电压。
具体的，本发明实施例以第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8均为P型晶体管为例，在图2所示的像素电路的工作时，其工作过程具体可以分为三个阶段，分别为：复位阶段、补偿电位写入阶段以及发光阶段。图4是图2所示像素电路工作过程中各个控制信号线的时序图。如图4所示，在图4中分别用P1、P2和P3来相应地表示复位阶段、补偿电位写入阶段以及发光阶段。
具体的，P1阶段为复位阶段，该阶段的等效电路如图5所示。在该复位阶段中，第一控制信号端Gn-1输入低电平，第二控制信号端EM和第三控制信号端Gn输入高电平，第一电源信号端VREF输入第一电压Vref，第二电源信号端VDD输入第二电压Vdd，第三电源信号端VINI输入第三电压Vini，第三电压Vini大于第八晶体管M8的阈值电压Vth，且小于第二电压Vdd。此时，第一晶体管M1、第二晶体管M2和第三晶体管M3导通，第一电源信号端VREF输入的第一电压Vref写入第二控制点B，第二电源信号端VDD输入的第二电压Vdd写入第一控制点A，第三电源信号端VINI输入的第三电压Vini写入第三控制点C。
P2阶段为补偿电位写入阶段，该阶段的等效电路如图6所示。在该补偿电位写入阶段中，第三控制信号端Gn输入低电平，第一控制信号端Gn-1和第二控制信号端EM输入高电平，数据信号端DATA输入数据电压Data，第一电源信号端VREF输入第一电压Vref。此时，第四晶体管M4和第六晶体管M6导通，第一晶体管M1、第二晶体管M2和第三晶体管M3关断，数据信号端DATA输入的数据电压Data写入第四控制点D，第一电源信号端VREF输入的第一电压Vref写入第二控制点B，使得第八晶体管M8在第一控制点A电压和第四控制点D电压的控制下通过该有机发光二极管D1进行放电，直至该第八晶体管M8关断。
第一控制点A的电压为该第二电源信号端VDD输入的第二电压Vdd，第三控制点C的电压为该第三电源信号端VINI输入的第三电压Vini，由于在复位阶段中，第三电源信号端VINI输入的第三电压Vini大于该第八晶体管M8的阈值电压Vth，且小于第二电源信号端VDD输入的第二电压Vdd，因此，第一控制点A的电压和第三控制点C的电压能够形成电压差，使得利于第一控制点A向第三控制点C放电，且该第一控制点A的电压和第三控制点C的电压之间的差值，小于现有技术中第一控制点A的电压与第三控制点C的电压之间的差值，根据电压预补偿原理，相较于现有技术，该第一控制点A的电压由第二电源信号端VDD输入的第二电压Vdd变为Data-Vth的速度更快，所需的时间更短，实现了在高分辨率的情况下，驱动晶体管在短时间内放电至Vth电位的效果。此时，该电容CST两端的电位分别为第二控制点B的电压第一电压Vref和第一控制点A的电压Data-Vth，该电容CST两端的电压差值为Vref-(Data-Vth)。
P3阶段为发光阶段，该阶段的等效电路如图7所示。在该发光阶段中，第二控制信号端EM输入低电平，第一控制信号端Gn-1和第三控制信号端Gn输入高电平，第二电源信号端VDD输入第二电压Vdd，此时，第四晶体管M4和第六晶体管M6关断，第五晶体管M5和第七晶体管M7导通，第二电源信号端VDD输入的第二电压Vdd写入第一控制点A。由于该发光阶段中该第二电压Vdd写入第一控制点A，所以，此时该第一控制点A的电压为Vdd。该第五晶体管M5的导通，使得该第二控制点B的电压和该第四控制点D的电压相等，为了使得电容CST两端的电压差值保持上一阶段中的电压差值Vref-(Data-Vth)，该第二控制点B的电压和该第四控制点D的电压变为Vdd+Vref-(Data-Vth)，即该第八晶体管M8栅极的电压为Vdd+Vref-(Data-Vth)，该第八晶体管M8源极的电压为该第一控制点A的电压Vdd，此时，由于该第八晶体管M8处于饱和阶段，流经该第八晶体管M8的电流为：
I d s = 1 2 · K · ( V g s - V t h ) 2 = 1 2 · K · { V d d + V r e f - ( D a t a - V t h ) } 2 = 1 2 · K · ( V r e f - D a t a ) 2 ;
其中，
具体的，μ为该第八晶体管M8的载流子迁移率，C为该第八晶体管M8的栅极绝缘层的电容，W/L为该第八晶体管M8的宽长比。通过该第八晶体管M8的电流驱动该有机发光二极管D1发光。由此可见，在有机发光二极管D1正常工作时，流经该第八晶体管M8的电流与其阈值电压Vth和第二电源信号端VDD输入的电压Vdd无关，仅仅与数据信号端DATA输入的数据电压Data以及第一电源信号端VREF输入的第一电压Vref有关，避免了该有机发光二极管D1，由于放电时间较短而出现第八晶体管M8放电不完全而导致的有机发光二极管D1的显示亮度不同于预设显示亮度，提高显示效果。
可选的，可以将该第一电源信号端VREF接地，此时，该第一电源信号端VREF输入的第一电压Vref为0伏，流经该第八晶体管M8和该有机发光二极管D1的电流仅仅与数据信号端DATA输入的数据电压Data相关，避免了该第一电压Vref引起的该有机发光二极管D1的显示亮度不同于预设显示亮度，进一步的提高了显示效果。示例的，由于该第三电源信号端VINI与该像素电路无法构成回路，所以，避免了由于该第三电源信号端VINI输入的第三电压Vini引起的压降问题。
需要说明的是，在上述实施例中，均是以第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8为P型晶体管为例进行的说明。当然，该第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8还可以采用N型晶体管，当第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和该第八晶体管M8为N型晶体管时，该各个控制信号线的时序可以与图4中各个控制信号线的时序相反(即二者的相位差为180度)。
综上所述，本发明实施例提供的像素电路驱动方法中，通过复位模块将第二电源信号端的输入电压写入第一控制点，补偿模块将第三电源信号端的输入电压写入第三控制点，驱动控制模块将数据信号端的输入电压写入第四控制点，使得该驱动模块在第一控制点的电压、第三控制点的电压和第四控制点的电压的控制下放电，由于第三电源信号端的输入电压大于数据信号端的输入电压与驱动模块的阈值电压之差，且小于第二电源信号端的输入电压，所以，根据电压预补偿原理对驱动模块的电压进行了预补偿，可以加快驱动模块放电到Vth电位的速度，减小了驱动模块放电至Vth电位的时间，在保证放电完全的情况下，驱动晶体管短时间内放电至Vth电位。
本发明实施例提供了一种显示装置，该显示装置可以包括像素电路，该像素电路可以为图1或图2所示的像素电路00。
综上所述，本发明实施例提供的显示装置中，通过复位模块将第二电源信号端的输入电压写入第一控制点，补偿模块将第三电源信号端的输入电压写入第三控制点，驱动控制模块将数据信号端的输入电压写入第四控制点，使得该驱动模块在第一控制点的电压、第三控制点的电压和第四控制点的电压的控制下放电，由于第三电源信号端的输入电压大于数据信号端的输入电压与驱动模块的阈值电压之差，且小于第二电源信号端的输入电压，所以，根据电压预补偿原理对驱动模块的电压进行了预补偿，可以加快驱动模块放电到Vth电位的速度，减小了驱动模块放电至Vth电位的时间，在保证放电完全的情况下，驱动晶体管短时间内放电至Vth电位。
以上所述仅为本发明的较佳实施例，并不用以限制本发明，凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (18)

1.一种像素电路，其特征在于，所述像素电路包括:复位模块、补偿模块、储能模块、驱动模块、驱动控制模块、供电模块和发光模块，
所述复位模块分别连接第一电源信号端、第二电源信号端、第一控制信号端、第一控制点和第二控制点，用于根据所述第一控制信号端输入的控制信号，将所述第一电源信号端的输入电压写入所述第二控制点，将所述第二电源信号端的输入电压写入所述第一控制点；
所述补偿模块分别连接所述第一控制信号端、第三电源信号端和第三控制点，用于根据所述第一控制信号端输入的控制信号，将所述第三电源信号端的输入电压写入所述第三控制点；
所述驱动控制模块分别连接所述第一电源信号端、第二控制信号端、第三控制信号端、数据信号端、所述第二控制点和第四控制点，用于根据所述第三控制信号端输入的控制信号，将所述数据信号端的输入电压写入所述第四控制点；
所述供电模块分别连接所述第二电源信号端、所述第二控制信号端和所述第一控制点，用于根据所述第二控制信号端输入的控制信号，向所述第一控制点提供所述第二电源信号端的电压；
所述驱动模块分别连接所述第一控制点、所述第三控制点和所述第四控制点，用于在所述第一控制点的电压、所述第三控制点的电压和所述第四控制点的电压的控制下放电；
所述储能模块分别连接所述第一控制点和所述第二控制点，用于存储所述第一控制点和第二控制点的电压；
所述发光模块分别连接所述第三控制点和第四电源信号端，用于在所述第三控制点电压和所述第四电源信号端电压的控制下发光；
其中，所述第三电源信号端的输入电压大于所述数据信号端的输入电压与所述驱动模块的阈值电压之差，且小于所述第二电源信号端的输入电压。
2.根据权利要求1所述的像素电路，其特征在于，
所述复位模块包括：第一晶体管和第二晶体管，
所述第一晶体管的第一级连接所述第一电源信号端，所述第一晶体管的第二级连接所述第二控制点，所述第一晶体管的栅极连接所述第一控制信号端；
所述第二晶体管的第一级连接所述第二电源信号端，所述第二晶体管的第二级连接所述第一控制点，所述第二晶体管的栅极连接所述第一控制信号端。
3.根据权利要求1所述的像素电路，其特征在于，
所述补偿模块包括：第三晶体管，
所述第三晶体管的第一级连接所述第三电源信号端，所述第三晶体管的第二级连接所述第三控制点，所述第三晶体管的栅极连接所述第一控制信号端。
4.根据权利要求1所述的像素电路，其特征在于，
所述驱动控制模块包括：第四晶体管、第五晶体管和第六晶体管，
所述第四晶体管的第一级连接所述第一电源信号端，所述第四晶体管的第二级连接所述第二控制点，所述第四晶体管的栅极连接所述第三控制信号端；
所述第五晶体管的第一级连接所述第二控制点，所述第五晶体管的第二级连接所述第四控制点，所述第五晶体管的栅极连接所述第二控制信号端；
所述第六晶体管的第一级连接所述第四控制点，所述第六晶体管的第二级连接数据信号端，所述第六晶体管的栅极连接所述第三控制信号端。
5.根据权利要求1所述的像素电路，其特征在于，
所述供电模块包括：第七晶体管，
所述第七晶体管的第一级连接所述第二电源信号端，所述第七晶体管的第二级连接所述第一控制点，所述第七晶体管的栅极连接所述第二控制信号端。
6.根据权利要求1所述的像素电路，其特征在于，
所述驱动模块包括：第八晶体管，所述驱动模块的阈值电压包括：所述第八晶体管的阈值电压，
所述第八晶体管的第一级连接所述第一控制点，所述第八晶体管的第二级连接所述第三控制点，所述第八晶体管的栅极连接所述第四控制点。
7.根据权利要求1所述的像素电路，其特征在于，
所述储能模块包括：电容，
所述电容的一端连接所述第一控制点，所述电容的另一端连接所述第二控制点。
8.根据权利要求1所述的像素电路，其特征在于，
所述发光模块包括：有机发光二极管，
所述有机发光二极管的一端连接所述第三控制点，所述有机发光二极管的另一端连接所述第四电源信号端。
9.根据权利要求1至8任一权利要求所述的像素电路，其特征在于，
所述第一电源信号端接地。
10.根据权利要求2至6任一权利要求所述的像素电路，其特征在于，
所述晶体管均为N型晶体管；或者所述晶体管均为P型晶体管。
11.根据权利要求10所述的像素电路，其特征在于，
当所述晶体管为P型晶体管时，所述晶体管的第一极为源极，所述晶体管的第二极为漏极。
12.一种像素电路驱动方法，其特征在于，用于如权利要求1至11中任一权利要求所述的像素电路，所述像素电路包括:复位模块、补偿模块、储能模块、驱动模块、驱动控制模块、供电模块和发光模块，所述像素电路驱动方法包括：
第一控制信号端输入导通控制信号，第一电源信号端输入第一电压，第二电源信号端输入第二电压，第三电源信号端输入第三电压，使得所述第一电压写入第二控制点，所述第二电压写入第一控制点，所述第三电压写入第三控制点；
所述第一控制信号端输入关闭控制信号，第三控制信号端输入导通控制信号，数据信号端输入数据电压，所述第一电源信号端输入所述第一电压，使得所述数据电压写入第四控制点，所述第一电压写入所述第二控制点，所述驱动模块在所述第一控制点电压和所述第四控制点电压的控制下通过所述发光模块进行放电；
所述第三控制信号端输入关闭控制信号，第二控制信号端输入导通控制信号，所述第二电源信号端输入所述第二电压，使得所述第二电压写入所述第一控制点，通过所述驱动模块的电流驱动所述发光模块发光；
其中，所述第三电压大于所述数据电压与所述驱动模块的阈值电压之差，且小于所述第二电压。
13.根据权利要求12的像素电路驱动方法，其特征在于，
所述复位模块包括：第一晶体管和第二晶体管，所述补偿模块包括：第三晶体管，所述驱动控制模块包括：第四晶体管、第五晶体管和第六晶体管，所述供电模块包括：第七晶体管，所述驱动模块包括：第八晶体管，所述驱动模块的阈值电压包括：所述第八晶体管的阈值电压，所述储能模块包括：电容，所述发光模块包括：有机发光二极管，
当所述第一控制信号端输入导通控制信号时，所述第一晶体管、所述第二晶体管和所述第三晶体管导通；
当所述第一控制信号端输入关闭控制信号时，所述第一晶体管、所述第二晶体管和所述第三晶体管关闭；
当所述第三控制信号端输入导通控制信号时，所述第四晶体管和所述第六晶体管导通；
当所述第三控制信号端输入关闭控制信号时，所述第四晶体管和所述第六晶体管关闭；当所述第二控制信号端输入导通控制信号时，所述第五晶体管和所述第七晶体管导通。
14.根据权利要求12或13所述的像素电路驱动方法，其特征在于，
所述第一电源信号端接地。
15.根据权利要求13所述的像素电路驱动方法，其特征在于，
所述晶体管均为N型晶体管；或者所述晶体管均为P型晶体管。
16.根据权利要求15所述的像素电路驱动方法，其特征在于，
当所述晶体管均为P型晶体管时，所述晶体管的第一极均为源极，所述晶体管的第二极均为漏极。
17.根据权利要求16所述的像素电路驱动方法，其特征在于，当所述晶体管均为P型晶体管时，控制信号的时序包括：
第一阶段：所述第一控制信号端输入低电平，所述第二控制信号端和所述第三控制信号端输入高电平，所述第一电源信号端输入所述第一电压，所述第二电源信号端输入所述第二电压，所述第三电源信号端输入所述第三电压，所述第三电压大于所述第八晶体管的阈值电压，且小于所述第二电压；
第二阶段：所述第三控制信号端输入低电平，所述第一控制信号端和所述第二控制信号端输入高电平，所述数据信号端输入所述数据电压，所述第一电源信号端输入所述第一电压；
第三阶段：所述第二控制信号端输入低电平，所述第一控制信号端和所述第三控制信号端输入高电平，所述第二电源信号端输入所述第二电压。
18.一种显示装置，其特征在于，包括权利要求1至11任一所述的像素电路。
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