CN104320244B - 一种产生网格多翼蝴蝶混沌吸引子的混沌电路及使用方法 - Google Patents

一种产生网格多翼蝴蝶混沌吸引子的混沌电路及使用方法 Download PDF

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Abstract

本发明公开了一种产生网格多翼蝴蝶混沌吸引子的混沌电路及使用方法，涉及保密通信中所需的混沌电路。该混沌电路由三阶自治电路(N)、第一分段时滞函数序列发生器(N1)、第二分段时滞函数序列发生器(N2)和分压器(N3)四部分构成。第一分段时滞函数序列发生器(N1)和第二分段时滞函数序列发生器(N2)能控制混沌电路产生不同数量的网格多翼蝴蝶混沌吸引子。其方法是通过调节开关k1、k2、k3、k4、k5、k6、k7、k8，控制第一分段时滞函数序列发生器(N1)和第二分段时滞函数序列发生器(N2)输出不同的信号，使得混沌电路产生网格4×2、6×3、8×3和8×4翼蝴蝶混沌吸引子；可应用于保密通信，能提高通信的安全性。

Description

一种产生网格多翼蝴蝶混沌吸引子的混沌电路及使用方法
技术领域
本发明涉及一种混沌电路，具体涉及保密通信中所需的一种网格多翼蝴蝶混沌吸引子的混沌电路及使用方法。
背景技术
如何产生用于混沌保密通信中所需的各种混沌信号是非线性电路与系统科学研究的一个新领域。目前对于产生两翼蝴蝶混沌吸引子的混沌电路研究已取得了一系列的成果，但是两翼蝴蝶混沌吸引子没有多翼蝴蝶混沌吸引子的动力学行为复杂，因此在公开号为CN103236920A的中国发明专利申请公开说明书公开了一种改进的四维统一多翼混沌系统，以及在公开号为CN103957098A的中国发明专利申请公开说明书公开了一种产生多蝴蝶形吸引子的混沌电路及实现方法，这些系统只能产生一个方向的多翼蝴蝶混沌吸引子。而网格多翼蝴蝶混沌吸引子能在两个方向(横坐标方向和纵坐标方向)产生多翼蝴蝶混沌吸引子，比一个方向的多翼蝴蝶混沌吸引子的动力学行为更复杂，然而目前还没有涉及产生网格多翼蝴蝶混沌吸引子的混沌电路。
发明内容
本发明所要解决的技术问题是，针对现有技术的混沌电路不能产生网格多翼蝴蝶混沌吸引子，设计了一种产生网格多翼蝴蝶混沌吸引子的混沌电路。
本发明解决上述技术问题的技术方案是，设计一种产生网格多翼蝴蝶混沌吸引子的混沌电路，该电路包括：三阶自治电路(N)、第一分段时滞函数序列发生器(N1)、第二分段时滞函数序列发生器(N2)和分压器(N3)四部分；三阶自治电路(N)的b1输出端分别连接第一分段时滞函数序列发生器(N1)的x1、x3和x4输入端；三阶自治电路(N)的b2输出端连接第一分段时滞函数序列发生器(N1)的x2输入端；三阶自治电路(N)的b3输出端分别连接第二分段时滞函数序列发生器(N2)的z1、z2和z3输入端；三阶自治电路(N)的b4输出端连接第二分段时滞函数序列发生器(N2)的z4输入端；分压器(N3)的v-3、v-1、v0、v3、v2和v1输出端分别连接第一分段时滞函数序列发生器(N1)的v-3、v-1、v0、v3、v2和v1输入端；分压器(N3)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输出端分别连接第二分段时滞函数序列发生器(N2)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输入端；第一分段时滞函数序列发生器(N1)的f1输出端分别连接三阶自治电路(N)的a2、a3和a6输入端；第一分段时滞函数序列发生器(N1)的f2输出端连接三阶自治电路(N)的a1输入端；第二分段时滞函数序列发生器(N2)的f3输出端分别连接三阶自治电路(N)的a4和a5输入端。
所述的三阶自治电路(N1)由两个乘法器(M1、M2)、三个加法器(U1、U4、U7)、三个积分器(U2、U5、U8)和三个反相器(U3、U6、U9)分别级联构成。三阶自治电路(N)的b1输出端分别连接第一分段时滞函数序列发生器(N1)的x1、x3和x4输入端；三阶自治电路(N)的b2输出端连接第一分段时滞函数序列发生器(N1)的x2输入端；三阶自治电路(N)的b3输出端分别连接第二分段时滞函数序列发生器(N2)的z1、z2和z3输入端；三阶自治电路(N)的b4输出端连接第二分段时滞函数序列发生器(N2)的z4输入端；第一分段时滞函数序列发生器(N1)的f1输出端分别连接三阶自治电路(N)的a2、a3和a6输入端；第一分段时滞函数序列发生器(N1)的f2输出端连接三阶自治电路(N)的a1输入端；第二分段时滞函数序列发生器(N2)的f3输出端分别连接三阶自治电路(N)的a4和a5输入端。
所述的第一分段时滞函数序列发生器(N1)由八个运算放大器(U10、U11、U12、U13、U14、U15、U16、U17)和四个开关(k1、k3、k4、k5)构成。第一分段时滞函数序列发生器(N1)的f1输出端分别连接三阶自治电路(N)的a2、a3和a6输入端；第一分段时滞函数序列发生器(N1)的f2输出端连接三阶自治电路(N)的a1输入端；三阶自治电路(N)的b1输出端分别连接第一分段时滞函数序列发生器(N1)的x1、x3和x4输入端；三阶自治电路(N)的b2输出端连接第一分段时滞函数序列发生器(N1)的x2输入端；分压器(N3)的v-3、v-1、v0、v3、v2和v1输出端分别连接第一分段时滞函数序列发生器(N1)的v-3、v-1、v0、v3、v2和v1输入端。
所述的第二分段时滞函数序列发生器(N2)由八个运算放大器(U18、U19、U20、U21、U22、U23、U24、U25)和四个开关(k2、k6、k7、k8)构成。第二分段时滞函数序列发生器(N2)的f3输出端分别连接三阶自治电路(N)的a4和a5输入端。三阶自治电路(N)的b3输出端分别连接第二分段时滞函数序列发生器(N2)的z1、z2和z3输入端；三阶自治电路(N)的b4输出端连接第二分段时滞函数序列发生器(N2)的z4输入端；分压器(N3)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输出端分别连接第二分段时滞函数序列发生器(N2)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输入端。
所述的分压器(N3)由电阻R66～R75构成多级分压系统。电阻R66与R67之间的v3输出端分别连接第一分段时滞函数序列发生器(N1)的v3输入端和第二分段时滞函数序列发生器(N2)的v3输入端；电阻R67与R68之间的v2.5输出端连接第二分段时滞函数序列发生器(N2)的v2.5输入端；电阻R68与R69之间的v2输出端分别连接第一分段时滞函数序列发生器(N1)的v2输入端和第二分段时滞函数序列发生器(N2)的v2输入端；电阻R69与R70之间的v1输出端分别连接第一分段时滞函数序列发生器(N1)的v1输入端和第二分段时滞函数序列发生器(N2)的v1输入端；电阻R70与R71之间的v0.5输出端连接第二分段时滞函数序列发生器(N2)的v0.5输入端；电阻R71与R72之间的v0输出端分别连接第一分段时滞函数序列发生器(N1)的v0输入端和第二分段时滞函数序列发生器(N2)的v0输入端；电阻R72与R73之间的v-1输出端分别连接第一分段时滞函数序列发生器(N1)的v-1输入端和第二分段时滞函数序列发生器(N2)的v-1输入端；电阻R73与R74之间的v-1.5输出端连接第二分段时滞函数序列发生器(N2)的v-1.5输入端；电阻R74与R75之间的v-3输出端分别连接第一分段时滞函数序列发生器(N1)的v-3输入端和第二分段时滞函数序列发生器(N2)的v-3输入端。
本发明还提出一种产生网格多翼蝴蝶混沌吸引子的使用方法，其中，三阶自治电路(N)通过b1和b3输出端产生网格多翼蝴蝶混沌吸引子，第一分段时滞函数序列发生器(N1)的输出端f1和f2产生相位相反的分段时滞信号，控制整个电路在横坐标方向的产生四翼、六翼和八翼蝴蝶混沌吸引子。第二分段时滞函数序列发生器(N2)的输出端f3产生分段时滞信号，控制整个电路在纵坐标方向的产生二翼、三翼和四翼蝴蝶混沌吸引子。
通过调节第一分段时滞函数序列发生器(N1)的开关k1、k3、k4、k5和第二分段时滞函数序列发生器(N2)的开关k2、k6、k7、k8控制电路产生不同翼的蝴蝶混沌吸引子：
(1)当开关k1、k2置2，k4、k7闭合，k3、k5、k6、k8断开时，产生4×2翼蝴蝶混沌吸引子；
(2)当开关k1、k2置2，k4、k5、k7、k8闭合，k3、k6断开时，产生6×3翼蝴蝶混沌吸引子；
(3)当开关k1置1，k2置2，k3、k4、k5、k7、k8闭合，k6断开时，产生8×3翼蝴蝶混沌吸引子；
(4)当开关k1、k2置1，k3、k4、k5、k6、k7、k8闭合时，产生8×4翼蝴蝶混沌吸引子。
本发明与现有技术相比，其第一分段时滞函数序列发生器(N1)输出横坐标方向的多翼蝴蝶混沌吸引子，第二分段时滞函数序列发生器(N2)输出纵坐标方向的多翼蝴蝶混沌吸引子，其产生的网格多翼蝴蝶混沌吸引子较一个方向的多翼蝴蝶混沌吸引子的动力学行为更复杂，可应用于保密通信，能提高保密通信的安全性。
附图说明
图1为产生网格多翼蝴蝶混沌吸引子的混沌电路原理框图；
图2为产生网格多翼蝴蝶混沌吸引子的混沌电路原理图；
图3为4×2翼蝴蝶混沌吸引子的电路仿真实验结果图；
图4为6×3翼蝴蝶混沌吸引子的电路仿真实验结果图；
图5为8×3翼蝴蝶混沌吸引子的电路仿真实验结果图；
图6为8×4翼蝴蝶混沌吸引子的电路仿真实验结果图。
具体实施方式
以下针对附图和具体实例对本发明的实施进行具体说明。
图1所示为本发明电路原理框图。该电路包括：三阶自治电路(N)、第一分段时滞函数序列发生器(N1)、第二分段时滞函数序列发生器(N2)和分压器(N3)四部分；三阶自治电路(N)的b1输出端分别连接第一分段时滞函数序列发生器(N1)的x1、x3和x4输入端；三阶自治电路(N)的b2输出端连接第一分段时滞函数序列发生器(N1)的x2输入端；三阶自治电路(N)的b3输出端分别连接第二分段时滞函数序列发生器(N2)的z1、z2和z3输入端；三阶自治电路(N)的b4输出端连接第二分段时滞函数序列发生器(N2)的z4输入端；分压器(N3)的v-3、v-1、v0、v3、v2和v1输出端分别连接第一分段时滞函数序列发生器(N1)的v-3、v-1、v0、v3、v2和v1输入端；分压器(N3)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输出端分别连接第二分段时滞函数序列发生器(N2)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输入端；第一分段时滞函数序列发生器(N1)的f1输出端分别连接三阶自治电路(N)的a2、a3和a6输入端；第一分段时滞函数序列发生器(N1)的f2输出端连接三阶自治电路(N)的a1输入端；第二分段时滞函数序列发生器(N2)的f3输出端分别连接三阶自治电路(N)的a4和a5输入端。
图2所示为本发明的电路原理图。电路原理图中的运算放大器均可采用UA741CN，乘法器可采用AD633JN，其电源电压为E+＝15V，E-＝-15V，运算放大器输出饱和电压值Vsat＝13.5伏特，乘法器的增益为0.1。电路原理图中电阻R1＝R2＝R3＝R4＝R5＝R6＝R10＝R11＝R12＝R13＝R16＝R17＝R18＝R19＝R22＝R24＝R25＝R26＝R27＝R30＝R32＝R33＝R36＝R38＝R39＝R40＝R41＝R42＝R45＝R47＝R48＝R49＝R50＝R53＝R55＝R56＝R59＝R61＝R62＝R63＝R64＝R65＝10kΩ；R23＝R31＝R37＝R46＝R54＝R60＝135kΩ，R21＝R29＝R35＝R44＝R52＝R58＝1MΩ；R20＝R28＝R34＝R43＝R51＝R57＝0.74kΩ；R67＝R68＝R70＝R71＝R73＝0.5kΩ；R66＝R75＝12kΩ；R69＝R72＝1kΩ；R7＝3.57kΩ；R8＝100kΩ；R9＝0.59kΩ；R14＝37.5kΩ；R15＝0.87kΩ；R74＝1.5kΩ；电容C1＝C2＝C3＝10nF。
图2中的三阶自治电路(N1)由两个乘法器(M1、M2)、三个加法器(U1、U4、U7)、三个积分器(U2、U5、U8)和三个反相器(U3、U6、U9)分别级联构成。三阶自治电路(N)的a1输入端和积分器U5的输出端分别通过电阻R1和R2连接加法器U1的反相输入端，加法器U1的反相输入端通过电阻R3连接加法器U1的输出端，加法器U1的输出端通过电阻R4连接积分器U2的反相输入端，积分器U2的反相输入端通过电容C1连接积分器U2的输出端，积分器U2的输出端连接三阶自治电路(N)的b1输出端，三阶自治电路(N)的b1输出端分别连接第一分段时滞函数序列发生器(N1)的x1、x3和x4输入端,同时，积分器U2的输出端还通过电阻R5连接反相器U3的反相输入端，反相器U3的反相输入端通过电阻R6连接反相器U3的输出端，反相器U3的输出端连接三阶自治电路(N)的b2输出端，三阶自治电路(N)的b2输出端连接第一分段时滞函数序列发生器(N1)的x2输入端；三阶自治电路(N)的a3和a4输入端连接乘法器M1的输入端，三阶自治电路(N)的a2输入端、反相器U6的输出端和乘法器M1的输出端分别通过电阻R7、R8和R9连接加法器U4的反相输入端，加法器U4的反相输入端通过电阻R10连接加法器U4的输出端，加法器U4的输出端通过电阻R11连接积分器U5的反相输入端，积分器U5的反相输入端通过电容C2连接积分器U5的输出端，积分器U5的输出端连接乘法器M2的输入端、通过电阻R1连接加法器U1的反相输入端、通过电阻R12连接反相器U6的反相输入端，反相器U6的反相输入端通过电阻R13连接反相器U6的输出端；三阶自治电路(N)的a6输入端和积分器U5的输出端分别连接乘法器M2的输入端，三阶自治电路(N)的a5输入端和乘法器M2的输出端分别通过电阻R14和R15连接加法器U7的反相输入端，加法器U7的反相输入端通过电阻R16连接加法器U7的输出端，加法器U7的输出端通过电阻R17连接积分器U8的反相输入端，积分器U8的反相输入端通过电容C3连接积分器U8的输出端，积分器U8的输出端连接三阶自治电路(N)的b3输出端，三阶自治电路(N)的b3输出端分别连接第二分段时滞函数序列发生器(N2)的z1、z2和z3输入端,同时，积分器U8的输出端还通过电阻R18连接反相器U9的反相输入端，反相器U9的反相输入端通过电阻R19连接反相器U9的输出端，反相器U9的输出端连接三阶自治电路(N)的b4输出端，三阶自治电路(N)的b4输出端连接第二分段时滞函数序列发生器(N2)的z4输入端。
图2中的第一分段时滞函数序列发生器(N1)由八个运算放大器(U10、U11、U12、U13、U14、U15、U16、U17)和四个开关(k1、k3、k4、k5)构成。第一分段时滞函数序列发生器(N1)的x1输入端连接运算放大器U10的反相输入端，第一分段时滞函数序列发生器(N1)的v-3输入端通过电阻R20连接运算放大器U10的正相输入端，运算放大器U10的正相输入端通过R21连接运算放大器U10的输出端，运算放大器U10的输出端和第一分段时滞函数序列发生器(N1)的v3输入端分别通过电阻R23和R22连接运算放大器U11的反相输入端，运算放大器U11的反相输入端通过R24连接运算放大器U11的输出端，运算放大器U11的输出端连接开关k3；第一分段时滞函数序列发生器(N1)的x3输入端连接运算放大器U12的反相输入端，第一分段时滞函数序列发生器(N1)的v-1输入端通过电阻R28连接运算放大器U12的正相输入端，运算放大器U12的正相输入端通过R29连接运算放大器U12的输出端，运算放大器U12的输出端和第一分段时滞函数序列发生器(N1)的v1输入端分别通过电阻R31和R30连接运算放大器U13的反相输入端，运算放大器U13的反相输入端通过R32连接运算放大器U13的输出端，运算放大器U13的输出端连接开关k4；第一分段时滞函数序列发生器(N1)的x4输入端连接运算放大器U14的反相输入端，第一分段时滞函数序列发生器(N1)的v1输入端通过电阻R34连接运算放大器U14的正相输入端，运算放大器U14的正相输入端通过R35连接运算放大器U14的输出端，运算放大器U14的输出端和第一分段时滞函数序列发生器(N1)的v-1输入端分别通过电阻R37和R36连接运算放大器U15的反相输入端，运算放大器U15的反相输入端通过R38连接运算放大器U15的输出端，运算放大器U15的输出端连接开关k5；第一分段时滞函数序列发生器(N1)的v2和v0输入端连接开关k1，开关k1、k3、k4、k5和第一分段时滞函数序列发生器(N1)的x2输入端分别通过电阻R26、R25、R33、R39和R27连接运算放大器U16的反相输入端，运算放大器U16的反相输入端通过电阻R40连接运算放大器U16的输出端，运算放大器U16的输出端连接第一分段时滞函数序列发生器(N1)的f1输出端，第一分段时滞函数序列发生器(N1)的f1输出端分别连接三阶自治电路(N)的a2、a3和a6输入端，同时，运算放大器U16的输出端还通过电阻R41连接运算放大器U17的反相输入端，运算放大器U17的反相输入端通过电阻R42连接运算放大器U17的输出端，运算放大器U17的输出端连接第一分段时滞函数序列发生器(N1)的f2输出端，第一分段时滞函数序列发生器(N1)的f2输出端连接三阶自治电路(N)的a1输入端。
图2中的第二分段时滞函数序列发生器(N2)由八个运算放大器(U18、U19、U20、U21、U22、U23、U24、U25)和四个开关(k2、k6、k7、k8)构成。第二分段时滞函数序列发生器(N2)的z1输入端连接运算放大器U18的反相输入端，第二分段时滞函数序列发生器(N2)的v-1.5输入端通过电阻R43连接运算放大器U18的正相输入端，运算放大器U18的正相输入端通过R44连接运算放大器U18的输出端，运算放大器U18的输出端和第二分段时滞函数序列发生器(N2)的v3输入端分别通过电阻R46和R45连接运算放大器U19的反相输入端，运算放大器U19的反相输入端通过R47连接运算放大器U19的输出端，运算放大器U19的输出端连接开关k6；第二分段时滞函数序列发生器(N2)的z3输入端连接运算放大器U20的反相输入端，第二分段时滞函数序列发生器(N2)的v0.5输入端通过电阻R51连接运算放大器U20的正相输入端，运算放大器U20的正相输入端通过R52连接运算放大器U20的输出端，运算放大器U20的输出端和第二分段时滞函数序列发生器(N2)的v1输入端分别通过电阻R54和R53连接运算放大器U21的反相输入端，运算放大器U21的反相输入端通过R55连接运算放大器U21的输出端，运算放大器U21的输出端连接开关k7；第二分段时滞函数序列发生器(N2)的z4输入端连接运算放大器U22的反相输入端，第二分段时滞函数序列发生器(N2)的v2.5输入端通过电阻R57连接运算放大器U22的正相输入端，运算放大器U22的正相输入端通过R58连接运算放大器U22的输出端，运算放大器U22的输出端和第二分段时滞函数序列发生器(N2)的v-1输入端分别通过电阻R60和R59连接运算放大器U23的反相输入端，运算放大器U23的反相输入端通过R61连接运算放大器U23的输出端，运算放大器U23的输出端连接开关k8；第二分段时滞函数序列发生器(N2)的v2和v0输入端连接开关k2，开关k2、k6、k7、k8和第二分段时滞函数序列发生器(N2)的z2输入端分别通过电阻R49、R48、R56、R62和R50连接运算放大器U24的反相输入端，运算放大器U24的反相输入端通过电阻R63连接运算放大器U24的输出端，运算放大器U24的输出端通过电阻R64连接运算放大器U25的反相输入端，运算放大器U25的反相输入端通过电阻R65连接运算放大器U25的输出端，运算放大器U25的输出端连接第二分段时滞函数序列发生器(N2)的f3输出端，第二分段时滞函数序列发生器(N2)的f3输出端分别连接三阶自治电路(N)的a4和a5输入端。
在图2中，分压器(N3)由电阻R66、R67、R68、R69、R70、R71、R72、R73、R74和R75依次串联构成。其中，R66和R75分别连接电源的正极E+和负极E-；R66和R67之间连接分压器(N3)的v3输出端，R67和R68之间连接分压器(N3)的v2.5输出端，R68和R69之间连接分压器(N3)的v2输出端，R69和R70之间连接分压器(N3)的v1输出端，R70和R71之间连接分压器(N3)的v0.5输出端，R71和R72之间连接分压器(N3)的v0输出端，R72和R73之间连接分压器(N3)的v-1输出端，R73和R74之间连接分压器(N3)的v-1.5输出端，R74和R75之间连接分压器(N3)的v-3输出端；分压器(N3)的v-3、v-1、v0、v3、v2和v1输出端分别连接第一分段时滞函数序列发生器(N1)的v-3、v-1、v0、v3、v2和v1输入端；分压器(N3)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输出端分别连接第二分段时滞函数序列发生器(N2)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输入端。
在图2中，三阶自治电路(N)通过b1和b3输出端产生网格多翼蝴蝶混沌吸引子，第一分段时滞函数序列发生器(N1)的输出端f1和f2产生相位相反的分段时滞信号，控制整个电路在横坐标方向的产生四翼、六翼和八翼蝴蝶混沌吸引子。第二分段时滞函数序列发生器(N2)的输出端f3产生分段时滞信号，控制整个电路在纵坐标方向的产生二翼、三翼和四翼蝴蝶混沌吸引子。
通过调节第一分段时滞函数序列发生器(N1)的开关k1、k3、k4、k5和第二分段时滞函数序列发生器(N2)的开关k2、k6、k7、k8控制电路产生不同翼的蝴蝶混沌吸引子：
(1)当开关k1、k2置2，k4、k7闭合，k3、k5、k6、k8断开时，产生4×2翼蝴蝶混沌吸引子；
(2)当开关k1、k2置2，k4、k5、k7、k8闭合，k3、k6断开时，产生6×3翼蝴蝶混沌吸引子；
(3)当开关k1置1，k2置2，k3、k4、k5、k7、k8闭合，k6断开时，产生8×3翼蝴蝶混沌吸引子；
(4)当开关k1、k2置1，k3、k4、k5、k6、k7、k8闭合时，产生8×4翼蝴蝶混沌吸引子。
本发明的混沌电路产生的4×2、6×3、8×3和8×4翼蝴蝶混沌吸引子的电路仿真图形分别为图3、图4、图5、图6。从图3—图6可以看出，本发明电路能产生网格多翼蝴蝶混沌吸引子，且产生的蝴蝶混沌吸引子的数量可控，说明本发明电路满足需求。

Claims (6)

1.一种产生网格多翼蝴蝶混沌吸引子的混沌电路，其特征在于，该电路包括：三阶自治电路(N)、第一分段时滞函数序列发生器(N1)、第二分段时滞函数序列发生器(N2)和分压器(N3)四部分；三阶自治电路(N)的b1输出端分别连接第一分段时滞函数序列发生器(N1)的x1、x3和x4输入端；三阶自治电路(N)的b2输出端连接第一分段时滞函数序列发生器(N1)的x2输入端；三阶自治电路(N)的b3输出端分别连接第二分段时滞函数序列发生器(N2)的z1、z2和z3输入端；三阶自治电路(N)的b4输出端连接第二分段时滞函数序列发生器(N2)的z4输入端；分压器(N3)的v-3、v-1、v0、v3、v2和v1输出端分别连接第一分段时滞函数序列发生器(N1)的v-3、v-1、v0、v3、v2和v1输入端；分压器(N3)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输出端分别连接第二分段时滞函数序列发生器(N2)的v-1.5、v-1、v0、v0.5、v1、v2、v2.5和v3输入端；第一分段时滞函数序列发生器(N1)的f1输出端分别连接三阶自治电路(N)的a2、a3和a6输入端；第一分段时滞函数序列发生器(N1)的f2输出端连接三阶自治电路(N)的a1输入端；第二分段时滞函数序列发生器(N2)的f3输出端分别连接三阶自治电路(N)的a4和a5输入端。
2.根据权利要求1所述的产生网格多翼蝴蝶混沌吸引子的混沌电路，其特征在于，三阶自治电路(N)由两个乘法器(M1、M2)、三个加法器(U1、U4、U7)、三个积分器(U2、U5、U8)和三个反相器(U3、U6、U9)分别级联构成，其中由b1和b3输出端产生网格多翼蝴蝶混沌吸引子。
3.根据权利要求1所述的产生网格多翼蝴蝶混沌吸引子的混沌电路，其特征在于，第一分段时滞函数序列发生器(N1)由运算放大器(U10、U11、U12、U13、U14、U15、U16、U17)和四个开关(k1、k3、k4、k5)构成，其中输出端f1和f2产生相位相反的分段时滞信号，控制整个电路在横坐标方向的产生四翼、六翼和八翼蝴蝶混沌吸引子。
4.根据权利要求1所述的产生网格多翼蝴蝶混沌吸引子的混沌电路，其特征在于，第二分段时滞函数序列发生器(N2)由八个运算放大器(U18、U19、U20、U21、U22、U23、U24、U25)和四个开关(k2、k6、k7、k8)构成，其中输出端f3产生分段时滞信号，控制整个电路在纵坐标方向的产生二翼、三翼和四翼蝴蝶混沌吸引子。
5.根据权利要求1所述的产生网格多翼蝴蝶混沌吸引子的混沌电路，其特征在于，分压器(N3)由电阻R66～R75构成多级分压系统，为第一分段时滞函数序列发生器(N1)和第二分段时滞函数序列发生器(N2)提供不同的输入电压。
6.一种产生网格多翼蝴蝶混沌吸引子的使用方法，其特征在于，
(1)当开关k1、k2置2，k4、k7闭合，k3、k5、k6、k8断开时，产生4×2翼蝴蝶混沌吸引子；
(2)当开关k1、k2置2，k4、k5、k7、k8闭合，k3、k6断开时，产生6×3翼蝴蝶混沌吸引子；
(3)当开关k1置1，k2置2，k3、k4、k5、k7、k8闭合，k6断开时，产生8×3翼蝴蝶混沌吸引子；
(4)当开关k1、k2置1，k3、k4、k5、k6、k7、k8闭合时，产生8×4翼蝴蝶混沌吸引子。
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