CN104157236A - 一种移位寄存器及栅极驱动电路 - Google Patents

一种移位寄存器及栅极驱动电路 Download PDF

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Abstract

本发明公开了一种移位寄存器及栅极驱动电路，包括信号输入单元、复位控制单元、发光信号输出控制单元，以及扫描信号输出控制单元；在充电阶段，信号输入单元控制发光信号输出控制单元导通第一参考信号端和发光信号输出端，并控制扫描信号输出控制单元导通第二时钟信号端和扫描信号输出端；在扫描信号输出阶段，扫描信号输出端输出扫描信号；在发光信号输出阶段，发光信号输出端输出发光信号。本发明实施例提供的上述移位寄存器集成了输出扫描信号和发光信号的功能，这样可以省去在OLED显示面板的边框处设置用于向各像素电路提供发光信号的发光驱动电路，有利于显示面板的窄边框设计。

Description

一种移位寄存器及栅极驱动电路
技术领域
本发明涉及显示技术领域，尤其涉及一种移位寄存器及栅极驱动电路。
背景技术
有机发光显示器(Organic Light Emitting Diode，OLED)是当今平板显示器研究领域的热点之一，与液晶显示器相比，OLED具有低能耗、生产成本低、自发光、宽视角及响应速度快等优点，目前，在手机、PDA、数码相机等显示领域OLED已经开始取代传统的LCD显示屏。与LCD利用稳定的电压控制亮度不同，OLED属于电流驱动，需要稳定的电流来控制发光。由于工艺制程和器件老化等原因，会使驱动OLED的驱动晶体管的阈值电压Vth存在不均匀性，这样就导致了流过每个像素点OLED的电流发生变化使得显示亮度不均，从而影响整个图像的显示效果。
因此，在现有的驱动OLED发光的像素电路中一般会消除驱动晶体管的阈值电压影响。具体地，如图1a所示，图1a为非常典型的OLED像素驱动电路，包括：驱动晶体管T2，开关晶体管T1、T3、T4、T5、T6，存储电容C，以及发光器件OLED；其中，开关晶体管T1的栅极与第二发光信号输入端EM(n+1)相连，源极与第一参考信号端ELVDD相连，漏极分别与存储电容C的一端和驱动晶体管T2的源极相连；驱动晶体管T2的栅极分别与开关晶体管T3的漏极和开关晶体管T6的漏极相连，漏极与发光器件OLED的一端相连；开关晶体管T3的栅极与第二发光信号输入端EM(n+1)相连，源极分别与存储电容C的另一端、开关晶体管T4的漏极以及开关晶体管T5的漏极相连；开关晶体管T4的栅极与第一扫描信号输入端S(n-1)相连，源极分别与第二参考信号端Vref和开关晶体管T5的源极相连；开关晶体管T5的栅极分别与第二扫描信号输入端S(n)和开关晶体管T6的栅极相连；开关晶体管T6的源极与数据电压信号输入端Vdata相连；发光器件OLED另一端与第三参考信号端ELVSS相连。
图1b为图1a的时序图，其中，信号S(n-1)为栅极驱动电路中第N-1级移位寄存器的输出端向图1a所示的像素电路中的第一扫描信号输入端S(n-1)输入的控制信号，信号S(n)为栅极驱动电路中第N级移位寄存器的输出端向图1a所示的像素电路中的第二扫描信号输入端S(n)输入的控制信号；信号EM(n)为发光驱动电路中第N级输出端向与图1a所示的像素电路相邻的上一级像素电路中的第一发光信号输入端EM(n)输入的控制信号，信号EM(n+1)为发光驱动电路中第N+1级输出端向图1a所示的像素电路中的第二发光信号输入端EM(n+1)输入的控制信号。如图1a所示的像素电路在第一扫描信号输入端S(n-1)、第二扫描信号输入端S(n)、第二发光信号输入端EM(n+1)三个控制信号端的控制下有四个工作阶段：第①阶段，第一扫描信号输入端S(n-1)和第二发光信号输入端EM(n+1)将开关晶体管T1、开关晶体管T3、开关晶体管T4导通，像素电路除通过第二参考信号端Vref和第一参考信号端ELVDD对电容C充电外，还完成了对驱动晶体管T2栅极的初始化功能；第②阶段，第二扫描信号输入端S(n)将开关晶体管T5和开关晶体管T6导通，对驱动晶体管T2进行数据电压的写入和阈值电压的补偿，第二发光信号输入端EM(n+1)将开关晶体管T1和开关晶体管T3截止；第③阶段为缓冲阶段，所有开关晶体管都处于关闭状态，避免开关切换引起不必要的杂讯；第④阶段为发光阶段，第二发光信号输入端EM(n+1)导通开关晶体管T1和开关晶体管T3，同时第一扫描信号输入端S(n-1)和第二扫描信号输入端S(n)将其它开关晶体管关闭，驱动晶体管T2在写入的数据电压的作用下开启，驱动发光器件OLED发光。
由上述可知，在像素电路的不同工作阶段，栅极驱动电路和发光驱动电路向像素电路的第一扫描信号输入端S(n-1)、第二扫描信号输入端S(n)以及发光信号输入端EM(n+1)输入相应的控制信号，控制像素电路完成不同阶段的工作。而在现有技术中，向各像素电路提供扫描信号和发光信号的栅极驱动电路和发光驱动电路，是分别独立设置在显示面板的非显示区域(边框区域)的，这样的电路设计较复杂，不利于显示面板窄边化发展。
发明内容
本发明实施例提供了一种移位寄存器及栅极驱动电路，用以实现移位寄存器为像素电路提供扫描信号和发光信号的功能。
本发明实施例提供了一种移位寄存器，包括：信号输入单元、复位控制单元、发光信号输出控制单元，以及扫描信号输出控制单元；其中，
所述信号输入单元的输入端与第一参考信号端相连，第一控制端与第一时钟信号端相连，第二控制端与信号输入端相连，第一输出端与第一节点相连，第二输出端与第二节点相连；
所述复位控制单元的输入端与第二参考信号端相连，控制端与复位信号端相连，输出端与所述第二节点相连；
所述发光信号输出控制单元的第一输入端与所述第一参考信号端相连，第二输入端与所述第二参考信号端相连，第一控制端与所述第一节点相连，第二控制端与所述第二节点相连，输出端与发光信号输出端相连；
所述扫描信号输出控制单元的第一输入端与第二时钟信号端相连，第二输入端与所述第一参考信号端相连，第三输入端与所述第二参考信号端相连，第一控制端与所述第一节点相连，第二控制端与所述发光信号输出控制单元的输出端相连，输出端与扫描信号输出端相连；
在充电阶段，在所述第一时钟信号端和所述信号输入端的控制下，所述信号输入单元通过所述第一节点，控制所述发光信号输出控制单元导通所述第一参考信号端和所述发光信号输出端，并控制所述扫描信号输出控制单元导通所述第二时钟信号端和所述扫描信号输出端；
在扫描信号输出阶段，在所述第二时钟信号端的控制下，所述扫描信号输出端输出扫描信号；
在发光信号输出阶段，在所述复位信号端和所述第二参考信号端的控制下，所述复位控制单元通过所述第二节点，控制所述扫描信号输出控制单元导通所述第一参考信号端和所述扫描信号输出端，并控制所述发光信号输出控制单元导通所述第二参考信号端和所述发光信号输出端，使所述发光信号输出端输出发光信号。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述扫描信号输出控制单元，具体包括：第一控制模块和第二控制模块；其中，
所述第一控制模块的第一输入端与所述第一参考信号端相连、第二输入端与所述第二参考信号端相连、第一控制端与所述第一节点相连、第二控制端与所述发光信号输出端相连、输出端与所述扫描信号输出端相连，用于在所述发光信号输出阶段，导通所述第一参考信号端与所述扫描信号输出端；
所述第二控制模块的输入端与所述第二时钟信号端相连、控制端与所述第一节点相连、输出端与所述扫描信号输出端相连，用于在所述充电阶段和所述扫描信号输出阶段，导通所述第二时钟信号端与所述扫描信号输出端，并在所述扫描信号输出阶段使所述扫描信号输出端输出扫描信号。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一控制模块，具体包括：第一开关晶体管、第二开关晶体管及第三开关晶体管；其中，
所述第一开关晶体管的栅极与所述发光信号输出端相连、源极与所述第二开关晶体管的漏极相连、漏极与所述第二参考信号端相连；
所述第二开关晶体管的栅极与所述第一节点相连、源极与所述第一参考信号端相连、漏极与所述第一开关晶体管的源极相连；
所述第三开关晶体管的栅极分别与所述第一开关晶体管的源极和所述第二开关晶体管的漏极相连、源极与所述第一参考信号端相连、漏极与所述扫描信号输出端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二控制模块，具体包括：第四开关晶体管和第一电容；其中，
所述第四开关晶体管的栅极与所述第一节点相连、源极与所述第二时钟信号端相连、漏极与所述扫描信号输出端相连；
所述第一电容连接于所述第一节点与所述扫描信号输出端之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述发光信号输出控制单元，具体包括：第三控制模块和第四控制模块；其中，
所述第三控制模块的输入端与所述第一参考信号端相连、控制端与所述第一节点相连、输出端与所述发光信号输出端相连，用于在所述充电阶段与所述扫描信号输出阶段，导通所述第一参考信号端与所述发光信号输出端；
第四控制模块的输入端与所述第二参考信号端相连、控制端与所述第二节点相连、输出端与所述发光信号输出端相连，用于在所述发光信号输出阶段，导通所述第二参考信号端与所述发光信号输出端，使所述发光信号输出端输出发光信号。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第三控制模块，具体包括：第五开关晶体管；
所述第五开关晶体管栅极与所述第一节点相连、源极与所述第一参考信号端相连、漏极与所述发光信号输出端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第四控制模块，具体包括：第六开关晶体管；
所述第六开关晶体管的栅极与所述第二节点相连、源极与所述发光信号输出端相连、漏极与所述第二参考信号端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述信号输入单元，具体包括：第七开关晶体管和第八开关晶体管；其中，
所述第七开关晶体管的栅极与所述第一时钟信号端相连、源极与所述第一节点相连、漏极与所述信号输入端相连；
所述第八开关晶体管的栅极与所述信号输入端相连、源极与所述第一参考信号端相连、漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述复位控制单元，具体包括：第九开关晶体管和第二电容；其中，
所述第九开关晶体管的栅极与所述复位信号端相连、源极与所述第二节点相连、漏极与所述第二参考信号端相连；
所述第二电容连接于所述第二节点与所述第二参考信号端之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述移位寄存器，还包括：第一节点维持单元；
所述第一节点维持单元的输入端与所述第一参考信号端相连、控制端与所述第二节点相连、输出端与所述第一节点相连，用于在所述发光信号输出阶段，在所述第二节点的控制下保持所述第一节点的电位。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一节点维持单元，具体包括：第十开关晶体管；
所述第十开关晶体管的栅极与所述第二节点相连、源极与所述第一参考信号端相连、漏极与所述第一节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述移位寄存器，还包括：第二节点维持单元；
所述第二节点维持单元的输入端与所述第一参考信号相连、控制端与所述第一节点相连、输出端与所述第二节点相连，用于在所述充电阶段与所述扫描信号输出阶段，在所述第一节点的控制下保持所述第二节点的电位。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二节点维持单元，具体包括：第十一开关晶体管；
所述第十一开关晶体管的栅极与所述第一节点相连、源极与所述第一参考信号端相连、漏极与所述第二节点相连。
本发明实施例提供了一种栅极驱动电路，包括串联的多个本发明实施例提供的上述移位寄存器，除第一个移位寄存器和最后一个移位寄存器之外，其余每个移位寄存器的扫描信号输出端均向与其相邻的下一个移位寄存器的信号输入端输入触发信号，并向与其相邻的上一个移位寄存器的复位信号端输入复位信号；第一个移位寄存器的扫描信号输出端向第二个移位寄存器的信号输入端输入触发信号；最后一个移位寄存器的扫描信号输出端向自身以及上一个移位寄存器的复位信号端输入复位信号。
本发明实施例提供的上述移位寄存器及栅极驱动电路，在充电阶段，在第一时钟信号端和信号输入端的控制下，信号输入单元通过第一节点，控制发光信号输出控制单元导通第一参考信号端和发光信号输出端，并控制扫描信号输出控制单元导通第二时钟信号端和扫描信号输出端；在扫描信号输出阶段，在第二时钟信号端的控制下，扫描信号输出端输出扫描信号，实现扫描信号输出的功能；在发光信号输出阶段，在复位信号端和第二参考信号端的控制下，复位控制单元通过第二节点，控制扫描信号输出控制单元导通第一参考信号端和扫描信号输出端，并控制发光信号输出控制单元导通第二参考信号端和发光信号输出端，使发光信号输出端输出发光信号，实现发光信号输出的功能，由此通过栅极驱动电路中三个相邻的移位寄存器驱动一个像素电路进行工作，第一个移位寄存器的扫描信号输出端向像素电路的第一扫描信号输入端输入扫描信号，第二个移位寄存器的扫描信号输出端向像素电路的第二扫描信号输入端输入扫描信号，第三个移位寄存器的发光信号输出端向像素电路的发光信号输入端输入发光信号，可以实现驱动像素电路在不同阶段正常工作。本发明实施例提供的上述移位寄存器集成了输出扫描信号和发光信号的功能，这样可以省去在OLED显示面板的边框处设置用于向各像素电路提供发光信号的发光驱动电路，有利于显示面板的窄边框设计。
附图说明
图1a为现有技术中像素电路的结构示意图；
图1b为图1a像素电路的时序示意图；
图2为本发明实施例提供的移位寄存器的结构示意图之一；
图3a和图3b分别为本发明实施例提供的移位寄存器中扫描信号输出控制单元的具体结构示意图；
图4a和图4b分别为本发明实施例提供的移位寄存器中发光信号输出控制单元的具体结构示意图；
图5a和图5b分别为本发明实施例提供的移位寄存器中信号输入单元和复位控制单元的具体结构示意图；
图6为本发明实施例提供的移位寄存器的结构示意图之二；
图7a和图7b分别为本发明实施例提供的移位寄存器中第一节点维持单元与第二节点维持单元的具体结构示意图；
图8a为本发明实施例提供的实施例一的具体结构示意图；
图8b为本发明实施例提供的实施例一的时序示意图；
图9a为本发明实施例提供的实施例二的具体结构示意图；
图9b为本发明实施例提供的实施例二的时序示意图；
图10为本发明实施例提供的栅极驱动电路的结构示意图。
具体实施方式
下面结合附图，对本发明实施例提供的移位寄存器及栅极驱动电路的具体实施方式进行详细地说明。
本发明实施例提供了一种移位寄存器，如图2所示，包括：信号输入单元10、复位控制单元20、发光信号输出控制单元30，以及扫描信号输出控制单元40；其中，
信号输入单元10的输入端与第一参考信号端Ref1相连，第一控制端与第一时钟信号端CLKB相连，第二控制端与信号输入端Input相连，第一输出端与第一节点P1相连，第二输出端与第二节点P2相连；
复位控制单元20的输入端与第二参考信号端Ref2相连，控制端与复位信号端Reset相连，输出端与所述第二节点P2相连；
发光信号输出控制单元30的第一输入端与第一参考信号Ref1相连，第二输入端与第二参考信号端Ref2相连，第一控制端与第一节点P1相连，第二控制端与第二节点P2相连，输出端与发光信号输出端Out1相连；
扫描信号输出控制单元40的第一输入端与第二时钟信号端CLK相连，第二输入端与第一参考信号端Ref1相连，第三输入端与第二参考信号端Ref2相连，第一控制端与第一节点P1相连，第二控制端与发光信号输出控制单元的输出端相连，输出端与扫描信号输出端Out2相连；
在充电阶段，在第一时钟信号端CLKB和信号输入端Input的控制下，信号输入单元10通过第一节点P1，控制发光信号输出控制单元30导通第一参考信号端Ref1和发光信号输出端Out1，并控制扫描信号输出控制单元40导通第二时钟信号端CLK和扫描信号输出端Out2；
在扫描信号输出阶段，在第二时钟信号端CLK的控制下，扫描信号输出端Out2输出扫描信号；
在发光信号输出阶段，在复位信号端Reset和第二参考信号端Ref2的控制下，复位控制单元20通过第二节点P2，控制扫描信号输出控制单元40导通第一参考信号端Ref1和扫描信号输出端Out2，并控制发光信号输出控制单元30导通第二参考信号端Ref2和发光信号输出端Out1，使发光信号输出端Out1输出发光信号。
本发明实施例提供的上述移位寄存器，在充电阶段，在第一时钟信号端CLKB和信号输入端Input的控制下，信号输入单元10通过第一节点，控制发光信号输出控制单元30导通第一参考信号端Ref1和发光信号输出端Out1，并控制扫描信号输出控制单元40导通第二时钟信号端CLK和扫描信号输出端Out2；在扫描信号输出阶段，在第二时钟信号端CLK的控制下，扫描输出端Out2输出扫描信号，实现扫描信号输出的功能；在发光信号输出阶段，在复位信号端Reset和第二参考信号端Ref2的控制下，复位控制单元20通过第二节点P2，控制扫描信号输出控制单元40导通第一参考信号端Ref1和扫描信号输出端Out2，并控制发光信号输出控制单元30导通第二参考信号端Ref2和发光信号输出端Out1，使发光信号输出端Out1输出发光信号，实现发光信号输出的功能。本发明实施例提供的上述移位寄存器集成了输出扫描信号和发光信号的功能，在扫描信号输出阶段，扫描信号输出端Out2输出扫描信号到与其相连的OLED像素电路的扫描信号输入端，在发光信号输出阶段，发光信号输出端Out1输出发光信号到与其相连的OLED像素电路的发光信号输入端，这样可以省去在OLED显示面板的边框处设置用于向各像素电路提供发光信号的发光驱动电路，有利于显示面板的窄边框设计。
下面对本发明实施例提供的上述移位寄存器的每一个单元的具体结构进行详细的说明。
在具体实施时，本发明实施例提供的上述移位寄存器中，扫描信号输出控制单元，如图3a和图3b所示，可以具体包括：第一控制模块401和第二控制模块402；其中，
第一控制模块401的第一输入端与第一参考信号端Ref1相连、第二输入端与第二参考信号端Ref2相连、第一控制端与第一节点P1相连、第二控制端与发光信号输出端Out1相连、输出端与扫描信号输出端Out2相连，用于在发光信号输出阶段，导通第一参考信号端Ref1与扫描信号输出端Out2；
第二控制模块402的输入端与第二时钟信号端CLK相连、控制端与第一节点P1相连、输出端与扫描信号输出端Out2相连，用于在充电阶段和扫描信号输出阶段，导通第二时钟信号端CLK与扫描信号输出端Out2，并在扫描信号输出阶段使扫描信号输出端Out2输出扫描信号。
在具体实施时，本发明实施例提供的上述移位寄存器，在充电阶段和扫描信号输出阶段，第二控制模块402在第一节点P1的控制下导通，导通的第二控制模块402将第二时钟信号端CLK与扫描信号输出端Out2导通，使扫描信号输出端Out2同步输出第二时钟信号端CLK的时钟信号，对第二时钟信号端CLK输入方波信号，这样可以使扫描信号输出端Out2在扫描信号输出阶段输出扫描信号，使扫描信号输出端Out2在充电阶段输出与扫描信号极性相反的信号；在发光信号输出阶段，第一控制模块401在第一节点P1和发光信号输出端Out1的控制下导通，导通的第一控制模块401将第一参考信号端Ref1与扫描信号输出端Out2导通，由于第一参考信号端Ref1输入的信号与扫描信号的极性相反，因此扫描信号输出端Out2在发光信号输出阶段输出与扫描信号极性相反的信号。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图3a和图3b所示，第一控制模块401可以具体包括：第一开关晶体管T1、第二开关晶体管T2及第三开关晶体管T3；其中，
第一开关晶体管T1的栅极与发光信号输出端Out1相连、源极与第二开关晶体管T2的漏极相连、漏极与第二参考信号端Ref2相连；
第二开关晶体管T2的栅极与第一节点P1相连、源极与第一参考信号端Ref1相连、漏极与第一开关晶体管T1的源极相连；
第三开关晶体管T3的栅极分别与第一开关晶体管T1的源极和第二开关晶体管T2的漏极相连、源极与第一参考信号端Ref1相连、漏极与扫描信号输出端Out2相连。
在具体实施时，第一开关晶体管T1、第二开关晶体管T2及第三开关晶体管T3可以同时均为P型晶体管，如图3a所示，也可以同时均为N型晶体管，如图3b所示，在此不作限定。在发光信号输出阶段，第一开关晶体管T1和第三开关晶体管T3处于导通状态，第二开关晶体管T2处于关闭状态，导通的第三开关晶体管T3将第一参考信号端Ref1与扫描信号输出端Out2导通；当第一开关晶体管T1、第二开关晶体管T2及第三开关晶体管T3为P型晶体管时，第一参考信号端Ref1输入高电平信号，其相应的显示面板的显示区域内的晶体管也全部应为P型晶体管，因此扫描信号输出端Out2输出与扫描信号极性相反的高电平信号；当第一开关晶体管T1、第二开关晶体管T2及第三开关晶体管T3为N型晶体管时，第一参考信号端Ref1输入低电平信号，其相应的显示面板的显示区域内的晶体管也全部应为N型晶体管，因此扫描信号输出端Out2输出与扫描信号极性相反的低电平信号。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图3a和图3b所示，第二控制模块402可以具体包括：第四开关晶体管T4和第一电容C1；其中，
第四开关晶体管T4的栅极与第一节点P1相连、源极与第二时钟信号端CLK相连、漏极与扫描信号输出端Out2相连；
第一电容C1连接于第一节点P1与扫描信号输出端Out2之间。
在具体实施时，第四开关晶体管T4可以为P型晶体管，如图3a所示，也可以为N型晶体管，如图3b所示，在此不做限定。在充电阶段和扫描信号输出阶段，第四开关晶体管T4处于导通状态，导通的第四开关晶体管T4将第二时钟信号端CLK与扫描信号输出端Out2导通，使扫描信号输出端Out2同步输出第二时钟信号端CLK的时钟信号，且在扫描信号输出阶段，第二时钟信号端CLK的时钟信号应为扫描信号，当第四膜薄晶体管T4为P型晶体管时，其相应的显示面板的显示区域内的晶体管也全部应为P型晶体管，扫描信号输出端Out2在扫描信号输出阶段输出低电平的扫描信号；当第四膜薄晶体管T4为N型晶体管时，其相应的显示面板的显示区域内的晶体管也全部应为N型晶体管，扫描信号输出端Out2在扫描信号输出阶段输出高电平的扫描信号。
在具体实施时，本发明实施例提供的上述移位寄存器中，发光信号输出控制单元，如图4a和图4b所示，可以具体包括：第三控制模块301和第四控制模块302；其中，
第三控制模块301的输入端与第一参考信号端Ref1相连、控制端与第一节点P1相连、输出端与发光信号输出端Out1相连，用于在充电阶段与扫描信号输出阶段，导通第一参考信号端Ref1与发光信号输出端Out1；
第四控制模块302的输入端与第二参考信号端Ref2相连、控制端与第二节点P2相连、输出端与发光信号输出端Out1相连，用于在发光信号输出阶段，导通第二参考信号端Ref2与发光信号输出端Out1，使发光信号输出端Out1输出发光信号。
在具体实施时，本发明实施例提供的上述移位寄存器，在充电阶段和扫描信号输出阶段，第三控制模块301在第一节点P1的控制下导通，导通的第三控制模块301将第一参考信号端Ref1与发光信号输出端Out1导通，由于第一参考信号端Ref1输入的信号与发光信号的极性相反，因此发光信号输出端Out1在充电阶段和扫描信号输出阶段输出与发光信号极性相反的信号；在发光信号输出阶段，第四控制模块302在第二节点P2的控制下导通，导通的第四控制模块302将第二参考信号端Ref2与发光信号输出端Out1导通，由于第二参考信号端Ref2输入的信号与发光信号的极性相同，因此发光信号输出端Out1在发光信号输出阶段输出发光信号。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图4a和图4b所示，第三控制模块301可以具体包括：第五开关晶体管T5；
第五开关晶体管T5的栅极与第一节点P1相连、源极与第一参考信号端Ref1相连、漏极与发光信号输出端Out1相连。
在具体实施时，第五开关晶体管T5可以为P型晶体管，如图4a所示，也可以为N型晶体管，如图4b所示，在此不做限定。在充电阶段和扫描信号输出阶段，第五开关晶体管T5处于导通状态，导通的第五开关晶体管T5将发光信号输出端Out1与第一参考信号端Ref1导通，当第五膜薄晶体管T5为P型晶体管时，第一参考信号端Ref1输入高电平信号，其相应的显示面板的显示区域内的晶体管也全部应为P型晶体管，发光信号输出端Out1在充电阶段和扫描信号输出阶段输出高电平的发光信号；当第五膜薄晶体管T5为N型晶体管时，第一参考信号端Ref1输入低电平信号，其相应的显示面板的显示区域内的晶体管也全部应为N型晶体管，发光信号输出端Out1在充电阶段和扫描信号输出阶段输出低电平的发光信号。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图4a和图4b所示，第四控制模块302可以具体包括：第六开关晶体管T6；
第六开关晶体管T6的栅极与第二节点P2相连、源极与发光信号输出端Out1相连、漏极与第二参考信号端Ref2相连。
在具体实施时，第六开关晶体管T6可以为P型晶体管，如图4a所示，也可以为N型晶体管，如图4b所示，在此不做限定。在发光信号输出阶段，第六开关晶体管T6处于导通状态，导通的第六开关晶体管T6将发光信号输出端Out1与第二参考电压信号端Ref2导通，当第六膜薄晶体管T6为P型晶体管时，第二参考信号端Ref2输入低电平信号，其相应的显示面板的显示区域内的晶体管也全部应为P型晶体管，发光信号输出端Out1在发光信号输出阶段输出低电平的发光信号；当第六膜薄晶体管T6为N型晶体管时，第二参考信号端Ref2输入高电平信号，其相应的显示面板的显示区域内的晶体管也全部应为N型晶体管，发光信号输出端Out1在发光信号输出阶段输出高电平的发光信号。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图5a和图5b所示，信号输入单元10可以具体包括：第七开关晶体管T7和第八开关晶体管T8；其中，
第七开关晶体管T7的栅极与第一时钟信号端CLKB相连、源极与第一节点P1相连、漏极与信号输入端Input相连；
第八开关晶体管T8的栅极与信号输入端Input相连、源极与第一参考信号端Ref1相连、漏极与第二节点P2相连。
在具体实施时，第七开关晶体管T7和第八开关晶体管T8可以同时均为P型晶体管，如图5a所示，也可以同时均为N型晶体管，如图5b所示，在此不作限定。当第七开关晶体管T7为P型晶体管时，第一时钟信号端CLKB输入低电平信号时，第七开关晶体管T7处于导通状态，当第七开关晶体管T7为N型晶体管时，第一时钟信号端CLKB输入高电平信号时，第七开关晶体管T7处于导通状态，导通的第七开关晶体管T7将第一节点P1与信号输入端Input导通，使第一节点P1的电位与信号输入端Input的电位相同；当第八开关晶体管T8为P型晶体管时，第一参考信号端Ref1输入高电平信号，信号输入端Input输入低电平信号时，第八开关晶体管T8导通，导通的第八开关晶体管T8将第一参考信号端Ref1与第二节点P2导通，使第二节点P2处于高电平状态；当第八开关晶体管T8为N型晶体管时，第一参考信号端Ref1输入低电平信号，信号输入端Input输入高电平信号时，第八开关晶体管T8导通，导通的第八开关晶体管T8将第一参考信号端Ref1与第二节点P2导通，使第二节点P2处于低电平状态。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图5a和图5b所示，复位控制单元20可以具体包括：第九开关晶体管T9和第二电容C2；其中，
第九开关晶体管T9的栅极与复位信号端Reset相连、源极与第二节点P2相连、漏极与第二参考信号端Ref2相连；
第二电容C2连接于第二节点P2与第二参考信号端Ref2之间。
在具体实施时，第九开关晶体管T9可以为P型晶体管，如图5a所示，也可以为N型晶体管，如图5b所示，在此不作限定。当第九开关晶体管T9为P型晶体管时，第二参考信号端Ref2输入低电平信号，复位信号端Reset输入低电平信号时，第九开关晶体管T9导通，导通的第九开关晶体管T9将第二参考信号端Ref2和第二节点P2导通，使第二节点P2处于低电平状态；当第九开关晶体管T9为N型晶体管时，第二参考信号端Ref2输入高电平信号，复位信号端Reset输入高电平信号时，第九开关晶体管T9处于导通状态，导通的第九开关晶体管T9将第二参考信号端Ref2与第二节点P2导通，使第二节点P2处于高电平状态。
在具体实施时，本发明实施例提供的上述移位寄存器，如图6所示，还包括：第一节点P1维持单元50；
第一节点P1维持单元50的输入端与第一参考信号端Ref1相连、控制端与第二节点P2相连、输出端与第一节点P1相连，用于在发光信号输出阶段，在第二节点P2的控制下保持第一节点P1的电位。
在具体实施时，本发明实施例提供的上述移位寄存器，在发光信号输出阶段，第一节点P1维持单元50在第二节点P2的控制下导通，导通的第一节点P1维持单元将第一参考信号端Ref1与第一节点P1导通，进一步保持第一节点P1的电位，可以降低第一节点P1的输出噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图7a和图7b所示，第一节点P1维持单元50可以具体包括：第十开关晶体管T10；
第十开关晶体管T10的栅极与第二节点P2相连、源极与第一参考信号端Ref1相连、漏极与第一节点P1相连。
在具体实施时，第十开关晶体管T10可以为P型晶体管，如图7a所示，也可以为N型晶体管，如图7b所示，在此不作限定。当第十开关晶体管T10为P型晶体管时，第一参考信号端Ref1输入高电平信号，在第二节点P2处于低电平时，第十开关晶体管T10导通，导通的第十开关晶体管T10将第一参考信号端Ref1与第一节点P1导通，使第一节点P1保持在高电平状态；当第十开关晶体管T10为N型晶体管时，第一参考信号端Ref1输入低电平信号，第二节点P2处于高电平时，第十开关晶体管T10导通，导通的第十开关晶体管T10将第一参考信号端Ref1与第一节点P1导通，使第一节点P1的保持在低电平状态。
在具体实施时，本发明实施例提供的上述移位寄存器，如图6所示，还包括：第二节点P2维持单元60；
第二节点P2维持单元60的输入端与第一参考信号Ref1相连、控制端与第一节点P1相连、输出端与第二节点P2相连，用于在充电阶段与扫描信号输出阶段，在第一节点P1的控制下保持第二节点P2的电位。
在具体实施时，本发明实施例提供的上述移位寄存器，在充电阶段和扫描信号输出阶段，第二节点P2维持单元60在第一节点P1的控制下导通，导通的第二节点P2维持单元将第一参考信号端Ref1与第二节点P2导通，进一步保持第二节点P2的电位，可以降低第二节点P2的输出噪声。
在具体实施时，本发明实施例提供的上述移位寄存器，如图7a和图7b所示，第二节点P2维持单元60可以具体包括：第十一开关晶体管T11；
第十一开关晶体管T11的栅极与第一节点P1相连、源极与第一参考信号端Ref1相连、漏极与第二节点P2相连。
在具体实施时，第十一开关晶体管T11可以为P型晶体管，如图7a所示，也可以为N型晶体管，如图7b所示，在此不作限定。当第十一开关晶体管T11为P型晶体管时，第一参考信号端Ref1输入高电平信号，第一节点P1处于低电平时，第十一开关晶体管T11导通，导通的第十一开关晶体管T11将第一参考信号端Ref1与第二节点P2导通，使第二节点P2保持在高电平状态；当第十一开关晶体管T11为N型晶体管时，第一参考信号端Ref1输入低电平信号，第一节点P1处于高电平时，第十一开关晶体管T11导通，导通的第十一开关晶体管T11将第一参考信号端Ref1与第二节点P2导通，使第二节点P2的保持在低电平状态。
需要说明的是本发明上述实施例中提到的开关晶体管可以是薄膜晶体管(TFT，Thin Film Transistor)，也可以是金属氧化物半导体场效应管(MOS，Metal Oxide Scmiconductor)，在此不做限定。在具体实施中，这些晶体管的源极和漏极可以互换，不做具体区分。在描述具体实施例时以薄膜晶体管为例进行说明。
并且，本发明实施例提供的上述移位寄存器中提到的开关晶体管可以全部采用P型晶体管或全部采用N型晶体管设计，这样可以简化移位寄存器的电路的制作工艺流程。本发明实施例提供的上述移位寄存器中的开关晶体管，全部采用P型晶体管时，第一参考信号端Ref1输入高电平信号，第二参考信号端Ref2输入低电平信号；全部采用N型晶体管时，第一参考信号端Ref1输入低电平信号，第二参考信号端Ref2输入高电平信号。
下面结合本发明实施例提供的移位寄存器的结构和时序对本发明实施例提供的移位寄存器的工作过程进行详细描述：其中，实施例一中移位寄存器的开关晶体管全部采用P型晶体管进行设计；实施例二中移位寄存器的开关晶体管全部采用N型晶体管进行设计。
实施例一：结合图8a所示的移位寄存器以及图8b所示的图8a的输入输出时序图，对本发明实施例提供的移位寄存器的工作过程作以描述。具体地，选取如图8b所示的输入输出时序图中的A～D四个阶段。下述描述中以1表示高电平信号，0表示低电平信号。
在A阶段，Input＝0，CLKB＝0，CLK＝1，Reset＝1，Ref1＝1。由于Reset＝1，因此第九开关晶体管T9关闭；由于Input＝0，因此第八开关晶体管T8导通，Ref1与第二节点P2导通，使得第二节点P2处于高电平，进而使得第十开关晶体管T10和第六开关晶体管T6关闭，关闭的第六开关晶体管T6使第一开关晶体管T1关闭；同时由于CLKB＝0，因此第七开关晶体管T7导通，信号输入端Input通过导通的第七开关晶体管T7对第一电容C1充电，同时导通的第七开关晶体管T7使第一节点P1与信号输入端Input导通，因而第一节点P1处于低电平，进而使第十一开关晶体管T11、第五开关晶体管T5、第四开关晶体管T4和第二开关晶体管T2导通，导通的第二开关晶体管T2将第三开关晶体管T3关闭，导通的第四开关晶体管T4将第二时钟信号端CLK与扫描信号输出端Out2导通，使扫描信号输出端Out2输出高电平信号，导通的第五开关晶体管T5将第一参考信号端Ref1与发光信号输出端Out1导通，使发光信号输出端Out1输出高电平信号。A阶段为第一电容C1的充电阶段。
在B阶段，Input＝1，CLKB＝1，CLK＝0，Reset＝1，Ref1＝1。由于Input＝1、CLKB＝1和Reset＝1，因此第七开关晶体管T7、第八开关晶体管T8、第九开关晶体管T9都处于关闭状态，第一节点P1保持低电平状态，同时由于第九开关晶体管T9关闭，第二电容C2没有放电路径，因此第二节点P2仍处于高电平，第六开关晶体管T6和第十开关晶体管T10关闭，关闭的第六开关晶体管将第一开关晶体管T1关闭；第一节点P1处于低电平将第十一开关晶体管T11、第五开关晶体管T5、第四开关晶体管T4和第二开关晶体管T2导通，导通的第二开关晶体管T2将第三开关晶体管T3关闭，导通的第四开关晶体管T4将扫描信号输出端Out2与第二时钟信号端CLK导通，使扫描信号输出端Out2输出低电平信号，导通的第五开关晶体管T5将第一参考信号端Ref1与发光信号输出端Out1导通，使发光信号输出端输Out1出高电平信号。B阶段为扫描信号输出阶段。
在C阶段，Input＝1，CLKB＝0，CLK＝1，Reset＝0，Ref1＝1，Ref2＝0。由于Input＝1，因此第八开关晶体管T8关闭；由于CLKB＝0，因此第七开关晶体管T7导通，导通的第七开关晶体管T7将第一节点P1与信号输入端Input导通，使得第一节点P1处于高电平，因此第十一开关晶体管T11、第五开关晶体管T5、第四开关晶体管T4和第二开关晶体管T2关闭；由于Reset＝0，因此第九开关晶体管T9导通，导通的第九开关晶体管T9将第二节点P2与第二参考信号端Ref2导通，使得第二节点P2处于低电平，进而使第六开关晶体管T6和第十开关晶体管T10导通，导通的第六开关晶体管T6将第一开关晶体管T1导通，导通第一开关晶体管T1将第三开关晶体管T3导通，导通的第三开关晶体管T3将第一参考信号端Ref1与扫描信号输出端Out2导通，使扫描信号输出端Out2输出高电平信号，同时导通的第六开关晶体管T6将发光信号输出端Out1与第二参考信号端Ref2导通，因此发光信号输出端Out1输出低电平信号。C阶段为发光信号输出阶段。
在D阶段，Input＝1，CLKB＝1，CLK＝0，Reset＝1，Ref1＝1，Ref2＝0。由于Input＝1、CLKB＝1和Reset＝1，因此第七开关晶体管T7、第八开关晶体管T8、第九开关晶体管T9都处于关闭状态，第二电容C2没有放电路径，因此第二节点P2仍处于低电平，由于第一电容C1也没有放电路径，所以第一节点P1保持高电平；第一节点P1处于高电平将第十一开关晶体管T11、第五开关晶体管T5、第四开关晶体管T4和第二开关晶体管T2关闭；第二节点P2处于低电平将第六开关晶体管T6和第十开关晶体管T10导通，导通的第六开关晶体管T6将第一开关晶体管T1导通，导通第一开关晶体管T1将第三开关晶体管T3导通，导通的第三开关晶体管T3将第一参考信号端Ref1与扫描信号输出端Out2导通，使扫描信号输出端Out2输出高电平信号，同时导通的第六开关晶体管T6将发光信号输出端Out1与第二参考信号端Ref2导通，因此发光信号输出端Out1输出低电平信号。D阶段仍为发光信号输出阶段。
至此不再进一步叙述，下一阶段仍为发光信号输出阶段。
实施例二：结合图9a所示的移位寄存器以及图9b所示的图9a的输入输出时序图，对本发明实施例提供的移位寄存器的工作过程作以描述。具体地，选取如图9b所示的输入输出时序图中的A～D四个阶段。下述描述中以1表示高电平信号，0表示低电平信号。
在A阶段，Input＝1，CLKB＝1，CLK＝0，Reset＝0，Ref1＝0。由于Reset＝0，因此第九开关晶体管T9关闭；由于Input＝1，因此第八开关晶体管T8导通，Ref1与第二节点P2导通，使得第二节点P2处于低电平，进而使得第十开关晶体管T10和第六开关晶体管T6关闭，关闭的第六开关晶体管T6将第一开关晶体管T1关闭；同时由于CLKB＝1，因此第七开关晶体管T7导通，信号输入端Input通过导通的第七开关晶体管T7对第一电容C1充电，同时导通的第七开关晶体管T7使第一节点P1与信号输入端Input导通，因而第一节点P1处于高电平，进而使第十一开关晶体管T11、第五开关晶体管T5、第四开关晶体管T4和第二开关晶体管T2导通，导通的第二开关晶体管T2将第三开关晶体管T3关闭，导通的第四开关晶体管T4将第二时钟信号端CLK与扫描信号输出端Out2导通，使扫描信号输出端Out2输出低电平信号，导通的第五开关晶体管T5将第一参考信号端Ref1与发光信号输出端Out1导通，使发光信号输出端Out1输出低电平信号。A阶段为第一电容C1的充电阶段。
在B阶段，Input＝0，CLKB＝0，CLK＝1，Reset＝1，Ref1＝0。由于Input＝0、CLKB＝0和Reset＝0，因此第七开关晶体管T7、第八开关晶体管T8、第九开关晶体管T9都处于关闭状态，第一节点P1保持高电平状态，同时由于第九开关晶体管T9关闭，第二电容C2没有放电路径，因此第二节点P2仍处于低电平，第六开关晶体管T6和第十开关晶体管T10关闭，关闭的第六开关晶体管T6将第一开关晶体管T1关闭；第一节点P1处于高电平将第十一开关晶体管T11、第五开关晶体管T5、第四开关晶体管T4和第二开关晶体管T2关闭导通，导通的第二开关晶体管T2将第三开关晶体管T3关闭，导通的第四开关晶体管T4将扫描信号输出端Out2与第二时钟信号端CLK导通，使扫描信号输出端Out2输出高电平信号，导通的第五开关晶体管T5将第一参考信号端Ref1与发光信号输出端Out1导通，使发光信号输出端输Out1出低电平信号。B阶段为扫描信号输出阶段。
在C阶段，Input＝0，CLKB＝1，CLK＝0，Reset＝1，Ref1＝0，Ref2＝1。由于Input＝0，因此第八开关晶体管T8关闭；由于CLKB＝1，因此第七开关晶体管T7导通，导通的第七开关晶体管T7将第一节点P1与信号输入端Input导通，使得第一节点P1处于低电平，因此第十一开关晶体管T11、第五开关晶体管T5、第四开关晶体管T4和第二开关晶体管T2关闭；由于Reset＝1，因此第九开关晶体管T9导通，导通的第九开关晶体管T9将第二节点P2与第二参考信号端Ref2导通，使得第二节点P2处于高电平，进而使第六开关晶体管T6和第十开关晶体管T10导通，导通的第六开关晶体管T6将第一开关晶体管T1导通，导通第一开关晶体管T1将第三开关晶体管T3导通，导通的第三开关晶体管T3将第一参考信号端Ref1与扫描信号输出端Out2导通，使扫描信号输出端Out2输出低电平信号，同时导通的第六开关晶体管T6将发光信号输出端Out1与第二参考信号端Ref2导通，因此发光信号输出端Out1输出高电平信号。C阶段为发光信号输出阶段。
在D阶段，Input＝0，CLKB＝0，CLK＝1，Reset＝0，Ref1＝0，Ref2＝1。由于Input＝0、CLKB＝0和Reset＝0，因此第七开关晶体管T7、第八开关晶体管T8、第九开关晶体管T9都处于关闭状态，第二电容C2没有放电路径，因此第二节点P2仍处于高电平，由于第一电容C1也没有放电路径，所以第一节点P1保持低电平；第一节点P1处于低电平将第十一开关晶体管T11、第五开关晶体管T5、第四开关晶体管T4和第二开关晶体管T2关闭；第二节点P2处于高电平将第六开关晶体管T6和第十开关晶体管T10导通，导通的第六开关晶体管T6将第一开关晶体管T1导通，导通第一开关晶体管T1将第三开关晶体管T3导通，导通的第三开关晶体管T3将第一参考信号端Ref1与扫描信号输出端Out2导通，使扫描信号输出端Out2输出低电平信号，同时导通的第六开关晶体管T6将发光信号输出端Out1与第二参考信号端Ref2导通，因此发光信号输出端Out1输出高电平信号。D阶段仍为发光信号输出阶段。
至此不再进一步叙述，下一阶段仍为发光信号输出阶段。
基于同一发明构思，本发明实施例提供了一种栅极驱动电路，如图10所示，包括串联的多个本发明实施例提供的上述移位寄存器，除第一个移位寄存器和最后一个移位寄存器之外，其余每个移位寄存器的扫描信号输出端Out2均向与其相邻的下一个移位寄存器的信号输入端Input输入触发信号，并向与其相邻的上一个移位寄存器的复位信号端Reset输入复位信号；第一个移位寄存器的扫描信号输出端Out2向第二个移位寄存器的信号输入端Input输入触发信号；最后一个移位寄存器的扫描信号输出端Out2向自身以及上一个移位寄存器的复位信号端Reset输入复位信号。
为了方便说明，图10中仅示出了五个移位寄存器，分别为第1级移位寄存器、第N-1级移位寄存器、第N级移位寄存器、第N+1级移位寄存器、第M级移位寄存器。其中，第N级移位寄存器的扫描信号输出端Out2，不仅向第N-1级移位寄存器输出复位信号，同时还向第N+1级移位寄存器输出触发信号。
本发明实施例提供了一种移位寄存器及栅极驱动电路，在充电阶段，在第一时钟信号端和信号输入端的控制下，信号输入单元通过第一节点，控制发光信号输出控制单元导通第一参考信号端和发光信号输出端，并控制扫描信号输出控制单元导通第二时钟信号端和扫描信号输出端；在扫描信号输出阶段，在第二时钟信号端的控制下，扫描信号输出端输出扫描信号，实现扫描信号输出的功能；在发光信号输出阶段，在复位信号端和第二参考信号端的控制下，复位控制单元通过第二节点，控制扫描信号输出控制单元导通第一参考信号端和扫描信号输出端，并控制发光信号输出控制单元导通第二参考信号端和发光信号输出端，使发光信号输出端输出发光信号，实现发光信号输出的功能，由此通过栅极驱动电路中三个相邻的移位寄存器驱动一个像素电路进行工作，第一个移位寄存器的扫描信号输出端向像素电路的第一扫描信号输入端输入扫描信号，第二个移位寄存器的扫描信号输出端向像素电路的第二扫描信号输入端输入扫描信号，第三个移位寄存器的发光信号输出端向像素电路的发光信号输入端输入发光信号，可以实现驱动像素电路在不同阶段正常工作。本发明实施例提供的上述移位寄存器集成了输出扫描信号和发光信号的功能，这样可以省去在OLED显示面板的边框处设置用于向各像素电路提供发光信号的发光驱动电路，有利于显示面板的窄边框设计。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (14)

1.一种移位寄存器，其特征在于，包括：信号输入单元、复位控制单元、发光信号输出控制单元，以及扫描信号输出控制单元；其中，
所述信号输入单元的输入端与第一参考信号端相连，第一控制端与第一时钟信号端相连，第二控制端与信号输入端相连，第一输出端与第一节点相连，第二输出端与第二节点相连；
所述复位控制单元的输入端与第二参考信号端相连，控制端与复位信号端相连，输出端与所述第二节点相连；
所述发光信号输出控制单元的第一输入端与所述第一参考信号端相连，第二输入端与所述第二参考信号端相连，第一控制端与所述第一节点相连，第二控制端与所述第二节点相连，输出端与发光信号输出端相连；
所述扫描信号输出控制单元的第一输入端与第二时钟信号端相连，第二输入端与所述第一参考信号端相连，第三输入端与所述第二参考信号端相连，第一控制端与所述第一节点相连，第二控制端与所述发光信号输出控制单元的输出端相连，输出端与扫描信号输出端相连；
在充电阶段，在所述第一时钟信号端和所述信号输入端的控制下，所述信号输入单元通过所述第一节点，控制所述发光信号输出控制单元导通所述第一参考信号端和所述发光信号输出端，并控制所述扫描信号输出控制单元导通所述第二时钟信号端和所述扫描信号输出端；
在扫描信号输出阶段，在所述第二时钟信号端的控制下，所述扫描信号输出端输出扫描信号；
在发光信号输出阶段，在所述复位信号端和所述第二参考信号端的控制下，所述复位控制单元通过所述第二节点，控制所述扫描信号输出控制单元导通所述第一参考信号端和所述扫描信号输出端，并控制所述发光信号输出控制单元导通所述第二参考信号端和所述发光信号输出端，使所述发光信号输出端输出发光信号。
2.如权利要求1所述的移位寄存器，其特征在于，所述扫描信号输出控制单元，具体包括：第一控制模块和第二控制模块；其中，
所述第一控制模块的第一输入端与所述第一参考信号端相连、第二输入端与所述第二参考信号端相连、第一控制端与所述第一节点相连、第二控制端与所述发光信号输出端相连、输出端与所述扫描信号输出端相连，用于在所述发光信号输出阶段，导通所述第一参考信号端与所述扫描信号输出端；
所述第二控制模块的输入端与所述第二时钟信号端相连、控制端与所述第一节点相连、输出端与所述扫描信号输出端相连，用于在所述充电阶段和所述扫描信号输出阶段，导通所述第二时钟信号端与所述扫描信号输出端，并在所述扫描信号输出阶段使所述扫描信号输出端输出扫描信号。
3.如权利要求2所述的移位寄存器，其特征在于，所述第一控制模块，具体包括：第一开关晶体管、第二开关晶体管及第三开关晶体管；其中，
所述第一开关晶体管的栅极与所述发光信号输出端相连、源极与所述第二开关晶体管的漏极相连、漏极与所述第二参考信号端相连；
所述第二开关晶体管的栅极与所述第一节点相连、源极与所述第一参考信号端相连、漏极与所述第一开关晶体管的源极相连；
所述第三开关晶体管的栅极分别与所述第一开关晶体管的源极和所述第二开关晶体管的漏极相连、源极与所述第一参考信号端相连、漏极与所述扫描信号输出端相连。
4.如权利要求2所述的移位寄存器，其特征在于，所述第二控制模块，具体包括：第四开关晶体管和第一电容；其中，
所述第四开关晶体管的栅极与所述第一节点相连、源极与所述第二时钟信号端相连、漏极与所述扫描信号输出端相连；
所述第一电容连接于所述第一节点与所述扫描信号输出端之间。
5.如权利要求1所述的移位寄存器，其特征在于，所述发光信号输出控制单元，具体包括：第三控制模块和第四控制模块；其中，
所述第三控制模块的输入端与所述第一参考信号端相连、控制端与所述第一节点相连、输出端与所述发光信号输出端相连，用于在所述充电阶段与所述扫描信号输出阶段，导通所述第一参考信号端与所述发光信号输出端；
所述第四控制模块的输入端与所述第二参考信号端相连、控制端与所述第二节点相连、输出端与所述发光信号输出端相连，用于在所述发光信号输出阶段，导通所述第二参考信号端与所述发光信号输出端，使所述发光信号输出端输出发光信号。
6.如权利要求5所述的移位寄存器，其特征在于，所述第三控制模块，具体包括：第五开关晶体管；
所述第五开关晶体管的栅极与所述第一节点相连、源极与所述第一参考信号端相连、漏极与所述发光信号输出端相连。
7.如权利要求5所述的移位寄存器，其特征在于，所述第四控制模块，具体包括：第六开关晶体管；
所述第六开关晶体管的栅极与所述第二节点相连、源极与所述发光信号输出端相连、漏极与所述第二参考信号端相连。
8.如权利要求1所述的移位寄存器，其特征在于，所述信号输入单元，具体包括：第七开关晶体管和第八开关晶体管；其中，
所述第七开关晶体管的栅极与所述第一时钟信号端相连、源极与所述第一节点相连、漏极与所述信号输入端相连；
所述第八开关晶体管的栅极与所述信号输入端相连、源极与所述第一参考信号端相连、漏极与所述第二节点相连。
9.如权利要求1所述的移位寄存器，其特征在于，所述复位控制单元，具体包括：第九开关晶体管和第二电容；其中，
所述第九开关晶体管的栅极与所述复位信号端相连、源极与所述第二节点相连、漏极与所述第二参考信号端相连；
所述第二电容连接于所述第二节点与所述第二参考信号端之间。
10.如权利要求1-9任一项所述的移位寄存器，其特征在于，所述移位寄存器，还包括：第一节点维持单元；
所述第一节点维持单元的输入端与所述第一参考信号端相连、控制端与所述第二节点相连、输出端与所述第一节点相连，用于在所述发光信号输出阶段，在所述第二节点的控制下保持所述第一节点的电位。
11.如权利要求10所述的移位寄存器，其特征在于，所述第一节点维持单元，具体包括：第十开关晶体管；
所述第十开关晶体管的栅极与所述第二节点相连、源极与所述第一参考信号端相连、漏极与所述第一节点相连。
12.如权利要求1-9任一项所述的移位寄存器，其特征在于，所述移位寄存器，还包括：第二节点维持单元；
所述第二节点维持单元的输入端与所述第一参考信号相连、控制端与所述第一节点相连、输出端与所述第二节点相连，用于在所述充电阶段与所述扫描信号输出阶段，在所述第一节点的控制下保持所述第二节点的电位。
13.如权利要求12所述的移位寄存器，其特征在于，所述第二节点维持单元，具体包括：第十一开关晶体管；
所述第十一开关晶体管的栅极与所述第一节点相连、源极与所述第一参考信号端相连、漏极与所述第二节点相连。
14.一种栅极驱动电路，其特征在于，包括串联的多个如权利要求1-13任一项所述的移位寄存器，除第一个移位寄存器和最后一个移位寄存器之外，其余每个移位寄存器的扫描信号输出端均向与其相邻的下一个移位寄存器的信号输入端输入触发信号，并向与其相邻的上一个移位寄存器的复位信号端输入复位信号；第一个移位寄存器的扫描信号输出端向第二个移位寄存器的信号输入端输入触发信号；最后一个移位寄存器的扫描信号输出端向自身以及上一个移位寄存器的复位信号端输入复位信号。
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