CN104035018A - 电压自适应调整电路和芯片 - Google Patents

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Abstract

本发明公开了一种电压自适应调整电路和芯片。该电压自适应调整电路包括性能分类监控器和自适应控制器，性能分类监控器，设置在芯片的内部，用于检测芯片在当前的工作电压下的工作性能，并向自适应控制器输出检测结果信号；自适应控制器，与性能分类监控器连接，用于根据性能分类监控器输出的检测结果信号，向芯片的电源管理模块输出控制信号，控制信号用于控制电源管理模块调整芯片的工作电压。本发明实施例能够降低测试工作量。

Description

电压自适应调整电路和芯片
技术领域
本发明实施例涉及电子技术领域，并且更具体地，涉及一种电压自适应调整电路和芯片。
背景技术
随着芯片制造工艺的发展和设计集成度的提升，芯片功耗问题成为亟待解决的问题。降低芯片功耗的技术除传统的时钟门控等技术外，自适应电压调整(AVS，Adaptive Voltage Scaling)技术作为新的有效而重要的低功耗技术而备受关注。其中，确定芯片的最低工作电压是实施AVS技术的核心步骤，该最低工作电压要满足系统最恶劣工作情形下的安全性。在芯片的最低工作电压基础上增加适当的电压裕量即可作为芯片实际工作电压。采用上述方法实现的AVS系统其实际工作电压可以降低到不采用AVS系统下工作电压的85％，功耗节省可达30％。
然而，在确定芯片的最低工作电压时，构造合理的测试向量非常困难，往往难以保证覆盖所有相关路径。目前业界通行的做法是采用测试专用设计(Design For Test，DFT)向量进行测试，进而确定芯片的最低工作电压。然后与实测结果进行对比，并在此基础上修正最低工作电压的值。上述方法需要测试大量的芯片，工作量大，测试流程耗时长。
发明内容
本发明实施例提供了一种电压自适应调整电路和芯片，能够降低测试工作量。
第一方面，提供了一种电压自适应调整电路，电压自适应调整电路包括性能分类监控器和自适应控制器，性能分类监控器，设置在芯片的内部，用于检测芯片在当前的工作电压下的工作性能，并向自适应控制器输出检测结果信号；自适应控制器，与性能分类监控器连接，用于根据性能分类监控器输出的检测结果信号，向芯片的电源管理模块输出控制信号，控制信号用于控制电源管理模块调整芯片的工作电压；其中，性能分类监控器包括一个源信号生成电路、一个比较基准电路、至少一个延时电路、至少一个比较分支电路和至少一个比较检测电路，源信号生成电路，用于为性能分类监控器提供源信号，比较基准电路，用于根据源信号输出基准信号，至少一个延时电路，用于对源信号进行延时处理，得到延时后的源信号，至少一个比较分支电路，用于根据延时后的源信号，输出比较信号，至少一个比较检测电路，用于根据基准信号和比较信号，输出检测结果信号。
结合第一方面，在第一方面的第一种实现方式中，自适应控制器包括配置电路和控制电路，配置电路，用于生成并向性能分类监控器输出配置信号，配置信号用于配置性能分类监控器的延时链；控制电路，用于根据性能分类监控器输出的检测结果信号，向芯片的电源管理模块输出控制信号。
结合第一方面及其上述实现方式，在第一方面的第二种实现方式中，至少一个延时电路包括第一延时电路和第二延时电路，至少一个比较分支电路包括第一比较分支电路和第二比较分支电路，至少一个比较检测电路包括第一比较检测电路和第二比较检测电路；源信号生成电路的输入端、比较基准电路的第一输入端、第一比较分支电路的第一输入端和第二比较分支电路的第一输入端分别接收时钟信号作为驱动；配置信号包括第一配置信号和第二配置信号，配置电路的第一输出端连接第一延时电路的第一输入端并提供第一配置信号，配置电路的第二输出端连接第二延时电路的第一输入端并提供第二配置信号；源信号生成电路的输出端用于提供源信号，分别与比较基准电路的第二输入端和第一延时电路的第二输入端以及第二延时电路的第二输入端连接；第一延时电路的输出端与第一比较分支电路的第二输入端连接，第二延时电路的输出端与第二比较分支电路的第二输入端连接；比较基准电路的输出端用于提供基准信号，分别与第一比较检测电路的第一输入端和第二比较检测电路的第一输入端连接，第一比较分支电路的输出端连接第一比较检测电路的第二输入端，第二比较分支电路的输出端连接第二比较检测电路的第二输入端；第一比较检测电路的输出端和第二比较检测电路的输出端分别与控制电路的输入端连接，用于提供检测结果信号。
结合第一方面及其上述实现方式，在第一方面的第三种实现方式中，至少一个延时电路为一个延时电路，至少一个比较分支电路为一个比较分支电路，至少一个比较检测电路为一个比较检测电路；源信号生成电路的输入端、比较基准电路的第一输入端和比较分支电路的第一输入端分别接收时钟信号作为驱动；配置信号包括第一配置信号，配置电路的第一输出端连接延时电路第一输入端并提供第一配置信号；源信号生成电路的输出端用于提供源信号，分别与比较基准电路的第二输入端和延时电路的第二输入端连接；延时电路的输出端与比较分支电路的第二输入端连接；比较基准电路的输出端用于提供基准信号，与比较检测电路的第一输入端连接，比较分支电路的输出端与比较检测电路的第二输入端连接；比较检测电路的输出端与控制电路的输入端连接，用于提供检测结果信号。
结合第一方面及其上述实现方式，在第一方面的第四种实现方式中，性能分类监控器为多个，且均匀地设置在芯片的内部。
结合第一方面及其上述实现方式，在第一方面的第五种实现方式中，比较检测电路包括异或门逻辑电路。
结合第一方面及其上述实现方式，在第一方面的第六种实现方式中，源信号生成电路包括触发器。
结合第一方面及其上述实现方式，在第一方面的第七种实现方式中，比较基准电路包括触发器。
结合第一方面及其上述实现方式，在第一方面的第八种实现方式中，至少一个比较分支电路包括触发器。
结合第一方面及其上述实现方式，在第一方面的第九种实现方式中，芯片在当前的工作电压下的工作性能包括：当前的工作电压过高、过低或能够适于正常工作。
第二方面，提供了一种芯片，芯片包括前述任一种电压自适应调整电路。
基于上述技术方案，在本发明实施例中，将性能分类监控器设置在芯片的内部，以实时检测不同工作电压下芯片的工作性能。然后，自适应控制器根据性能分类监控器输出的检测结果调整芯片的工作电压。这样，可以自动调整芯片的工作电压，以实现在满足工作性能要求的前提下，控制芯片在较低的电压下工作，从而降低了芯片功耗。
进一步地，根据本发明实施例，由设置在芯片内部的性能分类监控器来检测芯片的工作性能，继而确定芯片工作电压，而不是通过测量大量的芯片来确定，降低了工作量，也省去了耗时的测试流程。
附图说明
为了更清楚地说明本发明实施例的技术方案，下面将对本发明实施例中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明实施例的电压自适应调整电路的示意性框图。
图2是本发明一个实施例的性能分类监控器的示意性框图。
图3是本发明实施例的自适应控制器的示意性框图。
图4是本发明另一实施例的性能分类监控器的示意性框图。
图5是本发明另一实施例的性能分类监控器的示意性框图。
图6是本发明一个实施例的延时电路的示意性框图。
图7是本发明另一实施例的延时电路的示意性框图。
图8是本发明另一实施例的延时电路的示意性框图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本发明的一部分实施例，而不是全部实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动的前提下所获得的所有其他实施例，都应属于本发明保护的范围。
图1是本发明实施例的电压自适应调整电路的示意性框图。由图1所示，电压自适应调整电路10包括性能分类监控器110和自适应控制器120。
性能分类监控器110，设置在芯片的内部，用于检测芯片在当前的工作电压下的工作性能，并向自适应控制器输出检测结果信号。
例如，工作性能反映了如下至少一项：芯片在当前的工作电压下的工作是否满足预设需求(即是否过低)，当前的工作电压是否过高。或者，芯片在当前的工作电压下的工作是合适的，即不存在电压过高或过低，能够适于正常工作。
自适应控制器120，与性能分类监控器连接，用于根据性能分类监控器输出的检测结果信号，向芯片的电源管理模块输出控制信号，控制信号用于控制电源管理模块调整芯片的工作电压。
图2是本发明一个实施例的性能分类监控器的示意性框图。如图2所示，性能分类监控器110包括一个源信号生成电路111、一个比较基准电路112、至少一个延时电路113、至少一个比较分支电路114和至少一个比较检测电路115。
源信号生成电路111，用于为性能分类监控器提供源信号。
比较基准电路112，用于根据源信号输出基准信号。
至少一个延时电路113，用于对源信号进行延时处理，得到延时后的源信号。
至少一个比较分支电路114，用于根据延时后的源信号，输出比较信号。
至少一个比较检测电路115，用于根据基准信号和比较信号，输出检测结果信号。
基于上述技术方案，在本发明实施例中，将性能分类监控器设置在芯片的内部，以实时检测不同工作电压下芯片的工作性能。然后，自适应控制器根据性能分类监控器输出的检测结果调整芯片的工作电压。这样，可以自动调整芯片的工作电压，以实现在满足工作性能要求的前提下，控制芯片在较低的电压下工作，从而降低了芯片功耗。
进一步地，根据本发明实施例，由设置在芯片内部的性能分类监控器来检测芯片的工作性能，继而确定芯片工作电压，而不是通过测量大量的芯片来确定，降低了工作量，也省去了耗时的测试流程。
应理解，本发明实施例并不限定自适应控制器的位置。例如，自适应控制器可以设置芯片的内部，也可以设置在芯片的外部。
也应理解，性能分类监控器检测芯片在当前的工作电压下的工作性能时，检测结果也会受芯片当前的温度影响。换句话说，检测结果信号更能体现每个芯片的个体差异。这样，根据检测结果信号调整芯片的工作电压时，有着较高的准确度和调整效率。
图3是本发明实施例的自适应控制器的示意性框图。
可选地，作为另一实施例，自适应控制器120包括配置电路121和控制电路122。
配置电路121，用于生成并向性能分类监控器输出配置信号，配置信号用于配置性能分类监控器的延时链。所述延时链在所述配置信号的作用下使得所述检测结果信号跟踪所述芯片在当前的工作电压下的工作性能。
控制电路122，用于根据性能分类监控器输出的检测结果信号，向芯片的电源管理模块输出控制信号。
例如，配置电路121与性能分类监控器110中的延时电路113连接，向延时电路113输出配置信号，以配置延时电路的延时链。控制电路122与性能分类监控器110中的比较检测电路115连接，根据比较检测电路115输出的检测结果信号，向芯片的电源管理模块输出控制信号，以控制芯片的工作电压。
图4是本发明另一实施例的性能分类监控器的示意性框图。
如图4所示，可选地，作为另一实施例，至少一个延时电路包括第一延时电路403和第二延时电路404，至少一个比较分支电路包括第一比较分支电路405和第二比较分支电路406，至少一个比较检测电路包括第一比较检测电路407和第二比较检测电路408。
源信号生成电路401的输入端、比较基准电路402的第一输入端、第一比较分支电路405的第一输入端和第二比较分支电路406的第一输入端分别接收时钟信号CLK作为驱动。
配置信号包括第一配置信号PRI_SEL和第二配置信号AUX_SEL，配置电路的第一输出端连接第一延时电路403的第一输入端并提供第一配置信号PRI_SEL，配置电路的第二输出端连接第二延时电路404的第一输入端并提供第二配置信号AUX_SEL。
源信号生成电路401的输出端用于提供源信号，分别与比较基准电路402的第二输入端和第一延时电路403的第二输入端以及第二延时电路404的第二输入端连接。
第一延时电路403的输出端与第一比较分支电路405的第二输入端连接，第二延时电路404的输出端与第二比较分支电路406的第二输入端连接。
比较基准电路402的输出端用于提供基准信号，分别与第一比较检测电路407的第一输入端和第二比较检测电路408的第一输入端连接，第一比较分支电路405的输出端连接第一比较检测电路407的第二输入端，第二比较分支电路406的输出端连接第二比较检测电路408的第二输入端。
第一比较检测电路407的输出端和第二比较检测电路408的输出端分别与控制电路的输入端连接，用于提供检测结果信号。
其中，BPM-EN信号为使能信号。
配置电路121的第一输出端向第一延时电路403输出PRI_SEL信号，以配置第一延时电路403的延时链。配置电路121的第二输出端向第二延时电路404输出AUX_SEL信号，以配置第二延时电路404的延时链。具体地，可以通过检查芯片流片时的静态时序、分析芯片内部电阻压降IRDrop以及结合芯片工艺老化特性等数据来确定第一配置信号PRI_SEL和第二配置信号AUX_SEL。这样，第一配置信号PRI_SEL和第二配置信号AUX_SEL形成一个窗口，以检测芯片在当前的工作电压下工作性能是否出现异常。例如，电压正常，或者电压过低、过高。
第一配置信号PRI_SEL对应检测结果信号PRI_RPT，第二配置信号AUX_SEL对应检测结果信号AUX_RPT。例如，检测结果信号表示的含义如表一所示。
表一
这样，在控制电路122根据检测结果信号AUX_RPT和PRI_RPT，向芯片的电源管理模块输出控制信号，以提升或者降低芯片的工作电压。
当AUX_SEL配置不合理时，配置电路121需要重新配置AUX_SEL(或者同时重配置PRI_SEL值)。具体地，配置电路121可以利用原配置不合理的AUX_SEL值或PRI_SEL值查找预设的数值表以对AUX_SEL或PRI_SEL的值做修正。所述数值表可以预存在一个存储器中，配置电路121通过查找存储器中的数值表得到对原配置不合理的AUX_SEL值或PRI_SEL值进行修正后的修正值，并将修正值作为新的AUX_SEL值或PRI_SEL值发给性能分类监控器110。
在另一种实现方式中，由本领域技术人员配置配置电路121，从而使得配置电路121响应于本领域技术人员的配置得到AUX_SEL值或PRI_SEL值并将AUX_SEL值或PRI_SEL值发送给性能分类监控器110从而有效控制分类性能监控器110中的延时电路113。本领域技术人员具体可以根据经验或真实的芯片测试结果对配置电路121做配置使配置电路121产生合适的AUX_SEL值或PRI_SEL值。AUX_SEL值或PRI_SEL值改变之后，工作性能和检测结果信号PRI_RPT和/或AUX_RPT的对应关系也发生改变。也就是说，配置信号用于调整所述性能分类监控器的检测结果信号使得所述检测结果信号准确反映或跟踪所述芯片在当前的工作电压下的工作性能，减少所述检测结果信号出现误差(不能准确反映芯片当前电压的性能)的概率。例如，当PRI_RPT和AUX_RPT显示电压工作性能正常，但实际上当前工作电压并不能满足预设需求，则本领域技术人员(操作人员)需要通过配置配置电路121改变AUX_SEL值或PRI_SEL值，从而改变延时电路113的性能，使得PRI_RPT和AUX_RPT显示电压工作性能正常时当前芯片电压确实能满足需求。或者，当PRI_RPT和AUX_RPT显示电压工作性能正常，但实际上当前工作电压过高，会消耗额外电量，则本领域技术人员需要通过配置配置电路121改变AUX_SEL值或PRI_SEL值，从而改变延时电路113的性能，使得PRI_RPT和AUX_RPT显示电压工作性能正常时当前芯片电压回到理性水平，不会存在过度设计。
在本发明实施例中，性能分类监控器响应速度快，监控精度无损失。
图5是本发明另一实施例的性能分类监控器的示意性框图。
如图5所示，可选地，作为另一实施例，至少一个延时电路为一个延时电路503，至少一个比较分支电路为一个比较分支电路504，至少一个比较检测电路为一个比较检测电路505。
源信号生成电路501的输入端、比较基准电路502的第一输入端和比较分支电路504的第一输入端分别接收时钟信号CLK作为驱动。
配置信号包括第一配置信号PRI_SEL，配置电路的第一输出端连接延时电路503第一输入端并提供第一配置信号PRI_SEL。
源信号生成电路501的输出端用于提供源信号，分别与比较基准电路502的第二输入端和延时电路503的第二输入端连接。
延时电路503的输出端与比较分支电路504的第二输入端连接。
比较基准电路502的输出端用于提供基准信号，与比较检测电路505的第一输入端连接，比较分支电路504的输出端与比较检测电路505的第二输入端连接。
比较检测电路505的输出端与控制电路的输入端连接，用于提供检测结果信号。
其中，BPM-EN信号为使能信号。配置电路121的输出端向延时电路503输出PRI_SEL信号，以配置延时电路503的延时链。具体地，可以通过检查芯片流片时的静态时序、分析芯片内部电阻压降IRDrop以及结合芯片工艺老化特性等数据来确定配置信号PRI_SEL。
比较检测电路505输出检测结果信号PRI_RPT。例如，检测结果信号PRI_RPT输出为低表示其电路延时正常，保持供电电压。PRI_RPT输出为高表示其电路延时较大，需提升供电电压。这种情况下，控制电路122根据检测结果信号PRI_RPT，向芯片的电源管理模块输出控制信号，以提升芯片的供电电压。
可选地，作为另一实施例，性能分类监控器110为多个，且均匀地设置在芯片的内部。
这样，可以更加准确地检测芯片在当前工作电压下的工作性能，进一步提升了电压自适应控制的准确性和有效性。
可选地，作为另一实施例，比较检测电路包括异或门逻辑电路。
应理解，以与门和非门构造异或门逻辑电路，或者其它等价变换的形式都应落在本发明实施例的保护范围内。
可选地，作为另一实施例，源信号生成电路包括触发器，比较基准电路包括触发器，至少一个比较分支电路包括触发器。
可选地，作为另一实施例，芯片在当前的工作电压下的工作性能包括：当前的工作电压过高、过低或能够适于正常工作。
图6是本发明一个实施例的延时电路的示意性框图。
如图6所示，延时电路中通过二选一开关MUX对延时路径或直通路径进行选择。每级延时路径上有2^i(i为二进制编码比特位)个标准延时单元D，用D*2^i表示。例如，假设延时电路最大支持63级标准延时单元，则第0级MUX的延时路径为1个标准延时单元，第1级MUX的延时路径为2个标准延时单元，第2级MUX的延时路径为4个标准延时单元，第3级MUX的延时路径为8个标准延时单元，第4级MUX的延时路径为16个标准延时单元，第5级MUX的延时路径为32个标准延时单元，以此类推。其中，mux-sel[i]信号用于控制第i级二选一开关MUX的通断。
上述实现方式具有MUX单元使用少，不需要进行译码操作等优点。例如，如果需要25个标准延时单元，其编码为011001，则选中第0/3/4级MUX的延时路径即可。
图7是本发明另一实施例的延时电路的示意性框图。
如图7所示，延时电路中通过二选一开关MUX对延时路径或直通路径进行选择。每级延时路径上有一个标准延时单元D。解码器先对需要的延时量mux-sel进行译码，相应生成控制MUX开关的信号mux-sel[i]。其中，mux-sel[i]信号用于控制第i级二选一开关MUX的通断。
图8是本发明另一实施例的延时电路的示意性框图。
如图8所示，延时电路中通过二选一开关MUX对延时路径或直通路径进行选择。每级延时路径上有一个与非门逻辑单元。解码器先对需要的延时量mux-sel进行译码，相应生成控制与非门的信号nor-sel[i]和控制二选一开关的信号mux-sel[i]。
本发明实施例还提供一种芯片，该芯片包括前述任一种电压自适应调整电路，或者该芯片包括前述任一种性能分类监控器。
在本申请所提供的几个实施例中，应该理解到，所揭露的系统、装置和方法，可以通过其它的方式实现。例如，以上所描述的装置实施例仅仅是示意性的，例如，所述单元的划分，仅仅为一种逻辑功能划分，实际实现时可以有另外的划分方式，例如多个单元或组件可以结合或者可以集成到另一个系统，或一些特征可以忽略，或不执行。另外，所显示或讨论的相互之间的耦合或直接耦合或通信连接可以是通过一些接口、装置或单元的间接耦合或通信连接，也可以是电的，机械的或其它的形式连接。
所述作为分离部件说明的单元可以是或者也可以不是物理上分开的，作为单元显示的部件可以是或者也可以不是物理单元，即可以位于一个地方，或者也可以分布到多个网络单元上。可以根据实际的需要选择其中的部分或者全部单元来实现本发明实施例方案的目的。
另外，在本发明各个实施例中的各功能单元可以集成在一个处理单元中，也可以是各个单元单独物理存在，也可以是两个或两个以上单元集成在一个单元中。上述集成的单元既可以采用硬件的形式实现，也可以采用软件功能单元的形式实现。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到各种等效的修改或替换，这些修改或替换都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以权利要求的保护范围为准。

Claims (11)

1.一种电压自适应调整电路，其特征在于，所述电压自适应调整电路包括性能分类监控器和自适应控制器，
所述性能分类监控器，设置在芯片的内部，用于检测所述芯片在当前的工作电压下的工作性能，并向所述自适应控制器输出检测结果信号；
所述自适应控制器，与所述性能分类监控器连接，用于根据所述性能分类监控器输出的所述检测结果信号，向所述芯片的电源管理模块输出控制信号，所述控制信号用于控制所述电源管理模块调整所述芯片的工作电压；
其中，所述性能分类监控器包括一个源信号生成电路、一个比较基准电路、至少一个延时电路、至少一个比较分支电路和至少一个比较检测电路，
所述源信号生成电路，用于为所述性能分类监控器提供源信号，
所述比较基准电路，用于根据所述源信号输出基准信号，
所述至少一个延时电路，用于对所述源信号进行延时处理，得到延时后的源信号，
所述至少一个比较分支电路，用于根据所述延时后的源信号，输出比较信号，
所述至少一个比较检测电路，用于根据所述基准信号和所述比较信号，输出所述检测结果信号。
2.根据权利要求1所述的电路，其特征在于，所述自适应控制器包括配置电路和控制电路，
所述配置电路，用于生成并向所述性能分类监控器输出配置信号，所述配置信号用于配置所述性能分类监控器的延时链；
所述控制电路，用于根据所述性能分类监控器输出的检测结果信号，向所述芯片的电源管理模块输出所述控制信号。
3.根据权利要求2所述的电路，其特征在于，所述至少一个延时电路包括第一延时电路和第二延时电路，所述至少一个比较分支电路包括第一比较分支电路和第二比较分支电路，所述至少一个比较检测电路包括第一比较检测电路和第二比较检测电路；
所述源信号生成电路的输入端、所述比较基准电路的第一输入端、第一比较分支电路的第一输入端和所述第二比较分支电路的第一输入端分别接收时钟信号作为驱动；
所述配置信号包括第一配置信号和第二配置信号，所述配置电路的第一输出端连接第一延时电路的第一输入端并提供所述第一配置信号，所述配置电路的第二输出端连接第二延时电路的第一输入端并提供所述第二配置信号；
所述源信号生成电路的输出端用于提供源信号，分别与所述比较基准电路的第二输入端和所述第一延时电路的第二输入端以及第二延时电路的第二输入端连接；
所述第一延时电路的输出端与所述第一比较分支电路的第二输入端连接，所述第二延时电路的输出端与所述第二比较分支电路的第二输入端连接；
所述比较基准电路的输出端用于提供基准信号，分别与所述第一比较检测电路的第一输入端和第二比较检测电路的第一输入端连接，所述第一比较分支电路的输出端连接第一比较检测电路的第二输入端，所述第二比较分支电路的输出端连接第二比较检测电路的第二输入端；
所述第一比较检测电路的输出端和第二比较检测电路的输出端分别与所述控制电路的输入端连接，用于提供所述检测结果信号。
4.根据权利要求2所述的电路，其特征在于，所述至少一个延时电路为一个延时电路，所述至少一个比较分支电路为一个比较分支电路，所述至少一个比较检测电路为一个比较检测电路；
所述源信号生成电路的输入端、所述比较基准电路的第一输入端和所述比较分支电路的第一输入端分别接收时钟信号作为驱动；
所述配置信号包括第一配置信号，所述配置电路的第一输出端连接所述延时电路第一输入端并提供所述第一配置信号；
所述源信号生成电路的输出端用于提供源信号，分别与所述比较基准电路的第二输入端和所述延时电路的第二输入端连接；
所述延时电路的输出端与所述比较分支电路的第二输入端连接；
所述比较基准电路的输出端用于提供基准信号，与所述比较检测电路的第一输入端连接，所述比较分支电路的输出端与所述比较检测电路的第二输入端连接；
所述比较检测电路的输出端与所述控制电路的输入端连接，用于提供所述检测结果信号。
5.根据权利要求1至4中任一项所述的电路，其特征在于，所述性能分类监控器为多个，且均匀地设置在所述芯片的内部。
6.根据权利要求1至5中任一项所述的电路，其特征在于，所述比较检测电路包括异或门逻辑电路。
7.根据权利要求1至6中任一项所述的电路，其特征在于，所述源信号生成电路包括触发器。
8.根据权利要求1至7中任一项所述的电路，其特征在于，所述比较基准电路包括触发器。
9.根据权利要求1至8中任一项所述的电路，其特征在于，所述至少一个比较分支电路包括触发器。
10.根据权利要求1至9中任一项所述的电路，其特征在于，所述芯片在当前的工作电压下的工作性能包括：所述当前的工作电压过高、过低或能够适于正常工作。
11.一种芯片，其特征在于，所述芯片包括权利要求1至10中任一项所述的电压自适应调整电路。
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