CN103887161A - 一种抑制掺杂原子在栅介质中扩散的方法 - Google Patents
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Abstract
本发明为一种抑制掺杂原子在栅介质中扩散的方法,涉及用于半导体MOS器件的制造工艺领域,尤其涉及一种有效抑制掺杂原子在栅介质中扩散的方法,包括以下步骤:在基底上制备SiO2栅氧化层;对SiO2栅氧化层进行氮的注入,以形成SiON栅氧化层;在1000~1200℃并伴随纯惰性气体的氛围对SiON栅氧化层进行氮化处理,以修复晶格损伤并形成稳定Si-N键;在400~800℃的氛围下对SiON栅氧化层进行氧化处理,以修复SiO2/Si界面。与传统的高温氮化处理工艺相比,采用本发明制备的SiON栅氧化层不仅具有稳定的氮含量,而且能有效提高栅氧化物氮含量30%左右,从而能有效的抑制硼等掺杂原子在栅介质中的扩散。
Description
技术领域
本发明涉及用于半导体MOS器件的制造工艺领域,尤其涉及一种抑制掺杂原子在栅介质中扩散的方法。
背景技术
超大规模集成电路(VLSI)和特大规模集成电路(ULSI)的快速发展,对器件加工技术提出更多的特殊要求,其中MOS器件特征尺寸进入纳米时代对栅氧化层的要求就是一个明显的挑战。栅氧化层的制备工艺是半导体制造工艺中的关键技术,直接影响和决定了器件的电学特性和可靠性。
MOSFET器件的关键性能指标是驱动电流,驱动电流的大小取决于栅极电容。栅极电容与栅极表面积成正比,与栅介质厚度成反比。因此,通过增加栅极表面积和降低栅介质厚度均可提高栅极电容,而降低栅介质SiO2的厚度就变成推进MOSFET器件性能提高的首要手段。
但当半导体技术进入45纳米时代以来,传统单纯降低SiO2厚度的方法遇到了前所未有的挑战。因为这时候栅介质SiO2的厚度已经很薄(<20A),栅极漏电流中的隧道穿透机制已经起到主导作用。随着SiO2厚度的进一步降低,栅极漏电流也会以指数形式增长。栅介质厚度每降低2A,栅极漏电流就会增加10倍。另一方面,栅极、SiO2栅介质和硅衬底之间存在杂质的浓度梯度,随着栅介质厚度的不断降低,栅极里掺入的硼等杂质会从栅极中扩散到硅衬底中或者固定在栅介质中,这会影响器件的阈值电压,从而影响器件的性能。诚然,增加栅介质厚度可以有效抑制栅极漏电流和栅极中杂质的扩散,但是晶体管驱动电流、翻转延迟时间等关键性能也会大打折扣。这种驱动电流和栅极漏电对栅介质厚度要求上的矛盾,对于传统的SiO2栅介质而言是无法回避的。
C=e0KA/t,其中,C=栅极电容;e0=在空气中的电容率;K=材料的介电常数;A=栅极表面积;t=栅介质厚度
从栅极电容的公式中我们可以看出,栅极电容不仅取决于栅极表面积和栅介质厚度,还取决于栅介质的介电常数,故减少栅介质厚度不是提高栅极电容的唯一方法。即使栅介质厚度保持不变,提高栅介质的介电系数K也可达到降低EOT及增加栅极电容的效果。因此,如何提高栅介质的介电系数K成为了当务之急。
在现阶段,提高栅介质的介电系数的方法大致有两大类:
一类是采用全新的高介电系数的材料作为栅介质,如氮氧化铪硅(HfSiON)等。但采用全新材料涉及到栅极材料的选择,晶格常数的匹配及曝光蚀刻等一系列工艺集成问题,技术开发周期相对较长,不能立即满足45纳米技术的迫切需求。同时全新材料在技术上与以前工艺有较大差异,技术更新的成本过高。
另一大类则仍保持SiO2作为栅介质,通过SiO2氧化膜里掺入氮使之成为致密的SiON来提高栅介质的介电系数。因为传统栅介质SiO2的K值是3.9,而纯的Si3N4的K值可达到7,通过掺杂氮的多少可以实现对SiON栅介质介电系数剪裁的目的。氮原子的掺入还能有效的抑制硼等栅极掺杂原子在栅介质中的扩散。同时,该方法仍然采用SiO2作为栅介质的主体,因此与前期技术有良好的连续性和兼容性。
目前业界通常有三种主要的方法可实现SiO2中的氮掺杂以形成SiON。
第一种方法是在SiO2的生长过程中通入NO等含氮气体,从而在生长过程中直接掺入氮。但这种方法掺杂的氮均匀性很难控制,不能适应半导体生产的要求。
第二种方法是在SiO2介质生长完成后,采用在NO/N2O等含氮气体环境中进一步退火的办法掺杂氮。这种方法掺入的氮原子容易聚积在SiO2和沟道的界面处,从而对沟道中载流子的迁移速度产生负面影响。
第三种方法是在SiO2生长结束后,通过等离子体实现氮掺杂。该方法掺入的氮原子浓度高,深度上主要分布在栅介质的上表面而远离SiO2/沟道界面,是目前半导体业界广泛接受的提高栅介质介电系数的方法。其具体工艺由三步组成:
1)采用ISSG(In-Situ Steam Generation)原位水蒸汽氧化方法生长SiO2介质层;
2)采用DPN(Decoupled Plasma Nitridation)氮气等离子体向SiO2介质中掺杂氮;
3)采用PNA(Post Nitridation Anneal)高温退火工艺稳定N掺杂及修复介质中的等离子体损伤。
在上述制备工艺中,由于栅介质中掺入的氮原子浓度高且主要分布在栅介质的上表面,因此对后续PNA(Post Nitridation Anneal)高温退火工艺的温度、气体氛围和时间间隔必须严格控制,以防止本征氧化层和有机吸附而对氮掺杂造成的影响;此外,PNA(PostNitridation Anneal)的高温退火工艺既容易造成表面氮原子的挥发,又能使氮原子获得能量而继续扩散,造成部分氮原子聚积在SiO2/Si界面处,从而对沟道中载流子的迁移速度产生负面影响。
中国专利(CN102437143A)公开了一种低介电常数材料,包括低介电常数材料和添加剂的介电材料。添加剂包括具有Si-X-Si桥的化合物,其中X为1和8之间的碳原子数。添加剂可包括末端Si-CH3基团。包括添加剂的介电材料可用作半导体器件的层间介电(ILD)层。可使用CVD或溶胶-凝胶工艺形成包括添加剂的介电材料。所述添加剂的一个示例为双(三乙氧基硅基)乙烷。
中国专利(CN102544739A)公开了一种具有高介电常数的超材料,包括至少一个超材料片层,每个超材料片层包括基材和附着在基材上的多个人造微结构,所述人造微结构包括相互平行的第一金属线和第二金属线,还包括至少一个一端与所述第一金属线相连、另一端为自由端且朝向第二金属线的第一金属线分支;以及至少一个一端与所述第二金属线相连、另一端为自由端且朝向第一金属线的第二金属线分支,所述第一金属线分支和所述第二金属线分支依次交错分布。具有这种人造微结构的超材料的介电常数得到了大幅的提高。
发明内容
鉴于上述问题,本发明能使高温氮化处理工艺不仅具有稳定的氮含量,而且能有效的抑制硼等掺杂原子在栅介质中的扩散。
本发明解决技术问题所采用的技术方案为:
一种有效抑制掺杂原子在栅介质中扩散的方法,包括以下步骤:
步骤1、在基底上制备SiO2栅氧化层,并形成SiON栅氧化层;
步骤2、在1000~1200℃下并伴随纯惰性气体的氛围下对所述
SiON栅氧化层进行氮化处理,以修复晶格损伤并形成稳定Si-N键;
步骤3、在400~800℃下对经过氮化处理后的所述SiON栅氧化层进行氧化处理,以修复SiO2/Si界面。
优选的,在步骤1中,通过快速热退火工艺和/或垂直炉管工艺制备所述SiO2栅氧化层。
优选的,所述快速热退火工艺具体包括原位水蒸气氧化法和/或快速热退火氧化法。
优选的,采用N2O和H2为反应气体进行所述原位水蒸气氧化法;或
采用O2和H2为反应气体进行所述原位水蒸气氧化法。
优选的,在步骤1中,通过去耦等离子体氮化工艺和/或远程等离子体氮化工艺形成所述SiON。
优选的,在步骤1中,以NO、N2O或NH3为原料,采用垂直扩散设备形成所述SiON。
优选的,在步骤2中,所述氮化处理的温度范围为1000-1200℃,反应时间范围为5~120sec。
优选的,所述纯惰性气体氛围包含氮气或氩气中的任意一种。
优选的,在步骤3中,所述氧化处理的温度范围为400-800℃,反应时间范围为5~120sec。
本发明的技术方案与传统的高温氮化处理工艺相比,采用本发明制备的SiON栅氧化层不仅具有稳定的氮含量,而且能有效提高栅氧化物氮含量30%左右,从而能够有效的抑制硼等掺杂原子在栅介质中的扩散。
附图说明
参考所附附图,以更加充分的描述本发明的实施例。然而,所附附图仅用于说明和阐述,并不构成对本发明范围的限制。
图1本发明方法实施例的工艺步骤示意图;
图2本发明方法实施例的步骤1的基底结构示意图;
图3本发明方法实施例的步骤1的SiO2栅氧化层结构示意图;
图4本发明方法实施例的步骤1的SiON栅氧化层结构示意图;
图5本发明方法实施例的步骤2的结构示意图;
图6本发明方法实施例的步骤3的结构示意图。
具体实施方式
下面结合附图和具体实施例对本发明作进一步说明,显然,所描述的实例仅仅是本发明一部分实例,而不是全部的实例。基于本发明汇总的实例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有实例,都属于本发明保护的范围。
需要说明的是,在不冲突的情况下,本发明中的实例及实例中的特征可以相互自由组合。
本发明是一种抑制掺杂原子在栅介质中扩散的方法,包括以下步骤:
步骤S1、提供基底;
步骤S2、在所述基底上制备SiO2栅氧化层;
步骤S3、对所述SiO2栅氧化层进行氮的注入,使SiO2中的部分氧原子由氮原子取代,以形成SiON栅氧化层;
步骤S4、在高于1000℃并伴随纯惰性气体的氛围下对所述SiON栅氧化层进行氮化处理,以修复晶格损伤并形成稳定Si-N键;
步骤S5、在低于800℃的氛围下对经过氮化处理后的所述SiON栅氧化层进行氧化处理,以修复SiO2/Si界面。
以下将结合附图对本发明的一个实例做具体阐释。
如图1所示的本发明的实例是一种有效抑制掺杂原子在栅介质中扩散的方法,包括以下步骤:
步骤S1、如图2所示,提供基底1,并进行清洗;
步骤S2、如图3所示,在所述基底1上制备SiO2栅氧化层2;具体为对基底1执行热氧化操作和热处理操作,以制备一层具有稳定和均匀的目标厚度的SiO2栅氧化层2;其中,所述热氧化和热处理操作包括快速热退火(Rapid Thermal Process,简称:RTP)工艺和/或垂直炉管(Furnace)工艺;所述快速热退火工艺进一步可以包括原位水蒸汽氧化法(In-Situ Steam Generation,简称:ISSG)和/或快速热退火氧化法(Rapid Thermal Oxidation,简称:RTO);
步骤S3、如图4所示,对所述SiO2栅氧化层2进行氮3的注入,使SiO2中的部分氧原子由氮原子取代,以形成SiON栅氧化层4;具体为通过等离子体氮化技术对所述SiO2栅氧化层2进行氮3的注入,使SiO2中的部分氧原子由氮原子取代形成Si-N键,从而将所述SiO2栅氧化层2调整为具有一定氮浓度的SiON栅氧化层4,所述等离子体氮化技术包括:1.去耦等离子体氮化(Decoupled PlasmaNitridation,简称:DPN);2.远程等离子体氮化(Remote PlasmaNitridation,简称:RPN);3.快速热氮化(RTN);4.垂直扩散设备的NO,N2O和NH3的氮化处理工艺,也就是垂直炉管(Furnace)工艺;
步骤S4、如图5所示,在高于1000℃并伴随纯惰性气体的氛围下对SiON栅氧化层4进行氮5化处理,以修复晶格损伤并形成稳定Si-N键,从而具有形成稳定的氮含量和介电常数的栅氧化层6;所述氮化处理的温度范围优选为1000℃-1200℃(如1000℃,1030℃,1060℃,1100℃,1200℃等),反应时间范围为5sec-120sec(如5sec,40sec,80sec,120sec等);纯惰性气体氛围中的纯惰性气体为N2(氮气)或Ar(氩气)等惰性气体;
步骤S5、如图6所示,在低于800℃的氛围下对经过氮5化处理后的所述栅氧化层6进行氧7化处理,以修复SiO2/Si界面,形成新的栅氧化层8;其中,所述氧化处理的温度范围优选为400℃-800℃(如400℃,500℃,600℃,700℃,800℃等),反应时间范围为5sec-120sec(如5sec,40sec,80sec,120sec等);所述氧化处理中的氧化气体为O2或者H2与O2的混合气体。
本发明主要对目前SiON栅氧化层制备过程中单一高温退火工艺的温度、气体氛围进行了优化。
由于栅极、SiO2栅介质和硅衬底之间存在杂质的浓度梯度,随着栅介质厚度的不断降低,栅极里掺入的硼等杂质在后续的高温工艺中会从栅极中扩散到硅衬底中或者固定在栅介质中,导致器件的阈值电压漂移,沟道载流子迁移率下降,亚阈斜率增大等,从而使器件性能下降;此外,硼扩散还会使应力作用下栅介质内电子俘获陷阱和界面态产生的速率增加,栅介质抗击穿性能下降,可靠性退化。因此在工艺中有效的抑制硼向SiO2栅介质和硅衬底的扩散,对提高栅介质可靠性和改善器件性能是非常重要和必要的。
本发明主要是对目前SiON栅氧化层制备过程中单一高温退火工艺的温度、气体氛围进行了优化。首先通过高温和纯惰性气体氮化处理工艺,以修复晶格损伤并形成稳定Si-N键,从而形成稳定的氮含量;然后在低温(400℃-800℃)的氛围下对SiON栅氧化层进行氧化处理,以修复SiO2/Si界面。
本发明主要通过增加栅介质中的氮原子的含量来抑制硼等栅极掺杂原子在栅介质中的扩散。与传统的高温氮化处理工艺相比,采用本发明制备的SiON栅氧化层不仅具有稳定的氮含量,而且能有效提高栅氧化物氮含量30%左右,从而能有效的抑制硼等掺杂原子在栅介质中的扩散。
本发明的核心是通过高温氮化处理和低温氧化工艺来提高栅氧化物的氮含量,并通过增加栅介质中的氮原子的含量来抑制硼等栅极掺杂原子在栅介质中的扩散。
以上所述仅为本发明较佳的实施例,并非因此限制本发明的实施方式及保护范围,对于本领域技术人员而言,应当能够意识到凡运用本发明说明书及图示内容所做出的等同替换和显而易见的变化所得到的方案,均应当包含在本发明的保护范围内。
Claims (9)
1.一种抑制掺杂原子在栅介质中扩散的方法,其特征在于,包括以下步骤:
步骤1,在基底上制备SiO2栅氧化层,并形成SiON栅氧化层;
步骤2,在1000~1200℃下并伴随纯惰性气体的氛围下对所述SiON栅氧化层进行氮化处理,以修复晶格损伤并形成稳定Si-N键;
步骤3,在400~800℃下对经过氮化处理后的所述SiON栅氧化层进行氧化处理,以修复SiO2/Si界面。
2.如权利要求1所述的方法,其特征在于,在步骤1中,通过快速热退火工艺和/或垂直炉管工艺制备所述SiO2栅氧化层。
3.如权利要求2所述的方法,其特征在于,所述快速热退火工艺具体包括原位水蒸气氧化法和/或快速热退火氧化法。
4.如权利要求3所述的方法,其特征在于,采用N2O和H2为反应气体进行所述原位水蒸气氧化法;或
采用O2和H2为反应气体进行所述原位水蒸气氧化法。
5.如权利要求1所述的方法,其特征在于,在步骤1中,通过去耦等离子体氮化工艺和/或远程等离子体氮化工艺形成所述SiON。
6.如权利要求1所述的方法,其特征在于,在步骤1中,以NO、N2O或NH3为原料,采用垂直扩散设备形成所述SiON。
7.如权利要求1所述的方法,其特征在于,在步骤2中,所述氮化处理的温度范围为1000~1200℃,反应时间范围为5~120sec。
8.如权利要求1所述的方法,其特征在于,所述纯惰性气体氛围包含氮气或氩气中的任意一种。
9.如权利要求1所述的方法,其特征在于,在步骤3中,所述氧化处理的温度范围为400~800℃,反应时间范围为5~120sec。
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Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN105575785A (zh) * | 2014-10-09 | 2016-05-11 | 中芯国际集成电路制造(上海)有限公司 | 栅极结构的形成方法 |
CN107305842A (zh) * | 2016-04-25 | 2017-10-31 | 联华电子股份有限公司 | 栅介电层的制造方法 |
CN111769043A (zh) * | 2019-04-02 | 2020-10-13 | 中芯国际集成电路制造(上海)有限公司 | 栅介质层的形成方法、半导体结构及其形成方法 |
CN114864395A (zh) * | 2022-07-05 | 2022-08-05 | 北京屹唐半导体科技股份有限公司 | 控制氮掺杂深度分布的方法和半导体器件 |
WO2022247271A1 (zh) * | 2021-05-27 | 2022-12-01 | 惠科股份有限公司 | 薄膜晶体管及其制备方法和阵列基板、显示器件 |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5922343A (ja) * | 1982-07-29 | 1984-02-04 | Toshiba Corp | 半導体装置の製造方法 |
US6037651A (en) * | 1995-05-10 | 2000-03-14 | Nec Corporation | Semiconductor device with multi-level structured insulator and fabrication method thereof |
US20040175961A1 (en) * | 2002-06-12 | 2004-09-09 | Christopher Olsen | Two-step post nitridation annealing for lower EOT plasma nitrided gate dielectrics |
TW200805497A (en) * | 2006-03-02 | 2008-01-16 | Applied Materials Inc | Method for forming silicon oxynitride materials |
CN102427043A (zh) * | 2011-08-04 | 2012-04-25 | 上海华力微电子有限公司 | 一种改善pmos器件载流子迁移率的方法 |
-
2014
- 2014-03-20 CN CN201410106564.3A patent/CN103887161A/zh active Pending
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5922343A (ja) * | 1982-07-29 | 1984-02-04 | Toshiba Corp | 半導体装置の製造方法 |
US6037651A (en) * | 1995-05-10 | 2000-03-14 | Nec Corporation | Semiconductor device with multi-level structured insulator and fabrication method thereof |
US20040175961A1 (en) * | 2002-06-12 | 2004-09-09 | Christopher Olsen | Two-step post nitridation annealing for lower EOT plasma nitrided gate dielectrics |
TW200805497A (en) * | 2006-03-02 | 2008-01-16 | Applied Materials Inc | Method for forming silicon oxynitride materials |
CN102427043A (zh) * | 2011-08-04 | 2012-04-25 | 上海华力微电子有限公司 | 一种改善pmos器件载流子迁移率的方法 |
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN105575785A (zh) * | 2014-10-09 | 2016-05-11 | 中芯国际集成电路制造(上海)有限公司 | 栅极结构的形成方法 |
CN107305842A (zh) * | 2016-04-25 | 2017-10-31 | 联华电子股份有限公司 | 栅介电层的制造方法 |
CN107305842B (zh) * | 2016-04-25 | 2021-08-17 | 联华电子股份有限公司 | 栅介电层的制造方法 |
CN111769043A (zh) * | 2019-04-02 | 2020-10-13 | 中芯国际集成电路制造(上海)有限公司 | 栅介质层的形成方法、半导体结构及其形成方法 |
CN111769043B (zh) * | 2019-04-02 | 2023-02-17 | 中芯国际集成电路制造(上海)有限公司 | 栅介质层的形成方法、半导体结构及其形成方法 |
WO2022247271A1 (zh) * | 2021-05-27 | 2022-12-01 | 惠科股份有限公司 | 薄膜晶体管及其制备方法和阵列基板、显示器件 |
CN114864395A (zh) * | 2022-07-05 | 2022-08-05 | 北京屹唐半导体科技股份有限公司 | 控制氮掺杂深度分布的方法和半导体器件 |
CN114864395B (zh) * | 2022-07-05 | 2022-09-23 | 北京屹唐半导体科技股份有限公司 | 控制氮掺杂深度分布的方法和半导体器件 |
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