CN102754207A - 电阻式存储器及处理电阻式存储器的方法 - Google Patents
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Abstract
本文中描述电阻式存储器及处理电阻式存储器的方法。处理电阻式存储器的一个或一个以上方法实施例包含:在层间电介质中的开口中保形地形成单元材料,使得在所述单元材料中形成接缝;通过对所述接缝进行改性来形成导电通路;及在所述单元材料及所述接缝上形成电极。
Description
技术领域
本发明一般来说涉及半导体存储器装置以及方法及系统,且更特定来说,涉及电阻式存储器及处理电阻式存储器的方法。
背景技术
通常提供存储器装置作为计算机或其它电子装置中的内部半导体集成电路。存在许多不同类型的存储器,包含随机存取存储器(RAM)、只读存储器(ROM)、动态随机存取存储器(DRAM)、同步动态随机存取存储器(SDRAM)、快闪存储器及电阻式(例如电阻可变)存储器以及其它存储器。电阻式存储器的类型包含可编程导体存储器、相变随机存取存储器(PCRAM)及电阻式随机存取存储器(RRAM)以及其它电阻式存储器。
存储器装置用作需要高存储器密度、高可靠性及低功率消耗的宽广范围的电子应用的非易失性存储器。非易失性存储器可用于例如个人计算机、便携式存储器棒、固态驱动器(SSD)、数码相机、蜂窝式电话、例如MP3播放器的便携式音乐播放器、电影播放器及其它电子装置中。
存储器装置可包含布置成矩阵(例如,阵列)的若干个存储器单元。举例来说,存储器单元的存取装置(例如二极管、场效应晶体管(FET)或双极结晶体管(BJT))可耦合到形成阵列的“行”的存取线,例如字线。每一存储器单元的存储器元件可耦合到阵列的“列”中的数据线,例如位线。以此方式,可经由行解码器通过选择耦合到一行存储器单元的栅极的字线激活所述行存储器单元来存取存储器单元的存取装置。可通过取决于与特定存储器单元的经编程状态相关联的电阻而致使不同电流在存储器元件中流动来确定(例如,感测)一行选定存储器单元的经编程状态。
可将存储器单元编程(例如,写入)为所要状态。也就是说,可针对存储器单元设定若干个经编程状态(例如,电阻电平)中的一者。举例来说,单电平单元(SLC)可表示两个逻辑状态中的一者,例如,1或0。电阻式存储器单元也可编程为两个以上经编程状态中的一者以便表示两个以上二进制数字,例如,1111、0111、0011、1011、1001、0001、0101、1101、1100、0100、0000、1000、1010、0010、0110或1110。此些单元可称作多状态存储器单元、多数字单元或多电平单元(MLC)。
例如RRAM的电阻式存储器可通过改变电阻式存储器元件的电阻电平来存储数据。可通过将能量源(例如正或负电脉冲,例如正或负电压或电流脉冲)施加到特定电阻式存储器元件达预定持续时间而将数据编程到选定RRAM单元。可通过施加各种量值、极性及持续时间的电压或电流将RRAM单元编程为若干个电阻电平。
用于处理(例如,制作)RRAM单元的方法可包含RRAM单元的平面制作。也就是说,RRAM单元可具有平面结构。然而,具有平面结构的RRAM单元可较大,例如,具有平面结构的RRAM单元可增加RRAM装置的大小。此外,具有平面结构的RRAM单元可能不一致或错误地操作,例如,具有平面结构的RRAM单元的经感测电阻电平可不同于所述单元所编程到的电阻电平。
发明内容
附图说明
图1A到1G图解说明与根据本发明的若干个实施例形成电阻式存储器单元相关联的工艺步骤。
图2图解说明根据本发明的若干个实施例的电阻式存储器的功能框图。
具体实施方式
本文中描述电阻式存储器及处理电阻式存储器的方法。处理电阻式存储器的一个或一个以上方法实施例包含:在层间电介质中的开口中保形地形成单元材料,使得在所述单元材料中形成接缝;通过对所述接缝进行改性来形成导电通路;及在所述单元材料及所述接缝上形成电极。
根据本发明的若干个实施例处理电阻式存储器(例如,电阻式存储器单元)可减小电阻式存储器单元及/或与所述电阻式存储器单元相关联的存储器装置的大小。根据本发明的若干个实施例处理电阻式存储器还可增加所述电阻式存储器的一致性及可靠性。举例来说,根据本发明的若干个实施例处理电阻式存储器可减少与电阻式存储器相关联的错误数据读取的数目。
在本发明的以下详细描述中,参考形成本发明的一部分且其中以图解说明的方式展示可如何实践本发明的若干个实施例的随附图式。充分详细地描述这些实施例以使所属领域的技术人员能够实践本发明的若干个实施例,且应理解,可利用其它实施例且可在不背离本发明的范围的前提下作出工艺、电或机械改变。
将了解,可添加、更换及/或消除本文中的各种实施例中所展示的元件以便提供本发明的若干个额外实施例。另外,将了解,各图中所提供的元件的比例及相对标度既定图解说明本发明的实施例且不应视为具限制意义。本文中所使用,“若干个”某物可指代一个或一个以上此类事物。举例来说,若干个存储器装置可指代一个或一个以上存储器装置。
图1A到1G图解说明与根据本发明的若干个实施例形成电阻式存储器单元相关联的工艺步骤。图1A图解说明电极102上的层间电介质104的示意性横截面图,其中层间电介质104中具有开口106。电极102可为(例如)钨或铂。层间电介质104可为(例如)氧化物电介质,例如二氧化硅(SiO2)。层间电介质104也可为(例如)氮化物电介质,例如氮化硅(Si3N4)。本发明的实施例并不限于特定类型的层间电介质材料或电极。
如所属领域的技术人员将了解,可以若干种方式(包含化学气相沉积(CVD)或原子层沉积(ALD))在电极102上形成层间电介质104。接着可移除(例如,蚀刻及/或图案化)层间电介质104的一部分,以形成开口106。如图1中所示,开口106邻近于电极102。
在若干个实施例中,开口106可具有10纳米到30纳米的直径。举例来说,开口106可具有约22纳米、约25纳米或约27纳米的直径。然而,实施例并不限于开口106的特定直径。
图1B图解说明图1A中所示的结构在后续处理步骤之后的示意性横截面图。图1B包含形成于层间电介质104上及层间电介质104中的开口106中的电阻式存储器单元材料108。在若干个实施例中,可在层间电介质104上及开口106中保形地形成电阻式存储器单元材料108。可以若干种方式(包含ALD、CVD及电镀)在层间电介质104上及开口106中保形地形成电阻式存储器单元材料108。此外,保形形成的方法可包含具有电阻式存储器单元材料108的处于自下而上填充或选择性模式的一部分。然而,本发明的实施例并不限于保形形成的特定方法。所使用的保形形成方法可取决于(例如)用于电阻式存储器单元材料108的材料。
电阻式存储器单元材料108可为(例如)电阻随机存取存储器(RRAM)单元材料。RRAM单元材料可包含(例如)GexSey、例如CuxOy、WOx、Nb2O5、Al2O3、Ta2O5、TiOx、ZrOx、NixO及FexO的二元金属氧化物及/或可支持固相电解质行为的其它材料。其它RRAM单元材料可包含:例如经掺杂或未经掺杂SrTiO3、SrZrO3及BaTiO3的钙钛矿氧化物;例如Pr(1-x)CaxMnO3(PCMO)、La(1-x)CaxMnO3(LCMO)及Ba(1-x)SrxTiO3的巨磁阻材料;以及例如孟加拉玫瑰红、AlQ3Ag、Cu-TCNQ、DDQ、TAPA及基于荧光物的聚合物的聚合物材料;以及其它类型的RRAM单元材料。
在若干个实施例中,电阻式存储器单元材料108可保形地形成(例如,保形地沉积)于层间电介质104上及开口106中,使得在电阻式存储器单元材料108中形成接缝(例如,图1B中所示的接缝110-1及110-2)。如图1B中所示,所述接缝可为电阻式存储器单元材料108中的开口,例如,其中电阻式存储器单元材料108的相对侧彼此接近使得电阻式存储器单元材料108不完全填充开口106的区。也就是说,可在层间电介质104上及开口106中形成电阻式存储器单元材料108,使得电阻式存储器单元材料贴合层间电介质104且在电阻式存储器单元材料108中形成接缝。在若干个实施例中,可对形成于电阻式存储器单元材料108中的接缝进行改性以在电阻式存储器单元材料108中形成导电通路,如本文中将进一步描述。
图1B图解说明根据本发明的若干个实施例可由电阻式存储器单元材料108的保形形成产生的第一及第二接缝,例如,接缝110-1及110-2。如图1B中所示,接缝110-1及110-2具有不同的特性。区别特性可包含作为沉积程序的终止部分的一部分进行的表面或近表面改性。
形成于电阻式存储器单元材料108中的接缝的特性可取决于电阻式存储器单元材料108的保形形成发生的时间量。举例来说,接缝的直径及/或深度可随着电阻式存储器单元材料108的保形形成发生的时间量增加而减小。在图1B中所图解说明的实施例中,导致接缝110-1的形成的保形形成发生的时间量可大于导致接缝110-2的形成的保形形成发生的时间量。举例来说,接缝110-1的直径d1小于接缝110-2的直径d2,如本文中将进一步描述。另外,接缝110-1的深度D1小于接缝110-2的深度D2,例如,接缝110-2的底部部分112-2比接缝110-1的底部部分112-1更靠近于电极102,如图1B中所示。
在若干个实施例中,可在开口106中保形地形成电阻式存储器单元材料108,使得接缝的底部与电极102之间存在电阻式存储器单元材料108,例如,使得接缝不与电极102接触。举例来说,如图1B中所示,保形地形成接缝110-1及110-2,使得接缝110-1及110-2的底部部分112-1及112-2与电极102之间存在电阻式存储器单元材料108,例如,使得接缝110-1及110-2不与电极102接触。
接缝的底部与电极102之间的距离可取决于电阻式存储器单元材料108的保形形成发生的时间量。举例来说,接缝的底部与电极102之间的距离可随着电阻式存储器单元材料108的保形形成发生的时间量增加而增加。在图1B中所图解说明的实施例中,导致接缝110-1的形成的保形形成发生的时间量可大于导致接缝110-2的形成的保形形成发生的时间量。举例来说,底部部分112-1与电极102之间的距离大于底部部分112-2与电极102之间的距离,如图1B中所示。在若干个实施例中,接缝的底部与电极102之间的距离可在3埃到15埃的范围中。然而,本发明的实施例并不限于此。举例来说,接缝的底部与电极102之间的距离可高达100埃。
图1C图解说明其中形成有接缝110-1及110-2的电阻式存储器单元材料108的示意性俯视图。也就是说,图1C图解说明图1B中所示的电阻式存储器单元材料108的保形形成的示意性俯视图。如图1C中所示,接缝110-1的直径d1小于接缝110-2的直径d2。
在若干个实施例中,形成于电阻式存储器单元材料108中的接缝(例如,接缝110-1及110-2)可具有0.5纳米到5.0纳米的直径。举例来说,所述接缝可具有约1纳米的直径。可(例如)在接缝的顶部处测量所述接缝的直径。
根据本发明的若干个实施例,形成于电阻式存储器单元材料108中的接缝的特性(例如,接缝的深度及/或直径,及/或接缝的底部与电极102之间的距离)可由电阻式存储器单元材料108在层间电介质104上及开口106中的保形形成而产生。然而,使用先前方法(例如,平面制作)可能不能实现接缝的这些特性。
图1D图解说明图1B及1C中所示的结构在后续处理步骤之后的示意性横截面图。图1D包含形成于电阻式存储器单元材料108上及电阻式存储器单元材料108中的接缝110中(例如,接缝110内)的细丝114。细丝114可为改性物材料,所述改性物材料为不同于电阻式存储器单元材料108的材料及/或在接缝110中形成导电通路使得接缝110为导电通路。也就是说,在接缝110中形成细丝114可对接缝110进行改性以在电阻式存储器单元材料108中形成导电通路。举例来说,细丝114可为例如银及铜的金属或例如氧化铜及氧化银的金属氧化物。也就是说,细丝114可为(例如)容易在固相中被氧化或还原的例如铜及银的金属。细丝114可为额外(例如,顶部)电极结构(例如结合图1G所描述的电极116)的一部分。
在若干个实施例中,细丝114可为细丝源材料。也就是说,细丝114可含有可在电阻式存储器单元材料108内形成细丝的原子。
可以若干种方式(包含旋涂、喷溅、ALD、CVD及冷凝)在电阻式存储器单元材料108上及接缝110中形成细丝(例如,细丝源材料)114。在接缝110中形成细丝源材料114可增加细丝源材料114中的原子的浓度。由于可增加细丝源材料114中的原子的浓度,因此细丝源材料114可为薄材料,例如,细丝源材料114可具有小于电阻式存储器单元材料108的厚度的厚度,如图1D中所示。
如图1D中所示,可在接缝110中形成细丝源材料114,使得细丝源材料114的末端邻近于接缝110的底部部分112。由于细丝源材料114的末端可邻近于接缝110的底部部分112,因此细丝源材料114的末端与电极102之间可存在电阻式存储器单元材料108,细丝源材料114可不与电极102接触,及/或细丝源材料114的末端与电极102之间的距离可在3埃到15埃的范围中。也可在接缝110中形成细丝源材料114,使得细丝源材料114完全填充接缝110,如图1D中所示。
在若干个实施例中,可在电阻式存储器单元材料104上及接缝110中形成细丝源材料114之后对其进行加热。加热细丝源材料114可使原子从细丝源材料114扩散到电阻式存储器单元材料104中。
如本文中先前所描述,在接缝110中形成细丝源材料114可对接缝110进行改性以在电阻式存储器单元材料108中形成导电通路。可在不在细丝源材料114的末端与底部电极102之间形成任何额外材料以将细丝源材料114的末端耦合到底部电极102的情况下形成此导电通路。而是,所述导电通路可包含沿着从细丝源材料114的末端到底部电极102的路径延伸穿过电阻式存储器单元材料108中的区115的导电路径。也就是说,可在细丝源材料114的末端与底部电极材料102之间仅形成电阻式存储器单元材料108(例如,在区115中仅具有电阻式存储器单元材料108)的情况下形成所述导电通路。
图1E图解说明图1D中所示的结构在后续处理步骤之后的示意性横截面图。在图1E中,移除电阻式存储器单元材料108的一部分及细丝源材料114的一部分。可以若干种方式(包含化学机械抛光(CMP)及毯覆式蚀刻)移除(例如,蚀刻及/或图案化)电阻式存储器单元材料108及细丝源材料114的经移除部分。
电阻式存储器单元材料108的经移除部分可包含(例如)电阻式存储器单元材料108的不在开口106中的部分。细丝源材料114的经移除部分可包含(例如)细丝源材料114的不在接缝110中的部分。移除电阻式存储器单元材料108及细丝源材料114的这些部分可暴露层间电介质104,如图1E中所示。
图1F图解说明图1E的示意性俯视图。在若干个实施例中,细丝源材料114可具有0.5纳米到5.0纳米的直径d。举例来说,细丝源材料114可具有约1纳米的直径d。细丝源材料114的直径d可对应于接缝110的直径。例如,在其中细丝源材料114完全填充接缝110的实施例中,细丝源材料114的直径d可对应于在接缝110的顶部处接缝110的直径。
图1G图解说明图1E及1F中所示的结构在后续处理步骤之后的示意性横截面图。图1G包含形成于层间电介质104上的电极116、电阻式存储器单元材料108及细丝源材料114。电极116可为(例如)钨或铂。所属领域的技术人员将了解,可以若干种方式在层间电介质104、电阻式存储器单元材料108及细丝源材料114上形成(例如,沉积及图案化)电极116。在若干个实施例中,细丝源材料114可为电极116的结构的一部分,如本文中先前所描述。
图1G中所图解说明的结构可为电阻式存储器单元的组成部分,例如部分。举例来说,图1G中所图解说明的结构可为RRAM单元(例如,图2中所示的存储器单元212)的组成部分。
根据本发明的若干个实施例处理的电阻式存储器单元(例如,RRAM单元)可减小所述电阻式存储器单元及/或与所述电阻式存储器单元相关联的存储器装置的大小。根据本发明的若干个实施例处理的电阻式存储器单元还可具有增加的一致性及可靠性。举例来说,与根据先前方法(例如,平面制作)处理的存储器单元相比,根据本发明的若干个实施例处理的电阻式存储器单元可具有增加的可靠性。
作为一个实例,电阻式存储器单元材料108中的接缝110的底部部分112(例如,细丝源材料114的末端)与电极102之间的距离可在3埃到15埃的范围中,如本文中先前所描述,此可减小电阻式存储器单元的大小。此距离还可改进细丝源材料114的性能,此可增加电阻式存储器单元(例如,图2中所示的存储器单元212)的一致性及可靠性。根据本发明的若干个实施例,此距离可由电阻式存储器单元材料108在层间电介质104上及开口106中的保形形成而产生。然而,使用先前方法(例如,平面制作)可能不能实现此距离。
另外,开口106可有10纳米到30纳米的直径,如本文中先前所描述。此外,电阻式存储器单元材料108中的接缝110(例如,细丝源材料114)可具有0.5纳米到5.0纳米的直径,如本文中先前所描述。这些尺寸也可减小电阻式存储器单元的大小。根据本发明的若干个实施例,这些尺寸可由电阻式存储器单元材料108在层间电介质104上及开口106中的保形形成而产生。然而,使用先前方法(例如,平面制作)可能不能实现这些尺寸。
根据本发明的若干个实施例处理的电阻式存储器单元还可减小电阻式存储器单元材料108中的晶粒边界的效应。举例来说,电阻式存储器单元材料108可含有晶粒边界,且细丝源材料114可沿着所述晶粒边界较快地扩散。然而,本发明的实施例可将晶粒边界交互作用区域限制于细丝源材料114的中心点,例如,电阻式存储器单元材料108中的接缝110的中心点。此可减少与晶粒边界相关联的故障,此可增加电阻式存储器单元的一致性及可靠性。根据本发明的若干个实施例,此晶粒边界区域交互作用限制可由电阻式存储器单元材料108在层间电介质104上及开口106中的保形形成而产生。然而,使用先前方法(例如,平面制作)可能不能实现此晶粒边界区域交互作用限制。
图2图解说明根据本发明的若干个实施例的电阻式存储器200的功能框图。如图2中所示,电阻式存储器200包含电阻式存储器结构202。电阻式存储器结构202可为根据本发明的若干个实施例处理的结构。举例来说,电阻式存储器结构202可为图1G中所图解说明的结构。
在图2中,存取装置210与电阻式存储器结构202串联耦合以形成存储器单元212。存储器单元212耦合到数据线,例如,位线220及源极线222。存取装置210可用作用于启用及停用穿过电阻式存储器结构202的电流的开关。存取装置210可为(例如)具有耦合到存取线(例如,字线224)的栅极的晶体管,例如场效应晶体管(FET)或双极结晶体管(BJT)。因此,当给字线224通电时,可接通存取装置210,借此经由电阻式存储器结构202完成源极线222与位线220之间的电路。
在若干个实施例中,位线220及源极线222耦合到用于从存储器单元212感测(例如,读取)的逻辑及用于编程(例如,写入)存储器单元212的逻辑。举例来说,如图2中所示,读取/写入控制多路复用器230具有耦合到位线220的输出。读取/写入控制多路复用器230可由读取/写入控制逻辑线232控制以在耦合到双极写入脉冲产生器226的第一输入与耦合到读取感测逻辑228的第二输入之间进行选择。施加到电阻式存储器结构202以用于编程的电压或电流的量值、极性及/或持续时间可通过所述电压或电流在和存储器单元212相关联的位线220与源极线222之间的施加来控制。
在若干个实施例中,在写入操作期间,偏置产生器229可经由双极写入脉冲产生器226建立和存储器单元212相关联的位线220与源极线222之间的写入偏置电压电位差,例如,固定电压。所述写入偏置电压可致使特定量值的电流流动穿过电阻式存储器结构202,此可将电阻式存储器结构202的电阻改变到特定电阻。所述特定电阻可对应于电阻式存储器结构202的经编程状态。
在若干个实施例中,在读取操作期间,偏置产生器129可经由读取感测逻辑228建立和存储器单元212相关联的位线220与源极线222之间的读取偏置电压电位差,例如,固定电压。所述读取偏置电压可致使对应于电阻式存储器结构202的电阻的特定量值的电流流动。举例来说,根据欧姆定律,针对给定读取偏置电压,电阻式存储器结构202的电阻越大,流动的电流就越小。可由读取感测逻辑228感测在读取操作期间流动穿过电阻式存储器结构202的电流量(或与其成比例的电压),例如,感测放大器(未展示)可将电路导出输入与对应于两个经编程状态之间的边界条件的参考输入进行比较,以确定对应于由电阻式存储器结构202的当前电阻表示的经编程状态的输出。
在若干个实施例中,可穿过电阻式存储器结构202施加读取电流,从而致使产生对应电压,可感测所述电压并将其与参考电压进行比较。根据所述比较,可(例如)基于欧姆定律的原理来确定电阻式存储器结构202的电阻。
虽然图2图解说明且上文的论述描述特定读取与写入逻辑布置,但所属领域的技术人员将了解可使用用于切换及/或编程电阻式存储器结构202的逻辑的其它配置来实施本发明的若干个实施例。此外,所属领域的技术人员将了解,电阻式存储器200可包含图2中未展示以便不使本发明的实施例模糊的额外元件及/或电路。
结论
本文中描述电阻式存储器及处理电阻式存储器的方法。处理电阻式存储器的一个或一个以上方法实施例包含:在层间电介质中的开口中保形地形成单元材料,使得在所述单元材料中形成接缝;通过对所述接缝进行改性来形成导电通路;及在所述单元材料及所述接缝上形成电极。
虽然本文中已图解说明及描述了特定实施例,但所属领域的技术人员将了解,旨在实现相同结果的布置可替代所展示的特定实施例。本发明打算涵盖本发明的各种实施例的更改或变化形式。应了解,已以说明性方式而非限制性方式作出上文描述。在审阅上文描述之后,所属领域的技术人员将明了以上实施例的组合及本文中未具体描述的其它实施例。本发明的各种实施例的范围包含其中使用以上结构及方法的其它应用。因此,应参考所附权利要求书连同所述权利要求书授权的等效物的全部范围来确定本发明的各种实施例的范围。
在前述实施方式中,出于简化本发明的目的,将各种特征一起集合于单个实施例中。本发明的此方法不应解释为反映本发明的所揭示实施例必须使用比明确陈述于每一权利要求中更多的特征的意图。而是,如以上权利要求书所反映,发明性标的物在于少于单个所揭示实施例的所有特征。因此,特此将以上权利要求书并入到实施方式中,其中每一权利要求独立地作为单独实施例。
Claims (29)
1.一种处理电阻式存储器单元的方法,其包括:
在层间电介质中的开口中保形地形成单元材料,使得在所述单元材料中形成接缝;
通过对所述接缝进行改性来形成导电通路;及
在所述单元材料及所述接缝上形成电极。
2.根据权利要求1所述的方法,其中对所述接缝进行改性包含在所述接缝中形成细丝。
3.根据权利要求2所述的方法,其中所述方法包含在所述接缝中形成所述细丝之后加热所述细丝。
4.根据权利要求2所述的方法,其中所述细丝为细丝源材料。
5.根据权利要求1到4中任一权利要求所述的方法,其中所述方法包含:
在所述开口中保形地形成所述单元材料,使得在所述接缝的底部与邻近所述开口的额外电极之间形成单元材料;且
形成所述导电通路不包含形成将所述接缝的所述底部耦合到底部电极的额外材料。
6.一种处理电阻式随机存取存储器RRAM单元的方法,其包括:
通过在层间电介质中的开口中保形地沉积单元材料来在所述单元材料中形成接缝;
通过对所述接缝进行改性来在所述单元材料中形成导电通路;及
在所述单元材料及所述接缝上形成电极。
7.根据权利要求6所述的方法,其中对所述接缝进行改性包含在所述接缝中形成细丝。
8.根据权利要求6到7中任一权利要求所述的方法,其中所述方法包含在所述开口中保形地沉积所述单元材料,使得在所述接缝的底部与邻近所述开口的额外电极之间形成单元材料。
9.根据权利要求8所述的方法,其中在所述接缝的所述底部与所述额外电极之间仅形成单元材料。
10.根据权利要求6到7中任一权利要求所述的方法,其中所述方法包含在所述单元材料及所述接缝上形成所述电极之前移除所述单元材料的一部分。
11.一种处理电阻式存储器单元的方法,其包括:
在层间电介质中的开口中保形地形成电阻式存储器单元材料,使得在所述电阻式存储器单元材料中形成接缝;
在所述接缝中形成细丝;及
在所述电阻式存储器单元材料及细丝上形成电极。
12.根据权利要求11所述的方法,其中所述方法包含用不同于所述电阻式存储器单元材料的材料形成所述细丝。
13.根据权利要求11所述的方法,其中所述方法包含在所述接缝中形成所述细丝之后且在所述电阻式存储器单元材料及细丝上形成所述电极之前,使原子从所述细丝扩散到所述电阻式存储器单元材料中。
14.根据权利要求13所述的方法,其中所述方法包含通过加热所述细丝来使原子从所述细丝扩散。
15.根据权利要求11到14中任一权利要求所述的方法,其中所述方法包含在所述开口中保形地形成所述电阻式存储器单元材料,使得所述接缝不与邻近所述开口的额外电极接触。
16.根据权利要求11到14中任一权利要求所述的方法,其中所述方法包含在所述接缝中形成所述细丝,使得所述细丝完全填充所述接缝。
17.一种电阻式存储器单元,其包括:
层间电介质,其具有开口;
单元材料,其保形地形成于所述开口中;
导电通路,其在所述单元材料中;及
电极,其在所述单元材料及所述导电通路上。
18.根据权利要求17所述的电阻式存储器单元,其中所述导电通路包含细丝。
19.根据权利要求18所述的电阻式存储器单元,其中所述细丝为金属或金属氧化物。
20.根据权利要求17到19中任一权利要求所述的电阻式存储器单元,其中所述单元材料为金属氧化物。
21.根据权利要求17到19中任一权利要求所述的电阻式存储器单元,其中所述导电通路具有0.5纳米到5.0纳米的直径。
22.根据权利要求17到19中任一权利要求所述的电阻式存储器单元,其中所述开口具有10纳米到30纳米的直径。
23.一种电阻式随机存取存储器RRAM单元,其包括:
层间电介质,其具有开口;
电阻式存储器单元材料,其保形地形成于所述开口中使得所述单元材料包含接缝;
细丝,其在所述接缝中;及
电极,其在所述电阻式存储器单元材料及细丝上。
24.根据权利要求23所述的RRAM单元,其中所述细丝为不同于所述电阻式存储器单元材料的材料。
25.根据权利要求23所述的RRAM单元,其中所述电阻式存储器单元材料为GexSey。
26.根据权利要求23所述的RRAM单元,其中:
所述RRAM单元包含邻近所述层间电介质中的所述开口的额外电极;且
所述接缝中的所述细丝的末端距所述额外电极3埃到15埃的距离。
27.根据权利要求26所述的RRAM单元,其中所述RRAM单元在所述额外电极与所述细丝的所述末端之间仅包含电阻式存储器单元材料。
28.根据权利要求23所述的RRAM单元,其中所述细丝具有约1纳米的直径。
29.根据权利要求23到28中任一权利要求所述的RRAM单元,其中所述细丝为细丝源材料。
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