发明内容
本发明所要解决的技术问题是提供一种SiGe BiCMOS工艺中的SiGePNP双极晶体管,能大大缩小SiGe PNP晶体管的面积和提高SiGe PNP晶体管的电流放大系数。
为解决上述技术问题,本发明的SiGe BiCMOS工艺中的SiGe PNP双极晶体管,其有源区是利用浅槽场氧化层隔离,包括:
一集电区,由位于浅槽底部的P型埋层构成,通过在场氧化层上制作深阱接触引出所述集电区;
一基区,通过在有源区进行N型离子注入形成,所述基区的周侧为浅槽场氧化层,所述基区的宽度由所述浅槽的深度决定并和所述浅槽的深度相当,所述基区底部和所述集电区相连接,在所述集电区对侧的浅槽底部形成一N型埋层,所述基区和所述N型埋层相连并通过在所述N型埋层上的场氧化层上制作深阱接触引出所述基区;
一发射区,由形成于所述基区上方的一P型SiGe外延层构成。
本发明的SiGe BiCMOS工艺中的SiGe PNP双极晶体管是一种纵向结构,通过采用所述纵向结构、加上集电区埋层结构以及场氧化层上的深阱接触,使本发明的SiGe BiCMOS工艺中的SiGe PNP双极晶体管只包含一个有源区,大大缩小了SiGe PNP晶体管的面积,本发明的SiGe PNP晶体管的面积能小于现有SiGe PNP晶体管的四分之一。另外本发明的SiGePNP晶体管的基区宽度由所述浅槽的深度决定即本发明的基区宽度为有源区上的P型SiGe外延层到沟槽底部的P型埋层之间的距离,和所述浅槽的深度大致相等,要小于现有SiGe PNP晶体管的呈L形基区的宽度,从而能使电流放大系数得到提高。
附图说明
下面结合附图和具体实施方式对本发明作进一步详细的说明。
图1是现有SiGe PNP晶体管截面图;
图2是本发明的SiGe BiCMOS工艺中的SiGe PNP双极晶体管截面图;
图3是本发明实施例的SiGe BiCMOS工艺中的SiGe PNP双极晶体管截面图和各区的杂质分布;
图4a-图4f是本发明的SiGe BiCMOS工艺中的SiGe PNP双极晶体管制造过程的各步骤的截面图;
图5是本发明实施例的SiGe BiCMOS工艺中的SiGe PNP双极晶体管特性的TCAD模拟曲线。
具体实施方式
如图2所示为本发明所述SiGe BiCMOS工艺中的SiGe PNP双极晶体管结构示意图,其有源区是利用浅槽场氧化层隔离,包括:
一集电区,由位于浅槽底部的P型埋层(如图2所示的PBL层)构成,通过在场氧化层上制作深阱接触引出所述集电区。所述P型埋层是在所述浅槽形成后、所述场氧化层填入前通过离子注入形成,是利用有源区上的硬掩模层局部自对准注入,保证有源区没有被所述P型埋层杂质注入;所述P型埋层选择注入B或BF2,注入剂量为1e12~1e14cm-2,注入能量以不穿透硬掩模层为准。
一基区,为如图2所示的LC层即SiGe NPN HBT的集电区LC(LocalCollector),通过在有源区进行N型离子注入形成,所述基区的周侧为浅槽场氧化层,所述基区的宽度和所述浅槽的深度相当,所述基区底部和所述集电区相连接,在所述集电区对侧的浅槽底部形成一N型埋层(如图2所示的NBL层),所述基区和所述N型埋层相连并通过在所述N型埋层上的场氧化层上制作深阱接触引出所述基区。所述基区的N型离子注入能采用多次N型注入形成,离子注入窗口要略大于有源区,保证所述集电区和所述基区间的PN结的正确形成;必须有一次大能量注入,直接注入到所述N型埋层和所述P型埋层位置,充分连接所述N型埋层和所述P型埋层,基区的多次注入能量递减,注入的总剂量由所述纵向SiGe PNP双极晶体管的电流增益和击穿电压要求决定。所述N型埋层是在所述浅槽形成后、所述场氧化层填入前通过离子注入形成,是利用有源区上的硬掩模层局部自对准注入,保证有源区没有被所述N型埋层杂质注入,所述N型埋层选择注入砷或磷,注入剂量大于5e14cm-2,注入能量以不穿透硬掩模层为准。
一发射区,如图2所示的SiGe epi Ex Base层即为SiGe NPN HBT的P型SiGe外基区,由形成于所述基区上方的一P型SiGe外延层构成,通过P型离子注入对所述发射区进行掺杂,注入离子选择B或BF
2,注入剂量大于1e15cm
-2,注入能量根据所述SiGe外延层厚度决定,以注入穿透所述SiGe外延层并进入Si有源区100
~500
为参考。
如图3所示,为用TCAD模拟的本发明实施例的SiGe BiCMOS工艺中的SiGe PNP双极晶体管截面图和各区的杂质分布,共标出了3个区域的杂质分布曲线,区域1和区域2是纵向分布曲线,区域3是横向分布曲线。从区域3曲线能看出,其左侧为一N型区域、右侧为一P型区域,分别对应于所述SiGe PNP双极晶体管的N型埋层和P型埋层,都处于浅槽的底部,。由区域2曲线能看出,有源区的顶部为一P型区域、底部为一N型区域,顶部的P型区域对应于所述SiGe PNP双极晶体管的P型SiGe外延层以及100
~500
P型Si层、底部较宽的N型区域对应于所述SiGe PNP双极晶体管的基区。区域1显示了在有源区边界处的杂质分布,在其底部为所述SiGe PNP双极晶体管的基区和P型埋层相连接处。
本发明的SiGe BiCMOS工艺中的SiGe PNP双极晶体管制造方法包括如下工艺步骤:
1、如图4a所示,在P型衬底501上生长垫衬氧化层502、氮化硅层503和氧化层504;
2、如图4a所示,定义有源区,并刻蚀浅槽;
3、如图4a所示,淀积氧化层,并刻蚀形成浅槽氧化层侧墙505;
4、如图4a所示,光刻打开N型埋层(NBL)注入区域,其它区域覆盖光刻胶506;
5、如图4a所示,以光刻胶506和有源区上的硬掩模层即垫衬氧化层502、氮化硅层503和氧化层504为掩模版进行N型离子注入形成N型埋层507;
6、如图4b所示,去除氧化层504,以光刻胶506为掩模版进行N型离子注入,形成基区508,该基区508的纵向宽度和浅槽的深度相当,并和所述N型埋层507相连接;
7、如图4c所示,光刻打开P型埋层(PBL)注入区域;
8、如图4c所示,以光刻胶506和有源区上的硬掩模层即垫衬氧化层502、氮化硅层503为掩模版进行P型离子注入形成P型埋层509,该P型埋层509为本发明SiGe PNP双极晶体管的集电区;
9、如图4d所示,去除浅槽氧化层侧墙505,填入场氧化层510,并用化学机械抛光磨平;
10、如图4d所示,去除氮化硅503和氧化硅502;
11、如图4e所示,外延生长SiGe层511,P型高剂量注入,并刻蚀形成本发明SiGe PNP双极晶体管的发射区;
12、如图4f所示,生长氧化硅层间膜512;
13、如图4f所示,刻蚀深槽接触孔;
14、如图4f所示,填入过渡金属层Ti/TiN,再填入钨,形成513;
15、如图4f所示,淀积并刻蚀金属,形成514。
本发明的SiGe BiCMOS工艺中的SiGe PNP双极晶体管是一种纵向结构,通过采用所述纵向结构、加上集电区埋层结构以及场氧化层上的深阱接触,使本发明的SiGe BiCMOS工艺中的SiGe PNP双极晶体管只包含一个有源区,大大缩小了SiGe PNP晶体管的面积,本发明的SiGe PNP晶体管的面积只有现有SiGe PNP晶体管的四分之一。另外本发明的SiGePNP晶体管的基区宽度小于现有SiGe PNP晶体管的基区宽度,从而能使电流放大系数得到提高。如图5所示,为本发明实施例的SiGe BiCMOS工艺中的SiGe PNP双极晶体管特性的TCAD模拟曲线,从曲线能看出电流放大倍数已经达到37。
以上通过具体实施例对本发明进行了详细的说明,但这些并非构成对本发明的限制。在不脱离本发明原理的情况下,本领域的技术人员还可做出许多变形和改进,这些也应视为本发明的保护范围。