CN101706633A - 液晶显示器的双闸极晶体管基板 - Google Patents

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Abstract

本发明提供一种液晶显示器的双闸极晶体管基板，其是在相邻数据线之间且位于每组相邻画素单元之间设有虚设数据线之设计，且虚设数据线皆连接至一共同电压电极走线。这样就可有效降低共同电压的阻值，加快共同电压回复准位的时间，进而解决存在于现有技术中易发生水平方向串扰的画面质量问题。

Description

液晶显示器的双闸极晶体管基板
【技术领域】
本发明是有关一种双闸极(double gate)设计的液晶显示装置，特别是关于一种液晶显示器的双闸极晶体管基板。
【背景技术】
薄膜晶体管液晶显示器(TFT LCD)中，使用的驱动IC是依据X、Y轴而分为源极驱动IC(Source IC)和闸极驱动IC(Gate IC)，以利用来自时序控制器(Time Controller)传来的数据讯号由源极驱动IC依照讯号提供灰阶电压，而薄膜晶体管的开或关则由闸极驱动IC来控制的。
为了降低控制电路的面积，所以衍生出双闸极晶体管的设计，这是将数据线数目减半，并将扫描线数目加倍，以达到整体源极IC及其通道数量减少的效果。举例来说，一般液晶显示器800×RGB×480，总源极通道数目原本为2400，经过双闸极设计的后，源极通道可减半变为1200，而闸极通道数增加为960，所以总通道数由2800降为2160，共省下了640个通道数。一般双闸极晶体管的驱动架构如图1及图2所示，每二相邻晶体管系共享同一条数据线，并分别连接至不同的扫描线；如图所示，以两条扫描线为一组，扫描线G1及扫描线G2为一组、扫描线G3及扫描线G4为一组；在第一画素10中，薄膜晶体管102分别连接第一数据线S01、画素电容104及扫描线G1；在第二画素12中，薄膜晶体管122则分别连接第一数据线S01、画素电容124及扫描线G1-1连接；其中，第一画素10及第二画素12系共享第一资料线S01，而分别以扫描线G1及扫描线G2不同的扫描线来控制。
液晶显示面板的驱动电路在同一时间一次启动水平扫描线G1，以将该扫描线G1上的所有薄膜晶体管102打开，再经由垂直资料线S01送入数据信号至对应的第一画素10中；接着关闭薄膜晶体管102，直到下次再重新写入信号。接着，启动水平扫描线G2，以将该数据线G2上的所有薄膜晶体管122打开，再经由垂直资料线S01送入数据信号至对应的第二画素12中；接着关闭薄膜晶体管122，直到下次再重新写入信号。这期间使电荷保存在每个画素10、12中的画素电容104、124上；此时再依序启动下一条扫描线G3、G4…等等，依照上述方式经由数据线输入数据信号至对应画素中；如此依序将整个画面的数据信号写入。
然而，由于上述双闸极晶体管的设计架构，使得共同电压(Vcom)容易受到耦合(couple)，再加上因为充电时间减半的缘故，Vcom恢复原有电压准位的时间也跟着减半，如此将造成水平方向的串扰(cross-talk)的画面质量问题。
为改善上述问题，本发明提出一种液晶显示器的双闸极晶体管基板的先设计。
【发明内容】
本发明提供一种液晶显示器的双闸极晶体管基板，其是在具有双闸极驱动电路的基板中增加虚设数据线(dummy data line)的设计，以降低共同电压的阻值，加快共同电压回复准位的时间，进而解决存在于先前技术中易发生水平方向串扰的画面质量问题。
本发明另提供一种液晶显示器的双闸极晶体管基板，其在降低阻值的同时，也可减少电极接点(Transfer pad)的数量，并降低加工时间(tact time)。
为达到上述目的，本发明揭示一种液晶显示器的双闸极晶体管基板是包括有多条数据线、多条扫描线以及多组画素单元，其中每组画素单元系包含相邻的奇数画素单元与偶数画素单元，二者系共同连接至第一数据线，且奇数画素单元与偶数画素单元分别连接至相邻的二该扫描线；并有多条虚设数据线系平行间隔设置于此些数据线的间，并位于每组画素单元的间，且此些虚设数据线连接至一共同电压电极，以此达到降低共同电压的走线阻值。
【附图说明】
下面结合附图和实施例对本实用新型进一步说明。
图1为现有技术的双闸极晶体管基板的结构示意图；
图2为现有技术的双闸极晶体管基板的等效电路示意图；
图3为本发明的双闸极晶体管基板的结构示意图；
图4为本发明的双闸极晶体管基板的等效电路示意图。
【具体实施方式】
为了避免水平方向串扰的画质质量问题发生，需将共同电压(Vcom)回复准位的时间加快，因此本发明采用降低共同电压走线阻值的方式来加快共同电压回复准位的时间。
请参阅图3的结构示意图及图4的等效电路示意图，如图所示，本发明提出的液晶显示器的双闸极晶体管基板20系包括有多条数据线22、多条扫描线24、多画素单元26以及多条虚设数据线(dummy data line)38。第一列的画素单元使用扫描线G01、G02，第二列的画素单元使用扫描线G03、G04，第三列画素单元使用扫描线G05、G06，以此类推；且扫描线G01、G02、G03、G04…等系连接至外部闸极芯片(图中未标示)，每一画素单元中的二相邻画素则分别共享一条资料线S01、02、03、04，且资料线S01、02、03、044…等连接至外部源极芯片(图中未示)。其中，本实施例以扫描线G01和G02以及数据线S01为例来详细说明本发明的技术特征，以下分别称为第一扫描线G01、第二扫描线G02以及第一资料线S01、第二资料线S02。
本发明的多组画素单元，每组画素单元结构皆相同，以画素单元26、32为例，画素单元26包含二相邻的奇数画素单元28与偶数画素单元30，其共同连接至第一数据线S01，第一数据线S01连接至外部源极芯片，以传输数据讯号至画素单元26内的奇数画素单元28与偶数画素单元30；且奇数画素单元28与偶数画素单元30分别连接至第一扫描线G01与第二扫描线G02。画素单元32包含二相邻的奇数画素单元34与偶数画素单元36，其共同连接至第二数据线S02，第二数据线S02连接至外部源极芯片，以传输数据讯号至画素单元32内的奇数画素单元34与偶数画素单元36；且奇数画素单元34与偶数画素单元36分别连接至第一扫描线G01与第二扫描线G02。其中，第一扫描线G01与第二扫描线G02连接至外部闸极芯片，以分别透过第一扫描线G01及第二扫描线G02传输控制讯号给奇数画素单元28、34及偶数画素单元30、36。
再者，本发明的最大特征即在于增设多条虚设资料线38，此些虚设资料线38平行间隔设置于相邻数据线的间，并位于每组画素单元26的间，这些虚设数据线38即为原本未使用到的数据线，如图所示，是为位于数据线S01及S02的间，且位于相邻二画素单元26、32的间，以此类推，位于数据线S03及S04的间以及数据线S05及S06的间等等；且这些虚设数据线38共同连接至一共同电压电极走线40，且于图3中所绘示的黑色节点代表虚设数据线38与共同电压电极走线40的连接节点.其中，该等虚设数据线38可与前述的数据线22同时制作完成，而不需要额外的制程步骤.
其中，在上述架构中，如图4所示，每一奇数画素单元28分别包含一作为开关的薄膜晶体管以及作为画素电容的储存电容284和液晶电容286，使薄膜晶体管282受第一扫描线G01的控制，以选择性地自第一数据线S01传送数据信号至储存电容284和液晶电容286中。每一偶数画素单元30分别包含一作为开关的薄膜晶体管302及一储存电容304和液晶电容306，此薄膜晶体管302受第二扫描线G02的控制，以选择性地自第一数据线S01传送数据信号至储存电容304和液晶电容306。同理，其它所有画素单元的组成架构与作动，都与前述内容相同，故于此不再赘述。
其中，上述由多个奇数画素单元与偶数画素单元所组成的多画素单元，其极性反转方式系可为图框反转、行反转、列反转或点反转，并不限定为特性的极性转换方式。当然，画素电容中的储存电容的架构为储存电容于闸极上(Cs on gate)或储存电容于共同电极上(Cs oncommon)皆可。
本发明在基板上增加虚设数据线并与共同电压电极走线连接在一起，以达到降低共同电压阻值的目的，让共同电压回复准位的时间加快，进而解决存在于现有技术中易发生水平方向串扰的画面质量问题。且因为阻值降低了，所以亦可减少电极接点(Transfer pad)的数量，并降低加工时间(tact time)。甚至，若储存电容系采用H型设计，因为阻值降低了，所以可以缩小储存电容的面积，进而达到增加开口率的功效者。
以上所述的实施例仅为说明本发明的技术思想及特点，其目的在使本领域技术人员能够了解本发明的内容并据以实施，但不能以的限定本发明的专利范围，即大凡依本发明所揭示的精神所作的均等变化或修饰，仍应涵盖在本发明的专利范围内。

Claims (9)

1.一种液晶显示器的双闸极晶体管基板，其特征在于：包括，
多条数据线，包含第一资料线；
多条扫描线，包含第一扫描线及第二扫描线；
多组画素单元，其中每组该画素单元包含相邻的奇数画素单元与偶数画素单元共同连接至该第一数据线，且该奇数画素单元与该偶数画素单元分别连接至该第一扫描线与该第二扫描线；以及
多条虚设数据线(dummy data line)，平行间隔设置于所述数据线之间，并位于每组该画素单元之间，且所述虚设数据线连接至一共同电压电极。
2.根据权利要求1所述的液晶显示器的双闸极晶体管基板，其特征在于：所述数据线连接至外部源极芯片，以传输数据讯号至每组该画素单元。
3.根据权利要求1所述的液晶显示器的双闸极晶体管基板，其特征在于：所述扫描线连接至外部闸极芯片，以分别透过该第一扫描线及该第二扫描线传输控制讯号给该奇数画素单元及该偶数画素单元。
4.根据权利要求1所述的液晶显示器的双闸极晶体管基板，其特征在于：每一该奇数画素单元分别包含一开关、一液晶电容及储存电容，该开关受该第一扫描线的控制，以选择性地自该第一数据线传送数据信号至该液晶电容与该储存电容。
5.根据权利要求1所述的液晶显示器的双闸极晶体管基板，其特征在于：每一该偶数画素单元分别包含一开关、一液晶电容及储存电容，该开关受该第二扫描线的控制，以选择性地自该第一数据线传送数据信号至该液晶电容与该储存电容。
6.根据权利要求4或5所述的液晶显示器的双闸极晶体管基板，其特征在于：所述开关为薄膜晶体管。
7.根据权利要求1所述的液晶显示器的双闸极晶体管基板，其特征在于：所述画素单元的极性反转方式是选自图框反转、行反转、列反转或点反转。
8.根据权利要求1所述的液晶显示器的双闸极晶体管基板，其特征在于：所述数据线与所述虚设数据线同时制作完成。
9.根据权利要求4或5所述的液晶显示器的双闸极晶体管基板，其特征在于：所述储存电容的架构为储存电容于闸极上(Cs on gate)或储存电容于共同电极上(Cs oncommon)。
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