CN111142298B - 阵列基板及显示装置 - Google Patents
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Abstract
本发明实施例提供一种阵列基板及显示装置，涉及显示技术领域，可以提高显示效果。一种阵列基板，包括：阵列分布的多个像素；每个所述像素包括多个子像素，同一行中每两个相邻的子像素组成一子像素对；多个数据线对；所述数据线对包括两条数据线，同一列所述子像素对与同一所述数据线对中的两条数据线连接；其中，一条所述数据线与一列所述子像素对中位于奇数行奇数列和偶数行偶数列的各个子像素连接，另一条与位于奇数行偶数列和偶数行奇数列的各个子像素连接。
Description
技术领域
本发明涉及显示技术领域，尤其涉及阵列基板及显示装置。
背景技术
在显示装置不断向着低成本、高品质方向发展的背景下，以双栅(Dual Gate)进行驱动的阵列基板行驱动(GOA，Gate Driver On Array)设计，获得了广泛的应用。
发明内容
本发明的实施例提供一种阵列基板及显示装置，可以提高显示效果。
为达到上述目的，本发明的实施例采用如下技术方案：
一方面，提供一种阵列基板，包括：阵列分布的多个像素；每个所述像素包括多个子像素，同一行中每两个相邻的子像素组成一子像素对；多个数据线对；所述数据线对包括两条数据线，同一列所述子像素对与同一所述数据线对中的两条数据线连接；其中，一条所述数据线与一列所述子像素对中位于奇数行奇数列和偶数行偶数列的各个子像素连接，另一条与位于奇数行偶数列和偶数行奇数列的各个子像素连接。
可选地，阵列基板还包括：多个栅线对；所述栅线对包括两条栅线，同一行所述子像素与同一所述栅线对中的两条栅线连接；其中，一条所述栅线与位于奇数列的各个子像素连接，另一条与位于偶数列的各个子像素连接。
可选地，每个栅线对中的两条栅线分布在同一行所述子像素的两侧。
可选地，每个栅线对中两条栅线连接到同一个接线端。
可选地，阵列基板还包括：多条栅线；同一行所述子像素与同一所述栅线连接；每条栅线连接一个所述接线端。
可选地，阵列基板还包括：栅极驱动模块，与多个所述接线端连接，用于依次向多个所述接线端提供栅极扫描信号。
另一方面，还提供一种显示装置，包括如上述所述的阵列基板、数据驱动模块；在所述阵列基板中的栅极驱动模块向所述栅线提供栅极扫描信号时，所述数据驱动模块向各数据线输入数据信号。
可选地，所述数据驱动模块包括：多个数模转换器对；每个所述数模转换器对包括一个正极性和一个负极性的所述数模转换器；多个输出缓冲器对；每个所述数模转换器对连接相邻两个所述输出缓冲对；每个所述输出缓冲器对中的两个所述输出缓冲器分别连接同一所述数模转换器对中不同的所述数模转换器；每个所述输出缓冲器对连接一个所述数据线对；每个所述数据线对中的两条所述数据线分别与不同的所述输出缓冲器连接。
可选地，每个所述数模转换器对先后向位于奇数列和偶数列的所述数据线对提供数据信号。
可选地，所述数据驱动模块还包括：多个数字电路对；所述数字电路对包括两个所述数字电路；其中，相邻两个所述数字电路对与一个所述数模转换器对连接；同一所述数字电路对中的两个所述数字电路分别与同一所述数模转换器对中的不同数模转换器连接。
本发明的实施例提供一种阵列基板及显示装置，阵列基板包括阵列分布的多个像素，以及多个数据线对；每个像素包括多个子像素，同一行中每两个相邻的子像素组成一子像素对；数据线对包括两条数据线，同一列子像素对与同一数据线对中的两条数据线连接；通过将同一数据线对中的一条数据线与一列子像素对中位于奇数行奇数列和偶数行偶数列的各个子像素连接，另一条与位于奇数行偶数列和偶数行奇数列的各个子像素连接，从而使得阵列基板后续用于显示时，在数据线对中的两条数据线输出极性相反的数据信号，而每条数据线持续输出极性相同的数据信号的情况下，可以降低功耗同时消除充电率不足导致的V-line现象，提高显示效果。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1a为现有技术中显示装置的结构示意图；
图1b为现有技术中显示面板的结构示意图；
图2a为现有技术中一种阵列基板的结构示意图；
图2b为现有技术中另一种阵列基板的结构示意图；
图3a为本发明实施例提供的一种阵列基板的结构示意图；
图3b为本发明实施例提供的另一种阵列基板的结构示意图；
图4a为本发明实施例提供的又一种阵列基板的结构示意图；
图4b为本发明实施例提供的又一种阵列基板的结构示意图；
图5为本发明实施例提供的一种显示装置的结构示意图；
图6a为本发明实施例提供的另一种显示装置的结构示意图；
图6b为本发明实施例提供的又一种显示装置的结构示意图；
图7a为本发明实施例提供的一种数据驱动模块的结构示意图；
图7b为本发明实施例提供的另一种数据驱动模块的结构示意图。
附图标记：
1-显示装置；2-显示面板；3-数据驱动模块；4-栅极驱动模块；5-时序控制器；100-子像素对；21-阵列基板；22-对盒基板；23-液晶层；24-上偏光片；25-下偏光片；210-第一衬底；211-薄膜晶体管；212-像素电极；213-公共电极；214-第一绝缘层；215-第二绝缘层；220-第二衬底；221-彩色滤光层；222-黑矩阵图案；31-数模转换器对；310-数模转换器；32-输出缓冲器对；320-输出缓冲器；33-数字电路对；330-数字电路。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
如图1a所示，显示装置1包括显示面板2、数据驱动模块3和时序控制器5。
在显示装置1为液晶显示装置的情况下，显示面板2为液晶显示面板。如图1b所示，液晶显示面板的主要结构包括阵列基板21、对盒基板22以及设置在阵列基板21和对盒基板22之间的液晶层23。在此情况下，液晶显示装置包含的背光模组可以设置在显示面板2下方位置，背光模组可以向显示面板2提供背光。
阵列基板21的每个子像素均设置有位于第一衬底210上的薄膜晶体管211和像素电极212。薄膜晶体管211包括有源层、源极、漏极、栅极及栅绝缘层，源极和漏极分别与有源层接触，像素电极212与薄膜晶体管211的漏极电连接。在一些实施例中，阵列基板21还包括设置在第一衬底210上的公共电极213。像素电极212和公共电极213可以设置在同一层，在此情况下，像素电极212和公共电极213均为包括多个条状子电极的梳齿结构。像素电极212和公共电极213也可以设置在不同层，在此情况下，如图1b所示，像素电极212和公共电极213之间设置有第一绝缘层214。在公共电极213设置在薄膜晶体管211和像素电极212之间的情况下，如图1b所示，公共电极213与薄膜晶体管211之间还设置有第二绝缘层215。在另一些实施例中，对盒基板22包括公共电极213。
如图1b所示，对盒基板22包括设置在第二衬底220上的彩色滤光层221，在此情况下，对盒基板22也可以称为彩膜基板(Color filter，简称CF)。其中，彩色滤光层221至少包括红色光阻单元、绿色光阻单元以及蓝色光阻单元，红色光阻单元、绿色光阻单元以及蓝色光阻单元分别与阵列基板21上的子像素一一正对。对盒基板22还包括设置在第二衬底220上的黑矩阵图案222，黑矩阵图案222用于将红色光阻单元、绿色光阻单元以及蓝色光阻单元间隔开。
如图1b所示，液晶显示面板还包括设置在对盒基板22远离液晶层23一侧的上偏光片24以及设置在阵列基板21远离液晶层23一侧的下偏光片25。
在此基础上，阵列基板21还包括栅极驱动模块4、多条栅线和多条数据线。
时序控制器5分别与栅极驱动模块4和数据驱动模块3电连接，而栅极驱动模块4与栅线电连接，数据驱动模块3与数据线电连接。
其中，时序控制器5用于根据输入的同步信号生成控制栅极驱动模块4和数据驱动模块3的控制信号，栅极驱动模块4用于控制阵列基板中栅极的开启或关闭；数据驱动电路用于将数据信息输入至阵列基板中，从而实现图像的显示。
基于此，如果液晶层23中的液晶分子一直工作在某一固定的电压下不变，液晶分子的特性会发生固化，当取消这一固定电压后，液晶分子无法再响应外加电压的变化。因此，驱动液晶工作的电压不能是直流电压，而应该是交流电压。故显示面板2在显示一个固定画面时，加在液晶两端的像素电压具有两种极性，像素电极212上的电压大于公共电极213上的电压时，为正极性；反之为负极性。由于液晶两端的像素电压的绝对值相同，所以可以显示出相同亮度的画面。
然而，使用交流驱动容易引起显示画面的闪烁，为了抑制闪烁，通常利用空间融合法来消除闪烁成分。即，让相邻的像素保持相反的驱动极性，使得相邻像素的光学响应波形存在π相位差，这样，相邻像素的波形在空间上实现融合，人眼就分辨不出具体每个像素中存在的闪烁成分。
由此，在现有技术中，示例的，实现相邻像素极性相反的驱动方式有点反转(如图2a所示)，在同一帧画面下，每个点(子像素)与自己相邻的上下左右四个点保持相反的极性，在接下来的一帧画面下，所有子像素的电压极性同时反转，相邻子像素继续保持相反的极性；行2点反转(如图2b所示)，在每一行上以两点为单位正负极性反转，相邻的上下两行子像素则以行为单位正负极性反转。
如图2a和图2b所示，在此基础上，在栅极驱动模块4依次向栅线提供栅极扫描信号的情况下，数据驱动模块3向数据线提供的数据信号依次输入至该数据线左右两侧的两列子像素中，该两列子像素以z字型为序所对应的极性依次为：正负负正正负负正，或者为负正正负负正正负；又因为相邻极性相同时，子像素的充电率较高，相邻极性相反时，子像素的充电率较低，因此，在同样充电时间下，一数据线左右两侧的两列子像素，每行右侧子像素相对于左侧子像素均充电不足，导致比左侧子像素亮度低。由此，最终导致数据线左右两侧的两列子像素亮度不同，使人眼看到垂直亮暗线(V-line)现象。
针对上述问题，现有技术中，通常采用的方法是减少输出数据使能信号(Outputenable control，OE)的宽度，通过增加充电时长，以增加像素充电率，从而改善V-line现象。但是，当V-line现象严重时，仅仅减少OE宽度来改善，容易出现栅线重叠(GateOverlap)问题，即，会衍生出错充的问题。
基于上述问题，本发明的实施例提供一种阵列基板，如图3a-图4b所示，包括：
阵列分布的多个像素；每个像素包括多个子像素，同一行中每两个相邻的子像素组成一子像素对100；
多个数据线对；数据线对包括两条数据线，同一列子像素对100与同一数据线对中的两条数据线连接；
其中，一条数据线与一列子像素对100中位于奇数行奇数列和偶数行偶数列的各个子像素连接，另一条与位于奇数行偶数列和偶数行奇数列的各个子像素连接。
示例的，如图3a-图4b所示，阵列基板21包括多个数据线对(如图中所示的S1_1和S1_2为一对数据线对,S2_1和S2_2为一对数据线对,依次类推)。数据线S1_1和S1_2与第一列子像素对100(如图3a-图4b所示中的区域a中的子像素对100)连接。
其中，数据线S1_1与第1行第1列、第2行第2列、第3行第3列…依次类推，即，与位于奇数行奇数列和偶数行偶数列的各个子像素连接，数据线S1_2与第1行第2列、第2行第1列、第3行第2列…依次类推，即，与位于偶数行奇数列和奇数行偶数列的各个子像素连接。
本发明的实施例提供一种阵列基板21，包括阵列分布的多个像素，以及多个数据线对；每个像素包括多个子像素，同一行中每两个相邻的子像素组成一子像素对100；数据线对包括两条数据线，同一列子像素对100与同一数据线对中的两条数据线连接；通过将同一数据线对中的一条数据线与一列子像素对100中位于奇数行奇数列和偶数行偶数列的各个子像素连接，另一条与位于奇数行偶数列和偶数行奇数列的各个子像素连接，从而使得阵列基板21后续用于显示时，在数据线对中的两条数据线输出极性相反的数据信号，而每条数据线持续输出极性相同的数据信号的情况下，可以降低功耗同时消除充电率不足导致的V-line现象，提高显示效果。
可选地，如图3a和图3b所示，该阵列基板21还包括：
多个栅线对；栅线对包括两条栅线，同一行子像素与同一栅线对中的两条栅线连接；
其中，一条栅线与位于奇数列的各个子像素连接，另一条与位于偶数列的各个子像素连接。
示例的，如图3a和图3b所示，阵列基板21包括多个栅线对(如图中所示的G1_1和G1_2为一对栅线对,G2_1和G2_2为一对栅线对,依次类推)。栅线G1_1和G1_2与第一行子像素连接。
其中，栅线G1_1与第1行第1列、第1行第3列、第1行第5列…依次类推，即，与位于奇数列的各个子像素连接，栅线G1_2与第1行第2列、第1行第4列、第1行第6列…依次类推，即，与位于偶数列的各个子像素连接。
可选地，如图3a和图3b所示，每个栅线对中的两条栅线分布在同一行子像素的两侧。
示例的，如图3a和图3b所示，第一对栅线对中的栅线G1_1分布在第一行子像素的上方，栅线G1_2分布在第一行子像素的下方。
需要说明的是，“上方”和“下方”仅用于表示位置关系，当描述对象的绝对位置改变后，则该相对位置关系也可能相应的改变。
可选地，如图3a和图3b所示，每个栅线对中两条栅线连接到同一个接线端。
可以理解的是，由于每个子像素对100中的两个子像素分别与不同的数据线连接，互不影响，因此，该两个子像素所连接的栅线可以连接到同一接线端，当两个子像素在同一栅极扫描信号下打开时，对应的数据线同时输入数据信号，基于此，减少了接线端的数量。
可选地，如图4a和图4b所示，该阵列基板21还包括：
多条栅线；同一行子像素与同一栅线连接；每条栅线连接一个接线端。
可选地，如图3a-图4b所示，该阵列基板21还包括：
栅极驱动模块4，与多个接线端连接，用于依次向多个接线端提供栅极扫描信号。
可以理解的是，在阵列基板21包括多条栅线对，而栅线对连接同一接线端的情况下，或者在阵列基板21包括多条栅线，一条栅线连接一个接线端的情况下，栅极驱动模块依次向多个接线端提供栅极扫描信号，阵列排布的子像素均为一行一行依次打开。
本发明的实施例还提供一种显示装置，如图5所示，包括如上所述的阵列基板21、数据驱动模块3。
在阵列基板21中的栅极驱动模块4向栅线提供栅极扫描信号时，数据驱动模块3向各数据线输入数据信号。
在上述阵列基板21中，栅极驱动模块4是依次向接线端提供栅极扫描信号的，因此，像素为逐行打开，相应的，打开一行像素，数据驱动模块3向相对应的子像素输入数据信号。
需要说明的是，显示装置1还包括时序控制器5，分别与栅极驱动模块4和数据驱动模块3连接，用于控制栅极驱动模块4和数据驱动模块3。
本发明的实施例提供一种显示装置1，包括阵列基板21和数据驱动模块3，在阵列基板21中的栅极驱动模块4向栅线提供栅极扫描信号时，数据驱动模块3向各数据线输入数据信号。由于在阵列基板21中，同一列子像素对100与同一数据线对中的两条数据线连接；同一数据线对中的一条数据线与一列子像素对100中位于奇数行奇数列和偶数行偶数列的各个子像素连接，另一条与位于奇数行偶数列和偶数行奇数列的各个子像素连接，因此，显示装置1在显示时，可以使得数据线对中的两条数据线输出极性相反的数据信号，并且每条数据线持续输出极性相同的数据信号，从而可以降低功耗同时消除充电率不足导致的V-line现象，提高显示效果。
在此基础上，若相邻两条数据线输出极性相反的数据信号(即，点反转)，此时，相对于行2点反转，显示装置1具有更好的抗闪烁和串扰的表现。
可选地，如图6a和图6b所示，数据驱动模块3包括：
多个数模转换器对31；每个数模转换器对31包括一个正极性和一个负极性的数模转换器310。
多个输出缓冲器对32；每个数模转换器对连接相邻两个输出缓冲对；每个输出缓冲器对32中的两个输出缓冲器320分别连接同一数模转换器对31中不同的数模转换器310。
每个输出缓冲器对32连接一个数据线对；每个数据线对中的两条数据线分别与不同的输出缓冲器320连接。
示例的，一个输出缓冲器对32中的两个输出缓冲器320分别连接数据线对S1_1和S1_2,相邻的输出缓冲器对32中的两个输出缓冲器320分别连接数据线S2_1和S2_2；而该相邻的两队输出缓冲器对32于同一数模转换器对31连接，此时，与数据线S1_1对应的输出缓冲器320连接正极性的数模缓冲器，与数据线S1_2对应的输出缓冲器320连接负极性的数模缓冲器；若与数据线S2_1对应的输出缓冲器320连接负极性的数模缓冲器，与数据线S2_2对应的输出缓冲器320连接正极性的数模缓冲器，则显示一帧画面时，在栅线的延伸方向上，子像素的极性为行2点反转(如图6a所示)；若与数据线S2_1对应的输出缓冲器320连接正极性的数模缓冲器，与数据线S2_2对应的输出缓冲器320连接负极性的数模缓冲器，则显示一帧画面时，在栅线的延伸方向上，子像素的极性为行单点反转(如图6b所示)。
在现有的数据驱动模块3中，数模转换器310的面积约占总面积的60％，缩减数模转换器310即可降低成本。在本发明的实施例中，由于相邻两个数据线对复用一对数模转换器，可以在数量和面积上可以减少一半数模转换器，因此，可以降低数据驱动模块3的成本。
可选地，如图6a和图6b所示，每个数模转换模块对先后向位于奇数列和偶数列的数据线对提供数据信号。
此处，是将一对数据线对作为一个整体，即，一列。示例的，每个数模转换模块对先向位于奇数列的数据线对(例如，S1_1和S1_2)提供数据信号，再向偶数列的数据线对(例如，S2_1和S2_2)提供数据信号。即，第一组数据信息(例如，a1和a2)中的a1经过数字电路330传输至正极性的数模转换器310(DAC+),处理后经输出缓存器传输至数据线S1_1；同时，a2经过数字电路330传输至负极性的数模转换器310(DAC-),处理后经输出缓存器传输至数据线S1_2；然后，第二组数据信息(例如，b1和b2)中的b1经过数字电路330传输至负极性的数模转换器310(DAC-),处理后经输出缓存器传输至数据线S2_1；同时，b2经过数字电路330传输至正极性的数模转换器310(DAC+),处理后经输出缓存器传输至数据线S2_2。
或者，第一组数据信息(例如，a1和a2)中的a1经过数字电路330传输至正极性的数模转换器310(DAC+),处理后经输出缓存器传输至数据线S1_1；同时，a2经过数字电路330传输至负极性的数模转换器310(DAC-),处理后经输出缓存器传输至数据线S1_2；然后，第二组数据信息(例如，b1和b2)中的b1经过数字电路330传输至正极性的数模转换器310(DAC+),处理后经输出缓存器传输至数据线S2_1；同时，b2经过数字电路330传输至负极性的数模转换器310(DAC-),处理后经输出缓存器传输至数据线S2_2。
需要说明的是，由于阵列基板21中栅极驱动模块4连接的接线端减少，则意味着每条栅线打开的时间将延长，此时，每个数据转换模块对先后向位于奇数列和偶数列的数据线对提供数据信号是可以满足充电时间上的要求的。
可选地，如图6a和图6b所示，数据驱动模块3还包括：多个数字电路对33；数字电路对33包括两个数字电路330。
其中，相邻两个数字电路对33与一个数模转换器对连接；同一数字电路对中的两个数字电路330分别与同一数模转换器对中的不同数模转换器连接。
需要说明的是，如图7a和图7b所示，数字电路330包括第一暂存器、第二暂存器和电平转换器。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。
Claims (7)
1.一种阵列基板，其特征在于，包括：
阵列分布的多个像素；每个所述像素包括多个子像素，同一行中每两个相邻的子像素组成一子像素对；
多个数据线对；所述数据线对包括两条数据线，同一列所述子像素对与同一所述数据线对中的两条数据线连接；所述数据线对位于所述子像素对中所述两个相邻的子像素之间；其中，
一条所述数据线与一列所述子像素对中位于奇数行奇数列和偶数行偶数列的各个子像素连接，另一条与位于奇数行偶数列和偶数行奇数列的各个子像素连接；
所述阵列基板还包括多个栅线对；所述栅线对包括两条栅线，同一行所述子像素与同一所述栅线对中的两条栅线连接；其中，一条所述栅线与位于奇数列的各个子像素连接，另一条与位于偶数列的各个子像素连接；每个所述栅线对中两条栅线连接到同一个接线端。
2.根据权利要求1所述的阵列基板，其特征在于，每个栅线对中的两条栅线分布在同一行所述子像素的两侧。
3.根据权利要求1所述的阵列基板，其特征在于，还包括：
栅极驱动模块，与多个所述接线端连接，用于依次向多个所述接线端提供栅极扫描信号。
4.一种显示装置，其特征在于，包括权利要求1-3任一项所述的阵列基板、数据驱动模块；
在所述阵列基板中的栅极驱动模块向栅线提供栅极扫描信号时，所述数据驱动模块向各数据线输入数据信号。
5.根据权利要求4所述的显示装置，其特征在于，所述数据驱动模块包括：
多个数模转换器对；每个所述数模转换器对包括一个正极性和一个负极性的所述数模转换器；
多个输出缓冲器对；每个所述数模转换器对连接相邻两个所述输出缓冲器对；每个所述输出缓冲器对中的两个所述输出缓冲器分别连接同一所述数模转换器对中不同的所述数模转换器；
每个所述输出缓冲器对连接一个所述数据线对；每个所述数据线对中的两条所述数据线分别与不同的所述输出缓冲器连接。
6.根据权利要求5所述的显示装置，其特征在于，每个所述数模转换器对先后向位于奇数列和偶数列的所述数据线对提供数据信号。
7.根据权利要求5所述的显示装置，其特征在于，所述数据驱动模块还包括：多个数字电路对；所述数字电路对包括两个所述数字电路；
其中，相邻两个所述数字电路对与一个所述数模转换器对连接；同一所述数字电路对中的两个所述数字电路分别与同一所述数模转换器对中的不同数模转换器连接。
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