CN101950544A - 液晶显示装置的驱动电路 - Google Patents

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Abstract

本发明涉及一种液晶显示装置的驱动电路包含一像素数组、一第i个闸极驱动电路及一第i+1个闸极驱动电路。该像素数组包含N个像素列，其中每一像素列包含M个并排的像素；该第i个闸极驱动电路的最后一输出端是耦接于一第k像素列；及该第i+1个闸极驱动电路的第一输出端亦耦接于该第k个像素列；其中该第k像素列的M个并排的像素是由该第i个闸极驱动电路的最后一输出端与该第i+1个闸极驱动电路的第一输出端驱动，且该M个并排的像素中的两相邻像素分别由该最后一输出端与该第一输出端所驱动，其中N≧k≧1，及M≧1。

Description

液晶显示装置的驱动电路
技术领域
 本发明是有关于一种液晶显示装置的驱动电路，尤指一种由二闸极驱动电路共同驱动边界像素列的液晶显示装置的驱动电路。
背景技术
请参照图1，图1是为先前技术说明液晶显示装置的双闸极(dual gate)驱动电路的示意图。每个闸极驱动电路具有复数个输出端，用以驱动N个像素列。每一像素列包含复数个并排的像素，而复数个并排的像素中的相邻像素是分别由两输出端所驱动。请参照图2，图2是说明显示屏的亮度不均匀的示意图。如图2所示，因为闸极驱动电路Gm与Gm+1的驱动电压不一定相同，所以由闸极驱动电路Gm所驱动的像素列(第k-1个像素列及第k个像素列)与闸极驱动电路Gm+1所驱动的像素列(第k+1个像素列及第k+2个像素列)会有亮度上的差异，造成显示屏上会有亮度不均(mura)的横条纹。
发明内容
本发明的目的是提供一种液晶显示装置的驱动电路。
本发明采用以下方案实现：该驱动电路包含一像素数组、一第i个闸极驱动电路及一第i+1个闸极驱动电路。该像素数组包含N个像素列，其中每一像素列包含M个并排的像素，其中N≧1，以及M≧1；该第i个闸极驱动电路，具有复数个输出端，该第i个闸极驱动电路的最后一输出端是耦接于一第k个像素列，其中N≧k≧1；及该第i+1个闸极驱动电路，具有复数个输出端，该第i+1个闸极驱动电路的第一输出端是耦接于该第k个像素列；其中该第k像素列的M个并排的像素是由该第i个闸极驱动电路的最后一输出端与该第i+1个闸极驱动电路的第一输出端驱动，且该M个并排的像素中的相邻像素是分别由该第i个闸极驱动电路的最后一输出端与该第i+1个闸极驱动电路的第一输出端所驱动。
本发明所提供的一种液晶显示装置的驱动电路。该液晶显示装置的驱动电路是利用二闸极驱动电路共同驱动一边界像素列，以降低一显示屏亮度不均匀的现象，使一观察者的眼睛不易分辨出该显示屏上的亮暗边界。
附图说明
图1是为先前技术说明液晶显示装置的双闸极驱动电路的示意图。
图2是说明显示屏的亮度不均匀的示意图。
图3是为本发明的一实施例说明液晶显示装置的驱动电路的示意图。
图4A和图4B是说明驱动电路驱动边界像素列的示意图。
图5A和图5B是说明当像素为Z-Z型时，显示屏显示的画面的示意图。
图6A和图6B是说明当像素为Z-反Z型时，显示屏显示的画面的示意图。
图7A和图7B是说明当像素为弓型时，显示屏显示的画面的示意图。
图8是说明液晶显示装置的三闸极驱动电路的示意图。
 
  【主要组件符号说明】
300                                   驱动电路
302                                   像素数组
Gm、Gm+1、Gi、Gi +1                        闸极驱动电路
Gi +1O1、Gi +1O2、Gi +1O3、Gi +1O4、Gi +1O5                
Gi Ot、GiOt-1、Gi Ot-2、Gi Ot-3  、Gi Ot-4              输出端。
 
具体实施方式
请参照图3，图3是为本发明的一实施例说明液晶显示装置的驱动电路300的示意图。液晶显示装置的驱动电路300包含一像素数组302及复数个闸极驱动电路。如图3所示，像素数组302包含N个像素列，而每一像素列包含M个并排的像素，其中N≧1，以及M≧1；每一闸极驱动电路具有t个输出端，其中t≧1。在图3中，若驱动电路300仅包含二个闸极驱动电路，则i=1；若驱动电路300包含三个闸极驱动电路，则i=1或2。
请参照图4A和图4B，图4A和图4B是说明闸极驱动电路驱动边界像素列(第k个像素列及第k+1个像素列)的示意图。如图4A所示，在驱动电路300中，第i个闸极驱动电路Gi的最后输出端Gi Ot是耦接于一第k个像素列的M/2个像素，及第i+1个闸极驱动电路Gi+1的第一输出端Gi +1O1是耦接于第k个像素列的另M/2个像素，其中第k个像素列的M个并排的像素中的相邻像素是分别由第i个闸极驱动电路Gi的最后输出端Gi Ot和第i+1个闸极驱动电路Gi+1的第一输出端Gi +1O1所驱动。如图4B所示，在驱动电路300中，第i个闸极驱动电路Gi的最后输出端Gi Ot是耦接于一第k+1个像素列的M/2个像素，及第i+1个闸极驱动电路Gi+1的第一输出端Gi +1O1是耦接于第k+1个像素列的另M/2个像素，其中第k+1个像素列的M个并排的像素中的相邻像素是分别由第i个闸极驱动电路Gi的最后输出端Gi Ot和第i+1个闸极驱动电路Gi+1的第一输出端Gi +1O1所驱动。
因此，藉由上述驱动电路驱动像素列的方式，由第i个闸极驱动电路Gi和第i+1个闸极驱动电路Gi+1共同驱动第k个像素列或第k+1个像素列，则因为边界像素列是由第i个闸极驱动电路Gi和第i+1个闸极驱动电路Gi+1共同驱动，所以边界像素列会有亮暗交替的效果。如此，可降低显示屏亮度不均匀以及减轻边界的横条纹的现象。因此，只要液晶显示装置的边界像素列是由二闸极驱动电路所共同驱动，以降低显示屏亮度不均匀的现象，使人眼不易分辨出显示屏上的亮暗边界，皆属于本发明的范畴。
请参照图5A和图5B，图5A和图5B是说明当像素为Z-Z型时，显示屏显示的画面的示意图。如图5A所示，当复数个闸极驱动电路的所有输出端由显示屏的上方至下方依次驱动N个像素列时，因为第k+1个像素列是由第i个闸极驱动电路Gi和第i+1个闸极驱动电路Gi+1共同驱动，所以第k+1个像素列呈现亮暗交替的效果，可改善显示屏亮度不均匀的现象。如图5B所示，当复数个闸极驱动电路的所有输出端由显示屏的上方至下方依次驱动N个像素列时，因为第k个像素列是由第i个闸极驱动电路Gi和第i+1个闸极驱动电路Gi+1共同驱动，所以第k个像素列呈现亮暗交替的效果，可改善显示屏亮度不均匀的现象。
请参照图6A和图6B，图6A和图6B是说明当像素为Z-反Z型时，显示屏显示的画面的示意图。如图6A所示，当复数个闸极驱动电路的所有输出端由显示屏的上方至下方依次驱动N个像素列时，因为第k+1个像素列是由第i个闸极驱动电路Gi和第i+1个闸极驱动电路Gi+1共同驱动，所以第k+1个像素列呈现亮暗交替的效果，可改善显示屏亮度不均匀的现象。如图6B所示，当复数个闸极驱动电路的所有输出端由显示屏的上方至下方依次驱动N个像素列时，因为第k个像素列是由第i个闸极驱动电路Gi和第i+1个闸极驱动电路Gi+1共同驱动，所以第k个像素列呈现亮暗交替的效果，可改善显示屏亮度不均匀的现象。
请参照图7A和图7B，图7A和图7B是说明当像素为弓型时，显示屏显示的画面的示意图。如图7A所示，当复数个闸极驱动电路的所有输出端由显示屏的上方至下方依次驱动N个像素列时，因为第k+1个像素列是由第i个闸极驱动电路Gi和第i+1个闸极驱动电路Gi+1共同驱动，所以第k+1个像素列呈现亮暗交替的效果，可改善显示屏亮度不均匀的现象。如图7B所示，当复数个闸极驱动电路的所有输出端由显示屏的上方至下方依次驱动N个像素列时，因为第k个像素列是由第i个闸极驱动电路Gi和第i+1个闸极驱动电路Gi+1共同驱动，所以第k个像素列呈现亮暗交替的效果，可改善显示屏亮度不均匀的现象。
另外，本发明并不受限于由显示屏的上方至下方依次驱动N个像素列，亦可由显示屏的下方至上方依次驱动N个像素列。而本发明亦不受限于上述画素类型，只要液晶显示装置的边界像素列是由二闸极驱动电路所共同驱动，以降低显示屏亮度不均匀的现象，使人眼不易分辨出显示屏的亮暗边界，皆属于本发明的范畴。
本发明除了应用于双闸极(dual gate)驱动电路之外，亦可应用于三闸极(triple gate)驱动电路。请参照图8，图8是说明液晶显示装置的三闸极驱动电路的示意图。如图8所示，由于红绿蓝子像素中的每一子像素列仍是由二个闸极驱动电路所共同驱动，因此亦可藉由上述驱动电路驱动像素列的方式，以降低显示屏亮度不均匀以及减轻边界的横条纹的现象。图8是绿色子像素列做说明，但本发明并不受限于此。
综上所述，本发明所提供的液晶显示装置的驱动电路，利用二个闸极驱动电路共同驱动边界像素列的方式，降低显示屏亮度不均匀的现象，使观察者的眼睛不易分辨出显示屏上的亮暗边界。因此，本发明所提供的液晶显示装置的驱动电路可改善先前技术因为边界像素列是由不同的闸极驱动电路驱动，导致不同闸极驱动电路驱动的像素列之间产生明显边界的现象。
 以上所述仅为本发明的较佳实施例，凡依本发明申请专利范围所做的均等变化与修饰，皆应属本发明的涵盖范围。

Claims (4)

1.一种液晶显示装置的驱动电路，其特征在于，包含：
一像素数组，包含N个像素列，其中每一像素列包含M个并排的像素，其中N≧1，以及M≧1；
一第i个闸极驱动电路，具有复数个输出端，该第i个闸极驱动电路的最后一输出端是耦接于一第k像素列，其中N≧k≧1；及
一第i+1个闸极驱动电路，具有复数个输出端，该第i+1个闸极驱动电路的第一输出端是耦接于该第k像素列；
其中该第k像素列的M个并排的像素是由该第i个闸极驱动电路的最后一输出端与该第i+1个闸极驱动电路的第一输出端驱动，且该M个并排的像素中的相邻像素是分别由该第i个闸极驱动电路的最后一输出端与该第i+1个闸极驱动电路的第一输出端所驱动。
2.根据权利要求1所述的驱动电路，其特征在于：另包含一第i-1个闸极驱动电路，具有复数个输出端，该第i-1个闸极驱动电路的最后一输出端是耦接于一第j像素列，该第i个闸极驱动电路的第一输出端是耦接于该第j像素列，其中该第j像素列的M个并排的像素是由该第i-1个闸极驱动电路的最后一输出端与该第i个闸极驱动电路的第一输出端驱动，且该M个并排的像素中的相邻像素是分别由该第i-1个闸极驱动电路的最后一输出端与该第i个闸极驱动电路的第一输出端所驱动，其中k＞j。
3. 根据权利要求1所述的驱动电路，其特征在于：其中该第i个闸极驱动电路的所有输出端是由一显示屏的上方至下方依次驱动该N个像素列。
4. 根据权利要求1所述的驱动电路，其特征在于：其中该第i个闸极驱动电路的该所有输出端是由该显示屏的下方至上方依次驱动该N个像素列。
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