ATE334479T1 - VERFAHREN ZUR HERSTELLUNG INTEGRIERTER SCHALTUNGEN MIT VERBESSERTEN LEITERBAHNEN IN SOGENANNTER ßSÄGEBÜGELß-FORM - Google Patents

VERFAHREN ZUR HERSTELLUNG INTEGRIERTER SCHALTUNGEN MIT VERBESSERTEN LEITERBAHNEN IN SOGENANNTER ßSÄGEBÜGELß-FORM

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ATE334479T1
ATE334479T1 AT01954011T AT01954011T ATE334479T1 AT E334479 T1 ATE334479 T1 AT E334479T1 AT 01954011 T AT01954011 T AT 01954011T AT 01954011 T AT01954011 T AT 01954011T AT E334479 T1 ATE334479 T1 AT E334479T1
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AT
Austria
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integrated circuit
ßsaw
called
integrated circuits
conductor tracks
Prior art date
Application number
AT01954011T
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English (en)
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Ewald Bergler
Josef Preishuber-Pfluegl
Reinhard Fetzer
Klepzig Haiko
Original Assignee
Koninkl Philips Electronics Nv
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    • H01L22/00—Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
    • H01L22/30—Structural arrangements specially adapted for testing or measuring during manufacture or treatment, or specially adapted for reliability measurements
    • H01L22/32—Additional lead-in metallisation on a device or substrate, e.g. additional pads or pad portions, lines in the scribe line, sacrificed conductors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
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