WO2021246280A1 - SiC半導体素子の製造方法及びSiC半導体素子 - Google Patents

SiC半導体素子の製造方法及びSiC半導体素子 Download PDF

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恒暢 木本
拓真 小林
馨大 立木
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国立大学法人京都大学
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Definitions

  • the present invention relates to a method for manufacturing a SiC (silicon carbide) semiconductor element and a SiC semiconductor element.
  • SiC MOSFET MOS transistor
  • SiO 2 film gate oxide film
  • Patent Document 1 states that instead of directly forming a SiO 2 film on the surface of a SiC substrate by thermal oxidation, a Si thin film is deposited on the surface of the SiC substrate, and then the Si thin film is formed. A method of oxidizing to form a SiO 2 film is disclosed.
  • Non-Patent Document 1 a SiO 2 film is formed on the surface of a SiC substrate by thermal oxidation, and then heat treatment is performed in a NO (nitrogen monoxide) gas atmosphere.
  • NO nitrogen monoxide
  • the interface defect density at the interface between the SiO 2 film and the SiC substrate can be significantly reduced by the method disclosed in the above prior art document, the interface defect density is still high, which greatly limits the characteristics of the SiC MOSFET.
  • the method of nitriding the interface between the SiO 2 film and the SiC substrate by NO heat treatment promotes not only interfacial nitriding but also oxidation, so that it becomes a competitive process of "nitriding" and "oxidation", and optimization is difficult.
  • NO gas is extremely toxic and is not suitable for use in mass production.
  • the present invention has been made in view of this point, and a main object thereof is to provide a method for manufacturing a SiC semiconductor element capable of significantly reducing the defect density at the interface between the SiO 2 film and the SiC substrate.
  • the method for manufacturing a SiC semiconductor element according to the present invention is a step of etching the surface of a SiC substrate with H 2 gas at a temperature of 1200 ° C. or higher, and a SiO 2 under the condition that the SiC substrate is not oxidized on the SiC substrate. It includes a step of forming a film and a step of heat-treating the SiC substrate on which the SiO 2 film is formed at a temperature of 1350 ° C. or higher in an N 2 gas atmosphere.
  • (A) to (D) are views showing the manufacturing method of the SiC semiconductor element in one embodiment of the present invention. It is a graph which showed the defect density at the interface between a SiO 2 film and a SiC substrate. It is a graph which showed the kind of the defect existing on the SiC substrate side. It is a graph which showed the kind of the defect existing on the SiC substrate side. It is a graph which showed the CV characteristic of the SiO 2 film / SiC substrate. It is a graph which showed the IV characteristic of the SiO 2 film. It is a graph which showed the nitrogen atom density in the vicinity of the interface between a SiO 2 film and a SiC substrate. It is a graph showing the H 2 gas etching temperature dependence of interface defect density.
  • FIGS. (A) to (C) are views showing a method for manufacturing a SiC semiconductor device according to another embodiment of the present invention. It is a graph showing the H 2 gas etching temperature dependence of interface defect density. It is a graph illustrating the N 2 gas annealing temperature dependence of the interface defect density. It is a graph which showed the nitrogen atom density in the vicinity of the SiO 2 / SiC interface. It is a graph which showed the effect of high temperature H 2 etching under the Si excess atmosphere.
  • the oxidation formed on the surface of the SiC substrate is usually performed after sacrificial oxidation of the surface of the SiC substrate before starting the manufacturing process of the semiconductor element or during the manufacturing process.
  • a step of removing the film with a chemical solution such as hydrofluoric acid is carried out.
  • Non-Patent Document 2 There is also a report of theoretical calculation that when a SiC crystal is oxidized, an interface defect due to an excess of C atoms is generated at the interface between the oxide film and SiC. As described above, it is considered that if the SiC crystal is oxidized even a little, a large amount of interfacial defects and point defects on the SiC side are inevitably generated.
  • the present inventors have found that in order to validate it, as pretreatment before forming the SiO 2 film on the surface of the SiC substrate after the sacrificial oxidation, a surface of the SiC substrate obtained by removing the oxide film, a high temperature H 2 gas Considered etching.
  • a surface of the SiC substrate obtained by removing the oxide film, a high temperature H 2 gas Considered etching.
  • NO heat treatment in order to prevent the formation of an oxide film at the interface between the SiO 2 film and the SiC substrate by NO heat treatment, it was examined to perform the interfacial nitriding treatment by N 2 heat treatment.
  • the surface of the SiC substrate 1 was etched with hot H 2 gas. Etching of H 2 gas was performed under the conditions of H 2 flow rate: 1000 sccm, temperature: 1300 ° C., pressure: 0.1 MPa, and time: 3 minutes.
  • SiC substrate 1 As the SiC substrate 1, a SiC substrate 1 having a SiC epitaxial layer (not shown) formed on the SiC substrate 1 was used.
  • SiC substrate 1 an n-type 4H-SiC (0001) substrate was used, and the donor concentration of the SiC epitaxial growth layer was set to 5 ⁇ 10 15 cm -3 . Further, before the pretreatment step, the surface of the SiC epitaxial layer was sacrificed and oxidized, and then the oxide film was removed.
  • the Si thin film 2 was deposited on the SiC substrate 1 by the CVD method.
  • the Si thin film 2 was deposited under the conditions of SiH 4 flow rate: 50 sccm, H 2 flow rate: 50 sccm, temperature: 630 ° C., pressure: 173 Pa, and time: 90 seconds.
  • SiH 4 flow rate 50 sccm
  • H 2 flow rate 50 sccm
  • pressure: 173 Pa pressure
  • time 90 seconds.
  • a Si thin film 2 having a thickness of about 18 nm was formed on the SiC substrate 1.
  • the Si thin film 2 was thermally oxidized to form the SiO 2 film 3.
  • the Si thin film 2 was thermally oxidized under the conditions of O 2 flow rate: 2000 sccm, temperature: 750 ° C., and time: 24 hours. It should be noted that this condition is preferably a temperature range of 750 to 850 ° C. under the condition that the SiC substrate 1 is not oxidized. If the temperature exceeds 850 ° C., the SiC substrate 1 may be oxidized, which is not preferable.
  • the SiC substrate 1 on which the SiO 2 film 3 was formed was heat-treated in an N 2 gas atmosphere.
  • the conditions of the heat treatment were N 2 flow rate: 500 sccm, temperature: 1600 ° C., pressure: 1 atm, time: 1 minute.
  • a MOS capacitor is prepared for the SiO 2 film 3 formed by the methods shown in FIGS. 1 (A) to 1 (D), and the interface between the SiO 2 film 3 and the SiC substrate 1 is used by the High-Low CV method. The defect density in was determined.
  • Figure 2 is a graph showing the results, the horizontal axis is the energy (E T) from the conduction band edge (E C), the vertical axis represents the surface defect density.
  • E T energy
  • E C conduction band edge
  • FIG. 2 shows the case where the heat treatment with NO gas was performed as the interfacial nitriding treatment.
  • interface defect density As shown in FIG. 2, the sample (graph A) subjected to the H 2 gas etching as pretreatment, a wide energy range, interface defect level density (hereinafter, simply referred to as "interface defect density”) is, 3 ⁇ 10 At 10 cm -2 eV -1 or less, the interface defect density was significantly reduced as compared with the sample (graph B) which was not subjected to H 2 gas etching as a pretreatment.
  • the interface defect density was 3 ⁇ 10 10 cm -2 eV -1 or less. Since this energy region is close to the Fermi level when the n-channel MOSFET is on (energized), the low defect density in this energy range means that the channel resistance in the SiC MOSFET can be significantly reduced.
  • a MOS capacitor was prepared for the SiO 2 film 3 formed by the methods shown in FIGS. 1 (A) to 1 (D), and defects on the SiC substrate side were analyzed. Specifically, the DLTS (Deep Level Transient Spectroscopy) method was used to analyze the types of defects existing on the SiC substrate side.
  • DLTS Deep Level Transient Spectroscopy
  • FIG. 3 is a graph showing the results, where the horizontal axis shows the temperature and the vertical axis shows the DLTS signal.
  • the graph shown in C shows a case where etching with high temperature H 2 gas is performed as a pretreatment and heat treatment with N 2 gas is performed as an interfacial nitriding treatment.
  • a graph indicated by D is not subjected to etching with hot H 2 gas as a pretreatment, showing the case where heat-treated according to NO gas as the surface nitriding.
  • the sample subjected to the interfacial nitriding treatment with NO gas has been described, but after etching with the high temperature H 2 gas, the Si thin film 2 is deposited and the SiO 2 film 3 is oxidized by high temperature (950 ° C.). after forming the, in samples subjected to nitriding treatment by N 2 gas at high temperature (1600 ° C.), similar DLTS peaks N1, N2, N3 was observed. This means that the surface of the SiC substrate 1 is oxidized during the oxidation treatment at 950 ° C.
  • the sample used for verification was prepared using an n-type SiC substrate, but was prepared by the same method as shown in FIGS. 1 (A) to 1 (D) using a p-type SiC substrate.
  • the DLTS method was used to analyze the types of defects existing on the SiC substrate side.
  • FIG. 4 is a graph showing the results, and the graph shown by C shows a case where H 2 gas etching is performed as a pretreatment and heat treatment with N 2 gas is performed as an interfacial nitriding treatment. Further, the graph shown by D shows a case where H 2 gas etching is not performed as a pretreatment and heat treatment with NO gas is performed as an interfacial nitriding treatment.
  • Table 1 shows the energy positions and defect densities of the types of defects OX-N1, OX-N2, OX-N3, and OX-P1 indicated by arrows N1 to N3 and P1.
  • Ec is the energy level at the end of the conduction band
  • Ev is the energy level at the end of the valence band.
  • the energy position was obtained by the temperature dependence analysis of the time constant of carrier emission obtained by DLTS measurement.
  • the defect density was determined from the peak intensity seen in the DLTS measurement.
  • the point defects existing on the SiC substrate side are 1.0 eV lower than the conduction band edge for the following reasons.
  • the point defect density in energy is estimated to be 5 ⁇ 10 11 cm -3 or less.
  • the point defect density at energy 0.7 eV higher than the valence band edge is estimated to be 5 ⁇ 10 11 cm -3 or less.
  • the DLTS peak corresponding to these point defects is not observed in the sample subjected to the H 2 heat treatment as the pretreatment and the heat treatment with the N 2 gas as the interfacial nitriding treatment.
  • the DLTS peak was simulated by numerical calculation using the properties of defects observed in other samples, if the point defect density was at least 5 ⁇ 10 11 cm -3 , it was observed as a significant DLTS peak under these measurement conditions. Turned out to be. Therefore, the density of point defects present on the SiC substrate side in the unoxidized sample is estimated to be 5 ⁇ 10 11 cm -3 or less.
  • a MOS capacitor is prepared for the SiO 2 film 3 formed by the methods shown in FIGS. 1 (A) to 1 (D), and the characteristic shift due to voltage stress is evaluated. did. Specifically, after applying a voltage of 10V to the MOS capacitor for 300 seconds, the bias is swept from the positive voltage to the negative voltage, then a voltage of -10V is applied for 300 seconds, and then the bias is applied from the negative voltage to the positive voltage. Was swept and the shift of CV characteristics was measured.
  • FIG. 5 is a graph showing the results, where the horizontal axis shows the voltage and the vertical axis shows the capacitance. As shown in FIG. 5, no shift in CV characteristics was observed even when a high electric field (3.3 MV / cm) was applied to the SiO 2 film. This result suggests that there are very few traps in the SiO 2 membrane.
  • FIG. 6 is a graph showing the results, in which the horizontal axis shows the electric field (V / tox ; tox is the film thickness of the SiO 2 film 3), and the vertical axis shows the current density.
  • the SiO 2 film 3 was dielectrically broken down by an electric field of 10 MVcm-1 and showed good insulation characteristics.
  • Fowler-Nordheim tunnel current was observed in the range of 6-9 MVcm-1. This suggests that there are few defects in the SiO 2 film.
  • FIG. 7 is a graph showing the results.
  • the horizontal axis indicates the position in the film thickness direction, zero is the interface between the SiO 2 film 3 and the SiC substrate 1, the plus side is the position in the SiC substrate, and the minus side is the SiO 2. Indicates the position in the membrane.
  • the vertical axis indicates the nitrogen atom density.
  • nitrogen atoms having a density of about 2 ⁇ 10 21 cm -3 were present at the interface between the SiO 2 film 3 and the SiC substrate 1. Further, nitrogen atoms having a density of about 1 ⁇ 10 21 cm -3 were also distributed in the SiO 2 film.
  • the surface of the SiC substrate 1 to remove the oxide film by etching with hot H 2 gas greatly reduces the defects remaining in the vicinity of the surface of the SiC substrate 1 Can be done. Further, the surface of the SiC substrate 1, under a condition that does not oxidize the SiC substrate 1, after forming the SiO 2 film 3, the SiC substrate 1, by heat treatment in an N 2 gas atmosphere, the surface of the SiC substrate 1 oxide It can be prevented from being done. As a result, the defect density at the interface between the SiO 2 film and the SiC substrate is significantly reduced, and a SiO 2 film having high quality and stable characteristics can be obtained.
  • H 2 gas etching temperature dependence of interface defect density 8 the temperature for etching the surface of the SiC substrate 1 at a high temperature H 2 gas, 1100 ° C., 1200 ° C., at 1300 ° C., is a graph showing the results of the interface defect density was measured when performing each .. The measurement was performed using the High-Low CV method described above. The broken line of the graph shown in B in the drawing shows a case where no etching with hot H 2 gas.
  • the interface defect density is significantly reduced at a temperature of 1200 ° C. or higher.
  • the temperature of 1100 ° C. the effect of the etching of the H 2 gas was hardly observed. It is considered that this is because the SiC substrate was hardly etched at the temperature of 1100 ° C.
  • the melting point of Si is exceeded, so that it becomes difficult to maintain the chemical composition of the surface of the SiC substrate at a normal value. Therefore, in order to obtain the effect of reducing the interface defect density, etching of the H 2 gas is preferably carried out in a temperature range of 1200 °C ⁇ 1300 °C.
  • the interface defect density is significantly reduced at a temperature of 1350 ° C. or higher. Meanwhile, at temperatures below 1350 ° C., the effect of N 2 gas heat treatment it was hardly observed. It is considered that this is because nitrogen atoms having a sufficient density were not introduced into the interface between the SiO 2 film 3 and the SiC substrate 1 at a temperature lower than 1350 ° C. In the 1700 ° C. or higher temperatures, thermal decomposition of the SiO 2 film surface starts, it is difficult to maintain the film quality of the SiO 2 film. Therefore, in order to obtain the effect of reducing the interface defect density, it is preferable to perform the heat treatment (interface nitriding treatment) in the N 2 gas atmosphere in the temperature range of 1350 ° C to 1600 ° C.
  • FIG. 10 shows the results of measuring the nitrogen atom density at the SiO 2 / SiC interface when the heat treatment (interfacial nitriding treatment) was performed in an N 2 gas atmosphere at 1350 ° C. and 1600 ° C., respectively. It is a graph. The measurement was performed using the above-mentioned SIMS (secondary ion mass spectrometry).
  • the density is 2 ⁇ 10 19 cm -3 or higher in the interface between the SiC substrate and the SiO 2 film and in the SiO 2 film. Nitrogen atoms are present.
  • the manufacturing method of the SiC semiconductor device of the present embodiment the surface of the SiC substrate 1, at 1200 ° C. or higher, and etching with H 2 gas, on the SiC substrate 1, Si thin film
  • the defect density at the interface between the SiO 2 film 3 and the SiC substrate 1 can be significantly reduced, and the SiO 2 film 3 having high quality and stable characteristics can be obtained.
  • the SiO 2 film 3 is formed by depositing the Si thin film 2 on the SiC substrate 1 and then thermally oxidizing the Si thin film 2 at a temperature that does not oxidize the SiC substrate 1. As a result, the surface of the SiC substrate 1 is not oxidized. Further, by performing the interfacial nitriding treatment by heat treatment in a high temperature N 2 gas atmosphere after forming the SiO 2 film 3, the surface of the SiC substrate 1 can be maintained in a non-oxidized state.
  • the surface of the SiC substrate 1 was etched with hot H 2 gas, on the SiC substrate 1, under a condition that does not oxidize the SiC substrate 1, by forming the SiO 2 film 3, then, SiO 2 film 3 is formed the SiC substrate 1 which is, by heat treatment in hot N 2 gas atmosphere, it is possible to significantly reduce the defect density at the interface between the SiO 2 film 3 and the SiC substrate 1.
  • 11 (A) to 11 (C) are views showing another method of forming a SiO 2 film on a SiC substrate under the condition that the SiC substrate is not oxidized.
  • the surface of the SiC substrate 1 is etched in hot H 2 gas.
  • Etching of the H 2 gas can be performed under the conditions of, for example, H 2 flow rate: 1000 sccm, temperature: 1300 ° C., pressure: 0.1 MPa, and time: 3 minutes.
  • a SiC substrate 1 having a SiC epitaxial layer (not shown) formed on the SiC substrate 1 can be used. Further, it is preferable to remove the oxide film after sacrificing oxidation of the surface of the SiC epitaxial layer before the pretreatment step. For the reason described later , it is preferable that the etching of the H 2 gas is performed in a Si excess atmosphere. For example, SiH 4 gas having a flow rate of about 0.01 to 0.1 sccm may be added to the H 2 gas.
  • the SiO 2 film 4 is deposited on the SiC substrate 1 by the plasma CVD method.
  • the deposition of the SiO 2 film 4 is a SiC substrate 1 having a TEOS (tetraethoxysilane) flow rate: 0.3 sccm, O 2 flow rate: 450 sccm, temperature: 400 ° C., pressure: 43 Pa, high frequency power: 100 W, time: 30 minutes, etc. It should be done under the condition that is not oxidized.
  • TEOS tetraethoxysilane
  • the SiO 2 film 4 may be deposited by using a thermal CVD method.
  • the deposition of the SiO 2 film 4 is carried out by the SiC substrate 1 having a SiH 4 flow rate: 5 sccm, an N 2 O flow rate: 300 sccm, an N 2 flow rate: 3000 sccm, a temperature: 720 ° C., a pressure: 15 kPa, a time: 4 minutes, etc. It may be done under the condition that it is not oxidized.
  • the reaction gas contains O 2 gas and N 2 O gas
  • the surface of the SiC substrate 1 is slightly oxidized at the initial stage of the deposition. May occur.
  • an ultrathin Si layer of about 1 to 3 layers is formed on the surface of the SiC substrate 1. Since it is formed, the ultrathin Si layer is only oxidized, and the surface of the SiC substrate 1 is not oxidized.
  • the SiC substrate 1, the SiO 2 film 4 is formed, a heat treatment in an N 2 gas atmosphere.
  • Conditions of heat treatment eg, N 2 flow rate: 500 sccm, Temperature: 1600 ° C., pressure: 1 atm may be carried out under conditions such as time 1 minute.
  • FIG. 12 shows the H 2 gas etching temperature dependence of the interface defect density at the interface between the SiO 2 film 4 and the SiC substrate 1 when the SiO 2 film 4 is formed by the methods shown in FIGS. 11A to 11C. It is a graph showing sex. The measurement was performed using the High-Low CV method described above. The broken line of the graph shown in B in the drawing shows a case where no etching with hot H 2 gas (implementing the interface nitriding treatment with NO gas).
  • the interface defect density is significantly reduced at a temperature of 1200 ° C. or higher.
  • the temperature of 1100 ° C. the effect of the etching of the H 2 gas is hardly observed. It is considered that this is because the SiC substrate is hardly etched at the temperature of 1100 ° C.
  • the melting point of Si is exceeded, so that it becomes difficult to maintain the chemical composition of the surface of the SiC substrate at a normal value. Therefore, in order to obtain the effect of reducing the interface defect density, etching of the H 2 gas is preferably carried out in a temperature range of 1200 °C ⁇ 1300 °C.
  • the interface defect density is significantly reduced at a temperature of 1400 ° C. or higher.
  • the temperature of 1300 ° C. the effect of N 2 gas heat treatment was hardly observed. It is considered that this is because nitrogen atoms having a sufficient density were not introduced into the interface between the SiO 2 film 3 and the SiC substrate 1 at the temperature of 1300 ° C. In the 1700 ° C. or higher temperatures, thermal decomposition of the SiO 2 film surface starts, it is difficult to maintain the film quality of the SiO 2 film. Therefore, in order to obtain the effect of reducing the interface defect density, it is preferable to perform the heat treatment (interface nitriding treatment) in the N 2 gas atmosphere in the temperature range of 1350 ° C to 1600 ° C.
  • FIG. 14 is a graph showing the results of measuring the nitrogen atom density at the interface between the SiO 2 film 4 and the SiC substrate 1. The measurement was performed using the above-mentioned SIMS (secondary ion mass spectrometry). The horizontal axis indicates the position in the film thickness direction, zero indicates the interface between the SiO 2 film 4 and the SiC substrate 1, the plus side indicates the position in the SiC substrate, and the minus side indicates the position in the SiO 2 film. The vertical axis indicates the nitrogen atom density.
  • the graph shown by G in the figure shows a case where H 2 gas etching is performed at 1300 ° C.
  • the graph shown by H shows a case where H 2 gas etching is not performed as a pretreatment and heat treatment with NO gas is performed as an interfacial nitriding treatment.
  • FIG. 15 shows the difference in the defect density at the interface between the SiO 2 film 4 and the SiC substrate 1 between the case where the etching with the high temperature H 2 gas is performed in the Si excess atmosphere and the case where the etching is not performed in the Si excess atmosphere. It is a graph which showed the result of having measured. The graph shown by J shows the case where it was performed under the Si excess atmosphere, and the graph indicated by K shows the case where it was not performed under the Si excess atmosphere.
  • the etching with the high temperature H 2 gas was performed under the conditions of H 2 flow rate: 1000 sccm, temperature: 1300 ° C., pressure: 0.1 MPa, and time: 3 minutes.
  • H 2 flow rate 1000 sccm
  • pressure: 0.1 MPa 0.1 MPa
  • time: 3 minutes 3 minutes.
  • SiH 4 gas having a flow rate of 0.05 sccm was added.
  • the heat treatment in the N 2 gas atmosphere was performed under the conditions of N 2 flow rate: 500 sccm, temperature: 1450 ° C., pressure: 1 atm, and time of 1 minute.
  • the etching by hot H 2 gas when performed under Si-rich atmosphere (graph J), the interface defect density was significantly reduced in the 3 ⁇ 10 10 cm -2 eV -1 or less .
  • the interface defect density is sufficient even if the SiO 2 film is subsequently deposited under the conditions considered to be optimum and the high temperature N 2 treatment is applied. High quality interface was not obtained. It is considered that this is because the surface of the SiC substrate was oxidized at the initial stage of depositing the SiO 2 film because the ultrathin Si thin film was not formed on the surface of the SiC substrate.
  • the manufacturing method of the SiC semiconductor device of the present embodiment the surface of the SiC substrate 1, under Si-rich atmosphere, at 1200 ° C. or higher, and etching with H 2 gas, the SiC substrate on 1, comprising the steps of forming a SiO 2 film 4 by the CVD method, the SiC substrate 1, the SiO 2 film 4 is formed, at 1350 ° C. or higher, and a step of heat treatment in an N 2 gas atmosphere.
  • the defect density at the interface between the SiO 2 film 4 and the SiC substrate 1 can be significantly reduced, and the SiO 2 film 3 having high quality and stable characteristics can be obtained.
  • SiC semiconductor element A SiC semiconductor element (SiC MOSFET) can be configured by using the SiO 2 film formed by the manufacturing method of the present embodiment as a gate insulating film. In such a SiC semiconductor element, nitrogen atoms having a density of 2 ⁇ 10 19 cm -3 or more are present at the interface between the SiC substrate and the SiO 2 film and in the SiO 2 film.
  • the interface defect density between the SiC substrate and the SiO 2 film in the vicinity of energy 0.3 eV lower than the conduction band end is 3 ⁇ 10 10 cm -2 eV -1 or less.
  • the point defect density at an energy 1.0 eV lower than the conduction band end and the point defect density at an energy 0.7 eV higher than the valence band end are 5 ⁇ 10 11 cm, respectively. It is -3 or less.
  • the surface of the SiC substrate to form the SiC epitaxial layer, on the SiC epitaxial layer has formed the SiO 2 film may be directly formed an SiO 2 film on the SiC substrate.
  • a SiC substrate from which the oxide film has been removed after sacrificial oxidation of the surface is used, but the production method of the present invention can also be applied to a SiC substrate that has not been subjected to sacrificial oxidation.

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Abstract

SiC半導体素子の製造方法は、SiC基板1の表面を、1200℃以上の温度で、Hガスでエッチングするステップと、SiC基板上に、SiC基板を酸化させない条件で、SiO膜3、4を形成するステップと、SiO膜が形成されたSiC基板を、1350℃以上の温度で、Nガス雰囲気中で熱処理するステップとを含む。

Description

SiC半導体素子の製造方法及びSiC半導体素子
 本発明は、SiC(炭化珪素)半導体素子の製造方法、及びSiC半導体素子に関する。
 SiC基板を用いたMOS型トランジスタ(SiC MOSFET)において、SiC基板の表面に熱酸化でSiO膜(ゲート酸化膜)を形成した場合、SiO膜とSiC基板との界面における欠陥密度が非常に高いという問題がある。界面欠陥密度が高いと、SiC MOSFETのチャネル移動度等の特性が十分に得られない。
 界面欠陥密度を低減する方法として、特許文献1には、SiC基板の表面に直接、熱酸化によりSiO膜を形成する代わりに、SiC基板の表面にSi薄膜を堆積し、その後、Si薄膜を酸化してSiO膜を形成する方法が開示されている。
 また、界面欠陥密度を低減する他の方法として、非特許文献1には、SiC基板の表面に熱酸化によりSiO膜を形成した後、NO(一酸化窒素)ガス雰囲気中で熱処理を行い、SiO膜とSiC基板との界面を窒化する方法(界面窒化)が開示されている。
特開平11-067757号公報
G.Y. Chung et al., IEEE Electron Device Lett., vol.22, 176(2001) K. Kawahara et al., Appl. Phys. Express, vol. 6, 051301 (2013) F. Devynck et al., Phys. Rev. B, vol. 84, 235320 (2011) K. Kawahara et al., J. Appl. Phys. vol. 113, 033705 (2013)
 上記の先行技術文献に開示された方法によって、SiO膜とSiC基板との界面における欠陥密度は大幅に低減できるが、依然として界面欠陥密度が多く、SiC MOSFETの特性を大きく制限している。また、NO熱処理によりSiO膜とSiC基板との界面を窒化する方法は、界面窒化だけでなく、酸化も進行するため、「窒化」と「酸化」の競合過程となり、最適化が難しい。加えて、NOガスは、猛毒であるため、大量生産で使用するには不向きである。
 本発明は、かかる点に鑑みてなされたもので、その主な目的は、SiO膜とSiC基板との界面における欠陥密度を大幅に低減できるSiC半導体素子の製造方法を提供することにある。
 本発明に係るSiC半導体素子の製造方法は、SiC基板の表面を、1200℃以上の温度で、Hガスでエッチングするステップと、SiC基板上に、該SiC基板を酸化させない条件で、SiO膜を形成するステップと、SiO膜が形成されたSiC基板を、1350℃以上の温度で、Nガス雰囲気中で熱処理するステップとを含む。
 本発明によれば、SiO膜とSiC基板との界面における欠陥密度を大幅に低減できるSiC半導体素子の製造方法を提供することができる。
(A)~(D)は、本発明の一実施形態におけるSiC半導体素子の製造方法を示した図である。 SiO膜とSiC基板との界面における欠陥密度を示したグラフである。 SiC基板側に存在する欠陥の種類を示したグラフである。 SiC基板側に存在する欠陥の種類を示したグラフである。 SiO膜/SiC基板のC-V特性を示したグラフである。 SiO膜のI-V特性を示したグラフである。 SiO膜とSiC基板との界面近傍における窒素原子密度を示したグラフである。 界面欠陥密度のHガスエッチング温度依存性を示したグラフである。 界面欠陥密度のNガス熱処理温度依存性を示したグラフである。 SiO/SiC界面近傍における窒素原子密度を示したグラフである。 (A)~(C)は、本発明の他の実施形態におけるSiC半導体素子の製造方法を示した図である。 界面欠陥密度のHガスエッチング温度依存性を示したグラフである。 界面欠陥密度のNガス熱処理温度依存性を示したグラフである。 SiO/SiC界面近傍における窒素原子密度を示したグラフである。 Si過剰雰囲気下での高温Hエッチングの効果を示したグラフである。
 本発明の実施形態を説明する前に、本発明を想到するに至った経緯を説明する。
 SiC基板を用いて半導体素子を製造する際、半導体素子の製造工程を開始する前、あるいは製造工程の途中に、通常、SiC基板の表面を犠牲酸化した後、SiC基板の表面に形成された酸化膜をフッ酸などの薬液により除去する工程が実施される。これにより、意図せず表面に付着した不純物や、最表面近傍のSiC結晶のダメージ(化学組成のずれなど)を除去でき、半導体素子の特性の安定化や、歩留まり向上を図ることができる。
 確かに、犠牲酸化後に、酸化膜を除去することによって、SiC基板の表面に付着した不純物や、最表面近傍のSiC結晶のダメージ等を除去することには効果的であるが、SiC基板の表面に多くの欠陥が残存している可能性がある。実際、SiC結晶を酸化すると、SiCの表面近傍に高密度の点欠陥が生成することが知られている(非特許文献2)。また、SiC結晶を酸化すると、酸化膜とSiCの界面に過剰なC原子に起因する界面欠陥が生成されるという理論計算の報告もある(非特許文献3)。このように、SiC結晶を少しでも酸化すると、多量の界面欠陥とSiC側の点欠陥が生成することは避けられないと考えられる。
 本願発明者等は、それを検証するために、SiC基板の表面にSiO膜を形成する前の前処理として、犠牲酸化後に、酸化膜を除去したSiC基板の表面を、高温Hガスでエッチングすることを検討した。加えて、NO熱処理による界面窒化処理で、SiO膜とSiC基板との界面に酸化膜ができるのを防止するために、界面窒化処理をN熱処理で行うことを検討した。
 (検証試料の作製)
 高温Hガスエッチングの前処理効果、及びN熱処理による界面窒化処理の効果を検証するために、図1(A)~(D)に示した方法により、SiC基板の表面にSiO膜を形成した試料を作製した。
 図1(A)に示すように、前処理工程として、SiC基板1の表面を、高温Hガスでエッチングした。Hガスのエッチングは、H流量:1000sccm、温度:1300℃、圧力:0.1MPa、時間:3分の条件で行った。
 なお、SiC基板1としては、SiC基板1上にSiCエピタキシャル層(不図示)を形成したものを用いた。ここで、SiC基板1は、n型4H-SiC(0001)基板を用い、SiCエピタキシャル成長層のドナー濃度を5×1015cm-3とした。また、前処理工程の前に、SiCエピタキシャル層の表面を犠牲酸化した後、酸化膜を除去した。
 次に、図1(B)に示すように、SiC基板1上に、Si薄膜2をCVD法により堆積した。Si薄膜2の堆積は、SiH流量:50sccm、H流量:50sccm、温度:630℃、圧力:173Pa、時間:90秒の条件で行った。これにより、SiC基板1上に、厚さ約18nmのSi薄膜2を形成した。
 次に、図1(C)に示すように、Si薄膜2を熱酸化してSiO膜3を形成した。Si薄膜2を熱酸化は、O流量:2000sccm、温度:750℃、時間:24時間 の条件で行った。なお、この条件は、SiC基板1が酸化されない条件で、750~850℃の温度範囲が好ましい。850℃を超えるとSiC基板1が酸化されるおそれがあり好ましくない。
 次に、図1(D)に示すように、SiO膜3が形成されたSiC基板1を、Nガス雰囲気中で熱処理した。熱処理の条件は、N流量:500sccm、温度:1600℃、圧力:1気圧、時間:1分で行った。
 なお、比較のために、図1(A)に示した高温Hガスのエッチングによる前処理を行わず、図1(D)に示した界面窒化処理を、NOガスによる熱処理で行って、SiC基板上にSiO膜を形成した試料を作製した。
 (界面欠陥密度の解析)
 図1(A)~(D)に示した方法で形成したSiO膜3に対して、MOSキャパシタを作製し、High-Low CV法を用いて、SiO膜3とSiC基板1との界面における欠陥密度を求めた。
 図2は、その結果を示したグラフで、横軸は、伝導帯端(E)からのエネルギー(E)で、縦軸は界面欠陥密度を示す。Aで示したグラフが、前処理として高温Hガスによるエッチングを施し、界面窒化処理としてNガスによる熱処理を施した場合、Bで示したグラフが、前処理として高温Hガスによるエッチングを施さず、界面窒化処理としてNOガスによる熱処理を施した場合を示す。
 図2に示すように、前処理としてHガスエッチングを施した試料(グラフA)は、広いエネルギー範囲で、界面欠陥準位密度(以下、単に「界面欠陥密度」という)が、3×1010cm-2eV-1以下で、前処理としてHガスエッチングを施さなかった試料(グラフB)に比べて、界面欠陥密度が大幅に低減されていた。
 特に、伝導帯端(E)より0.3eV低いエネルギー近傍において、界面欠陥密度は、3×1010cm-2eV-1以下であった。このエネルギー領域は、nチャネルMOSFETのオン(通電)時におけるフェルミ準位に近いため、このエネルギー範囲の欠陥密度が低いことは、SiC MOSFETにおけるチャネル抵抗を大幅に低減することができることを意味する。
 このような解析結果から、表面を犠牲酸化した後に、酸化膜を除去したSiC基板1の表面には、多くの欠陥が残存しており、この欠陥を効率よく除去するために、高温Hガスを用いて、SiC基板1の表面をエッチングすることが効果的であることが判明した。
 (SiC基板側の欠陥解析)
 図1(A)~(D)に示した方法で形成したSiO膜3に対して、MOSキャパシタを作製し、SiC基板側の欠陥を解析した。具体的には、DLTS(Deep Level Transient Spectroscopy)法を用いて、SiC基板側に存在する欠陥の種類を解析した。
 図3は、その結果を示したグラフで、横軸は温度、縦軸はDLTS信号を示す。ここで、Cで示したグラフは、前処理として高温Hガスによるエッチングを施し、界面窒化処理としてNガスによる熱処理を施した場合を示す。また、Dで示したグラフは、前処理として高温Hガスによるエッチングを施さず、界面窒化処理としてNOガスによる熱処理を施した場合を示す。
 図3に示すように、Nガスによる熱処理を施した試料(グラフC)では、矢印Zで示したピークのみが観察された。一方、NOガスによる熱処理を施した試料(グラフD)では、矢印Zで示したピークの他に、矢印N1、N2、N3で示した3つのピークが観察された。ここで、矢印Zで示したピークは、SiCの結晶成長時に導入されたSiC基板1に内在する結晶欠陥(炭素空孔)によるものであることが知られている。一方、矢印N1、N2、N3で示したピークは、SiC基板1の熱酸化によりSiC表面近傍に発生する欠陥と一致する(非特許文献2)。
 このような結果から、界面窒化処理を、NOガスによる熱処理で行った場合、界面窒化処理中に、SiC基板1の表面がわずかに酸化されることが判明した。一方、界面窒化処理を、Nガスによる熱処理で行った場合、SiC基板1の表面が酸化されないことが判明した。
 また、このような結果は、たとえ高温HガスエッチングによりSiC表面を清浄化、高品質化しても、この後の工程でわずかでもSiCを酸化させると、十分低い界面欠陥密度を得ることができないことを示唆している。
 例えば、上記では、NOガスによる界面窒化処理を施した試料について述べたが、高温Hガスによるエッチングを施した後、Si薄膜2を堆積し、高温(950℃)の酸化によりSiO膜3を形成した後に、高温(1600℃)でNガスによる窒化処理を施した試料でも、同様のDLTSピークN1、N2、N3が観測された。これは、950℃の酸化処理の際、SiC基板1の表面が酸化されていることを意味する。
 すなわち、高温Hガスエッチングを施してSiC基板表面近傍の欠陥を除去したとしても、Si薄膜2を酸化してSiO膜3を形成する際、高温(950℃)で酸化を行うと、SiC基板1の表面もわずかに酸化されるため、この後に、高温(1600℃)でNガスによる窒化処理を施しても、十分に低い界面欠陥密度を得ることができない。
 なお、検証に用いた試料は、n型SiC基板を用いて作製したものであるが、p型SiC基板を用いて、図1(A)~(D)に示した方法と同じ方法で作製した試料についても、DLTS法を用いて、SiC基板側に存在する欠陥の種類を解析した。
 図4は、その結果を示したグラフで、Cで示したグラフは、前処理としてHガスエッチングを施し、界面窒化処理としてNガスによる熱処理を施した場合を示す。また、Dで示したグラフは、前処理としてHガスエッチングを施さず、界面窒化処理としてNOガスによる熱処理を施した場合を示す。
 図4に示すように、Nガスによる熱処理を施した試料(グラフC)では、SiC結晶中の点欠陥に起因するピークは観察されなかったが、NOガスによる熱処理を施した試料(グラフD)では、矢印P1で示したピークが観察された。ここで、P1で示したピークは、SiC基板1の熱酸化によりSiC表面近傍に発生する欠陥によるものであることが知られている(非特許文献4)。
 このような結果から、p型SiC基板を用いた場合でも、界面窒化処理を、NOガスによる熱処理で行った場合、SiC基板1の表面が酸化されるが、Nガスによる熱処理で行った場合、SiC基板1の表面が酸化されないことが分かる。
 表1は、矢印N1~N3、P1で示した欠陥の種類OX-N1、OX-N2、OX-N3、OX-P1のエネルギー位置、及び欠陥密度を示したものである。ここで、Ecは伝導帯端のエネルギー準位、Evは価電子帯端のエネルギー準位である。なお、エネルギー位置は、DLTS測定で求まるキャリア放出の時定数の温度依存性の解析により求めた。また、欠陥密度は、DLTS測定で見られるピーク強度から求めた。
Figure JPOXMLDOC01-appb-T000001
 
 表1から、前処理としてH熱処理を施し、界面窒化処理としてNガスによる熱処理を施した場合、SiC基板側に存在する点欠陥は、下記の理由により、伝導帯端より1.0eV低いエネルギーにおける点欠陥密度が、5×1011cm-3以下と推定される。また、価電子帯端より0.7eV高いエネルギーにおける点欠陥密度が、5×1011cm-3以下と推定される。
 すなわち、図3、図4に示すように、前処理としてH熱処理を施し、界面窒化処理としてNガスによる熱処理を施した試料では、これらの点欠陥に相当するDLTSピークが観測されない。他の試料で観測された欠陥の性質を用いて数値計算によりDLTSピークをシミュレーションしたところ、点欠陥密度が少なくとも5×1011cm-3以上であれば、この測定条件で有意なDLTSピークとして観測されることが判明した。したがって、酸化されていない試料におけるSiC基板側に存在する点欠陥密度は5×1011cm-3以下と推定される。
 (SiO膜の特性評価)
 図1(A)~(D)に示した方法で形成したSiO膜3について、高温Hガスによるエッチング効果、及びN熱処理による界面窒化処理の効果を確認するために、以下に示す方法により、SiO膜の特性等を評価した。
 (A)電圧ストレスによるC-V特性シフトの評価
 図1(A)~(D)に示した方法で形成したSiO膜3に対して、MOSキャパシタを作製し、電圧ストレスによる特性シフトを評価した。具体的には、MOSキャパシタに10Vの電圧を300秒印加した後、正電圧から負電圧にバイアスを掃引し、次に、―10Vの電圧を300秒印加した後、負電圧から正電圧にバイアスを掃引してC-V特性のシフトを測定した。
 図5は、その結果を示したグラフで、横軸は電圧、縦軸は容量を示す。図5に示すように、SiO膜に高電界(3.3MV/cm)を印加しても、C―V特性のシフトは全く観察されなかった。この結果は、SiO膜中のトラップが非常に少ないことを示唆する。
 (B)SiO膜の絶縁特性評価
 図1(A)~(D)に示した方法で形成したSiO膜3に対して、MOSキャパシタを作製し、SiO膜3の絶縁特性を評価した。具体的には、MOSキャパシタに正電圧を印加し、I-V特性を測定した。
 図6は、その結果を示したグラフで、横軸は電界(V/tox;toxはSiO膜3の膜厚)、縦軸は電流密度を示す。図6に示すように、SiO膜3は、10MVcm-1の電界で絶縁破壊され、良好な絶縁特性を示した。また、6~9MVcm-1の範囲で、Fowler-Nordheimトンネル電流が観察された。これは、SiO膜中の欠陥が少ないことを示唆する。
 (C)SiO/SiC界面の窒素原子密度
 Nガスによる界面窒化処理の効果を検証するために、SIMS(二次イオン質量分析法)を用いて、SiO膜3とSiC基板1との界面における窒素原子密度を測定した。
 図7は、その結果を示したグラフで、横軸は、膜厚方向の位置を示し、ゼロがSiO膜3とSiC基板1との界面、プラス側がSiC基板内の位置、マイナス側がSiO膜内の位置を示す。また、縦軸は、窒素原子密度を示す。
 図7に示すように、SiO膜3とSiC基板1との界面に、密度が約2×1021cm-3の窒素原子が存在していた。さらに、SiO膜中にも、約1×1021cm-3の密度の窒素原子が分布していた。
 このような結果から、Nガスによる熱処理によって、SiO膜とSiC基板との界面、及びSiO膜中に、十分な密度の窒素原子が導入されていることが分かる。これにより、SiO膜とSiC基板との界面における欠陥密度が十分に低減されていると考えられる。
 以上の結果から、表面を犠牲酸化した後に、酸化膜を除去したSiC基板1の表面を、高温Hガスでエッチングすることによって、SiC基板1の表面近傍に残存した欠陥を大幅に低減することができる。また、SiC基板1の表面に、SiC基板1を酸化させない条件で、SiO膜3を形成した後、SiC基板1を、Nガス雰囲気中で熱処理することによって、SiC基板1の表面が酸化されるのを防止することができる。これにより、SiO膜とSiC基板との界面における欠陥密度が大幅に低減され、高品質で、安定した特性を有するSiO膜を得ることができる。
 (界面欠陥密度のHガスエッチング温度依存性)
 図8は、SiC基板1の表面を高温Hガスでエッチングする際の温度を、1100℃、1200℃、1300℃で、それぞれ行ったときの界面欠陥密度を測定した結果を示したグラフである。なお、測定は、上述したHigh-Low CV法を用いて行った。また、図中のBで示した破線のグラフは、高温Hガスでエッチングしなかった場合を示す。
 図8に示すように、1200℃以上の温度で、界面欠陥密度が大幅に低減されることが分かる。一方、1100℃の温度では、Hガスのエッチングによる効果はほとんど見られなかった。これは、1100℃の温度では、SiC基板がほとんどエッチングされなかったためと考えられる。なお、1400℃以上の温度では、Siの融点を超えるため、SiC基板表面の化学組成を正常値に維持することが困難になる。従って、界面欠陥密度の低減効果を得るためには、Hガスのエッチングは、1200℃~1300℃の温度範囲で行うことが好ましい。
 (界面欠陥密度のNガス熱処理温度依存性)
 図9は、SiC基板1の表面にSiO膜3を形成した後、SiC基板1を、Nガス雰囲気中で熱処理(界面窒化処理)する際の温度を、1350℃、1400℃、1600℃で、それぞれ行ったときの界面欠陥密度を測定した結果を示したグラフである。なお、測定は、上述したHigh-Low CV法を用いて行った。また、図中のBで示した破線のグラフは、高温Hガスでエッチングしなかった場合(界面窒化処理をNOガスで実施)を示す。
 図9に示すように、1350℃以上の温度で、界面欠陥密度が大幅に低減されることが分かる。一方、1350℃より低い温度では、Nガス熱処理による効果はほとんど見られなかった。これは、1350℃より低い温度では、SiO膜3とSiC基板1との界面に、十分な密度の窒素原子が導入されなかったためと考えられる。なお、1700℃以上の温度では、SiO膜表面の熱分解が始まるため、SiO膜の膜質を維持することが困難になる。従って、界面欠陥密度の低減効果を得るためには、Nガス雰囲気中での熱処理(界面窒化処理)は、1350℃~1600℃の温度範囲で行うことが好ましい。
 図10は、Nガス雰囲気中で熱処理(界面窒化処理)する際の温度を、1350℃、1600℃で、それぞれ行ったときのSiO/SiC界面における窒素原子密度を測定した結果を示したグラフである。なお、測定は、上述したSIMS(二次イオン質量分析法)を用いて行った。
 図10に示すように、界面窒化処理を1350℃以上の温度で行った場合、SiC基板とSiO膜との界面、及び、SiO膜中に、密度が2×1019cm-3以上の窒素原子が存在している。
 以上、説明したように、本実施形態におけるSiC半導体素子の製造方法は、SiC基板1の表面を、1200℃以上の温度で、Hガスでエッチングするステップと、SiC基板1上に、Si薄膜2をCVD法により堆積するステップと、Si薄膜2を、SiC基板1を酸化させない温度で熱酸化してSiO膜3を形成すステップと、SiO膜3が形成されたSiC基板1を、1350℃以上の温度で、Nガス雰囲気中で熱処理するステップとを含む。これにより、SiO膜3とSiC基板1との界面における欠陥密度を大幅に低減することができ、高品質で、安定した特性を有するSiO膜3を得ることができる。
 (他の実施形態)
 上記の実施形態において、SiO膜3は、SiC基板1上にSi薄膜2を堆積した後、Si薄膜2を、SiC基板1を酸化させない温度で熱酸化することにより形成した。これにより、SiC基板1の表面は酸化されない。また、SiO膜3を形成した後、界面窒化処理を、高温のNガス雰囲気中での熱処理により行うことによって、SiC基板1の表面が酸化されていない状態を維持することができる。
 すなわち、SiC基板1の表面を、高温Hガスでエッチングした後、SiC基板1上に、SiC基板1を酸化させない条件で、SiO膜3を形成すれば、その後、SiO膜3が形成されたSiC基板1を、高温のNガス雰囲気中で熱処理することによって、SiO膜3とSiC基板1との界面における欠陥密度を大幅に低減することができる。
 図11(A)~(C)は、SiC基板上に、SiC基板を酸化させない条件で、SiO膜を形成する他の方法を示した図である。
 図11(A)に示すように、前処理工程として、SiC基板1の表面を、高温Hガスでエッチングする。Hガスのエッチングは、例えば、H流量:1000sccm、温度:1300℃、圧力:0.1MPa、時間:3分の条件で行うことができる。
 なお、SiC基板1としては、SiC基板1上にSiCエピタキシャル層(不図示)を形成したものを用いることができる。また、前処理工程の前に、SiCエピタキシャル層の表面を犠牲酸化した後、酸化膜を除去することが好ましい。なお、後述する理由により、Hガスのエッチングは、Si過剰雰囲気下において行うことが好ましい。例えば、Hガスに、0.01~0.1sccm程度の流量のSiHガスを添加すればよい。
 次に、図11(B)に示すように、SiC基板1上に、プラズマCVD法によりSiO膜4を堆積する。SiO膜4の堆積は、TEOS(テトラエトキシシラン)流量: 0.3sccm、O流量:450sccm、温度:400 ℃、圧力:43Pa、高周波電力:100W、時間:30分等の、SiC基板1が酸化されない条件で行えばよい。
 なお、SiO膜4の堆積は、熱CVD法を用いて行ってもよい。この場合、SiO膜4の堆積は、SiH流量:5sccm、NO流量:300sccm、N流量:3000sccm、温度:720 ℃、圧力:15kPa、時間:4分等の、SiC基板1が酸化されない条件で行えばよい。
 ところで、このような条件でSiO膜4を堆積した場合でも、反応ガスにOガスやNOガスが含まれているため、堆積の初期に、SiC基板1の表面がわずかに酸化される場合がある。しかしながら、このような場合でも、図11(A)に示したHガスのエッチングを、Si過剰雰囲気下において行うことによって、SiC基板1の表面に、1~3層程度の極薄Si層が形成されているため、この極薄Si層が酸化されるに止まり、SiC基板1の表面は酸化されない。
 次に、図11(C)に示すように、SiO膜4が形成されたSiC基板1を、Nガス雰囲気中で熱処理する。熱処理の条件は、例えば、N流量:500sccm、温度:1600℃、圧力:1気圧、時間1分等の条件で行えばよい。
 (界面欠陥密度のHガスエッチング温度依存性)
 図12は、図11(A)~(C)に示した方法でSiO膜4を形成したときの、SiO膜4とSiC基板1との界面における界面欠陥密度のHガスエッチング温度依存性を示したグラフである。なお、測定は、上述したHigh-Low CV法を用いて行った。また、図中のBで示した破線のグラフは、高温Hガスでエッチングしなかった場合(界面窒化処理をNOガスで実施)を示す。
 図12に示すように、1200℃以上の温度で、界面欠陥密度が大幅に低減されることが分かる。一方、1100℃の温度では、Hガスのエッチングによる効果はほとんど見られない。これは、1100℃の温度では、SiC基板がほとんどエッチングされないためと考えられる。なお、1400℃以上の温度では、Siの融点を超えるため、SiC基板表面の化学組成を正常値に維持することが困難になる。従って、界面欠陥密度の低減効果を得るためには、Hガスのエッチングは、1200℃~1300℃の温度範囲で行うことが好ましい。
 (界面欠陥密度のNガス熱処理温度依存性)
 図13は、SiC基板1の表面にSiO膜4を形成した後、SiC基板1を、Nガス雰囲気中で熱処理(界面窒化処理)する際の温度を、1300℃、1400℃、1450℃、1600℃で、それぞれ行ったときの界面欠陥密度を測定した結果を示したグラフである。なお、測定は、上述したHigh-Low CV法を用いて行った。また、図中のBで示した破線のグラフは、高温Hガスでエッチングを施さなかった場合(界面窒化処理をNOガスで実施)を示す。
 図13に示すように、1400℃以上の温度で、界面欠陥密度が大幅に低減されることが分かる。一方、1300℃の温度では、Nガス熱処理による効果はほとんど見られなかった。これは、1300℃の温度では、SiO膜3とSiC基板1との界面に、十分な密度の窒素原子が導入されなかったためと考えられる。なお、1700℃以上の温度では、SiO膜表面の熱分解が始まるため、SiO膜の膜質を維持することが困難になる。従って、界面欠陥密度の低減効果を得るためには、Nガス雰囲気中での熱処理(界面窒化処理)は、1350℃~1600℃の温度範囲で行うことが好ましい。
 (SiO/SiC界面の窒素原子密度)
 図14は、SiO膜4とSiC基板1との界面における窒素原子密度を測定した結果を示したグラフである。測定は、上述したSIMS(二次イオン質量分析法)を用いて行った。横軸は、膜厚方向の位置を示し、ゼロがSiO膜4とSiC基板1との界面、プラス側がSiC基板内の位置、マイナス側がSiO膜内の位置を示す。また、縦軸は、窒素原子密度を示す。図中のGで示したグラフは、前処理として、1300℃でHガスエッチングを施し、界面窒化処理として、1600℃でNガスによる熱処理を施した場合を示す。また、Hで示したグラフは、前処理としてHガスエッチングを施さず、界面窒化処理としてNOガスによる熱処理を施した場合を示す。
 図14に示すように、高温Hガスでエッチングした場合、SiO膜4とSiC基板1との界面に、密度が約2×1021cm-3の窒素原子が存在していた。さらに、SiO膜中にも、約1×1020cm-3以上の密度の窒素原子が分布していた。なお、図14には示していないが、図10に示したのと同様に、1350℃でNガスによる熱処理を施した場合でも、SiO膜中に、約2×1019cm-3以上の密度の窒素原子が分布しているのが確認できた。
 一方、NOガスで界面を窒化した場合でも、SiO膜4とSiC基板1との界面に、密度が約2×1021cm-3の窒素原子が存在していたが、SiO膜中には、ほとんど窒素原子は分布していなかった。
 (Si過剰雰囲気下での高温Hエッチング)
 上述したように、SiC基板1上に、SiC基板1が酸化されない条件でSiO膜4を堆積した場合でも、反応ガスにOガスやNOガスが含まれているため、堆積の初期に、SiC基板1の表面がわずかに酸化される場合がある。しかしながら、このような場合でも、前処理として行う高温Hガスによるエッチングを、Si過剰雰囲気下で行うことによって、SiC基板1の表面に、1~3層程度の極薄Si層が形成されているため、この極薄Si層が酸化されるに止まり、SiC基板1の表面は酸化されない。
 図15は、高温Hガスによるエッチングを、Si過剰雰囲気下で行った場合と、Si過剰雰囲気下で行わなかった場合とで、SiO膜4とSiC基板1との界面の欠陥密度の違いを測定した結果を示したグラフである。Jで示したグラフは、Si過剰雰囲気下で行った場合を示し、Kで示したグラフは、Si過剰雰囲気下で行わなかった場合を示すす。
 ここで、高温Hガスによるエッチングは、H流量:1000sccm、温度:1300℃、圧力:0.1MPa、時間:3分の条件で行った。また、高温Hガスによるエッチングを、Si過剰雰囲気下で行う場合、流量:0.05sccmのSiHガスを添加した。Nガス雰囲気中での熱処理は、N流量:500sccm、温度:1450℃、圧力:1気圧、時間1分の条件で行った。
 図15に示すように、高温Hガスによるエッチングを、Si過剰雰囲気下で行った場合(グラフJ)、界面欠陥密度は3×1010cm-2eV-1以下に大幅に低減されていた。一方、高温Hガスによるエッチングを、Si過剰雰囲気下で行わなかった場合、この後、最適と考えられる条件でSiO膜を堆積し、高温N処理を施しても、界面欠陥密度は十分に低減されず、高品質界面は得られなかった。これは、SiC基板表面に極薄Si薄膜が形成されていないために、SiO膜を堆積する初期段階で、SiC基板の表面が酸化されたためと考えられる。
 高温HガスによるエッチングをSi過剰雰囲気下で行った試料について、DLTS法を用いて、SiC基板側に存在する欠陥の種類を解析した結果、SiC結晶の酸化により発生する欠陥(図3及び図4に示した矢印N1~N3、P1の欠陥)は観察されなかった。一方、 高温HガスによるエッチングをSi過剰雰囲気下で行わなかった試料については、SiC基板側に、SiC結晶の酸化により発生する欠陥が観察された。これは、SiC基板1上に、SiC基板1が酸化されないと考えられる条件でSiO膜4を堆積しても、SiC基板1の表面が酸化されていることを意味する。
 以上、説明したように、本実施形態におけるSiC半導体素子の製造方法は、SiC基板1の表面を、Si過剰雰囲気下において、1200℃以上の温度で、Hガスでエッチングするステップと、SiC基板1上に、CVD法によりSiO膜4を形成するステップと、SiO膜4が形成されたSiC基板1を、1350℃以上の温度で、Nガス雰囲気中で熱処理するステップとを含む。これにより、SiO膜4とSiC基板1との界面における欠陥密度を大幅に低減することができ、高品質で、安定した特性を有するSiO膜3を得ることができる。
 (SiC半導体素子)
 本実施形態の製造方法により形成したSiO膜をゲート絶縁膜として、SiC半導体素子(SiC MOSFET)を構成することができる。このようなSiC半導体素子において、SiC基板とSiO膜との界面、及び、SiO膜中に、密度が2×1019cm-3以上の窒素原子が存在している。
 また、伝導帯端より0.3eV低いエネルギー近傍におけるSiC基板とSiO膜との界面欠陥密度が、3×1010cm-2eV-1以下である。
 また、SiC基板側に存在する点欠陥において、伝導帯端より1.0eV低いエネルギーにおける点欠陥密度、及び価電子帯端より0.7eV高いエネルギーにおける点欠陥密度が、それぞれ、5×1011cm-3以下である。
 以上、本発明を好適な実施形態により説明してきたが、こうした記述は限定事項ではなく、もちろん、種々の改変が可能である。例えば、上記実施形態では、SiC基板の表面にSiCエピタキシャル層を形成し、SiCエピタキシャル層上に、SiO膜を形成したが、SiC基板上に直接SiO膜を形成してもよい。
 また、上記実施形態では、表面を犠牲酸化した後に、酸化膜を除去したSiC基板を用いたが、犠牲酸化を施さなかったSiC基板にも、本発明の製造方法を適用することができる。
  1  SiC基板 
  2  Si薄膜 
  3、4  SiO膜 

Claims (13)

  1.  SiC基板の表面を、1200℃以上の温度で、Hガスでエッチングするステップ(A)と、
     前記SiC基板上に、該SiC基板を酸化させない条件で、SiO膜を形成するステップ(B)と、
     前記SiO膜が形成された前記SiC基板を、1350℃以上の温度で、Nガス雰囲気中で熱処理するステップ(C)と
    を含む、SiC半導体素子の製造方法。
  2.  前記ステップ(B)は、
      前記SiC基板上に、Si薄膜をCVD法により堆積するステップ(B1)と、
      前記Si薄膜を、前記SiC基板を酸化させない温度で熱酸化してSiO膜を形成すステップ(B2)と
    を含む、請求項1に記載のSiC半導体素子の製造方法。
  3.  前記ステップ(A)は、Si過剰雰囲気下において実行され、
     前記ステップ(B)は、前記SiC基板上に、CVD法によりSiO膜を形成するステップ(B3)からなる、請求項1に記載のSiC半導体素子の製造方法。
  4.  前記ステップ(A)において、前記SiC基板の表面に、1~3層のSi層が形成される、請求項3に記載のSiC半導体素子の製造方法。
  5.  前記ステップ(B2)は、750~850℃の温度範囲で実行される、請求項2に記載のSiC半導体素子の製造方法。
  6.  前記ステップ(A)の前に、前記SiC基板を犠牲酸化した後、前記SiC基板の表面に形成された酸化膜をエッチング除去するステップをさらに含む、請求項1に記載のSiC半導体素子の製造方法。
  7.  前記ステップ(C)の熱処理後において、前記SiC基板と前記SiO膜との界面、及び、前記SiO膜中に、密度が2×1019cm-3以上の窒素原子が存在している、請求項1~6の何れか1項に記載のSiC半導体素子の製造方法。
  8.  前記ステップ(C)の熱処理後において、伝導帯端より0.3eV低いエネルギー近傍における前記SiC基板と前記SiO膜との界面欠陥密度が、3×1010cm-2eV-1以下である、請求項1~6の何れか1項に記載のSiC半導体素子の製造方法。
  9.  前記ステップ(C)の熱処理後の前記SiC基板側に存在する点欠陥において、伝導帯端より1.0eV低いエネルギーにおける点欠陥密度、及び価電子帯端より0.7eV高いエネルギーにおける点欠陥密度が、それぞれ、5×1011cm-3以下である、請求項1~6の何れか1項に記載のSiC半導体素子の製造方法。
  10.  前記SiC基板は、表面にSiCエピタキシャル層が形成されたSiC基板を含む、請求項1に記載のSiC半導体素子の製造方法。
  11.  SiC基板上にSiO膜からなるゲート絶縁膜を有するSiC半導体素子であって、
     前記SiC基板と前記SiO膜との界面、及び、前記SiO膜中に、密度が2×1019cm-3以上の窒素原子が存在している、SiC半導体素子。
  12.  SiC基板上にSiO膜からなるゲート絶縁膜を有するSiC半導体素子であって、
     伝導帯端より0.3eV低いエネルギー近傍における前記SiC基板と前記SiO膜との界面欠陥密度が、3×1010cm-2eV-1以下である、SiC半導体素子。
  13.  SiC基板上にSiO膜からなるゲート絶縁膜を有するSiC半導体素子であって、
     前記SiC基板側に存在する点欠陥であって、伝導帯端より1.0eV低いエネルギーにおける点欠陥密度、及び価電子帯端より0.7eV高いエネルギーにおける点欠陥密度が、それぞれ、5×1011cm-3以下である、SiC半導体素子。
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Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH1167757A (ja) 1997-08-13 1999-03-09 Agency Of Ind Science & Technol 酸化薄膜形成方法
WO2011074237A1 (ja) * 2009-12-16 2011-06-23 国立大学法人奈良先端科学技術大学院大学 SiC半導体素子およびその作製方法
JP2014099495A (ja) * 2012-11-14 2014-05-29 New Japan Radio Co Ltd 炭化珪素半導体装置の製造方法
WO2015005397A1 (ja) * 2013-07-11 2015-01-15 富士電機株式会社 炭化ケイ素半導体装置および炭化ケイ素半導体装置の製造方法
JP2016058658A (ja) * 2014-09-11 2016-04-21 国立研究開発法人産業技術総合研究所 炭化ケイ素半導体装置
JP2020027894A (ja) * 2018-08-13 2020-02-20 富士電機株式会社 絶縁ゲート型半導体装置及び絶縁ゲート型半導体装置の製造方法

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006351744A (ja) * 2005-06-15 2006-12-28 Fuji Electric Holdings Co Ltd 炭化珪素半導体装置の製造方法

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH1167757A (ja) 1997-08-13 1999-03-09 Agency Of Ind Science & Technol 酸化薄膜形成方法
WO2011074237A1 (ja) * 2009-12-16 2011-06-23 国立大学法人奈良先端科学技術大学院大学 SiC半導体素子およびその作製方法
JP2014099495A (ja) * 2012-11-14 2014-05-29 New Japan Radio Co Ltd 炭化珪素半導体装置の製造方法
WO2015005397A1 (ja) * 2013-07-11 2015-01-15 富士電機株式会社 炭化ケイ素半導体装置および炭化ケイ素半導体装置の製造方法
JP2016058658A (ja) * 2014-09-11 2016-04-21 国立研究開発法人産業技術総合研究所 炭化ケイ素半導体装置
JP2020027894A (ja) * 2018-08-13 2020-02-20 富士電機株式会社 絶縁ゲート型半導体装置及び絶縁ゲート型半導体装置の製造方法

Non-Patent Citations (7)

* Cited by examiner, † Cited by third party
Title
F. DEVYNCK ET AL., PHYS. REV. B, vol. 84, 2011, pages 235320
G.Y. CHUNG ET AL., IEEE ELECTRON DEVICE LETT., vol. 22, 2001, pages 176
K. KAWAHARA ET AL., APPL. PHYS. EXPRESS, vol. 6, 2013, pages 051301
K. KAWAHARA ET AL., J. APPL. PHYS., vol. 113, 2013, pages 033705
KAWAHARA KOUTAROU; SUDA JUN; KIMOTO TSUNENOBU: "Deep levels generated by thermal oxidation in p-type 4H-SiC", JOURNAL OF APPLIED PHYSICS, AMERICAN INSTITUTE OF PHYSICS, 2 HUNTINGTON QUADRANGLE, MELVILLE, NY 11747, vol. 113, no. 3, 21 January 2013 (2013-01-21), 2 Huntington Quadrangle, Melville, NY 11747, pages 33705 - 033705-9, XP012169600, ISSN: 0021-8979, DOI: 10.1063/1.4776240 *
KOBAYASHI TAKUMA, OKUDA TAKAFUMI, TACHIKI KEITA, ITO KOJI, MATSUSHITA YU-ICHIRO, KIMOTO TSUNENOBU: "Design and formation of SiC (0001)/SiO 2 interfaces via Si deposition followed by low-temperature oxidation and high-temperature nitridation", APPLIED PHYSICS EXPRESS, JAPAN SOCIETY OF APPLIED PHYSICS; JP, JP, vol. 13, no. 9, 1 September 2020 (2020-09-01), JP , pages 091003, XP055880551, ISSN: 1882-0778, DOI: 10.35848/1882-0786/ababed *
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