WO2018225625A1 - 調光装置 - Google Patents

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高橋　洋
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株式会社オルタステクノロジー
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Definitions

  • the present invention relates to a light control device using liquid crystal.
  • a light control element using a polymer-dispersed liquid crystal or a polymer network type liquid crystal that does not necessarily require an alignment treatment and does not require a polarizing plate and is capable of bright display is known.
  • the liquid crystal layer includes a liquid crystal material and a polymer material, and the ordinary light refractive index of the liquid crystal material and the refractive index of the polymer material are set to be approximately the same.
  • the light control element is in a scattering state when no voltage is applied to the liquid crystal layer, and is in a transmissive state when a voltage is applied to the liquid crystal layer.
  • the driving of the light control element uses pulse driving in order to increase the driving efficiency with respect to the applied voltage.
  • a DC power source is generated from a commercial power source using an AC / DC converter or the like, and pulse driving is performed using the DC power source and a switching element.
  • pulse driving is performed after a required voltage is obtained by a DC / DC converter or the like from a DC power source fed from a secondary battery power source such as a battery.
  • the present invention provides a light control device capable of reducing color unevenness and flicker.
  • a light control device includes a first and second base material, first and second electrodes provided on the first and second base materials, and the first and second electrodes, respectively.
  • a light control element including a liquid crystal layer filled in the first electrode and a second terminal electrically connected to the first and second electrodes, a first driving voltage applied to the first terminal, And a driving circuit that applies a second driving voltage having a polarity different from that of the first driving voltage to the second terminal.
  • the first driving voltage is set to a first voltage in a first period, is set to a second voltage lower than the first voltage in a second period following the first period, and is a third period following the second period. Is set to a third voltage lower than the second voltage, and is set to a fourth voltage lower than the second voltage and higher than the third voltage in a fourth period following the third period.
  • FIG. 3 is a cross-sectional view of the light control element along the line AA ′ in FIG. 2. Sectional drawing explaining the orientation of a liquid-crystal layer.
  • the circuit diagram which mainly showed the drive circuit.
  • FIG. 6 is a timing chart for explaining the operation of the control circuit.
  • FIG. 3 is a timing chart for explaining the operation of the drive circuit according to the first embodiment.
  • the graph which shows an example of the VT characteristic in a light control element.
  • the circuit diagram of the drive circuit concerning a comparative example.
  • FIG. 9 is a timing chart for explaining the operation of the drive circuit according to the third embodiment.
  • FIG. 1 is a block diagram of a light control device 10 according to the first embodiment of the present invention.
  • the light control device 10 includes a light control element 11, a drive circuit 12, a power supply circuit 13, and a control circuit 14.
  • the light control element 11 is an element capable of controlling the light transmittance.
  • the light control element 11 is comprised from the light control film, for example.
  • the light control film is a functional film capable of switching between transparent and opaque (white turbidity). For example, by applying a voltage (maximum voltage) to the light control film, the light control film can be set in a transparent state. On the other hand, by applying 0 V (minimum voltage) to the light control film, the light control film is in a cloudy state. Can be set. Further, by applying an intermediate voltage between the maximum voltage and the minimum voltage to the light control film, gradation display can be performed in steps between the transparency and the cloudiness. A specific configuration of the light control element 11 will be described later.
  • the drive circuit 12 applies a voltage (drive voltage) to the light control element 11 to drive the light control element 11.
  • the circuit configuration of the drive circuit 12 will be described later.
  • the power supply circuit 13 receives an external power supply (external power supply).
  • the external power source is a commercial power source, an AC voltage (AC power source), or a DC voltage (DC power source).
  • the power supply circuit 13 generates a plurality of levels of voltages necessary for the operation of the dimming element 11 using an external power supply. The voltage generated by the power supply circuit 13 is supplied to the drive circuit 12.
  • the control circuit 14 controls the drive circuit 12 and the power supply circuit 13.
  • the control circuit 14 supplies a control signal to the drive circuit 12 and the power supply circuit 13 so that the drive circuit 12 and the power supply circuit 13 can perform a desired operation.
  • FIG. 2 is a plan view of the light control element 11.
  • FIG. 3 is a cross-sectional view of the light control element 11 taken along the line AA ′ of FIG.
  • the planar shape of the light control element 11 can be an arbitrary shape, for example, a quadrangle.
  • the light control element 11 is a light control film
  • the light control film is processed according to the external shape of the area
  • the light control element 11 includes base materials 20 and 21 disposed to face each other and a liquid crystal layer (light control layer) 24 disposed between the base materials 20 and 21.
  • the base materials 20 and 21 are comprised from a transparent member, for example, are comprised from a transparent film.
  • a polyethylene terephthalate (PET) film, a polyethylene (PE) film, or a polycarbonate (PC) film can be used.
  • the liquid crystal layer 24 includes a liquid crystal material 24A and a polymer material 24B.
  • the liquid crystal layer 24 is composed of polymer dispersed liquid crystal (PDLC: Polymer Dispersed Liquid Crystal) or polymer network liquid crystal (PNLC: Polymer Network Liquid Crystal).
  • the polymer-dispersed liquid crystal is composed of a composite in which a liquid crystal material is dispersed in a matrix made of a polymer material, that is, has a structure in which liquid crystals are phase-separated in the matrix.
  • the polymer network type liquid crystal is composed of a composite filled with a liquid crystal material having a continuous phase in a three-dimensional network structure (polymer network) made of a polymer material.
  • a photocuring resin can be used as the polymer material.
  • PDLC irradiates a solution in which a liquid crystal material is mixed with a photopolymerizable polymer precursor (monomer) by irradiating ultraviolet rays, polymerizes the monomer to form a polymer, and the liquid crystal is dispersed in a matrix made of the polymer. Is done.
  • the transparent electrode 22 is provided on the base material 20 so as to be in contact with the liquid crystal layer 24.
  • the transparent electrode 23 is provided on the base material 21 so as to be in contact with the liquid crystal layer 24.
  • the transparent electrodes 22 and 23 are made of a material having optical transparency and conductivity, and are made of, for example, ITO (indium tin oxide).
  • the light control element 11 includes a terminal T1 electrically connected to the transparent electrode 23 and a terminal T2 electrically connected to the transparent electrode 22.
  • the terminals T1 and T2 are, for example, arranged together on one side of the light control element 11.
  • the terminals T1 and T2 are electrically connected to the drive circuit 12.
  • the terminals T1 and T2 are made of metal (for example, gold, silver, copper, or aluminum).
  • the liquid crystal layer 24 is sealed between the transparent electrodes 22 and 23 by a sealing material 25.
  • the sealing material 25 is formed so as to surround the liquid crystal layer 24.
  • the sealing material 25 is made of, for example, a photocurable resin.
  • the sealing material 25 is not necessarily required.
  • the sealing material 25 is not always necessary.
  • the ordinary light refractive index of the liquid crystal material and the refractive index of the polymer material are set to be approximately the same.
  • the liquid crystal material for example, a positive (P-type) nematic liquid crystal having positive dielectric anisotropy is used.
  • the off state is a state in which the same voltage (for example, 0 V) is applied to the transparent electrode 22 and the transparent electrode 23 and an electric field is not applied to the liquid crystal layer 24.
  • FIG. 3 shows a state of the liquid crystal layer 24 in the off state.
  • the liquid crystal molecules When no voltage (electric field) is applied to the liquid crystal layer 24, the liquid crystal molecules are in a random state with respect to the interface of the polymer matrix (or polymer network). In this case, the refractive index of the liquid crystal material is different from the refractive index of the polymer matrix, and incident light is scattered at the interface of the polymer matrix. That is, in a state where the liquid crystal molecules are not aligned, the liquid crystal layer 24 is in a high haze state. At this time, the liquid crystal layer 24 becomes clouded, and the light control element 11 becomes opaque. Therefore, the light control element 11 can shield an object from an observer.
  • a haze value is a parameter
  • the on state is a state in which different voltages (for example, 0 V and positive voltage) are applied to the transparent electrode 22 and the transparent electrode 23, and an electric field is applied to the liquid crystal layer 24. Note that an alternating voltage is applied to the transparent electrode 22 and the transparent electrode 23.
  • FIG. 4 shows a state of the liquid crystal layer 24 in the ON state.
  • the major axis (director) of the liquid crystal molecules is aligned in a direction substantially perpendicular to the electrode surface.
  • the refractive index of the liquid crystal material and the refractive index of the polymer matrix are substantially the same, and incident light is hardly scattered in the liquid crystal layer 24 and passes through the liquid crystal layer 24. That is, in a state where the liquid crystal molecules are aligned, the liquid crystal layer 24 is in a low haze state. At this time, the light control element 11 will be in a transparent state. Therefore, the observer can observe the object through the light control element 11.
  • the dimming element that becomes opaque when not energized and becomes transparent when energized is described.
  • the present invention is not limited to this.
  • a reverse type that becomes transparent when not energized and becomes opaque when energized can also be applied to the light control element 11.
  • FIG. 5 is an equivalent circuit diagram of the light control element 11.
  • the transparent electrode 22 is formed in a planar shape. Therefore, the transparent electrode 22 forms a plurality of resistance components R1 to R11 so as to spread from the terminal side (side on which the terminals T1 and T2 are disposed) to the terminal side (side opposite to the terminals T1 and T2).
  • the transparent electrode 23 is formed in a planar shape. Therefore, the transparent electrode 23 constitutes a plurality of resistance components R12 to R22 so as to spread from the terminal side to the terminal side.
  • the liquid crystal layer 24 constitutes a plurality of capacitive components C1 to C4 connected between the transparent electrode 22 and the transparent electrode 23.
  • the voltage of the dimming element 11 decreases from the terminal side to the terminal side due to the voltage drop of the resistance component. That is, in the light control element 11, the voltage on the terminal side is high and the voltage on the terminal side is low.
  • the nodes on the end side are denoted as N1 and N2.
  • FIG. 6 is a circuit diagram mainly showing the drive circuit 12.
  • the control circuit 14 generates a signal OVPOSIN, a signal CONPOSIN, a signal OVNEGIN, and a signal CONNEGIN, and sends these control signals to the drive circuit 12.
  • the voltage waveforms of the signal OVPOSIN, the signal CONPOSIN, the signal OVNEGIN, and the signal CONNEGIN will be described later.
  • the power supply circuit 13 includes a positive side voltage source 30 for overdrive, a negative side voltage source 31 for overdrive, a voltage source 32 that generates a positive side control voltage for controlling the alignment of liquid crystal, and a negative side control voltage.
  • a voltage source 33 is provided.
  • the voltage source 30 generates an overdrive voltage Vov +.
  • the voltage source 31 generates an overdrive voltage Vov ⁇ .
  • the voltage source 32 generates a control voltage Vc +.
  • the voltage source 33 generates a control voltage Vc ⁇ .
  • the relationship is “Vov +> Vc +> Vc ⁇ > Vov ⁇ ”.
  • the positive side control voltage Vc + and the negative side control voltage Vc ⁇ are voltages for controlling the final liquid crystal alignment, and are determined according to the liquid crystal material used. That is, the voltage at which the liquid crystal molecules are vertically aligned (the threshold voltage of the liquid crystal) is determined according to the liquid crystal material, and the voltage “(Vc +) ⁇ (Vc ⁇ )” is set equal to or slightly higher than the threshold voltage of the liquid crystal. .
  • the drive circuit 12 includes switching elements 40 to 47.
  • a first terminal of the switching element 40 is connected to the voltage source 30, a second terminal thereof is connected to the terminal T1, and a signal OVPOSIN is input to the control terminal.
  • the first terminal of the switching element 41 is connected to the voltage source 31, the second terminal is connected to the terminal T1, and the signal OVNEGIN is input to the control terminal.
  • the switching element 41 is turned on when the signal OVNEGIN is at a high level, and turned off when the signal OVNEGIN is at a low level.
  • the first terminal of the switching element 42 is connected to the voltage source 30, the second terminal is connected to the terminal T2, and the signal OVNEGIN is input to the control terminal.
  • the switching element 42 is turned on when the signal OVNEGIN is at a high level, and turned off when the signal OVNEGIN is at a low level.
  • the first terminal of the switching element 43 is connected to the voltage source 31, the second terminal is connected to the terminal T2, and the signal OVPOSIN is input to the control terminal.
  • the switching element 43 is turned on when the signal OVPOSIN is at a high level and turned off when the signal OVPOSIN is at a low level.
  • the first terminal of the switching element 44 is connected to the voltage source 33, the second terminal is connected to the terminal T1, and the signal CONNEGIN is input to the control terminal.
  • the switching element 44 is turned on when the signal CONEGIN is at a high level and turned off when the signal CONEGIN is at a low level.
  • the first terminal of the switching element 45 is connected to the voltage source 32, the second terminal is connected to the terminal T1, and the signal CONPOSIN is input to the control terminal.
  • the switching element 45 is turned on when the signal CONPOSIN is at a high level and turned off when the signal CONPOSIN is at a low level.
  • the first terminal of the switching element 46 is connected to the voltage source 33, the second terminal is connected to the terminal T2, and the signal CONPOSIN is input to the control terminal.
  • the switching element 46 is turned on when the signal CONPOSIN is at a high level, and turned off when the signal CONPOSIN is at a low level.
  • the first terminal of the switching element 47 is connected to the voltage source 32, the second terminal is connected to the terminal T2, and the signal CONEGIN is input to the control terminal.
  • the switching element 47 is turned on when the signal CONNEGIN is at a high level, and turned off when the signal CONNEGIN is at a low level.
  • FIG. 7 is a timing chart for explaining the operation of the control circuit 14. As described above, the control circuit 14 generates the signal OVPOSIN, the signal CONPOSIN, the signal OVNEGIN, and the signal CONEGIN.
  • control circuit 14 sets the signal CONPOSIN to the low level and sets the signal OVNEGIN to the high level.
  • the control circuit 14 sets the signal OVNEGIN to the low level and sets the signal CONNEGIN to the high level.
  • Time t0 to t4 is one cycle, and the same cycle is repeated thereafter.
  • FIG. 8 is a timing chart for explaining the operation of the drive circuit 12. Times t0 to t9 in FIG. 8 correspond to times t0 to t9 in FIG. In FIG. 8, (1) the drive voltage OUT1 applied to the terminal T1 of the light control element 11 by the drive circuit 12, (2) drive voltage OUT2 applied to the terminal T2 of the light control element 11, (3) The voltage V1out of the node N1 of the dimmer 11 and (4) the voltage V2out of the node N2 of the dimmer 11 are shown. In FIG.
  • the drive voltage OUT1 is indicated by a solid line
  • the drive voltage OUT2 is indicated by a broken line
  • the voltage V1out is indicated by a one-dot chain line
  • the voltage V2out is indicated by a two-dot chain line.
  • the terminal-side voltage V1out rises faster than when the control voltage Vc + is applied to the terminal T1. Further, the terminal-side voltage V2out falls faster than when the control voltage Vc ⁇ is applied to the terminal T2.
  • the terminal-side voltage V1out is set to the control voltage Vc +, and the terminal-side voltage V2out is set to the control voltage Vc ⁇ .
  • the terminal-side voltage V1out falls faster than when the control voltage Vc ⁇ is applied to the terminal T1.
  • the terminal-side voltage V2out rises faster than when the control voltage Vc + is applied to the terminal T2.
  • the same operation as in cycles t0 to t4 is repeated.
  • the driving frequency is 20 Hz.
  • the overdrive period that is, each of the periods t0 to t1 and the periods t2 to t3 is set according to the load (resistance and capacitance) of the dimming element 11. That is, the overdrive period is set shorter than the period during which the terminal side voltage V1out rises from the control voltage Vc ⁇ to the control voltage Vc +. The overdrive period is set shorter than the period during which the terminal-side voltage V2out falls from the control voltage Vc + to the control voltage Vc ⁇ .
  • FIG. 9 is a graph showing an example of voltage-transmittance (VT) characteristics in the light control element 11.
  • the horizontal axis in FIG. 9 is voltage (V), the vertical axis is transmittance (%), and both the horizontal axis and vertical axis in FIG. 9 are arbitrary units.
  • the voltage in FIG. 9 is a voltage applied to the liquid crystal layer, that is, a voltage between the electrodes 22 and 23.
  • the transmittance of the light control element 11 can be changed by changing the voltage (drive voltage) applied to the light control element 11. Further, even when a drive voltage equal to or higher than the saturation voltage is applied to the light control element 11, the transmittance does not change.
  • the saturation voltage is the minimum voltage among the voltages that achieve the maximum transmittance. For example, the voltage “(Vc +) ⁇ (Vc ⁇ )” is set below the saturation voltage. Therefore, even when the overdrive voltage is set to a voltage equal to or higher than the saturation voltage within a range not exceeding the breakdown voltage of the liquid crystal, the dimmer 11 is driven using the overdrive voltage without affecting the transmittance of the liquid crystal. it can.
  • the effective voltage on the terminal side is almost the control voltage Vc +, Vc-. Further, since the terminal side voltage reaches the control voltages Vc + and Vc ⁇ at a faster timing, the terminal side effective voltage is also close to the control voltages Vc + and Vc ⁇ . Thereby, the difference in transmittance between the terminal side and the terminal side is reduced, and color unevenness can be reduced.
  • the period of polarity inversion including the zero cross point (the point where the voltage V1out and the voltage V2out intersect)
  • the transmission of the liquid crystal The rate is not the desired transmittance.
  • the voltage applied to the liquid crystal is 0V.
  • the voltage on the terminal side rises at a faster timing by using overdrive driving. Accordingly, the period for performing the polarity inversion can be shortened, and flicker can be reduced.
  • FIG. 10 is a circuit diagram of a drive circuit according to a comparative example.
  • the voltage source 32 generates a control voltage Vc +.
  • the voltage source 33 generates a control voltage Vc ⁇ .
  • the first terminal of the switching element 44 is connected to the voltage source 33, the second terminal is connected to the terminal T1, and the signal NEGIN is input to the control terminal.
  • the switching element 44 is turned on when the signal NEGIN is at a high level and turned off when the signal NEGIN is at a low level.
  • the first terminal of the switching element 45 is connected to the voltage source 32, the second terminal is connected to the terminal T1, and the signal POSIN is input to the control terminal.
  • the switching element 45 is turned on when the signal POSIN is at a high level and turned off when the signal POSIN is at a low level.
  • the first terminal of the switching element 46 is connected to the voltage source 33, the second terminal is connected to the terminal T2, and the signal POSIN is input to the control terminal.
  • the switching element 46 is turned on when the signal POSIN is at a high level and turned off when the signal POSIN is at a low level.
  • the first terminal of the switching element 47 is connected to the voltage source 32, the second terminal is connected to the terminal T2, and the signal NEGIN is input to the control terminal.
  • the switching element 47 is turned on when the signal NEGIN is at a high level and turned off when the signal NEGIN is at a low level.
  • FIG. 11 is a diagram for explaining the operation of the light control device according to the comparative example.
  • the signal POSIN is set to high level, and the signal NEGIN is set to low level.
  • the signal POSIN is set to low level and the signal NEGIN is set to high level.
  • the signal POSIN is set to high level and the signal NEGIN is set to low level.
  • the light control device 10 includes the base materials 20 and 21 disposed opposite to each other, and the transparent electrodes provided on the base materials 20 and 21, respectively. 22, 23, a liquid crystal layer 24 filled between the transparent electrodes 22, 23, a dimming element 11 including terminals T 1, T 2 electrically connected to the transparent electrodes 22, 23, and a drive voltage across the terminal T 1
  • a drive circuit 12 that applies OUT1 and applies a drive voltage OUT2 having a polarity different from that of the drive voltage OUT1 to the terminal T2 is provided.
  • the drive voltage OUT1 is set to the positive side overdrive voltage Vov + in the first period, is set to the positive side control voltage Vc + in the second period following the first period, and is negatively exceeded in the third period following the second period.
  • the drive voltage Vov ⁇ is set, and the negative control voltage Vc ⁇ is set in the fourth period following the third period.
  • the voltage on the side opposite to the terminal side can be set to the control voltages Vc + and Vc ⁇ faster. Therefore, the difference in transmittance between the terminal side and the terminal side is reduced, and color unevenness can be reduced.
  • flicker occurs during the period of polarity reversal including the zero cross point (the point where the voltage V1out and the voltage V2out intersect).
  • flicker can be reduced.
  • FIG. 12 is a schematic diagram of the amount of electric charge consumed according to the first example.
  • the horizontal axis in FIG. 12 represents the position between the terminal and the terminal, and the vertical axis represents the voltage applied to the liquid crystal (applied voltage).
  • the region of 0V to 40V is a gradation region in which the transmittance can be changed
  • the region of 40V to 70V is a saturated region in which the transmittance does not substantially change.
  • the charge amount A is a charge amount in normal pulse driving.
  • the normal pulse driving in the first example is an example in which the applied voltage is 40V and the frequency is lowered until the terminal voltage reaches 40V. In normal pulse driving, the terminal side finally becomes 40V, so that color unevenness between the terminal side and the terminal side can be reduced. However, since the time required for polarity reversal becomes longer, the flicker becomes larger.
  • the charge amount B is a charge amount that increases by overdrive driving relative to normal pulse driving.
  • the overdrive driving is an example in which driving is performed using an overdrive voltage of 70V. Since the voltage decreases from the terminal side to the terminal side, the charge amount B is represented by a triangle that gradually decreases from the terminal side toward the terminal side.
  • flicker can be reduced and color unevenness can be reduced only by increasing the charge amount B compared to normal pulse driving.
  • the amount of charge C is the amount of charge that decreases with overdrive driving relative to full driving.
  • Full driving is an example of driving using 70V. That is, “charge amount A + charge amount B + charge amount C” is a full drive charge amount.
  • flicker is reduced, but the amount of electric charge consumed is increased.
  • flicker can be reduced to the same extent as in full driving, and the amount of charge consumed can be reduced compared to full driving.
  • FIG. 13 is a schematic diagram of the amount of charge consumed according to the second example.
  • the second example is an example in which halftone is performed.
  • the charge amount D is a charge amount in normal pulse driving.
  • the normal pulse driving of the second example is an example in which the applied voltage is 20V and the frequency is lowered until the terminal voltage becomes 20V.
  • the flicker since the terminal side finally becomes 20 V, color unevenness between the terminal side and the terminal side can be reduced.
  • the time required for polarity reversal becomes longer, the flicker becomes larger.
  • the frequency is increased in order to reduce flicker, the potential difference between the terminal side and the terminal side increases, and color unevenness occurs.
  • the amount of charge when the frequency is increased is a lower region indicated by a broken line in FIG. That is, color unevenness and flicker are in a trade-off relationship.
  • the charge amount E is a charge amount that is increased by overdrive driving with respect to normal pulse driving. Even when halftone is performed using overdrive driving, flicker can be reduced and color unevenness can be reduced only by increasing the charge amount E compared to normal pulse driving. Also in the second example, overdrive driving can reduce flicker to the same extent as full driving of 70V.
  • the second embodiment is a specific configuration example of the drive circuit 12 and the power supply circuit 13.
  • the second embodiment is an example in which the drive circuit 12 is configured digitally using transistors.
  • FIG. 14 is a circuit diagram mainly showing the drive circuit 12 according to the second embodiment of the present invention.
  • each of the plurality of switching elements constituting the drive circuit 12 is configured by a MOS transistor or a bipolar transistor.
  • MOS transistor or a bipolar transistor.
  • the dimming element 11 includes a resistive load RL and a capacitive load CL as can be understood from FIG. 5 when expressed as an equivalent circuit.
  • the control circuit 14 includes a timing generation circuit 14A.
  • the timing generation circuit 14A controls the timing of the signal OVPOSIN, the signal CONPOSIN, the signal OVNEGIN, and the signal CONEGIN.
  • the drive circuit 12 includes a gate driver 12A.
  • the gate driver 12A receives the signal OVPOSIN, the signal CONPOSIN, the signal OVNEGIN, and the signal CONNEGIN from the timing generation circuit 14A.
  • the gate driver 12A uses the signal OVPOSIN, the signal CONPOSIN, the signal OVNEGIN, and the signal CONNEGIN to set these signal levels to an optimum gate voltage level for the transistor. Then, the gate driver 12A generates a signal OVPOSIN-G, a signal CONPOSIN-G, a signal OVNEGIN-G, and a signal CONEGIN-G as signals having the optimum gate voltage level for the transistor.
  • the drive circuit 12 includes N-channel MOS transistors 40 to 43, 44A, 44B, 45A, 45B, 46A, 46B, 47A, and 47B. Further, signal lines 40S, 42S, 44S, 45S, 46S, and 47S are connected to the gate driver 12A. The signal lines 40S, 42S, 44S, 45S, 46S, and 47S provide the gate driver 12A with the source voltage level of the transistor in order to set the optimum gate voltage level.
  • the drain of the transistor 40 is connected to the voltage source 30 that generates the overdrive voltage Vov +, the source is connected to the terminal T1, and the signal OVPOSIN-G is input to the gate.
  • the source of the transistor 40 is connected to the gate driver 12A through the signal line 40S.
  • the drain of the transistor 41 is connected to the terminal T1, the source is connected to the voltage source 31 that generates the overdrive voltage Vov ⁇ , and the signal OVNEGIN-G is input to the gate.
  • the drain of the transistor 42 is connected to the voltage source 30, the source is connected to the terminal T2, and the signal OVNEGIN-G is input to the gate.
  • the source of the transistor 42 is connected to the gate driver 12A through the signal line 42S.
  • the drain of the transistor 43 is connected to the terminal T2, the source is connected to the voltage source 31, and the signal OVPOSIN-G is input to the gate.
  • Transistors 44A and 44B constitute the switching element 44 of FIG.
  • the drain of the transistor 44A is connected to the terminal T1
  • its source is connected to the source of the transistor 44B
  • the signal CONEGIN-G is input to its gate.
  • the drain of the transistor 44B is connected to the voltage source 33 that generates the control voltage Vc ⁇ , and the signal CONEGIN-G is input to the gate thereof.
  • the source of the transistor 44A is connected to the gate driver 12A through the signal line 44S.
  • Transistors 45A and 45B constitute the switching element 45 of FIG.
  • the drain of the transistor 45A is connected to the terminal T1, its source is connected to the source of the transistor 45B, and the signal CONPOSIN-G is input to its gate.
  • the drain of the transistor 45B is connected to the voltage source 32 that generates the control voltage Vc +, and the signal CONPOSIN-G is input to the gate thereof.
  • the source of the transistor 45A is connected to the gate driver 12A through the signal line 45S.
  • the transistors 46A and 46B constitute the switching element 46 of FIG.
  • the drain of the transistor 46A is connected to the terminal T2
  • the source is connected to the source of the transistor 46B
  • the signal CONPOSIN-G is input to the gate.
  • the drain of the transistor 46B is connected to the voltage source 33, and the signal CONPOSIN-G is input to the gate thereof.
  • the source of the transistor 46A is connected to the gate driver 12A through the signal line 46S.
  • the transistors 47A and 47B constitute the switching element 47 of FIG.
  • the drain of the transistor 47A is connected to the terminal T2
  • the source is connected to the source of the transistor 47B
  • the signal CONEGIN-G is input to the gate.
  • the drain of the transistor 47B is connected to the voltage source 32, and the signal CONEGIN-G is input to the gate thereof.
  • the source of the transistor 47A is connected to the gate driver 12A through the signal line 47S.
  • the power supply circuit 13 includes a voltage source 13A and voltage sources 30 to 33.
  • the voltage source 13A generates a voltage Vin from the power supply voltage VCC.
  • the voltage source 30 includes a Zener diode (constant voltage diode) 30A as a constant voltage element and a resistor (resistance element) 30B.
  • the cathode of the Zener diode 30A is connected to the voltage source 13A, and its anode is connected to one end of the resistor 30B.
  • the other end of the resistor 30B is connected to the ground terminal GND.
  • the voltage source 30 may use other configurations. For example, when a voltage to be handled is large, two or more Zener diodes may be connected in series. Further, an NPN transistor for current amplification may be added to a connection node between the Zener diode 30A and the resistor 30B. Further, the voltage source 30 may be configured by a series regulator having a voltage control terminal. Further, the voltage source 30 may be constituted by a DC / DC converter.
  • the voltage source 32 includes a Zener diode 32A and a resistor 32B. One end of the resistor 32B is connected to the voltage source 13A, and the other end is connected to the cathode of the Zener diode 32A. The anode of the Zener diode 32A is connected to the ground terminal GND. Another configuration example similar to that of the voltage source 30 may be used for the voltage source 32.
  • the voltage source 33 includes a Zener diode 33A and a resistor 33B.
  • the cathode of the Zener diode 33A is connected to the voltage source 13A, and the anode thereof is connected to one end of the resistor 33B.
  • the other end of the resistor 33B is connected to the ground terminal GND.
  • Another configuration example similar to that of the voltage source 30 may be used for the voltage source 33.
  • the drive circuit 12 can be configured using transistors.
  • the voltage control of the second embodiment is the same as the voltage control of the first embodiment.
  • Other effects are the same as those of the first embodiment.
  • the third embodiment is a specific configuration example of the drive circuit 12 and the power supply circuit 13.
  • the third embodiment is an example in which the drive circuit 12 is configured in an analog manner using a power amplifier.
  • FIG. 15 is a circuit diagram mainly showing the drive circuit 12 according to the third embodiment of the present invention.
  • the drive circuit 12 includes an overdrive waveform generation circuit 12B and power amplifiers 12C and 12D.
  • the overdrive waveform generation circuit 12B generates the positive voltage waveform VP and the negative voltage waveform VN using the control signal from the timing generation circuit 14A.
  • the power amplifiers 12C and 12D can output four quadrants that can operate from the first quadrant to the fourth quadrant. That is, the power amplifiers 12C and 12D can supply (source) and absorb (sink) current regardless of the direction of voltage.
  • the power amplifier 12C receives the positive voltage waveform VP from the overdrive waveform generation circuit 12B and amplifies the positive voltage waveform VP.
  • the power amplifier 12C outputs the drive voltage OUT1.
  • the drive voltage OUT1 is applied to the terminal T1 of the light control element 11.
  • the power amplifier 12D receives the negative voltage waveform VN from the overdrive waveform generation circuit 12B and amplifies the negative voltage waveform VN.
  • the power amplifier 12D outputs a drive voltage OUT2.
  • the drive voltage OUT2 is applied to the terminal T2 of the light control element 11.
  • FIG. 16 is a timing chart for explaining the operation of the drive circuit 12.
  • the drive voltages OUT1 and OUT2 have the same waveforms as those in FIG. 8 of the first embodiment.
  • the drive voltage OUT1 has the same waveform as the positive voltage waveform VP in the previous stage, and is an amplified output current.
  • the drive voltage OUT2 has the same waveform as the negative voltage waveform VN in the previous stage, and is an amplified output current.
  • the overdrive drive can be realized in an analog manner.
  • Other effects are the same as those of the first embodiment.
  • the liquid crystal element (light control element) using PDLC or PNLC is illustrated, it is not limited to this.
  • the liquid crystal element as the light control element may have a configuration in which a polarizing plate and an alignment film are arranged on both sides of the liquid crystal layer, such as a TN (Twisted Nematic) method, a VA (Vertical Alignment) method, or an IPS (In-Plane Switching) method. Can be used.
  • various types of electro-optic elements whose refractive index changes with voltage can be used as the light control element.
  • the switching element shown in the above embodiment includes an SiC-MOSFET using silicon carbide (SiC) as a semiconductor layer, or a GaN-MOSFET using gallium nitride (GaN) as a semiconductor layer. You may comprise.
  • the light control device described in the above embodiment can be applied to windows and indoor partitions in houses, offices, or public facilities, video projection screens and signage in commercial facilities or event venues, windows and sunroofs in automobiles or aircraft, and the like.
  • the dimmer element is described as an example of the liquid crystal element.
  • the present invention is not limited to this, and the driving method in this embodiment includes various devices using liquid crystals (including liquid crystal display devices). It is applicable to.
  • this invention is not limited to the said embodiment, In the implementation stage, it can change variously in the range which does not deviate from the summary. Further, the embodiments may be implemented in combination as appropriate, and in that case, the combined effect can be obtained. Furthermore, the present invention includes various inventions, and various inventions can be extracted by combinations selected from a plurality of disclosed constituent elements. For example, even if several constituent requirements are deleted from all the constituent requirements shown in the embodiment, if the problem can be solved and an effect can be obtained, the configuration from which the constituent requirements are deleted can be extracted as an invention.

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Abstract

調光装置は、基材２０、２１と、基材２０、２１にそれぞれ設けられた電極２２、２３と、電極２２、２３間に充填された液晶層２４と、電極２２、２３に電気的に接続された端子Ｔ１、Ｔ２とを含む調光素子１１と、Ｔ１端子に第１駆動電圧を印加し、端子Ｔ２に１駆動電圧と極性が異なる第２駆動電圧を印加する駆動回路１２とを含む。第１駆動電圧は、第１期間において第１電圧に設定され、第１期間に続く第２期間において第１電圧より低い第２電圧に設定され、第２期間に続く第３期間において第２電圧より低い第３電圧に設定され、第３期間に続く第４期間において第２電圧より低くかつ第３電圧より高い第４電圧に設定される。

Description

調光装置
　本発明は、液晶を用いた調光装置に関する。
　配向処理を必ずしも必要とせず、偏光板も不要で明るい表示が可能な高分子分散型液晶やポリマーネットワーク型液晶を用いた調光素子が知られている。液晶層（調光層）は、液晶材料と高分子材料とを含み、液晶材料の常光屈折率と高分子材料の屈折率とは概略同じに設定される。
　調光素子は、例えば、液晶層に電圧を印加しない場合に、散乱状態となり、液晶層に電圧を印加した場合に、透過状態となる。例えば、調光素子の駆動は、印加電圧に対する駆動効率を高くするために、パルス駆動が用いられる。
　家庭や会社内で調光素子を使用する場合、商用電源からＡＣ／ＤＣコンバータ等を使用してＤＣ電源を生成し、このＤＣ電源とスイッチング素子とを用いてパルス駆動を行う。また、自動車等で調光素子を使用する場合、バッテリー等の二次電池電源等から給電されるＤＣ電源からＤＣ／ＤＣコンバータ等で所要の電圧を得た後、パルス駆動を行う。
　建物等に調光素子を固定する場合、及び自動車の窓等に調光素子を設置する場合、建物や窓の実装上、電源を印加する端子部を調光素子の一方にまとめることが要求される。しかし、平面形状を有する調光素子のうち端子部から離れた部分では、調光素子の持つ抵抗成分及び容量成分によって電圧降下が生じる。このため、端子部に耐圧以下の最大電圧を印加しても、端子部と逆の末端部に印加される電圧は、液晶を駆動する閾値電圧に達することができず、十分な透過モードへの移行ができない。
　また、容量成分により調光素子の末端部で生じる電圧降下の影響を低減するために、駆動周波数を下げ、末端部に印加される電圧が上昇するまで同極性の電圧を印加し続ける手法が考えられる。しかし、末端部に印加される電圧が上昇するまでの時間が長くなるため、末端部付近においてフリッカーが目立ってしまう。
　本発明は、色ムラ及びフリッカーを低減することが可能な調光装置を提供する。
　本発明の一態様に係る調光装置は、第１及び第２基材と、前記第１及び第２基材にそれぞれ設けられた第１及び第２電極と、前記第１及び第２電極間に充填された液晶層と、前記第１及び第２電極に電気的に接続された第１及び第２端子とを含む調光素子と、前記第１端子に第１駆動電圧を印加し、前記第２端子に前記第１駆動電圧と極性が異なる第２駆動電圧を印加する駆動回路とを具備する。前記第１駆動電圧は、第１期間において第１電圧に設定され、前記第１期間に続く第２期間において前記第１電圧より低い第２電圧に設定され、前記第２期間に続く第３期間において前記第２電圧より低い第３電圧に設定され、前記第３期間に続く第４期間において前記第２電圧より低くかつ前記第３電圧より高い第４電圧に設定される。
　本発明によれば、色ムラ及びフリッカーを低減することが可能な調光装置を提供することができる。
第１実施形態に係る調光装置のブロック図。 調光素子の平面図。 図２のＡ－Ａ´線に沿った調光素子の断面図。 液晶層の配向を説明する断面図。 調光素子の等価回路図。 駆動回路を主として示した回路図。 制御回路の動作を説明するタイミング図。 第１実施形態に係る駆動回路の動作を説明するタイミング図。 調光素子におけるＶ－Ｔ特性の一例を示すグラフ。 比較例に係る駆動回路の回路図。 比較例に係る調光装置の動作を説明する図。 第１例に係る消費される電荷量の模式図。 第２例に係る消費される電荷量の模式図。 第２実施形態に係る駆動回路を主として示した回路図。 第３実施形態に係る駆動回路を主として示した回路図。 第３実施形態に係る駆動回路の動作を説明するタイミング図。
　以下、実施形態について図面を参照して説明する。ただし、図面は模式的または概念的なものであり、各図面の寸法および比率等は必ずしも現実のものと同一とは限らない。また、図面の相互間で同じ部分を表す場合においても、互いの寸法の関係や比率が異なって表される場合もある。特に、以下に示す幾つかの実施形態は、本発明の技術思想を具体化するための装置および方法を例示したものであって、構成部品の形状、構造、配置等によって、本発明の技術思想が特定されるものではない。なお、以下の説明において、同一の機能及び構成を有する要素については同一符号を付し、重複説明は必要な場合にのみ行う。
　［第１実施形態］
　［１］　調光装置１０の構成
　図１は、本発明の第１実施形態に係る調光装置１０のブロック図である。調光装置１０は、調光素子１１、駆動回路１２、電源回路１３、及び制御回路１４を備える。
　調光素子１１は、光の透過率を制御可能な素子である。調光素子１１は、例えば調光フィルムから構成される。調光フィルムは、透明と不透明（白濁）とを切り替え可能な機能性フィルムである。例えば、調光フィルムに電圧（最大電圧）を印加することで、調光フィルムを透明状態に設定でき、一方、調光フィルムに０Ｖ（最小電圧）を印加することで、調光フィルムを白濁状態に設定できる。また、最大電圧と最小電圧との間の中間電圧を調光フィルムに印加することで、透明と白濁との間で段階的な階調表示が可能である。調光素子１１の具体的な構成については後述する。
　駆動回路１２は、調光素子１１に電圧（駆動電圧）を印加し、調光素子１１を駆動する。駆動回路１２の回路構成については後述する。
　電源回路１３は、外部から電源（外部電源）を受ける。外部電源は、商用電源、交流電圧（交流電源）、又は直流電圧（直流電源）である。電源回路１３は、外部電源を用いて、調光素子１１の動作に必要な複数レベルの電圧を生成する。電源回路１３によって生成された電圧は、駆動回路１２に供給される。
　制御回路１４は、駆動回路１２及び電源回路１３を制御する。制御回路１４は、駆動回路１２及び電源回路１３が所望の動作を行うことが可能なように、駆動回路１２及び電源回路１３に制御信号を供給する。
　［１－１］　調光素子１１の構成
　次に、調光素子１１の構成について説明する。図２は、調光素子１１の平面図である。図３は、図２のＡ－Ａ´線に沿った調光素子１１の断面図である。
　調光素子１１の平面形状は、任意の形状とすることが可能であり、例えば四角形である。調光素子１１が調光フィルムである場合、調光フィルムは、貼り付けられる領域の外形に合わせて加工される。
　調光素子１１は、対向配置された基材２０、２１と、基材２０、２１間に配置された液晶層（調光層）２４とを備える。基材２０、２１は、透明部材から構成され、例えば透明フィルムから構成される。基材２０、２１には、例えば、ポリエチレンテレフタレート（ＰＥＴ）フィルム、ポリエチレン（ＰＥ）フィルム、又はポリカーボネート（ＰＣ）フィルムなどを用いることができる。
　液晶層２４は、液晶材料２４Ａ及び高分子材料２４Ｂを備える。液晶層２４は、高分子分散型液晶（ＰＤＬＣ：Polymer Dispersed Liquid Crystal）、又はポリマーネットワーク型液晶（ＰＮＬＣ：Polymer Network Liquid Crystal）から構成される。高分子分散型液晶は、高分子材料からなるマトリックス中に液晶材料を分散させた複合体からなり、すなわち、マトリックス中において液晶が相分離した構造を有する。ポリマーネットワーク型液晶は、高分子材料からなる３次元網目構造（ポリマーネットワーク）中に連続相を有する液晶材料を満たした複合体からなる。高分子材料としては、光硬化樹脂を用いることができる。例えば、ＰＤＬＣは、光重合型の高分子前駆体（モノマー）に液晶材料を混合させた溶液に紫外線を照射し、モノマーを重合させてポリマーを形成し、そのポリマーからなるマトリックス中に液晶が分散される。
　透明電極２２は、液晶層２４に接するようにして、基材２０上に設けられる。透明電極２３は、液晶層２４に接するようにして、基材２１上に設けられる。透明電極２２、２３は、光透過性及び導電性を有する材料からなり、例えばＩＴＯ（インジウム錫酸化物）から構成される。
　調光素子１１は、透明電極２３に電気的に接続された端子Ｔ１と、透明電極２２に電気的に接続された端子Ｔ２とを備える。端子Ｔ１、Ｔ２は、例えば、調光素子１１の一側部にまとめて配置される。端子Ｔ１、Ｔ２は、駆動回路１２に電気的に接続される。端子Ｔ１、Ｔ２は、金属（例えば、金、銀、銅、又はアルミニウムなど）から構成される。
　液晶層２４は、シール材２５によって透明電極２２、２３間に封止される。シール材２５は、液晶層２４を囲むように形成される。シール材２５は、例えば光硬化樹脂から構成される。液晶層２４の材料によっては、シール材２５は必ずしも必要ではない。例えば、液晶層２４の高分子材料２４Ｂによって液晶材料２４Ａが封止されている場合、シール材２５は必ずしも必要ではない。
　［１－２］　液晶層２４の動作
　次に、液晶層（調光層）２４の大まかな動作について説明する。
　液晶層２４において、液晶材料の常光屈折率と高分子材料の屈折率とは概略同じに設定される。液晶材料としては、例えば、正の誘電率異方性を有するポジ型（Ｐ型）のネマティック液晶が用いられる。
　まず、オフ状態における液晶層２４の動作について説明する。オフ状態とは、透明電極２２と透明電極２３とに同電圧（例えば０Ｖ）が印加された状態であり、液晶層２４に電界が印加されていない状態である。図３は、オフ状態における液晶層２４の様子を示している。
　液晶層２４に電圧（電界）が印加されない場合、液晶分子は、高分子マトリックス（又はポリマーネットワーク）の界面に対してランダムな状態になる。この場合、液晶材料の屈折率と高分子マトリックスの屈折率とが異なる状態となり、入射光は高分子マトリックスの界面で散乱する。すなわち、液晶分子が配向されていない状態において、液晶層２４は高ヘイズ状態となる。このとき、液晶層２４は白濁した状態となり、調光素子１１は、不透明な状態となる。よって、調光素子１１は、対象物を観察者から遮蔽することができる。ヘイズ値は、部材の透明性に関する指標であり、曇り度を表す。ヘイズ値が小さいほど、透明度が高い。
　次に、オン状態における液晶層２４の動作について説明する。オン状態とは、透明電極２２と透明電極２３とに異なる電圧（例えば０Ｖ及び正電圧）が印加された状態であり、液晶層２４に電界が印加されている状態である。なお、透明電極２２と透明電極２３とには、交流電圧が印加される。図４は、オン状態における液晶層２４の様子を示している。
　液晶層２４に電圧が印加された場合、液晶分子の長軸（ダイレクタ）は、電極面に対して概略垂直方向に配向する。この場合、液晶材料の屈折率と高分子マトリックスの屈折率とが概略同じ状態になり、入射光は、液晶層２４内でほとんど散乱されず、液晶層２４を透過する。すなわち、液晶分子が配向されている状態において、液晶層２４は低ヘイズ状態となる。このとき、調光素子１１は、透明な状態となる。よって、観察者は、調光素子１１越しに対象物を観察することができる。
　なお、本実施形態では、非通電時に不透明状態となり、通電時に透明状態となる調光素子について説明しているが、これに限定されるものではない。非通電時に透明状態となり、通電時に不透明状態となるリバースタイプを調光素子１１に適用することも可能である。
　［１－３］　調光素子１１の等価回路
　次に、調光素子１１の等価回路について説明する。図５は、調光素子１１の等価回路図である。
　透明電極２２は、平面状に形成される。よって、透明電極２２は、端子側（端子Ｔ１、Ｔ２が配置される側）から末端側（端子Ｔ１、Ｔ２と反対側）まで広がるように、複数の抵抗成分Ｒ１～１１を構成する。
　同様に、透明電極２３は、平面状に形成される。よって、透明電極２３は、端子側から末端側まで広がるように、複数の抵抗成分Ｒ１２～２２を構成する。
　液晶層２４は、透明電極２２と透明電極２３との間に接続された複数の容量成分Ｃ１～Ｃ４を構成する。
　図４から理解できるように、調光素子１１は、抵抗成分の電圧降下に起因して、端子側から末端側にいくにつれて、電圧が低くなる。すなわち、調光素子１１において、端子側の電圧が高く、末端側の電圧が低くなる。末端側のノードをＮ１、Ｎ２と表記する。
　［１－４］　駆動回路１２の構成
　次に、駆動回路１２の構成について説明する。図６は、駆動回路１２を主として示した回路図である。
　制御回路１４は、信号ＯＶＰＯＳＩＮ、信号ＣＯＮＰＯＳＩＮ、信号ＯＶＮＥＧＩＮ、及び信号ＣＯＮＮＥＧＩＮを生成し、これらの制御信号を駆動回路１２に送る。信号ＯＶＰＯＳＩＮ、信号ＣＯＮＰＯＳＩＮ、信号ＯＶＮＥＧＩＮ、及び信号ＣＯＮＮＥＧＩＮの電圧波形については、後述する。
　電源回路１３は、オーバードライブ用の正側電圧源３０、オーバードライブ用の負側電圧源３１、液晶の配向を制御するための正側制御電圧を生成する電圧源３２、及び負側制御電圧を生成する電圧源３３を備える。電圧源３０は、オーバードライブ電圧Ｖｏｖ＋を生成する。電圧源３１は、オーバードライブ電圧Ｖｏｖ－を生成する。電圧源３２は、制御電圧Ｖｃ＋を生成する。電圧源３３は、制御電圧Ｖｃ－を生成する。“Ｖｏｖ＋＞Ｖｃ＋＞Ｖｃ－＞Ｖｏｖ－”の関係を有する。
　正側制御電圧Ｖｃ＋、負側制御電圧Ｖｃ－は、最終的な液晶の配向を制御する電圧であり、使用される液晶材料に応じて決定される。すなわち、液晶材料に応じて液晶分子が垂直に配向する電圧（液晶の閾値電圧）が決定され、電圧“（Ｖｃ＋）－（Ｖｃ－）”は、液晶の閾値電圧と同じか若干高く設定される。電圧“（Ｖｏｖ＋）－（Ｖｏｖ－）”は、液晶の耐圧より小さく設定される。例えば、Ｖｏｖ＋＝７０Ｖ、Ｖｏｖ－＝０Ｖ、Ｖｃ＋＝５５Ｖ、Ｖｃ－＝１５Ｖである。
　駆動回路１２は、スイッチング素子４０～４７を備える。スイッチング素子４０の第１端子は、電圧源３０に接続され、その第２端子は、端子Ｔ１に接続され、その制御端子には、信号ＯＶＰＯＳＩＮが入力される。スイッチング素子４０は、信号ＯＶＰＯＳＩＮがハイレベル（例えば電圧Ｖｄｄ＝５Ｖ）の場合にオンし、信号ＯＶＰＯＳＩＮがローレベル（例えば接地電圧＝０Ｖ）の場合にオフする。
　スイッチング素子４１の第１端子は、電圧源３１に接続され、その第２端子は、端子Ｔ１に接続され、その制御端子には、信号ＯＶＮＥＧＩＮが入力される。スイッチング素子４１は、信号ＯＶＮＥＧＩＮがハイレベルの場合にオンし、信号ＯＶＮＥＧＩＮがローレベルの場合にオフする。
　スイッチング素子４２の第１端子は、電圧源３０に接続され、その第２端子は、端子Ｔ２に接続され、その制御端子には、信号ＯＶＮＥＧＩＮが入力される。スイッチング素子４２は、信号ＯＶＮＥＧＩＮがハイレベルの場合にオンし、信号ＯＶＮＥＧＩＮがローレベルの場合にオフする。
　スイッチング素子４３の第１端子は、電圧源３１に接続され、その第２端子は、端子Ｔ２に接続され、その制御端子には、信号ＯＶＰＯＳＩＮが入力される。スイッチング素子４３は、信号ＯＶＰＯＳＩＮがハイレベルの場合にオンし、信号ＯＶＰＯＳＩＮがローレベルの場合にオフする。
　スイッチング素子４４の第１端子は、電圧源３３に接続され、その第２端子は、端子Ｔ１に接続され、その制御端子には、信号ＣＯＮＮＥＧＩＮが入力される。スイッチング素子４４は、信号ＣＯＮＮＥＧＩＮがハイレベルの場合にオンし、信号ＣＯＮＮＥＧＩＮがローレベルの場合にオフする。
　スイッチング素子４５の第１端子は、電圧源３２に接続され、その第２端子は、端子Ｔ１に接続され、その制御端子には、信号ＣＯＮＰＯＳＩＮが入力される。スイッチング素子４５は、信号ＣＯＮＰＯＳＩＮがハイレベルの場合にオンし、信号ＣＯＮＰＯＳＩＮがローレベルの場合にオフする。
　スイッチング素子４６の第１端子は、電圧源３３に接続され、その第２端子は、端子Ｔ２に接続され、その制御端子には、信号ＣＯＮＰＯＳＩＮが入力される。スイッチング素子４６は、信号ＣＯＮＰＯＳＩＮがハイレベルの場合にオンし、信号ＣＯＮＰＯＳＩＮがローレベルの場合にオフする。
　スイッチング素子４７の第１端子は、電圧源３２に接続され、その第２端子は、端子Ｔ２に接続され、その制御端子には、信号ＣＯＮＮＥＧＩＮが入力される。スイッチング素子４７は、信号ＣＯＮＮＥＧＩＮがハイレベルの場合にオンし、信号ＣＯＮＮＥＧＩＮがローレベルの場合にオフする。
　［２］　調光装置１０の動作
　上記のように構成された調光装置１０の動作について説明する。図７は、制御回路１４の動作を説明するタイミング図である。前述したように、制御回路１４は、信号ＯＶＰＯＳＩＮ、信号ＣＯＮＰＯＳＩＮ、信号ＯＶＮＥＧＩＮ、及び信号ＣＯＮＮＥＧＩＮを生成する。
　時刻ｔ０において、制御回路１４は、信号ＯＶＰＯＳＩＮをハイレベル（例えば電圧Ｖｄｄ＝５Ｖ）にする。時刻ｔ１において、制御回路１４は、信号ＯＶＰＯＳＩＮをローレベル（例えば０Ｖ）にし、信号ＣＯＮＰＯＳＩＮをハイレベルにする。
　時刻ｔ２において、制御回路１４は、信号ＣＯＮＰＯＳＩＮをローレベルにし、信号ＯＶＮＥＧＩＮをハイレベルにする。時刻ｔ３において、制御回路１４は、信号ＯＶＮＥＧＩＮをローレベルにし、信号ＣＯＮＮＥＧＩＮをハイレベルにする。
　時刻ｔ４において、制御回路１４は、信号ＣＯＮＮＥＧＩＮをローレベルにし、信号ＯＶＰＯＳＩＮをハイレベルにする。時刻ｔ０～ｔ４が１つのサイクルであり、以後、同様のサイクルが繰り返される。
　図８は、駆動回路１２の動作を説明するタイミング図である。図８の時刻ｔ０～ｔ９は、図７の時刻ｔ０～ｔ９に対応する。図８には、（１）駆動回路１２が調光素子１１の端子Ｔ１に印加する駆動電圧ＯＵＴ１、（２）駆動回路１２が調光素子１１の端子Ｔ２に印加する駆動電圧ＯＵＴ２、（３）調光素子１１のノードＮ１の電圧Ｖ１ｏｕｔ、及び（４）調光素子１１のノードＮ２の電圧Ｖ２ｏｕｔを示している。図８において、駆動電圧ＯＵＴ１が実線、駆動電圧ＯＵＴ２が破線、電圧Ｖ１ｏｕｔが一点鎖線、電圧Ｖ２ｏｕｔが二点鎖線で示される。
　期間ｔ０～ｔ１において、スイッチング素子４０がオンし、電圧ＯＵＴ１＝Ｖｏｖ＋に設定される。また、期間ｔ０～ｔ１において、スイッチング素子４３がオンし、電圧ＯＵＴ２＝Ｖｏｖ－に設定される。これにより、末端側の電圧Ｖ１ｏｕｔは、端子Ｔ１に制御電圧Ｖｃ＋を印加する場合に比べて、速く立ち上がる。また、末端側の電圧Ｖ２ｏｕｔは、端子Ｔ２に制御電圧Ｖｃ－を印加する場合に比べて、速く立ち下がる。
　期間ｔ１～ｔ２において、スイッチング素子４５がオンし、電圧ＯＵＴ１＝Ｖｃ＋に設定される。また、期間ｔ１～ｔ２において、スイッチング素子４６がオンし、電圧ＯＵＴ２＝Ｖｃ－に設定される。これにより、末端側の電圧Ｖ１ｏｕｔは、制御電圧Ｖｃ＋に設定され、末端側の電圧Ｖ２ｏｕｔは、制御電圧Ｖｃ－に設定される。
　期間ｔ２～ｔ３において、スイッチング素子４１がオンし、電圧ＯＵＴ１＝Ｖｏｖ－に設定される。また、期間ｔ２～ｔ３において、スイッチング素子４２がオンし、電圧ＯＵＴ２＝Ｖｏｖ＋に設定される。これにより、末端側の電圧Ｖ１ｏｕｔは、端子Ｔ１に制御電圧Ｖｃ－を印加する場合に比べて、速く立ち下がる。また、末端側の電圧Ｖ２ｏｕｔは、端子Ｔ２に制御電圧Ｖｃ＋を印加する場合に比べて、速く立ち上がる。
　期間ｔ３～ｔ４において、スイッチング素子４４がオンし、電圧ＯＵＴ１＝Ｖｃ－に設定される。また、期間ｔ３～ｔ４において、スイッチング素子４７がオンし、電圧ＯＵＴ２＝Ｖｃ＋に設定される。これにより、末端側の電圧Ｖ１ｏｕｔは、制御電圧Ｖｃ－に設定され、末端側の電圧Ｖ２ｏｕｔは、制御電圧Ｖｃ＋に設定される。
　以後、サイクルｔ０～ｔ４と同じ動作が繰り返される。例えば、駆動周波数は、２０Ｈｚである。
　なお、オーバードライブ期間、すなわち、期間ｔ０～ｔ１、及び期間ｔ２～ｔ３の各々は、調光素子１１の負荷（抵抗及び容量）に応じて設定される。すなわち、オーバードライブ期間は、末端側の電圧Ｖ１ｏｕｔが制御電圧Ｖｃ－から制御電圧Ｖｃ＋に立ち上がる期間より短く設定される。また、オーバードライブ期間は、末端側の電圧Ｖ２ｏｕｔが制御電圧Ｖｃ＋から制御電圧Ｖｃ－に立ち下がる期間より短く設定される。
　図９は、調光素子１１における電圧対透過率（Ｖ－Ｔ：voltage-transmittance）特性の一例を示すグラフである。図９の横軸が電圧（Ｖ）、縦軸が透過率（％）であり、図９の横軸及び縦軸ともに任意単位である。図９の電圧は、液晶層に印加される電圧、すなわち、電極２２、２３間の電圧である。
　図９から理解できるように、調光素子１１に印加する電圧（駆動電圧）を変化させることで、調光素子１１の透過率を変化させることができる。また、調光素子１１に飽和電圧以上の駆動電圧を印加しても、透過率は変わらない。飽和電圧とは、最大透過率を実現する電圧のうち最小電圧である。例えば、電圧“（Ｖｃ＋）－（Ｖｃ－）”は、飽和電圧以下に設定される。よって、オーバードライブ電圧を液晶の耐圧を越えない範囲で、飽和電圧以上の電圧に設定した場合でも、オーバードライブ電圧を用いて、液晶の透過率に影響を及ぼすことなく、調光素子１１を駆動できる。
　端子側の実効電圧は、ほぼ制御電圧Ｖｃ＋、Ｖｃ－となる。また、末端側の電圧がより速いタイミングで制御電圧Ｖｃ＋、Ｖｃ－に到達するため、末端側の実効電圧も制御電圧Ｖｃ＋、Ｖｃ－に近くなる。これにより、端子側と末端側との透過率の差が小さくなり、色ムラを低減することができる。
　また、ゼロクロス点（電圧Ｖ１ｏｕｔと電圧Ｖ２ｏｕｔとが交差する点）を含む極性反転を行う期間（例えば、図８の期間ｔ０～ｔ１）では、液晶に印加される実効電圧が低いため、液晶の透過率は、所望の透過率にならない。特に、ゼロクロス点では、液晶に印加される電圧は、０Ｖである。しかし、本実施形態では、オーバードライブ駆動を用いることで、末端側の電圧がより速いタイミングで上昇する。これにより、極性反転を行う期間を短くできるので、フリッカーを低減することができる。
　［３］　比較例
　次に、比較例に係る調光装置について説明する。図１０は、比較例に係る駆動回路の回路図である。
　電圧源３２は、制御電圧Ｖｃ＋を生成する。電圧源３３は、制御電圧Ｖｃ－を生成する。例えば、Ｖｃ＋＝４０Ｖ、Ｖｃ－＝０Ｖである。
　スイッチング素子４４の第１端子は、電圧源３３に接続され、その第２端子は、端子Ｔ１に接続され、その制御端子には、信号ＮＥＧＩＮが入力される。スイッチング素子４４は、信号ＮＥＧＩＮがハイレベルの場合にオンし、信号ＮＥＧＩＮがローレベルの場合にオフする。
　スイッチング素子４５の第１端子は、電圧源３２に接続され、その第２端子は、端子Ｔ１に接続され、その制御端子には、信号ＰＯＳＩＮが入力される。スイッチング素子４５は、信号ＰＯＳＩＮがハイレベルの場合にオンし、信号ＰＯＳＩＮがローレベルの場合にオフする。
　スイッチング素子４６の第１端子は、電圧源３３に接続され、その第２端子は、端子Ｔ２に接続され、その制御端子には、信号ＰＯＳＩＮが入力される。スイッチング素子４６は、信号ＰＯＳＩＮがハイレベルの場合にオンし、信号ＰＯＳＩＮがローレベルの場合にオフする。
　スイッチング素子４７の第１端子は、電圧源３２に接続され、その第２端子は、端子Ｔ２に接続され、その制御端子には、信号ＮＥＧＩＮが入力される。スイッチング素子４７は、信号ＮＥＧＩＮがハイレベルの場合にオンし、信号ＮＥＧＩＮがローレベルの場合にオフする。
　図１１は、比較例に係る調光装置の動作を説明する図である。時刻ｔ０において、信号ＰＯＳＩＮがハイレベルにされ、信号ＮＥＧＩＮがローレベルにされる。時刻ｔ１において、信号ＰＯＳＩＮがローレベルにされ、信号ＮＥＧＩＮがハイレベルにされる。時刻ｔ２において、信号ＰＯＳＩＮがハイレベルにされ、信号ＮＥＧＩＮがローレベルにされる。
　期間ｔ０～ｔ１において、スイッチング素子４５がオンし、電圧ＯＵＴ１＝Ｖｃ＋に設定される。また、期間ｔ０～ｔ１において、スイッチング素子４６がオンし、電圧ＯＵＴ２＝Ｖｃ－に設定される。これにより、末端側の電圧Ｖ１ｏｕｔは、オーバードライブ駆動に比べて、緩やかに立ち上がる。また、末端側の電圧Ｖ２ｏｕｔは、オーバードライブ駆動に比べて、緩やかに立ち下がる。
　期間ｔ１～ｔ２において、スイッチング素子４４がオンし、電圧ＯＵＴ１＝Ｖｃ－に設定される。また、期間ｔ１～ｔ２において、スイッチング素子４７がオンし、電圧ＯＵＴ２＝Ｖｃ＋に設定される。これにより、末端側の電圧Ｖ１ｏｕｔは、オーバードライブ駆動に比べて、緩やかに立ち下がる。また、末端側の電圧Ｖ２ｏｕｔは、オーバードライブ駆動に比べて、緩やかに立ち上がる。
　比較例では、極性反転において、末端側の電圧Ｖ１ｏｕｔ、電圧Ｖ２ｏｕｔが所望の電圧（Ｖｃ＋、Ｖｃ－）になるまでの時間が長い。これにより、比較例では、フリッカーが大きくなってしまう。また、比較例では、端子側と末端側とで実効電圧が異なる期間が長くなるため、色ムラが発生してしまう。
　［４］　第１実施形態の効果
　以上詳述したように第１実施形態では、調光装置１０は、対向配置された基材２０、２１と、基材２０、２１にそれぞれ設けられた透明電極２２、２３と、透明電極２２、２３間に充填された液晶層２４と、透明電極２２、２３に電気的に接続された端子Ｔ１、Ｔ２とを含む調光素子１１と、端子Ｔ１に駆動電圧ＯＵＴ１を印加し、端子Ｔ２に駆動電圧ＯＵＴ１と極性が異なる駆動電圧ＯＵＴ２を印加する駆動回路１２とを具備する。駆動電圧ＯＵＴ１は、第１期間において正側オーバードライブ電圧Ｖｏｖ＋に設定され、前記第１期間に続く第２期間において正側制御電圧Ｖｃ＋に設定され、第２期間に続く第３期間において負側オーバードライブ電圧Ｖｏｖ－に設定され、第３期間に続く第４期間において負側制御電圧Ｖｃ－に設定される。
　従って第１実施形態によれば、端子側と反対側の電圧を、より速く制御電圧Ｖｃ＋、Ｖｃ－に設定することができる。これにより、端子側と末端側との透過率の差が小さくなり、色ムラを低減することができる。
　また、ゼロクロス点（電圧Ｖ１ｏｕｔと電圧Ｖ２ｏｕｔとが交差する点）を含む極性反転を行う期間では、フリッカーが発生する原因となる。しかし、本実施形態では、極性反転を行う期間を短くできるので、フリッカーを低減することができる。
　図１２は、第１例に係る消費される電荷量の模式図である。図１２の横軸は、端子－末端間の位置を表し、縦軸は、液晶に印加される電圧（印加電圧）を表している。例えば、０Ｖ～４０Ｖの領域は、透過率を変化させることが可能な階調領域であり、４０Ｖ～７０Ｖの領域は、透過率がほぼ変化しない飽和領域である。
　電荷量Ａは、通常パルス駆動における電荷量である。第１例の通常パルス駆動は、印加電圧４０Ｖを用い、かつ末端側の電圧が４０Ｖになるまで周波数を低くして駆動する例である。通常パルス駆動では、末端側が最終的に４０Ｖになるので、端子側と末端側との色ムラは低減できる。しかし、極性反転にかかる時間が長くなるので、フリッカーが大きくなる。
　電荷量Ｂは、通常パルス駆動に対するオーバードライブ駆動で増加する電荷量である。オーバードライブ駆動は、オーバードライブ電圧７０Ｖを用いて駆動する例である。端子側から末端側にいくにつれて電圧が低くなるので、電荷量Ｂは、端子側から末端側に向かって漸減する三角形で表される。オーバードライブ駆動を行う場合、電荷量Ｂの増加のみで、通常パルス駆動に比べて、フリッカーを低減できるとともに、色ムラが低減できる。
　電荷量Ｃは、フル駆動に対するオーバードライブ駆動で減少する電荷量である。フル駆動は、７０Ｖを用いて駆動する例である。すなわち、“電荷量Ａ＋電荷量Ｂ＋電荷量Ｃ”がフル駆動の電荷量である。フル駆動では、フリッカーは低減されるが、消費される電荷量が大きくなる。オーバードライブ駆動では、フル駆動と同程度にフリッカーを低減できつつ、フル駆動に比べて消費される電荷量を低減できる。
　図１３は、第２例に係る消費される電荷量の模式図である。第２例は、中間調を実施した場合の例である。
　電荷量Ｄは、通常パルス駆動における電荷量である。第２例の通常パルス駆動は、印加電圧２０Ｖを用い、かつ末端側の電圧が２０Ｖになるまで周波数を低くして駆動する例である。通常パルス駆動では、末端側が最終的に２０Ｖになるので、端子側と末端側との色ムラは低減できる。しかし、極性反転にかかる時間が長くなるので、フリッカーが大きくなる。また、フリッカーを低減させるために、周波数を大きくすると、端子側と末端側との電位差が大きくなり、色ムラが発生する。周波数を大きくした場合の電荷量は、図１３の破線で示した下の領域である。すなわち、色ムラとフリッカーとはトレードオフの関係にある。
　電荷量Ｅは、通常パルス駆動に対するオーバードライブ駆動で増加する電荷量である。オーバードライブ駆動を用いて中間調を実施した場合でも、電荷量Ｅの増加のみで、通常パルス駆動に比べて、フリッカーを低減できるとともに、色ムラが低減できる。また、第２例の場合も、オーバードライブ駆動では、７０Ｖのフル駆動と同程度にフリッカーを低減できる。
　［第２実施形態］
　第２実施形態は、駆動回路１２、及び電源回路１３の具体的な構成例である。第２実施形態は、トランジスタを用いてデジタル式に駆動回路１２を構成した例である。
　図１４は、本発明の第２実施形態に係る駆動回路１２を主として示した回路図である。本実施形態では、駆動回路１２を構成する複数のスイッチング素子の各々は、ＭＯＳトランジスタ、又はバイポーラトランジスタから構成される。本実施形態では、ＮチャネルＭＯＳトランジスタ（又はパワーＭＯＳトランジスタ）を用いる例について説明する。調光素子１１は、等価回路として表現すると、図５から理解されるように、抵抗性負荷ＲＬと、容量性負荷ＣＬとを含む。
　制御回路１４は、タイミング発生回路１４Ａを備える。タイミング発生回路１４Ａは、信号ＯＶＰＯＳＩＮ、信号ＣＯＮＰＯＳＩＮ、信号ＯＶＮＥＧＩＮ、及び信号ＣＯＮＮＥＧＩＮのタイミングを制御する。
　駆動回路１２は、ゲートドライバ１２Ａを備える。ゲートドライバ１２Ａは、タイミング発生回路１４Ａから、信号ＯＶＰＯＳＩＮ、信号ＣＯＮＰＯＳＩＮ、信号ＯＶＮＥＧＩＮ、及び信号ＣＯＮＮＥＧＩＮを受ける。ゲートドライバ１２Ａは、信号ＯＶＰＯＳＩＮ、信号ＣＯＮＰＯＳＩＮ、信号ＯＶＮＥＧＩＮ、及び信号ＣＯＮＮＥＧＩＮを用いて、これらの信号レベルを、トランジスタに最適なゲート電圧レベルに設定する。そして、ゲートドライバ１２Ａは、トランジスタに最適なゲート電圧レベルの信号として、信号ＯＶＰＯＳＩＮ－Ｇ、信号ＣＯＮＰＯＳＩＮ－Ｇ、信号ＯＶＮＥＧＩＮ－Ｇ、及び信号ＣＯＮＮＥＧＩＮ－Ｇを生成する。
　駆動回路１２は、ＮチャネルＭＯＳトランジスタ４０～４３、４４Ａ、４４Ｂ、４５Ａ、４５Ｂ、４６Ａ、４６Ｂ、４７Ａ、４７Ｂを備える。また、ゲートドライバ１２Ａには、信号線４０Ｓ、４２Ｓ、４４Ｓ、４５Ｓ、４６Ｓ、４７Ｓが接続される。信号線４０Ｓ、４２Ｓ、４４Ｓ、４５Ｓ、４６Ｓ、４７Ｓは、上記の最適なゲート電圧レベルを設定するために、トランジスタのソース電圧レベルをゲートドライバ１２Ａに与えるものである。
　トランジスタ４０のドレインは、オーバードライブ電圧Ｖｏｖ＋を生成する電圧源３０に接続され、そのソースは、端子Ｔ１に接続され、そのゲートには、信号ＯＶＰＯＳＩＮ－Ｇが入力される。また、トランジスタ４０のソースは、信号線４０Ｓを介して、ゲートドライバ１２Ａに接続される。
　トランジスタ４１のドレインは、端子Ｔ１に接続され、そのソースは、オーバードライブ電圧Ｖｏｖ－を生成する電圧源３１に接続され、そのゲートには、信号ＯＶＮＥＧＩＮ－Ｇが入力される。
　トランジスタ４２のドレインは、電圧源３０に接続され、そのソースは、端子Ｔ２に接続され、そのゲートには、信号ＯＶＮＥＧＩＮ－Ｇが入力される。また、トランジスタ４２のソースは、信号線４２Ｓを介して、ゲートドライバ１２Ａに接続される。
　トランジスタ４３のドレインは、端子Ｔ２に接続され、そのソースは、電圧源３１に接続され、そのゲートには、信号ＯＶＰＯＳＩＮ－Ｇが入力される。
　トランジスタ４４Ａ、４４Ｂは、図６のスイッチング素子４４を構成する。トランジスタ４４Ａのドレインは、端子Ｔ１に接続され、そのソースは、トランジスタ４４Ｂのソースに接続され、そのゲートには、信号ＣＯＮＮＥＧＩＮ－Ｇが入力される。トランジスタ４４Ｂのドレインは、制御電圧Ｖｃ－を生成する電圧源３３に接続され、そのゲートには、信号ＣＯＮＮＥＧＩＮ－Ｇが入力される。また、トランジスタ４４Ａのソースは、信号線４４Ｓを介して、ゲートドライバ１２Ａに接続される。
　トランジスタ４５Ａ、４５Ｂは、図６のスイッチング素子４５を構成する。トランジスタ４５Ａのドレインは、端子Ｔ１に接続され、そのソースは、トランジスタ４５Ｂのソースに接続され、そのゲートには、信号ＣＯＮＰＯＳＩＮ－Ｇが入力される。トランジスタ４５Ｂのドレインは、制御電圧Ｖｃ＋を生成する電圧源３２に接続され、そのゲートには、信号ＣＯＮＰＯＳＩＮ－Ｇが入力される。また、トランジスタ４５Ａのソースは、信号線４５Ｓを介して、ゲートドライバ１２Ａに接続される。
　トランジスタ４６Ａ、４６Ｂは、図６のスイッチング素子４６を構成する。トランジスタ４６Ａのドレインは、端子Ｔ２に接続され、そのソースは、トランジスタ４６Ｂのソースに接続され、そのゲートには、信号ＣＯＮＰＯＳＩＮ－Ｇが入力される。トランジスタ４６Ｂのドレインは、電圧源３３に接続され、そのゲートには、信号ＣＯＮＰＯＳＩＮ－Ｇが入力される。また、トランジスタ４６Ａのソースは、信号線４６Ｓを介して、ゲートドライバ１２Ａに接続される。
　トランジスタ４７Ａ、４７Ｂは、図６のスイッチング素子４７を構成する。トランジスタ４７Ａのドレインは、端子Ｔ２に接続され、そのソースは、トランジスタ４７Ｂのソースに接続され、そのゲートには、信号ＣＯＮＮＥＧＩＮ－Ｇが入力される。トランジスタ４７Ｂのドレインは、電圧源３２に接続され、そのゲートには、信号ＣＯＮＮＥＧＩＮ－Ｇが入力される。また、トランジスタ４７Ａのソースは、信号線４７Ｓを介して、ゲートドライバ１２Ａに接続される。
　電源回路１３は、電圧源１３Ａ、及び電圧源３０～３３を備える。電圧源１３Ａは、電源電圧ＶＣＣから電圧Ｖｉｎを生成する。
　電圧源３０は、定電圧素子としてのツェナーダイオード（定電圧ダイオード）３０Ａ、及び抵抗（抵抗素子）３０Ｂを備える。ツェナーダイオード３０Ａのカソードは、電圧源１３Ａに接続され、そのアノードは、抵抗３０Ｂの一端に接続される。抵抗３０Ｂの他端は、接地端子ＧＮＤに接続される。電圧源３０は、他の構成を用いてもよい。例えば、扱う電圧が大きい場合には、２個又はそれ以上のツェナーダイオードを直列接続してもよい。また、ツェナーダイオード３０Ａと抵抗３０Ｂとの接続ノードに、電流増幅用のＮＰＮトランジスタを追加してもよい。また、電圧源３０は、電圧制御端子を備えたシリーズレギュレータで構成してもよい。また、電圧源３０は、ＤＣ／ＤＣコンバータで構成してもよい。
　電圧源３２は、ツェナーダイオード３２Ａ、及び抵抗３２Ｂを備える。抵抗３２Ｂの一端は、電圧源１３Ａに接続され、その他端は、ツェナーダイオード３２Ａのカソードに接続される。ツェナーダイオード３２Ａのアノードは、接地端子ＧＮＤに接続される。電圧源３２には、電圧源３０と同様の他の構成例を用いてもよい。
　電圧源３３は、ツェナーダイオード３３Ａ、及び抵抗３３Ｂを備える。ツェナーダイオード３３Ａのカソードは、電圧源１３Ａに接続され、そのアノードは、抵抗３３Ｂの一端に接続される。抵抗３３Ｂの他端は、接地端子ＧＮＤに接続される。電圧源３３には、電圧源３０と同様の他の構成例を用いてもよい。
　以上詳述したように第２実施形態では、トランジスタを用いて駆動回路１２を構成することができる。第２実施形態の電圧制御は、第１実施形態の電圧制御と同じである。その他の効果は、第１実施形態と同じである。
　［第３実施形態］
　第３実施形態は、駆動回路１２、及び電源回路１３の具体的な構成例である。第３実施形態は、電力増幅器を用いてアナログ式に駆動回路１２を構成した例である。
　図１５は、本発明の第３実施形態に係る駆動回路１２を主として示した回路図である。駆動回路１２は、オーバードライブ波形発生回路１２Ｂ、及び電力増幅器１２Ｃ、１２Ｄを備える。オーバードライブ波形発生回路１２Ｂは、タイミング発生回路１４Ａからの制御信号を用いて、正側電圧波形ＶＰ、及び負側電圧波形ＶＮを生成する。
　電力増幅器１２Ｃ、１２Ｄは、第１象限から第４象限までの動作が可能な４象限出力が可能である。すなわち、電力増幅器１２Ｃ、１２Ｄは、電圧の向きによらず、電流の供給（ソース）と吸収（シンク）とが可能である。
　電力増幅器１２Ｃは、オーバードライブ波形発生回路１２Ｂから正極電圧波形ＶＰを受け、この正極電圧波形ＶＰを増幅する。電力増幅器１２Ｃは、駆動電圧ＯＵＴ１を出力する。駆動電圧ＯＵＴ１は、調光素子１１の端子Ｔ１に印加される。
　電力増幅器１２Ｄは、オーバードライブ波形発生回路１２Ｂから負極電圧波形ＶＮを受け、この負極電圧波形ＶＮを増幅する。電力増幅器１２Ｄは、駆動電圧ＯＵＴ２を出力する。駆動電圧ＯＵＴ２は、調光素子１１の端子Ｔ２に印加される。
　図１６は、駆動回路１２の動作を説明するタイミング図である。駆動電圧ＯＵＴ１、ＯＵＴ２は、第１実施形態の図８と同じ波形である。駆動電圧ＯＵＴ１は、前段の正極電圧波形ＶＰと波形は同じで、出力電流を増幅したものである。駆動電圧ＯＵＴ２は、前段の負極電圧波形ＶＮと波形は同じで、出力電流を増幅したものである。
　第２実施形態によれば、アナログ式にオーバードライブ駆動を実現できる。その他の効果は、第１実施形態と同じである。
　［実施例］
　上記実施形態では、ＰＤＬＣ又はＰＮＬＣを用いた液晶素子（調光素子）を例示しているが、これに限定されるものではない。調光素子としての液晶素子は、偏光板及び配向膜を液晶層の両側に配置した構成でもよく、ＴＮ（Twisted Nematic）方式、ＶＡ（Vertical Alignment）方式、又はＩＰＳ（In-Plane Switching）方式などを用いることができる。また、調光素子として、液晶素子以外で、電圧により屈折率が変化する様々な種類の電気光学素子を用いることができる。
　上記実施形態で示したスイッチング素子は、ＭＯＳトランジスタ、又はバイポーラトランジスタ以外に、炭化シリコン（ＳｉＣ）を半導体層に用いたＳｉＣ－ＭＯＳＦＥＴ、又は窒化ガリウム（ＧａＮ）を半導体層に用いたＧａＮ－ＭＯＳＦＥＴなどで構成してもよい。
　上記実施形態で説明した調光装置は、住宅、オフィス、又は公共施設における窓や室内パーテーション、商業施設又はイベント会場における映像投影スクリーンやサイネージ、自動車又は航空機における窓やサンルーフなどに適用可能である。
　上記実施形態では、液晶素子として調光素子を例に挙げて説明しているが、これに限定されず、本実施形態における駆動方法は、液晶を用いた様々な装置（液晶表示装置を含む）に適用可能である。
　なお、本発明は、上記実施形態に限定されるものではなく、実施段階ではその要旨を逸脱しない範囲で種々に変形することが可能である。また、各実施形態は適宜組み合わせて実施してもよく、その場合組み合わせた効果が得られる。更に、上記実施形態には種々の発明が含まれており、開示される複数の構成要件から選択された組み合わせにより種々の発明が抽出され得る。例えば、実施形態に示される全構成要件からいくつかの構成要件が削除されても、課題が解決でき、効果が得られる場合には、この構成要件が削除された構成が発明として抽出され得る。

Claims (8)

  1. 　第１及び第２基材と、前記第１及び第２基材にそれぞれ設けられた第１及び第２電極と、前記第１及び第２電極間に充填された液晶層と、前記第１及び第２電極に電気的に接続された第１及び第２端子とを含む調光素子と、
    　前記第１端子に第１駆動電圧を印加し、前記第２端子に前記第１駆動電圧と極性が異なる第２駆動電圧を印加する駆動回路と
    　を具備し、
    　前記第１駆動電圧は、第１期間において第１電圧に設定され、前記第１期間に続く第２期間において前記第１電圧より低い第２電圧に設定され、前記第２期間に続く第３期間において前記第２電圧より低い第３電圧に設定され、前記第３期間に続く第４期間において前記第２電圧より低くかつ前記第３電圧より高い第４電圧に設定される
    　調光装置。
  2. 　前記第１電圧と前記第３電圧との電圧差は、前記調光素子の耐圧より小さい
    　請求項１に記載の調光装置。
  3. 　前記第２電圧と前記第４電圧との電圧差は、前記調光素子の飽和電圧以下である
    　請求項１に記載の調光装置。
  4. 　前記駆動回路は、第１乃至第８スイッチング素子を含み、
    　前記第１スイッチング素子は、前記第１電圧を発生する第１電圧源と前記第１端子との間に接続され、
    　前記第２スイッチング素子は、前記第３電圧を発生する第３電圧源と前記第１端子との間に接続され、
    　前記第３スイッチング素子は、前記第１電圧源と前記第２端子との間に接続され、
    　前記第４スイッチング素子は、前記第３電圧源と前記第２端子との間に接続され、
    　前記第５スイッチング素子は、前記第２電圧を発生する第２電圧源と前記第１端子との間に接続され、
    　前記第６スイッチング素子は、前記第４電圧を発生する第４電圧源と前記第１端子との間に接続され、
    　前記第７スイッチング素子は、前記第２電圧源と前記第２端子との間に接続され、
    　前記第８スイッチング素子は、前記第４電圧源と前記第２端子との間に接続される
    　請求項１に記載の調光装置。
  5. 　第１乃至第４制御信号を生成する制御回路をさらに具備し、
    　前記第１制御信号は、前記第１及び第４スイッチング素子に入力され、
    　前記第２制御信号は、前記第２及び第３スイッチング素子に入力され、
    　前記第３制御信号は、前記第５及び第８スイッチング素子に入力され、
    　前記第４制御信号は、前記第６及び第７スイッチング素子に入力される
    　請求項４に記載の調光装置。
  6. 　前記第１期間において、前記第１制御信号が活性化され、
    　前記第２期間において、前記第３制御信号が活性化され、
    　前記第３期間において、前記第２制御信号が活性化され、
    　前記第４期間において、前記第４制御信号が活性化される
    　請求項５に記載の調光装置。
  7. 　前記第１乃至第４電圧源の各々は、定電圧素子を含む
    　請求項４に記載の調光装置。
  8. 　前記第１乃至第８スイッチング素子の各々は、トランジスタで構成される
    　請求項４に記載の調光装置。
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