WO2007104534A1 - Schaltungsanordnung und verfahren zum bereitstellen eines taktsignals mit einem einstellbaren tastverhältnis - Google Patents

Schaltungsanordnung und verfahren zum bereitstellen eines taktsignals mit einem einstellbaren tastverhältnis Download PDF

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WO2007104534A1
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circuit
input
output
circuit arrangement
amplifier
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PCT/EP2007/002209
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Urs Denier
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Austriamicrosystems Ag
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    • H03—ELECTRONIC CIRCUITRY
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    • H03K5/156—Arrangements in which a continuous pulse train is transformed into a train having a desired pattern
    • H03K5/1565—Arrangements in which a continuous pulse train is transformed into a train having a desired pattern the output pulses having a constant duty cycle
    • H—ELECTRICITY
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    • H03K5/08—Shaping pulses by limiting; by thresholding; by slicing, i.e. combined limiting and thresholding

Definitions

  • the present invention relates to a circuit arrangement for providing a clock signal with an adjustable duty cycle, their use and a method for providing a clock signal with an adjustable duty cycle.
  • the document US Pat. No. 5,481,228 describes an arrangement for controlling the duty cycle with series-connected transistor stages.
  • the object of the present invention is to provide a circuit arrangement and a method for providing a clock signal, which allow an exact adjustment of the duty cycle of the clock signal.
  • a circuit arrangement for providing a clock signal with an adjustable duty cycle comprises an amplifier circuit, a low-pass filter and an integrator circuit.
  • the amplifier circuit is connected at a first input to an input of the circuit arrangement.
  • the amplifier circuit is coupled at an output to an output of the circuit arrangement.
  • the low-pass filter is connected on the input side to the output of the amplifier circuit and on the output side to the integrator circuit.
  • the integrator circuit in turn is connected on the output side to a second input of the amplifier circuit.
  • the input of the circuit arrangement is used to connect an oscillator.
  • An oscillator voltage is supplied to the input of the circuit arrangement.
  • a clock signal with a duty cycle can be tapped.
  • a signal applied to the output of the amplifier circuit is supplied to the low-pass filter.
  • a signal which can be tapped off at the low-pass on the output side is fed to the integrator circuit.
  • the integrator circuit is designed to deliver a predefinable threshold for controlling the duty cycle. This threshold will be the second input of the Amplifier circuit supplied.
  • the amplifier circuit outputs a signal on the output side which is provided as a function of the oscillator signal and the threshold value.
  • the signal provided by the amplifier circuit is thus fed back via the low-pass filter and the integrator circuit to the second input of the amplifier circuit.
  • the low-pass filter provides a signal which, to a first approximation, is designed as a DC signal and corresponds to a value of the pulse duty factor.
  • a threshold value of the amplifier circuit can be set by means of the threshold value provided by the integrator circuit. It is an advantage of the circuit arrangement that one phase of the clock signal is almost identical to one phase of the oscillator signal.
  • the amplifier circuit has a buffer with an input, which by means of an - A -
  • Nes coupling capacitor is connected to the first input of the amplifier circuit.
  • the buffer is furthermore connected to the input of the amplifier circuit at the input and to the output of the amplifier circuit on the output side.
  • the buffer may include an inverter.
  • the buffer may comprise a first inverter and a second inverter, wherein the second inverter is connected downstream of the first inverter.
  • the current driving capability of the second inverter may be greater than the current driving capability of the first inverter.
  • a width to length ratio of the P-channel field effect transistor of the second inverter greater than a width to length ratio of the P-channel field effect transistor of the first inverter and corresponding to a width to length ratio of the N-channel field effect transistor of the second inverter may be larger than a width-to-length ratio of the N-channel field effect transistor of the first inverter. This improves the ability to drive.
  • the buffer may include more than two inverters.
  • an even number of inverters will cause almost no phase shift in the amplifier circuit.
  • a signal supplied to the buffer can be converted into a rectangular signal, which is output as the clock signal.
  • the clock signal is thus present as discrete-value, preferably digital signal.
  • the amplifier circuit can be designed to provide on the output side a square wave signal as a clock signal.
  • the amplifier circuit comprises the first input, the second input, the comparator whose inputs form the first and the second input of the amplifier circuit, the buffer having the first inverter and the output of the comparator with the output the amplifier circuit couples, and the output of the amplifier circuit.
  • the integrator circuit comprises a transconductance amplifier.
  • the transconductance amplifier is coupled at a first input to the low-pass filter and at an output to the second input of the amplifier circuit.
  • the transconductance amplifier can be supplied with a reference voltage at a second input.
  • the reference voltage may be supplied to the circuit arrangement via an input of the circuit arrangement or generated internally.
  • the reference voltage may preferably be a constant voltage or DC voltage.
  • the reference voltage is preferably AC voltage free.
  • the integrator circuit preferably has a DC voltage source for providing the reference voltage.
  • the duty cycle depends on the reference chip from a value of the reference voltage for setting the threshold and thus the duty cycle is used.
  • the DC voltage source of the integrator circuit has a voltage divider with a first and a second resistor, which is connected between a supply voltage connection and a reference potential connection.
  • a tap of the voltage divider between the two resistors is connected to the second input of the transconductance amplifier or to the noninverting input of the operational amplifier.
  • the reference voltage can be provided.
  • the first and the second resistor are designed with the same resistance value.
  • a switched-capacitor circuit instead of the voltage divider, can be provided, which is covered by the DC voltage source.
  • the switched capacitor circuit includes first and second switched capacitors connected in series between a supply voltage terminal and a reference potential terminal, and a tap between the first and second switched capacitors.
  • the tap of the switched-capacitor circuit is connected to the second input of the transconductance amplifier or the non-inverting one Input of the operational amplifier connected.
  • the reference voltage provided at the tap may, in a first approximation, be independent of a value of the first and a value of the second switched capacitor and may be approximately half of the supply voltage.
  • a hold capacitor connects the tap of the switched-capacitor circuit to the reference potential terminal.
  • the low-pass filter which is connected between the output of the amplifier circuit and the input of the integrator circuit, can be configured as a first-order low-pass filter and can have a resistor and a capacitor. Alternatively, it can be realized as a low-pass higher order. It can be designed as a transconductance amplifier C-filter.
  • a control loop comprising the amplifier circuit, the low-pass filter and the integrator circuit, advantageously a duty cycle of the clock signal can be set precisely.
  • the coupleable oscillator may be a crystal oscillator.
  • the crystal oscillator can be realized as Piercescrien.
  • the oscillator may be formed as a ring oscillator.
  • the oscillator can be realized as a relaxation oscillator.
  • the relaxation oscillator can be designed as an LC oscillator or preferably as an RC oscillator.
  • a method for providing a clock signal with an adjustable duty cycle provides the following steps: An oscillator signal is supplied to an amplifier circuit. Depending on a threshold value, the oscillator signal is processed. The processed oscillator signal is provided on the output side as a clock signal with the duty cycle. From the duty cycle, a signal is derived. The signal derived from the duty cycle is compared with a predefinable reference voltage and the threshold value is provided as a function of the comparison result.
  • the threshold value and thus the duty cycle can thus be adjusted by means of a reference voltage.
  • FIG. 1 shows an exemplary embodiment of the circuit arrangement as a block diagram according to the proposed principle
  • FIGS. 2A and 2B show exemplary embodiments of FIG
  • FIG. 3 shows exemplary signal profiles of a circuit arrangement according to the proposed principle as a function of time
  • FIGS. 4A to 4D show an exemplary embodiment of a switched capacitor circuit
  • FIG. 5 shows an exemplary embodiment of a first and a second inverter
  • FIG. 6 shows an exemplary embodiment of an operational amplifier
  • Figures 7A to 7B show an exemplary embodiment of a clocked transconductance amplifier.
  • FIG. 1 shows an exemplary embodiment of a circuit arrangement as a block diagram according to the proposed principle.
  • the circuit arrangement 1 comprises an amplifier circuit 20, a low-pass filter 40 and an integrator circuit 50.
  • the circuit arrangement 1 furthermore has an input 2, which is connected to the oscillator 3.
  • the circuit arrangement 1 further comprises an output 4 for outputting a clock signal Vout.
  • the amplifier circuit 20 is connected at a first input 21 to the input 2 of the circuit arrangement 1 and at an output 23 to the output 4 of the circuit arrangement 1 and to an input of the low-pass filter 40.
  • the integrator circuit 50 is connected on the input side to the low-pass filter 40 and on the output side to a second input 22 of the amplifier circuit.
  • the oscillator 3 provides on the output side an oscillator voltage Vosc, which is supplied to the first input 21 of the amplifier circuit 20 and thus to the comparator 24.
  • the clock signal Vout with a clock ratio ⁇ is formed by means of the comparator 24 as a function of the oscillator voltage Vosc and a threshold voltage Vth, which can be tapped on the output side of the integrator circuit 50.
  • the clock signal Vout is filtered using the low-pass filter 40, so that on the output side of the low-pass filter 40, a signal representing the clock ratio ⁇ , can be tapped off.
  • This signal is compared by means of the transconductance amplifier 51 with a reference voltage Vref, the output side of the voltage divider 55 can be tapped.
  • the reference voltage Vref is an ne DC voltage.
  • the loop filter 71 filters out a signal that can be tapped on the output side of the transconductance amplifier 51 and supplies it to the second input 22 of the circuit arrangement 1.
  • the duty cycle ⁇ of the clock signal Vout is set in accordance with the reference voltage by means of the circuit arrangement 1.
  • the amplifier circuit 20, the low-pass filter 40 and the integrator circuit 50 form a control circuit.
  • a switched-capacitor circuit 59 may be provided as a DC voltage source 75, which provides the reference voltage Vref on the output side.
  • an operational amplifier 65 having an inverting and a noninverting input 66, 67 may be provided, which are coupled to the output of the low pass 40 and a tap of the voltage divider 55.
  • FIG 2A shows an exemplary embodiment of a circuit arrangement according to the proposed principle with reference to a development of the block diagram of Figure 1.
  • the oscillator 3 comprises a quartz crystal 10, at a first connection via a first capacitor 11 and at a second terminal via a second Capacitor 12 is connected to a reference potential terminal 8. The first and the second terminal of the quartz crystal 10 are beyond connected together via a resistor 13.
  • the first terminal of the quartz oscillator 10 is connected to a control terminal of an inverter 14, 15.
  • the inverter has a P-channel field effect transistor 14 and an N-channel field effect transistor 15, which are connected between a supply voltage connection 9 and the reference potential connection 8.
  • a tap between the controlled paths of the two transistors 14, 15 is connected to the second terminal of the quartz oscillator 10 and the input 2 of the circuit arrangement 1.
  • the low pass 40 includes a resistor 41 and a capacitor 42.
  • the resistor 41 connects an input to an output of the low pass 40 and the capacitor 42 connects the output of the low pass 40 to the reference potential terminal 8.
  • the voltage divider 55 which is included in the DC voltage source 75 , comprises a first and a second resistor 56, 57 which are connected between the supply voltage terminal 9 and the reference potential terminal 8. A tap between the first and second resistors 56, 57 is connected to the second input 53 of the transconductance amplifier 51.
  • the low-pass filter 40 is connected on the output side to a first input 52 of the transconductance amplifier 51.
  • An output 54 of the transconductance amplifier 51 is connected to the second input 22 of the amplifier circuit 20.
  • the output side of the oscillator voltage Vosc can be tapped.
  • the comparator 24 compares the oscillator voltage Vosc with the threshold value Vth, which is provided by the integrator circuit 50 on the output side.
  • the comparator 24 outputs the clock signal Vout with the duty cycle ⁇ on the output side.
  • the clock signal Vout is filtered by means of the low-pass filter 40, so that an approximately constant signal is present at the first input 52 of the transconductance amplifier 51, which represents the duty cycle ⁇ .
  • a current at the output 54 of the transconductance amplifier 51 is formed in response to the filtered signal and the reference voltage Vref tapped at the tap between the first and second resistors 56,57.
  • the first input 52 of the transconductance amplifier 51 is designed as a non-inverting input and the second input 53 as an inverting input.
  • the integrator circuit 50 provides the output side of the threshold value Vth in response to the current at the output 54 of the transconductance amplifier 51 and a filter characteristic of the loop filter 71 ready.
  • the loop filter 71 is formed as a low-pass filter. In the forward branch of the control loop only the amplifier circuit 20 is provided, which has only a small phase delay. In the feedback branch, the low-pass filter 40 and the integrator circuit 50 including the loop filter 71 are provided. The low-pass filter 40 and the loop filter 71 produce a phase shift of up to 90 degrees each. From the connection of the integrator circuit 50 with the inverting input of the comparator 24 results in a further phase shift of approximately 180 degrees, so that the phase shift in the control loop a total of 360 degrees
  • FIG. 2B shows a further exemplary embodiment of a circuit arrangement according to the proposed principle.
  • the amplifier circuit 20 ' accordinging to FIG. 2B has a coupling capacitor 28 which connects the first input 21 of the amplifier circuit 20' to the input of the buffer 25.
  • the second input 22 of the amplifier circuit 20 ' is also connected to the input of the buffer 25.
  • the input of the first inverter 26 thus the threshold value Vth is supplied, which is formed in a first approximation as a DC voltage.
  • This DC voltage is superposed by means of the coupling capacitor 28, the oscillator voltage Vosc or a portion of the oscillator voltage Vosc.
  • a signal can be tapped off at the first inverter 26, which signal essentially has the low and high levels, which are formed as a function of the coupled-in AC voltage signal and the threshold value Vth.
  • the first inverter 26 has an inverter threshold for the transition from the low level to the high level.
  • the value Low is output by the first inverter 26 on the output side, and the value High, which is simultaneously the value of the clock signal Vout, from the downstream second inverter 27.
  • the amplifier circuit 20 ' According to FIG. 2B that the realization by means of a first and a second inverter 26, 27 requires a very low expenditure on components. It is an advantage of the circuit arrangement 1 according to FIG. 2B.
  • the duty cycle ⁇ of the clock signal Vout is almost independent of the inverter threshold value of the first inverter 26 and an inverter threshold value of the second inverter 27. This is achieved on the one hand in that the two inverters 26, 27 are connected in series and, for example, an increased inverter threshold value of the first inverter 26 is compensated by an increased inverter threshold value of the second inverter 27.
  • the threshold value Vth is set in such a way that the desired duty cycle ⁇ is achieved even if the inverter threshold values deviate from a prescribed value.
  • FIG. 3 shows exemplary signal curves as a function of the time t, as can be tapped, for example, in a circuit arrangement 1 according to FIGS. 1 and 2A.
  • FIGS. 4A to 4D show an exemplary embodiment of the DC voltage source 75, which comprises a switched-capacitor circuit 59, which can be used instead of the voltage divider 55 in the integrator circuit 50 according to FIG. 1 as well as in FIGS. 2A and 2B.
  • FIG. 4A shows the switched-capacitor circuit 59 for providing the reference voltage Vref, which is a fixed voltage.
  • the switched-capacitor circuit 59 comprises a first and a second switched capacitor 60, 61 as well as a holding capacitor 62.
  • the holding capacitor 62 is connected between the tap 63, at which the reference voltage Vref is provided, and the reference potential terminal 8.
  • the tap 63 may in one embodiment be connected to the second input 53 of the transconductance amplifier 51.
  • the first switching capacitor 60 is connected at a first electrode in a first phase A via a switch 84 to the supply voltage terminal 9 and at a second electrode via a transistor 85 to the tap 63.
  • the second switching capacitor 61 is connected in the first phase A at a first electrode via a switch 86 to the tap 63 and at a second electrode via a switch 87 to the reference potential terminal 8.
  • the first electrode of the first switching capacitor 60 is connected to the tap 63 via a switch 80 and to the reference potential terminal 8 at the second electrode via a switch 81.
  • the first electrode of the second switched capacitor 61 is connected to the supply voltage terminal 9 via a switch 82 and the second electrode is connected via a switch 82
  • FIG. 4A shows a control arrangement 64, the output side with the switches 84 to 87 for supplying a first phase signal phl and connected to the switches 80 to 83 for supplying a second phase signal ph2.
  • the control arrangement 64 is coupled to the input 2 of the circuit arrangement 1. This coupling is provided for generating the periodically occurring phase signals phl, ph2 by means of the control arrangement 64.
  • one of the two switched capacitors 60, 61 is thus connected between the tap 63 and the reference potential terminal 8 in one phase and between the supply voltage terminal 9 and the tap 63 in the other phase.
  • the difference between the supply voltage Vdd and the reference voltage Vref and at the second of the two switched capacitors 60, 61 the reference voltage Vref.
  • a stable value is provided for the reference voltage Vref, which is approximately half the value of the supply voltage Vdd. This value of the reference voltage Vref is, to a first approximation, independent of the values of the capacitors 60, 61, 62.
  • a reference voltage Vref can be provided, which has the value 1/2, which corresponds to a duty cycle of also 1/2.
  • the reference voltage provided at tap 63 is, to a first approximation, independent of a frequency with which first and second switched capacitor 60, 61 are switched.
  • the switches 80 to 87 may be formed in one embodiment as field effect transistors.
  • FIG. 4B shows the first and the second control signal phl, ph2.
  • a time t1 is in the first phase A, during which the first phase signal phl has the logical value High
  • a time t2 is in the second phase B, during which the phase signal ph2 has the logical value High.
  • Non-overlap phases are provided between the first phase A and the second phase B. Apart from that, the phases A, B alternate periodically.
  • a short circuit between the supply voltage connection 9 and the tap 63 and a short circuit between the tap 63 and the reference potential connection 8 are thus avoided.
  • FIG. 4C shows the switching position of the switched-capacitor circuit 59 at the time t 1 during the first phase A.
  • the first switched capacitor 60 couples the supply voltage Vdd to the reference voltage Vref, while the second switched capacitor 61 couples the reference voltage Vref to the reference potential Vss ,
  • FIG. 5 shows an exemplary embodiment of a buffer 25, as it can be used in the amplifier circuit 20 of the circuit arrangement 1 according to Figure 1, 2A and 2B.
  • the buffer 25 has a first and a second inverter 26, 27.
  • the first inverter comprises a P-channel field-effect transistor 30 and an N-channel field-effect transistor 31 connected in series with one another and between the supply voltage connection 9 and the reference potential connection 8. tet are.
  • the second inverter 27 has a P-channel field effect transistor 32 and an N-channel field effect transistor 33, which are connected in series with one another and between the supply voltage connection 9 and the reference potential connection 8.
  • the four transistors 30 to 33 are designed as self-blocking transistors.
  • the P-channel field effect transistor 30 has a channel width WpI and a channel length LpI. Accordingly, the P-channel field effect transistor 32 has a channel width Wp2 and a channel length Lp2, and the N-channel field effect transistor 31 has a channel width WnI and a channel length LnI, and the N-channel field effect transistor has a channel width Wn2 and a channel length Ln2.
  • the channel widths WpI, Wp2 and the channel lengths LpI and Lp2 of the P-channel field effect transistor 30 and the P-channel field effect transistor 32 may have approximately the same values.
  • the channel widths WnI, Wn2 of the two N-channel field effect transistors 31, 33 and the channel lengths LnI, Ln2 of the two N-channel field effect transistors 31, 33 can have approximately the same values.
  • the current driving capability of the first inverter 26 and the second inverter 27 is approximately equal.
  • FIG. 6 shows an operational amplifier 65 which can be used in place of the transconductance amplifier 51 in the integrator circuit 50 according to FIGS. 1, 2A and 2B.
  • An inverting input 66 of the operational amplifier 65 is connected via a feedback capacitor 69 to an output 68 of the operational amplifier 65.
  • the output 68 of the operational amplifier 65 is coupled to the second input 22 of the amplifier circuit 20 via the loop filter 71 (not shown in FIG. 6).
  • the low-pass filter 40 is connected on the output side to the inverting input 66.
  • a non-inverting input 67 of the operational amplifier 65 is connected to the tap 63 of the switched-capacitor circuit 59 or the tap between the two resistors 56, 57 of the voltage divider 55 for supplying the reference voltage Vref to the operating amplifier 65. Due to the feedback capacitance 69, the operational amplifier 65 is connected as an integrating amplifier.
  • the operational amplifier 65 is connected to the second input 22 of the amplifier circuit 20 without the interposition of the loop filter 71.
  • FIGS. 7A to 7B show an exemplary embodiment of a clocked transconductance amplifier 51 as can be used in the integrator circuit 50 according to FIGS. 1, 2A and 2B.
  • the transconductance amplifier 51 is designed for chopper operation.
  • FIG. 7A shows the schematic diagram of the transconductance amplifier 61 with the first and the second input 52, 53 for supplying a first and a second input voltage Vinn, Vinp.
  • the transconductance amplifier 51 is connected to two outputs of a control arrangement 58 for supplying a first and a second control signal ⁇ 1, ⁇ 2. On the output side, an output voltage Vouto can be tapped off at the transconductance amplifier 51.
  • the taps 108, 109 are coupled to the first and second inputs 52, 53 by means of the switches 104 to 107 for supplying the first and second input voltages Vinp, Vinn.
  • a tap between the transistor 90 and the transistor 100 is coupled via a switch 102 to the output 54 of the transconductance amplifier 51.
  • a tap between the transistor 93 and the transistor 101 is coupled via a switch 103 to the output 54 of the transconductance amplifier 51.
  • a control connection of the transistor 100 is connected to a control terminal of the transistor 101. Via a switch 98, the two control terminals are coupled to the tap between the transistors 90, 100. Also, the two control terminals via a switch 99 to the tap between the transistors 93, 101 are coupled.
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Abstract

Die Schaltungsanordnung (1) umfasst einen Eingang (2) zum Anschließen eines Oszillator (3) und eine Verstärkerschaltung (20) mit einem ersten Eingang (21), der mit dem Eingang (21) der Schaltungsanordnung (1) gekoppelt ist, mit einem zweiten Eingang (22) und mit einem Ausgang (23), der mit einem Ausgang (4) der Schaltungsanordnung (1) verbunden ist. An dem Ausgang 44) der Schaltungsanordnung (1) ist ein Taktsignal (Vout) mit einem Tastverhältnis (ϕ) abgreifbar. Weiter weist die Schaltungsanordnung (1) einen Tiefpass (40), der eingangsseitig mit dem Ausgang (23) der Verstärkerschaltung (20) verbunden ist, und eine Integratorschaltung (50) auf, die eingangsseitig mit dem Tiefpass (40) und ausgangs seitig mit dem zweiten Eingang (22) der Verstärkerschaltung (20) zur Abgabe eines vorgebbaren Schwellwertes (Vth) zur Steuerung des Tastverhältnisses (ϕ) verbunden ist.

Description

Beschreibung
Schaltungsanordnung und Verfahren zum Bereitstellen eines Taktsignals mit einem einstellbaren Tastverhältnis
Die vorliegende Erfindung betrifft eine Schaltungsanordnung zum Bereitstellen eines Taktsignals mit einem einstellbaren Tastverhältnis, deren Verwendung und ein Verfahren zum Bereitstellen eines Taktsignals mit einem einstellbaren Tast- Verhältnis.
Oszillatoren und insbesondere Schwingquarzoszillatoren sind weit verbreitete Schaltkreise, um Mikroprozessoren und Speicherbausteine mit einem Taktsignal zu versorgen. Dabei wird häufig ein genaues Tastverhältnis gefordert. Das Tastverhältnis eines Taktsignals wird üblicherweise als das Verhältnis der Zeit, während der sich das Taktsignal auf einem Pegel "High" befindet, zu einer Periodendauer des Taktsignals definiert .
Das Dokument "High-Performance Crystal Oscillator Circuits: Theory and Application", Autoren E. Vittoz, M. Degrauwe, S. Bitz, IEEE Journal of Solid-State Circuits, Band 23, Nummer 3, Juni 1988, pp. 774 bis 783 beschreibt ein Ersatzschaltbild eines Schwingquarzes und einen Schwingquarzschaltkreis.
Das Dokument US 4,959,557 befasst sich mit einem Schaltkreis mit einem Vorwärts- und einem Rückkopplungszweig zur Kontrolle des Tastverhältnisses eines Taktsignals.
Das Dokument US 5,481,228 beschreibt eine Anordnung zur Steuerung des Tastverhältnisses mit seriell geschalteten Transistorstufen. Aufgabe der vorliegenden Erfindung ist es, eine Schaltungsanordnung und ein Verfahren zum Bereitstellen eines Taktsignals anzugeben, die eine genaue Einstellung des Tastverhältnisses des Taktsignals ermöglichen.
Diese Aufgabe wird mit dem Gegenstand gemäß Patentanspruch 1 sowie dem Verfahren gemäß Patentanspruch 16 gelöst. Weiterbildungen und Ausgestaltungen sind jeweils Gegenstand der ab- hängigen Ansprüche.
Erfindungsgemäß umfasst eine Schaltungsanordnung zum Bereitstellen eines Taktsignals mit einem einstellbaren Tastverhältnis eine Verstärkerschaltung, einen Tiefpass und eine In- tegratorschaltung. Die Verstärkerschaltung ist an einem ersten Eingang mit einem Eingang der Schaltungsanordnung verbunden. Die Verstärkerschaltung ist an einem Ausgang mit einem Ausgang der Schaltungsanordnung gekoppelt. Der Tiefpass ist eingangsseitig mit dem Ausgang der Verstärkerschaltung und ausgangsseitig mit der Integratorschaltung verbunden. Die Integratorschaltung wiederum ist ausgangsseitig mit einem zweiten Eingang der Verstärkerschaltung verbunden.
Der Eingang der Schaltungsanordnung dient zum Anschließen ei- nes Oszillators. Eine Oszillatorspannung wird dem Eingang der Schaltungsanordnung zugeleitet. An dem Ausgang der Schaltungsanordnung ist ein Taktsignal mit einem Tastverhältnis abgreifbar. Ein an dem Ausgang der Verstärkerschaltung anliegendes Signal wird dem Tiefpass zugeführt. Ein ausgangsseitig an dem Tiefpass abgreifbares Signal wird der Integratorschaltung zugeleitet. Die Integratorschaltung ist zur Abgabe eines vorgebbaren Schwellwerts zur Steuerung des Tastverhältnisses ausgelegt. Dieser Schwellwert wird dem zweiten Eingang der Verstärkerschaltung zugeleitet. Die Verstärkerschaltung gibt ausgangsseitig ein Signal ab, das in Abhängigkeit von dem Oszillatorsignal und dem Schwellwert bereitgestellt wird.
Das von der Verstärkerschaltung bereitgestellten Signal wird somit über den Tiefpass und die Integratorschaltung auf den zweiten Eingang der Verstärkerschaltung zurückgekoppelt. Der Tiefpass stellt ein Signal bereit, dass in erster Näherung als Gleichsignal ausgebildet ist und einem Wert des Tastver- hältnisses entspricht. Mittels der Rückkopplung wird bei einer Änderung des Tastverhältnisses, die beispielsweise durch eine Störung in der Oszillatorspannung oder durch eine ausgangsseitig ankoppelbare elektrische Last verursacht wird, gegengesteuert, so dass wieder das Tastverhältnis vor der Störung erzielt wird.
Mit Vorteil ist mittels des von der Integratorschaltung bereitgestellten Schwellwertes ein Schwellwert der Verstärkerschaltung einstellbar. Es ist ein Vorteil der Schaltungsan- Ordnung, dass eine Phase des Taktsignals nahezu identisch mit einer Phase des Oszillatorsignals ist.
In einer Weiterbildung weist die Verstärkerschaltung einen Komparator auf, der an einem ersten und an einem zweiten Ein- gang mit dem ersten beziehungsweise dem zweiten Eingang der Verstärkerschaltung verbunden ist. Der Komparator kann an einem Ausgang mit dem Ausgang der Verstärkerschaltung verbunden sein. Mit Vorteil kann ein Puffer zur Verbindung des Ausgangs des Komparators mit dem Ausgang der Verstärkerschaltung vor- gesehen sein.
In einer alternativen Weiterbildung weist die Verstärkerschaltung einen Puffer mit einem Eingang auf, der mittels ei- - A -
nes Einkoppelkondensators mit dem ersten Eingang der Verstärkerschaltung verbunden ist. Der Puffer ist an dem Eingang weiterhin mit dem zweiten Eingang der Verstärkerschaltung und ausgangsseitig mit dem Ausgang der Verstärkerschaltung ver- bunden .
Der Puffer kann einen Inverter aufweisen. Alternativ kann der Puffer einen ersten Inverter und einen zweiten Inverter umfassen, wobei der zweite Inverter dem ersten Inverter nachge- schaltet ist. Dabei kann die Stromtreiberfähigkeit des zweiten Inverters größer als die Stromtreiberfähigkeit des ersten Inverters sein. In einer Ausführungsform dieser Weiterbildung kann ein Weite zu Länge-Verhältnis des P-Kanal Feldeffekttransistors des zweiten Inverters größer als ein Weite zu Länge-Verhältnis des P-Kanal Feldeffekttransistors des ersten Inverters und entsprechend ein Weite zu Länge-Verhältnis des N-Kanal-Feldeffekttransistors des zweiten Inverters größer als ein Weite zu Länge-Verhältnis des N-Kanal Feldeffekttransistors des ersten Inverters sein. Dies verbessert die Trei- berfähigkeit .
Der Puffer kann mehr als zwei Inverter umfassen. Mit Vorteil verursacht eine geradzahlige Anzahl von Invertern nahezu keine Phasenverschiebung in der Verstärkerschaltung. Mit Vorteil kann mittels des ersten Inverters beziehungsweise der zwei oder mehr Inverter ein dem Puffer zugeführtes Signal in ein Rechtecksignal umgewandelt werden, welches als das Taktsignal abgegeben wird. Das Taktsignal liegt somit als wertdiskretes, bevorzugt digitales Signal vor.
Die Verstärkerschaltung kann dazu ausgelegt sein, ausgangsseitig ein Rechtecksignal als Taktsignal bereitzustellen. In einer bevorzugten Ausführungsform umfasst die Verstärkerschaltung den ersten Eingang, den zweiten Eingang, den Kompa- rator, dessen Eingänge den ersten und den zweiten Eingang der Verstärkerschaltung bilden, den Puffer, der den ersten Inver- ter aufweist und den Ausgang des Komparators mit dem Ausgang der Verstärkerschaltung koppelt, und den Ausgang der Verstärkerschaltung .
In einer Ausführungsform weist die Integratorschaltung einen Transkonduktanz-Verstärker auf. Der Transkonduktanz-Verstärker ist an einem ersten Eingang mit dem Tiefpass und an einem Ausgang mit dem zweiten Eingang der Verstärkerschaltung gekoppelt. Dem Transkonduktanz-Verstärker ist an einem zweiten Eingang eine Referenzspannung zuführbar. Die Referenzspannung kann der Schaltungsanordnung über einen Eingang der Schaltungsanordnung zugeführt sein oder intern erzeugt werden.
In einer alternativen Ausführungsform weist die Integratorschaltung einen Operationsverstärker auf . Der Operationsver- stärker ist an einem invertierenden Eingang mit dem Tiefpass verbunden. Einem nichtinvertierenden Eingang des Operationsverstärkers ist die Referenzspannung zuführbar. Der Operationsverstärker ist an einem Ausgang mit dem zweiten Eingang der Verstärkerschaltung und über einen Rückkoppelkondensator mit dem invertierenden Eingang des Operationsverstärkers gekoppelt .
Die Referenzspannung kann bevorzugt eine konstante Spannung oder Gleichspannung sein. Die Referenzspannung ist bevorzugt Wechselspannungsfrei . Die Integratorschaltung weist bevorzugt eine Gleichspannungsquelle zum Bereitstellen der Referenzspannung auf . Das Tastverhältnis hängt von der Referenzspan- nung ab, da ein Wert der Referenzspannung zum Einstellen des Schwellwertes und damit deε Tastverhältnisses dient.
In einer Weiterbildung weist die Gleichspannungsquelle der Integratorschaltung einen Spannungsteiler mit einem ersten und einem zweiten Widerstand auf, der zwischen einen Versor- gungsspannungsanschluss und einen Bezugspotenzialanschluss geschaltet ist. Ein Abgriff des Spannungsteilers zwischen den beiden Widerständen ist mit dem zweiten Eingang des Transkon- duktanz-Verstärkers beziehungsweise dem nichtinvertierenden Eingang des Operationsverstärkers verbunden. Am Abgriff des Spannungsteilers kann die Referenzspannung bereitgestellt werden. Bevorzugt sind für ein Tastverhältnis 1/2 der erste und der zweite Widerstand mit demselben Widerstandswert aus- gelegt.
Der erste Widerstand und der zweite Widerstand des Spannungsteilers können als Widerstandsnetzwerk mit mehreren Abgriffen ausgebildet sein. Zwischen den Abgriffen kann zum Einstellen der Referenzspannung auf verschiedene Werte umgeschaltet werden. Der von der Integratorschaltung bereitgestellte Schwell- wert wird in Abhängigkeit von der Referenzspannung abgegeben.
In einer alternativen Ausführungsform kann anstelle des Span- nungsteilers eine Switched-Capacitor-Schaltung vorgesehen sein, welche von der Gleichspannungsquelle umfasst ist. Die Switched-Capacitor-Schaltung umfasst einen ersten und einen zweiten Schaltkondensator, die in Serie zwischen einen Ver- sorgungsspannungsanschluss und einen Bezugspotenzialanschluss geschaltet sind, und einen Abgriff zwischen dem ersten und dem zweiten Schaltkondensator. Der Abgriff der Switched- Capacitor-Schaltung ist mit dem zweiten Eingang des Transkon- duktanz-Verstärkers beziehungsweise dem nichtinvertierenden Eingang des Operationsverstärkers verbunden. Die an dem Abgriff bereitgestellte Referenzspannung kann in erster Näherung unabhängig von einem Wert des ersten und einem Wert des zweiten Schaltkondensators sein und näherungsweise die Hälfte der VersorgungsSpannung betragen. Mit Vorteil verbindet ein Haltekondensator den Abgriff der Switched-Capacitor-Schaltung mit dem Bezugspotenzialanschluss .
Der Tiefpass, der zwischen den Ausgang der Verstärkerschal- tung und den Eingang der Integratorschaltung geschaltet ist, kann als Tiefpass erster Ordnung ausgebildet sein und einen Widerstand und einen Kondensator aufweisen. Alternativ kann er als Tiefpass höherer Ordnung realisiert sein. Er kann als Transkonduktanz-Verstärker C-Filter ausgebildet sein. Mittels eines Regelkreises, umfassend die Verstärkerschaltung, den Tiefpass und die Integratorschaltung, kann vorteilhaft ein Tastverhältnis des Taktsignals genau eingestellt werden.
Der ankoppelbare Oszillator kann ein Schwingquarzoszillator sein. Der Schwingquarzoszillator kann als Pierceschaltung realisiert sein. Alternativ kann der Oszillator als Ringoszillator ausgebildet sein. Der Oszillator kann als Relaxations- Oszillator realisiert sein. Der Relaxations-Oszillator kann als LC-Oszillator oder bevorzugt als RC-Oszillator ausgebil- det sein.
Die Schaltungsanordnung kann auf einem Halbleiterkörper realisiert sein. In einer alternativen Ausführung kann zusätzlich auch eine Beschaltung eines Schwingquarzes auf dem HaIb- leiterkörper realisiert sein.
Die Schaltungsanordnung kann in einem Mikroprozessorschaltkreis oder einem Halbleiterspeicherbaustein eingesetzt sein. Erfindungsgemäß sieht ein Verfahren zum Bereitstellen eines Taktsignals mit einem einstellbaren Tastverhältnis folgende Schritte vor: Ein Oszillatorsignal wird einer Verstärker- Schaltung zugeführt. In Abhängigkeit eines Schwellwerts wird das Oszillatorsignal verarbeitet. Das verarbeitete Oszillatorsignal wird ausgangsseitig als Taktsignal mit dem Tastverhältnis bereitgestellt. Aus dem Tastverhältnis wird ein Signal abgeleitet. Das aus dem Tastverhältnis abgeleitete Signal wird mit einer vorgebbaren Referenzspannung verglichen und der Schwellwert wird in Abhängigkeit des Vergleichsergebnisses bereitgestellt.
Mit Vorteil sind somit mittels einer Referenzspannung der Schwellwert und damit das Tastverhältnis einstellbar.
Bevorzugt wird eine Signalverarbeitung des Oszillatorsignals in Abhängigkeit des Schwellwerts mittels Vergleichen des Oszillatorsignals und des Schwellwerts, Verstärken des Ver- gleichsergebnisses und Bereitstellen des verstärkten Vergleichsergebnisses als das Taktsignal mit dem Tastverhältnis durchgeführt. Das Taktsignal mit dem Taktverhältnis wird in Abhängigkeit des Oszillatorsignals und des Schwellwerts eingestellt. Dabei ist das Taktsignal bevorzugt ein wertdiskre- tes Signal.
Die Erfindung wird nachfolgend an mehreren Ausführungsbeispielen anhand der Figuren näher erläutert. Funktions- beziehungsweise wirkungsgleiche Bauelemente tragen gleiche Bezugs- zeichen. In soweit sich Schaltungsteile oder Bauelemente gleichen, wird deren Beschreibung nicht in jeder der folgenden Figuren wiederholt . Figur 1 zeigt eine beispielhafte Ausführungsform der Schaltungsanordnung als Blockschaltbild nach dem vorgeschlagenen Prinzip,
Figuren 2A und 2B zeigen beispielhafte Ausführungsformen von
Schaltungsanordnungen nach dem vorgeschlagenen Prinzip,
Figur 3 zeigt beispielhafte Signalverläufe einer Schaltungsanordnung nach dem vorgeschlagenen Prinzip in Abhängigkeit von der Zeit,
Figuren 4A bis 4D zeigen eine beispielhafte Ausführungsform einer Switched-Capacitor-Schaltung,
Figur 5 zeigt eine beispielhafte Ausführungsform eines ersten und eines zweiten Inverters,
Figur 6 zeigt eine beispielhafte Ausführungsform eines Operationsverstärkers und
Figuren 7A bis 7B zeigen eine beispielhafte Ausführungsform eines getakteten Transkonduktanz-Verstärkers .
Figur 1 zeigt eine beispielhafte Ausführungsform einer Schal- tungsanordnung als Blockschaltbild nach dem vorgeschlagenen Prinzip. Die Schaltungsanordnung 1 umfasst eine Verstärkerschaltung 20, einen Tiefpass 40 und eine Integratorschaltung 50. Die Schaltungsanordnung 1 weist darüber hinaus einen Eingang 2 auf, der mit dem Oszillator 3 verbunden ist. Die Schaltungsanordnung 1 umfasst ferner einen Ausgang 4 zur Abgabe eines Taktsignals Vout . Die Verstärkerschaltung 20 ist an einem ersten Eingang 21 mit dem Eingang 2 der Schaltungs- anordnung 1 und an einem Ausgang 23 mit dem Ausgang 4 der Schaltungsanordnung 1 sowie mit einem Eingang des Tiefpasses 40 verbunden. Die Integratorschaltung 50 ist eingangsseitig mit dem Tiefpass 40 und ausgangsseitig mit einem zweiten Eingang 22 der Verstärkerschaltung verbunden. Die Verstärkerschaltung 20 weist einen Komparator 24 auf, der eingangsseitig mit dem ersten und dem zweiten Eingang 21, 22 der Integratorschaltung 20 gekoppelt ist. Ausgangsseitig ist der Komparator 24 mit dem Ausgang 23 der Verstärkerschaltung 20 gekoppelt. Ein Puffer 25 ist zwischen den Komparator 24 und den Ausgang 23 der Verstärkerschaltung 20 geschaltet. Die Integratorschaltung 50 umfasst einen Transkonduktanz-Verstärker 51, eine Gleichspannungsquelle 75, welche einen Spannungstei- ler 55 aufweist, und ein Schleifenfilter 71. Der Transkonduktanz-Verstärker 51 ist eingangsseitig mit dem Tiefpass 40 und dem Spannungsteiler 55 verbunden. Ausgangsseitig ist der Transkonduktanz-Verstärker 51 über das Schleifenfilter 71 mit dem zweiten Eingang 22 der Verstärkerschaltung 20 verbunden.
Der Oszillator 3 stellt ausgangsseitig eine Oszillatorspannung Vosc bereit, die dem ersten Eingang 21 der Verstärkerschaltung 20 und damit dem Komparator 24 zugeleitet wird. Das Taktsignal Vout mit einem Taktverhältnis φ wird mittels des Komparators 24 in Abhängigkeit der Oszillatorspannung Vosc und einer SchwellSpannung Vth, welche ausgangsseitig an der Integratorschaltung 50 abgreifbar ist, gebildet. Das Taktsignal Vout wird unter Verwendung des Tiefpasses 40 gefiltert, so dass ausgangsseitig am Tiefpass 40 ein Signal, welches das Taktverhältnis φ wiedergibt, abgreifbar ist. Dieses Signal wird mittels des Transkonduktanz-Verstärkers 51 mit einer Referenzspannung Vref , die ausgangsseitig am Spannungsteiler 55 abgreifbar ist, verglichen. Die Referenzspannung Vref ist ei- ne Gleichspannung. Das Schleifenfilter 71 filtert ein am Transkonduktanz-Verstärker 51 ausgangsseitig abgreifbares Signal und führt es dem zweiten Eingang 22 der Schaltungsanordnung 1 zu .
Mit Vorteil wird das Tastverhältnis φ des Taktsignals Vout entsprechend der Referenzspannung mittels der Schaltungsanordnung 1 eingestellt. Mit Vorteil bilden die Verstärkerschaltung 20, der Tiefpass 40 und die Integratorschaltung 50 einen Regelkreis.
Anstelle des Spannungsteilers 55 kann in einer alternativen Ausführungsform eine Switched-Capacitor-Schaltung 59 als Gleichspannungsquelle 75 vorgesehen sein, die ausgangsseitig die Referenzspannung Vref bereitstellt.
In einer alternativen Ausführungsform kann anstelle des Transkonduktanz-Verstärkers 51 ein Operationsverstärker 65 mit einem invertierenden und einem nichtinvertierenden Ein- gang 66, 67 vorgesehen sein, die mit dem Ausgang des Tiefpasses 40 und eines Abgriffes des Spannungsteilers 55 gekoppelt sind.
Der Puffer 25 kann alternativ entfallen.
Figur 2A zeigt eine beispielhafte Ausführungsform einer Schaltungsanordnung nach dem vorgeschlagenen Prinzip anhand einer Weiterbildung des Blockschaltbilds von Figur 1. Der Oszillator 3 weist einen Schwingquarz 10 auf, der an einem ers- ten Anschluss über einen ersten Kondensator 11 und an einem zweiten Anschluss über einen zweiten Kondensator 12 mit einem Bezugspotenzialanschluss 8 verbunden ist. Der erste und der zweite Anschluss des Schwingquarzes 10 sind darüber hinaus über einen Widerstand 13 miteinander verbunden. Der erste An- schluss des Schwingquarzes 10 ist an einen Steueranschluss eines Inverters 14, 15 angeschlossen. Der Inverter weist einen P-Kanal Feldeffekttransistor 14 und einen N-Kanal Feldef- fekttransistor 15 auf, die zwischen einen Versorgungsspan- nungsanschluss 9 und den Bezugspotenzialanschluss 8 geschaltet sind. Ein Abgriff zwischen den gesteuerten Strecken der beiden Transistoren 14, 15 ist mit dem zweiten Anschluss des Schwingquarzes 10 und dem Eingang 2 der Schaltungsanordnung 1 verbunden.
Der Tiefpass 40 umfasst einen Widerstand 41 und einen Kondensator 42. Der Widerstand 41 verbindet einen Eingang mit einem Ausgang des Tiefpasses 40 und der Kondensator 42 verbindet den Ausgang des Tiefpasses 40 mit dem Bezugspotenzialanschluss 8. Der Spannungsteiler 55, welcher von der Gleichspannungsquelle 75 umfasst ist, umfasst einen ersten und einen zweiten Widerstand 56, 57, die zwischen den Versorgungs- spannungsanschluss 9 und den Bezugspotenzialanschluss 8 ge- schaltet sind. Ein Abgriff zwischen dem ersten und dem zweiten Widerstand 56, 57 ist an den zweiten Eingang 53 des Transkonduktanz-Verstärkers 51 angeschlossen. Der Tiefpass 40 ist ausgangsseitig an einen ersten Eingang 52 des Transkonduktanz-Verstärkers 51 angeschlossen. Ein Ausgang 54 des Transkonduktanz-Verstärkers 51 ist an dem zweiten Eingang 22 der Verstärkerschaltung 20 angeschlossen. Das Schleifenfilter 71 ist als Impedanz zwischen dem Ausgang 54 des Transkonduk- tanz-Verstärkers 51 und dem Bezugspotenzialanschluss 8 realisiert. Das Schleifenfilter 71 umfasst einen ersten Kondensa- tor 74, der parallel zu einer Serienschaltung, aufweisend einen zweiten Kondensator 72 und einen ersten Widerstand 73, zwischen den Ausgang 54 des Transkonduktanz-Verstärkers 51 und den Bezugspotentialanschluss 8 geschaltet ist. Der Puffer 25 in der Verstärkerschaltung 20 umfasst eine Serienschaltung eines ersten und eines zweiten Inverters 26, 27.
Am Oszillator 3 ist ausgangsseitig die Oszillatorspannung Vosc abgreifbar. Der Komparator 24 vergleicht die Oszillatorspannung Vosc mit dem Schwellwert Vth, welcher von der Integratorschaltung 50 ausgangsseitig bereitgestellt wird. Der Komparator 24 gibt ausgangsseitig das Taktsignal Vout mit dem Tastverhältnis φ ab. Das Taktsignal Vout wird mittels des Tiefpasses 40 gefiltert, so dass an dem ersten Eingang 52 des Transkonduktanz-Verstärkers 51 ein näherungsweise konstantes Signal anliegt, welches das Tastverhältnis φ repräsentiert. Ein Strom am Ausgang 54 des Transkonduktanz-Verstärkers 51 wird in Abhängigkeit von dem gefilterten Signal und der Refe- renzspannung Vref , die an dem Abgriff zwischen den ersten und den zweiten Widerstand 56, 57 abgreifbar ist, gebildet. Der erste Eingang 52 des Transkonduktanz-Verstärkers 51 ist dabei als nichtinvertierender Eingang und der zweite Eingang 53 als invertierender Eingang ausgebildet. Die Integratorschaltung 50 stellt ausgangsseitig den Schwellwert Vth in Abhängigkeit von dem Strom am Ausgang 54 des Transkonduktanz-Verstärkers 51 und von einer Filtercharakteristik des Schleifenfilters 71 bereit. Das Schleifenfilter 71 ist als Tiefpass ausgebildet. Im Vorwärtszweig des Regelkreises ist ausschließlich die Ver- Stärkerschaltung 20 vorgesehen, die nur eine geringe Phasenverzögerung aufweist. Im Rückkopplungszweig ist der Tiefpass 40 und die Integratorschaltung 50, umfassend das Schleifenfilter 71, vorgesehen. Der Tiefpass 40 und das Schleifenfilter 71 erzeugen eine Phasenverschiebung von jeweils bis zu 90 Grad. Aus der Verbindung der Integratorschaltung 50 mit dem invertierenden Eingang des Komparators 24 resultiert eine weitere Phasenverschiebung von näherungsweise 180 Grad, so dass die Phasenverschiebung im Regelkreis insgesamt 360 Grad
Figur 2B zeigt eine weitere beispielhafte Ausführungsform ei- ner Schaltungsanordnung nach dem vorgeschlagenen Prinzip. Im Unterschied zur Schaltungsanordnung gemäß Figur 2A weist die Verstärkerschaltung 20' gemäß Figur 2B einen Koppelkondensator 28 auf, der den ersten Eingang 21 der Verstärkerschaltung 20' mit dem Eingang des Puffers 25 verbindet. Der zweite Ein- gang 22 der Verstärkerschaltung 20' ist ebenfalls am Eingang des Puffers 25 angeschlossen.
Dem Eingang des ersten Inverters 26 wird somit der Schwellwert Vth zugeführt, welcher in erster Näherung als Gleich- Spannung ausgebildet ist. Dieser Gleichspannung wird mittels des Koppelkondensators 28 die Oszillatorspannung Vosc beziehungsweise ein Anteil der OszillatorSpannung Vosc überlagert. Ausgangsseitig ist am ersten Inverter 26 ein Signal abgreifbar, das im Wesentlichen die Pegel Low und High aufweist, welche in Abhängigkeit von dem eingekoppelten Wechselspannungssignal und dem Schwellwert Vth gebildet werden. Der erste Inverter 26 weist einen Inverterschwellwert für den Übergang vom Pegel Low zum Pegel High auf . Steigt die Summe aus dem Schwellwert Vth und dem eingekoppelten Wechselspannungs- signal über den Inverterschwellwert, so wird ausgangsseitig von dem ersten Inverter 26 der Wert Low und von dem nachgeschalteten zweiten Inverter 27 der Wert High ausgegeben, welcher gleichzeitig der Wert des Taktsignals Vout ist.
Es ist ein Vorteil der Verstärkerschaltung 20' gemäß Figur 2B, dass die Realisierung mittels eines ersten und eines zweiten Inverters 26, 27 einen sehr geringen Aufwand an Bauelementen benötigt. Es ist ein Vorteil der Schaltungsanordnung 1 gemäß Figur 2B. dass das Tastverhältnis φ des Taktsignals Vout nahezu unabhängig von dem Inverterschwellwert des ersten Inverters 26 und einem Inverterschwellwert des zweiten Inverters 27 ist. Dies wird zum einen dadurch erreicht, dass die beiden Inver- ter 26, 27 hintereinander geschaltet sind und beispielsweise ein erhöhter Inverterschwellwert des ersten Inverters 26 durch einen erhöhten Inverterschwellwert des zweiten Inver- ters 27 ausgeglichen wird. Zum anderen wird mittels des Tiefpasses 40 und der Integratorschaltung 50 der Schwellwert Vth derart eingestellt, dass das gewünschte Tastverhältnis φ auch bei Abweichungen der Inverterschwellwerte von einem vorgesehenen Wert erzielt wird.
Figur 3 zeigt beispielhafte Signalverläufe in Abhängigkeit von der Zeit t, wie sie etwa in einer Schaltungsanordnung 1 gemäß den Figuren 1 und 2A abgreifbar sind. Sinkt die Oszillatorspannung Vosc unter den Schwellwert Vth, so weist das Taktsignal Vout den Pegel Low auf. Übersteigt hingegen die Oszillatorspannung Vosc den Schwellwert Vth, so weist das Taktsignal Vout den Pegel High auf. Der Pegel High liegt während einer Anschaltdauer ton und der Pegel Low während einer Ausschaltdauer toff an. Die Periodendauer T ist die Summe aus der Anschaltdauer ton und der Ausschaltdauer toff. Das Tastverhältnis φ beträgt in diesem Beispiel näherungsweise 0,7.
Es ist beispielhaft ein weiterer Schwellwert Vthl und ein weiteres Taktsignal Voutl gezeigt. Die weitere Anschaltdauer tonl und die weitere Ausschaltdauer toffl sind gleich, so dass das Tastverhältnis φ den Wert 0,5 aufweist. Figuren 4A bis 4D zeigen eine beispielhafte Ausführungsform der Gleichspannungsquelle 75, welche eine Switched-Capacitor- Schaltung 59 umfasst, wie sie anstelle des Spannungsteilers 55 in der Integratorschaltung 50 gemäß Figur 1 sowie gemäß Figuren 2A und 2B eingesetzt werden kann.
Figur 4A zeigt die Switched-Capacitor-Schaltung 59 zum Bereitstellen der Referenzspannung Vref, welche eine feste Spannung ist. Die Switched-Capacitor-Schaltung 59 umfasst ei- nen ersten und einen zweiten Schaltkondensator 60, 61 sowie einen Haltekondensator 62. Der Haltekondensator 62 ist zwischen den Abgriff 63, an dem die Referenzspannung Vref bereitgestellt wird, und den Bezugspotenzialanschluss 8 geschaltet. Der Abgriff 63 kann in einer Ausführungsform mit dem zweiten Eingang 53 des Transkonduktanz-Verstärkers 51 verbunden sein. Der erste Schaltkondensator 60 ist an einer ersten Elektrode in einer ersten Phase A über einen Schalter 84 mit dem Versorgungsspannungsanschluss 9 und an einer zweiten Elektrode über einen Transistor 85 mit dem Abgriff 63 verbunden. Der zweite Schaltkondensator 61 ist in der ersten Phase A an einer ersten Elektrode über einen Schalter 86 mit dem Abgriff 63 und an einer zweiten Elektrode über einen Schalter 87 mit dem Bezugspotenzialanschluss 8 verbunden. In einer zweiten Phase B ist die erste Elektrode des ersten Schaltkondensators 60 über einen Schalter 80 mit dem Abgriff 63 und an der zweiten Elektrode über einen Schalter 81 mit dem Bezugspotenzialanschluss 8 verbunden. Ebenfalls ist in der zweiten Phase B die erste Elektrode des zweiten Schaltkondensators 61 über einen Schalter 82 mit dem Versorgungs- spannungsanschluss 9 und die zweite Elektrode über einen
Schalter 83 mit dem Abgriff 63 verbunden. Weiter zeigt Figur 4A eine Steuerungsanordnung 64, die ausgangsseitig mit den Schaltern 84 bis 87 zur Zuführung eines ersten Phasensignals phl und mit den Schaltern 80 bis 83 zur Zuführung eines zweiten Phasensignals ph2 verbunden ist. Eingangsseitig ist die Steuerungsanordnung 64 mit dem Eingang 2 der Schaltungsanordnung 1 gekoppelt. Diese Kopplung ist zum Erzeugen der perio- disch auftretenden Phasensignale phl, ph2 mittels der Steuerungsanordnung 64 vorgesehen.
Jeweils einer der beiden Schaltkondensatoren 60, 61 wird somit in der einen Phase zwischen den Abgriff 63 und den Be- zugspotenzialanschluss 8 und in der anderen Phase zwischen den Versorgungsspannungsanschluss 9 und den Abgriff 63 geschaltet. Es liegt somit bei einem der beiden Schaltkondensatoren 60, 61 die Differenz zwischen der VersorgungsSpannung Vdd und der Referenzspannung Vref und am zweiten der beiden Schaltkondensatoren 60, 61 die Referenzspannung Vref an. Nach einigen Taktzyklen wird ein stabiler Wert für die Referenzspannung Vref bereitgestellt, der näherungsweise die Hälfte des Wertes der Versorgungsspannung Vdd beträgt. Dieser Wert der Referenzspannung Vref ist in erster Näherung unabhängig von den Werten der Kondensatoren 60, 61, 62.
Somit kann mit Vorteil eine Referenzspannung Vref bereitgestellt werden, die den Wert 1/2 aufweist, was einem Tastverhältnis von ebenfalls 1/2 entspricht. Mit Vorteil ist die am Abgriff 63 bereitgestellte Referenzspannung in erster Näherung von einer Frequenz unabhängig, mit der der erste und der zweite Schaltkondensator 60, 61 umgeschaltet werden.
Die Schalter 80 bis 87 können in einer Ausführungsform als Feldeffekttransistoren ausgebildet sein.
Figur 4B zeigt das erste und das zweite Steuersignal phl, ph2. Ein Zeitpunkt tl befindet sich in der ersten Phase A, während der das erste Phasensignal phl den logischen Wert High aufweist, und ein Zeitpunkt t2 befindet sich in der zweiten Phase B, während der das Phasensignal ph2 den logischen Wert High aufweist. Es sind Nichtüberlappungsphasen zwischen der ersten Phase A und der zweiten Phase B vorgesehen. Davon abgesehen wechseln sich die Phasen A, B periodisch ab. Mit Vorteil wird so ein Kurzschluss zwischen dem Versor- gungsspannungsanschluss 9 und dem Abgriff 63 und ein Kurzschluss zwischen dem Abgriff 63 und dem Bezugspotenzialan- Schluss 8 vermieden.
Figur 4C zeigt die Schaltstellung der Switched-Capacitor- Schaltung 59 zu dem Zeitpunkt tl während der ersten Phase A. Der erste Schaltkondensator 60 koppelt die Versorgungsspan- nung Vdd mit der Referenzspannung Vref , während der zweite Schaltkondensator 61 die Referenzspannung Vref mit dem Bezugspotenzial Vss koppelt.
Figur 4D zeigt die Schaltstellung der Switched-Capacitor- Schaltung 59 zu dem Zeitpunkt t2 während der zweiten Phase B. Der zweite Schaltkondensator 61 koppelt die Versorgungsspannung Vdd mit der Referenzspannung Vref, während der erste Schaltkondensator 60 die Referenzspannung Vref mit dem Bezugspotenzial Vss koppelt.
Figur 5 zeigt eine beispielhafte Ausführungsform eines Puffers 25, wie er in der Verstärkerschaltung 20 der Schaltungsanordnung 1 gemäß Figur 1, 2A und 2B eingesetzt werden kann. Der Puffer 25 weist einen ersten und einen zweiten Inverter 26, 27 auf. Der erste Inverter umfasst einen P-Kanal Feldeffekttransistor 30 und einen N-Kanal Feldeffekttransistor 31, die in Serie zueinander sowie zwischen den Versorgungsspan- nungsanschluss 9 und den Bezugspotenzialanschluss 8 geschal- tet sind. Entsprechend weist der zweite Inverter 27 einen P- Kanal Feldeffekttransistor 32 und einen N-Kanal Feldeffekttransistor 33 auf, die in Serie zueinander und zwischen den Versorgungsspannungsanschluss 9 und den Bezugspotenzialan- Schluss 8 geschaltet sind. Die vier Transistoren 30 bis 33 sind als selbstsperrende Transistoren ausgebildet. Der P- Kanal Feldeffekttransistor 30 weist eine Kanalweite WpI und eine Kanallänge LpI auf. Entsprechend weist der P-Kanal Feldeffekttransistor 32 eine Kanalweite Wp2 und eine Kanallänge Lp2 sowie der N-Kanal Feldeffekttransistor 31 eine Kanalweite WnI und eine Kanallänge LnI und der N-Kanal Feldeffekttransistor eine Kanalweite Wn2 und eine Kanallänge Ln2 auf.
In einer Ausführungsform können die Kanalweiten WpI, Wp2 und die Kanallängen LpI und Lp2 des P-Kanalfeldeffekttransistors 30 und des P-Kanalfeldeffekttransistors 32 näherungsweise die gleichen Werte aufweisen. Ebenfalls können in dieser Ausführungsform die Kanalweiten WnI, Wn2 der beiden N-Kanal Feldeffekttransistoren 31, 33 und die Kanallängen LnI, Ln2 der bei- den N-Kanal Feldeffekttransistoren 31, 33 näherungsweise die gleichen Werte aufweisen. Gemäß dieser Ausführungsform ist die Stromtreiberfähigkeit des ersten Inverters 26 und des zweiten Inverters 27 näherungsweise gleich.
In einer anderen Ausführungsform ist das Verhältnis aus der Kanalweite Wp2 zur Kanallänge Lp2 des P-Kanal Feldeffekttransistors 32 größer als das Verhältnis der Kanallänge WpI und der Kanallänge LpI des P-Kanal Feldeffekttransistors 30. Entsprechend ist auch ein Verhältnis der Kanalweite Wn2 zu der Kanallänge Ln2 des Transistors 33 größer als ein Verhältnis der Kanalweite WnI zu der Kanallänge LnI des Transistors 31. Gemäß dieser alternativen Ausführungsform ist die Stromtreiberfähigkeit des zweiten Inverters 27 größer als die des ers- ten Inverters 26. Mit Vorteil können somit elektrische Lasten, die am Ausgang 4 der Schaltungsanordnung 1 angekoppelt sind, besser getrieben werden.
Figur 6 zeigt einen Operationsverstärker 65, wie er anstelle des Transkonduktanz-Verstärkers 51 in der Integratorschaltung 50 gemäß Figur 1, 2A und 2B einsetzbar ist. Ein invertierender Eingang 66 des Operationsverstärkers 65 ist über eine Rückkoppelkapazität 69 mit einem Ausgang 68 des Operations- Verstärkers 65 verbunden. Der Ausgang 68 des Operationsverstärkers 65 ist über das in der Figur 6 nicht gezeigte Schleifenfilter 71 mit dem zweiten Eingang 22 der Verstärkerschaltung 20 gekoppelt. Der Tiefpass 40 ist ausgangsseitig mit dem invertierenden Eingang 66 verbunden. Ein nichtinver- tierender Eingang 67 des Operationsverstärkers 65 ist mit dem Abgriff 63 der Switched-Capacitor-Schaltung 59 oder dem Abgriff zwischen den beiden Widerständen 56, 57 des Spannungsteilers 55 zur Zuleitung der Referenzspannung Vref an den O- perationsverstärker 65 verbunden. Aufgrund der Rückkoppelka- pazität 69 ist der Operationsverstärker 65 als integrierender Verstärker beschaltet.
In einer alternativen Ausführungsform ist der Operationsverstärker 65 ohne Zwischenschaltung des Schleifenfilters 71 mit dem zweiten Eingang 22 der Verstärkerschaltung 20 verbunden.
Figuren 7A bis 7B zeigen eine beispielhafte Ausführungsform eines getakteten Transkonduktanz-Verstärkers 51, wie er in der Integratorschaltung 50 gemäß den Figuren 1, 2A und 2B einsetzbar ist. Der Transkonduktanz-Verstärker 51 ist für den Chopper-Betrieb ausgelegt. Figur 7A zeigt das Prinzipbild des Transkonduktanz-Verstärkers 61 mit dem ersten und dem zweiten Eingang 52, 53 zur Zuführung einer ersten und einer zweiten EingangsSpannung Vinn, Vinp. Der Transkonduktanz-Verstärker 51 ist mit zwei Ausgän- gen einer Steueranordnung 58 zur Zuführung eines ersten und eines zweiten Steuersignals Θl, Θ2 verbunden. Ausgangsseitig ist am Transkonduktanz-Verstärker 51 eine AusgangsSpannung Vouto abgreifbar.
Figur 7B zeigt eine beispielhafte Ausführungsform des getakteten Transkonduktanz-Verstärkers 51. Der Transkonduktanz- Verstärker 51 weist einen Stromspiegel 90, 91 und einen weiteren Stromspiegel 92, 93 auf, die an einem Anschluss mit dem Versorgungspotenzialanschluss 9 verbunden sind. Der Transis- tor 90 ist über einen Transistor 100 mit dem Bezugspotenzial- anschluss 8 verbunden. Entsprechend ist der Transistor 93 ü- ber einen Transistor 101 ebenfalls mit dem Bezugspotenzialan- schluss 8 verbunden. Hingegen ist der Transistor 91 über einen Transistor 94 mit einem ersten Anschluss einer Stromquel- Ie 97 verbunden. Der Transistor 92 ist über einen Transistor 109 ebenfalls mit dem ersten Anschluss der Stromquelle 97 verbunden. Ein Steueranschluss des Transistors 94 ist über eine Spannungsquelle 96 mit dem Abgriff 108 verbunden. Ein Steueranschluss des Transistors 95 ist mit dem Abgriff 109 verbunden. Die Abgriffe 108, 109 sind mit dem ersten und dem zweiten Eingang 52, 53 mittels der Schalter 104 bis 107 zur Zuführung der ersten und der zweiten EingangsSpannung Vinp, Vinn gekoppelt. Ein Abgriff zwischen dem Transistor 90 und dem Transistor 100 ist über einen Schalter 102 mit dem Aus- gang 54 des Transkonduktanz-Verstärkers 51 gekoppelt. Entsprechend ist ein Abgriff zwischen dem Transistor 93 und dem Transistor 101 über einen Schalter 103 mit dem Ausgang 54 des Transkonduktanz-Verstärkers 51 gekoppelt. Ein Steueranschluss des Transistors 100 ist mit einem Steueranschluss des Transistors 101 verbunden. Über einen Schalter 98 sind die beiden Steueranschlüsse mit dem Abgriff zwischen den Transistoren 90, 100 gekoppelt. Ebenfalls sind die beiden Steueranschlüsse über einen Schalter 99 mit dem Abgriff zwischen den Transistoren 93, 101 gekoppelt.
Während das erste Steuersignal Θl den Pegel "High" annimmt, wird die erste EingangsSpannung Vinp mittels des Schalters 104 dem Abgriff 108 und die zweite Eingangsspannung Vinn über den Schalter 107 dem Abgriff 109 zugeleitet. Dahingegen wird, während das zweite Steuersignal Θ2 den Pegel "High" annimmt, die erste Eingangsspannung Vinp über den Schalter 105 dem Abgriff 109 und die zweite EingangsSpannung Vinn über den Schalter 106 dem Abgriff 108 zugeführt.
Während das erste Steuersignal Θl den Pegel "High" annimmt, sind auch die Schalter 99, 102 in einem geschlossen Betriebszustand. Während das zweite Steuersignal Θ2 den Pegel "High" annimmt, sind die Schalter 98, 103 in einem geschlossenen Betriebszustand. Somit werden eingangsseitig und ausgangsseitig derartig die Anschlüsse umgeschaltet, dass nach einer Glättung durch einen Tiefpass, welcher am Ausgang 54 angeschlossen ist, ein Schwellwert Uth am Ausgang der Integratorschal- tung 50 abgreifbar ist, welcher in erster Näherung unabhängig von einem Offset des Transkonduktanz-Verstärkers 51 ist. Bezugszeichenliste
1 Schaltungsanordnung
2 Eingang 3 Oszillator
4 Ausgang
8 Bezugspotentialanschluss
9 Versorgungsspannungsanschluss
10 Schwingquarz 11 erster Kondensator
12 zweiter Kondensator
13 Widerstand 14, 15 Transistor
20 Verstärkerschaltung 21 erster Eingang
22 zweiter Eingang
23 Ausgang
24 Komparator
25 Puffer 26 erster Inverter
27 zweiter Inverter
28 Koppelkondensator
30, 32 p-Kanal Feldeffekttransistor
31, 33 n-Kanal Feldeffekttransistor 40 Tiefpass
41 Widerstand
42 Kondensator
50 IntegratorSchaltung
51 Transkonduktanz-Verstärker 52 erster Eingang
53 zweiter Eingang
54 Ausgang
55 Spannungsteiler 56 erster Widerstand
57 zweiter Widerstand
58 Steuerungsanordnung
59 Switched Capacitor Schaltung 60 erster Schaltkondensator
61 zweiter Schaltkondensator
62 Haltekondensator
63 Abgriff
64 Steuerungsanordnung 65 Operationsverstärker
66 invertierender Eingang
67 nichtinvertierender Eingang
68 Ausgang
69 Rückkoppelkapazität 71 Schleifenfilter
72 zweiter Kondensator
73 erster Widerstand
74 erster Kondensator
75 Gleichspannungsquelle 80 bis 87 Schalter
90 bis 95 Transistor
96 Spannungsquelle
97 Stromquelle 98, 99 Schalter 100, 101 Transistor
102 bis 107 Schalter φ Tastverhältnis θl erstes Steuersignal
Θ2 zweites Steuersignal A erste Phase
B zweite Phase
Ibias Stromquellenstrom phl, ph2 Phasensignal t Zeit
T Periodendauer ton Anschaltdauer tonl weitere Anschaltdauer toff Ausschaltdauer toffl weitere Ausschaltdauer tl, t2 Zeitpunkt
Vdd VersorgungsSpannung
Vinn zweite EingangsSpannung
Vinp erste EingangsSpannung
Vn, Vp EingangsSpannung
Vout Taktsignal
Voutl weiteres Taktsignal
Vouto AusgangsSpannung
Vosc Oszillatorspannung
Vref ReferenzSpannung
Vss Bezugspotential
Vth Schwellwert
Vthl weiterer Schwellwert

Claims

Patentansprüche
1. Schaltungsanordnung zum Bereitstellen eines Taktsignals mit einem einstellbaren Tastverhältnis, umfassend - einen Eingang (2) zum Anschließen eines Oszillator (3),
- eine Verstärkerschaltung (20) mit einem ersten Eingang (21) , der mit dem Eingang (1) der Schaltungsanordnung (1) gekoppelt ist, mit einem zweiten Eingang (22) , - mit einem Komparator (24), dessen Eingänge den ersten und den zweiten Eingang (21, 22) der Verstärkerschaltung (20) bilden, und mit einem Puffer (25) , der zumindest einen ersten In- verter (26) aufweist und einen Ausgang des Komparators (24) mit einem Ausgang (23) der Verstärkerschaltung (20) koppelt,
- einen Ausgang (4), der mit dem Ausgang (23) der Verstärkerschaltung (20) verbunden und an dem ein Taktsignal (Vout) mit einem Tastverhältnis (φ) abgreifbar ist, - einen Tiefpass (40) , der eingangsseitig mit dem Ausgang (23) der Verstärkerschaltung (20) verbunden ist, und
- eine Integratorschaltung (50) , die eingangsseitig mit dem Tiefpass (40) und ausgangsseitig mit dem zweiten Eingang (22) der Verstärkerschaltung (20) zur Abgabe eines vorgeb- baren Schwellwertes (Vth) zur Steuerung des Tastverhältnisses (φ) verbunden ist.
2. Schaltungsanordnung nach Anspruch 1, dadurch gekennzeichnet, dass der Puffer (25) einen zweiten Inverter (27) umfasst, wobei der zweite Inverter (27) dem ersten Inverter (26) nachgeschaltet und die Stromtreiberfähigkeit des zweiten Inverters (27) größer als die Stromtreiberfähigkeit des ersten Inver- ters (26) ist.
3. Schaltungsanordnung nach Anspruch 1 oder 2, dadurch gekennzeichnet, dass die Integratorschaltung (50) einen Transkonduktanz-Verstärker (51) umfasst,
- der an einem ersten Eingang (52) mit dem Tiefpass (40) verbunden ist, - dem an einem zweiten Eingang (53) eine Referenzspannung (Vref) zuleitbar ist und
- der an einem Ausgang (54) mit dem zweiten Eingang (22) der Verstärkerschaltung (20) gekoppelt ist.
4. Schaltungsanordnung nach Anspruch 3, dadurch gekennzeichnet, dass der Transkonduktanz -Verstärker (51) für einen Chopper-Betrieb ausgelegt ist.
5. Schaltungsanordnung nach Anspruch 1 oder 2, dadurch gekennzeichnet, dass die Integratorschaltung (50) einen Operationsverstärker (65) umfasst, der an einem invertierenden Eingang (66) mit dem Tiefpass (40) verbunden ist, - dem an einem nichtinvertierenden Eingang (67) eine Referenzspannung (Vref) zuleitbar ist und der an einem Ausgang (68) mit dem zweiten Eingang (22) der Verstärkerschaltung (20) sowie über einen Rückkoppelkondensator (69) mit dem invertierendem Eingang (66) gekop- pelt ist.
6. Schaltungsanordnung nach einem der Ansprüche 3 bis 5, dadurch gekennzeichnet, dass die Integratorschaltung (50) eine Gleichspannungsquelle (75) umfasst, die einen Abgriff aufweist, an dem die Referenzspannung (Vref) abgreifbar ist.
7. Schaltungsanordnung nach Anspruch 6, dadurch gekennzeichnet, dass die Gleichspannungsquelle (75) der Integratorschaltung (50) einen Spannungsteiler (55) mit einem ersten und einem zweiten Widerstand (56, 57) umfasst, der zwischen einen Versorgungs- spannungsanschluss (9) und einen Bezugspotentialanschluss (8) geschaltet ist und einen Abgriff aufweist, an dem die Referenzspannung (Vref) abgreifbar ist und der mit dem zweiten Eingang (53) des Transkonduktanz-Verstärkers (51) beziehungsweise dem nichtinvertierenden Eingang (67) des Operationsver- stärkers (65) verbunden ist.
8. Schaltungsanordnung nach Anspruch 7, dadurch gekennzeichnet, dass der erste Widerstand (56) als Widerstandsnetzwerk mit mehre- ren Abgriffen ausgebildet ist, zwischen denen umgeschaltet werden kann, und/oder der zweite Widerstand (57) als Widerstandsnetzwerk mit mehreren Abgriffen ausgebildet ist, zwischen denen umgeschaltet werden kann, derart dass die Referenzspannung (Vref) zwischen verschiedenen Werten zur Ein- Stellung des Schwellwertes (Vth) umschaltbar ist.
9. Schaltungsanordnung nach Anspruch 6, dadurch gekennzeichnet, dass die Gleichspannungsquelle (75) der Integratorschaltung (50) eine Switched Capacitor Schaltung (59) mit einem ersten und einem zweiten Schaltkondensator (60, 61) und mit einem Abgriff (63) umfasst, der mit dem zweiten Eingang (53) des Transkonduktanz-Verstärkers (51) beziehungsweise dem nichtin- vertierenden Eingang (72) des Operationsverstärkers (70) und über einen Haltekondensator (62) mit einem Bezugspotentialan- schluss (8) verbunden ist und an dem die Referenzspannung (Vref) abgreifbar ist.
10. Schaltungsanordnung nach Anspruch 9, dadurch gekennzeichnet, dass in einer ersten Phase (A) der erste Schaltkondensator (60) zwischen einen Versorgungsspannungsanschluss (9) und den Abgriff (63) und der zweite Schaltkondensator (61) zwischen den Abgriff (63) und den Bezugspotentialanschluss (8) geschaltet ist und in einer zweiten Phase (B) der erste Schaltkondensator (60) zwischen den Abgriff (63) und den Bezugspotentialan- Schluss (8) und der zweite Schaltkondensator (61) zwischen den Versorgungsspannungsanschluss (9) und den Abgriff (63) geschaltet ist, wobei die erste und die zweite Phase (A, B) periodisch abwechseln.
11. Schaltungsanordnung nach einem der Ansprüche 1 bis 10, dadurch gekennzeichnet, dass die Integratorschaltung (50) ein Schleifenfilter (71) aufweist, welches am Ausgang der Integratorschaltung (50) angeschlossen ist.
12. Schaltungsanordnung nach Anspruch 11, dadurch gekennzeichnet, dass das Schleifenfilter (71) einen ersten Kondensator (74) um- fasst, welches den Ausgang der Integratorschaltung (50) mit dem Bezugspotentialanschluss (8) verbindet.
13. Schaltungsanordnung nach Anspruch 11 oder 12, dadurch gekennzeichnet, dass das Schleifenfilter (71) eine Serienschaltung, umfassend einen Widerstand (73) und einen zweiten Kondensator (72), aufweist, welche den Ausgang der Integratorschaltung (50) mit dem Bezugspotentialanschluss (8) verbindet.
14. Schaltungsanordnung nach einem der Ansprüche 1 bis 13, dadurch gekennzeichnet, dass der Tiefpass (40) einen Widerstand (41) , der einen Eingang des Tiefpasses (40) mit einem Ausgang des Tiefpasses (40) verbindet, und einen Kondensator (42) , der den Ausgang des Tiefpasses (40) mit einem Bezugspotentialanschluss (8) verbindet, umfasst.
15. Verwendung der Schaltungsanordnung (1) nach einem der An- sprüche 1 bis 14 in einem Mikroprozessor-Schaltkreis oder einem Halbleiterspeicher.
16. Verfahren zum Bereitstellen eines Taktsignals mit einem einstellbarem Tastverhältnis, umfassend folgende Schritte:
- Zuführen eines Oszillatorsignals (Vosc) ,
- Vergleichen des Oszillatorsignals (Vosc) mit einem Schwellwert (Vth) , Verstärken des Vergleichsergebnisses und Bereitstellen des verstärkten Vergleichsergebnisses als das Taktsignal (Vout) mit dem Tastverhältnis (φ) ,
- Bereitstellen eines vom Tastverhältnis (φ) abgeleiteten Signals,
- Vergleichen des vom Tastverhältnis (φ) abgeleiteten Signals und einer vorgebbaren Referenzspannung (Vref) und Bereit- stellen des Schwellwerts (Vth) in Abhängigkeit vom Vergleichsergebnis .
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