WO2002052725A2 - Circuit de temporisation a temporisation reglable - Google Patents
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- H03K5/133—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals using a chain of active delay devices
Abstract
L'invention concerne un circuit de temporisation à temporisation réglable, comprenant un premier bloc (1) et un second bloc (2) monté en aval, qui présentent chacun une chaîne d'éléments de temporisation (11 à 16, 21 à 26). Il est alloué à chaque bloc, un groupe de commutateurs (4, 5) permettant de sélectionner des prélèvements côté sortie sur les éléments de temporisation (11 à 16, 21 à 26), au moyen de commutateurs (S1 à S6), afin de pouvoir sélectionner un temps de temporisation voulu. Afin de pouvoir amorcer simultanément le commutateur (S6) relié à l'élément de temporisation côté sortie (16) du premier bloc (1) et le commutateur (S6) relié à l'élément de temporisation côté entrée (26) du second bloc (2), leurs entrées de commande sont interconnectées. Ce qui permet d'éviter les impulsions perturbatrices, même en cas de cycles d'horloge de signaux d'horloge (A) applicables côté entrée aux éléments de temporisation. Le circuit de temporisation décrit est de ce fait particulièrement adapté à une utilisation dans des boucles de régulation de temporisation dans des puces mémoire à faisceau hertzien numérique.
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