TWI674752B - 驅動保護電路及操作電路 - Google Patents

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TWI674752B
TWI674752B TW107143194A TW107143194A TWI674752B TW I674752 B TWI674752 B TW I674752B TW 107143194 A TW107143194 A TW 107143194A TW 107143194 A TW107143194 A TW 107143194A TW I674752 B TWI674752 B TW I674752B
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Abstract

一種驅動保護電路，其透過一輸入輸出接腳耦接一負載，並包括一信號產生電路、一輸入輸出電路、一計數電路、一偵測電路以及一控制電路。信號產生電路用以產生一驅動信號。輸入輸出電路根據一致能信號，傳送驅動信號至輸入輸出接腳。當致能信號為一預設位準時，計數電路調整一計數值。偵測電路偵測輸入輸出接腳的電壓位準，用以產生一偵測信號。當計數值等於一預設值時，控制電路判斷偵測信號的位準是否相同於驅動信號的位準。當偵測信號的位準不同於驅動信號的位準時，控制電路發出一錯誤信號，用以關閉負載的電源。

Description

驅動保護電路及操作電路
本發明係有關於一種驅動保護電路，特別是有關於一種輸出一錯誤信號予外部負載的驅動保護電路。
在一般的電子裝置中，通常具有一驅動電路，用以提供驅動信號予後端的負載。負載根據驅動信號而動作。然而，當驅動信號受到干擾而處於不正確的位準時，負載可能因異常的驅動信號而誤動作，或是因而損壞。
本發明提供一種驅動保護電路，其透過一輸入輸出接腳耦接一負載，並包括一信號產生電路、一輸入輸出電路、一計數電路、一偵測電路以及一控制電路。信號產生電路用以產生一驅動信號。輸入輸出電路根據一致能信號，傳送驅動信號至輸入輸出接腳。當致能信號為一預設位準時，計數電路調整一計數值。偵測電路耦接輸入輸出接腳，並偵測輸入輸出接腳的電壓位準，用以產生一偵測信號。控制電路耦接計數電路及偵測電路。當計數值等於一預設值時，控制電路判斷偵測信號的位準是否相同於驅動信號的位準。當偵測信號的位準不同於驅動信號的位準時，控制電路發出一錯誤信號，用以關閉負載的電源。
本發明另提供一種操作電路，包括：一電源供應電路、一電晶體、一輸入輸出接腳以及一驅動保護電路。電源供應電路，用以提供一操作電壓。電晶體接收操作電壓。輸入輸出接腳耦接電晶體的閘極。驅動保護電路耦接輸入輸出接腳，並包括一信號產生電路、一輸入輸出電路、一計數電路、一偵測電路以及一控制電路。信號產生電路用以產生一驅動信號。輸入輸出電路根據一致能信號，傳送驅動信號至輸入輸出接腳。當致能信號為一預設位準時，計數電路調整一計數值。偵測電路耦接輸入輸出接腳，並偵測輸入輸出接腳的電壓位準，用以產生一偵測信號。控制電路耦接計數電路及偵測電路。當計數值等於一預設值時，控制電路判斷偵測信號的位準是否相同於驅動信號的位準。當偵測信號的位準不同於驅動信號的位準時，控制電路發出一錯誤信號，用以關閉電源供應電路。
為讓本發明之目的、特徵和優點能更明顯易懂，下文特舉出實施例，並配合所附圖式，做詳細之說明。本發明說明書提供不同的實施例來說明本發明不同實施方式的技術特徵。其中，實施例中的各元件之配置係為說明之用，並非用以限制本發明。另外，實施例中圖式標號之部分重覆，係為了簡化說明，並非意指不同實施例之間的關聯性。
第1圖為本發明之操作電路的示意圖。如圖所示，操作電路100包括一驅動保護電路110以及一負載120。在一可能實施例中，驅動保護電路110與負載120係設置在同一電路板(PCB)上。在另一可能實施例中，驅動保護電路110係為一晶片，而負載120係為另一獨立的晶片。
驅動保護電路110透過一輸入輸出接腳111，提供一驅動信號S D予負載120。負載120根據驅動信號S D而動作。在本實施例中，驅動保護電路110判斷輸入輸出接腳111的電壓位準是否異常。當輸入輸出接腳111的電壓位準異常時，很容易損害負載120。因此，驅動保護電路110透過一輸入輸出接腳112，輸出一錯誤信號S FL，用以關掉負載120的電源。在其它實施例中，當輸入輸出接腳111的電壓位準異常時，驅動保護電路110停止提供驅動信號S D予負載120。稍後將說明驅動保護電路110如何判斷輸入輸出接腳111的電壓位準是否異常。
本發明並不限定負載120的電路架構。在一可能實施例中，負載120包括一電源供應電路121、一微處理單元(Microcontroller Unit；MCU)122、一電晶體123以及一操作電路124。電源供應電路121用以將一輸入電壓VCC轉換成一操作電壓VDD。本發明並不限定電源供應電路121的電路架構。在一可能實施例中，電源供應電路121係為一降壓轉換器(buck converter)。
電晶體123根據驅動信號S D，傳送操作電壓VDD予操作電路124。本發明並不限定電晶體123的種類。在一可能實施例中，電晶體123係為一金屬氧化半導體(MOS)電晶體。在其它實施中，電晶體123係為一N型電晶體，其閘極接收驅動信號S D，其汲極接收操作電壓VDD，其源極耦接操作電路124。操作電路124根據操作電壓VDD而動作。
微處理單元122用以控制電源供應電路121。舉例而言，當驅動保護電路110未送出錯誤信號S FL時，微處理單元122命令電源供應電路121轉換輸入電壓VCC，用以提供操作電壓VDD予電晶體123。然而，當驅動保護電路110送出錯誤信號S FL時，微處理單元122命令電源供應電路121停止轉換輸入電壓VCC。因此，電晶體123不再傳送操作電壓VDD予操作電路124。在其它實施例中，電源供應電路121直接接收錯誤信號S FL。在此例中，當驅動保護電路110送出錯誤信號S FL時，電源供應電路121停止動作，當驅動保護電路110未送出錯誤信號S FL時，電源供應電路121提供操作電壓VDD予電晶體123。
第2A圖為本發明之驅動保護電路110的一可能實施例。如圖所示，驅動保護電路110包括一信號產生電路210、一處理電路220、一輸入輸出電路230以及一偵測電路240。信號產生電路210用以產生驅動信號S D。在一可能實施例中，驅動信號S D係為一脈寬調變(pulse width modulation；PWM)信號。
輸入輸出電路230根據一致能信號S EN，傳送驅動信號S D至輸入輸出接腳111。在本實施例中，當致能信號S EN為一預設位準(如高位準)時，輸入輸出電路230傳送驅動信號S D至輸入輸出接腳111。當致能信號S EN不為預設位準時，輸入輸出電路230停止傳送驅動信號S D至輸入輸出接腳111。在一可能實施例中，輸入輸出電路230係為一輸入輸出緩衝器(I/O buffer)。
偵測電路240耦接輸入輸出接腳111，並偵測輸入輸出接腳111的電壓位準V 111，用以產生一偵測信號S DT。本發明並不限定偵測電路240的電路架構。任何可偵測電壓位準的電路架構，均可作為偵測電路240。
在一可能實施例中，輸入輸出接腳111的電壓位準V 111可能受到雜訊干擾，或是受到相鄰輸入輸出接腳的電壓干擾，導致輸入輸出接腳111的電壓位準V 111發生變化。為了消除輸入輸出接腳111上的短暫雜訊干擾，偵測電路240可能包括一突波消除電路241。當輸入輸出接腳111的電壓位準V 111大於一第一臨界值時，突波消除電路241設定偵測信號S DT為一第一位準(如一高位準)。當輸入輸出接腳111的電壓位準V 111小於一第二臨界值時，突波消除電路241設定偵測信號S DT為一第二位準(如一低位準)。第一臨界值可能高於第二臨界值。因此，當輸入輸出接腳111的電壓位準V 111發生微小變化時(即電壓位準V 111位於第一及第二臨界值之間)，突波消除電路241不會改變偵測信號S DT。在一可能實施例中，突波消除電路241係為一史密特觸發器(Schmitt trigger)。當突波消除電路241的速度越快時，越能及時地偵測到突波。
處理電路220根據致能信號S EN、驅動信號S D以及偵測信號S DT，決定是否產生錯誤信號S FL。在本實施例中，當致能信號S EN導通輸入輸出電路230時，輸入輸出接腳111的電壓位準應該相同於驅動信號S D。然而，由於輸入輸出接腳111的電壓位準需要較長的時間才會相同於驅動信號S D，故在輸入輸出電路230被導通後，處理電路220在等待一段時間，才判斷輸入輸出接腳111的電壓位準是否異常，便可減少誤判發生(誤以為偵測信號S DT不同於驅動信號S D)。舉例而言，當致能信號S EN為一預設位準時，輸入輸出電路230被導通。因此，處理電路220等待一第一預設時間後，才比較驅動信號S D以及偵測信號S DT的位準，用以判斷輸入輸出接腳111的電壓位準V 111是否發生異常。當偵測信號S DT的位準不同於驅動信號S D的位準，表示輸入輸出接腳111的電壓位準V 111發生異常。因此，處理電路220產生錯誤信號S FL予輸入輸出接腳112。當偵測信號S DT的位準相同於驅動信號S D的位準，表示輸入輸出接腳111的電壓位準V 111正常。因此，處理電路220不產生錯誤信號S FL。
第2B圖為本發明之驅動保護電路110的另一實施例。第2B圖相似第2A圖，不同之處在於，第2B圖多了一邏輯電路250。邏輯電路250根據致能信號S EN及錯誤信號S FL，控制輸入輸出電路230。在本實施例中，當致能信號S EN等於一預設位準並且處理電路220未產生錯誤信號S FL時，邏輯電路250導通輸入輸出電路230。因此，輸入輸出電路230傳送驅動信號S D予輸入輸出接腳111。然而，當處理電路220產生錯誤信號S FL時，即使致能信號S EN等於該預設位準，邏輯電路250不導通輸入輸出電路230。因此，輸入輸出電路230停止傳送驅動信號S D予輸入輸出接腳111。在其它實施例中，當致能信號S EN不等於該預設位準時，邏輯電路250不導通輸入輸出電路230。
第2C圖為本發明之驅動保護電路110的另一可能實施例。第2C圖相似第2圖，不同之處在於，第2C圖的驅動保護電路110多了一濾波電路260。濾波電路260用以濾除電壓振幅較大的雜訊。舉例而言，當輸入輸出接腳111的電壓位準V 111因雜訊干擾或是因靜電放電(ESD)事件而發生變化時，電壓位準V 111可能遠大於突波消除電路241的第一臨界值或是遠小於第二臨界值，只不過電壓位準V 111的變化很短暫，可能只有2奈秒(nanosecond；ns)。因此，當電壓位準V 111大於第一臨界值或小於第二臨界值時，濾波電路260判斷電壓位準V 111維持在第一或第二位準的持續時間。
假設，當電壓位準V 111大於第一臨界值時，偵測信號S DT為第一位準，當電壓位準V 111小於第二臨界值時，偵測信號S DT為第二位準。在此例中，濾波電路260判斷偵測信號S DT為第一位準或第二位準的持續時間。當偵測信號S DT維持在第一或第二位準的持續時間小於一第二預設時間(如20ns)時，表示輸入輸出接腳111的電壓位準V 111發生變化是因為受到干擾，故濾波電路260在偵測信號S DT從第一或第二位準回復到原本位準後，再將偵測信號S DT提供予處理電路220。舉例而言，偵測信號S DT維持在第一位準的時間只有10ns，在10ns後，偵測信號S DT將回復到第二位準。此時，濾波電路260輸出具有第二位準的偵測信號S DT予處理電路220。然而，如果偵測信號S DT維持在第一或第二位準的持續時間大於第二預設時間(如20ns)時，表示輸入輸出接腳111的電壓位準V 111發生變化並非雜訊影響。因此，濾波電路260直接將偵測信號S DT輸出予處理電路220。此時，偵測信號S DT仍維持在第一或第二位準。
在一可能實施例中，第二預設時間係事先儲存於濾波電路260中。在另一可能實施例中，第二預設時間小於處理電路220的第一預設時間。本發明並不限定濾波電路260的電路架構。在一可能實施例中，濾波電路260係以同步(synchronize)或非同步(asynchronize)方式判斷偵測信號S DT的持續時間。濾波電路260可能係為一數位濾波器或是類比延遲電路(delay cell)。在其它實施例中，濾波電路260可能整合在偵測電路240或是處理電路220中。在一些實施例中，濾波電路260可應用在第2B圖中。
第3圖為本發明之處理電路220的一可能示意圖。如圖所示，處理電路220包括一計數電路(counter)310以及一控制電路320。計數電路310根據致能信號S EN調整計數值VU。在本實施例中，當致能信號S EN為一預設位準時，計數電路310先將計數值VU重置成一初始值，再調整(遞增或遞減)計數值VU。然而，當致能信號S EN不為預設位準時，計數電路310不調整計數值VU。
控制電路320耦接計數電路310，用以接收計數值VU。當計數值VU等於一預設值時，控制電路320開始判斷偵測信號S DT的位準是否相同於驅動信號S D的位準。當偵測信號S DT的位準不同於驅動信號S D的位準時，控制電路320發出錯誤信號S FL。然而，當偵測信號S DT的位準相同於驅動信號S D的位準時，控制電路320不發出錯誤信號S FL。在其它實施例中，當計數值VU不等於預設值時，控制電路320不比較偵測信號S DT與驅動信號S D的位準。因此，即使偵測信號S DT的位準不同於驅動信號S D的位準，控制電路220也不產生錯誤信號S FL。
在本實施例中，控制電路320包括一比較電路321以及一控制器322。比較電路321比較驅動信號S D及偵測信號S DT的位準，用以產生一比較信號S CM。控制器322判斷計數值VU是否等於一預設值。當計數值VU等於預設值時，控制器322再根據比較信號S CM，決定是否發出錯誤信號S FL。當計數值VU不等於預設值時，控制器322不發出錯誤信號S FL。
第4圖為本發明之驅動信號S D、輸入輸出接腳111的電壓位準V 111與錯誤信號S FL的關係示意圖。如圖所示，在時間點T 41，驅動信號S D的位準發生變化，如由低位準變化至高位準。因此，一計數器開始計數。在時間點T 42，計數器的計數值等於一預設值。此時，由於輸入輸出接腳111的電壓位準V 111已大於臨界位準V H，故可視為輸入輸出接腳111的電壓位準V 111為高位準。此時，由於輸入輸出接腳111的電壓位準V 111與驅動信號S D的位準均為高位準，故錯誤信號S FL維持在一預設位準，如低位準。
在時間點T 43，驅動信號S D的位準發生變化，如由高位準變化至低位準。因此，計數器重新計數。在時間點T 44，計數器的計數值再度等於預設值。此時，由於輸入輸出接腳111的電壓位準V 111已小於臨界位準V L，故可視為輸入輸出接腳111的電壓位準V 111為低位準。此時，由於輸入輸出接腳111的電壓位準V 111相同於驅動信號S D的位準，均為低位準，因此，錯誤信號S FL繼續維持在低位準。
在時間點T 45，驅動信號S D的位準發生變化，如由低位準變化至高位準。因此，計數器重新計數。在時間點T 46，計數器的計數值再度等於預設值。此時，由於輸入輸出接腳111的電壓位準V 111已大於臨界位準V H，故可視為輸入輸出接腳111的電壓位準V 111為高位準。此時，由於輸入輸出接腳111的電壓位準V 111與驅動信號S D的位準均為高位準，故錯誤信號S FL維持在低位準。
在時間點T 47，驅動信號S D的位準發生變化，如由高位準變化至低位準。因此，計數器開始計數。在時間點T 48，計數器的計數值等於預設值。此時，輸入輸出接腳111的電壓位準V 111仍大於臨界位準V H，故可視為輸入輸出接腳111的電壓位準V 111為高位準。此時，由於輸入輸出接腳111的電壓位準V 111(高位準)不同於驅動信號S D的位準(低位準)，故錯誤信號S FL被致能，由低位準變化至高位準。
第5圖為本發明之控制方法的一可能流程示意圖。首先，產生一驅動信號(步驟S511)。本發明並不限定驅動信號的種類。在一可能實施例中，驅動信號係為一PWM信號。接著，提供驅動信號予一第一輸入輸出接腳並致能一計數電路(步驟S512)。在一可能實施例中，第一輸入輸出接腳提供驅動信號予一負載。在其它實施例中，當計數電路被致能後，計數電路先重置一計數值，再調整該計數值。計數電路可能遞增或遞減計數值。
判斷計數值是否等於一預設值(步驟S513)。當計數值不等於預設值時，回到步驟S513。當計數值等於預設值時，偵測第一輸入輸出接腳的電壓位準，用以產生一偵測信號(步驟S514)。在一可能實施例中，步驟S514係利用一突波消除電路偵測第一輸入輸出接腳的電壓位準。當輸入輸出接腳的電壓位準大於一第一臨界值時，突波消除電路設定偵測信號為一第一位準。當輸入輸出接腳的電壓位準小於一第二臨界值時，突波消除電路設定該偵測信號為一第二位準。突波消除電路可能是一史密特觸發器。
判斷偵測信號的位準是否等於驅動信號的位準(步驟S515)。當偵測信號的位準等於驅動信號的位準時，表示輸入輸出接腳的電壓位準正常，故執行步驟S512，繼續提供驅動信號予第一輸入輸出接腳。然而，當偵測信號的位準不等於驅動信號的位準時，表示輸入輸出接腳的電壓位準異常，故產生一錯誤信號，用以關閉負載的電源(步驟S516)。在一可能實施例中，步驟S516利用一第二輸入輸出接腳傳送錯誤信號予負載。在其它實施例中，步驟S516可能停止提供驅動信號予第一輸入輸出接腳。
當輸入輸出接腳的電壓位準異常時，可能損害負載。因此，本揭露在輸入輸出接腳的電壓位準異常時，即時關閉負載的電源，用以防止異常導致危害整個系統。再者，在提供驅動信號予輸入輸出接腳時，由於輸入輸出接腳的電壓位準需要較長的時間才會達目標值，故輸入輸出接腳的電壓位準可能不同於驅動信號，此時，如果立即判斷輸入輸出接腳的電壓位準是否相同於驅動信號，很有可能造成誤判。為避免誤判，在提供驅動信號予輸入輸出接腳後，等待一段預設時間，等計數值達預設值時，再偵測輸入輸出接腳的電壓位準是否相同於驅動信號，則可大幅提高準確性。
本發明之控制方法，或特定型態或其部份，可以以程式碼的型態存在。程式碼可儲存於實體媒體，如軟碟、光碟片、硬碟、或是任何其他機器可讀取(如電腦可讀取)儲存媒體，亦或不限於外在形式之電腦程式產品，其中，當程式碼被機器，如電腦載入且執行時，此機器變成用以參與本發明之裝置。程式碼也可透過一些傳送媒體，如電線或電纜、光纖、或是任何傳輸型態進行傳送，其中，當程式碼被機器，如電腦接收、載入且執行時，此機器變成用以參與本發明之裝置。當在一般用途處理單元實作時，程式碼結合處理單元提供一操作類似於應用特定邏輯電路之獨特裝置。
除非另作定義，在此所有詞彙(包含技術與科學詞彙)均屬本發明所屬技術領域中具有通常知識者之一般理解。此外，除非明白表示，詞彙於一般字典中之定義應解釋為與其相關技術領域之文章中意義一致，而不應解釋為理想狀態或過分正式之語態。
雖然本發明已以較佳實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明之精神和範圍內，當可作些許之更動與潤飾。舉例來，本發明實施例所系統、裝置或是方法可以硬體、軟體或硬體以及軟體的組合的實體實施例加以實現。因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
100‧‧‧操作電路
110‧‧‧驅動保護電路
120‧‧‧負載
111、112‧‧‧輸入輸出接腳
SD‧‧‧驅動信號
SFL‧‧‧錯誤信號
121‧‧‧電源供應電路
122‧‧‧微處理單元
123‧‧‧電晶體
124‧‧‧操作電路
VCC‧‧‧輸入電壓
VDD‧‧‧操作電壓
210‧‧‧信號產生電路
220‧‧‧處理電路
230‧‧‧輸入輸出電路
240‧‧‧偵測電路
SEN‧‧‧致能信號
SDT‧‧‧偵測信號
V111‧‧‧電壓位準
241‧‧‧突波消除電路
250‧‧‧邏輯電路
310‧‧‧計數電路
VU‧‧‧計數值
320‧‧‧控制電路
321‧‧‧比較電路
322‧‧‧控制器
SCM‧‧‧比較信號
T41~T48‧‧‧時間點
S511~S516‧‧‧步驟
260‧‧‧濾波電路
VH、VL‧‧‧臨界位準
第1圖為本發明之操作電路的示意圖。 第2A圖為本發明之驅動保護電路的一可能實施例。 第2B圖為本發明之驅動保護電路的另一實施例。 第2C圖為本發明之驅動保護電路的另一實施例。 第3圖為本發明之處理電路的一可能示意圖。 第4圖為本發明之驅動信號、輸入輸出接腳的電壓位準與錯誤信號的關係示意圖。 第5圖為本發明之控制方法的一可能流程示意圖。

Claims (10)

  1. 一種驅動保護電路，透過一輸入輸出接腳耦接一負載，並包括：一信號產生電路，用以產生一驅動信號；一輸入輸出電路，根據一致能信號，傳送該驅動信號至該輸入輸出接腳；一計數電路，當該致能信號為一預設位準時，調整一計數值；一偵測電路，耦接該輸入輸出接腳，並偵測該輸入輸出接腳的電壓位準，用以產生一偵測信號；以及一控制電路，耦接該計數電路及該偵測電路，當該計數值等於一預設值時，該控制電路判斷該偵測信號的位準是否相同於該驅動信號的位準，每當該偵測信號的位準不同於該驅動信號的位準時，該控制電路發出一錯誤信號，用以關閉該負載的電源。
  2. 如申請專利範圍第1項所述之驅動保護電路，其中當該計數值不等於該預設值並且該偵測信號的位準不同於該驅動信號的位準時，該控制電路不產生該錯誤信號。
  3. 如申請專利範圍第1項所述之驅動保護電路，其中該驅動信號係為一脈寬調變信號。
  4. 如申請專利範圍第3項所述之驅動保護電路，其中該輸入輸出電路係為一緩衝器，當該致能信號為該預設位準時，該緩衝器傳送該脈寬調變信號至該輸入輸出接腳，當該致能信號不為該預設位準時，該緩衝器停止傳送該脈寬調變信號至該輸入輸出接腳。
  5. 如申請專利範圍第1項所述之驅動保護電路，其中當該致能信號不為該預設位準時，該計數電路不調整該計數值。
  6. 如申請專利範圍第1項所述之驅動保護電路，其中當該控制電路發出該錯誤信號時，該輸入輸出電路停止傳送該驅動信號予該輸入輸出接腳。
  7. 如申請專利範圍第1項所述之驅動保護電路，其中該偵測電路包括一突波消除電路，當該輸入輸出接腳的電壓位準大於一第一臨界值時，該突波消除電路設定該偵測信號為一第一位準，當該輸入輸出接腳的電壓位準小於一第二臨界值時，該突波消除電路設定該偵測信號為一第二位準。
  8. 如申請專利範圍第7項所述之驅動保護電路，其中該突波消除電路係為一史密特觸發器(Schmitt trigger)。
  9. 一種操作電路，包括： 一電源供應電路，用以提供一操作電壓； 一電晶體，用以接收該操作電壓； 一第一輸入輸出接腳，耦接該電晶體的閘極； 一驅動保護電路，耦接該第一輸入輸出接腳，並包括： 一信號產生電路，用以產生一驅動信號； 一輸入輸出電路，根據一致能信號，傳送該驅動信號至該第一輸入輸出接腳； 一計數電路，當該致能信號為一預設位準時，調整一計數值； 一偵測電路，耦接該第一輸入輸出接腳，並偵測該第一輸入輸出接腳的電壓位準，用以產生一偵測信號；以及 一控制電路，耦接該計數電路及該偵測電路，當該計數值等於一預設值時，該控制電路判斷該偵測信號的位準是否相同於該驅動信號的位準，每當該偵測信號的位準不同於該驅動信號的位準時，該控制電路發出一錯誤信號，用以關閉該電源供應電路。
  10. 如申請專利範圍第9項所述之操作電路，更包括一第二輸入輸出接腳，用以傳送該錯誤信號予該電源供應電路。
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