TWI523498B - An image coding method, an image decoding method, an image coding apparatus, and an image decoding apparatus - Google Patents

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Description

動畫像編碼方法、動畫像解碼方法、動畫像編碼裝置及動畫像解碼裝置
本發明，係有關於動畫像編碼方法、動畫像解碼方法、動畫像編碼裝置及動畫像解碼裝置，特別是有關對於將用以儲存週邊巨集區塊資訊之記憶體的記憶容量之增大減輕一事而為有效的技術。
被稱作MPEG-2之動畫像的一般性之壓縮方式，係為藉由ISO/IEC 13818-2所作了標準化之規格。MPEG-2，係根據下述之原理所進行者：亦即是，經由從位元串流而將冗長資訊削除，來對於視訊記憶容量與所需要之帶域寬幅作削減。另外，MPEG，係為Moving Picture Experts Group之略稱。
MPEG-2之規格，由於係僅對於位元串流之語法(壓縮編碼資料列之規則或者是編碼資料之位元串流的構成方法)以及解碼程序作規定，因此，係為能夠在衛星播放服務、有線電視、互動電視、網路等之各種狀況下而充分地作利用之具有柔軟性者。
在MPEG-2之編碼處理程序中，最初，為了對於數位視訊之各像素的顏色與輝度的成分作規定，視訊訊號係被樣本化並被量化。代表顏色與輝度之成分的值，係使用離散餘弦變換(DCT：Discrete Cosine Transform)而被變換為頻率值。經由DCT所得到之變換係數，係具有依畫像之 輝度與顏色而為相異之頻率。被作了量化之DCT變換係數，係經由進行將位元串流更進而作壓縮之可變長度編碼(VLC：Variable Length Coding)而被作編碼。
在MPEG-2、MPEG-4、MPEG-4 AVC(H.264)等之國際標準動畫像編碼方法中，為了使用時間方向之相關而實現高編碼效率，係使用有圖框間預測編碼。在圖框之編碼模式中，係存在有：並不使用圖框間之相關地作編碼之I圖框、和根據在過去而作了編碼之1個圖框來進行預測之P圖框、以及根據在過去而作了編碼的2個圖框來進行預測之B圖框。
在此圖框間預測編碼中，係從動畫像而將被作了運動補償之參考畫像(預測畫像)作減算，由此減算所得之預測殘差係被作編碼。編碼之處理，係包含有DCT(離散餘弦變換)等之正交變換和量化以及可變長度編碼之處理。運動補償(運動修正)，係為包含有使圖框間預測之參考圖框作空間性移動的處理者，運動補償之處理，係以被編碼圖框之區塊單位而被進行。當在畫像內容中並不存在有運動的情況時，係並不存在有移動，與被預測像素相同位置之像素係被作使用。當存在有運動的情況時，係對於最為適合之區塊作探索，而移動量係被設為運動向量。運動補償之區塊，在MPEG-2之編碼方法中，係為16像素×16像素/16像素×8像素之區塊，在MPEG-4之編碼方法中，係為16像素×16像素/16像素×8像素/8像素×8像素之區塊，在MPEG-4 AVC(H.264)之編碼方法中，係為16像素×16 像素/16像素×8像素/8像素×16像素/8像素×8像素/8像素×4像素/4像素×8像素/4像素×4像素之區塊。
上述之編碼處理，係為在每一影像畫面(圖框或者是圖場)中而被進行者，將畫面作了細分化之區塊(通常係為16像素×16像素，在MPEG中係被稱為巨集區塊(MB))係成為處理單位。亦即是，在應進行編碼之區塊的每一者中，係從已被作了編碼之參考畫像而選擇出最為類似之區塊(預測畫像)，編碼畫像(區塊)與預測畫像之差分訊號，係被作編碼(正交變換、量化等)。在畫面內之被作編碼的區塊與預測訊號的相對位置之差，係被稱為運動向量。
在下述非專利文獻1中，係記載有以建議H.264/AVC為準據之視訊編碼技術。由建議H.264/AVC所進行之視訊編碼，係由為了將視訊文脈(video context)有效地作表現所設計的視訊編碼層(VCL：Video Coding Layer)、和為了將視訊之VCL表現作格式化並且為了進行由各種之傳輸層或者是記憶媒體所致的傳輸而以適當之方法來賦予標頭資訊之網路抽象層(NCL：Network Abstraction Layer)，所構成者。
又，在下述非專利文獻2中，係記載有：由H.264/AVC所進行之視訊編碼層(VCL)，係為依據被稱作區塊基礎混合視訊編碼(Block based Hybrid video coding)之工作方式(Approach)所進行者。VCL設計，係由巨集區塊、切片、切片區塊所構成者，各畫像係被分割為固定尺 寸之複數的巨集區塊，各巨集區塊係包含有：在輝度成分上之16×16樣本的四角形畫像區域、和在與其相對應之2個的色差成分之各個中的四角形樣本區域。1個畫像，係可包含有一個或者是此以上之切片，各切片，在將有效序列和畫像參考組作賦予的意義上，係為具有自我關連性者，切片表現，基本上由於係可並不使用從其他之切片而來的資訊便被作解碼，因此，語法元素係能夠從位元串流和畫像之區域的樣本之值而解析出來。然而，在為了進行更加完全性之解碼而橫跨切片邊界地將解塊濾波器作適應，係成為需要從其他之切片而來的數個的資訊。又，各切片，由於係與畫像之其他切片相獨立地而被作編碼並被作解碼，因此，在下述非專利文獻2中，係對於能夠將切片作平行處理一事有所記載。
另外，MPEG-2，係在國際電性通訊聯盟(ITU：International Telecommunication Union)中作為H.262而被規格化，又，係被ISO/IEC作為國際標準ISO/IEC 13818-2而承認。進而，MPEG-4，係被ISO/IEC作為國際標準ISO/IEC 14496-2而承認。又更進而，MPEG-4 AVC(Advanced Video Coding)，係在國際電性通訊聯盟(ITU)中作為H.264而被規格化，又，係被ISO/IEC作為國際標準ISO/IEC 14496-10而承認。
[先前技術文獻] [非專利文獻]
[非專利文獻1]Thomas Wiegand et al, “Overview of the H.264/AVC Video Coding Standard”, IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS FOR VIDEO TECHNOLOGY, JULY 2003, PP.1-19.
[非專利文獻2]GARY J. SULLIVAN et al,“Video Compression-From Concept to the H.264/AVC Standard”, PROCEEDING OF THE IEEE, VOL.93、No.1, JANUARY 2005、PP.18-31.
本發明者們，係在本發明之前，便已對於下一世代之國際標準動畫像編碼方式而進行了研究、開發。
另一方面，如同上述一般，在編碼處理中，I圖框、P圖框或者是B圖框之1枚的影像畫面，係被分割為複數之被稱作巨集區塊(MB)的小區域，並從位置在1枚的影像畫面之左上方處的巨集區塊(MB)起，來依據作顯示之逐線掃描的順序而對於右方向以及下方向的複數之巨集區塊(MB)依序實行編碼處理。在動畫像編碼中，係利用動畫像畫面內之巨集區塊(MB)的空間性之相關關係，而將動畫像資訊作壓縮。亦即是，在對於1個的巨集區塊(MB)作處理時，係根據其週邊之巨集區塊(1枚的影像畫面之上方向以及左方向的巨集區塊)的資訊，而預測出被作處理之1個的巨集區塊(MB)之資訊，在動畫像編碼 處理中，係僅有其與預測資訊間之差分會被作編碼。
例如，在MPEG-4之框內編碼處理中，係藉由作為區塊之像素資訊的DCT係數的DC成分以及AC成分來實行區塊間預測。又，在MPEG-4 AVC(H.264/AVC)之區塊間預測中，係藉由DCT變換處理後之區塊的像素值之DC成分以及AC成分來實行區塊間預測。
又，在MPEG-4與MPEG-4 AVC(H.264/AVC)之編碼處理的用以檢測出運動向量之運動預測中，係實行有被編碼圖框之編碼對照區塊與參考圖框之複數之區塊間的區塊匹配。在進行區塊匹配時，係藉由最初所探索出之4像素精確度運動向量之1個的巨集區塊(MB)之週邊的複數之巨集區塊(MB)，來實行2像素精確度運動向量之探索與1像素精確度運動向量之探索，並檢測出最終之運動向量。
更進而，在用以將在準據於MPEG-4 AVC(H.264/AVC)而進行畫像解碼時所產生的區塊變形作減少之解塊濾波處理中，係有必要對於區塊邊界之左右合計8像素以及上下合計8像素而實行依據特定之演算式的濾波處理，並對於左右合計8像素與上下合計8像素作改寫。
另一方面，在電視播送或者是影像記錄等之中所使用的動畫像之畫像尺寸，係持續著擴大的傾向，近年來，高精細HD(High Definition)尺寸之1920像素×1080像素係成為主流。故而，可以推測到，今後之動畫像的畫像尺寸，亦會逐漸地普及至4K×2K尺寸之4096像素×2048像素 或者是8K×4K之8192像素×4096像素等的超高精細畫像。
此種有著畫像尺寸之擴大傾向的下一世代之動畫像編碼方式，係成為有必要對於上述之超高精細畫像有所對應。另外，在動畫像編碼處理與動畫像解碼處理中，如同上述一般，係需要被處理巨集區塊(MB)之週邊的複數之巨集區塊(MB)的資訊。故而，在藉由系統大規模半導體積體電路(系統LSI)所構成之動畫像編碼/解碼處理裝置之半導體晶片中，係需要對於將週邊巨集區塊資訊作儲存之內藏記憶體(ON CHIP SRAM)進行積體化。一般而言，在藉由系統LSI所構成之動畫像編碼/解碼處理裝置的半導體晶片處，係被連接有經由同步型動態隨機記憶體(SDRAM)等所構成的畫像記憶體。在此畫像記憶體中，係成為能夠將編碼處理或者是解碼處理前之動畫像資料以及編碼處理或者是解碼處理後之動畫像資料作儲存。但是，由於此畫像記憶體，對於將週邊巨集區塊資訊作儲存一事而言，存取速度係變得較慢，因此，週邊巨集區塊資訊，係設為被儲存在內藏記憶體(ON CHIP SRAM)中。另一方面，有必要儲存在內藏記憶體(ON CHIP SRAM)中之週邊巨集區塊資訊量，係會對應於畫像尺寸之增大而有所增加，相對於此，內藏記憶體(ON CHIP SRAM)之記憶容量則係有所限度，此一問題，係經由本發明者們所進行的檢討而成為明瞭。
本發明，係為根據上述一般之本發明者們在本發明之前所作的檢討之結果所進行者。
故而，本發明之目的，係在於將用以儲存週邊巨集區塊資訊之記憶體的記憶容量之增大減輕。
本發明之前述以及其他目的、以及新穎之特徵，應可藉由本說明書之記述以及所添附之圖面而成為明瞭。
在本申請案中所揭示之發明中，若是對代表性者作簡單說明，則係如下所述。
亦即是，本發明之代表性實施形態，係為一種動畫像編碼方法，係使用編碼處理裝置(201)，而將在水平方向之橫寬幅為較垂直方向之縱寬幅更大的橫長畫面之動畫像中所包含之複數之巨集區塊(MB)作編碼。
在前述複數之巨集區塊的編碼時，應編碼之巨集區塊(MB)之週邊的複數之完成編碼的複數之巨集區塊(MB)的資訊，係被儲存在內藏於前述編碼處理裝置中之資訊儲存記憶體(204)中。
在前述複數之巨集區塊之前述編碼時，最初，在前述橫長畫面之前述橫寬幅的左端處所被配列在前述垂直方向上之複數之巨集區塊(MB)係依序被作編碼，藉由此，在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)的編碼資訊，係被儲存在前述資訊儲存記憶體(204)中。
在被配列於前述垂直方向上之前述複數之巨集區塊被作了編碼後，接著係使在前述橫長畫面之前述橫寬幅的前 述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊(MB)依序被作編碼(參考圖3、圖4、圖5)。
在本申請案中所揭示之發明中，若是對藉由代表性者所可得到之效果作簡單說明，則係如下所述。
亦即是，若依據本發明，則係能夠將用以儲存週邊巨集區塊資訊之記憶體的記憶容量之增大減輕。
1.實施形態之概要
首先，針對在本申請案中所揭示之發明的代表性之實施形態而作概要說明。在關於代表性實施形態之概要說明中所附加有括弧而作參考的圖面之參考符號、係僅為對於被包含在附加有該符號之構成要素的概念中之物作例示者。
(1)本發明之代表性實施形態，係為一種動畫像編碼方法，係使用編碼處理裝置(201)，而將在水平方向之橫寬幅為較垂直方向之縱寬幅更大的橫長畫面中所包含之複數之巨集區塊(MB)作編碼。
在前述複數之巨集區塊的編碼時，應編碼之巨集區塊(MB)之週邊的複數之完成編碼的複數之巨集區塊(MB)的資訊，係被儲存在內藏於前述編碼處理裝置中 之資訊儲存記憶體(204)中。
在前述複數之巨集區塊之前述編碼時，最初，在前述橫長畫面之前述橫寬幅的左端處所被配列在前述垂直方向上之複數之巨集區塊(MB)係依序被作編碼，藉由此，在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)的編碼資訊，係被儲存在前述資訊儲存記憶體(204)中。
在被配列於前述垂直方向上之前述複數之巨集區塊被作了編碼後，接著係使在前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊(MB)依序被作編碼(參考圖3、圖4、圖5)。
若依據前述實施形態，則係能夠將用以儲存週邊巨集區塊資訊之記憶體的記憶容量之增大減輕。
在理想之實施形態中，係具備有下述特徵：亦即是，在前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)依序被作編碼時，係使用有被儲存在前述資訊儲存記憶體(204)中之在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)的前述編碼資訊(參考圖3、圖4、圖5)。
在其他理想實施形態中，係具備有下述特徵：亦即是，在前述被配列在垂直方向上之前述複數之巨集區塊的各巨集區塊被作了編碼之後，經由前述編碼處理裝置(201)，來對於前述各巨集區塊而判定其是否為位置在 前述縱寬幅之下端或者是上端處的最後或者是最初之巨集區塊(圖3：參考步驟104)。
在更理想之實施形態中，係具備有下述特徵：亦即是，當在前述橫長畫面之前述橫寬幅的前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)被作了編碼之後，經由前述編碼處理裝置(201)，來對於被作了編碼之前述複數之巨集區塊(MB)而判定其是否為位置在前述橫寬幅之右端的最後之複數之巨集區塊(圖3：參考步驟106)。
在其他更理想之實施形態中，係具備有下述特徵：亦即是，當經由前述編碼處理裝置(201)，而判定前述各巨集區塊係並非為位置在前述縱寬幅之前述下端或者是前述上端處之前述最後或者是前述最初之巨集區塊的情況時，係將代表在前述左端之前述垂直方向上而下一個被作編碼之巨集區塊的位置之垂直方向巨集區塊計數器(205)的計數值，作1的增數(圖3，參考步驟105)。
在具體性之實施形態中，係具備有下述特徵：亦即是，當經由前述編碼處理裝置(201)，而判定被作了編碼的前述複數之巨集區塊(MB)係並非為位置在前述橫寬幅之前述右端處之前述最後之複數之巨集區塊的情況時，係將代表在前述橫長畫面之前述橫寬幅的前述水平方向上而下一個被作編碼之複數之巨集區塊的位置之水平方向巨集區塊計數器(207)的計數值，作1的增數(圖3：參考步驟107)。
(2)本發明之另一觀點的代表性實施形態，係為一種動畫像解碼方法，係使用解碼處理裝置(201)，而將在水平方向之橫寬幅為較垂直方向之縱寬幅更大的橫長畫面中所包含之複數之巨集區塊(MB)作解碼。
在前述複數之巨集區塊的解碼時，應解碼之巨集區塊(MB)之週邊的複數之完成解碼的複數之巨集區塊(MB)的資訊，係被儲存在內藏於前述解碼處理裝置中之資訊儲存記憶體(204)中。
在前述複數之巨集區塊之前述解碼時，最初，在前述橫長畫面之前述橫寬幅的左端處所被配列在前述垂直方向上之複數之巨集區塊(MB)係依序被作解碼，藉由此，在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)的解碼資訊，係被儲存在前述資訊儲存記憶體(204)中。
在被配列於前述垂直方向上之前述複數之巨集區塊被作了解碼後，接著係使在前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊(MB)依序被作解碼(參考圖3、圖4、圖5)。
若依據前述實施形態，則係能夠將用以儲存週邊巨集區塊資訊之記憶體的記憶容量之增大減輕。
在理想之實施形態中，係具備有下述特徵：亦即是，在前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)依序被作解碼時，係 使用有被儲存在前述資訊儲存記憶體(204)中之在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)的前述解碼資訊(參考圖3、圖4、圖5)。
在其他理想實施形態中，係具備有下述特徵：亦即是，在前述被配列在垂直方向上之前述複數之巨集區塊的各巨集區塊被作了解碼之後，經由前述解碼處理裝置(201)，來對於前述各巨集區塊而判定其是否為位置在前述縱寬幅之下端或者是上端處的最後或者是最初之巨集區塊(圖3：參考步驟104)。
在更理想之實施形態中，係具備有下述特徵：亦即是，當在前述橫長畫面之前述橫寬幅的前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)被作了解碼之後，經由前述解碼處理裝置(201)，來對於被作了解碼之前述複數之巨集區塊(MB)而判定其是否為位置在前述橫寬幅之右端的最後之複數之巨集區塊(圖3：參考步驟106)。
在其他更理想之實施形態中，係具備有下述特徵：亦即是，當經由前述解碼處理裝置(201)，而判定前述各巨集區塊係並非為位置在前述縱寬幅之前述下端或者是前述上端處之前述最後或者是前述最初之巨集區塊的情況時，係將代表在前述左端之前述垂直方向上而下一個被作解碼之巨集區塊的位置之垂直方向巨集區塊計數器(205)的計數值，作1的增數(圖3：參考步驟105)。
在具體性之實施形態中，係具備有下述特徵：亦即 是，當經由前述解碼處理裝置(201)，而判定被作了解碼的前述複數之巨集區塊(MB)係並非為位置在前述橫寬幅之前述右端處之前述最後之複數之巨集區塊的情況時，係將代表在前述橫長畫面之前述橫寬幅的前述水平方向上而下一個被作解碼之複數之巨集區塊的位置之水平方向巨集區塊計數器(207)的計數值，作1的增數(圖3：參考步驟107)。
(3)本發明之代表性的其他實施形態，係為一種動畫像編碼處理裝置(201)，其係具備有用以將在水平方向之橫寬幅為較垂直方向之縱寬幅更大的橫長畫面中所包含之複數之巨集區塊(MB)作編碼的編碼處理部(203)和資訊儲存記憶體(204)。
在由前述編碼處理部(203)所致之前述複數之巨集區塊的編碼時，應編碼之巨集區塊(MB)之週邊的複數之完成編碼的複數之巨集區塊(MB)的資訊，係被儲存在前述資訊儲存記憶體(204)中。
在前述複數之巨集區塊之前述編碼時，最初，在前述橫長畫面之前述橫寬幅的左端處所被配列在前述垂直方向上之複數之巨集區塊(MB)，係經由前述編碼處理部(203)而依序被作編碼，藉由此，在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)的編碼資訊，係經由前述編碼處理部(203)而被儲存在前述資訊儲存記憶體(204)中。
在被配列於前述垂直方向上之前述複數之巨集區塊被 作了編碼後，接著係使在前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊(MB)，經由前述編碼處理部(203)而依序被作編碼(參考圖3、圖4、圖5)。
若依據前述實施形態，則係能夠將用以儲存週邊巨集區塊資訊之記憶體的記憶容量之增大減輕。
在理想之實施形態中，係具備有下述特徵：亦即是，在前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)經由前述編碼處理部(203)而依序被作編碼時，係使用有被儲存在前述資訊儲存記憶體(204)中之在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)的前述編碼資訊(參考圖3、圖4、圖5)。
在其他理想實施形態中，係具備有下述特徵：亦即是，在前述被配列在垂直方向上之前述複數之巨集區塊的各巨集區塊(MB)被作了編碼之後，經由前述動畫像編碼處理裝置(201)，來對於前述各巨集區塊而判定其是否為位置在前述縱寬幅之下端或者是上端處的最後或者是最初之巨集區塊(圖3：參考步驟104)。
進而，在其他之理想之實施形態中，係具備有下述特徵：亦即是，當在前述橫長畫面之前述橫寬幅的前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)被作了編碼之後，經由前述動畫像編碼處理裝置(201)，來對於被作了編碼之前述複數 之巨集區塊(MB)而判定其是否為位置在前述橫寬幅之右端的最後之複數之巨集區塊(圖3：參考步驟106)。
更進而，由其他之理想之實施形態所致的前述動畫像編碼處理裝置(201)，係更進而具備有：垂直方向巨集區塊計數器(205)，其係對於在前述垂直方向上而下一個被作編碼之巨集區塊的位置作表示(參考圖5)。
係具備有下述特徵：亦即是，當經由前述動畫像編碼處理裝置(201)，而判定前述各巨集區塊係並非為位置在前述縱寬幅之前述下端或者是前述上端處之前述最後或者是前述最初之巨集區塊的情況時，係將前述垂直方向巨集區塊計數器(205)的計數值，作1的增數(圖3，參考步驟105)。
更進而，由其他之理想之實施形態所致的前述動畫像編碼處理裝置(201)，係更進而具備有：水平方向巨集區塊計數器(207)，其係對於在前述水平方向上而下一個被作編碼之巨集區塊的位置作表示(參考圖5)。
係具備有下述特徵：亦即是，當經由前述動畫像編碼處理裝置(201)，而判定被作了編碼的前述複數之巨集區塊(MB)係並非為位置在前述橫寬幅之右端處之前述最後之複數巨集區塊的情況時，係將前述水平方向巨集區塊計數器(207)的計數值，作1的增數(圖3，參考步驟107)。
由更理想之實施形態所致之前述動畫像編碼處理裝置(201)，係被設為能夠與可將被包含在前述橫長畫面之 前述動畫像中的前述複數之巨集區塊作儲存的畫像記憶體(702、902、1302)作連接。
係具備有下述特徵：亦即是，設為在將在前述橫長畫面之前述縱寬幅的前述上端處所被配列在前述水平方向上之複數之巨集區塊(1、2、3、4)儲存在前述畫像記憶體中之後，能夠接著而將前述橫長畫面之前述縱寬幅的前述上端之垂直方向下鄰處所被配列在前述水平方向上之複數之巨集區塊(5、6、7、8)儲存在前述畫像記憶體中(參考圖13、圖14、圖15)。
在其他之更理想之實施形態中，係具備有下述特徵：亦即是，前述動畫像編碼處理裝置(701)，係更進而具備有：畫像旋轉部(703)，係從前述畫像記憶體而將前述橫長畫面讀出，並將畫像作90°旋轉，之後，將所產生了的旋轉畫像寫入至前述畫像記憶體中，設為能夠將被儲存在前述畫像記憶體中之旋轉畫像讀出並供給至前述編碼處理部(704)處(參考圖13)。
進而，在其他之更理想之實施形態中，前述動畫像編碼處理裝置(201)，係更進而具備有：畫像記憶體介面(903、906、1303、1306、1309)(參考圖14、圖15)。
係具備有下述特徵：亦即是，前述畫像記憶體介面，係被設為能夠進行：從前述畫像記憶體而將前述橫長畫面之在前述橫寬幅的前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(9、5、1)讀出，並供給至前述編碼處理部(904、1304)，之後，接著將前述橫長畫面 之在前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊(10、6、2)讀出，並供給至前述編碼處理部(904、1304)(參考圖14、圖15)。
又，由其他之更理想之實施形態所致的前述動畫像編碼處理裝置，係具備有下述特徵：亦即是，係更進而具備有：畫像讀取位址產生部(906、1306)，係藉由此而成為能夠進行：從前述畫像記憶體而將前述橫長畫面之在前述橫寬幅的前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(9、5、1)讀出，並供給至前述編碼處理部(904、1304)，之後，接著將前述橫長畫面之在前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊(10、6、2)讀出，並供給至前述編碼處理部(904、1304)(參考圖14、圖15)。
由具體之實施形態所致的前述動畫像編碼處理裝置，係具備有下述特徵：亦即是，係更進而具備有：畫像旋轉部(903、1303)，係藉由此，而成為能夠產生將根據從前述畫像讀取位址產生部所產生之位址而從前述畫像記憶體所讀出之前述複數之巨集區塊的各巨集區塊作了略90°旋轉的旋轉畫像，並供給至前述編碼處理部(參考圖14、圖15)。
在由最為具體之實施形態所致的前述動畫像編碼處理裝置中，係具備有下述特徵：亦即是，前述編碼處理部(704、904、1304)，係包含有可變長度編碼部和正交變 換器、量化器以及運動預測部之各動作功能(參考圖16)。
(4)本發明之代表性的另一其他實施形態，係為一種動畫像解碼處理裝置(201)，其係具備有用以將在水平方向之橫寬幅為較垂直方向之縱寬幅更大的橫長畫面之動畫像中所包含之複數之巨集區塊(MB)作解碼的解碼處理部(203)和資訊儲存記憶體(204)。
在由前述解碼處理部(203)所致之前述複數之巨集區塊的解碼時，應解碼之巨集區塊(MB)之週邊的複數之完成解碼的複數之巨集區塊(MB)的資訊，係被儲存在前述資訊儲存記憶體(204)中。
在前述複數之巨集區塊之前述解碼時，最初，在前述橫長畫面之前述橫寬幅的左端處所被配列在前述垂直方向上之複數之巨集區塊(MB)，係經由前述解碼處理部(203)而依序被作解碼，藉由此，在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)的解碼資訊，係經由前述解碼處理部(203)而被儲存在前述資訊儲存記憶體(204)中。
在被配列於前述垂直方向上之前述複數之巨集區塊被作了解碼後，接著係使在前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊(MB)，經由前述解碼處理部(203)而依序被作解碼(參考圖3、圖4、圖5)。
若依據前述實施形態，則係能夠將用以儲存週邊巨集 區塊資訊之記憶體的記憶容量之增大減輕。
在理想之實施形態中，係具備有下述特徵：亦即是，在前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)經由前述解碼處理部(203)而依序被作解碼時，係使用有被儲存在前述資訊儲存記憶體(204)中之在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)的前述解碼資訊(參考圖3、圖4、圖5)。
在其他理想實施形態中，係具備有下述特徵：亦即是，在前述被配列在垂直方向上之前述複數之巨集區塊的各巨集區塊(MB)被作了解碼之後，經由前述動畫像解碼處理裝置(201)，來對於前述各巨集區塊而判定其是否為位置在前述縱寬幅之下端或者是上端處的最後或者是最初之巨集區塊(圖3：參考步驟104)。
進而，在其他之理想之實施形態中，係具備有下述特徵：亦即是，當在前述橫長畫面之前述橫寬幅的前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊(MB)被作了解碼之後，經由前述動畫像解碼處理裝置(201)，來對於被作了解碼之前述複數之巨集區塊(MB)而判定其是否為位置在前述橫寬幅之右端的最後之複數之巨集區塊(圖3：參考步驟106)。
更進而，由其他之理想之實施形態所致的前述動畫像解碼處理裝置(201)，係更進而具備有：垂直方向巨集區塊計數器(205)，其係對於在前述垂直方向上而下一 個被作解碼之巨集區塊的位置作表示(參考圖5)。
係具備有下述特徵：亦即是，當經由前述動畫像解碼處理裝置(201)，而判定前述各巨集區塊係並非為位置在前述縱寬幅之前述下端或者是前述上端處之前述最後或者是前述最初之巨集區塊的情況時，係將前述垂直方向巨集區塊計數器(205)的計數值，作1的增數(圖3，參考步驟105)。
更進而，由其他之理想之實施形態所致的前述動畫像解碼處理裝置(201)，係更進而具備有：水平方向巨集區塊計數器(207)，其係對於在前述水平方向上而下一個被作解碼之複數之巨集區塊的位置作表示(參考圖5)。
係具備有下述特徵：亦即是，當經由前述動畫像解碼處理裝置(201)，而判定被作了解碼之前述複數之巨集區塊(MB)係並非為位置在前述橫寬幅之前述右端處之前述最後的複數之巨集區塊的情況時，係將前述水平方向巨集區塊計數器(207)的計數值，作1的增數(圖3，參考步驟107)。
由另一理想之實施形態所致之前述動畫像解碼處理裝置(711、911、1311)，係被設為能夠與可將前述複數之巨集區塊作儲存的畫像記憶體(712、912、1312)作連接。
在其他之更理想之實施形態中，係具備有下述特徵：亦即是，前述動畫像解碼處理裝置(711)，係更進而具 備有：畫像旋轉部(713)，係從前述畫像記憶體而將前述橫長畫面讀出，並將畫像作90°旋轉，之後，將所產生了的旋轉畫像寫入至前述畫像記憶體中(參考圖13)。
由更理想之實施形態所致之前述動畫像解碼處理裝置(911、1311)，係更進而具備有可將動畫像編碼訊號作供給之外部介面(913、916、918、1313、1316、1318)。
係具備有下述特徵：亦即是，前述外部介面，係被設為能夠進行：將被包含在前述動畫像編碼訊號中之前述橫長畫面之在前述橫寬幅的前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊(9、5、1)，供給至前述解碼處理部(914、1314)，之後，接著將被包含在前述動畫像編碼訊號中之前述橫長畫面之在前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊(10、6、2)，供給至前述解碼處理部。
前述動畫像解碼處理裝置，係在對於被包含在從前述外部介面所供給而來之前述動畫像編碼訊號中之前述橫長畫面之在前述橫寬幅的前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊而作了解碼處理之後，接著對於被包含在從前述外部介面所供給而來之前述動畫像編碼訊號中之前述橫長畫面之在前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊，而進行解碼處理。
前述動畫像解碼處理裝置，係被設為能夠與可將水平 方向之橫寬幅為較垂直方向之縱寬幅更大的解碼動畫像資訊作儲存的畫像記憶體(912、1312)作連接。
前述動畫像解碼處理裝置，係被設為能夠進行：將前述橫長畫面之在前述橫寬幅的前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊的解碼處理資訊，儲存在前述畫像記憶體之第1記憶區域(9、5、1)中，之後，接著將前述動畫像編碼訊號中所包含之前述橫長畫面之在前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊的解碼處理資訊，儲存在前述畫像記憶體之第2記憶區域(10、6、2)中。
前述畫像記憶體之前述第1記憶區域與前述第2記憶區域，係與水平方向之顯示橫寬幅為較垂直方向之顯示縱寬幅更大的橫長之動畫像顯示畫面之在前述顯示橫寬幅之前述左端處所配列在前述垂直方向上之複數之畫像資訊、和在前述顯示橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之畫像資訊，而分別相對應(參考圖14、圖15)。
在其他之更理想之實施形態中，前述動畫像解碼處理裝置，係更進而具備有：畫像寫入位址產生部(918、1318)，係藉由此而成為能夠進行：將前述橫長畫面之在前述橫寬幅的前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊的解碼處理資訊，儲存在前述畫像記憶體之前述第1記憶區域中，之後，接著將前述動畫像編碼訊號中所包含之前述橫長畫面之在前述橫寬幅的前述左端 之水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊的解碼處理資訊，儲存在前述畫像記憶體之前述第2記憶區域中(參考圖14、圖15)。
在具體性之實施形態中，前述外部介面，係被設為能夠產生將在前述動畫像編碼訊號中所包含之前述複數之巨集區塊作了略90°旋轉後之旋轉畫像並供給至前述解碼處理部(參考圖14、圖15)。
在由最為具體之實施形態所致的前述動畫像解碼處理裝置中，係具備有下述特徵：亦即是，前述解碼處理部(714、914、1314)，係包含有可變長度解碼部和逆量化器、逆正交變換器以及運動補償部之各動作功能(參考圖16)。
2.實施形態之詳細內容
接著，針對實施形態作更進一步的詳細敘述。另外，在為了對於用以實施發明之最佳實施形態作說明之全圖中，對於與前圖具備有相同之功能的零件，係附加相同之符號，並省略對其之重複說明。
(實施形態1) 〈動畫像編碼/解碼處理方式中之階層構造〉
圖1，係為對於在由本發明之實施形態1所致的動畫像編碼/解碼處理方式中之階層構造作說明之圖。
如圖1中所示一般，由本發明之實施形態1所致之動畫 編碼方式，係具備有從與動畫像之全體相對應的序列(Sequence)10起直到離散餘弦變換(DCT：Discrete Cosine Transform)之處理單位的區塊(block)15、16、17為止的6階層之構造。亦即是，第1階層係為序列(Sequence)10，第2階層係為畫像群組(GOP)11、第3階層係為畫像(Picture)12、第4階層係為切片(Slice)13、第5階層係為巨集區塊(Macro-block)14、第6階層係為區塊(Block)15、16、17。在畫像群組(GOP)11中所包含之畫像(Picture)12的數量、或者是在切片(Slice)13中所包含之巨集區塊(Macro-block)14的數量，係成為較具備有柔軟性。
如圖1中所示一般，第3階層之畫像(Picture)12的動畫像之畫像縱寬幅，係成為較動畫像之畫面橫寬幅更短，而成為橫長畫面。在先前技術之MPEG-2的動畫編碼方式/解碼處理方式中，第4階層係為切片(Slice)13，其係被配置在第3階層之畫像(Picture)12的橫寬幅方向上，第5階層之巨集區塊(MB)14，亦係在被配置於橫寬幅方向上之第4階層之切片13的內部，於橫寬幅方向上而依序被作編碼或者是解碼之處理。相對於此，在由本發明之實施形態1所致的動畫編碼方式中，第4階層係為切片(Slice)13，其係被配置在第3階層之畫像(Picture)12的縱寬幅方向上，第5階層之巨集區塊(MB)14，亦係在被配置於縱寬幅方向上之第4階層之切片13的內部，如同以虛線之箭頭所示一般地而在縱寬幅方向上而依序被作編 碼或者是解碼之處理。
〈編碼位元串流之構成〉
圖2，係為對於藉由在圖1中所示之由本發明之實施形態1所致的動畫像編碼方式而被作了編碼之編碼位元串流的構成作展示之圖。
圖2中所示之位元串流，係成為將序列層211、畫像群組(GOP)層221、畫像層231、切片層241、巨集區塊(MB)層251之相異的層作了重合之階層。故而，下方之各層，係成為其之上方的各層之一部分。序列層211，係為序列之連續，各序列，係包含有複數之畫像群組(GOP)的群組。畫像群組(GOP)層221之群組，係為畫像之群組的連續，各GOP，係包含有1個或者是多數之畫像。畫像層231，係為畫像(包含I圖框、P圖框、B圖框)之連續，各畫像230，係包含有1個或者是多數之切片240。切片層242，係為切片240之連續，各切片240，係包含有1個或者是多數之巨集區塊250。巨集區塊(MB)層251，係為巨集區塊之連續。
為了對於圖2中所示之位元串流作解碼，係需要有關於位元串流之確實的資訊，此資訊，通常係被包含於在位元串流中所包含之標頭中。故而，位元串流之各層的資料之各區塊，一般而言係具備有包含與位元串流之編碼以及解碼相關連的關連資訊之標頭。例如，在序列層211中，序列210係具備有序列標頭212、在GOP層221中，GOP220 係具備有GOP標頭222、在畫像層231中，畫像230係具備有畫像標頭232、在切片層241中，切片240係具備有切片標頭242，在MB層251中，巨集區塊(MB)250係具備有巨集區塊(MB)標頭252。
序列標頭212係包含有：被稱作水平尺寸(horizontal_size)之畫像12的寬幅、被稱作垂直尺寸(vertical_size)之畫像12的高度、被稱作縱橫比例(aspect_ratio_information)的像素之縱橫比等的資訊。
GOP標頭222係包含有：被稱作時間碼(time_code)之參數、和被稱作封閉GOP(closed_gop)或者是斷線鍊結(broken_link)之對於GOP的構造作記述之參數的資訊。
畫像標頭232，係包含有對於畫像係為I畫像與P畫像以及B畫像中之何者的畫像一事作標示的被稱作畫像編碼形態(picture_coding_type)的參數等之資訊。畫像標頭232，係更進而包含有對於運動向量係根據何者之畫像而被作了編碼一事作標示的被稱作F碼(f_code)之參數。
切片標頭242，係包含有代表切片之開始的切片開始碼(slice_start_code)、和對於切片之最初的巨集區塊(MB)之垂直位置、水平位置作標示的參數等之資訊。
巨集區塊(MB)標頭252，係包含有：巨集區塊位址、和巨集區塊之形態、和巨集區塊250是否包含有運動向量和運動向量之形態(順方向、逆方向)、以及以巨集區塊單位而作指定之量化器尺度等的資訊。進而，巨集區 塊(MB)標頭252，係對於離散餘弦變換(DCT)之形態和DCT係數等作決定。
〈動畫像編碼處理/解碼處理之處理程序〉
圖3，係為對於由本發明之實施形態1所致的動畫像編碼/解碼處理之處理程序作展示的流程圖。
於圖3中所展示之由本發明之實施形態1的動畫編碼方式所致之位元串流的語法(壓縮編碼資料列之規格或者是編碼資料之位元串流的構成方法)，係遵循使用圖1與圖2所說明了的規則。
在圖3的步驟101之前，實行由本發明之實施形態1所致的動畫像之編碼/解碼處理的處理之動畫像編碼/解碼處理裝置，係經由對於上述之語法作解析，而判斷出應依據由本發明之實施形態1所致的語法來實行動畫像之編碼/解碼處理的處理。
在此判斷之後，於圖3中，係經由步驟101，而開始一枚的影像畫面(畫像12)之動畫像編碼處理或者是動畫像解碼處理的處理，並經由步驟102而將巨集區塊(MB)之座標(x，y)初期化為原點(0，0)。經由步驟103，位置在巨集區塊座標(x，y)處之1個的巨集區塊(MB)係被作編碼處理或者是解碼處理。經由步驟104，而判定在步驟103處所被作了處理之巨集區塊(MB)是否位於畫面下端。在步驟104中，當判定出被作了處理的巨集區塊(MB)係並非位於畫面下端的情況時，係在步驟105處， 將巨集區塊座標(x，y)之縱方向的座標y作1的增數，之後，反覆進行步驟103之巨集區塊(MB)的編碼處理或者是解碼處理。當經由步驟104，而判定被作了處理之巨集區塊(MB)係位於畫面下端的情況時，係在步驟106處，判定被作了處理之巨集區塊(MB)是否位於畫面右端。在步驟106中，當判定出被作了處理的巨集區塊(MB)係並非位於畫面右端的情況時，係在步驟107處，將巨集區塊座標(x，y)之橫方向的座標x作1的增數，並將縱方向之座標y重置為初期值0，之後，反覆進行步驟103之巨集區塊(MB)的編碼處理或者是解碼處理。當在步驟106處而判定出被作了處理之巨集區塊(MB)係位於畫面右端的情況時，係在步驟108處，而結束1枚的影像畫面之動畫像編碼處理或者是動畫像解碼處理的處理。
圖4，係為對於經由在圖3之流程圖中所示之由本發明之實施形態1所致的動畫像編碼/解碼處理之程序，而對於1枚的影像畫面之被配置在2維巨集區塊座標(x、y)處的複數之巨集區塊(MB)依序作處理的模樣作展示之圖。
如圖4中所示一般，從1枚的影像畫面之位置在左上的巨集區塊(MB)開始，最初之處理的移動方向，係並非依循顯示之逐線掃描的順序地被設定為畫面之橫右方向，而是被設定為畫面之縱下方向。若是經由朝向畫面之縱下方向的處理而完成了處理之巨集區塊(MB)到達了影像畫面之下端，則處理係被移動至位置在更一個右側的巨集 區塊(MB)之列的上端處之巨集區塊(MB)(處理係被反覆進行)，又，處理之移動方向，係被設為畫面之縱下方向。
〈動畫像編碼/解碼處理裝置之構成〉
圖5，係為對於能夠實行在圖3之流程圖中所示之由本發明之實施形態1所致的動畫像編碼/解碼處理之處理程序的由本發明之實施形態1所致的動畫編碼/解碼處理裝置的構成作展示之圖。
如圖5中所示一般，在藉由系統LSI所構成之動畫像編碼/解碼處理裝置201處，係被連接有經由同步型動態隨機存取記憶體所構成的畫像記憶體202。動畫像編碼/解碼處理裝置201之半導體晶片，係包含有：巨集區塊編碼/解碼處理部203、和週邊巨集區塊資訊儲存記憶體204、和垂直方向巨集區塊計數器205、和畫面下端判定部206、和水平方向巨集區塊計數器207、和畫面右端判定部208、以及AND邏輯閘電路209。
在動畫像編碼處理時，動畫像編碼/解碼處理裝置201，係為使用被儲存在畫像記憶體202中之原畫像和參考畫像，而實行動畫像編碼處理，並將動畫像編碼位元串流以及參考畫像輸出至畫像記憶體202處者。又，在動畫像解碼處理時，動畫像編碼/解碼處理裝置201，係為使用被儲存在畫像記憶體202中之動畫像編碼位元串流和參考畫像，而實行動畫像解碼處理，並將解碼動畫像輸出至畫 像記憶體202處者。
巨集區塊編碼/解碼處理部203，係為對於位置在經由垂直方向巨集區塊計數器205和水平方向巨集區塊計數器207所標示出的巨集區塊座標處之巨集區塊(MB)，而實行編碼處理或者是解碼處理者。
週邊巨集區塊資訊儲存記憶體204，係將從巨集區塊編碼/解碼處理部203所輸出之畫面之縱下方向(垂直方向)的複數之巨集區塊(MB)的資訊作儲存。故而，巨集區塊編碼/解碼處理部203，係將左側列之巨集區塊(MB)的資訊從週邊巨集區塊資訊儲存記憶體204而讀出，並實行編碼或者是解碼之處理。垂直方向巨集區塊計數器205，係經由從巨集區塊編碼/解碼處理部203所輸出之巨集區塊處理結束訊號，而將計數值作1的增數。垂直方向巨集區塊計數器205之輸出訊號的垂直方向巨集區塊位置訊號，係被供給至畫面下端判定部206處。當經由以畫面下端判定部203所獲得之巨集區塊位置之判定結果而判定出巨集區塊位置係為畫面下端的情況時，垂直方向巨集區塊計數器205係被清除(重置)為初期值(0)，水平方向巨集區塊207之計數值係被作1的增數。又，水平方向巨集區塊計數器207之輸出訊號的水平方向巨集區塊位置訊號，係被供給至畫面右端判定部208處。當經由以畫面右端判定部208所獲得之巨集區塊位置之判定結果，而判定出巨集區塊位置係為畫面右端，同時，經由以畫面下端判定部206所獲得之巨集區塊位置之判定結果，而判定出 巨集區塊位置係為畫面下端的情況時，在AND邏輯閘電路209處，係被供給有畫面下端判定部206之判定結果和畫面右端判定部208之判定結果。故而，根據AND邏輯閘電路209之輸出所產生的HIGH準位(“1”)之畫面處理結束訊號，係被供給至巨集區塊編碼/解碼處理部203處。
〈動畫像編碼位元串流之資料配列〉
圖6，係為對於在使圖5中所示之由本發明之實施形態1所致的動畫像編碼/解碼處理裝置作為解碼處理裝置而動作時所供給之動畫像編碼位元串流的資料配列作展示之圖。
如圖6中所示一般，在動畫像編碼位元串流之資料配列中，係接續於畫像標頭301，而最初係被配置有畫面左上端之巨集區塊座標(0，0)的巨集區塊(MB(0，0))之被作了編碼的資訊302。接著，從垂直下方向之巨集區塊座標(0，1)的巨集區塊(MB(0，1))被編碼後的資訊303起，朝向垂直下方向而依序被配置有巨集區塊(MB)之被作了編碼的資訊。在畫面左下端之巨集區塊座標(0，h-1)的巨集區塊(MB(0，h-1))被編碼後的資訊304之後，係被配置有從畫面左端起之第2列的巨集區塊座標(1，0)之巨集區塊(MB(1，0))的被編碼後之資訊305。之後，相同的，係被配置有直到畫面右下端之巨集區塊座標(w-1，h-1)之巨集區塊(MB(w-1，h-1))為止的被作了編碼之資訊。另外，於圖6所示之畫 像標頭301中，實際上，係為包含有圖2中所示之序列標頭212、GOP標頭222、畫像標頭232、切片標頭242、巨集區塊(MB)標頭252者。其結果，經由對於圖6中所示之畫像標頭301作解析，係成為能夠判斷出應依循由本發明之實施形態1所致的語法來進行動畫像之編碼/解碼處理的處理。又，經由對於在圖2所示之序列標頭212中所包含的被稱作水平尺寸之畫像12的寬幅和被稱作垂直尺寸之畫像12的高度作解析，係成為能夠得知在圖3之處理程序中的步驟104處所判斷之畫面下端和步驟106處所判斷的畫面右端。
〈週邊巨集區塊〉
圖7，係為對於在實行與本發明相異之先前技術之編碼處理的情況時之處理對象巨集區塊(MB)401與在處理對象巨集區塊(MB)401之預測中所被使用之4個的週邊巨集區塊(MB)402~405間的關係作展示之圖。
圖8，係為對於在實行於圖1~圖6中所說明了的由本發明之實施形態1所致的動畫像之編碼/解碼處理之處理程序的情況時之處理對象巨集區塊(MB)401與在處理對象巨集區塊(MB)401之預測中所被使用之4個的週邊巨集區塊(MB)406~409間的關係作展示之圖。
於圖7中，由於係必須要在位置於處理對象巨集區塊(MB)401之右上方的巨集區塊(MB)404仍為未處理之狀態下來對於處理對象巨集區塊(MB)401進行處理，因 此，參考資訊係減少，預測精確度係會劣化。相對於此，在由本發明之實施形態1所致的圖8中，在處理對象巨集區塊(MB)401之處理時序處，由於4個的週邊巨集區塊(MB)406~409係全部為完成處理的狀態，因此，係成為能夠避免由於參考資訊之減少所導致的預測精確度之劣化。
〈週邊巨集區塊資訊之儲存記憶體〉
圖9，係為對於根據先前技術之編碼處理而從位置在1枚的影像畫面之左上方的巨集區塊(MB)起來開始並以所標示之逐列掃描順序來最初朝向右方向並接著朝向下方向而依序實行複數之巨集區塊(MB)之編碼處理的模樣作展示之圖。
在圖9所示之先前技術的編碼處理中，週邊巨集區塊資訊之儲存記憶體的記憶容量，係有必要成為具備有將畫面橫寬幅之量的巨集區塊(MB)資訊502作儲存之大的記憶容量。
圖10，係為對於在圖1~圖6中所說明了的由本發明之實施形態1所致的編碼處理而從位置在1枚的影像畫面之左上方的巨集區塊(MB)起來開始而最初朝向下方向並接著朝向右方向而依序實行複數之巨集區塊(MB)之編碼處理的模樣作展示之圖。
在圖10所示之由本發明之實施形態1所致的編碼處理中，週邊巨集區塊資訊之儲存記憶體的記憶容量，係只要 具備有將畫面縱寬幅之量的巨集區塊(MB)資訊504作儲存之較小的記憶容量便已為充分。
一般而言，動畫像之畫面縱寬幅，係為較動畫像之畫面橫寬幅而更短之長度。例如，在QVGA(Quarter Video Graphic Array)尺寸中，係為320像素×240像素，在標準(Standard)尺寸中，係為720像素×480像素，在高精細HD(High Definition)尺寸中，係為1920像素×1080像素，在4K×2K尺寸中，係為4096像素×2048像素，在8K×4K尺寸中，係為8192像素×4096像素。故而，相較於在圖9所示之先前技術的編碼處理中所需要的畫面橫寬幅之量的較大容量，在圖10所示之由本發明之實施形態1所致的編碼處理中所需要的週邊巨集區塊資訊的儲存記憶體之記憶容量，係成為畫面縱寬幅之量的較小之容量。
〈巨集區塊適應型之圖框、圖場預測模式〉
圖11，係為對於將被導入至MPEG-4 AVC(H.264)之編碼方式中的巨集區塊適應型之圖框、圖場預測模式的2列之巨集區塊(MB)的對，根據先前技術之編碼處理來作編碼的模樣作展示之圖。
在圖11所示之先前技術的編碼處理中，週邊巨集區塊資訊之儲存記憶體的記憶容量，係有必要成為具備有將畫面橫寬幅之量的2倍之巨集區塊(MB)資訊602作儲存之大的記憶容量。
圖12，係為對於將被導入至MPEG-4 AVC(H.264)之 編碼方式中的巨集區塊適應型之圖框、圖場預測模式之巨集區塊(MB)的對，根據在圖1~圖6中所說明了的由本發明之實施形態1所致的編碼處理來作編碼的模樣作展示之圖。
於圖12所示之由在圖1~圖6中所說明了的本發明之實施形態1所致的編碼處理中，週邊巨集區塊資訊之儲存記憶體的記憶容量，係只要具備有將畫面縱寬幅之量的巨集區塊(MB)資訊604作儲存之較小的記憶容量便已為充分。
(實施形態2) 〈由實施形態2所致之動畫像編碼/解碼處理裝置〉
圖13，係為對於由本發明之實施形態2所致的動畫像編碼/解碼處理裝置之構成作展示之圖。
於圖13之上部，係展示有實行由本發明之實施形態2所致的動畫像編碼之處理的編碼裝置701，於圖13之下部，係展示有實行由本發明之實施形態2所致的動畫像解碼之處理的解碼裝置711。
編碼裝置701，係包含有畫像旋轉部703、和編碼處理部704、以及週邊巨集區塊資訊儲存記憶體705。編碼裝置701，係經由實行被儲存在畫像記憶體702中之原畫像的動畫像編碼處理，來將動畫像編碼位元串流和參考畫像輸出至畫像記憶體702處。
被儲存在畫像記憶體702中之原畫像，係被供給至編 碼裝置701之畫像旋轉部703處，畫像旋轉部703，係將原畫像作+90°之右旋轉，並將旋轉畫像供給至畫像記憶體702處。故而，被儲存在畫像記憶體702中之原畫像的橫寬幅，係成為較縱寬幅更長的橫長畫像，並藉由畫面顯示之逐次掃描的順序，而在右水平方向上配列有複數之巨集區塊(MB)1、2、3、4，並在下垂直方向上配列有複數之巨集區塊(MB)1、5、9。亦即是，在被儲存於畫像記憶體702中之原畫像的橫寬幅之右水平方向上所配列的複數之巨集區塊(MB)1、2、3、4的個數，係成為較在原畫像之縱寬幅的下垂直方向上所配列的複數之巨集區塊(MB)1、5、9之個數而更大之值。
另一方面，經由畫像旋轉部703而被作了+90°之右旋轉並被供給至畫像記憶體702處之旋轉畫像，在橫寬幅之水平方向上，係包含有個數較小的複數之巨集區塊(MB)1、5、9，在縱寬幅之垂直方向上，係包含有個數較大的複數之巨集區塊(MB)1、2、3、4。又，被儲存在畫像記憶體702處之參考畫像，亦係與旋轉畫像相同的，在橫寬幅之水平方向上，係包含有個數較小的複數之巨集區塊(MB)1、5、9，在縱寬幅之垂直方向上，係包含有個數較大的複數之巨集區塊(MB)1、2、3、4。
編碼處理部704，最初係將在被儲存於畫像記憶體702處之旋轉畫像的橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)9、5、1和在被儲存於畫像記憶體702中之參考畫像的橫寬幅之水平方向上所配列的個數較 小之複數之巨集區塊(MB)9、5、1依序讀出，並實行動畫像編碼處理。接著，編碼處理部704，係將在被儲存於畫像記憶體702中之旋轉畫像以及參考畫像的各橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)10、6、2依序讀出，並實行動畫像編碼處理。又，經由動畫像編碼處理所產生之動畫像編碼位元串流，係被儲存在畫像記憶體702中。在此動畫像編碼處理中所需要之週邊巨集區塊資訊儲存記憶體705的記憶容量，係只需要在被儲存於畫像記憶體702中之原畫像的縱寬幅之垂直方向上所配列的複數之巨集區塊(MB)9、5、1的個數便已足夠。
故而，在藉由系統LSI來構成編碼裝置701時，係成為能夠容易地使用較小之記憶容量的週邊巨集區塊資訊儲存記憶體705來作為系統LSI之內藏記憶體(ON-CHIP SRAM)。又，將原畫像和旋轉畫像以及動畫像編碼位元串流作儲存的畫像記憶體702，係經由同步型動態隨機存取記憶體(SDRAM)而構成之。
解碼裝置711，係包含有解碼處理部714、和週邊巨集區塊資訊儲存記憶體715、以及畫像旋轉部713。
解碼處理部714，最初係將在被儲存於畫像記憶體712處之動畫像編碼位元串流的橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)9、5、1和在被儲存於畫像記憶體712中之參考畫像的橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)9、5、1依序讀 出，並實行動畫像解碼處理。接著，解碼處理部714，係將在被儲存於畫像記憶體712中之動畫像編碼位元串流以及參考畫像的各橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)10、6、2依序讀出，並實行動畫像解碼處理。又，經由動畫像解碼處理所產生之動畫像解碼位元串流，係被儲存在畫像記憶體712中。進而，畫像旋轉部713，係將被儲存在畫像記憶體712中之動畫像解碼位元串流作90°的左旋轉，並作為最終之動畫像解碼位元串流來再度供給至畫像記憶體712處。在此動畫像解碼處理中所需要之週邊巨集區塊資訊儲存記憶體715的記憶容量，係只需要在被儲存於畫像記憶體712中之動畫像編碼位元串流的橫寬幅之水平方向上所配列的複數之巨集區塊(MB)9、5、1的個數便已足夠。
故而，在藉由系統LSI來構成解碼裝置711時，係成為能夠容易地使用較小之記憶容量的週邊巨集區塊資訊儲存記憶體715來作為系統LSI之內藏記憶體(ON-CHIP SRAM)。又，將動畫像編碼位元串流和旋轉畫像以及動畫像解碼位元串流作儲存的畫像記憶體712，係經由同步型動態隨機存取記憶體(SDRAM)而構成之。
於圖13中所示之由本發明之實施形態2所致的動畫像之編碼裝置701和解碼裝置711，係能夠使藉由系統LSI所構成之動畫像編碼/解碼處理裝置積體化至半導體晶片中。此時，編碼處理部704與解碼處理部714，係可藉由共通硬體資源來構成，週邊巨集區塊資訊儲存記憶體705與 週邊巨集區塊資訊儲存記憶體715，係可藉由共通硬體資源來構成，畫像旋轉部703與畫像旋轉部713，係可藉由共通硬體資源來構成。根據在電源投入時等之初期化序列中所被供給之動作模式設定資訊，係成為能夠使藉由系統LSI所構成之動畫像編碼/解碼處理裝置作為編碼裝置701與解碼裝置711之任一者來任意地動作。
(實施形態3) 〈由實施形態3所致之動畫像編碼/解碼處理裝置〉
圖14，係為對於由本發明之實施形態3所致的動畫像編碼/解碼處理裝置之構成作展示之圖。
若是與圖13中所示之由本發明之實施形態2所致的動畫像編碼/解碼處理裝置作比較，則在圖14所示之由本發明之實施形態3所致的動畫像編碼/解碼處理裝置中，係成為能夠將對於畫像記憶體902之存取頻度降低。
於圖14之上部，係展示有實行由本發明之實施形態3所致的動畫像編碼之處理的編碼裝置901，於圖14之下部，係展示有實行由本發明之實施形態3所致的動畫像解碼之處理的解碼裝置911。
編碼裝置901，係包含有右90°旋轉部903、和編碼處理部904、和週邊巨集區塊資訊儲存記憶體905、以及畫像讀取位址產生部906。編碼裝置901，係經由實行被儲存在畫像記憶體902中之原畫像的動畫像編碼處理，來將動畫像編碼位元串流和參考畫像輸出至畫像記憶體902處。
被儲存在畫像記憶體902中之原畫像的複數之巨集區塊(MB)，係依據由畫像讀取位址產生部906所產生的位址，而被供給至編碼裝置901之右90°旋轉部903處，右90°旋轉部903，係將使被供給而來之巨集區塊(MB)作了+90°之旋轉後的旋轉畫像供給至編碼處理部904處。亦即是，被儲存在畫像記憶體902中之原畫像的橫寬幅，係成為較縱寬幅更長的橫長畫像，並藉由畫面顯示之逐次掃描的順序，而在右水平方向上配列有複數之巨集區塊(MB)1、2、3、4，並在下垂直方向上配列有複數之巨集區塊(MB)1、5、9。其結果，在被儲存於畫像記憶體902中之原畫像的橫寬幅之右水平方向上所配列的複數之巨集區塊(MB)1、2、3、4的個數，係成為較在原畫像之縱寬幅的下垂直方向上所配列的複數之巨集區塊(MB)1、5、9之個數而更大之值。
另一方面，經由畫像旋轉部703而被作了+90°之右旋轉並被供給至編碼處理部904處之旋轉畫像，在橫寬幅之水平方向上，係包含有個數較小的複數之巨集區塊(MB)9、5、1，在縱寬幅之垂直方向上，係包含有個數較大的複數之巨集區塊(MB)1、2、3、4。又，被儲存在畫像記憶體902處之參考畫像，亦係與旋轉畫像相同的，在橫寬幅之水平方向上，係包含有個數較小的複數之巨集區塊(MB)9、5、1，在縱寬幅之垂直方向上，係包含有個數較大的複數之巨集區塊(MB)1、2、3、4。
編碼處理部904，最初係將在從右90°旋轉部903所供 給而來之旋轉畫像的橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)9、5、1和在被儲存於畫像記憶體902中之參考畫像的橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)9、5、1依序讀出，並實行動畫像編碼處理。接著，編碼處理部904，係將在從右90°旋轉部903所供給而來之旋轉畫像以及被儲存在畫像記憶體902中之參考畫像的各橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)10、6、2依序讀出，並實行動畫像編碼處理。又，經由動畫像編碼處理所產生之動畫像編碼位元串流，係被儲存在畫像記憶體902中。在上述之動畫像編碼處理中所需要之週邊巨集區塊資訊儲存記憶體905的記憶容量，係只需要在被儲存於畫像記憶體902中之原畫像的縱寬幅之垂直方向上所配列的複數之巨集區塊(MB)1、5、9的個數便已足夠。
故而，在藉由系統LSI來構成編碼裝置901時，係成為能夠容易地使用較小之記憶容量的週邊巨集區塊資訊儲存記憶體905來作為系統LSI之內藏記憶體(ON-CHIP SRAM)。又，將原畫像與動畫像編碼位元串流作儲存的畫像記憶體902，係經由同步型動態隨機存取記憶體(SDRAM)而構成之。又，經由編碼裝置901之動畫像編碼處理而被作了編碼的運動向量MV1，亦係成為與被儲存在畫像記憶體902中之原畫像處的運動向量作比較並經由右90°旋轉部903而作了+90°右旋轉者。
解碼裝置911，係包含有解碼處理部914、和週邊巨集 區塊資訊儲存記憶體915、和左90°旋轉部913、和畫像讀取位址產生部916、和差分畫像產生部917、以及畫像寫入位址產生部918。
解碼處理部914，最初係將在被儲存於畫像記憶體912中之動畫像編碼位元串流的橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)9、5、1依序讀出。在從畫像記憶體912所被依序讀出之動畫像編碼位元串流的橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)9、5、1，係透過差分畫像產生部917而被供給至左90°旋轉部913處。左90°旋轉部913，係產生在縱寬幅之垂直方向上所配列的複數之巨集區塊(MB)9、5、1，並供給至解碼處理部914處。
又，畫像讀取位址產生部916，由於係將在被儲存於畫像記憶體712處之參考畫像的縱寬幅之垂直方向上所配列的複數之巨集區塊(MB)9、5、1依序讀出，因此，解碼處理部914，係使用動畫像編碼位元串流之複數之巨集區塊(MB)9、5、1和參考畫像的複數之巨集區塊(MB)9、5、1而實行動畫像解碼處理。經由動畫像解碼處理而從解碼處理部914所產生之動畫像解碼位元串流，係根據由畫像寫入位址產生部918所產生的位址，而被儲存在畫像記憶體712中。在此動畫像解碼處理中所需要之週邊巨集區塊資訊儲存記憶體915的記憶容量，係只需要在被儲存於畫像記憶體912中之動畫像編碼位元串流的橫寬幅之水平方向上所配列的複數之巨集區塊(MB)9、5、1的個 數便已足夠。
故而，在藉由系統LSI來構成解碼裝置911時，係成為能夠容易地使用較小之記憶容量的週邊巨集區塊資訊儲存記憶體915來作為系統LSI之內藏記憶體(ON-CHIP SRAM)。又，將動畫像編碼位元串流和參考畫像以及動畫像解碼位元串流作儲存的畫像記憶體912，係經由同步型動態隨機存取記憶體(SDRAM)而構成之。又，經由在解碼裝置911處之動畫像解碼處理所解碼了的運動向量MV2，係為以將經由編碼裝置901之動畫編碼處理所作了編碼的運動向量MV1之x座標作為運動向量MV2之y座標、並且將運動向量MV1之y座標作為運動向量MV2之x座標(但是，係為負號)的方式而作了座標變換者。
於圖14中所示之由本發明之實施形態3所致的動畫像之編碼裝置901和解碼裝置911，係能夠使藉由系統LSI所構成之動畫像編碼/解碼處理裝置積體化至半導體晶片中。此時，編碼處理部904與解碼處理部914，係可藉由共通硬體資源來構成，週邊巨集區塊資訊儲存記憶體905與週邊巨集區塊資訊儲存記憶體915，係可藉由共通硬體資源來構成，右90°旋轉部903與左90°旋轉部913，係可藉由共通硬體資源來構成。根據在電源投入時等之初期化序列中所被供給之動作模式設定資訊，係成為能夠使藉由系統LSI所構成之動畫像編碼/解碼處理裝置作為編碼裝置901與解碼裝置911之任一者來任意地動作。
(實施形態4) 〈由實施形態4所致之動畫像編碼/解碼處理裝置〉
圖15，係為對於由本發明之實施形態4所致的動畫像編碼/解碼處理裝置之構成作展示之圖。
若是與圖14中所示之由本發明之實施形態3所致的動畫像編碼/解碼處理裝置作比較，則在圖15所示之由本發明之實施形態4所致的動畫像編碼/解碼處理裝置中，係成為能夠將被儲存在畫像記憶體1302中之參考畫像的複數之巨集區塊(MB)的配列設為與原畫像之複數之巨集區塊(MB)的配列相同。
於圖15之上部，係展示有實行由本發明之實施形態4所致的動畫像編碼之處理的編碼裝置1301，於圖15之下部，係展示有實行由本發明之實施形態4所致的動畫像解碼之處理的解碼裝置1311。
編碼裝置1301，係包含有右90°旋轉部1303、和編碼處理部1304、和週邊巨集區塊資訊儲存記憶體1305、和畫像讀取位址產生部1306、和差分畫像產生部1307、和參考畫像位址產生部1308、以及左90°旋轉部1309。編碼裝置1301，係經由實行被儲存在畫像記憶體1302中之原畫像的動畫像編碼處理，來將動畫像編碼位元串流和參考畫像輸出至畫像記憶體1302處。
根據由畫像讀取位址產生部1306所產生之位址，從畫像記憶體1302，係將在原畫像以及參考畫面之縱寬幅的垂直方向上所配列的個數較小之複數之巨集區塊(MB)9、 5、1依序讀出，並供給至差分畫像產生部1307處。差分畫像產生部1307之輸出訊號，係被供給至右90°旋轉部1303處，右90°旋轉部1303，係將把被供給而來之巨集區塊(MB)作了+90°右旋轉後的旋轉畫像供給至編碼處理部1304處。亦即是，被儲存在畫像記憶體1302中之原畫像的橫寬幅，係成為較縱寬幅更長的橫長畫像，並藉由畫面顯示之逐次掃描的順序，而在右水平方向上配列有複數之巨集區塊(MB)1、2、3、4，並在下垂直方向上配列有複數之巨集區塊(MB)1、5、9。其結果，在被儲存於畫像記憶體1302中之原畫像的橫寬幅之右水平方向上所配列的複數之巨集區塊(MB)1、2、3、4的個數，係成為較在原畫像之縱寬幅的下垂直方向上所配列的複數之巨集區塊(MB)1、5、9之個數而更大之值。
另一方面，經由右90°旋轉部1303而被作了+90°之右旋轉並被供給至編碼處理部1304處之旋轉畫像，在橫寬幅之水平方向上，係包含有個數較小的複數之巨集區塊(MB)9、5、1，在縱寬幅之垂直方向上，係包含有個數較大的複數之巨集區塊(MB)1、2、3、4。
編碼處理部1304，係對於從右90°旋轉部1303所供給而來之差分畫像產生部1307的輸出訊號之巨集區塊(MB)9、5、1依序作處理，而實行動畫像編碼處理。接著，編碼處理部1304，係對於從右90旋轉部1303所供給而來之差分畫像產生部1307的輸出訊號之巨集區塊(MB)10、6、2依序作處理，而實行動畫像編碼處理。經由此動 畫像編碼處理所產生而從編碼處理部1304之輸出所產生的動畫像編碼位元串流，係被儲存在畫像記憶體1302中。又，編碼處理部1304之輸出，係被供給至左90°旋轉部1309處，左90°旋轉部1309之輸出，係根據從參考畫像位址產生部1308所產生之參考畫像位址，而作為參考畫像來儲存在畫像記憶體1302中。在此動畫像編碼處理中所需要之週邊巨集區塊資訊儲存記憶體1305的記憶容量，係只需要在被儲存於畫像記憶體1302中之原畫像的縱寬幅之垂直方向上所配列的複數之巨集區塊(MB)1、5、9的個數便已足夠。
故而，在藉由系統LSI來構成解碼裝置1301時，係成為能夠容易地使用較小之記憶容量的週邊巨集區塊資訊儲存記憶體1305來作為系統LSI之內藏記憶體(ON-CHIP SRAM)。又，將原畫像與參考畫像以及動畫像編碼位元串流作儲存的畫像記憶體1302，係經由同步型動態隨機存取記憶體(SDRAM)而構成之。又，經由編碼裝置1301之動畫像編碼處理而被作了編碼的運動向量MV1，亦係成為與被儲存在畫像記憶體1302中之原畫像處的運動向量作比較並經由右90°旋轉部1303而作了+90°右旋轉者。
解碼裝置1311，係包含有解碼處理部1314、和週邊巨集區塊資訊儲存記憶體1315、和左90°旋轉部1313、和畫像讀取位址產生部1316、和差分畫像產生部1317、以及畫像寫入位址產生部1318。
解碼處理部1314，最初係將在被儲存於畫像記憶體 1312中之動畫像編碼位元串流的橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)9、5、1依序讀出。在從畫像記憶體1312所被依序讀出之動畫像編碼位元串流的橫寬幅之水平方向上所配列的個數較小之複數之巨集區塊(MB)9、5、1，係透過差分畫像產生部1317而被供給至左90°旋轉部1313處。左90°旋轉部1313，係產生在縱寬幅之垂直方向上所配列的複數之巨集區塊(MB)9、5、1，並供給至解碼處理部1314處。
又，畫像讀取位址產生部1316，由於係將在被儲存於畫像記憶體1312處之參考畫像的縱寬幅之垂直方向上所配列的複數之巨集區塊(MB)9、5、1依序讀出，因此，解碼處理部1314，係使用動畫像編碼位元串流之複數之巨集區塊(MB)9、5、1和參考畫像的複數之巨集區塊(MB)9、5、1而實行動畫像解碼處理。經由動畫像解碼處理而從解碼處理部1314所產生之動畫像解碼位元串流，係根據由畫像寫入位址產生部1318所產生的位址，而被儲存在畫像記憶體1312中。在此動畫像解碼處理中所需要之週邊巨集區塊資訊儲存記憶體915的記憶容量，係只需要在被儲存於畫像記憶體1312中之動畫像編碼位元串流的橫寬幅之水平方向上所配列的複數之巨集區塊(MB)9、5、1的個數便已足夠。
其結果，在藉由系統LSI來構成解碼裝置1311時，係成為能夠容易地使用較小之記憶容量的週邊巨集區塊資訊儲存記憶體1315來作為系統LSI之內藏記憶體(ON-CHIP SRAM)。又，將動畫像編碼位元串流和參考畫像以及動畫像解碼位元串流作儲存的畫像記憶體1312，係經由同步型動態隨機存取記憶體(SDRAM)而構成之。又，經由在解碼裝置1311處之動畫像解碼處理所解碼了的運動向量MV2，係為以將經由編碼裝置1301之動畫編碼處理所作了編碼的運動向量MV1之x座標作為運動向量MV2之y座標、並且將運動向量MV1之y座標作為運動向量MV2之x座標(但是，係為負號)的方式而作了座標變換者。
於圖15中所示之由本發明之實施形態4所致的動畫像之編碼裝置1301和解碼裝置1311，係能夠使藉由系統LSI所構成之動畫像編碼/解碼處理裝置積體化至半導體晶片中。此時，編碼處理部1304與解碼處理部1314，係可藉由共通硬體資源來構成，週邊巨集區塊資訊儲存記憶體1305與週邊巨集區塊資訊儲存記憶體1315，係可藉由共通硬體資源來構成，右90°旋轉部1303與左90°旋轉部1313，係可藉由共通硬體資源來構成。根據在電源投入時等之初期化序列中所被供給之動作模式設定資訊，係成為能夠使藉由系統LSI所構成之動畫像編碼/解碼處理裝置作為編碼裝置1301與解碼裝置1311之任一者來任意地動作。
(實施形態5) 〈由實施形態5所致之動畫像處理裝置〉
圖16，係為對於能夠作為在圖5中所示之由本發明之實施形態1所致的動畫像編碼/解碼處理裝置201之巨集區 塊編碼/解碼處理部203、或者是作為在圖13中所示之由本發明之實施形態2所致的編碼裝置701之編碼處理部704與解碼裝置711之解碼處理部714、或者是作為在圖14中所示之由本發明之實施形態3所致的編碼裝置901之編碼處理部904與解碼裝置911之解碼處理部914、亦或是作為在圖15中所示之由本發明之實施形態4所致的編碼裝置1301之編碼處理部1304與解碼裝置1311之解碼處理部1314來使用的由本發明之實施形態5所致的動畫像處理裝置1750之構成作展示的圖。
於圖16中所示之由本發明之實施形態5所致的動畫像處理裝置1750，係具備有：可變長度編碼解碼部(VLCS)1703、和第1動畫像處理單元(CODEC1)1719、和第2動畫像處理單元(CODEC2)1729、和記憶體控制部(MEC)1714、和本地記憶體控制器(LMC)1724、和全體控制部(CTRL)1715、和DMA控制器(DMAC)1725、和外部匯流排1701、以及內部匯流排1702。若依據理想之實施形態，則動畫像處理裝置1750，係藉由被形成在例如單結晶矽基板等之1個的半導體基板上之大規模半導體積體電路(LSI：Large Scale Integrated Circuits)的形態所構成者。又，於圖16中所示之由本發明之實施形態5所致的動畫像處理裝置1750，係成為能夠依據在電源投入時等之初期化序列中所被供給之動作模式設定資訊，來作為編碼裝置與解碼裝置之任一者來任意地動作。
〈可變長度編碼解碼部〉
在可變長度編碼解碼部(VLCS)1703處，係從硬碟(HDD)、光碟、大容量非揮發性快閃記憶體、無線LAN(區域網路)等之媒體來透過DMA控制器1725而以位元串流(BS)的形態被供給有動畫編碼資料。在可變長度編碼解碼部(VLCS)1703之內部，係內藏有串流解析部，經由此串流解析部，被配列在身為奇數行之第1行、第3行、…處的巨集區塊，係被供給至第1動畫像處理單元(CODEC1)1719處，另一方面，被配列在身為偶數行之第2行、第4行、…處的巨集區塊，係被供給至第2動畫像處理單元(CODEC2)1729處。
在可變長度編碼解碼部(VLCS)1703之內部，係內藏有管線控制部，經由此管線控制部，用以進行與巨集區塊相關連之第1動畫像處理單元(CODEC1)1719和第2動畫像處理單元(CODEC2)1729間的並列動作之管線動作，係被作控制。亦即是，身為第1動畫像處理單元(CODEC1)1719之內部電路的第1可變長度編碼解碼部(VLCF1)1710、和第1頻率變換部(TRF1)1711、和第1運動補償部(FME1)1712以及第1去區塊濾波器(DEB1)1713，係為經由被可變長度編碼解碼部(VLCS)1703的管線控制部所控制，而實行管線動作者。又，身為第2動畫像處理單元(CODEC2)1729之內部電路的第2可變長度編碼解碼部(VLCF2)1720、和第2頻率變換部(TRF2) 1721、和第2運動補償部(FME2)1722以及第2去區塊濾波器(DEB2)1723，係為經由被可變長度編碼解碼部(VLCS)1703的管線控制部所控制，而實行管線動作者。故而，實行管線動作之第1動畫像處理單元(CODEC1)1719和第2動畫像處理單元(CODEC2)1729間的並列動作，係成為適合於在圖12中所示之由本發明之實施形態1所致的巨集區塊適應型之圖框、圖場預測模式的巨集區塊(MB)之對(pair)的編碼處理或者是解碼處理者。
如此這般，可變長度編碼解碼部(VLCS)1703，係具備有下述之功能，亦即是，係經由將被供給而來之位元串流作可變長度解碼，而將巨集區塊與運動向量抽出，並求取出在後段之第1動畫像處理單元(CODEC1)1719和第2動畫像處理單元(CODEC2)1729中所需要的參數群之值。
〈可變長度編碼解碼部〉
從可變長度編碼解碼部(VLCS)1703而分別被供給有奇數行與偶數行之巨集區塊的第1可變長度編碼解碼部(VLCF1)1710和第2可變長度編碼解碼部(VLCF2)1720，係為經由實行文脈基礎(context base)適應可變長度編碼解碼，而實行運動向量資訊或巨集區塊參數或是頻率變換資訊之解碼處理者。
〈頻率變換部〉
第1頻率變換部(TRF1)1711與第2頻率變換部(TRF2)1721，係經由從第1可變長度編碼解碼部(VLCF1)1710和第2可變長度編碼解碼部(VLCF2)1720而被供給有頻率變換資訊，來實行逆量化(IQ：Inverse Quantization)和逆離散餘弦變換(IDCT：Inverse Discrete Cosine Transformation)。亦即是，第1頻率變換部(TRF1)1711、第2頻率變換部(TRF2)1721，係對於從第1可變長度編碼解碼部(VLCF1)1710、第2可變長度編碼解碼部(VLCF2)1720所供給而來之作為頻率變換資訊的量化變換係數與量化參數進行處理，並作逆量化變換而算出變換係數，再對於所算出的逆變換係數進行逆正交變換，而求取出像素值或者是圖框間預測殘差，再將從第1運動補償部(FME1)1712、第2運動補償部(FME2)1722所供給而來之參考畫像與圖框間預測殘差作加算，而算出像素值，並將所算出之畫像作輸出。
〈運動補償部〉
第1運動補償部(FME1)1712與第2運動補償部(FME2)1722，係實行運動補償處理。亦即是，第1運動補償部(FME1)1712、第2運動補償部(FME2)1722，係使用從畫像記憶體所透過記憶體控制部(MEC)1714和內部匯流排1702和DMA控制器(DMAC)1725以及外部匯流排1701所供給而來之參考畫像，而實行運動探索，並藉由 此而算出運動向量位置之參考畫像，再輸出至第1頻率變換部(TRF1)1711、第2頻率變換部(TRF2)1721處。
〈去區塊濾波器〉
第1去區塊濾波器(DEB1)1713和第2去區塊濾波器(DEB2)1723，係為實行用以將在畫像解碼時所產生的區塊變形減少之去區塊濾波處理者。亦即是，第1和第2去區塊濾波器(DEB1、DEB2)1713、1723，係使用從第1和第2頻率變換部(TRF1、TRF2)1711、1721所供給而來的處理對象之巨集區塊(MB)的畫像資料、和從第1和第2去區塊濾波器(DEB1、DEB2)1713、1723中的內藏記憶體所供給而來之處理對象的左邊之巨集區塊(MB)的畫像資料，而實行去區塊濾波處理。
〈記憶體控制部〉
記憶體控制部(MEC)1714，係將根據從第1和第2可變長度編碼解碼部(VLCF1、VLCF2)1710、1720所供給而來之運動向量的資訊而用以在圖框間預測中作使用之參考畫像，從畫像記憶體而經由內部匯流排1702與DMA控制器(DMAC)1725以及外部匯流排1701來供給至第1和第2運動補償部(FME1、FME2)1712、1722處。
〈全體控制部〉
全體控制部(CTRL)1715，係對於動畫像處理裝置 1750之全部的內部電路之動作進行控制。例如，全體控制部(CTRL)1715，係產生對於第1和第2去區塊濾波器(DEB1、DEB2)1713、1723之動作作控制的動作控制訊號deb_start。
〈本地區域記憶體控制器〉
本地記憶體控制器(LMC)1724，係對於在圖5中所示之由本發明之實施形態1所致的動畫像編碼/解碼處理裝置(CODEC)201之週邊巨集區塊資訊儲存記憶體204、或者是作為在圖13中所示之由本發明之實施形態2所致的編碼裝置701之週邊巨集區塊資訊儲存記憶體705與解碼裝置711之週邊巨集區塊資訊儲存記憶體715、或者是作為在圖14中所示之由本發明之實施形態3所致的編碼裝置901之週邊巨集區塊資訊儲存記憶體905與解碼裝置911之週邊巨集區塊資訊儲存記憶體915、亦或是作為在圖15中所示之由本發明之實施形態4所致的編碼裝置1301之週邊巨集區塊資訊儲存記憶體1305與解碼裝置1311之週邊巨集區塊資訊儲存記憶體1315，而對於其之寫入動作和讀出動作作控制。
例如，本地記憶體控制器(LMC)1724，係將與相關於奇數行之巨集區塊(MB)的第1動畫像處理單元(CODEC1)1719之處理結果有所關連的參數，儲存在此些之週邊巨集區塊資訊儲存記憶體中，並將與相關於偶數行之巨集區塊(MB)的在第2動畫像處理單元 (CODEC2)1729中所必要之畫像有所關連的參數作傳輸。又，本地記憶體控制器(LMC)1724，係將與相關於偶數行之巨集區塊(MB)的第2動畫像處理單元(CODEC2)1729之處理結果有所關連的參數，儲存在此些之週邊巨集區塊資訊儲存記憶體中，並將與相關於奇數行之巨集區塊(MB)的在第1動畫像處理單元(CODEC1)1719中所必要之畫像有所關連的參數作傳輸。如此這般，本地記憶體控制器(LMC)1724，係為實行週邊巨集區塊資訊之對於週邊巨集區塊資訊儲存記憶體的儲存動作與讀出動作者，並與作為被內藏在經由系統大規模半導體積體電路(系統LSI)所構成的動畫像編碼解碼裝置(CODEC)之半導體晶片中的週邊巨集區塊資訊儲存記憶體之內藏記憶體(ON-CHIP SRAM)作連接。
〈DMA控制器〉
DMA控制器(DMAC：Direct Memory Access Controller)1725，係為在被與動畫像處理裝置1750之外部匯流排1701作連接的例如經由同步型動態隨機存取記憶體(SDRAM)所構成之畫像記憶體、和第1與第2動畫像處理單元1719、1729之間，而被使用來進行包含有大量之巨集區塊(MB)的參考畫像或者是編碼位元串流之高速資料傳輸。
在使圖16中所示之由本發明之實施形態5所致的動畫像處理裝置1750作為解碼裝置而動作時，第1動畫像處理 單元(CODEC1)1719之第1可變長度編碼解碼部(VLCF1)1710和第1頻率變換部(TRF1)1711以及第1運動補償部(FME1)1712，係分別作為可變長度解碼部和逆量化器、逆DCT變換器以及運動補償部而動作。同樣的，第2動畫像處理單元(CODEC2)1729之第2可變長度編碼解碼部(VLCF2)1720和第2頻率變換部(TRF2)1721以及第2運動補償部(FME2)1722，亦係分別作為可變長度解碼部和逆量化器、逆DCT變換器以及運動補償部而動作。
另一方面，在使圖16中所示之由本發明之實施形態5所致的動畫像處理裝置1750作為編碼裝置而動作時，第1動畫像處理單元(CODEC1)1719之第1可變長度編碼解碼部(VLCF1)1710和第1頻率變換部(TRF1)1711以及第1運動補償部(FME1)1712，係分別作為構成殘差編碼部之可變長度編碼部和DCT變換器、量化器以及運動預測部而動作。同樣的，第2動畫像處理單元(CODEC2)1729之第2可變長度編碼解碼部(VLCF2)1720和第2頻率變換部(TRF2)1721以及第2運動補償部(FME2)1722，亦係分別作為構成殘差編碼部之可變長度編碼部和DCT變換器、量化器以及運動預測部而動作。
以上，雖根據各種之實施之形態，而對本發明者所致之發明作了具體的說明。但是，本發明係並不被限定於此，不用說，在不脫離其要旨之範圍內，係可作各種之變更。
例如，在圖16中所示之本發明之實施形態5中，第1動畫像處理單元(CODEC1)1719之第1可變長度編碼解碼部(VLCF1)1710和第1頻率變換部(TRF1)1711和第1運動補償部(FME1)1712，以及第2動畫像處理單元(CODEC2)1729之第2可變長度編碼解碼部(VLCF2)1720和第2頻率變換部(TRF2)1721和第2運動補償部(FME2)1722，係並不被限定於經由硬體來實現之。此些之動作功能，例如，亦可經由微處理器等之軟體處理來實現之。此時，週邊巨集區塊資訊儲存記憶體204、705、715等，係亦可使用微處理器等之快取記憶體。
以上所說明了的由本發明之各種實施形態所致的動畫像編碼/解碼處理裝置，係可搭載在行動電話、車輛導航系統、DVD/HDD/BD錄影機、數位視訊攝像機、數位相機、數位電視、電話會議系統等之中。
201‧‧‧動畫像編碼/解碼處理裝置
202‧‧‧畫像記憶體
203‧‧‧巨集區塊編碼/解碼處理部
204‧‧‧週邊巨集區塊資訊儲存記憶體
205‧‧‧垂直方向巨集區塊計數器
206‧‧‧畫面下端判定部
207‧‧‧水平方向巨集區塊計數器
208‧‧‧畫面右端判定部
209‧‧‧AND邏輯閘電路
701‧‧‧編碼裝置
702‧‧‧畫像記憶體
703‧‧‧畫像旋轉部
704‧‧‧編碼處理部
705‧‧‧週邊巨集區塊資訊儲存記憶體
711‧‧‧解碼裝置
712‧‧‧畫像記憶體
713‧‧‧畫像旋轉部
714‧‧‧解碼處理部
715‧‧‧週邊巨集區塊資訊儲存記憶體
901‧‧‧編碼裝置
902‧‧‧畫像記憶體
903‧‧‧右90°旋轉部
904‧‧‧編碼處理部
905‧‧‧週邊巨集區塊資訊儲存記憶體
906‧‧‧畫像讀取位址產生部
911‧‧‧解碼裝置
912‧‧‧畫像記憶體
913‧‧‧左90°旋轉部
914‧‧‧解碼處理部
915‧‧‧週邊巨集區塊資訊儲存記憶體
916‧‧‧畫像讀取位址產生部
917‧‧‧差分畫像產生部
918‧‧‧畫像寫入位址產生部
1301‧‧‧編碼裝置
1302‧‧‧畫像記憶體
1303‧‧‧右90°旋轉部
1304‧‧‧編碼處理部
1305‧‧‧週邊巨集區塊資訊儲存記憶體
1306‧‧‧畫像讀取位址產生部
1307‧‧‧差分畫像產生部
1308‧‧‧參考畫像位址產生部
1309‧‧‧左90°旋轉部
1311‧‧‧解碼裝置
1312‧‧‧畫像記憶體
1313‧‧‧左90°旋轉部
1314‧‧‧解碼處理部
1315‧‧‧週邊巨集區塊資訊儲存記憶體
1316‧‧‧畫像讀取位址產生部
1317‧‧‧差分畫像產生部
1318‧‧‧畫像寫入位址產生部
[圖1]圖1，係為展示在由本發明之實施形態1所致的動畫像編碼/解碼處理方式中之階層構造作說明之圖。
[圖2]圖2，係為對於藉由在圖1中所示之由本發明之實施形態1所致的動畫像編碼方式而被作了編碼之編碼位元串流的構成作展示之圖。
[圖3]圖3，係為對於由本發明之實施形態1所致的動畫像編碼/解碼處理之程序作展示的流程圖。
[圖4]圖4，係為對於經由在圖3之流程圖中所示之由本 發明之實施形態1所致的動畫像編碼/解碼處理之程序，而對於1枚的影像畫面之被配置在2維巨集區塊座標(x、y)處的複數之巨集區塊(MB)依序作處理的模樣作展示之圖。
[圖5]圖5，係為對於能夠實行在圖3之流程圖中所示之由本發明之實施形態1所致的動畫像編碼/解碼處理之程序的由本發明之實施形態1所致的動畫編碼/解碼處理裝置的構成作展示之圖。
[圖6]圖6，係為對於在使圖5中所示之由本發明之實施形態1所致的動畫像編碼/解碼處理裝置作為解碼處理裝置而動作時所供給之動畫像編碼位元串流的資料配列作展示之圖。
[圖7]圖7，係為對於在實行與本發明相異之先前技術之編碼處理的情況時之處理對象巨集區塊(MB)401與在處理對象巨集區塊(MB)401之預測中所被使用之4個的週邊巨集區塊(MB)402~405間的關係作展示之圖。
[圖8]圖8，係為對於在實行於圖1~圖6中所說明了的由本發明之實施形態1所致的動畫像之編碼/解碼處理之程序的情況時之處理對象巨集區塊(MB)401與在處理對象巨集區塊(MB)401之預測中所被使用之4個的週邊巨集區塊(MB)406~409間的關係作展示之圖。
[圖9]圖9，係為對於根據先前技術之編碼處理而從位置在1枚的影像畫面之左上方的巨集區塊(MB)起來開始並以所標示之逐列掃描順序來最初朝向右方向並接著朝向 下方向而依序實行複數之巨集區塊(MB)之編碼處理的模樣作展示之圖。
[圖10]圖10，係為對於在圖1~圖6中所說明了的由本發明之實施形態1所致的編碼處理而從位置在1枚的影像畫面之左上方的巨集區塊(MB)起來開始而最初朝向下方向並接著朝向右方向而依序實行複數之巨集區塊(MB)之編碼處理的模樣作展示之圖。
[圖11]圖11，係為對於將被導入至MPEG-4 AVC(H.264)之編碼方式中的巨集區塊適應型之圖框、圖場預測模式的2列之巨集區塊(MB)的對(pair)，根據先前技術之編碼處理來作編碼的模樣作展示之圖。
[圖12]圖12，係為對於將被導入至MPEG-4 AVC(H.264)之編碼方式中的巨集區塊適應型之圖框、圖場預測模式之巨集區塊(MB)的對(pair)，根據在圖1~圖6中所說明了的由本發明之實施形態1所致的編碼處理來作編碼的模樣作展示之圖。
[圖13]圖13，係為對於由本發明之實施形態2所致的動畫像編碼/解碼處理裝置之構成作展示之圖。
[圖14]圖14，係為對於由本發明之實施形態3所致的動畫像編碼/解碼處理裝置之構成作展示之圖。
[圖15]圖15，係為對於由本發明之實施形態4所致的動畫像編碼/解碼處理裝置之構成作展示之圖。
[圖16]圖16，係為對於能夠作為在圖5中所示之由本發明之實施形態1所致的動畫像編碼/解碼處理裝置201之巨 集區塊編碼/解碼處理部203、或者是作為在圖13中所示之由本發明之實施形態2所致的編碼裝置701之編碼處理部704與解碼裝置711之解碼處理部714、或者是作為在圖14中所示之由本發明之實施形態3所致的編碼裝置901之編碼處理部904與解碼裝置911之解碼處理部914、亦或是作為在圖15中所示之由本發明之實施形態4所致的編碼裝置1301之編碼處理部1304與解碼裝置1311之解碼處理部1314來使用的由本發明之實施形態5所致的動畫像處理裝置1750之構成作展示的圖。
MB‧‧‧巨集區塊

Claims (35)

  1. 一種動畫像編碼方法，係為使用編碼處理裝置來將被包含於水平方向之橫寬幅為較垂直方向之縱寬幅更大的橫長畫面之動畫像中的複數之巨集區塊作編碼之動畫像編碼方法，其特徵為：前述編碼處理裝置，係被連接有畫像記憶體，並內藏有資訊儲存記憶體，該畫像記憶體，係儲存有前述動畫像之編碼前的前述複數之巨集區塊之資訊和已完成編碼的複數之巨集區塊之資訊，在前述複數之巨集區塊的編碼時，身為被儲存在前述畫像記憶體中之前述已完成編碼的複數之巨集區塊之一部分且為在應進行編碼之巨集區塊週邊的複數之已完成編碼的複數之巨集區塊的資訊，係被儲存在前述資訊儲存記憶體中，在前述複數之巨集區塊的前述編碼時，最初係經由將前述橫長畫面之前述橫寬幅的左端處所配列在前述垂直方向上的複數之巨集區塊依序作編碼，而將在前述左端處所配列在前述垂直方向上之前述複數之巨集區塊的編碼資訊儲存在前述資訊儲存記憶體中，在前述被配列在垂直方向上之前述複數之巨集區塊被作了編碼後，接著，將前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰的被配列在前述垂直方向上之複數之巨集區塊，依序作編碼。
  2. 如申請專利範圍第1項所記載之動畫像編碼方法， 其中，在前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊依序被作編碼時，係使用有被儲存在前述資訊儲存記憶體中之在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊的前述編碼資訊。
  3. 如申請專利範圍第2項所記載之動畫像編碼方法，其中，在前述被配列在垂直方向上之前述複數之巨集區塊的各巨集區塊被作了編碼之後，經由前述編碼處理裝置，來對於前述各巨集區塊而判定其是否為位置在前述縱寬幅之下端或者是上端處的最後或者是最初之巨集區塊。
  4. 如申請專利範圍第3項所記載之動畫像編碼方法，其中，當在前述橫長畫面之前述橫寬幅的前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊被作了編碼之後，經由前述編碼處理裝置，來對於被作了編碼之前述複數之巨集區塊而判定其是否為位置在前述橫寬幅之右端的最後之複數之巨集區塊。
  5. 如申請專利範圍第4項所記載之動畫像編碼方法，其中，當經由前述編碼處理裝置，而判定前述各巨集區塊係並非為位置在前述縱寬幅之前述下端或者是前述上端處之前述最後或者是前述最初之巨集區塊的情況時，係將代表在前述左端之前述垂直方向上而下一個被作編碼之巨集區塊的位置之垂直方向巨集區塊計數器的計數值，作1的增數。
  6. 如申請專利範圍第5項所記載之動畫像編碼方法， 其中，當經由前述編碼處理裝置，而判定被作了編碼的前述複數之巨集區塊係並非為位置在前述橫寬幅之前述右端處之前述最後之複數之巨集區塊的情況時，係將代表在前述橫長畫面之前述橫寬幅的前述水平方向上而下一個被作編碼之複數之巨集區塊的位置之水平方向巨集區塊計數器的計數值，作1的增數。
  7. 一種動畫像解碼方法，係為使用解碼處理裝置來將被包含於水平方向之橫寬幅為較垂直方向之縱寬幅更大的橫長畫面之動畫像中的複數之巨集區塊作解碼之動畫像解碼方法，其特徵為：前述解碼處理裝置，係被連接有畫像記憶體，並內藏有資訊儲存記憶體，該畫像記憶體，係儲存有前述動畫像之解碼前的前述複數之巨集區塊之資訊和已完成解碼的複數之巨集區塊之資訊，在前述複數之巨集區塊的解碼時，身為被儲存在前述畫像記憶體中之前述已完成解碼的複數之巨集區塊之一部分且為在應進行解碼之巨集區塊週邊的複數之已完成解碼的複數之巨集區塊的資訊，係被儲存在前述資訊儲存記憶體中，在前述複數之巨集區塊的前述解碼時，最初係經由將前述橫長畫面之前述橫寬幅的左端處所配列在前述垂直方向上的複數之巨集區塊依序作解碼，而將在前述左端處所配列在前述垂直方向上之前述複數之巨集區塊的解碼資訊儲存在前述資訊儲存記憶體中， 在前述被配列在垂直方向上之前述複數之巨集區塊被作了解碼後，接著，將前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰的被配列在前述垂直方向上之複數之巨集區塊，依序作解碼。
  8. 如申請專利範圍第7項所記載之動畫像解碼方法，其中，在前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊依序被作解碼時，係使用有被儲存在前述資訊儲存記憶體中之在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊的前述解碼資訊。
  9. 如申請專利範圍第8項所記載之動畫像解碼方法，其中，在前述被配列在垂直方向上之前述複數之巨集區塊的各巨集區塊被作了解碼之後，經由前述解碼處理裝置，來對於前述各巨集區塊而判定其是否為位置在前述縱寬幅之下端或者是上端處的最後或者是最初之巨集區塊。
  10. 如申請專利範圍第9項所記載之動畫像解碼方法，其中，當在前述橫長畫面之前述橫寬幅的前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊被作了解碼之後，經由前述解碼處理裝置，來對於被作了解碼之前述複數之巨集區塊而判定其是否為位置在前述橫寬幅之右端的最後之複數之巨集區塊。
  11. 如申請專利範圍第10項所記載之動畫像解碼方法，其中，當經由前述解碼處理裝置，而判定前述各巨集區塊係並非為位置在前述縱寬幅之前述下端或者是前述上 端處之前述最後或者是前述最初之巨集區塊的情況時，係將代表在前述左端之前述垂直方向上而下一個被作解碼之巨集區塊的位置之垂直方向巨集區塊計數器的計數值，作1的增數。
  12. 如申請專利範圍第11項所記載之動畫像解碼方法，其中，當經由前述解碼處理裝置，而判定被作了解碼的前述複數之巨集區塊係並非為位置在前述橫寬幅之前述右端處之前述最後之複數之巨集區塊的情況時，係將代表在前述橫長畫面之前述橫寬幅的前述水平方向上而下一個被作解碼之複數之巨集區塊的位置之水平方向巨集區塊計數器的計數值，作1的增數。
  13. 一種動畫像編碼處理裝置，係為了將被包含於水平方向之橫寬幅為較垂直方向之縱寬幅更大的橫長畫面之動畫像中的複數之巨集區塊作編碼，而具備有編碼處理部與資訊儲存記憶體，該動畫像編碼處理裝置，其特徵為：係能夠與畫像記憶體作連接，該畫像記憶體，係儲存有前述動畫像之編碼前的前述複數之巨集區塊之資訊和已完成編碼的複數之巨集區塊之資訊，在由前述編碼處理部所進行之前述複數之巨集區塊的編碼時，身為被儲存在前述畫像記憶體中之前述已完成編碼的複數之巨集區塊之一部分且為在應進行編碼之巨集區塊週邊的複數之已完成編碼的複數之巨集區塊的資訊，係被儲存在前述資訊儲存記憶體中，在前述複數之巨集區塊的前述編碼時，最初係經由將 前述橫長畫面之前述橫寬幅的左端處所配列在前述垂直方向上的複數之巨集區塊以前述編碼處理部來依序作編碼，而將在前述左端處所配列在前述垂直方向上之前述複數之巨集區塊的編碼資訊經由前述編碼處理部來儲存在前述資訊儲存記憶體中，在前述被配列在垂直方向上之前述複數之巨集區塊被作了編碼後，接著，將前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰的被配列在前述垂直方向上之複數之巨集區塊，經由前述編碼處理部來依序作編碼。
  14. 如申請專利範圍第13項所記載之動畫像編碼處理裝置，其中，在前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊經由前述編碼處理部而依序被作編碼時，係使用有被儲存在前述資訊儲存記憶體中之在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊的前述編碼資訊。
  15. 如申請專利範圍第14項所記載之動畫像編碼處理裝置，其中，在前述被配列在垂直方向上之前述複數之巨集區塊的各巨集區塊被作了編碼之後，經由前述動畫像編碼處理裝置，來對於前述各巨集區塊而判定其是否為位置在前述縱寬幅之下端或者是上端處的最後或者是最初之巨集區塊。
  16. 如申請專利範圍第15項所記載之動畫像編碼處理裝置，其中，當在前述橫長畫面之前述橫寬幅的前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述 複數之巨集區塊被作了編碼之後，經由前述動畫像編碼處理裝置，來對於被作了編碼之前述複數之巨集區塊而判定其是否為位置在前述橫寬幅之右端的最後之複數之巨集區塊。
  17. 如申請專利範圍第16項所記載之動畫像編碼處理裝置，其中，前述動畫像編碼處理裝置，係更進而具備有：垂直方向巨集區塊計數器，係顯示在前述垂直方向上而下一個被作編碼之巨集區塊的位置，當經由前述動畫像編碼處理裝置，而判定前述各巨集區塊係並非為位置在前述縱寬幅之前述下端或者是前述上端處之前述最後或者是前述最初之巨集區塊的情況時，係將前述垂直方向巨集區塊計數器的計數值，作1的增數。
  18. 如申請專利範圍第17項所記載之動畫像編碼處理裝置，其中，前述動畫像編碼處理裝置，係更進而具備有：水平方向巨集區塊計數器，係顯示在前述水平方向上而下一個被作編碼之複數之巨集區塊的位置，當經由前述動畫像編碼處理裝置，而判定被作了編碼的前述複數之巨集區塊係並非為位置在前述橫寬幅之前述右端處之前述最後之複數之巨集區塊的情況時，係將前述水平方向巨集區塊計數器的計數值，作1的增數。
  19. 如申請專利範圍第14項所記載之動畫像編碼處理裝置，其中，係設為在將在前述橫長畫面之前述縱寬幅的前述上端處所被配列在前述水平方向上之複數之巨集區塊儲存在前述畫像記憶體中之後，能夠接著而將前述橫長畫 面之前述縱寬幅的前述上端之垂直方向下鄰處所被配列在前述水平方向上之複數之巨集區塊儲存在前述畫像記憶體中。
  20. 如申請專利範圍第19項所記載之動畫像編碼處理裝置，其中，前述動畫像編碼處理裝置，係更進而具備有：畫像旋轉部，係從前述畫像記憶體而將前述橫長畫面讀出，並將畫像作90°旋轉，之後，將所產生了的旋轉畫像寫入至前述畫像記憶體中，設為能夠將被儲存在前述畫像記憶體中之旋轉畫像讀出並供給至前述編碼處理部處。
  21. 如申請專利範圍第20項所記載之動畫像編碼處理裝置，其中，前述動畫像編碼處理裝置，係更進而具備有：畫像記憶體介面，係被設為能夠與前述畫像記憶體作連接，前述畫像記憶體介面，係被設為能夠進行：從前述畫像記憶體而將前述橫長畫面之在前述橫寬幅的前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊讀出，並供給至前述編碼處理部，之後，接著將前述橫長畫面之在前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊讀出，並供給至前述編碼處理部。
  22. 如申請專利範圍第19項所記載之動畫像編碼處理裝置，其中，係更進而具備有：畫像旋轉部，係成為能夠產生將從前述畫像記憶體所讀出之前述複數之巨集區塊的各巨集區塊作了90°旋轉的旋轉畫像，並供給至前述編碼處理部。
  23. 如申請專利範圍第22項所記載之動畫像編碼處理裝置，其中，係更進而具備有：畫像讀取位址產生部，係藉由此而成為能夠進行：從前述畫像記憶體而將前述橫長畫面之在前述橫寬幅的前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊讀出，並供給至前述畫像旋轉部，之後，接著將前述橫長畫面之在前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊讀出，並供給至前述畫像旋轉部。
  24. 如申請專利範圍第13項乃至第23項中之任一項所記載之動畫像編碼處理裝置，其中，前述編碼處理部，係包含有可變長度編碼部和正交變換器、量化器以及運動預測部之各動作功能。
  25. 一種動畫像解碼處理裝置，係為了將被包含於水平方向之橫寬幅為較垂直方向之縱寬幅更大的橫長畫面之動畫像中的複數之巨集區塊作解碼，而具備有解碼處理部與資訊儲存記憶體，該動畫像解碼處理裝置，其特徵為：係能夠與畫像記憶體作連接，該畫像記憶體，係儲存有前述動畫像之解碼前的前述複數之巨集區塊之資訊和已完成解碼的複數之巨集區塊之資訊，在由前述解碼處理部所進行之前述複數之巨集區塊的解碼時，身為被儲存在前述畫像記憶體中之前述已完成解碼的複數之巨集區塊之一部分且為在應進行解碼之巨集區塊週邊的複數之已完成解碼的複數之巨集區塊的資訊，係被儲存在前述資訊儲存記憶體中， 在前述複數之巨集區塊的前述解碼時，最初係經由將前述橫長畫面之前述橫寬幅的左端處所配列在前述垂直方向上的複數之巨集區塊以前述解碼處理部來依序作解碼，而將在前述左端處所配列在前述垂直方向上之前述複數之巨集區塊的解碼資訊經由前述解碼處理部來儲存在前述資訊儲存記憶體中，在前述被配列在垂直方向上之前述複數之巨集區塊被作了解碼後，接著，將前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰的被配列在前述垂直方向上之複數之巨集區塊，經由前述解碼處理部來依序作解碼。
  26. 如申請專利範圍第25項所記載之動畫像解碼處理裝置，其中，在前述左端之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊經由前述解碼處理部而依序被作解碼時，係使用有被儲存在前述資訊儲存記憶體中之在前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊的前述解碼資訊。
  27. 如申請專利範圍第26項所記載之動畫像解碼處理裝置，其中，在前述被配列在垂直方向上之前述複數之巨集區塊的各巨集區塊被作了解碼之後，經由前述動畫像解碼處理裝置，來對於前述各巨集區塊而判定其是否為位置在前述縱寬幅之下端或者是上端處的最後或者是最初之巨集區塊。
  28. 如申請專利範圍第27項所記載之動畫像解碼處理裝置，其中，當在前述橫長畫面之前述橫寬幅的前述左端 之前述水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊被作了解碼之後，經由前述動畫像解碼處理裝置，來對於被作了解碼之前述複數之巨集區塊而判定其是否為位置在前述橫寬幅之右端的最後之複數之巨集區塊。
  29. 如申請專利範圍第28項所記載之動畫像解碼處理裝置，其中，前述動畫像解碼處理裝置，係更進而具備有：垂直方向巨集區塊計數器，係顯示在前述垂直方向上而下一個被作解碼之巨集區塊的位置，當經由前述動畫像解碼處理裝置，而判定前述各巨集區塊係並非為位置在前述縱寬幅之前述下端或者是前述上端處之前述最後或者是前述最初之巨集區塊的情況時，係將前述垂直方向巨集區塊計數器的計數值，作1的增數。
  30. 如申請專利範圍第29項所記載之動畫像解碼處理裝置，其中，前述動畫像解碼處理裝置，係更進而具備有：水平方向巨集區塊計數器，係顯示在前述水平方向上而下一個被作解碼之複數之巨集區塊的位置，當經由前述動畫像解碼處理裝置，而判定被作了解碼的前述複數之巨集區塊係並非為位置在前述橫寬幅之前述右端處之前述最後之複數之巨集區塊的情況時，係將前述水平方向巨集區塊計數器的計數值，作1的增數。
  31. 如申請專利範圍第26項所記載之動畫像解碼處理裝置，其中，前述動畫像解碼處理裝置，係更進而具備有：畫像旋轉部，係從前述畫像記憶體而將前述橫長畫面 讀出，並將畫像作90°旋轉，之後，將所產生了的旋轉畫像寫入至前述畫像記憶體中。
  32. 如申請專利範圍第26項所記載之動畫像解碼處理裝置，其中，前述動畫像解碼處理裝置，係更進而具備有可供給動畫像編碼訊號之外部介面，前述外部介面，係構成為能夠將前述動畫像編碼訊號中所包含之在前述橫長畫面的前述橫寬幅之前述左端處所配列在前述垂直方向上之前述複數之巨集區塊，供給至前述解碼處理部，之後，接著將前述動畫像編碼訊號中所包含之在前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊，供給至前述解碼處理部，前述動畫像解碼處理裝置，係對於從前述外部介面所供給而來之前述動畫像編碼訊號中所包含之在前述橫長畫面的前述橫寬幅之前述左端處所配列在前述垂直方向上之前述複數之巨集區塊，進行解碼處理，之後，接著對於從前述外部介面所供給而來之前述動畫像編碼訊號中所包含之在前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之巨集區塊，進行解碼處理，前述動畫像解碼處理裝置，係被設為能夠將在前述橫長畫面的前述橫寬幅之前述左端處所配列在前述垂直方向上之前述複數之巨集區塊的解碼處理資訊，儲存在前述畫 像記憶體之第1記憶區域中，之後，接著將前述動畫像編碼訊號中所包含之在前述橫長畫面之前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊的解碼處理資訊，儲存在前述畫像記憶體之第2記憶區域中，前述畫像記憶體之前述第1記憶區域、和前述第2記憶區域，係與水平方向之顯示橫寬幅為較垂直方向之顯示縱寬幅更大的橫長動畫像顯示畫面之在前述顯示橫寬幅之左端處所配列在前述垂直方向上之複數之畫像資訊、和在前述顯示橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之複數之畫像資訊，而分別相對應。
  33. 如申請專利範圍第32項所記載之動畫像解碼處理裝置，其中，該動畫像解碼處理裝置，係更進而具備有：畫像寫入位址產生部，係藉由此而成為能夠進行：將前述橫長畫面之在前述橫寬幅的前述左端處所被配列在前述垂直方向上之前述複數之巨集區塊的解碼處理資訊，儲存在前述畫像記憶體之前述第1記憶區域中，之後，接著將前述動畫像編碼訊號中所包含之前述橫長畫面之在前述橫寬幅的前述左端之水平方向右鄰處所被配列在前述垂直方向上之前述複數之巨集區塊的解碼處理資訊，儲存在前述畫像記憶體之前述第2記憶區域中。
  34. 如申請專利範圍第33項所記載之動畫像解碼處理裝置，其中，前述外部介面，係被設為能夠產生將在前述動畫像編碼訊號中所包含之前述複數之巨集區塊作了略90°旋轉後之旋轉畫像並供給至前述解碼處理部。
  35. 如申請專利範圍第25項乃至第34項中之任一項所記載之動畫像解碼處理裝置，其中，前述解碼處理部，係包含有可變長度解碼部和逆量化器、逆正交變換器以及運動補償部之各動作功能。
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