TW202205242A - 畫素電路 - Google Patents

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Abstract

一種畫素電路，其包括驅動電路、第一開關、第二開關、第三開關、控制電路以及發光單元。第一開關連接驅動電路並由第一啟動訊號控制，第一開關根據第一啟動訊號之第一工作週期輸出第一電流。第二開關連接驅動電路並由第二啟動訊號控制，第二開關根據第二啟動訊號之第二工作週期輸出第二電流，第二工作週期和第一工作週期相異。第三開關連接第二開關及接收第二電流。控制電路連接第三開關並發出控制訊號至第三開關，第三開關根據控制訊號和第二電流而輸出第三電流。發光單元連接第三開關和第一開關，發光單元根據第一電流或第三電流而發光。

Description

畫素電路
本發明關於一種利用第一開關、第二開關以及第三開關調整驅動電流流經發光單元的發光時間之畫素電路。
有機發光二極體具有自發光、高亮度、高對比、製程簡單等優點，已逐漸應用於各種類型顯示器。有機發光二極體本身為電流驅動元件，透過給予畫素電路不同資料電壓產生不同驅動電流來控制有機發光二極體的亮度(亦稱灰階值)；然而，顯示器需要多個不同的灰階值，當需求之灰階數目大於資料驅動電路可提供的資料電壓數目時，一個資料電壓對應一個灰階值之畫素電路便不敷使用。
綜觀前所述，本發明之發明者思索並設計一種畫素電路，以期針對習知技術之缺失加以改善，進而增進產業上之實施利用。
有鑑於上述習知之問題，本發明的目的在於提供一種畫素電路，用以解決習知技術中所面臨之問題。
基於上述目的，本發明提供一種畫素電路，其包括驅動電路、第一開關、第二開關、第三開關、控制電路以及發光單元。第一開關連接驅動電路並由第一啟動訊號控制，第一開關根據第一啟動訊號之第一工作週期(duty cycle)輸出第一電流。第二開關連接驅動電路並由第二啟動訊號控制，第二開關根據第二啟動訊號之第二工作週期輸出第二電流，第二工作週期和第一工作週期相異。第三開關連接第二開關及接收第二電流。控制電路連接第三開關並發出控制訊號至第三開關，第三開關根據控制訊號和第二電流而輸出第三電流。發光單元連接第三開關和第一開關，發光單元根據第一電流或第三電流而發光。
在本發明的實施例中，當第一開關、第二開關以及第三開關導通時，發光單元受第一電流和第三電流的驅動而發光。
在本發明的實施例中，當第一開關、第二開關導通而第三開關關閉時，發光單元受第一電流的驅動而發光。
在本發明的實施例中，第一啟動訊號和第二啟動訊號的頻率彼此相異。
在本發明的實施例中，第一啟動訊號和第二啟動訊號使第一開關與第二開關交錯開啟。
在本發明的實施例中，第一開關和第二開關為負緣觸發。
在本發明的實施例中，驅動電路為電流源電路。
在本發明的實施例中，控制電路包括電晶體和電容，電晶體的第一端連接第三開關的控制端，電容設置於電晶體和第三開關之間。
在本發明的實施例中，第三開關為負緣觸發。
在本發明的實施例中，當驅動電路於第一模式，發光單元具有第一亮度，當驅動電路於第二模式，發光單元具有第二亮度，第二亮度高於第一亮度。
承上所述，本發明之畫素電路，透過第一開關、第二開關以及第三開關的操控，使發光單元具有不同的亮度。
本發明之優點、特徵以及達到之技術方法將參照例示性實施例及所附圖式進行更詳細地描述而更容易理解，且本發明可以不同形式來實現，故不應被理解僅限於此處所陳述的實施例，相反地，對所屬技術領域具有通常知識者而言，所提供的實施例將使本揭露更加透徹與全面且完整地傳達本發明的範疇，且本發明將僅為所附加的申請專利範圍所定義。
應當理解的是，儘管術語「第一」、「第二」等在本發明中可用於描述各種元件、部件、區域、層及/或部分，但是這些元件、部件、區域、層及/或部分不應受這些術語的限制。這些術語僅用於將一個元件、部件、區域、層及/或部分與另一個元件、部件、區域、層及/或部分區分開。因此，下文討論的「第一元件」、「第一部件」、「第一區域」、「第一層」及/或「第一部分」可以被稱為「第二元件」、「第二部件」、「第二區域」、「第二層」及/或「第二部分」，而不悖離本發明的精神和教示。
另外，術語「包括」及/或「包含」指所述特徵、區域、整體、步驟、操作、元件及/或部件的存在，但不排除一個或多個其他特徵、區域、整體、步驟、操作、元件、部件及/或其組合的存在或添加。
除非另有定義，本發明所使用的所有術語(包括技術和科學術語)具有與本發明所屬技術領域的普通技術人員通常理解的相同含義。將進一步理解的是，諸如在通常使用的字典中定義的那些術語應當被解釋為具有與它們在相關技術和本發明的上下文中的含義一致的定義，並且將不被解釋為理想化或過度正式的意義，除非本文中明確地這樣定義。
請參閱第1圖，其為本發明之畫素電路之第一實施例的配置圖。如第1圖所示，本發明之畫素電路，其包括驅動電路10、第一開關20、第二開關30、第三開關40、控制電路50以及發光單元60。第一開關20連接驅動電路10並由第一啟動訊號EM1控制，第一開關20根據第一啟動訊號EM1之第一工作週期Duty1輸出第一電流I1。第二開關30連接驅動電路10並由第二啟動訊號EM2控制，第二開關30根據第二啟動訊號EM2之第二工作週期Duty2輸出第二電流I2，第二工作週期Duty2和第一工作週期Duty1相異。第三開關40連接第二開關30及接收第二電流I2。控制電路50連接第三開關40並發出控制訊號至第三開關40，第三開關40根據控制訊號和第二電流而輸出第三電流I3。發光單元60連接第三開關40和第一開關20，發光單元60根據第一電流I1或第三電流I3而發光。
其中，第一啟動訊號EM1和第二啟動訊號EM2的工作週期彼此相異，第一啟動訊號EM1和第二啟動訊號EM2使第一開關20與第二開關30交錯開啟，亦即，第一開關20和第二開關30未同時開啟。第一開關20、第二開關30以及第三開關40皆為負緣觸發，第一開關20和第二開關30於接受第一啟動訊號EM1和第二啟動訊號EM2的負緣時導通，第一開關20和第二開關30於接受第一啟動訊號EM1和第二啟動訊號EM2的正緣時關閉。
續言之，控制電路50包括電晶體T和電容C1，電晶體T的第一端S1連接第三開關40的控制端(亦即閘極)，電容C設置於電晶體T和第三開關40之間，電晶體T的第二端D1接收第一電壓VGL和第二電壓VGH，電晶體T的控制端G1使電晶體T導通，電晶體T根據第二端D1所接收第一電壓VGL和第二電壓VGH，於第一端S1輸出第一電壓VGL和第二電壓VGH，第二電壓VGH高於第一電壓VGL。發光單元60可為水平式發光二極體、覆晶式發光二極體、垂直式發光二極體或其他電子元件，而未侷限於本發明所列舉的範圍。
請參閱第2A圖至第3B圖，其分別為本發明之畫素電路之第一實施例之第一態樣的示意圖、本發明之畫素電路之第一實施例之第一態樣的波形圖、本發明之畫素電路之第二實施例之第一態樣的示意圖、本發明之畫素電路之第二實施例之第一態樣的波形圖。如第2A圖至第3B圖所示，詳細說明本發明之畫素電路之作動如下：(1)如第2A圖和第2B圖所示，於時間點T1期間，第一開關20和第二開關30分別接收第一啟動訊號EM1和第二啟動訊號EM2而交錯開啟，電晶體T的控制端G1使電晶體T導通，電晶體T根據第二端D1所接收第一電壓VGL，於第一端S1輸出第一電壓VGL，並傳送控制訊號至第三開關40而使其導通，第一開關20輸出第一電流I1至發光單元60，第二開關30輸出第二電流I2至第三開關40，第三開關40根據控制訊號和第二電流I2而輸出第三電流I3至發光單元60，發光單元60根據第一電流I1和第三電流I3而發光。舉例來說，第一電流I1流經發光單元60的時間占一個畫面時間之40%，第三電流I3流經發光單元60的時間占一個畫面時間之60%，前述僅為例舉，第一電流I1和第三電流I3流經發光單元60的時間比例能根據所需而調整，而未侷限於本發明所列舉的範圍。
(2)如第3A圖和第3B圖所示，於時間點T2期間，第一開關20接收第一啟動訊號EM1而開啟，第二開關30接收第二啟動訊號EM2而未開啟，電晶體T的控制端G1使電晶體T導通，電晶體T根據第二端D1所接收第二電壓VGH，於第一端S1輸出第二電壓VGH，使第三開關40關閉，發光單元60根據第一電流I1而發光。
總括而言，利用第一電壓VGL和第二電壓VGH控制第三開關40的導通狀況，而使發光單元60接收兩種電流(第一電流I1及第一電流I1和第三電流I3之和)而具有兩種亮度，進而降低畫素電路的複雜度。
請參閱第4圖和第5圖，其為本發明之畫素電路之第一實施例於普通狀態的亮度圖以及本發明之畫素電路之第一實施例於高亮度狀態的亮度圖。如第4圖所示，本發明之畫素電路於普通狀態下，當驅動電路10於第一模式(例如為L168)，發光單元60具有第一亮度(其可例如為140nit)， 流經發光單元60的電流為第一電流I1(如第3A圖所示)；當驅動電路於第二模式(例如為L255)，發光單元60具有第二亮度(其可例如為350nit)，流經發光單元60的電流為第一電流I1和第三電流I3之和(如第2A圖所示)，第二亮度高於第一亮度。
如第5圖所示，本發明之畫素電路於高亮度狀態下，當驅動電路10於第一模式(例如為L168)，發光單元60具有第一亮度(其可例如為400nit)， 流經發光單元60的電流為第一電流I1(如第3A圖所示)；當驅動電路於第二模式(例如為L255)，發光單元60具有第二亮度(其可例如為1000nit)，流經發光單元60的電流為第一電流I1和第三電流I3之和(如第2A圖所示)，第二亮度高於第一亮度。需說明的是，驅動電路10於普通狀態和高亮度狀態時的電流並不相同，舉例來說，驅動電路10於普通狀態下所流經的電流為3A，驅動電路10於高亮度狀態下所流經的電流為5A，驅動電路10於高亮度狀態時所流經的電流高於普通狀態下所流經的電流，驅動電路10於高亮度狀態時和普通狀態時所流經的電流數值能根據實際狀況調整，其不侷限於本發明所列舉的範圍。
請參閱第6A圖至第6H圖，其分別為本發明之畫素電路之第二實施例之第一態樣的示意圖、本發明之畫素電路之第二實施例之第一態樣的波形圖、本發明之畫素電路之第二實施例之第二態樣的示意圖、本發明之畫素電路之第二實施例之第二態樣的波形圖、本發明之畫素電路之第二實施例之第三態樣的示意圖、本發明之畫素電路之第二實施例之第三態樣的波形圖、本發明之畫素電路之第二實施例之第四態樣的示意圖、本發明之畫素電路之第二實施例之第四態樣的波形圖。如第6A圖至第6H圖所示，本發明之第二實施例的驅動電路10由複數個電晶體T1~T6組成，電晶體T1和第一開關20由第一啟動訊號EM1控制，電晶體T2由第二開關30和第二啟動訊號EM2控制。
於此，詳細說明本發明之第二實施例的作動如下：(1)如第6A圖和第6B圖所示，於時間點T11期間，第一開關20和電晶體T1因第一啟動訊號EM1的正緣而關閉，第二開關30和電晶體T2因第二啟動訊號EM2的正緣而關閉，電晶體T5因訊號A1的負緣而開啟，電晶體T41及T3因訊號A2的負緣而開啟，電晶體T的控制端G1使電晶體T不導通(如第1圖所示)，A點的電壓VA 約為電壓VREF ，B點的電壓VB 約為電壓VDATA ，發光單元60未發光。
(2)如第6C圖和第6D圖所示，於時間點T12期間，第一開關20和電晶體T1因第一啟動訊號EM1的正緣而關閉，第二開關30和電晶體T2因第二啟動訊號EM2的正緣而關閉，電晶體T5因訊號A1的正緣而關閉，電晶體T41、T42及T3因訊號A2的負緣而開，電晶體T的控制端G1使電晶體T導通(如第1圖所示)，電晶體T根據第二端D1所接收第一電壓VGL或第二電壓VGH，於第一端S1輸出第一電壓VGL或第二電壓VGH，對電容C1充電，A點的電壓VA 約為電壓VDD 和電晶體T6的臨界電壓VTH6 之差，B點的電壓VB 約為電壓VDATA ，發光單元60未發光。
(3)如第6E圖和第6F圖所示，於時間點T13期間，第一開關20和電晶體T1因第一啟動訊號EM1的負緣而導通，第二開關30和電晶體T2因第二啟動訊號EM2的正緣而關閉，電晶體T5因訊號A1的正緣而關閉，電晶體T41、T42及T3因訊號A2的正緣而關閉，電晶體T的控制端G1使電晶體T不導通(如第1圖所示)，A點的電壓VA 為VDD -
Figure 02_image001
+(VREF -VDATA )，B點的電壓VB 約為電壓VREF ，發光單元60之電流IOLED 為
Figure 02_image003
，k為電晶體T9的製程參數，發光單元60發光。
如第6G圖和第6H圖所示，於時間點T14期間，第一開關20和電晶體T1因第一啟動訊號EM1的正緣而關閉，第二開關30和電晶體T2因第二啟動訊號EM2的負緣而導通，電晶體T5因訊號A1的正緣而關閉，電晶體T41、T42及T3因訊號A2的正緣而關閉，電晶體T的控制端G1使電晶體T不導通(如第1圖所示)，A點的電壓VA 為VDD -
Figure 02_image001
+(VREF -VDATA )，B點的電壓VB 約為電壓VREF ，C點的電壓VC 為第一電壓VGL，發光單元60之電流IOLED 為
Figure 02_image003
，k為電晶體T9的製程參數，發光單元60發光。
請參閱第7圖，其為本發明之畫素電路之第三實施例的配置圖。如第7圖所示，本發明之第三實施例的驅動電路10由兩個電晶體T1~T2和電容C2所組成，電晶體T1連接掃描線Scan和資料線Data，電晶體T2連接電壓VDD ，驅動電路10也可為其他控制結構，驅動電路例如可為電流鏡電路、3T1C的架構、3T2C的架構、4T1C的架構、4T2C的架構、5T1C的架構、5T2C的架構、6T1C的架構、6T2C的架構等，而未侷限於本發明所列舉的範圍。
觀前所述，本發明之畫素電路，透過第一開關20、第二開關30以及第三開關40的操控，使發光單元60具有不同的亮度，降低電路的複雜性。
以上所述僅為舉例性，而非為限制性者。任何未脫離本發明之精神與範疇，而對其進行之等效修改或變更，均應包含於後附之申請專利範圍中。
10:驅動電路 20:第一開關 30:第二開關 40:第三開關 50:控制電路 60:發光單元 C1、C2:電容 CM:電流鏡電路 Data:資料線 Duty1:第一工作週期 Duty2:第二工作週期 EM1:第一啟動訊號 EM2:第二啟動訊號 I1:第一電流 I2:第二電流 I3:第三電流 IOLED :電流 A1、A2:訊號 Scan:掃描線 S1:第一端 D1:第二端 G1:控制端 T、T1、T2、T3、T41、T42、T5、T6、T7:電晶體 T1、T2、T11、T12、T13、T14:時間點 VA 、VB 、VC 、VREF 、VDATA 、VDD :電壓 VTH6 :臨界電壓 VGL:第一電壓 VGH:第二電壓
第1圖為本發明之畫素電路之第一實施例的配置圖。 第2A圖為本發明之畫素電路之第一實施例之第一態樣的示意圖。 第2B圖為本發明之畫素電路之第一實施例之第一態樣的波形圖。 第3A圖為本發明之畫素電路之第一實施例之第二態樣的示意圖。 第3B圖為本發明之畫素電路之第一實施例之第二態樣的波形圖。 第4圖為本發明之畫素電路之第一實施例於普通狀態的亮度圖。 第5圖為本發明之畫素電路之第一實施例於高亮度狀態的亮度圖。 第6A圖為本發明之畫素電路之第二實施例之第一態樣的示意圖。 第6B圖為本發明之畫素電路之第二實施例之第一態樣的波形圖。 第6C圖為本發明之畫素電路之第二實施例之第二態樣的示意圖。 第6D圖為本發明之畫素電路之第二實施例之第二態樣的波形圖。 第6E圖為本發明之畫素電路之第二實施例之第三態樣的示意圖。 第6F圖為本發明之畫素電路之第二實施例之第三態樣的波形圖。 第6G圖為本發明之畫素電路之第二實施例之第四態樣的示意圖。 第6H圖為本發明之畫素電路之第二實施例之第四態樣的波形圖。 第7圖為本發明之畫素電路之第三實施例的配置圖。
10:驅動電路
20:第一開關
30:第二開關
40:第三開關
50:控制電路
60:發光單元
C1:電容
EM1:第一啟動訊號
EM2:第二啟動訊號
T:電晶體
VGL:第一電壓
VGH:第二電壓
VREF 、VSS :電壓

Claims (10)

  1. 一種畫素電路，其包括： 一驅動電路； 一第一開關，連接該驅動電路並由一第一啟動訊號控制，該第一開關根據該第一啟動訊號之一第一工作週期輸出一第一電流； 一第二開關，連接該驅動電路並由一第二啟動訊號控制，該第二開關根據該第二啟動訊號之一第二工作週期輸出一第二電流，該第二工作週期和該第一工作週期相異； 一第三開關，連接該第二開關及接收該第二電流； 一控制電路，連接該第三開關並發出一控制訊號至該第三開關，該第三開關根據該控制訊號和該第二電流而輸出一第三電流；以及 一發光單元，連接該第三開關和該第一開關，該發光單元根據該第一電流或該第三電流而發光。
  2. 如請求項1所述之畫素電路，當該第一開關、該第二開關以及該第三開關導通時，該發光單元受該第一電流和該第三電流的驅動而發光。
  3. 如請求項1所述之畫素電路，當該第一開關、該第二開關導通而該第三開關關閉時，該發光單元受該第一電流的驅動而發光。
  4. 如請求項1所述之畫素電路，該第一啟動訊號和該第二啟動訊號的頻率彼此相異。
  5. 如請求項1所述之畫素電路，該第一啟動訊號和該第二啟動訊號使該第一開關與該第二開關交錯開啟。
  6. 如請求項1所述之畫素電路，其中該第一開關和該第二開關為負緣觸發。
  7. 如請求項1所述之畫素電路，其中該驅動電路包含電流源電路。
  8. 如請求項1所述之畫素電路，其中該控制電路包括一電晶體和一電容，該電晶體的第一端連接該第三開關的控制端，該電容設置於該電晶體和該第三開關之間。
  9. 如請求項8所述之畫素電路，其中該第三開關為負緣觸發。
  10. 如請求項1所述之畫素電路，當該驅動電路於一第一模式，該發光單元具有一第一亮度，當該驅動電路於一第二模式，該發光單元具有一第二亮度，該第二亮度高於該第一亮度。
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