TW201727728A - 基板處理方法及基板處理裝置 - Google Patents
基板處理方法及基板處理裝置 Download PDFInfo
- Publication number
- TW201727728A TW201727728A TW105135643A TW105135643A TW201727728A TW 201727728 A TW201727728 A TW 201727728A TW 105135643 A TW105135643 A TW 105135643A TW 105135643 A TW105135643 A TW 105135643A TW 201727728 A TW201727728 A TW 201727728A
- Authority
- TW
- Taiwan
- Prior art keywords
- gas
- film
- etching
- layer
- chamber
- Prior art date
Links
- 238000000034 method Methods 0.000 title claims abstract description 189
- 239000000758 substrate Substances 0.000 title claims abstract description 86
- 230000008569 process Effects 0.000 claims abstract description 184
- 238000012545 processing Methods 0.000 claims description 97
- 238000005530 etching Methods 0.000 claims description 83
- 238000003672 processing method Methods 0.000 claims description 45
- 238000001179 sorption measurement Methods 0.000 claims description 9
- 238000000859 sublimation Methods 0.000 claims description 4
- 230000008022 sublimation Effects 0.000 claims description 4
- 230000009471 action Effects 0.000 claims description 2
- ZAMOUSCENKQFHK-UHFFFAOYSA-N Chlorine atom Chemical compound [Cl] ZAMOUSCENKQFHK-UHFFFAOYSA-N 0.000 claims 2
- 229910052801 chlorine Inorganic materials 0.000 claims 2
- 239000000460 chlorine Substances 0.000 claims 2
- 229910052736 halogen Inorganic materials 0.000 claims 2
- 150000002367 halogens Chemical class 0.000 claims 2
- 229910052747 lanthanoid Inorganic materials 0.000 claims 2
- 150000002602 lanthanoids Chemical class 0.000 claims 2
- 238000007599 discharging Methods 0.000 claims 1
- 238000006243 chemical reaction Methods 0.000 abstract description 7
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 abstract 6
- 229910052681 coesite Inorganic materials 0.000 abstract 3
- 229910052906 cristobalite Inorganic materials 0.000 abstract 3
- 239000000377 silicon dioxide Substances 0.000 abstract 3
- 235000012239 silicon dioxide Nutrition 0.000 abstract 3
- 229910052682 stishovite Inorganic materials 0.000 abstract 3
- 229910052905 tridymite Inorganic materials 0.000 abstract 3
- 239000007789 gas Substances 0.000 description 292
- 229910004298 SiO 2 Inorganic materials 0.000 description 110
- 235000012431 wafers Nutrition 0.000 description 98
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 description 81
- 229910000040 hydrogen fluoride Inorganic materials 0.000 description 79
- 238000012546 transfer Methods 0.000 description 31
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 25
- 229920005591 polysilicon Polymers 0.000 description 25
- 229910052732 germanium Inorganic materials 0.000 description 19
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 description 19
- 239000007795 chemical reaction product Substances 0.000 description 18
- 238000010438 heat treatment Methods 0.000 description 18
- 230000007246 mechanism Effects 0.000 description 16
- 230000000052 comparative effect Effects 0.000 description 8
- 239000000047 product Substances 0.000 description 7
- QGZKDVFQNNGYKY-UHFFFAOYSA-N Ammonia Chemical compound N QGZKDVFQNNGYKY-UHFFFAOYSA-N 0.000 description 6
- 229910052581 Si3N4 Inorganic materials 0.000 description 6
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 6
- 238000011068 loading method Methods 0.000 description 5
- -1 ammonium fluoroantimonate Chemical compound 0.000 description 3
- 230000001276 controlling effect Effects 0.000 description 3
- 230000006866 deterioration Effects 0.000 description 3
- 239000010931 gold Substances 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 239000002245 particle Substances 0.000 description 3
- 230000005476 size effect Effects 0.000 description 3
- 230000032258 transport Effects 0.000 description 3
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 2
- 229910021529 ammonia Inorganic materials 0.000 description 2
- 238000001816 cooling Methods 0.000 description 2
- 239000013078 crystal Substances 0.000 description 2
- 238000009792 diffusion process Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000011049 filling Methods 0.000 description 2
- 230000006870 function Effects 0.000 description 2
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 2
- 229910052737 gold Inorganic materials 0.000 description 2
- 238000002844 melting Methods 0.000 description 2
- 230000008018 melting Effects 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 229920002120 photoresistant polymer Polymers 0.000 description 2
- 230000009257 reactivity Effects 0.000 description 2
- 230000001105 regulatory effect Effects 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 2
- 239000000126 substance Substances 0.000 description 2
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 1
- KJTLSVCANCCWHF-UHFFFAOYSA-N Ruthenium Chemical compound [Ru] KJTLSVCANCCWHF-UHFFFAOYSA-N 0.000 description 1
- 230000003044 adaptive effect Effects 0.000 description 1
- 229910052786 argon Inorganic materials 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 229910052797 bismuth Inorganic materials 0.000 description 1
- JCXGWMGPZLAOME-UHFFFAOYSA-N bismuth atom Chemical compound [Bi] JCXGWMGPZLAOME-UHFFFAOYSA-N 0.000 description 1
- 239000006227 byproduct Substances 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 238000003486 chemical etching Methods 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000001312 dry etching Methods 0.000 description 1
- 238000001459 lithography Methods 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 238000002156 mixing Methods 0.000 description 1
- 229910000069 nitrogen hydride Inorganic materials 0.000 description 1
- LXPCOISGJFXEJE-UHFFFAOYSA-N oxifentorex Chemical compound C=1C=CC=CC=1C[N+](C)([O-])C(C)CC1=CC=CC=C1 LXPCOISGJFXEJE-UHFFFAOYSA-N 0.000 description 1
- 230000000704 physical effect Effects 0.000 description 1
- 238000001020 plasma etching Methods 0.000 description 1
- 229910052707 ruthenium Inorganic materials 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 238000005092 sublimation method Methods 0.000 description 1
- 238000012360 testing method Methods 0.000 description 1
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
- H01L21/306—Chemical or electrical treatment, e.g. electrolytic etching
- H01L21/3065—Plasma etching; Reactive-ion etching
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02041—Cleaning
- H01L21/02043—Cleaning before device manufacture, i.e. Begin-Of-Line process
- H01L21/02046—Dry cleaning only
- H01L21/02049—Dry cleaning only with gaseous HF
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/027—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
- H01L21/033—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers
- H01L21/0334—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers characterised by their size, orientation, disposition, behaviour, shape, in horizontal or vertical plane
- H01L21/0337—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising inorganic layers characterised by their size, orientation, disposition, behaviour, shape, in horizontal or vertical plane characterised by the process involved to create the mask, e.g. lift-off masks, sidewalls, or to modify the mask, e.g. pre-treatment, post-treatment
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
- H01L21/311—Etching the insulating layers by chemical or physical means
- H01L21/31105—Etching inorganic layers
- H01L21/31111—Etching inorganic layers by chemical means
- H01L21/31116—Etching inorganic layers by chemical means by dry-etching
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/321—After treatment
- H01L21/3213—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
- H01L21/32133—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only
- H01L21/32135—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/321—After treatment
- H01L21/3213—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
- H01L21/32133—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only
- H01L21/32135—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only
- H01L21/32136—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only using plasmas
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/324—Thermal treatment for modifying the properties of semiconductor bodies, e.g. annealing, sintering
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67011—Apparatus for manufacture or treatment
- H01L21/67017—Apparatus for fluid treatment
- H01L21/67063—Apparatus for fluid treatment for etching
- H01L21/67069—Apparatus for fluid treatment for etching for drying etching
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67011—Apparatus for manufacture or treatment
- H01L21/67155—Apparatus for manufacturing or treating in a plurality of work-stations
- H01L21/67207—Apparatus for manufacturing or treating in a plurality of work-stations comprising a chamber adapted to a particular process
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67242—Apparatus for monitoring, sorting or marking
- H01L21/67248—Temperature monitoring
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/683—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping
- H01L21/687—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping using mechanical means, e.g. chucks, clamps or pinches
- H01L21/68707—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping using mechanical means, e.g. chucks, clamps or pinches the wafers being placed on a robot blade, or gripped by a gripper for conveyance
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Chemical & Material Sciences (AREA)
- General Chemical & Material Sciences (AREA)
- Chemical Kinetics & Catalysis (AREA)
- Inorganic Chemistry (AREA)
- Plasma & Fusion (AREA)
- Robotics (AREA)
- Drying Of Semiconductors (AREA)
Abstract
本發明之課題為提供一種可得到平坦被處理膜之基板處理方法。使得HF氣體分子吸附至在被施行過氧化膜去除處理的晶圓W之溝槽角落部所殘存之角落部SiO2層49,排出剩餘的HF氣體,朝吸附有HF氣體分子之角落部SiO2層49供給NH3氣體,使得角落部SiO2層49、HF氣體以及NH3氣體起反應來生成AFS48,使得AFS48升華而被去除。
Description
本發明係關於一種使用半導體晶圓之基板處理方法及基板處理裝置。
使用半導體晶圓(以下簡稱「晶圓」)之電子元件之製造方法中,例如實行有:於晶圓表面形成導電膜、絕緣膜之成膜製程;於所成膜之導電膜、絕緣膜上形成既定圖案之光阻層之微影製程;將光阻層當作遮罩使用,藉由從處理氣體所生成之電漿來將導電膜成形為閘極電極、或是於絕緣膜成形出配線溝槽、接觸孔之蝕刻製程等。
例如,於某電子元件之製造方法中,在晶圓W表面所形成之多晶矽膜80處以既定圖案來形成溝槽之後,再形成填埋此溝槽之氧化膜亦即SiO2層81(圖7(A)),其次,將所形成之SiO2層81以成為既定厚度的方式利用蝕刻等來部分性去除。
此時,做為SiO2層81之去除方法,已知有對晶圓W施以COR(Chemical Oxide Removal)處理以及PHT(Post Heat Treatment)處理之基板處理方法。COR處理係使得SiO2層81與氣體分子起化學反應來生成反應生成物之處理。PHT處理係將施行過COR處理之晶圓W予以加熱,使得COR處理中所生成之反應生成物升華而從晶圓W被去除之處理。
做為實行由COR處理以及PHT處理所構成之基板處理方法的基板處理裝置,已知有具備化學反應處理室(COR處理室)以及連接於化學反應處理室之熱處理室(PHT處理室)的基板處理裝置(例如參見專利文獻1)。此外,已知有在相同處理室內對晶圓W以低溫進行了COR處理後再加熱晶圓W而升溫至既定溫度來進行PHT處理之基板處理裝置(例如參見專利文獻2)。不論是
何種基板處理裝置,於COR處理中係使用氟化氫(HF)氣體與氨(NH3)氣體,從SiO2層81來生成反應生成物。
先前技術文獻
專利文獻1 日本特開2008-160000號公報
專利文獻2 日本特開2007-266455號公報
但是,於COR處理所使用之HF氣體為反應性高的氣體,若和NH3氣體、SiO2層81接觸會立即起化學反應而生成反應生成物。亦即,由於HF氣體在到達氣體不易擴散之場所(例如溝槽之角落部)之前會和NH3氣體、SiO2層81起化學反應,故溝槽角落部的SiO2層(以下稱為「角落部SiO2層」)82不會變質為反應生成物,於後續之PHT處理中無法升華。亦即,即便實行由COR處理以及PHT處理所構成之基板處理方法,但會殘存角落部SiO2層82(圖7(B)),難以得到平坦的SiO2層81。
是以,雖可考慮長時間實行COR處理直到HF氣體擴散至溝槽之角落部,迫使角落部SiO2層82變質為反應生成物,但於此情況,角落部SiO2層82以外之SiO2層81會所需以上地變質為反應生成物,終究難以得到平坦的SiO2層81(圖7(C))。
本發明之目的在於提供一種可得到平坦被處理膜之基板處理方法以及基板處理裝置。
為了達成上述目的,本發明之基板處理方法,係將在基板之表面所形成之被處理膜至少部分性去除;具備下述製程:第1蝕刻製程,係對該被處理膜施以第1蝕刻;以及第2蝕刻製程,係對已施行過該第1蝕刻之被處理膜施以第2蝕刻;其中該第2蝕刻製程具有下述製程:吸附製程,係使得第1處理氣體之分子吸附於已施行過該第1蝕刻之被處理膜;生成製程,係朝吸附有該第1處理氣體之分子的被處理膜供給第2處理氣體,使得該被處理膜、該第1處理氣體以及該第2處理氣體起反應來生成出生成物;以及去除製程,係使得所生成之該生成物升華以去除。
為了達成上述目的,本發明之基板處理裝置,具備:載置台,係載置
表面形成有被處理膜之基板;處理室,係收容該載置台;處理氣體供給部,係對於該處理室之內部供給第1處理氣體以及第2處理氣體;以及控制部,係控制該處理氣體供給部之動作;其中該控制部係實行:第1蝕刻製程,當該基板載置於該載置台之際,對該被處理膜施以第1蝕刻;以及第2蝕刻製程,係對已施行過該第1蝕刻之被處理膜施以第2蝕刻;該控制部於該第2蝕刻製程中係藉由控制該處理氣體供給部之動作來使得第1處理氣體之分子吸附至已施行過該第1蝕刻之被處理膜,進而,朝吸附有該第1處理氣體之分子的被處理膜供給第2處理氣體,使得該被處理膜、該第1處理氣體以及該第2處理氣體起反應來生成出生成物。
依據本發明,使得第1處理氣體之分子吸附至被施以第1蝕刻之被處理膜,並朝吸附有第1處理氣體之分子的被處理膜供給第2處理氣體,第1處理氣體以及第2處理氣體起反應來生成出生成物,所生成之生成物經升華而去除。施行過第1蝕刻後而殘存之被處理膜之非平坦部分因著第1蝕刻成為鬆散構造故表面積增加,吸附多量的第1處理氣體之分子。從而,若被供給第2處理氣體,則被處理膜之非平坦部分相較於被處理膜之其他部分會積極地和第2處理氣體起反應,被處理膜之非平坦部分絕大多數變質為生成物。其結果,藉由使得生成物升華可將絕大多數的非平坦部分去除,從而,可得到平坦的被處理膜。
W‧‧‧晶圓
1‧‧‧基板處理系統
5‧‧‧蝕刻裝置
17‧‧‧載置台
16‧‧‧腔室
42‧‧‧溫度調節器
43‧‧‧程序控制器
47‧‧‧SiO2層
48‧‧‧AFS
49‧‧‧角落部SiO2層
53‧‧‧多晶矽膜
54‧‧‧角落部多晶矽膜
55‧‧‧SiN層
56‧‧‧角落部SiN層
圖1係示意顯示具備本發明之實施形態相關之基板處理裝置的基板處理系統之構成俯視圖。
圖2係示意顯示圖1中蝕刻裝置之構成截面圖。
圖3係用以說明本實施形態相關之基板處理方法之製程圖。
圖4係用以說明HF氣體之分子吸附於角落部SiO2層之微少凹部、微少空隙之表面的模樣之放大部分截面圖。
圖5係用以說明本實施形態相關之基板處理方法之變形例之製程圖。
圖6係本發明之比較例以及實施例1至3之晶圓表面之SEM照片,圖6(A)顯示比較例,圖6(B)顯示實施例1,圖6(C)顯示實施例2,圖6(D)顯示實施例3。
圖7係用以說明以往之氧化膜去除處理之製程圖。
以下,針對本發明之實施形態,參見圖式來詳細說明。
圖1係示意顯示具備本發明之實施形態相關之基板處理裝置的基板處理系統之構成俯視圖。
圖1中,基板處理系統1具備有:搬出入部2,係對做為基板之晶圓W進行搬出入;2個加載互鎖室(L/L)3,係鄰接於搬出入部2而設者;熱處理裝置4,係分別鄰接於各加載互鎖室3而設,對晶圓W施以熱處理;蝕刻裝置5,係分別鄰接於各熱處理裝置4而設,對晶圓W施以做為蝕刻處理一例之氧化膜去除處理(後述之COR處理與PHT處理)(第1蝕刻製程);以及控制部6。
搬出入部2具有搬送室(L/M)8,內部設有搬送晶圓W之第1晶圓搬送機構7。第1晶圓搬送機構7具有將晶圓W加以大致水平保持之2個搬送臂7a,7b。於搬送室8之長邊方向側部設有載置台9,載置台9中,可將複數片晶圓W並排收容之載具C例如能以3個左右來載置、連接。此外,鄰接於搬送室8設置有使得晶圓W做旋轉以光學方式求出偏心量而進行對位之定向器10。
於搬出入部2,晶圓W係藉由搬送臂7a,7b所保持,利用第1晶圓搬送機構7之驅動而在大致水平面內進行直進移動、升降以搬送至所希望之位置。此外,藉由搬送臂7a,7b之進退,可使得晶圓W分別相對於載置台9上之載具C、定向器10、加載互鎖室3來進行搬出入。
各加載互鎖室3係於和搬送室8之間分別介設有閘閥11之狀態下分別連結於搬送室8。於各加載互鎖室3內設有搬送晶圓W之第2晶圓搬送機構12。此外,加載互鎖室3係以可抽真空至既定真空度的方式所構成。
第2晶圓搬送機構12具有多關節臂(未圖示),再者,具有設置於多關節臂前端將晶圓W大致水平保持之夾取器12a。第2晶圓搬送機構12係以多關節臂縮短之狀態讓夾取器12a位於加載互鎖室3內,而藉由伸長多關節臂讓夾取器12a到達熱處理裝置4,進而伸長而可到達蝕刻裝置5。亦即,第2晶圓搬送機構12可在加載互鎖室3、熱處理裝置4以及蝕刻裝置5之間搬送晶圓
W。
熱處理裝置4具有可抽真空之腔室13。於腔室13之內部設有載置晶圓W之未圖示的載置台,載置台內埋設有未圖示之加熱器。熱處理裝置4,於蝕刻裝置5施行過氧化膜去除處理後的晶圓W係載置於載置台,藉由加熱器來加熱晶圓W而施行熱處理以使得殘存於晶圓W之殘渣氣化。於腔室13之加載互鎖室3側,在其與加載互鎖室3之間設有搬送晶圓W之搬出入口(未圖示),此搬出入口可藉由閘閥14進行開閉。此外,於腔室13之蝕刻裝置5側,在其與蝕刻裝置5之間設有搬送晶圓W之搬出入口(未圖示),此搬出入口可藉由閘閥15進行開閉。
於腔室13之側壁上部連接著未圖示之氣體供給流路,此氣體供給流路連接於未圖示之氣體供給單元。此外,於腔室13之底壁連接著未圖示之排氣流路,此排氣流路連接於未圖示之真空泵。此外,從氣體供給單元至腔室13之氣體供給流路設有流量調節閥,另一方面,於排氣流路設有壓力調整閥,藉由調整此等閥可將腔室13內保持在既定壓力來進行熱處理。
圖2係示意顯示圖1中蝕刻裝置5之構成截面圖。
圖2中,蝕刻裝置5具有做為處理室容器之腔室16、配置於腔室16內而載置晶圓W之載置台17、以及於腔室16上方和載置台17呈對向配置之淋灑頭18。此外,蝕刻裝置5在做為將腔室16內之氣體等加以排氣之排氣單元方面具有:TMP(Turbo Molecular Pump)19;以及做為可變式閥之APC(Adaptive Pressure Control)閥21,係配置於TMP19以及連接於腔室16之排氣導管20之間,用以控制腔室16內之壓力。
淋灑頭18具有由分別為板狀之下層部22以及上層部23所構成之2層構造,下層部22以及上層部23分別具有第1緩衝室24以及第2緩衝室25。第1緩衝室24以及第2緩衝室25分別經由氣體通氣孔26、27而連通於腔室16內。亦即,淋灑頭18係由具有被分別供給於第1緩衝室24以及第2緩衝室25之氣體朝腔室16內之內部通路、以階層狀方式堆疊的2個板狀體(下層部22、上層部23)所構成。
腔室16係和具有氨(NH3)氣體供給系統28(處理氣體供給部)與氟化氫(HF)氣體供給系統29(處理氣體供給部)的氣體供給單元相連接。淋灑頭18之
下層部22係連接於NH3氣體供給系統28。NH3氣體供給系統28具有:和下層部22之第1緩衝室24相連通之NH3氣體供給管30、配置於NH3氣體供給管30之NH3氣體閥31、以及連接於NH3氣體供給管30之NH3氣體供給部32。NH3氣體供給部32係經由NH3氣體供給管30而對第1緩衝室24供給NH3氣體,進而調節所供給之NH3氣體之流量。NH3氣體閥31係自由地進行NH3氣體供給管30之遮斷、連通。
NH3氣體供給系統28具有:氮(N2)氣體供給部33、和N2氣體供給部33連接之N2氣體供給管34、以及配置於N2氣體供給管34之N2氣體閥35。此外,N2氣體供給管34於第1緩衝室24以及NH3氣體閥31之間係連接於NH3氣體供給管30。N2氣體供給部33經由N2氣體供給管34以及NH3氣體供給管30而對第1緩衝室24供給N2氣體。此外,N2氣體供給部33係對於所供給之N2氣體流量進行調節。N2氣體閥35係自由進行N2氣體供給管34之遮斷、連通。NH3氣體供給系統28中,可藉由切換NH3氣體閥31以及N2氣體閥35之開閉來選擇性切換對於第1緩衝室24乃至於腔室16內所供給之氣體種類。
淋灑頭18之上層部23係連接於HF氣體供給系統29。HF氣體供給系統29具備有:和上層部23之第2緩衝室25相連通之HF氣體供給管36、配置於HF氣體供給管36之HF氣體閥37、以及連接於HF氣體供給管36之HF氣體供給部38。HF氣體供給部38係經由HF氣體供給管36對第2緩衝室25供給HF氣體,進而對於所供給之HF氣體之流量進行調節。HF氣體閥37係自由進行HF氣體供給管36之遮斷、連通。淋灑頭18之上層部23內設有未圖示之加熱器,可藉由此加熱器來加熱第2緩衝室25內之HF氣體。
HF氣體供給系統29具有:氬(Ar)氣體供給部39、和Ar氣體供給部39連接之Ar氣體供給管40、以及配置於Ar氣體供給管40之Ar氣體閥41。Ar氣體供給管40於第2緩衝室25以及HF氣體閥37之間係連接於HF氣體供給管36。Ar氣體供給部39係經由Ar氣體供給管40以及HF氣體供給管36對第2緩衝室25供給Ar氣體。此外,Ar氣體供給部39係對於所供給之Ar氣體流量進行調節。Ar氣體閥41係自由進行Ar氣體供給管40之遮斷、連通。
蝕刻裝置5係使得NH3氣體供給系統28之NH3氣體供給部32與HF氣體供給系統29之HF氣體供給部38偕同動作,來對於從淋灑頭18供給至腔室16內
之NH3氣體與HF氣體之體積流量比進行調整。此外,蝕刻裝置5係以於腔室16內首次混合NH3氣體以及HF氣體的方式來設計(後置混合設計)。藉此,可防止NH3氣體與HF氣體在被導入腔室16內之前出現混合而反應。再者,蝕刻裝置5係於腔室16之側壁內設未圖示之加熱器,藉此,可防止腔室16內之氛圍溫度的降低,進而可提高氧化膜去除處理之再現性。此外,藉由控制側壁溫度,可抑制氧化膜去除處理之際於腔室16內所升華之反應生成物或氣化之副生成物再次附著於側壁之內側。
載置台17俯視上呈現大致圓形而固定於腔室16之底部。於載置台17之內部設有調節該載置台17溫度的溫度調節器42(溫度調節部)。溫度調節器42例如具備讓水等溫度調節用介質進行循環之管路,藉由和流經該管路內之溫度調節用介質進行熱交換來調節載置台17之溫度,進行載置台17上之晶圓W的溫度控制。此外,載置台17為了在其和第2晶圓搬送機構12之間進行晶圓W之傳輸,而具有讓晶圓W於載置台17之上面做升降之未圖示的升降銷。此外,關於在蝕刻裝置5所實行之氧化膜去除處理之詳細將於後述。
回到圖1之說明,控制部6具有程序控制器43,程序控制器43具備控制基板處理系統1之各構成要素的微處理器(電腦)。程序控制器43連接著使用者介面44,具有操作者為了管理基板處理系統1而進行指令之輸入操作等的鍵盤(未圖示)、以及將基板處理系統1之運轉狀況加以視覺化顯示之顯示器等。此外,程序控制器43連接著記憶部45,存放有做為以程序控制器43之控制來實現在基板處理系統1所實行之各種處理(例如在蝕刻裝置5所進行之氧化膜去除處理)所使用之處理氣體的供給或腔室16內排氣等的控制程式、用以因應於處理條件而對基板處理系統1之各構成要素實行既定處理之控制程式的處理配方以及各種資料庫等。此外,處理配方等係記憶於記憶部45之中的記憶媒體(未圖示)。此外,依必要性從記憶部45呼叫出任意的處理配方而於程序控制器43做實行,可在程序控制器43之控制下在基板處理系統1進行所希望之處理。
本實施形態中,例如首先將具有成為蝕刻裝置5處之氧化膜去除處理對象的SiO2層(被處理膜)的晶圓W收納於載具C內,搬送至基板處理系統1。之後,基板處理系統1係在大氣側之閘閥11開啟的狀態下從搬出入部2之載具C
藉由第1晶圓搬送機構7之搬送臂7a,7b其中一者將1片的晶圓W搬送至加載互鎖室3,而傳輸至加載互鎖室3內之第2晶圓搬送機構12之夾取器12a。之後,關閉大氣側之閘閥11對加載互鎖室3內進行真空排氣,其次,開啟閘閥15使得夾取器12a移動至蝕刻裝置5來將晶圓W搬送至蝕刻裝置5。
之後,使得夾取器12a返回加載互鎖室3,關閉閘閥15,於蝕刻裝置5進行後述之氧化膜去除處理。於氧化膜去除處理結束後,開啟閘閥14、15,藉由第2晶圓搬送機構12之夾取器12a將氧化膜去除處理後之晶圓W搬送至熱處理裝置4,載置於熱處理裝置4所設之載置台上。其次,一邊對腔室13內導入N2氣體等、一邊藉由加熱器來加熱載置台上之晶圓W,將晶圓W之殘渣等予以加熱去除。
其次,熱處理裝置4之熱處理結束後,開啟閘閥14,藉由第2晶圓搬送機構12之夾取器12a使得熱處理裝置4之載置台上的晶圓W退避到加載互鎖室3,藉由第1晶圓搬送機構7之搬送臂7a,7b其中之一來返回載具C。藉此,完成一片晶圓的處理。
此外,於基板處理系統1,熱處理裝置4非必要。當不設置熱處理裝置4之情況,只要將結束了氧化膜去除處理之晶圓W利用第2晶圓搬送機構12之夾取器12a來退避至加載互鎖室3,利用第1晶圓搬送機構7之搬送臂7a,7b其中一者來返回載具C即可。
其次,針對在蝕刻裝置5所實行之氧化膜去除處理來詳細說明。
氧化膜去除處理中,首先,一旦具有SiO2層(被處理膜)之晶圓W搬送至蝕刻裝置5而載置於載置台17,則從N2氣體供給部33以及Ar氣體供給部39對腔室16內供給N2氣體以及Ar氣體。此外,藉由TMP19之運作使得腔室16內之壓力被維持在減壓至較大氣壓來得低之既定真空度的狀態下。再者,藉由溫度調節器42使得晶圓W之溫度被保持在70℃~120℃之範圍的一定溫度下(例如120℃)。此外,晶圓W在氧化膜去除處理結束為止,於載置台17上被保持在一定溫度。
其次,實行使得SiO2層之一部分和NH3氣體以及HF氣體起反應來變化為反應生成物(其他生成物)之反應製程(以下稱為「COR製程」)。COR製程中,首先,從NH3氣體供給部32對腔室16內供給NH3氣體。此時,腔室16內
也被供給Ar氣體,但停止N2氣體之供給。此外,相反地也可供給N2氣體而停止Ar氣體之供給、或是持續供給N2氣體與Ar氣體。
之後,對腔室16內持續供給NH3氣體,並開始從HF氣體供給部38對腔室16內供給HF氣體。此時,由於腔室16內被預先供給NH3氣體,故藉由供給HF氣體,腔室16內之氛圍會成為含HF氣體與NH3氣體之混合氣體。此外,藉由使得SiO2層暴露於混合氣體中,則會依照以下之反應式來變質成為氟矽酸銨((NH4)2SiF6:Ammonium hexa-fluorosilicate)等反應生成物,生成反應生成物。
SiO2+4HF→SiF4+2H2O↑
SiF4+2NH3+2HF→(NH4)2SiF6
其次,實行用以使得在COR製程中所生成之反應生成物(主要為氟矽酸銨)產生升華而從晶圓W加以去除之升華製程(以下稱為「PHT製程」)(其他去除製程)。PHT製程中,係停止對腔室16內供給HF氣體與NH3氣體,並供給Ar氣體或是N2氣體。此時,雖晶圓W之溫度保持在和COR製程為相同溫度,但COR製程所生成之反應生成物會因熱而升華,藉由TMP19之運作從腔室16內被排出。
亦即,氧化膜去除處理中,透過COR製程以及PHT製程而從SiO2層生成反應生成物,進而使得所生成之反應生成物升華來去除SiO2層。此外,SiO2層之去除量主要係藉由COR製程中的NH3氣體、HF氣體之供給量來控制。
另一方面,於COR製程中開始對腔室16內供給HF氣體之際,HF氣體之反應性高,若和NH3氣體、SiO2層做接觸會立即起化學反應而生成反應生成物。亦即,由於HF氣體在到達氣體不易擴散之場所(例如於晶圓W表面所形成之溝槽的角落部)之前會和NH3氣體、SiO2層起化學反應,故溝槽之角落部的SiO2層不會變質為反應生成物,於後續PHT製程中無法被升華。亦即,即便以蝕刻裝置5來實行氧化膜去除處理,晶圓W於溝槽之角落部會殘存SiO2層。本實施形態中,對應於此以蝕刻裝置5來實行氧化膜去除處理之後,係實行殘存於溝槽角落部處的SiO2層之去除處理。
圖3係用以說明本實施形態相關之基板處理方法之製程圖。圖3之基板處理方法係藉由程序控制器43實行從記憶部45呼叫出的處理配方來實現。
此外,被施以圖3之基板處理方法的晶圓W具有如下構造:於由矽(Si)所構成之基部的表面所形成之多晶矽膜46處以既定圖案來形成溝槽,以填埋此溝槽的方式形成有SiO2層47。圖3之基板處理方法係去除SiO2層47之一部分。
圖3之基板處理方法,最初係實行氧化膜去除處理。例如,一旦晶圓W被搬送至蝕刻裝置5而載置於載置台17,首先係實行COR製程。亦即,將晶圓W之溫度保持在70℃~120℃之範圍的一定溫度(例如120℃),將腔室16內之壓力減壓至低於大氣壓的既定真空度,進而對腔室16內供給Ar氣體以及NH3氣體後,供給HF氣體(圖3(A))。此時,如上述般,SiO2層47之一部分會和NH3氣體、HF氣體起反應而變質為主要的反應生成物亦即氟矽酸銨(以下稱為「AFS」)48(圖3(B))。另一方面,溝槽角落部的SiO2層(以下稱為「角落部SiO2層」)49基於上述理由不會變質為AFS48。此外,SiO2層47之變質量係以NH3氣體、HF氣體之供給量來控制。
其次實行PHT製程。亦即,將晶圓W之溫度保持在和COR製程為相同溫度,停止對腔室16內供給HF氣體與NH3氣體。藉此,停止SiO2層47變質為AFS48,所生成之AFS48藉熱而升華,從腔室16內被排出。其結果,SiO2層47之一部分因著氧化膜去除處理而被去除,殘存於溝槽中央部的SiO2層47被平坦化。另一方面,未變質為AFS48之角落部SiO2層49並未升華而殘存。
其次,實行角落部SiO2層49之去除處理(以下稱為「角落部去除處理」)(第2蝕刻製程)。角落部SiO2層49之去除處理係採用ALE(Atomic Layer Etching)製程而於被處理膜表面吸附約一層的處理氣體之分子而將該被處理膜以化學反應來去除。具體而言,將晶圓W之溫度保持在和氧化膜去除處理為相同溫度下,使得在COR製程中變質後的AFS48在PHT製程中完全升華後,首先,從N2氣體供給部33以及Ar氣體供給部39對腔室16內供給N2氣體以及Ar氣體,進而,限於既定期間,從HF氣體供給部38對腔室16內供給HF氣體(第1處理氣體)(圖3(C))。此時,由於腔室16內不存在NH3氣體,故HF氣體不會和氧化膜去除處理後殘存於溝槽中央部的SiO2層47或角落部SiO2層49起反應而是直接到達殘存於溝槽中央部的SiO2層47或角落部SiO2層49之表面,於角落部SiO2層49等之表面吸附HF氣體之分子(吸附製程)(圖3(D))。
其次,對腔室16內持續供給N2氣體以及Ar氣體,停止HF氣體之供給,進而,積極地使得TMP19運轉以將未吸附於角落部SiO2層49等表面處之剩餘的HF氣體從腔室16內排出(排出製程)。
另一方面,於COR製程,並非HF氣體完全不會到達角落部SiO2層49,而有微量的HF氣體會到達該處。從而,角落部SiO2層49之極少部分會變質為微量的AFS48,於後續PHT製程中,角落部SiO2層49所含微量的AFS48會升華。其結果,角落部SiO2層49之構造會較氧化膜去除處理後殘存於溝槽中央部處的SiO2層47之構造來得鬆散,於角落部SiO2層49之表面存在多數的微少凹部,再者,於內部存在多數的微少空隙。此外,當HF氣體分子吸附於角落部SiO2層49之際,如圖4所示般,會於角落部SiO2層49之微少凹部或微少空隙的表面吸附HF氣體分子。藉此,吸附於角落部SiO2層49之各表面處的HF氣體分子之數量會遠遠地多過殘存於溝槽中央部之SiO2層47之表面所吸附之HF氣體分子之數量。亦即,將剩餘的HF氣體從腔室16內排出後,於角落部SiO2層49之各表面所吸附之HF氣體分子的數量會遠遠地超過殘存於溝槽中央部之SiO2層47之表面所吸附的HF氣體分子之數量。此外,如上述般,由於剩餘的HF氣體從腔室16內被排出,可防止HF氣體分子過度地吸附於角落部SiO2層49之各表面,結果角落部SiO2層49之各表面會被約一層的HF氣體分子所覆蓋。
其次,持續對腔室16內供給N2氣體以及Ar氣體,限於既定期間,從NH3氣體供給部32對腔室16內供給NH3氣體(第2處理氣體)。朝腔室16內之NH3氣體會到達殘存於溝槽中央部處的SiO2層47、角落部SiO2層49之表面,但如上述般,由於角落部SiO2層49之各表面所吸附之HF氣體分子之數量遠遠超過殘存於溝槽中央部處的SiO2層47之表面所吸附之HF氣體分子之數量,故角落部SiO2層49會較殘存於溝槽中央部處的SiO2層47更積極地和HF氣體或NH3氣體起反應,角落部SiO2層49絕大多數變質為AFS48而生成AFS48(生成製程)(圖3(E))。另一方面,由於殘存於溝槽中央部處的SiO2層47之表面所吸附之HF氣體分子之數量少,故殘存於溝槽中央部處的SiO2層47幾乎不會變質為AFS48。
其次,持續對腔室16內供給N2氣體以及Ar氣體,停止HF氣體之供給而
停止變質為AFS48。此時,已變質之AFS48會因著來自載置台17之溫度調節器42的熱而升華,從腔室16內被排出,但殘存於溝槽中央部之SiO2層47幾乎不會變質為AFS48,相對地角落部SiO2層49絕大多數變質為AFS48,故結果上角落部SiO2層49被選擇性地去除(去除製程)(圖3(F))。之後,結束本方法。
依據圖3之基板處理方法,使得HF氣體分子吸附至在經過氧化膜去除處理之晶圓W處所殘存之角落部SiO2層49,並朝吸附有HF氣體分子之角落部SiO2層49供給NH3氣體,角落部SiO2層49、HF氣體以及NH3氣體起反應而生成AFS48,將AFS48升華去除。被施以氧化膜去除處理後殘存於晶圓W之角落部SiO2層49由於藉由氧化膜去除處理而成為構造鬆散者故表面積增加,可吸附多量的HF氣體分子。從而,一旦供給NH3氣體,則角落部SiO2層49會較殘存於溝槽中央部的SiO2層47更積極地和NH3氣體起反應,角落部SiO2層49絕大多數變質為AFS48。其結果,藉由使得AFS48升華,可選擇性去除角落部SiO2層49,從而可於溝槽得到平坦的SiO2層47。
此外,通常,為了對於以填埋既定圖案之溝槽的方式所形成之SiO2層47施以氧化膜去除處理來得到平坦的SiO2層47,也可考慮儘量縮短實行1次COR製程的期間來減少HF氣體之擴散程度的差而減少HF氣體難以到達之區域。但是,於此情況,為了去除一定量的SiO2層47,必須反覆多次進行儘量縮短期間之COR製程,而有生產量降低之問題。對此,圖3之基板處理方法,由於以一次的氧化膜去除處理來大量去除SiO2層47,能以一次的角落部去除處理來去除殘存之角落部SiO2層49,而可大幅提高生產量。
再者,圖3之基板處理方法,朝角落部SiO2層49來吸附HF氣體分子之後、且朝角落部SiO2層49供給NH3氣體之前,將剩餘的HF氣體從腔室16內排出。藉此,可防止HF氣體分子過度地吸附至於溝槽中央部所殘存之SiO2層47,從而,可防止殘存於溝槽中央部之SiO2層47以所需以上程度變質為AFS48被去除,而造成角落部SiO2層49之形狀崩壞。此外,也可防止HF氣體分子過度地吸附至角落部SiO2層49之各表面,角落部SiO2層49之各表面被約一層的HF氣體分子所覆蓋。藉此,若微觀觀察角落部SiO2層49之各表面,則會於角落部SiO2層49之各表面產生微量的AFS48。其結果,藉由所謂的尺寸效應,AFS48之升華所需時間可極度縮短,可更為提高生產量。此外,此
處所稱尺寸效應,為若物質的大小逐漸變小,則當變成比某特定大小來得小會造成物質性質(物性)改變之效應,例如,已知雖然通常金(Au)的熔點為1064℃,但直徑2.4nm之粒子的金的熔點會降低接近100℃之效應。尺寸效應之主要原因乃因構成物質之粒子的大小若變小則1個粒子中原子、分子的表面積之比率變大,受到外在作用等影響之部分變大之故。
此外,圖3之基板處理方法,在角落部去除處理所使用之氣體的種類和在氧化膜去除處理所使用之氣體的種類相同。從而,蝕刻裝置5可實行任一處理,藉此可進而提高生產量。此外,當氧化膜去除處理以及角落部去除處理係以相同蝕刻裝置5來實行之情況,由於無需增加蝕刻裝置5之氣體供給系統的種類,可防止蝕刻裝置5之構成變得複雜。
上述圖3之基板處理方法中的角落部去除處理,雖吸附製程、排出製程、生成製程以及去除製程均對腔室16內供給N2氣體以及Ar氣體,但任一製程也可對腔室16內僅供給N2氣體以及Ar氣體當中之一者。
此外,上述圖3之基板處理方法中的角落部去除處理,係於吸附製程中對腔室16內供給HF氣體,之後,於排出製程中將剩餘的HF氣體自腔室16內排出,再者,於生成製程中對腔室16內供給NH3氣體,但氣體之供給順序不限於此。例如,也可首先於吸附製程中對腔室16內供給NH3氣體而吸附至角落部SiO2層49等之表面,之後,於排出製程中將剩餘的NH3氣體從腔室16內排出,再者,於生成製程中對腔室16內供給HF氣體而將角落部SiO2層49變質為AFS48。
圖5係用以說明本實施形態相關之基板處理方法之變形例的製程圖。圖5之基板處理方法也是藉由程序控制器43實行從記憶部45呼叫出的處理配方而實現。此外,被施以圖5之基板處理方法的晶圓W所具構造為:在由Si所構成之基部50之表面形成一對的氮化矽(SiN)之壁部51,在由一對的壁部51所構成之溝槽的底部形成閘極氧化膜52,再者閘極氧化膜52之上方以多晶矽膜53來覆蓋溝槽內部。圖5之基板處理方法係將多晶矽膜53全數去除。此外,圖5之基板處理方法也由蝕刻裝置5所實行,但使用的氣體種類不同於圖3之基板處理方法。
圖5之基板處理方法,最初係實行多晶矽膜去除處理(第1蝕刻製程)。例
如,若晶圓W朝蝕刻裝置5被搬送而載置於載置台17,首先係實行COR製程。具體而言,將晶圓W之溫度保持在70℃~120℃之範圍的一定溫度,將腔室16內的壓力減壓至既大氣壓來得低的既定真空度,再者,對腔室16內供給Ar氣體以及NH3氣體之後,供給F2氣體(圖5(A))。此時,多晶矽膜53會和NH3氣體、F2氣體起反應而變質為AFS48(圖5(B)),但由於F2氣體和HF氣體同樣地具高反應性,在到達氣體難以擴散之場所、例如由壁部51所構成之溝槽的角落部之前會和NH3氣體、多晶矽膜53起化學反應,故溝槽角落部的多晶矽膜(以下稱為「角落部多晶矽膜」)54不會變質為AFS48。
其次,實行PHT製程。具體而言,在晶圓W之溫度保持在和COR製程為相同溫度之下,停止對腔室16內供給F2氣體與NH3氣體。藉此,多晶矽膜53停止變質為AFS48,所生成之AFS48因熱而升華,從腔室16內排出。其結果,藉由多晶矽膜去除處理,大部分的多晶矽膜53會被去除,但並未變質為AFS48之角落部多晶矽膜54不會升華而是殘存。
其次,實行角落部多晶矽膜54之去除處理(第2蝕刻製程)。即便是角落部多晶矽膜54之去除處理也使用ALE製程。具體而言,將晶圓W之溫度保持在和多晶矽膜去除處理為相同溫度,使得在COR製程中已變質之AFS48在PHT製程中來完全升華後,首先,對腔室16內供給N2氣體以及Ar氣體,進而,限於既定期間,對腔室16內供給F2氣體(第1處理氣體)(圖5(C))。此時,由於腔室16內不存在NH3氣體,故F2氣體不會和殘存之角落部多晶矽膜54起反應而到達角落部多晶矽膜54之表面,於角落部多晶矽膜54之表面吸附F2氣體之分子(吸附製程)(圖5(D))。
其次,持續對腔室16內供給N2氣體以及Ar氣體,停止F2氣體之供給,進而,積極地使得TMP19做運轉,而將未吸附於角落部多晶矽膜54等表面之剩餘的F2氣體從腔室16內排出(排出製程)。
另一方面,即便是圖5之基板處理方法,和圖3之基板處理方法同樣地,於COR製程中,F2氣體並非完全不會到達角落部多晶矽膜54,而是有微量的F2氣體會到達該處。從而,角落部多晶矽膜54之極少部分會變質為微量的AFS48,於後續PHT製程中,角落部多晶矽膜54所含微量的AFS48會升華。其結果,角落部多晶矽膜54之構造變得鬆散,和角落部SiO2層49同樣地,於
角落部多晶矽膜54之表面會存在多數的微少凹部,再者,於內部存在多數的微少空隙。此外,當F2氣體分子吸附於角落部多晶矽膜54之際,F2氣體分子會吸附於角落部多晶矽膜54之微少凹部、微少空隙的表面。藉此,於角落部多晶矽膜54之各表面所吸附之F2氣體分子的數量會變成非常多。此外,如上述般,由於剩餘的F2氣體從腔室16內被排出,可防止F2氣體分子過度地吸附於角落部多晶矽膜54之各表面,結果角落部多晶矽膜54之各表面會被約一層的F2氣體分子所覆蓋。
其次,持續對腔室16內供給N2氣體以及Ar氣體,限於既定期間,對腔室16內供給NH3氣體(第2處理氣體)。NH3氣體朝腔室16內會到達角落部多晶矽膜54之表面,但如上述所述,由於角落部多晶矽膜54之各表面吸附有非常多數的F2氣體分子,故角落部多晶矽膜54會積極地和F2氣體、NH3氣體起反應,角落部多晶矽膜54絕大多數變質為AFS48,而生成AFS48(生成製程)(圖5(E))。
其次,持續對腔室16內供給N2氣體以及Ar氣體,停止F2氣體之供給,而停止變質為AFS48。此時,變質後的AFS48會因來自載置台17之溫度調節器42的熱而升華,從腔室16內被排出,但由於角落部多晶矽膜54絕大多數變質為AFS48,結果可選擇性去除角落部多晶矽膜54(去除製程)(圖5(F))。其結果,於溝槽可從由壁部51所構成之溝槽來完全去除多晶矽膜53,從而於溝槽之底部可露出閘極氧化膜52。之後,結束本方法。
上述圖5之基板處理方法的變形例中之角落部去除處理,係於吸附製程中對腔室16內供給F2氣體,之後,於排出製程將剩餘的F2氣體從腔室16內排出,再者,於生成製程中對腔室16內供給NH3氣體,但氣體之供給順序不限於此。例如,也可首先於吸附製程中對腔室16內供給NH3氣體而吸附至角落部多晶矽膜54等的表面,之後,於排出製程將剩餘的NH3氣體從腔室16內排出,再者,於生成製程對腔室16內供給F2氣體使得角落部多晶矽膜54變質為AFS48。
以上,針對本發明之實施形態做了說明,但本發明不受限於上述實施形態。例如,於圖3以及圖5之基板處理方法中,COR製程、PHT製程以及ALE製程各實行了1次,但各製程之實施次數不限於1次。具體而言,當COR
製程以及PHT製程反覆複數次之情況,也可組合COR製程、PHT製程以及冷卻晶圓W之CST(Cooling Storage)製程,反覆實行該組合複數次後,再實行ALE製程1次,或是ALE製程以及PHT製程各實行1次,或是COR製程、ALE製程以及PHT製程各實行1次。此外,當COR製程中幾乎未發生AFS48之情況,於基板處理方法中,可省略PHT製程僅使得COR製程以及ALE製程各實行1次,或是使得COR製程以及ALE製程各實行1次後僅實行1次PHT製程。
此外,圖3以及圖5之基板處理方法中,雖第1蝕刻製程中利用了以化學反應為主之蝕刻(COR製程、PHT製程),但第1蝕刻製程只要利用乾式蝕刻即可,例如可利用電漿蝕刻。
再者,圖3以及圖5之基板處理方法中,雖使用ALE製程將由SiO2或矽所構成且殘存於溝槽角落部的層(角落部SiO2層49、角落部多晶矽膜54)加以去除,但同樣地可使用ALE製程將由SiN所構成且殘存於溝槽角落部的層加以去除。於此情況,也可將殘存於溝槽角落部之由SiN所構成之層加以選擇性去除。
此外,本發明之目的也可藉由例如以下方式來達成:將記錄有實現上述本實施形態機能之軟體程式碼的記憶媒體供給於程序控制器43,由程序控制器43讀取儲存在記憶媒體中的程式碼來實行。
於此情況,從記憶媒體讀取出之程式碼本身成為實現上述本實施形態之機能,該程式碼以及記憶有該程式碼之記憶媒體會構成本發明。
其次針對本發明之實施例做說明。
首先,準備具有以填埋在矽所構成之基部的表面所形成之多晶矽膜46之既定圖案的溝槽的方式形成了SiO2層47之構造的測試用晶圓W當作比較例,將該晶圓W搬送至蝕刻裝置5,於蝕刻裝置5實行了圖3之基板處理方法中的氧化膜去除處理後,將晶圓W從基板處理系統1取出,以SEM確認晶圓W之表面(圖6(A))。
其次,和比較例1同樣地準備晶圓W做為實施例1,於蝕刻裝置5中對該晶圓W施行圖3之基板處理方法中的氧化膜去除處理以及角落部去除處理之後,將晶圓W從基板處理系統1取出,以SEM確認晶圓W之表面(圖6(B))。
於實施例1之角落部去除處理,藉由載置台17之溫度調節器42將晶圓W之溫度保持在100℃。
其次,和比較例1同樣地準備晶圓W做為實施例2,於蝕刻裝置5中對該晶圓W施行圖3之基板處理方法中的氧化膜去除處理以及角落部去除處理之後,將晶圓W從基板處理系統1取出,以SEM確認晶圓W之表面(圖6(C))。實施例2之角落部去除處理中,晶圓W之溫度保持在80℃。
其次,和比較例1同樣地準備晶圓W做為實施例3,於蝕刻裝置5中對該晶圓W施行了圖3之基板處理方法中的氧化膜去除處理以及角落部去除處理之後,將晶圓W從基板處理系統1取出,以SEM確認晶圓W之表面(圖6(D))。實施例3之角落部去除處理中,晶圓W之溫度保持在60℃。
從比較例1以及實施例1至3之SEM的確認結果,確認了比較例1中角落部SiO2層49未被去除,另一方面,確認了實施例1、2中角落部SiO2層49被去除,尤其,實施例2中幾乎未殘存角落部SiO2層49。從而,可知於角落部SiO2層49之去除中利用ALE製程之角落部去除處理相當有效。
此外,如上述般,確認了實施例1、2去除了角落部SiO2層49,另一方面,實施例3中在角落部殘存有AFS48。據推測此乃實施例3之角落部去除處理中的晶圓W之溫度低達60℃,於角落部去除處理中從角落部SiO2層49所變質之AFS48未充分升華之故。
從以上可知,利用ALE製程之角落部去除處理,為了去除角落部SiO2層49,只要將晶圓W之溫度保持在70℃~120℃之間即可,較佳為保持在80℃~100℃之間,更佳為保持在接近100℃之溫度。
46‧‧‧多晶矽膜
47‧‧‧SiO2層
48‧‧‧AFS
49‧‧‧角落部SiO2層
W‧‧‧晶圓
Claims (10)
- 一種基板處理方法,係將在基板之表面所形成之被處理膜至少部分性去除;具備下述製程:第1蝕刻製程,係對該被處理膜施以第1蝕刻;以及第2蝕刻製程,係對已施行過該第1蝕刻之被處理膜施以第2蝕刻;該第2蝕刻製程具有下述製程:吸附製程,係使得第1處理氣體之分子吸附於已施行過該第1蝕刻之被處理膜;生成製程,係朝吸附有該第1處理氣體之分子的被處理膜供給第2處理氣體,使得該被處理膜、該第1處理氣體以及該第2處理氣體起反應來生成出生成物;以及去除製程,係使得所生成之該生成物升華以去除。
- 如申請專利範圍第1項之基板處理方法,其中該第2蝕刻製程於該吸附製程與該生成製程之間進而具有將剩餘的該第1處理氣體加以排出之排出製程。
- 如申請專利範圍第1或2項之基板處理方法,其中該第1蝕刻製程具有下述製程:反應製程,係使得該被處理膜變質為其他生成物;以及其他去除製程,係使得該其他生成物升華來去除。
- 如申請專利範圍第1或2項之基板處理方法,其中反覆實行複數次該第1蝕刻製程之後,實行該第2蝕刻製程。
- 如申請專利範圍第1或2項之基板處理方法,其中該被處理膜係形成於在該基板之表面所形成之溝槽之內部。
- 如申請專利範圍第1或2項之基板處理方法,其中該第1處理氣體為鹵素系氣體,該第2處理氣體為氯系氣體,該被處理膜為矽系膜。
- 如申請專利範圍第1或2項之基板處理方法,其中該第1處理氣體為氯系氣體,該第2處理氣體為鹵素系氣體,該被處理膜為矽系膜。
- 如申請專利範圍第1或2項之基板處理方法,其中該第2蝕刻製程中,該基板之溫度係保持於70℃~120℃之間。
- 一種基板處理裝置,具備: 載置台,係載置表面形成有被處理膜之基板;處理室,係收容該載置台;處理氣體供給部,係對於該處理室之內部供給第1處理氣體以及第2處理氣體;以及控制部,係控制該處理氣體供給部之動作;該控制部係實行:第1蝕刻製程,當該基板載置於該載置台之際,對該被處理膜施以第1蝕刻;以及第2蝕刻製程,係對已施行過該第1蝕刻之被處理膜施以第2蝕刻;該控制部於該第2蝕刻製程中係藉由控制該處理氣體供給部之動作來使得第1處理氣體之分子吸附至已施行過該第1蝕刻之被處理膜,進而,朝吸附有該第1處理氣體之分子的被處理膜供給第2處理氣體,使得該被處理膜、該第1處理氣體以及該第2處理氣體起反應來生成出生成物。
- 如申請專利範圍第9項之基板處理裝置,係進而具備對載置於該載置台的基板之溫度進行調節之溫度調節部;該控制部在該第2蝕刻製程中係藉由控制該溫度調節部之動作來使得生成之該生成物升華而去除。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2015217701A JP6643045B2 (ja) | 2015-11-05 | 2015-11-05 | 基板処理方法及び基板処理装置 |
JP2015-217701 | 2015-11-05 |
Publications (2)
Publication Number | Publication Date |
---|---|
TW201727728A true TW201727728A (zh) | 2017-08-01 |
TWI692806B TWI692806B (zh) | 2020-05-01 |
Family
ID=58662403
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
TW105135643A TWI692806B (zh) | 2015-11-05 | 2016-11-03 | 基板處理方法及基板處理裝置 |
Country Status (6)
Country | Link |
---|---|
US (1) | US10629446B2 (zh) |
JP (1) | JP6643045B2 (zh) |
KR (1) | KR102159869B1 (zh) |
CN (1) | CN108352309B (zh) |
TW (1) | TWI692806B (zh) |
WO (1) | WO2017077876A1 (zh) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN110660663A (zh) * | 2018-06-28 | 2020-01-07 | 株式会社日立高新技术 | 蚀刻处理方法以及蚀刻处理装置 |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP6308637B1 (ja) | 2017-05-08 | 2018-04-11 | 国立大学法人福井大学 | 特徴量を用いた3次元計測方法およびその装置 |
JP7137976B2 (ja) * | 2018-07-04 | 2022-09-15 | 東京エレクトロン株式会社 | 基板処理方法及び基板処理装置 |
JP7138529B2 (ja) * | 2018-09-28 | 2022-09-16 | 東京エレクトロン株式会社 | エッチング方法 |
JP7415594B2 (ja) * | 2020-01-24 | 2024-01-17 | 東京エレクトロン株式会社 | 基板処理方法及び基板処理装置 |
JP7550534B2 (ja) * | 2020-05-15 | 2024-09-13 | 東京エレクトロン株式会社 | エッチング方法およびエッチング装置 |
JP2022148452A (ja) * | 2021-03-24 | 2022-10-06 | 株式会社Screenホールディングス | 基板処理方法および処理液 |
KR20230165190A (ko) | 2021-04-08 | 2023-12-05 | 도쿄엘렉트론가부시키가이샤 | 에칭 방법 및 플라즈마 처리 시스템 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2004128382A (ja) * | 2002-10-07 | 2004-04-22 | Tokyo Electron Ltd | 処理方法及び処理装置 |
JP4933789B2 (ja) * | 2006-02-13 | 2012-05-16 | 東京エレクトロン株式会社 | 基板処理装置、基板処理方法及び記憶媒体 |
JP2007266455A (ja) | 2006-03-29 | 2007-10-11 | Tokyo Electron Ltd | 基板処理装置、基板処理方法及び記憶媒体 |
US7416989B1 (en) * | 2006-06-30 | 2008-08-26 | Novellus Systems, Inc. | Adsorption based material removal process |
JP5084250B2 (ja) | 2006-12-26 | 2012-11-28 | 東京エレクトロン株式会社 | ガス処理装置およびガス処理方法ならびに記憶媒体 |
JP4968861B2 (ja) * | 2009-03-19 | 2012-07-04 | 東京エレクトロン株式会社 | 基板のエッチング方法及びシステム |
US8956546B2 (en) * | 2010-08-03 | 2015-02-17 | Tokyo Electron Limited | Substrate processing method and substrate processing apparatus |
-
2015
- 2015-11-05 JP JP2015217701A patent/JP6643045B2/ja active Active
-
2016
- 2016-10-14 CN CN201680064463.1A patent/CN108352309B/zh active Active
- 2016-10-14 KR KR1020187011703A patent/KR102159869B1/ko active IP Right Grant
- 2016-10-14 US US15/772,546 patent/US10629446B2/en active Active
- 2016-10-14 WO PCT/JP2016/081190 patent/WO2017077876A1/ja active Application Filing
- 2016-11-03 TW TW105135643A patent/TWI692806B/zh active
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN110660663A (zh) * | 2018-06-28 | 2020-01-07 | 株式会社日立高新技术 | 蚀刻处理方法以及蚀刻处理装置 |
Also Published As
Publication number | Publication date |
---|---|
US20180330962A1 (en) | 2018-11-15 |
US10629446B2 (en) | 2020-04-21 |
CN108352309A (zh) | 2018-07-31 |
KR20180054841A (ko) | 2018-05-24 |
JP6643045B2 (ja) | 2020-02-12 |
TWI692806B (zh) | 2020-05-01 |
WO2017077876A1 (ja) | 2017-05-11 |
KR102159869B1 (ko) | 2020-09-24 |
CN108352309B (zh) | 2022-06-24 |
JP2017092144A (ja) | 2017-05-25 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
TWI692806B (zh) | 基板處理方法及基板處理裝置 | |
TWI686843B (zh) | 基板處理方法及基板處理裝置 | |
KR101853522B1 (ko) | 에칭 방법 및 기억 매체 | |
TWI727023B (zh) | 基板處理方法及基板處理裝置 | |
TWI648791B (zh) | Etching method | |
JP5881612B2 (ja) | 半導体装置の製造方法および製造装置 | |
TWI608536B (zh) | Etching method and memory medium | |
KR101715460B1 (ko) | 가스 처리 방법 | |
TW201448021A (zh) | 蝕刻方法 | |
WO2013175872A1 (ja) | ガス処理方法 | |
TW201742134A (zh) | 基板處理方法 | |
US10622205B2 (en) | Substrate processing method and substrate processing apparatus | |
US11548804B2 (en) | Method and apparatus for processing oxygen-containing workpiece |