TW201606744A - 移位暫存器 - Google Patents

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施嫚雯
陳雅鈴
李建亞
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Abstract

一種移位暫存器，包括多級移位暫存電路，每一移位暫存電路包含第一開關、輸入電路、下拉電路、及漣波抑制電路。第一開關用以根據節點及時脈訊號的電位，輸出移位暫存電路之掃描訊號。輸入電路用以接收並根據前級移位暫存電路輸出之掃描訊號上拉本級移位暫存電路節點之電位。下拉電路用以根據後級移位暫存電路輸出之掃描訊號，下拉本級移位暫存電路的節點及掃描訊號的電位。漣波抑制電路用以抑制本級移位暫存電路的節點及掃描訊號之電位受時脈訊號耦合所產生之漣波。

Description

移位暫存器
本發明係有關於一種移位暫存器，尤指一種可減少漣波的移位暫存器。
一般而言，顯示面板包含有複數個畫素、閘極驅動電路以及源極驅動電路。閘極驅動電路包含複數級移位暫存電路，用來提供複數個掃描訊號，以控制畫素之開啟與關閉。源極驅動電路則用以寫入資料訊號至被開啟的畫素。移位暫存器即為一種常用來實現閘極驅動器功能的電路，移位暫存器可包含複數級的移位暫存電路，其中每一級一位暫存電路係用以根據其對應的時脈訊號來提供其閘極訊號，使得顯示面板中每一列的畫素被依序地開啟與關閉。
第1圖為先前技術之移位暫存電路100的示意圖，移位暫存電路100包含用以輸出掃描訊號GN的第一開關T1。第一開關T1的第一端用以接收時脈訊號CK，第一開關T1的第二端用以輸出移位暫存電路的掃描訊號GN，第一開關T1的控制端係接收內部參考電壓VQ。當內部參考電壓VQ及時脈訊號CK皆為高電壓位準時，移位暫存器100則對應地輸出具有高電壓位準的掃描訊號GN。然而由於時脈訊號CK會週期性地在高電壓位準及低電壓位準之間變動，因此，即便在內部參考電壓VQ應為低電壓位準時，移位暫存器100仍可能在時脈訊號由低電壓位準變為高電壓位準時，因為時脈訊號CK對第一開關T1的耦合效應，使得使內部參考電壓VQ產生漣波(ripple)，進而誤發掃描訊號GN，導致顯示面板的誤判或錯充。
隨著現今顯示面板的解析度越來越高，顯示面板的源極驅動器傳輸一個位元的畫素資訊所需的時間也跟著被縮短，因此如何能有效且迅速的抑制時脈訊號對移位暫存器造成的漣波影響，即成為一個需解決的問題。
本發明之一實施例提供一種移位暫存器。移位暫存器包括多級移位暫存電路，每一移位暫存電路包含第一開關、輸入電路、下拉電路及漣波抑制電路。第一開關具有第一端、第二端及控制端，第一開關的第一端用以接收第一時脈訊號，第一開關的第二端用以輸出移位暫存電路的掃描訊號，第一開關的控制端電性耦接於移位暫存電路的節點。輸入電路係用以接收並根據多級移位暫存電路中前級移位暫存電路輸出之掃描訊號上拉該級移位暫存電路的節點之電壓位準。下拉電路電性耦接於第二系統電壓端、該級移位暫存電路的節點及第一開關的第二端，用以根據多級移位暫存電路中後級移位暫存電路輸出之掃描訊號，下拉該級移位暫存電路的節點及第一開關的第二端之電壓位準。漣波抑制電路係電性耦接於該級移位暫存電路的節點及一第一系統電壓端，用以接收第二時脈訊號，並用以抑制該級移位暫存電路的節點及該級移位暫存電路輸出的掃描訊號之電壓位準受該第一時脈訊號耦合所產生之漣波。其中第一時脈訊號與第二時脈訊號具有相同週期且互為反向。
根據上述本發明之實施例，移位暫存電路中的漣波抑制電路可避免在時脈訊號變動時，於節點上產生漣波而錯誤導通第一開關，並誤發掃描訊號的問題，因此可確保移位暫存器所輸出的掃描訊號之波形的正確性，並避免顯示面板的錯充或誤判。
100、400N、500N‧‧‧移位暫存電路
200N-1、200N、200N+1‧‧‧移位暫存電路
300‧‧‧移位暫存器
210‧‧‧輸入電路
220、420‧‧‧下拉電路
230、430、530‧‧‧漣波抑制電路
T1‧‧‧第一開關
T2‧‧‧第二開關
T3‧‧‧第三開關
T4‧‧‧第四開關
T5‧‧‧第五開關
T6‧‧‧第六開關
T7‧‧‧第七開關
C1‧‧‧第一電容
C2‧‧‧第二電容
C3‧‧‧第三電容
CK1‧‧‧第一時脈訊號
CK2‧‧‧第二時脈訊號
VQ‧‧‧內部參考電壓
CK、HC1、HC2‧‧‧時脈訊號
V1‧‧‧第一系統電壓端
V2‧‧‧第二系統電壓端
SP‧‧‧起始訊號
QN‧‧‧節點
GN-1、GN、GN+1‧‧‧掃描訊號
VGH‧‧‧閘極高電壓位準
VGL‧‧‧閘極低電壓位準
第1圖為先前技術之移位暫存電路的示意圖。
第2圖為本發明一實施例之移位暫存電路的電路圖。
第3圖為本發明一實施例之移位暫存器的電路圖。
第4圖為第3圖之移位暫存電器的時序操作圖。
第5圖為本發明另一實施例之移位暫存電路的電路圖。
第6圖為本發明另一實施例之移位暫存電路的電路圖。
第2圖為本發明一實施例之移位暫存電路200N的電路圖，第3圖為本發明一實施例之移位暫存器300的電路圖，移位暫存器300包含多級移位暫存電路200N-1、200N及200N+1，每一級移位暫存器具有相同的架構，且N為大於1之正整數。
移位暫存電路200N包含第一開關T1、輸入電路210、下拉電路220及漣波抑制電路230。第一開關T1具有第一端，第二端及控制端，第一開關T1的第一端用以接收第一時脈訊號CK1，第一開關的第二端用以輸出移位暫存電路200N的掃描訊號GN，第一開關的控制端電性耦接於移位暫存電路200N的節點QN。輸入電路210係用以接收並根據一前級移位暫存電路200N-1輸出之掃描訊號GN-1，以上拉移位暫存電路200的節點QN之電壓位準。下拉電路220係電性耦接於第二系統電壓端V2、移位暫存電路200N的節點QN及第一開關T1的第二端，用以根據後級移位暫存電路200N+1輸出之掃描訊號GN+1，下拉移位暫存電路200N的節點QN及第一開關T1的第二端之電壓位準。漣波抑制電路230係電性耦接於移位暫存電路200N的節點QN及第一系統電壓端V1，用以接收第二時脈訊號CK2，並用以抑制移位暫存電路200N的節點QN及移位暫存電路200N輸出的掃描訊號GN之電壓位準受第一時脈訊號CK1耦合所產生之漣波。
在第2圖中，移位暫存電路200N的漣波抑制電路230包含第二開關T2、第三開關T3、第四開關T4、第一電容C1及第二電容C2。第二開關 T2具有第一端、第二端及控制端，第二開關T2的第一端電性耦接於第一系統電壓端V1，第二開關T2的控制端用以接收後級移位暫存電路200N+1輸出之掃描訊號GN+1。第三開關T3具有第一端、第二端及控制端，第三開關T3的第一端電性耦接於第二開關T2的第二端，第三開關T3的第二端電性耦接於第二系統電壓端V2，第三開關T3的控制端接收前級移位暫存電路200N-1輸出之掃描訊號GN-1。第四開關T4具有第一端、第二端及控制端，第四開關T4的第一端接收第二時脈訊號CK2，第四開關T4的控制端電性耦接於第二開關T2的第二端。第一電容C1具有第一端及第二端，第一電容C1的第一端電性耦接於第二開關T2的第二端，第一電容C1的第二端電性耦接於第二系統電壓端V2。第二電容C2具有第一端及第二端，第二電容C2的第一端電性耦接於第四開關T4的第二端，第二電容C2的第二端電性耦接於移位暫存電路200N的節點QN。
在第2圖中，移位暫存電路200N的輸入電路210包含第五開關 T5。第五開關T5具有第一端、第二端及控制端，第五開關T5的第一端用以接收前級移位暫存電路200N-1輸出之掃描訊號GN-1，第五開關T5的第二端電性耦接於移位暫存電路200N的節點QN，第五開關T5的控制端電性耦接於第五開關T5的第一端。移位暫存電路200N的下拉電路220包含第六開關T6及第七開關T7。第六開關T6具有第一端、第二端及控制端，第六開關T6的第一端電性耦接於移位暫存電路200N的節點QN，第六開關T6的第二端電性耦接於第二系統電壓端V2，第六開關T6的控制端用以接收後級移位暫存電路200N+1輸出之掃描訊號GN+1。第七開關T7具有第一端、第二端及控制端，第七開關T7的第一端電性耦接於第一開關T1的第二端，第七開關T7的第二端電性耦接於第二系統電壓端V2，第七開關T7的控制端用以接收後級移位暫存電路200N+1輸出之掃描訊號GN+1。移位暫存電路200還包含第三電容C3，第三電容C3具有第一端及第二端，第三電容C3的第一端電性耦接於移位暫存電路200N的節點QN，第三電容C3的第二端電性耦接於第一開 關T1的第二端。
在上述實施例中，移位暫存電路200N中的第一開關至第七開關皆 可為N型場效電晶體，此時，第一系統電壓端V1可提供閘極高電壓位準VGH，而第二系統電壓端V2可提供閘極低電壓位準VGL，亦即第一系統電壓端V1之電壓位準可高於第二系統電壓端V2之電壓位準。然而，移位暫存電路200N中的第一開關至第七開關亦可為P型場效電晶體，此時，第一系統電壓端V1可提供閘極低電壓位準VGL，而第二系統電壓端V2可提供閘極高電壓位準VGH，亦即第一系統電壓端V1之電壓位準可低於第二系統電壓端V2之電壓位準。為方便說明，以下將以第一開關至第七開關係為N型場效電晶體的情況來說明，然而如上所述，相關領域者亦可將第一開關至第七開關以P型場效電晶體實施而仍應屬本發明之範圍。
移位暫存器300可用於顯示面板的閘極驅動器，而移位暫存器300 中多級的移位暫存電路即可用來提供複數個閘極訊號，以控制顯示面板的畫素之開啟與關閉。在第3圖中，移位暫存電路200N-1至200N+1會分別將掃描訊號GN-1至GN+1輸出至對應的閘極線(或稱掃描線)，以依序地開啟顯示面板各列的畫素。移位暫存電路200N至200N+1會分別接收其前一級移位暫存電路200N-1至200N的掃描訊號GN-1至GN，倘若移位暫存電路200N-1是第一級移位暫存電路，則移位暫存電路200N-1會接收起始訊號，否則會接收其前一級移位暫存電路的掃描訊號GN-2。此外，移位暫存電路200N-1至移位暫存電路200N亦分別會分別接收其後一級移位暫存電路200N至200N+1的掃描訊號GN至GN+1，倘若移位暫存電路200N+1是最後一級移位暫存電路，則移位暫存電路200N+1會接收終止訊號，否則會接收其後一級移位暫存電路所輸出的掃描訊號GN+2。於一實施例中，移位暫存電路200N-1會優先發出其掃描訊號GN-1，然後移位暫存電路200N、200N+1會跟著依序發出其掃描訊號GN、GN+1，亦即移位暫存電路200N+1是三個移位暫存電路200N-1至200N+1當中最後發出掃描訊號GN+1的移位暫存電路。此外，移位暫存電路200N-1及200N+1會以時脈訊 號HC1作為其第一時脈訊號，並以時脈訊號HC2作為其第二時脈訊號，而移位暫存電路200N則係以時脈訊號HC2作為其第一時脈訊號，並以時脈訊號HC1作為其第二時脈訊號。時脈訊號HC1及HC2的電壓位準會在閘極高電壓位準VGH及閘極低電壓位準VGL之間切換，並每隔一個週期由閘極低電壓位準VGL被提升至閘極高電壓位準VGH，且時脈訊號HC1及HC2不同時為閘極高電壓位準VGH；亦即時脈訊號HC1與時脈訊號HC2具有相同週期且互為反向。
第4圖為第3圖之移位暫存器300中，移位暫存電路200N之操作 時序圖。於時段t1期間，時脈訊號HC1(即為移位暫存電路200N的第二時脈訊號CK2)為閘極高電壓位準VGH，時脈訊號HC2(即為移位暫存電路200N的第一時脈訊號CK1)為閘極低電壓位準VGL，掃描訊號GN-1為閘極高電壓位準VGH，掃描訊號GN+1為閘極低電壓位準VGL。此時第五開關T5被導通，導致節點QN的電壓位準被上拉至閘極高電壓位準VGH，並對第三電容C3充電，且導通第一開關T1，掃描訊號GN的電壓位準則因此被維持在與時脈訊號HC2相同的閘極低電壓位準VGL。第六開關T6及第七開關T7皆為截止狀態。第二開關T2被截止，第三開關T3則被導通並使第一電容C1放電，使得第四開關T4亦被截止。
於時段t2期間，時脈訊號HC1為閘極低電壓位準VGL，時脈訊 號HC2為閘極高電壓位準VGH，掃描訊號GN-1為閘極低電壓位準VGL，掃描訊號GN+1為閘極低電壓位準VGL。此時第五開關T5被截止，且由於第六開關T6及第七開關T7亦皆為截止狀態，導致節點QN無放電路徑，而仍可將第一開關T1導通，使得掃描訊號GN的電壓位準被上拉至與時脈訊號HC2相同的閘極高電壓位準VGH。並且由於第三電容C3的耦合效應，節點QN的電壓位準會被上抬至約兩倍的閘極高電壓位準VGH(即2VGH)。第二開關T2、第三開關T3及第四開關T4皆被截止。
於時段t3期間，時脈訊號HC1為閘極高電壓位準VGH，時脈訊 號HC2為閘極低電壓位準VGL，掃描訊號GN-1為閘極低電壓位準VGL，掃描訊號GN+1為閘極高電壓位準VGH。此時第五開關T5仍被截止，而第六開關T6及第七開關T7皆被導通，導致節點QN及掃描訊號GN的電壓位準被下拉至第二系統電壓端V2相同的閘極低電壓位準VGL，而第一開關T1則被截止。第二開關T2被導通並向第一電容C1充電，第四開關T4因此被導通並向第二電容C2充電。第三開關T3則被截止。
於時段t4期間，時脈訊號HC1為閘極低電壓位準VGL，時脈訊 號HC2為閘極高電壓位準VGH，掃描訊號GN-1為閘極低電壓位準VGL，掃描訊號GN+1為閘極低電壓位準VGL。此時第二開關T2、第三開關T3、第五開關T5、第六開關T6及第七開關T7皆被截止，然而由於第一電容C1仍保有於時段t3期間所儲存之電荷，因此第四開關T4仍被導通，且由於時脈訊號HC1此時為閘極低電壓位準VGL，因此透過第一電容C1對節點QN的耦合效應即可抵銷時脈訊號HC2變為閘極高電壓位準VGH時，經由第一開關T1的寄生電容對節點QN的耦合效應，進而得以避免第一開關T1因為節點QN上產生之漣波而被錯誤導通，而誤發掃描訊號GN。
從上述實施例中可以得知，移位暫存電路200N的漣波抑制電路可 避免在時脈訊號HC2變為高電壓位準VGH時，於節點QN上產生漣波而錯誤導通第一開關T1，並誤發掃描訊號GN的問題，因此可確保移位暫存器300所輸出的掃描訊號之波形的正確性，並避免顯示面板的錯充或誤判。
第5圖為本發明另一實施例之移位暫存電路400N的電路圖。移位 暫存電路400N與移位暫存電路200N的架構相似，其差別在於移位暫存電路400N中漣波抑制電路430之第二開關T2的第一端及控制端皆係用以接收後級移位暫存電路輸出之掃描訊號GN+1，而移位暫存電路400N中下拉電路420之第五開關T5的第一端係電性耦接於第一系統電壓端V1，並使第五開關T5的控制端用以接收前級移位暫存電路輸出之該掃描訊號GN-1。由於移位暫存電路400N的第二開關T2及第五開關T5與移位暫存電路200N的第二開關T2 及第五開關T5仍係於相同時段導通截止，因此可取代移位暫存電路200N作為移位暫存器300內部的移位暫存電路，其操作時序可參考上述對的移位暫存電路200N之操作時序的說明，在此不另贅述。
第6圖為本發明另一實施例之移位暫存電路500N的電路圖。移位 暫存電路500N與移位暫存器電路200N的架構相似，其差別在於漣波抑制電路530中之第一電容C1的第二端係電性耦接於第一系統電壓端V1。移位暫存電路500N亦可作為移位暫存器300中的各級移位暫存器，由於其操作時序亦與移位暫存器電路200N相似，以下將同樣利用第4圖所示之操作時序來說明。
於時段t1期間，時脈訊號HC1(其為第5圖的第二時脈訊號CK2) 為閘極高電壓位準VGH，時脈訊號HC2(其為第5圖的第一時脈訊號CK1)為閘極低電壓位準VGL，掃描訊號GN-1為閘極高電壓位準VGH，掃描訊號GN+1為閘極低電壓位準VGL。此時第五開關T5被導通，導致節點QN的電壓位準被上拉至閘極高電壓位準VGH，並對第三電容C3充電，且導通第一開關T1，掃描訊號GN的電壓位準則因此被維持在與時脈訊號HC2相同的閘極低電壓位準VGL。第六開關T6及第七開關T7皆為截止狀態。第二開關T2被截止，第三開關T3則被導通，使得第一電容C1的第一端為閘極高電壓位準VGH而第一電容C1的第二端則為閘極低電壓位準VGL，並使得第四開關T4被截止。
於時段t2期間，時脈訊號HC1為閘極低電壓位準VGL，時脈訊 號HC2為閘極高電壓位準VGH，掃描訊號GN-1為閘極低電壓位準VGL，掃描訊號GN+1為閘極低電壓位準VGL。此時第五開關T5被截止，且由於第六開關T6及第七開關T7亦皆為截止狀態，導致節點QN無放電路徑，而仍可將第一開關T1導通，使得掃描訊號GN的電壓位準被上拉至與時脈訊號HC2相同的閘極高電壓位準VGH。並且由於第三電容C3的耦合效應，節點QN的電壓位準會被上抬至約兩倍的閘極高電壓位準VGH(即2VGH)。第二開關 T2、第三開關T3及第四開關T4皆被截止。
於時段t3期間，時脈訊號HC1為閘極高電壓位準VGH，時脈訊 號HC2為閘極低電壓位準VGL，掃描訊號GN-1為閘極低電壓位準VGL，掃描訊號GN+1為閘極高電壓位準VGH。此時第五開關T5仍被截止，而第六開關T6及第七開關T7皆被導通，導致節點QN及掃描訊號GN的電壓位準被下拉至第二系統電壓端V2相同的閘極低電壓位準VGL，而第一開關T1則被截止。第二開關T2被導通並使第一電容C1的第二端亦提升至閘極高電壓位準，第四開關T4因此被導通並向第二電容C2充電。第三開關T3則被截止。
於時段t4期間，時脈訊號HC1為閘極低電壓位準VGL，時脈訊 號HC2為閘極高電壓位準VGH，掃描訊號GN-1為閘極低電壓位準VGL，掃描訊號GN+1為閘極低電壓位準VGL。此時第二開關T2、第三開關T3、第五開關T5、第六開關T6及第七開關T7皆被截止，然而由於第一電容C1已無留存電荷，因此第一電容C1的第二端仍維持在閘極高電壓位準VGH，而使得第四開關T4仍被導通，且由於時脈訊號HC1此時為閘極低電壓位準VGL，因此透過第一電容C1對節點QN的耦合效應即可抵銷時脈訊號HC2變為閘極高電壓位準VGH時，經由第一開關T1的寄生電容對節點QN的耦合效應，進而得以避免第一開關T1因為節點QN上產生之漣波而被錯誤導通，而誤發掃描訊號GN。
從上述實施例中可以得知，移位暫存電路500N的漣波抑制電路亦 可避免節點QN上產生漣波，以得以避免第一開關T1被錯誤導通，而致使誤發掃描訊號GN的問題，因此可確保移位暫存器300所輸出的掃描訊號之波形的正確性，並避免顯示面板的錯充或誤判。
綜上所述，本發明之實施例所提供之移位暫存器，可避免受時脈 訊號耦合的影響，導致內部節點產生漣波而將開關錯誤導通，而誤發掃描訊號，因此得以確保顯示面板的閘極驅動器所輸出的掃描訊號之波形正確性，並避免顯示面板的錯充或誤判。
以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
200N‧‧‧移位暫存電路
210‧‧‧輸入電路
220‧‧‧下拉電路
230‧‧‧漣波抑制電路
T1‧‧‧第一開關
T2‧‧‧第二開關
T3‧‧‧第三開關
T4‧‧‧第四開關
T5‧‧‧第五開關
T6‧‧‧第六開關
T7‧‧‧第七開關
C1‧‧‧第一電容
C2‧‧‧第二電容
C3‧‧‧第三電容
CK1‧‧‧第一時脈訊號
CK2‧‧‧第二時脈訊號
V1‧‧‧第一系統電壓端
V2‧‧‧第二系統電壓端
QN‧‧‧節點
GN-1、GN、GN+1‧‧‧掃描訊號

Claims (10)

  1. 一種移位暫存器，包括多級移位暫存電路，每一移位暫存電路包含：一第一開關，具有一第一端，一第二端及一控制端，該第一開關的該第一端用以接收一第一時脈訊號，該第一開關的該第二端用以輸出該移位暫存電路的一掃描訊號，該第一開關的該控制端電性耦於接該移位暫存電路的一節點；一輸入電路，用以接收並根據該些移位暫存電路中一前級移位暫存電路輸出之一掃描訊號上拉該移位暫存電路的該節點之電壓位準；一下拉電路，電性耦接於一第二系統電壓端、該移位暫存電路的該節點及該第一開關的該第二端，用以根據該些移位暫存電路中一後級移位暫存電路輸出之一掃描訊號，下拉該移位暫存電路的該節點及該第一開關的該第二端之電壓位準；及一漣波抑制電路，電性耦接於該移位暫存電路的該節點及一第一系統電壓端，用以接收一第二時脈訊號，並用以抑制該移位暫存電路的該節點及該移位暫存電路輸出的該掃描訊號之電壓位準受該第一時脈訊號耦合所產生之漣波(ripple)；其中該第一時脈訊號與該第二時脈訊號具有相同週期且互為反向。
  2. 如請求項1所述之移位暫存器，其中該漣波抑制電路包含：一第二開關，具有一第一端，一第二端及一控制端，該第二開關的該第一端電性耦接於該第一系統電壓端，該第二開關的該控制端用以接收該後級移位暫存電路輸出之該掃描訊號；一第三開關，具有一第一端，一第二端及一控制端，該第三開關的該第一端電性耦接於該第二開關的該第二端，該第三開關的該第二端電 性耦接於該第二系統電壓端，該第三開關的該控制端接收該前級移位暫存電路輸出之該掃描訊號；一第四開關，具有一第一端，一第二端及一控制端，該第四開關的該第一端接收該第二時脈訊號，該第四開關的該控制端電性耦接於該第二開關的該第二端；一第一電容，具有一第一端及一第二端，該第一電容的該第一端電性耦接於該第二開關的該第二端；一第二電容，具有一第一端及一第二端，該第二電容的該第一端電性耦接於該第四開關的該第二端，該第二電容的該第二端電性耦接於該移位暫存電路的該節點。
  3. 如請求項1所述之移位暫存器，其中該漣波抑制電路包含：一第二開關，具有一第一端，一第二端及一控制端，該第二開關的該第一端及該第二開關的該控制端用以接收該後級移位暫存電路輸出之該掃描訊號；一第三開關，具有一第一端，一第二端及一控制端，該第三開關的該第一端電性耦接於該第二開關的該第二端，該第三開關的該第二端電性耦接於該第二系統電壓端，該第三開關的該控制端接收該前級移位暫存電路輸出之該掃描訊號；一第四開關，具有一第一端，一第二端及一控制端，該第四開關的該第一端接收該第二時脈訊號，該第四開關的該控制端電性耦接於該第二開關的該第二端；一第一電容，具有一第一端及一第二端，該第一電容的該第一端電性耦接於該第二開關的該第二端；一第二電容，具有一第一端及一第二端，該第二電容的該第一端電性耦接於該第四開關的該第二端，該第二電容的該第二端電性 耦接於該移位暫存電路的該節點。
  4. 如請求項2或3所述之移位暫存器，其中該第一電容的該第二端電性耦接於該第一系統電壓端或該第二系統電壓端。
  5. 如請求項1所述之移位暫存器，其中該輸入電路包含：一第五開關，具有一第一端，一第二端及一控制端，該第五開關的該第一端用以接收該前級移位暫存電路輸出之該掃描訊號，該第五開關的該第二端電性耦接於該移位暫存電路的該節點，該第五開關的該控制端電性耦接於該第五開關的該第一端。
  6. 如請求項1所述之移位暫存器，其中該輸入電路包含：一第五開關，具有一第一端，一第二端及一控制端，該第五開關的該第一端電性耦接於該第一系統電壓端，該第五開關的該第二端電性耦接於該移位暫存電路的該節點，該第五開關的該控制端用以接收該前級移位暫存電路輸出之該掃描訊號。
  7. 如請求項1所述之移位暫存器，其中該下拉電路包含：一第六開關，具有一第一端，一第二端及一控制端，該第六開關的該第一端電性耦接於該移位暫存電路的該節點，該第六開關的該第二端電性耦接於該第二系統電壓端，該第六開關的該控制端用以接收該後級移位暫存電路輸出之該掃描訊號；及一第七開關，具有一第一端，一第二端及一控制端，該第七開關的該第一端電性耦接於該第一開關的該第二端，該第七開關的該第二端電性耦接於該第二系統電壓端，該第七開關的該控制端用以接收該後級移位暫存電路輸出之該掃描訊號。
  8. 如請求項1所述之移位暫存器，另包含：一第三電容，具有一第一端及一第二端，該第三電容的該第一端電性耦接於該移位暫存電路的該節點，該第三電容的該第二端電性耦接於該第一開關的該第二端。
  9. 如請求項1至3及5至7中任一項所述之移位暫存器，其中該些開關係為N型場效電晶體，及該第一系統電壓端之電壓位準高於該第二系統電壓端之電壓位準。
  10. 如請求項1至3及5至7中任一項所述之移位暫存器，其中該些開關係為P型場效電晶體，及該第一系統電壓端之電壓位準低於該第二系統電壓端之電壓位準。
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