TW200845443A - Phase-change memory element - Google Patents

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TW200845443A TW096138486A TW96138486A TW200845443A TW 200845443 A TW200845443 A TW 200845443A TW 096138486 A TW096138486 A TW 096138486A TW 96138486 A TW96138486 A TW 96138486A TW 200845443 A TW200845443 A TW 200845443A
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Description

200845443 九、發明說明: 【發明所屬之技術領域】 變化 本發明關於一種記憶體,特別關於一種相 【先前技術】
相受化記憶體具有尚碩,〜a 心〜卞.馬〜曰 可靠度、高寫擦次數、低工作電壓/電流及低戍束、南 且非常適合與CMOS製程結合,可用來作為铁高,特質’ 立式或喪入式的記憶體應用,是目前十分被看^★度的獨 代新記憶體。由於相變化記憶體技術的獨特優勢、下世 其被認為非常有可能取代目前商業化極具競爭怪也使知 與DRAM揮發性記憶體與Flash非揮發性記悔趟纟SRAM 望成為未來極有潛力的新世代半導體記憶體。、技術,可 相變化記憶體在設計上朝著以下幾個方式方 知式化電流、高穩定度、較小的體積、及快速 ^低的 度,此外,相變化記憶體目前之主要應用例如變=速 電流消粍的可攜式裝置(需要較小程式化電流)。 相變化記憶體的發展趨勢,可以明顯的發現主要的瓶頸^ 在於70件的操作電流過大,因而無法有效地降低相變化記 憶體元件所串接的驅動電晶體面積,導致單位元尺寸過大 使得記憶體密度無法提升的問題。 降低相變化記憶體操作電流可藉由縮小相變化記憶胞 中相變層與電極之接觸面積來達成,且有利於CMOS元件 的縮小以及5己憶體岔度的提升。然而,此方法會受限於微 影與製程能力的限制,較不易獲得有效地突破。此外,降 0949-A22022TWF(N2);P51950186TW;phoelip 6 200845443 低相變化記憶胞中相變層與電極之接觸面積意即縮小加熱 區域,雖然可降低元件尺寸,但是較小的加熱區域意味著 熱更易由週遭環境散失,因此仍需增加電流密度以維持足 夠的熱產生相變化,如此一來會造成電子遷移產生影響到 元件穩定度。因此,藉由材料的選用來降低電子遷移發生 或是改善熱變遷以降低由週遭環境所散失的熱,亦為相變 化記憶體的重要發展方向之一。 熱散失主要係跟環繞在相變化層週圍之介電層的熱傳 導能力有關。一般來說,相變化材料(例如:Ge2Sb2Te5)由於 其微結構的關係,使其熱傳導度可降至約為〇·3 W/m-K。 自從相變化材料主要係作為主動層,因此不會將其用來作 為週遭介電層的材質。然而傳統介電材料,例如氧化矽或 氮化矽,他們的熱傳導係數一般係高於1 W/m-K。如此高 的熱傳導係數,加速熱由相變化材料移至外界的速度。 為解決上述問題,美國專利5933365揭露一種相變化 記憶體,其使用一熱絕緣層來防止熱從相變化材料散失至 外界。然而,該熱絕緣層之材料不易取得,且與目前相變 化記憶體的製程不相容,現階段並無法導入一般業界所用 之相變化記憶體製程。 因此,在以與目前相變化記憶體製程相容為前提下, 發展出具有低熱傳導能力的材料及結構來降低熱從相變化 材料層散出的速率,是目前相變化記憶體一項重要技術關 鍵。 【發明内容】 0949-A22022TWF(N2);P51950186TW;phoelip 7 200845443 記憶體,其= 二呈=::變化材料層熱散失之相變化 變化層’使得熱不易由週遭環境::及;;電材料來包覆相 -複合材料層包含一介電材 x目文化5己憶體’包合 形成於該複合“層::ΓΓ:低熱傳導材料;一貫孔 份之該貫孔内。 —相魏材料形成於至少一部 g: 此外,依據本發明之另—每^ /t 化記憶體亦可包含:一義板.::例,本發明所述之相變 =層:成於該基板之上,其中該複合材料層包含一介 Γ p低熱料材料;—貫孔貫穿該複合材料層;以 及一相變化材料形成 電性連結。 4…至夕-部份之貫孔内並與該電極 以下藉由數個實施例及比較實施例,以更進一步說明 本毛月之n特彳纽優點,但並非用來限制本發明之範 圍,本發明之範圍應以所附之中請專利範圍 【實施方式】 、下π配5圖式及對應實施例,來詳細說明本發明 一實施例所述之相變化記憶體及其製造方法。 實施例1 : 首先,4苓照第la圖,提供一具有一下電極12之美 板ίο,且形成有一絕緣層14於環繞該下電極12,並露= 該下電極12之上表面15。其中,該基板1()可為—半導體 製程所使用之基板,例如為石夕基板。該基板1()可為一已完 0949-A22022TWF(N2);P51950186TW;phoelip 〇 200845443 成CMOS前段製程的基板,亦可能包含隔離結構、電容、 二極體與其類似物,為簡化圖示起見,圖中僅以一平整基 板表不。該下電極12係為導電材料,例如為A1、w、M〇、
TiN、或TiW。該絕緣層14可以為含矽的化合物,例如氧 化石夕或氮化石夕。 接著,請參照第lb圖,一複合材料層2〇形成於該下 電極12及該絕緣層丨4之上,其中該複合材料層2〇包含交 替相豐的介電材料層16及低熱傳導材料層18。此外,該 ( 複合材料層20至少包含一層介電材料層16及一低熱傳導 材料層18。 該單一之介電材料層16及該低熱傳導材料層的厚 度至少大於3 nm。該低熱傳導材料層18具有一熱傳導係 數介於 〇·1 W/m-K 至 1 W/m_K,例如 〇 2 w/m_K 至 〇·3 W/m-K,且該低熱傳導材料可為相變化材料、氮摻雜相變 化材料、或氧摻雜相變化材料,例如:GeTe、、
GeSbTe或InGeSbTe。該介電材料層丨6可以為含矽的化合 、 物,例如氧化矽或氮化矽。 接著,請參照第1c圖,該複合材料層20進一步被圖 形化以形成-貫孔22,該貫孔22係經由微影技術及钱刻 製程所得亚貫穿該複合材料層20,以露出下電極12的上 表面15。該蝕刻製程可例如為一乾蝕刻製程。 接著明參知、弟Id圖,形成一相變化材料層24以填 入该貝孔22内。該相變化材料層24可包含化、Ge、sb、 Te或其混合,例如是GeTe、以处、、⑽价或 0949-A22022TWF(N2);P51950186TW;phoelip 9 200845443
InGeSbTe 〇 最後’请參照第1 e圖,一上電極26係形成於該複合 材料層20之上並進一步與該相變化材料層24電性連結。 該上電極26的材料可例如為TaN、W、TiN、 或TiW。 實施例2: 首先,請參照第2a圖,提供一具有一下電極1〇2之基 板100,且形成有一絕緣層1〇4環繞該下電極1〇2,並露出 ( 該下電極1〇2之上表面105。其中,該基板1〇〇可為一半 導體製程所使用之基板,例如為矽基板。該基板1〇〇可為 一已完成CMOS前段製程的基板,亦可能包含隔離結構、 電容、二極體與其類似物,為簡化圖示起見,圖中僅以一 平整基板表示。該下電極1〇2係為導電材料,例如為a卜 W、Mo、TiN、或TiW。該絕緣層丨〇4可以為含矽的化合 物,例如氧化矽或氮化矽。 接著’請參照第2b圖,一複合材料層110形成於該 " 下電極102及該絕緣層忉4之上,其中該複合材料層110 包含由介電材料106及低熱傳導材料1〇8混合所得之膜 層’其中該複合材料層之介電材料及低熱傳導材料之重量 比係為1:10〜1:1。該低熱傳導材料1〇8具有一熱傳導係數 介於 0·1 W/m_K 至1 W/m-K,例如 0.2 W/m-K 至 0.3 W/m-K ’且邊低熱傳導材料可為相變化材料、氮摻雜相變 化材料、或氧摻雜相變化材料,例如·· GeTe、GeSb、sbTe、 GeSbTe或InGeSbTe。該介電材料ι〇6可以為含矽的化合 0949-A22022TWF(N2);P51950186TW;ph〇elip 1Λ 200845443 物,例如氧化矽或氮化矽。 接著,請參照第2c圖,該複合材料層110進一步被圖 形化以形成一貫孔111,該貫孔111係經由微影技術及蝕 刻製程所得並貫穿該複合材料層n〇,以露出下電極102 的上表面105。該姓刻製程可例如為一乾触刻製程。 接著,請參照第2d圖,形成一相變化材料層112以填 入該貫孔111内。該相變化材料層112可包含In、Ge、Sb、
Te或其組合,例如是GeTe、GeSb、SbTe、GeSbTe或 f InGeSbTe 〇 最後,請參照第2e圖,一上電極114係形成於該複合 材料層110之上並進一步與該相變化材料層112電性連 結。該上電極114的材料可例如為TaN、W、TiN、或TiW。 實施例3: 首先,請參照第3a圖,提供一具有一下電極2〇2之基 板200,且形成有一絕緣層2〇4環繞該下電極2〇2,並露出 該下電極202之上表面2〇5。其中,該基板2⑻可為一半 導體製程所使用之基板,例如切基板。該基板可為 已兀成CMOS月ij段製程的基板,#可能包含隔離結構、 電容、二極體與其類似物,為簡化®I示起見,目中僅以一 平整基板表示。該下電極202係為導電材料,例如為ai、 W、Mo、TiN或Tiw。該絕緣層可以為含石夕的化合物, 例如氧化矽或氮化矽。 接著’請參照第㈣,-相變化材料層212係形成於 0949-A22022TWF(N2);P51950186TW;phoelip Π 200845443 違下電極202之上,並血今 $—上恭朽”電極202電性連結,接著形 成上包極214於該相變化姑极昆。μ 料層m電性μ。12之上並與相變化材
Sh Te 人 邊化材料層212可包含In、Ge、
Sb、Te或其混合,例如异 彳 T r QkT 疋 GeTe、GeSb、SbTe、GeSbTe 或InGeSbTe。該上電極21 ★ T.w…i 妁材枓可例如為TaN、W、TiN、 或TiW。形成該相變化材 π勺人·分成 十層212及该上電極214之方法
;〇〇二,接::成」目變化材料層及-導電層於該基板 料;^ ^ d心技彳;t及軸製程圖形化該相變化材 枓及^層以形成該相變化材料層212及該上電極214圖 开>。 ㈣H ~、第3e圖’介電材料層206及該低熱傳導 材^層208交替的形成於該基板200之上。該複合材料層 ,介電材料及低熱傳導材料之重量比係例如為㈣七。 。亥低,、、、傳$材料2〇8具有—熱傳導係數介於〇」W/m_K至 1 W/m-K ’例如〇.2 W/m_K至〇 3 u,且該低熱傳導 材料可為相變化材料、氮摻雜相變化材料、或氧掺雜相變 化材料,例如:GeTe、GeSb、SbTe、㈣阶或。 該介電材料2〇6可以為切的化合物,例如氧财或氮化 石夕。 、取後’请麥照第3d圖,蝕刻該介電材料層2〇6及低熱 傳導材料層2G8,形成圖形化的介電材料層2_及低熱傳 導材料層208a,以露出該上電極214之上表面及該介電層 2^4之上表面。請參照第4圖,係顯示該第%圖的上視示 思圖’由圖中可知該介電材料層2G6及該低熱傳導材料層 0949-A22022TWF(N2);P51950186TW;phoelip 1? 200845443 208經蝕刻後係形成該複合材料層2i〇 210包含交替相疊的共圓心環狀介電材料層206^f料層 導材料層鳩,並環繞該相變化材㈣2ι =低熱傳 值得=意的是,該介電材料寫形成於該相 =214。 及上電極214之側壁及周圍並與其直 料層212 依據上述,自從需要的焦耳執。 變化記憶體可有效降低操作電壓 ^本“所述之相 操作電壓降低,元件的穩定度可有二掸电流。此外’自從 所述之相變化記憶體之製程相對簡> 曰、σ。再者’本發明 製程,且製程費用相對便宜。 適用於不同之元件 雖然本發明已以較佳實施例揭露 限定本發明,任何熟習此技藝者,在工然其並非用以 和範圍内,當可作些許之更動與潤飾不,離本發明之精神 範圍當視後附之申請專利範圍^界定者本發明之保護 0949-A22022TWF(N2);P51950186TW;phoelip 200845443 【圖式簡單說明】 第la至第le圖係顯示本發明實施例1所述之相變化 記憶體元件的製作流程剖面圖。 第2a至第2e圖係顯示本發明實施例2所述之相變化 記憶體元件的製作流程剖面圖。 第3a至3d圖係顯示本發明實施例3所述之相變化記 憶體元件的製作流程剖面圖。 第4圖係顯示第3d圖之上視示意圖。 f 【主要元件符號說明】 基板〜10 ; 下電極〜12 ; 絕緣層〜14 ; 下電極上表面〜15 ; 介電材料層〜16 ; 低熱傳導材料層〜18 ; 複合材料層〜20 ; 、 貫孔〜22 ; 相變化材料層〜24 ; 上電極〜26 ; 基板〜10 0 ; 下電極〜102 ; 絕緣層〜104 ; 下電極上表面〜105 ; 複合材料層〜110 ; 0949-A22022TWF(N2);P51950186TW;phoelip 14 200845443 介電材料〜106 ; 低熱傳導材料〜10 8, 貫孔〜111 ; 相變化材料層〜112 ; 上電極〜114 ; 基板〜200 ; 下電極〜202 ; 絕緣層〜204 ; f 下電極上表面〜205 ; 相變化材料層〜212 ; 上電極〜214, 介電材料層〜206 ; 低熱傳導材料層〜208 ; 圖形化的介電材料層〜206a, 圖形化的低熱傳導材料層〜208a,以及 該複合材料層〜210。 0949-A22022TWF(N2) ;P51950186TW;phoelip 15

Claims (1)

  1. 200845443 十、申請專利範園: h一種相變化記憶體,包含: 一複合材料層包含一介電 -貫孔形成於該複合材料層:::低熱傳導材料·’ -相變化材料形成於 2.如申請專利範圍第i項所=該貫孔内。 該低熱傳導材料具有^相變化記憶體,其中 W/m_K。 、¥係數;ι 於 〇·1 W/m_K 至 1 3·如申請專利範圍第1 該介電材料包含氮切:处之相變化記憶體,其中 4如申往直剎一 平b矽、或其混合。 4·如曱明專利範圍第丨 口 該低熱傳導材料包含相變化材^述之相變化記憶體,其中 5·如申請專利範圍第^ ^ 該低熱傳導材料包含、处之相變化記憶體,其中 ⑽專“圍tr?變化材料。 該低熱傳導材料包含氧摻力員所述之相變化記憶體,其中 7.如申請專利範圍第=:目變化材料。 該複合材料層包含交替相#、所述之相變化記憶體,其中 層。 A的介電材料層及低熱傳導材料 8·如申請專利範圍第7工 該介電材料層的厚度至小員所述之相變化記憶體,其中 ^ ^ 夕為3 nm 〇 9·如申請專利範圍第7工 該低熱傳導材料層的厚度至1所述之相變化記憶體,其中 10·如申請專利範圍第7為3 nm。 項所逑之相變化記憶體,其中 0949-A22022TWF(N2) ;P51950186TW;ph〇elip 200845443 該複合材料層至少包含一層介電材料層及一低熱傳導材料 〇 11. 如申請專利範圍第1項所述之相變化記憶體,其 中該複合材料層包含由介電材料及低熱傳導材料混合所得 之膜層。 12. 如申請專利範圍第11項所述之相變化記憶體,其 中該複合材料層之介電材料及低熱傳導材料之重量比係為 1:10 〜1:1 〇 Γ 13.如申請專利範圍第1項所述之相變化記憶體,其 中該複合材料層包含交替相疊的共圓心環的介狀電材料層 及低熱傳導材料層,並環繞該貫孔。 14. 如申請專利範圍第13項所述之相變化記憶體,其 中該介電材料形成於該貫孔周圍並與其直接接觸。 15. —種相變化記憶體,包含: 一基板; 一電極形成於該基板上; 、 一複合材料層形成於該基板之上’其中該複合材料層 包含一介電材料及一低熱傳導材料; 一貫孔貫穿該複合材料層;以及 一相變化材料形成於該至少一部份之貫孔内並與該電 極電性連結。 16. 如申請專利範圍第15項所述之相變化記憶體,其 中該低熱傳導材料具有一熱傳導係數介於〇·1 W/m-K至1 W/m-K之間。 0949-A22022TWF(N2);P51950186TW;phoelip 17 200845443 17. 如申請專利範圍第15項所述之相變化記憶體,其 中該低熱傳導材料包含相變化材料、氮摻雜相變化材料或 氧摻雜相變化材料。 18. 如申請專利範圍第15項所述之相變化記憶體,其 中該複合材料層包含交替相疊的介電材料層及低熱傳導材 料層。 19. 如申請專利範圍第15項所述之相變化記憶體,其 中該複合材料層包含由介電材料及低熱傳導材料混合所得 之膜層。 20. 如申請專利範圍第15項所述之相變化記憶體,其 中該複合材料層包含交替相疊的共圓心環的介狀電材料層 及低熱傳導材料層,並環繞該貫孔。 0949-A22022TWF(N2);P51950186TW;phoelip 18
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