SU736176A1 - Ferrite matrix testing device - Google Patents
Ferrite matrix testing device Download PDFInfo
- Publication number
- SU736176A1 SU736176A1 SU752104710A SU2104710A SU736176A1 SU 736176 A1 SU736176 A1 SU 736176A1 SU 752104710 A SU752104710 A SU 752104710A SU 2104710 A SU2104710 A SU 2104710A SU 736176 A1 SU736176 A1 SU 736176A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- unit
- control unit
- ferrite
- inputs
- monitoring
- Prior art date
Links
Landscapes
- Tests Of Electronic Circuits (AREA)
Description
1one
Изобретение относитс к вычислительной технике и предназначено дл контрол ферритовых матриц.The invention relates to computing and is intended to control ferrite matrices.
Известно устройство дл контрол запоминаюидах матриц оперативной пам ти, содержащее блок управлени , блок регистра адреса, блок дешифраторов, прижимное приспособление дл провер емой ферритовой матрицы, блок контрол , блок усилителей считывани , формирователи тока 1.A device for controlling memory matrices of a RAM, comprising a control unit, an address register unit, a decoder unit, a pressure device for a tested ferrite matrix, a control unit, a read amplifier unit, current drivers 1, is known.
Наиболее близким техническим решением к изобретению вл етс устройство, которое содержит блок управлени , соединенный с регистрами адреса, дешифраторами, усилител ми считывани , блоком сравнени , блоком многокаскадных генераторов тока, коммутаторами и блоком выполнени диагностических тестов, и шаблон дл контролируемой ферритовой матрицы, соединенный с коммутаторами и усилител ми считывани 2.The closest technical solution to the invention is a device that contains a control unit connected to address registers, decoders, read amplifiers, a comparison unit, a multi-stage current generator unit, switches and a diagnostic test unit, and a pattern for a controlled ferrite matrix connected to switches and read amplifiers 2.
Однако отсутствие автоматической р ггистрации результатов контрол снижает быстродей ствие и надежность этого устройства, кроме того, оно позвол ет определить область хранени информации (ОХИ) контролируемых фсрритовых матриц только по четырем точкам , что снижает качество проверки матриц.However, the lack of automatic monitoring of the control results reduces the speed and reliability of this device; in addition, it allows determining the information storage area (NCI) of monitored fsrrit matrices by only four points, which reduces the quality of the matrix checks.
Целью изобретени вл етс повышение быстродействи и надежности устройства.The aim of the invention is to increase the speed and reliability of the device.
Это достигаетс тем, что устройство дл контрол ферритовых матриц содержит блок задани и анализа режимов, входы которого соединены с выходом блока выполнени диагностических тестов и блока сравнетш , а вы10 ходы - с входами многокаскадных генераторов тока и блока управлени , и блок регистрации результатов контрол , входы которого подключены к выходам регистра адреса блока управлени , блока сравнени , блока выполне15 ни диагностических тестов и к второму выходу блока задани и анализа режимов, а выход соединен с регистрируюцим прибором.This is achieved by the fact that the device for monitoring ferrite matrices contains a block for setting and analyzing modes, the inputs of which are connected to the output of the diagnostic test execution unit and the comparison unit, and the outputs are connected to the inputs of the multi-stage current generators and the control unit, and the control result recording unit, the inputs which are connected to the outputs of the register of the address of the control unit, the comparator unit, the unit performing 15 diagnostic tests and to the second output of the task setting and mode analysis, and the output is connected to the registering device rum.
На чертеже представлена блок-схема устройства .The drawing shows the block diagram of the device.
2020
Она содержит блок управлени 1, регистрирующий прибор (РП) 2, блок 3 регистрации результатов контрол , регистры адреса 4, дешифраторы 5, блок 6 выполнени диагности есКих тестов, коммутаторы 7, 1иаблои 8, б/юк 9 задани и анализа режимов, многокаскадные генераторы токов 10, усилители П считывани ., блок 12 сравнени .It contains a control unit 1, a registering device (RP) 2, a unit 3 for recording control results, an address register 4, a decoder 5, a unit 6 for performing diagnostics of most tests, switches 7, 1 and set 8, b / w 9 for setting and analyzing modes, multi-stage generators currents 10, amplifiers P readout., unit 12 comparison.
Устройство работает следующим образом. При определении области хранени информаили (ОХ матриц оператор на панели управлени уста авливает граничные значени токов, программу проверки, вид диапюстических тестов, вид области (полна или частична ОХИ), способ вывода результатов проверки {автоматическа печать или ручна запись) и производит пуск . устройства.The device works as follows. When determining the storage area of information (OX matrices, the operator on the control panel sets the current boundary values, the test program, the type of diapetic tests, the type of area (full or partial OKHI), the method of displaying the test results {automatic printing or manual recording) and starts. devices.
: При этом блок управлени 1 вырабатывает все необходимые сигналь запуска регистров адреса 4, дешифраторов 5, блока 3 регистраЦни результатов контрюл (если он включен) блока 6 выполнени диапгостических тесгов и блока 9 задани и анализа режимов. В: At the same time, the control unit 1 generates all the necessary signal for triggering the address registers 4, decoders 5, block 3 of the registering results of the control (if enabled) of unit 6 for performing diagstic tests and unit 9 for setting and analyzing modes. AT
Зависимости от заданного режима работь мен етс уровень в блоке 9 задани и анализа режимов.Depending on the set operation mode, the level changes in block 9 of setting and analyzing the modes.
первый уровень - при выполнении рзчного режима проверки;the first level - when performing rzchny mode of verification;
второй уровень - при выполнении автоматического режима сн ти (определени ) част№1ной области по четырем точкам;the second level - when performing the automatic mode of removal (determination) of the partial area on four points;
третий уровень - при выполнении авгомашческого режима сн ти (определени ) полной области во всем диапазоне изменени токов.the third level is when performing the Augomash mode of removing (determining) the full area in the whole range of current variation.
При сн тии частичной ОХИ матриц по сигналу с блока управле1 и блок 9 задани ы аттализа режимов переходит во второр организацио1П ый уровень, в нем вырабатываютс коды, определ ющие значение токов дл каждой из 4-х точек и последовательность их выполнени . Значени этих кодов поступают на многокаскадные генераторы тока 10, При а1 тии полной ОХИ блок 9 задани и анализа режимов переходит в третий организащотнный уровень, при этом производитс запуск многокаскадных генераторов тока 10 и через коммутаторы 7, в соответствии с адресом зап минающей чейки, в контролируемую матрицу установленную на шаблоне 8, поступают импупьсы адресных и разр дных токов, соответствующие номш)альным значени м. Одновременно в блоке 9 задани и анализа режимов по сигналу из блока 6 выполнени диагностических тестов производитс анализ вьшолнели программы при номинальных значени х токов и запись соответствующей информаиди (диагностического теста), Далее, в соответствии с программой и способом сн ти области (ОХИ), запоминаетс код, соответствующий максимальному значению тока, при этом код номинального значени тока остаетс . Адресный ток соответствует максимальному значению, а разр дный ток уменьшаетс с Дискретностью, установленной на панели В каждом шаге изменени разр дного тока (при посто нном адресном) блок 9 анализирует информацию, поступающ ю с запоминающих чеек провер емой матрицы.When the partial OXI matrices are removed by a signal from the control unit and unit 9, the tasks of modalization of modes go to the second organizational level in the second, it produces codes defining the value of currents for each of the 4 points and the sequence of their execution. The values of these codes are sent to the multi-stage current generators 10. When the full NCI is completed, the unit 9 assigns and analyzes the modes to the third organizational level, this starts the multi-stage current generators 10 and through the switches 7, according to the address of the memory cell, to the controlled the matrix installed on template 8 receives impulses of address and discharge currents corresponding to the nominal values. At the same time, in block 9 of the task and analysis of modes by a signal from block 6 of diagnostic tests the program is analyzed at the nominal current values and the corresponding information is recorded (diagnostic test). Further, the code corresponding to the maximum current value is stored in accordance with the program and area removal method (NCI), while the code of the nominal current value remains. The address current corresponds to the maximum value, and the discharge current decreases with the resolution set on the panel. At each step of changing the discharge current (at a constant address), block 9 analyzes information coming from the storage cells of the matrix under test.
Если поступают ошибки из блока сравнеffflH 12, характеризующие, что данное значение тока лежит за пределами устойчивой области хранени информации (УОХИ), то в блоке вырабатываютс сигналы дд дальнейшего обхода области. Затем при максимальном 31 ачении адресного тока происходит возрастание разр дного тока до максимального с установленной дискретностью. В каждом шаге изменени тока блок 9 анализирует информа1ЩЮ с провер емой матрицы, выдел (если есть) значение токов, соответствующих УОХИ.If there are errors from the unit compared to effl 12, characterizing that the current value lies outside the sustainable information storage area (UIH), then the unit produces signals dd for further bypassing the region. Then, at the maximum of the address current, the discharge current increases to the maximum with a fixed resolution. At each step of changing the current, block 9 analyzes the information from the matrix being checked, highlighting (if any) the value of the currents corresponding to the UHI.
После того, как закончитс один полн1:.ш шаг автоматического программного изменени и форл-шровани токов, то начинает выполн тьс второй и т.д. полный шаг с той лишь раз{шцей , что адресный ток уменьшаетс после каждого полного шага изменени разр длого тока на ту же дискретность, установленную -с панели управлени .After one full1: .shift step of automatic program change and for-shirovaniya currents, then the second begins, and so on. full step with the only time that the address current decreases after each full step of changing the discharge current by the same resolution as the -c control panel.
Процесс вьшолнени полных шагов автоматического программного изменени токов, обеспечивающий сн тие полной УОХИ и ее реально существующей геометрической формы, выполн етс до услови соответстви минимгум адресного тока в УОХИ. На этом процесс сн ти (определени ) ОХИ заканчиваетс .The process of executing the full steps of automatic programmatic change of the currents, ensuring the removal of the full WALP and its actually existing geometrical shape, is carried out before the condition that the minimum of the address current in the WALER is matched. This completes the OHS determination process.
Как в случае сн ти частичтюй, так и полной зоны, код с блока 9 задани и анализа режимов поступает на многокаскадные генераторы тока 10, формирующие по коду адресный и разр дный ток, который через коммутаторы 7 действует на ферриты (запом1шающие чейки) провер емой матрицы. После усилени сигналов с провер емой матрицы ус1и1ител ми считывани И и анализа их блоком сравнени 12 обеспечиваетс обратна св зь в устройстве, благодар которой существует возможность иметь информацию о значении токов, амплитуде и форме считанного сигнала, характере ошибок с ферритов провер емой матрицы адресов сбоев, диагностическом тесте и программе проверки.As in the case of part and full zone removal, the code from the task setting and mode analysis unit 9 goes to the multi-stage current generators 10, which form the address and discharge current by code, which through the switches 7 acts on the ferrites (storing cells) of the tested matrix . After amplifying the signals from the checked matrix with readout AND sensors and analyzing them by the comparator unit 12, feedback is provided in the device, thanks to which it is possible to have information about the value of currents, amplitude and shape of the read signal, the nature of errors from the ferrites of the fault address matrix being tested, diagnostic test and verification program.
При автоматической регистрации обеспечиваетс вывод всей необхо{шмой информации о значении токов, адресов сбоев и геометрической формы УОХИ на регистрирующий прибор 2.With automatic registration, it is provided that all the necessary information on the value of currents, addresses of malfunctions and the geometric shape of UHI is provided to a recording device 2.
Claims (2)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU752104710A SU736176A1 (en) | 1975-02-14 | 1975-02-14 | Ferrite matrix testing device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU752104710A SU736176A1 (en) | 1975-02-14 | 1975-02-14 | Ferrite matrix testing device |
Publications (1)
Publication Number | Publication Date |
---|---|
SU736176A1 true SU736176A1 (en) | 1980-05-25 |
Family
ID=20609943
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU752104710A SU736176A1 (en) | 1975-02-14 | 1975-02-14 | Ferrite matrix testing device |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU736176A1 (en) |
-
1975
- 1975-02-14 SU SU752104710A patent/SU736176A1/en active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR19990013738A (en) | IC test apparatus and method | |
SU736176A1 (en) | Ferrite matrix testing device | |
JPH1130653A (en) | Lsi failure automatic analyzer and analyzing method thereof as well as storage medium stored with program to have its method executed by computer | |
SU926620A1 (en) | Device for quality control of man-machine system | |
JPS6232559B2 (en) | ||
SU577529A1 (en) | Object monitoring system | |
SU519766A1 (en) | Device for controlling ferrite matrices of RAM | |
RU2133479C1 (en) | Method for proximate diagnostics of multichannel digital units | |
SU729482A1 (en) | Device for diagnosis of service lofe of mechanisms and machines | |
SU888211A1 (en) | Rapid-access unit testing device | |
SU875468A1 (en) | Storage matrix testing device | |
SU453674A1 (en) | SYSTEM OF AUTOMATIC CONTROL OF OPERATOR PARAMETERS IN THE CONTROL CIRCUIT | |
SU894556A1 (en) | Multi-channel device for determination of developing crack coordinates | |
JPH08201125A (en) | Measuring apparatus | |
JPS59108955A (en) | Multiprobe-coil multifrequency eddy current type flaw detector | |
SU1194131A1 (en) | Bench for determining the overheating of turbine blade from value of internal friction | |
SU1578765A1 (en) | Digital measuring system for checking parameters of tape recorders | |
SU815967A1 (en) | Device for automatic monitoring of quality parameters of television channels | |
SU531058A1 (en) | Device for controlling the destruction of the sample | |
SU640266A1 (en) | Pulse transmission monitoring device | |
SU792258A1 (en) | Test diagnosis apparatus | |
SU858071A1 (en) | Device for evaluating skillness of operators of automated control system | |
SU1486907A1 (en) | Eddy-current flaw detector | |
SU1610422A1 (en) | Testing complex for microprocessor instruments of nondestructive inspection | |
SU877382A1 (en) | Device for testing instrument functioning under dynamic loads |