SU1649550A1 - Устройство дл контрол логических блоков - Google Patents
Устройство дл контрол логических блоков Download PDFInfo
- Publication number
- SU1649550A1 SU1649550A1 SU884378018A SU4378018A SU1649550A1 SU 1649550 A1 SU1649550 A1 SU 1649550A1 SU 884378018 A SU884378018 A SU 884378018A SU 4378018 A SU4378018 A SU 4378018A SU 1649550 A1 SU1649550 A1 SU 1649550A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- output
- group
- trigger
- inputs
- Prior art date
Links
Landscapes
- Logic Circuits (AREA)
Abstract
Изобретение относитс к вычислительной технике и может быть использовано дл контрол логических блоков и схем, при приемосдаточных испытани х. Целью изобретени вл етс упрощение устройства и сокращение времени контрол однотипных логических блоков. С этой целью в устройство , содержащее генератор тактовых импульсов , два элемента И, счетчик тактовых импульсов, первый триггер и блок индикации , введены группа из п элементов ИЛИ, группа из п элементов И, группа сумматоров по модулю два, элемент ИЛИ и второй триггер. 1 ил.
Description
Изобретение относитс к вычислительной технике и может быть использовано дл контрол логических блоков и схем при приемосдаточных испытани х.
Целью изобретени вл етс упрощение устройства и сокращение времени контрол однотипных логических блоков.
На чертеже показана структурна схема устройства дл контрол логических блоков.
Устройство дл контрол логических блоков содержит генератор 1 тактовых импульсов , первый и второй элементы И 2 и 3, счетчик 4 тактовых импульсов, группу контролируемых логических блоков 5, группу элементов ИЛИ 6, группу элементов И 7, группу сумматоров 8 по модулю два, элемент ИЛИ 9, первый и второй триггеры 10 и 11, блок 12 индикации и имеет вход 13 запуска устройства.
Выход генератора 1 тактовых импульсов соединен с первым входом элемента 2, выход которого соединен со счетным входом счетчика 4, выходы которого соединены
со входами группы контролируемых логических блоков 5 и входами элемента 3. Выход элемента 3 соединен со входом установки в нулевое состо ние триггера 10, вход установки в единичное состо ние которого вл етс входом 13 запуска устройства, а инверсный и пр мой выходы триггера 10 соединены соответственно с первым входом блока 12 индикации и вторым входом элемента 2. Первые выходы контролируемых логических блоков 5 группы соединены со входами первых элементов 6 группы и элементов группы, выходы которых соединены со входами первого сумматора 8 группы сумматоров по модулю два. Вторые выходы контролируемых логических блоков 5 группы соединены со входами второго сумматора 8 группы сумматоров по модулю два и т.д., а выходы сумматора 8 соединены со входами элемента 9, выход которого соединен со входом установки в единичное состо ние триггера 11. Инверсный и пр мой выходы триггера 11 соединены соотаетст (Л
С
о
о ел ел о
венно с третьим входом элемента 2 и вторым входом блока 12 индикации.
Устройство работает следующим образом .
В исходном состо нии счетчик 4 тактовых импульсов, триггеры 10 и 11 наход тс в нулевом состо нии, на блоке 12 индикации светитс транспарант Конец контрол (цепи установки устройства в исходное состо ние не показаны).
При подаче на вход 13 устройства импульса запуска триггер 10 устанавливаетс в единичное состо ние, При этом гаснет транспарант Конец контрол на блоке 12 индикации и единичный сигнал с пр мого выхода триггера 10 поступает на второй вход элемента 2. разреша поступление импульсов с генератора 1 на счетный вход счетчика 4. С выходов счетчика 4 на входы группы контролируемых логических блоков 5 начинают поступать комбинации входных сигналов, которые одновременно поступают на входы элемента 3. Сигналы с выходов группы контролируемых логических блоков 5 поступают на входы элементов б и элементов 7. Причем на входы первых элементов 6 и элементов 7 поступают сигналы с первых входов контролируемых логических блоков 5 группы, на входы вторых элементов 6 и элементов 7 поступают сигналы со вторых выходов контролируемых блоков 5 группы и т.д.. С выходов первых элементов 6 и элементов 7 сигналы поступают на входы первого сумматора 8, с выходов вторых элементов 6 и элементов 7 сигналы поступают на входы второго сумматора 8 и т.д.
При обнаружении неисправности одного или нескольких контролируемых логических блоков 5 группы на каком-либо такте контрол на соответствующие входы одного или нескольких сумматоров 8 поступают разнотипные сигналы (1, О или О, 1), которые приведут к по влению единичного сигнала на выходе элемента 9, который переключит триггер 11 в единичное состо ние. При этом единичный сигнал с пр мого выхода триггера 11 поступит на второй вход блока 12 индикации и приведет к загоранию транспаранта Неисправность, а нулевой сигнал с инверсного выхода этого же триггера поступит на третий вход элемента 2 и запретит прохождение тактовых импульсов с выхода генератора 1 и на вход счетчика 4. После этого процесс контрол прекращаетс .
При отсутствии неисправностей в группе контролируемых логических блоков 5 с выходов сумматоров 8 будут поступать нулевые сигналы на входы элемента 9, которые не приведут к переключению в
единичное состо ние триггера 11. В этом случае при поступлении с выходов счетчика 4 последней комбинации (1,1,11) на выходе элемента 3 по витс единичный сигнал,
который установит триггер 10 в нулевое состо ние . При этом нулевой сигнал с пр мого выхода триггера 10 поступит на второй вход элемента 2 и запретит прохождение тактовых импульсов с выхода генератора 1 на
вход счетчика 4.
Одновременный единичный сигнал с инверсного выхода триггера 10 поступит на первый вход блока 12 индикации и приведет к загоранию транспаранта Конец контрол .
Claims (1)
- Формула изобретени Устройство дл контрол логических блоков, содержащее генератор тактовыхимпульсов, два элемента И, счетчик тактовых импульсов, первый триггер и блок индикации , причем первый и второй входы и выход первого элемента И соединены соответственно с выходом генератора тактовыхимпульсов, пр мым выходом триггера и счетным входом счетчика тактовых импульсов , выход которого подключен ко входам второго элемента И и вл етс выходом устройства дл подключени ко входам контролируемых логических блоков, а установочный вход, вход сброса и инверсный выход триггера соединены соответственно со входом запуска устройства, выходом второго элемента И и первым входом блокаиндикации, отличающеес тем, что, с целью упрощени устройства и сокращени времени контрол однотипных логических блоков, оно содержит группу из п элементов ИЛИ, группу из п элементов И,группу из п сумматоров по модулю два (где п - число выходов контролируемых логических блоков),элемент ИЛИ и второй триггер, при этом 1-е входы j-ro элемента ИЛИ группы и j-ro элемента И группы (1 i m, 1j п, где m - количество контролируемых логических блоков) образуют вход устройства дл подключени к j-y выходу i-ro контролируемого , логического блока, первый и второй входы и выход j-го сумматора по модулю два группы соединены соответственно с выходом j-ro элемента ИЛИ группы, выходом i-ro элемента И группы и j-м входом элемента ИЛИ, выход которого подключен к установочному входу второго триггера, авход сброса, пр мой и инверсный выходы второго триггера соединены соответственно со входом начальной установки устройства , вторым входом блока индикации и третьим входом первого элемента И.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU884378018A SU1649550A1 (ru) | 1988-02-10 | 1988-02-10 | Устройство дл контрол логических блоков |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU884378018A SU1649550A1 (ru) | 1988-02-10 | 1988-02-10 | Устройство дл контрол логических блоков |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1649550A1 true SU1649550A1 (ru) | 1991-05-15 |
Family
ID=21355513
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU884378018A SU1649550A1 (ru) | 1988-02-10 | 1988-02-10 | Устройство дл контрол логических блоков |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1649550A1 (ru) |
-
1988
- 1988-02-10 SU SU884378018A patent/SU1649550A1/ru active
Non-Patent Citations (1)
Title |
---|
Авторское свидетельство СССР Ыг 830392, кл. G 06 F 11/26, 1979. Авторское свидетельство СССР № 1049913,кл.G 06 F 11/26.1983. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU1649550A1 (ru) | Устройство дл контрол логических блоков | |
US4379993A (en) | Pulse failure monitor circuit employing selectable frequency reference clock and counter pair to vary time period of pulse failure indication | |
SU1231504A1 (ru) | Устройство дл контрол логических блоков | |
SU1037257A1 (ru) | Устройство дл контрол логических блоков | |
SU1619276A1 (ru) | Устройство дл оперативного контрол цифровых блоков | |
SU1287118A1 (ru) | Устройство дл поиска неисправностей | |
SU1520526A1 (ru) | Устройство дл контрол схем сравнени | |
SU955148A1 (ru) | Устройство дл контрол исправности нагрузочных цепей | |
SU1183972A1 (ru) | Устройство дл имитации отказов дискретной аппаратуры | |
SU1091167A1 (ru) | Устройство дл контрол источника последовательности импульсов | |
SU811315A1 (ru) | Устройство дл индикации | |
SU1450974A1 (ru) | Устройство контрол работы автоматической линии | |
SU1070562A1 (ru) | Устройство дл контрол логических блоков | |
SU1378054A1 (ru) | Делитель частоты следовани импульсов | |
SU1354195A1 (ru) | Устройство дл контрол цифровых узлов | |
SU849490A1 (ru) | Устройство функциональногоКОНТРОл дВОичНыХ СчЕТчиКОВ | |
SU1167574A1 (ru) | Электронное временное устройство с обнаружением отказов | |
SU1656540A1 (ru) | Устройство дл тестировани цифровых блоков | |
SU1578714A1 (ru) | Генератор тестов | |
SU1175022A1 (ru) | Устройство дл контрол серий импульсов | |
SU1167585A1 (ru) | Устройство дл программного управлени | |
SU1228140A1 (ru) | Устройство дл индикации | |
SU1185600A1 (ru) | Управляемый делитель частоты | |
SU1725388A1 (ru) | Двоичное пересчетное устройство с контролем | |
SU1191887A1 (ru) | Устройство дл контрол элементов индикации |