SU1339546A1 - Операционное устройство с самоконтролем - Google Patents
Операционное устройство с самоконтролем Download PDFInfo
- Publication number
- SU1339546A1 SU1339546A1 SU864026471A SU4026471A SU1339546A1 SU 1339546 A1 SU1339546 A1 SU 1339546A1 SU 864026471 A SU864026471 A SU 864026471A SU 4026471 A SU4026471 A SU 4026471A SU 1339546 A1 SU1339546 A1 SU 1339546A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- group
- elements
- input
- inputs
- output
- Prior art date
Links
Landscapes
- Hardware Redundancy (AREA)
Abstract
Изобретение относитс к автоматике и вычислительной технике и может быть использовано при создании устройств дл обработки цифровых данных. Цель изобретени - повышение достоверности контрол устройства Устройство содержит шину 2 контрольной ин33 п (Л СлЭ 00 СО ел 35
Description
формации, злемеичъ If 3,-3i 1 ервой группы, элементы И BTopof i труп пы, настроечный вход 5, управл ющий вход 6, элементы Ш1И 7,,-7, первой группы , арифметические блоки 8,-8 , второй информационный вход 9 второй информационный выход 10, адресный вход 11, шину 12 ввода тестовой информации , элементы И 13,-135 третьей группы, элементы И K,-14a, четвертой группы, элементы НЕ первой группы, элементы И 16,-16, п той группы, элементы И 17,-17, шестой
1
Изобретение относитс к автоматике и вычислительной технике и может быть использовано при построении устройств дл обработки цифровых данных„
Цель изобретени - повышение достоверности контрол устройства о
На фиг,,1 представлена блок-схема предлагаемого устройства; на фиг,2 - блок-схема арифметического блока; на фиг,3 - формат команды; на фиг о 4 и 5 - временные диаграммы работы узлов синхронизации арифметического блока; на фигоб - зависимость досто- верности косвенного контрол от степни коррелированности отказов и числа контрольных элементов с,
Устройство состоит из модул .1,
выполненного в виде кристалла интегральнои схемы, который содержит шину 2 контрольной информации, элементы И 3 -3 первой групш 1 и 4( - 4, второй группы, настроечный 5 и управл ющий 6 входы, элементы ИЛИ 7, -7з первой группы, арифметическ е блоки 8,-85 второй информационный вход 9 и второй информационный выход 10, адресный вход 11, 01ину 12 ввода тестовой информации, элементы И 3,-13j третьей группы и 14, - 14 ;j четвертой группы, элементы НЕ 15, -15.
первой группы, элементы И 16, -165 п той группы и 17, -17, шестой группы, элементы НЕ 18, -18 второй группы, а также элеменпч И 19,-19, седьмой т руппы, группа элементов 20,-20} сравнени , элемент
j4S:jh
I pyiiiibi, jJieMCHTbi ИР. 8,-18.5 нторой группы, элементы И 19,-19 седьмой группы, группу элементов 7.0 -20, сравнени , элемент И 21, второй элемент ШШ 22, первый управл ющий вход 23, четвертый элемент ИЛИ 24, третий элемент Ш1И 25, второй управл ющий выход 26, элементы НЕ , третьей группы, элементы И 28,-28, восьмой группы, эле.менты И 29,-29 третьей группы, элемент сравнени 30, элементы ИЛИ 31,-31, второй группы, мажоритарный элемент 32. 6 ил„
5
0
5
Ь
И 21 , второй элемент ИЛИ 22, первый управл ющий выход 23, четвертый 24 и третий 25 элементь ИЛИ, второй управл ющий вход 26, элементы НЕ 27.) - 27 третьей . группы, элементы И 28, -28 восьмой группы и 29 29j дев той группы, элементы 30 ср авне- ни , элементы ИЛИ 31, -31, второй группы, мажоритарный элемент 32, первый элемент ИЛИ 33, настроечные входы 34,35,-35,; 36, -36,; 37,- 37,; 38,-38,,
Арифметический блок содержит . (фиГ(,2) первый предварительный регистр 39 данных, первый регистр 40 данных, первый элемент И 41, регистр 42 адреса, второй элемент И 43, первый регистр 44 результата, первый 45 и второй 46 узлы синхронизации, третий элемент И 47, универсальный ком- бинационньй сумматор 48, четвертый элемент И 49, второй регистр 50 ре- зультата, второй предварительный регистр 51 данных, второй регистр 52 данных, п тый элемент И 53, запоминающее устройство (ЗУ) 54 тестовых программ, закольцованные сдвигающие регистры 55,-55 с последовательной .выдачей, шестой элемент И 56, одноразр дный регистр 57 признака, регистр 58 кода операции, первый элемент ИЛИ 59, седьмой элемент И 60, трехразр дный регистр 61 признака, элемент НЕ 62, регистр 63 команды, элемент 64 сравнени , регистр 65 номера арифметического блока. При этом
входы арифметического блока 8 подключены к информационным входам регистра 39, управл ющий вход которого подключен к управл ющему входу регистра 51 и выходу узла 45 синхронизации , информационные выходы регистров 39 и 51 подключены к информационным входам регистров АО и 52 соответственно , а управл ющие выходы регистров 39 и 51 - соответственно к первому и второму входам узла 46 синхронизации,.выход которого подклчен к управл ющим входам регистров 40 и 52, к тактируюпщм входам ре- гистров 55,-55 ЗУ 54 и первому входу элемента И 47, второй вход которого подключен к выходу одноразр дного регистра 57, а выход - к управл ющему входу регистра 58, выходы которого подключены к управл ющим входам комбинационного сумматора 48, первые и вторые входы операндов которого подключены к выходам элементов И 41 и 53 соответственно, причем первые входы элементов И 41 и 53 подключены соответственно к выходам регистров 40 и 52, а их вторые входы - к первым и вторым выходам регистра 61, при этом первый выход последнего подключен к первому входу элемента И 43, первому входу узла 45 синхронизации и третьему входу узла А6 синхронизации, второй выход этого регистра - к первому входу элемента И 49, к второму входу узла 45 синхронизации и к четвертому входу узла 46 синхронизации, вторые входы элеметов И 43 и 49 подключены к информационному выходу комбинационного сумматора 48, который также подключен к регистру 42 адреса, соединенному с выходом 10 арифметического блока, а их выходы - к входам регистров 44
И 50 соответственно, управл ющие выходы которых подключены к третьему и соответственно четвертому входам узла 45 синхронизации, а информационные - к соответствующим информационным выходам арифметического блока 8, при этом управл ющий вход регистра 42 подключен к первому выходу регистра 63, второй выход которого подключен к входу регистра 61, третий вы45
50
Поле НЭ служит дл указани номера арифметического блока, дл , которого предназначаетс данна команда Поле КОП используетс дл задани кода операции, на выполнение которой настраиваетс данный арифме.Г тический блок. Список возможных операций , на выполнение которых может быть настроен арифметический блок, включает операции пересылок, арифметические , логические и разовые операции, операции условных переходов . Поле ПС используетс дл управлени подачей сигналов начала выполнени операций. При ненулевом значении ПС выполнение операций начинаетс после окончани записи операндов на выходные регистры 40 и 52 при наличии сигнала разрешени , который вл етс дл комбинационного сумматора 48 синхронизирующим
При ненулевом значении ПС синхронизирующий сигнал игнорируетс , Поле
ход которого подключен к первому вхо- 55 используетс дл задани характера ду элемента И 60 и входу элемента обмена следующим образом:
5
10
20
ig 339546
НЕ 62, выход которого подключен к первому вх оду элемента И 56, второй вход которого подключен к выходам сдвигающих закольцован1а1х регистров 55,-554 и ЗУ 54, а выход - к первому входу элемента ИЛИ 59, выход которого подключен к входу регистра 58, а второй вход - к выходу элемента И 60, второй вход которого подключен к третьему выходу регистра 63, четвертый выход которого подключен к входу одноразр дного регистра 57, причем информационный вход регистра 63 подключен к входу 34 и первому входу элемента 64, второй вход которого подключен к выходу регистра 65, а выход - к управл ющему входу регистра 63, информационные входы регистров 55(-554 блока 54 подключены к вхо- ДУ 12о
Формат команды () предусматривает п ть полей: НЭ - поле номера арифметического блока 8, КОП - код
25 операции, ПС - поле запрета (разрешени ) сигналов начала операции, на выполнение которой настроен данный арифметический блок, ПВ - поле выбора, А - адресное поле, ПК - поле коммутации .
30
Поле НЭ служит дл указани номера арифметического блока, дл , которого предназначаетс данна команда Поле КОП используетс дл задани кода операции, на выполнение которой настраиваетс данный арифме.Г тический блок. Список возможных операций , на выполнение которых может быть настроен арифметический блок, включает операции пересылок, арифметические , логические и разовые операции, операции условных переходов . Поле ПС используетс дл управлени подачей сигналов начала выполнени операций. При ненулевом значении ПС выполнение операций начинаетс после окончани записи операндов на выходные регистры 40 и 52 при наличии сигнала разрешени , который вл етс дл комбинационного сумматора 48 синхронизирующим
При ненулевом значении ПС синхронизирующий сигнал игнорируетс , Поле
в
1339546
, операци выполн етс с
использованием адресного пол ;
101, операци выполн етс с использованием коммутационного пол ;
111, операци выполн етс с использованием адресного и . комм утационного полей;
100, разовые операции (тестовые команды)о
Адресное поле используетс дл задани адреса при выполнении адресных командо
Поле коммутации ПК используетс дл коммутации арифметического блока в модуле операционного устройства с В этом поле задаютс сигналы, которые при расшифровке команды поступают на входы 35,-38,; ,; 35з-38з.
Устройство работает следующим образом .
Перед началом работы на вход 5 операционного устройства подаютс управл ющие сигналы и команды,, соответствующие программе выполнени функции f, о В случае использовани косвенного контрол модул операционного устройства на вход 6 устройства подаетс сигнал О, С помощью управл ющих сигналов.
,;
поступающих на 34
вхо ды 34|-37, , - j,, t, операционном устройстве происходит выделение контрольных и рабочих арифметических блоков. Коммутации рабочих арифметических блоков 8 операционного устройства также определ ютс -управл ющими cигнaлa И, посту- пгуощимн на входы 35,-38,; .; , В таблиде даны знач ени управл ющих сигналов, подаваемых на эти входы дл выделени конт- рольных и рабочих арифметических блоков модул 1 и задани режима боты рабочих арифметических блоков (параллельный или последовательный) , Контрольные арифметические блоки не- пользуютс дл косвенного контрол модул , так как наличие коррел ционных св зей между отказами различных долей кристалла модул делает возможным применение косвенного контрол
I
При контроле модул соответствующи;е контролыше арифметические блоки 8 используютс дл выполнени тесто
I
вой программы. На вход 2 подаетс
контрольна информаци , котора через соответствующие элементы И 3 и ИЛИ 7 поступает на вход арифметического блока 8, вл ющегос контрольным дл модул данного операционного устройства С выхода контрольного арифметического блока 8 информаци через соответствующие элементы И 13 и ИЛИ 17 попадает на вход элемента 20 сравнени , на другой вход которого с входа 2 через элемент И 19 также поступает контрольна информаци , В случае совпадени информации данный модуль расцениваетс как исправный, и с пр мого выхода элемента 20 сравнени выдаетс 1, а с инверсного - О, В состо нии исправности на входы элемента И 21 поступает 1, котора через элемент ИЛИ 22 выдаетс на выходы 23, при этом на входы элемента ИЛИ 24 поступает О, который через элемент ИЛИ 23 проходит на выход 26 о В случае несовпадени информации данный модуль расцениваетс как неисправный , и с пр мого выхода элемента 20 сравнени выдаетс О, который через элементь И 21 и ИЛИ 22 поступает на выход 23, а с инверсного выхода элемента 20 сравнени выдаетс 1, котора через элементы ИЛИ 24 и 23 поступает на выход 26 Выходы 23 и 26 -операционного устройства используютс дл индикации его состо ни исправности
Тестова программа, используема дл контрол контрольных арифметических блоков 8 модул 1J выполн етс независимо от штатной работы арифметических блоков 8 данного операционного устройства Способы построени тестовых программ могут быть различными, В частности, тестова программа может быть сравнима по своей сложности с контрольной проверочной программой ЦВМ (охватыва все узлы контрольных арифметических бло- ков операционного устройства)о Достоверность косвенного контрол модул 1 пропорционально зависит от числа контрольных арифметических блоков модул , а именно: чем больше арифметических блоков контролируетс , тем вьше достоверность контрол всего модул 1 о
При организации параллельного функционировани рабочих арифметических блоков 8 входна информаци , с первых информационных входов операционного устройства через соответствующие элементы И 4, у; (где К 1, 2,3) и ИЛИ УК поступает на входы арифметических блоков 8, с выходов которых информаци через элемен-20 ществл етс блокировка вьщачи результы И 13
и и ID к поступает на .входы соответствующих элементов И 28 и 29ц, и, поскольку с управл к цего входа 6 подаетс О, блокирующий элемент И 29 , информаци с выхода .элемента И через элементы И 28ц и ИЛИ 31) вьщаетс на первые информационные выходы операционного устройствао В этом случае в операционном устройстве может выполн тьс параллельна поразр дна обработка входного слова, соответствующа какой- либо элементарной операции при выполнении потоковой функции
При организации последовательного функчионированн арифметических блоков 8 операционного блока устройства входна информаци через элементы
25
тата вычислени с выхода арифметических блоков в первые информационные выходы операционного устройства через элементы И 28,-28., и производитс выдача результатов вына
числени через элементы И 29, -29.J соответствующий вход мажоритарного элемента 32, с выхода которого результат вычислений через элементы
30 ИЛИ 33 и 31,-31з выдаетс на первые информационные выходы операционного устройства. При этом в случае несовпадени результатов вычислений выдаваемых с арифметических блоков
35 8,-83, операционное устройство рас- цениваетс как отказавшее, с пр мого и инверсного выходов элемента 30 сравнени вьщаютс соответственно сигналы 1 и О, которые через элеИ 4,, и ИЛИ 7, поступает на
рабочего арифметического блока и
вход
8,
с выхода которого информаци через элементы И 14 ц и РШИ 7 к поступает на вход следующего рабочего арифметического блока 8, информаци с выхода последнего рабочего арифметического блока 8 через элементы И 13, 16, 28 и ШШ 31 выдаетс на соответствующий первый информационный выход операционного устройства о В этом случае в последнем может быть выполнена более сложна последовательна обработка входного, слова, соответствующа какой-либо операции при выполнении потоковой функции
Кроме того, в устройстве предусмотрена возможность контрол операционного устройства, котора вл етс более эффективным, чем косвенный контроль при малой степени коррели- рованности отказов При мажоритарном контроле реализуетс однопотокова обработка информации, когда одна и та же информаци обрабатываетс параллельно и независимо на трех (в данном случае) арифметических блоках 8,-8з, выходы которых подключены через соответствующие элементы И 29 к входам мажоритарного элемента 32, При этом на входы 35,36, 37, 38 зтветстз
I 1 II II 1 II Мои II 1 II
1 , -Л , и , 1 ,
торых осуществл етс параллельна и независима работа арифметических блоков . На вход 6 подаетс сигнал 1, с помощью которого осуч - к подаютс соответственно сигналы 1, .1, О, 1, с помощью ко
тата вычислени с выхода арифметических блоков в первые информационные выходы операционного устройства через элементы И 28,-28., и производитс выдача результатов вына
числени через элементы И 29, -29.J соответствующий вход мажоритарного элемента 32, с выхода которого результат вычислений через элементы
ИЛИ 33 и 31,-31з выдаетс на первые информационные выходы операционного устройства. При этом в случае несовпадени результатов вычислений выдаваемых с арифметических блоков
8,-83, операционное устройство рас- цениваетс как отказавшее, с пр мого и инверсного выходов элемента 30 сравнени вьщаютс соответственно сигналы 1 и О, которые через элементы ИЛИ 22 к 25 попадают на выходы 23 и 26 операционного устройства При совпадении результатов вычи.сле- ний арифметических блоков 8/ -8j операционное устройство расцениваетс как исправное, с пр мого и инверсного выходов элемента 30 сравнени выдаютс соответственно сигналы О и 1, которые через элементы ИЛИ 22 и 25 попадают на выходы 23 и 26 операционного устройства.
Арифметический блок 8 работает следующим образом.
Перед началом штатной работы в регистр 65 заноситс математический номер данного арифметического блока, через вход 12 в блок 54 записываетс тестова программа так, что в первых разр дах регистров 55,-554 со55
держитс первое командное слово прогр ам 5 второе и т.д„ В процессе штатной работы через вход 34 на регистр 63 записываетс команда, при этом на первый вход элемента 64 сравнени поступает информаци , содержао1а с в поле НЭ данной команды При совпадении номера, записанного в регистре 65 и номера, содержащегос в поле НЭ, с выхода элемента 64 сравнени на управл ющий вход регистра 63 выдаетс сигнал, который вл етс разрешающим дл вьщачи команды, записанной в регистре 63 на дальнейшее исполнение о В противном случае команда игнорируетс о
При наличии только разрешающего сигнала с выходов регистра 63 выдает- с содержимое полей ПС, КОП, ПВ и А данной команды а Б режиме, вычислений с третьего выхода регистра 61 выдаетс единица, котора открывает элемент И 60, и код операции через элементы И 60 и ИПИ 59 проходит на регистр 58, при этом с выхода НЕ 62 на первые входы элементов И 56 поступает нулевой сигнал, который блокирует выдачу тестовой информации из ЗУ 54 тестовых программ через элементы ИЛИ 59 в регистр 58о Входной операнд, поступающий из соседнего АУ, принимаетс на регистр 52, а информаци , поступающа с входа 9 - на регистр 39, после чего при наличии разрешающего сигнала, вызываемого с выхода узла 45 синхронизации, с выходов регистров 39 и 51 соответственно на первый и второй входы узла 46 синхронк(зации
вьщаетс сигнал окончани приема one- Q зуетс при формировании диаграммы в рандов, а информаци , записанна в адресных командах, при этом выдача
этих регистрах, переписываетс соответственно в регистры 40 и 52, откуда , при наличии разрешающего сигнала, вьщаваемого с выхода узла 46 синхро - низации, информаци через элементы И 41 и 53 соответственно поступает 3 универсальный комбинационный сумматор 48о При этом сигнал, вьодаваемый узлом 46 синхронизации через элемент И 47 поступает на управл ющий вход регистра 58, с выхода которого код операции поступает на командные входы комбинационного сумматора 48,, после чего производитс необходима операци о
При наличии вьщача сигнала с выхода элемента И 47 блокируетс .. Подобна возможность расцениваетс
как необходима при организации операций ожидани по условию. При с второго выхода регистра 61 выдаетс
нулевой сигнал, который поступает на первый вход элемента И 49 и на второй вход элемента И 53, тем самым блокируютс поступление информации на сумматор 48 из соседнего арифметического блока и выдача результата обра- ботки через регистр 50 в следующий за ним арифметический блок С первого выхода регистра 61 выдаетс единичный сигнал, который поступает на первый вход элемента И 43 и на второй вход элемента И 41, тем самым разру-- , шаютс поступление информации на сумматор 48 и. выдача результата обработки через регистр 44 на выход 11 АУ„ Кроме того, с помощью сигналов, вьщаваемых с первого и второго выходов регистра 61, формируетс временна диаграмма работы узлов 45 и 46 синхронизации фиг о 4 и 5) соответственно .
Аналогично при происход т разрешение приема обрабатываемой информации на сумматор 48 из соседнего АУ и выдача результата обработки в следующий за ним арифметический блок, при этом блокируютс пути приема информации, поступающей с выхода 9 и выдача результата на вход 11. Прием входных операндов из соседнего
арифметического блока, а также на
вход 9, и вьщача результатов в следующий арифметический блок, а также на выход 1 1 могут быть реализованы при . Регистр 42 адреса исполь
5
адреса с него осуществл етс через выход 10 арифметического блока. По окончании выполнени операции с выхода сумматора 48 результат через элементы И 49 и: 43 и в зависимости от признака ПВ записываетс в регистры 44 и 50 соответственно. По завершении записи с управл ющих выходов регистров 44 и 50 на входы узлов 45 синхронизации, временна диаграмма работы которого формируетс с помощью признака ПВ, поступают единичные сигналы. При этом с выхода узла g 45 вьщаетс разрешающий сигнал, который поступает на управл ющие входь: регистров 39 и 51. В результате этого , из регистров 39 и 51 происходит выдача очередных операндов.
0
метического блока с третьего выхода регистра 61 выдаетс нулевой сигнал, который поступает на первый вход элементов И 60 и блокирует выдачу в регистр 58 кода операции, хран щегос в регистре 63, при этом с выхода элемента НЕ 62 вьщаетс единичный сигнал, который поступает на первый вход элемента И 56, и тем самым разрешает выдачу из ЗУ 54 тестовой программы , котора через элемент ИЛИ 59 записываетс на регистр 58.
В режиме проверки на вход 2 опера- 15 пы -.к вторым входам соответствующих ционного устройства подаетс заранее элементов И четвертой группы и к пер- выбранна тестова последовательвым входам соответствующих элементов И седьмой группы, каждый элемент И седьмой группы соединен вторым вхоность , элемент которой вл етс дл
вым входам соответствующих элементов И седьмой группы, каждый элемент И седьмой группы соединен вторым вхосумматора 48 операндом. Работа ариф- . метического блока в этом случае така 20 шиной контрольной информации же, как и в режиме вычислений По устройства, а выходом - с первым завершении вьщачи операнда из регист- входом соответствующего элемента
сравнени , подключенного вторым входом к выходу соответствующего шесто- 25 го элемента И шестой группы, а пр мым выходом - с входом элемента И, причем третий вход первого элемента ИЛИ первой группы подключен к выхора 51 в регистр 52 с выхода узла 46 синхронизации выдаетс сиг.нал, кото-, рый вл етс импульсом сдвига дл .закольцованных сдвигающих регистоов 55( -55, В результате этого с выду п-го элемента И четвертой группы.
хода ЗУ 54 через элементы И 56 и ИЛИ 59 в регистр 58 записываетс очередное командное слово тестовой програм- 30 третий вход i-го элемента ИЛИ (где мы и затем аналогично выполн етс , i 2,3,...п) первой группы подключен к выходу (i-l)-ro элемента И
Claims (1)
- Формула изобретени четвертой группы, отличающеес тем, что, с целью повышениОперационное устройство с самоконт-з5 Достоверности контрол , в него вве- ролем, содержащее первые информаци- дены элементы И восьмой и дев той онные выходы по числу п первых информационных входов, элементы И первой группы, подключенные первыми входами к настроечному входу устройства, вторыми входами - к шине Контрольна информаци устройства, а выходами - к первым входам соответствующих элементов ИЛИ первой группы, соединенных вторыми входами с выхода Ми 45 Дев той группы св зан с соответст- соответствующих элементов И второй вующими входами элемента сравнени и группы, а выходами - с первыми входа- мажоритарного элемента, а второйгрупп, элементы НЕ третьей группы, элементы ИЛИ второй группы, первый, второй, третий и четвертый элементы 4Q ИЛИ, элемент сравнени и мажоритарный элемент, первые входы элементов И восьмой и дев той групп подключены к выходу соответствующего элемента И п той группы, причем выход элементами соответствующих арифметических блоков, каждый из которых подключен вторым, третьим и четвертым входами соответственно к соответствующему настроечному входу устройства, к шине ввода тестовой информации и к второму информационному входу устройства , а первым, вторым и третьим выхо- gg ИЛИ второй группы, соединенного вто-дами соответственно - к второму информационному выходу устройства, к адресному выходу устройства и к первым входам соответствукицих элементоввторые входы элементов И третьей группы подключены к настроечному входу устройства и через соответствуюпшй элемент НЕ первой группы к второму входу соответствующего элемента И четвертой группы, а выходы элементов И третьей группы св заны с первыми входами соответствующих эле-ментов И п той и шестой групп, причем вторые входы элемента и п той группы подключены к настроечному входу устройства и через элементы НЕ второй группы -.к вторым входам соответствующих элементов И четвертой группы и к пер-вым входам соответствующих элементов И седьмой группы, каждый элемент И седьмой группы соединен вторым шиной контрольной информации устройства, а выходом - с первым входом соответствующего элементаду п-го элемента И четвертой группы.третий вход i-го элемента ИЛИ (где i 2,3,...п) первой группы подключен к выходу (i-l)-ro элемента ИДостоверности контрол , в него вве- дены элементы И восьмой и дев той Дев той группы св зан с соответст- вующими входами элемента сравнени и мажоритарного элемента, а второйгрупп, элементы НЕ третьей группы, элементы ИЛИ второй группы, первый, второй, третий и четвертый элементы ИЛИ, элемент сравнени и мажоритарный элемент, первые входы элементов И восьмой и дев той групп подключены к выходу соответствующего элемента И п той группы, причем выход элементавход - с управл ющим входом устройства , первым входом первого элемента ИЛИ и через соответствующий элемент НЕ третьей группы с вторым входом соответствующего элемента И восьмой группы, подключенного выходом к первому входу соответствующего элементарым входом с выходом первого элемента ИЛИ, подключенного вторым входом к выходу мажоритарного элемента, а пр мой и инверсный выходы элементасравнени св заны с первыми входами соответственно второго и третьего элементов ИЛИ, выходы которых вл ютс управл ющими выходами устройства, а вторые входы подключены к выходам соответственно элемента И и четвертого элемента ИЛИ, соединенного входами с инверсными выходами, элементов сравнени группы, выходы элементов И второй группы вл ютс первьми информационными выходами устройства .72ф1/г.ЗПР1w//y//////vy/////////Aпргi /7flf//7d-ff7/t ffpt// e: fffфиг Лt fjpl/ /7 --///цзиг.5inpu/7e ff1фиг. 6Редактор И„ГорнаСоставитель Но Горбунова Техред М.Хода ничЗаказ 4222/38 Тираж 672ПодписноеВНИИПИ Государственного комитета СССРпо делам изобретений и открытий 113035, Москва, Ж-35, Раушска наб,,,Производственно-полиграфическое предпри тие, г Ужгород, ул.Проектна ,4Корректор А.Обручар
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864026471A SU1339546A1 (ru) | 1986-02-24 | 1986-02-24 | Операционное устройство с самоконтролем |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864026471A SU1339546A1 (ru) | 1986-02-24 | 1986-02-24 | Операционное устройство с самоконтролем |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1339546A1 true SU1339546A1 (ru) | 1987-09-23 |
Family
ID=21223098
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU864026471A SU1339546A1 (ru) | 1986-02-24 | 1986-02-24 | Операционное устройство с самоконтролем |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1339546A1 (ru) |
-
1986
- 1986-02-24 SU SU864026471A patent/SU1339546A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
EP0045634B1 (en) | Programmable digital data processing apparatus arranged for the execution of instructions in overlap | |
US4658355A (en) | Pipeline arithmetic apparatus | |
JPS63291134A (ja) | 論理集積回路 | |
GB1594014A (en) | Microprogramme system with fixed jump addressing | |
US5307300A (en) | High speed processing unit | |
SU1339546A1 (ru) | Операционное устройство с самоконтролем | |
US4794527A (en) | Microprogrammed data processing system using latch circuits to access different control stores with the same instruction at different times | |
US4240136A (en) | Apparatus for inserting instructions in a control sequence in a stored program controlled telecommunication system | |
US5093775A (en) | Microcode control system for digital data processing system | |
US4685077A (en) | Data processing apparatus having binary multiplication capability | |
JPH1091430A (ja) | 命令解読装置 | |
JPH04359323A (ja) | マイクロコンピュータ | |
JPH11259291A (ja) | マイクロコンピュータの命令解読装置 | |
SU1716528A1 (ru) | Вычислительное устройство с совмещением операций | |
JPS6339928B2 (ru) | ||
JPH0343830A (ja) | ブロックリピート回路 | |
US20060271610A1 (en) | Digital signal processor having reconfigurable data paths | |
SU964639A1 (ru) | Микропрограммное устройство управлени | |
RU1797108C (ru) | Арифметическое устройство с микропрограммным управлением | |
SU1091160A1 (ru) | Микропрограммное устройство управлени | |
SU1430962A1 (ru) | Вычислительное устройство | |
SU941978A1 (ru) | Устройство дл обмена информацией | |
EP0242003A2 (en) | Processor internal bus control | |
SU896623A1 (ru) | Устройство управлени конвейерным вычислительным устройством | |
SU881748A1 (ru) | Микропрограммное устройство управлени |