RU2009539C1 - Плата расширения вычислительной системы - Google Patents
Плата расширения вычислительной системы Download PDFInfo
- Publication number
- RU2009539C1 RU2009539C1 SU904830249A SU4830249A RU2009539C1 RU 2009539 C1 RU2009539 C1 RU 2009539C1 SU 904830249 A SU904830249 A SU 904830249A SU 4830249 A SU4830249 A SU 4830249A RU 2009539 C1 RU2009539 C1 RU 2009539C1
- Authority
- RU
- Russia
- Prior art keywords
- board
- connector
- block
- bus
- contacts
- Prior art date
Links
Images
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/40—Bus structure
- G06F13/4063—Device-to-bus coupling
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/40—Bus structure
- G06F13/4063—Device-to-bus coupling
- G06F13/409—Mechanical coupling
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S439/00—Electrical connectors
- Y10S439/955—Electrical connectors including electronic identifier or coding means
Landscapes
- Engineering & Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
- Debugging And Monitoring (AREA)
- Bus Control (AREA)
- Details Of Connecting Devices For Male And Female Coupling (AREA)
Abstract
Использование: сменная плата расширения для системы вычислительных машин имеет специальные схемы, чтобы позволять плате самой приспосабливаться к техническим характеристикам отдельного разъема, в который она вставляется. Вычислительные машины, предназначенные для индивидуального использования или использования в малых сетях, обеспечивают разъемы для подключения, чтобы позволять платам расширения, добавляться и соединяться с шиной вычислительной машины для добавления новой функции или возможности. Целью изобретения является создание платы расширения, которая адаптируется к ширине разъма. Плата содержит разъем и дополнительную плату, в которую введен блок идентификации, соединенный с одним из контактов платы, входящим в зацепление с контактом разъема, соединенным с источником питания, в случае 32-разрядной шины системы, и не входящим в контакт в случае 16-разрядной шины. 1 з. п. ф-лы, 12 ил.
Description
Изобретение относится к вычислительной системе, включающей конфигурацию разъемов с первым множеством контактов, а также дополнительную плату со вторым множеством контактов, в которой первое множество контактов сделано для сцепления со вторым множеством контактов, что позволяет вставить дополнительную пасту в конфигурацию разъемов.
Известно, что компьютер, например компьютер серии PS/2 корпорации 1ВМ, снабжают гнездами, включающими один или несколько шинных разъемов, чтобы позволить подсоединить к компьютерной шине топологические платы с соответствующими схемами, с целью расширения компьютерных возможностей для пользователя. Эти гнезда обеспечивают физическую поддержку для топологических плат, а шинный(ые) разъем(ы) приспособлен(ы) таким образом, чтобы сопрягаться с разъемом на топологической плате, когда плата полностью вставлена в гнездо.
В определенных компьютерах, как, например, 1ВМ PS/2 модели 80, в соответствующих гнездах предусмотрены шинные разъемы двух разных размеров. Эти разные разъемы отражают различия в количестве параллельных разрядов, отведенных для адресации к данным и памяти. Обычно разряды распределяют кратно восьми, а в случае с моделью 80 имеются гнезда, которые предусмотрены для 16-разрядной параллельной адресации, а также гензда, которые предусмотрены для 32 параллельных разрядов. Известно, что предусматривается позиция флагового разряда, чтобы показать, когда команда, посланная по шине, является 16-разрядной командой, а когда 32-разрядной (например, логическая 1 - 32 разрядам, а логический 0 = 16 разрядам) для того, чтобы плата в 16-разрядном гнезде могла обнаружить команды, выходящие за ее диапазон, и не выполнять никаких действий. Это позволяет 16-разрядной плате избежать ситуации, когда, видя только часть команды или адреса, она приступает к неправильному действию.
Эта позиция флагового разряда однако не дает никакой защиты в случае, когда 32-разрядную плату вставляют в 16-разрядное гнездо. В этом случае будет работать так, как будто она находится в 32-разрядном гнезде, и неправильно интерпретировать сигналы в пропущенных позициях.
Известно битовое управление данными между двумя шинами данных разного размера, но такое битовое управление обычно осуществляют посредством фиксированной интерфейсной логики, осознавая, что определение шин на каждой стороне будет оставаться одинаковым.
Целью изобретения является разработка платы расширения, которая адаптируется к ширине разъема, т. е. которая обнаруживает, когда она находится в разъеме, который предусмотрен для платы с меньшей шириной шины.
Разработана топологическая плата, включающая специальные схемы для обнаружения условия, которое обычно не обеспечивает информацию о состоянии и последующей реакции на это условие, так, чтобы был выработан двоичный сигнал, характеризующий ширину шины гнезда.
Цель достигается тем, что в плату расширения, содержащую разъем с первой группой контактов и дополнительную плату со второй группой контактов, выполненную с возможностью соединения с первой группой контактов разъема при вставлении дополнительной платы в разъем, введен в дополнительную плату блок идентификации, первый вывод которого соединен с К-м контактом дополнительной платы, второй вывод блока идентификации соединен с локальной шиной дополнительной платы, при этом К-й контакт первой группы разъема соединен с шиной питания вычислительной системы, а блок идентификации содержит делитель напряжения, первый вывод первого резистора которого является первым выводом блока, первый вывод второго резистора соединен с шиной нулевого потенциала, а объединенные вторые выводы резисторов образуют второй вывод блока.
На фиг. 1 показана структурная схема, показывающая элементы базисной системы, соединенные с предпочтительной в настоящее время реализацией для платы расширения, в которой логическая часть, распознающая команды, может быть реализована программируемым локальным процессором; на фиг. 2 - схематическое изображение платы расширения, ориентированной, чтобы вставляться в гнездо, имеющее разъем с полным набором контактов, для которого рассчитана данная плата; на фиг. 3 - схематическое изображение платы расширения, ориентированной, чтобы вставляться в гнездо, в котором часть контактов разъема не зацепляет контакты разъема системы; на фиг. 4 и 5 - упрощенные схематические изображения 16-битового и 32-битового разъемов соответственно; на фиг. 6 и 7 - схематическое изображение назначений штырьков разъема для 16-битовой ширины шины, согласно микроканальной фирменной архитектуре, применяемой а персональных ЭВМ марки PS/2 фирмы ИВМ; на фиг. 8 - схематическое изображение предпочтительной реализации для блока идентификации; на фиг. 9 - структурная схема алгоритма обработки команд для платы расширения; на фиг. 10 - схема алгоритма, соответствующая фиг. 8, но включающая проверку команд, согласно предпочтительной реализации этого изобретения, чтобы блокировать выполнение команд, которые не могут исполняться надлежащим образом; на фиг. 11 - схема алгоритма для реализации универсальным процессором проверки определенных типов невыполнимых команд, полученных от базисной системы; на фиг. 12 - детализированная схема алгоритма идентификации невыполнимых команд, принятых от базисного процессора.
Плата расширения I показана (фиг. 1) соединенной с базисной системой 2 разъемом платы 3, который соединяется с разъемом системы 4, чтобы принимать сигналы и питание от шины системы 5. Базисная система 2 включает центральый процессор 6 и системную память 7, соединенные с шиной системы 5, как представляется типичным для таких систем, как вычислительные машины марки "Персональная Система/2" фирмы ИБМ.
Сигналы от разъема платы 3 принимаются на регистрах интерфейса 8, с которых делается выборка локальным процессором 9 через локальную шину 10. Системная память 11 и суперпозиционные драйверы 12 также соединяются с локальной шиной 10 и могут рассматриваться вместе с локальным процессором 9 и системной памятью 11 в качестве части расширительного устройства 13. Суперпозиционые драйверы 12 могут меняться от платы к плате и могли бы, например, управлять внешними устройствами 14, такими как накопители на дисках, согласующимися с интерфейсом системы с малой вычислительной машиной. Блок идентификации 15 соединяется с разъемом платы 3 согласно предпочтительной реализации для этого изобретения и обеспечивает сигнал к локальной шине 10.
Рассмотрим фиг. 2, плата расширения 1 показывается включающей панель 16 из недеформируемого материала для монтажных плат. Отдельные контакты 17 разъема платы 3 располагаются в предварительно выбранных разнесенных друг от друга на некоторое расстояние положениях на любой стороне панели 16 (меньшее, чем предпочтительное число контактов, показано для ясности иллюстрации). Разъем системы 4 монтируется на плоской монтажной плате 18 и ему придается конфигурация контактами (не показана) для соприкосновения с контактами 17 по длине разъема платы 3 и служит для того, чтобы определять принимающее гнездо 19. Разъем платы представляет, предпочтительно, вкладышевый (вилочный) краевой разъем платы, а разъем системы тогда должен представлять гнездовой (розеточный) краевой разъем платы, фиг. 3 показывает сокращенный разъем системы 4 .
На фиг. 4 и 5 показаны положения контактов для типовых разъемов 4 и 4, поддерживающих 16-битовые и 32-битовые операции соответственно. Фиг. 6 и 7 показаны назначения для контактов разъема 3 системой шины 5 (см. фиг. 1), согласующиеся со спецификацией микроканальной шины с обозначениями А и Д, показывающими позиции адреса и данных соответственно. Дополнительное описание, касающееся такой системы, может быть найдено в руководстве Техническое обращение с интерфейсом аппаратных средств персональнной системы PS/2.
На фиг. 8 изображен блок идентификации 15, который соединяется с отдельным контактом разъема 3, обозначенным А77 на фиг. 7, который не зацепляется 16-битовым разъемом системы 4 (см. фиг. 3), однако мог бы контактировать с 12-вольтовым источником постоянного напряжения через 32-битовый разъем 4 (см. фиг. 2). Резисторы 19 и 20 действуют в качестве делителя напряжения, чтобы образовывать логический сигнал на отводном соединении, которое подает сигнал в качестве управляющего сигнала к порту ввода для процессора 9 (фиг. 1) через локальную шину 10.
Нормальная последовательность операций для исполнения команд, представленных базисной системой 2 (см. фиг. 1), показана на фиг. 9. Этот алгоритм, предпочтительно, реализуется использованием программируемого процессора 9 (см. фиг. 1), который, например, может представлять процессор модели "Интел-8032". Первоначально команда выбирается блоком 21 из регистров 8. Затем обрабатывается команда (блоком 22), которая могла бы подготавливаться разработчиком в соответствии с функцией конкретной платы 1. Затем блок 23 должен завершать цикл обработки и подготавливать следующую команду.
Фиг. 10 показывает изменения в алгоритме, показанные на фиг. 9, согласно предпочтительной в настоящее время реализации для данного изобретения. После выборки команды согласно блоку 21 все адреса ячеек памяти, которые эта команда требует, чтобы они были представлены на шине 5 (см. фиг. 1), извлекаются (блок 24) и проверяются, чтобы определять, не превышают ли они 16-мегобайтовый предел для 16-битовой адресации (блок 25). Если да, то логический блок 26 проверяет сигнал "Большой разъем", представленный блоком идентификации 15, чтобы определять, не превышает ли данный адрес пределов адресации данного разъема. Следовательно, только в том случае, если адрес превышает предел разъема, согласно предпочтительной в настоящее время реализации этого изобретения, эта плата блокирует команду, пользуясь блоком 27.
На фиг. 11 изображен алгоритм обработки команд в блоке управления, который начинается с приема адреса для обращения к управляющему блоку (блок 28). Уровень сигнала "БОЛЬШОЙ РАЗЪЕМ" выбирается в блоке 29 и проверяется в блоке 30. Если разъем ограничивает адресацию, то адрес управляющего блока проверяется в блоке 31, если таковой превышает интервал, базисной системе 2 посылается сообщение об ошибке логической частью 32. В противном случае логическая часть 33 выбирает управляющий блок.
На фиг. 12 показана дополнительная часть алгоритма, чтобы дополнять алгоритм, показанный на фиг. 11. В блоке 34 команда принимается в память 11. Сигнал "БОЛЬШОЙ РАЗЪЕМ" считывается в блоке 35 и, если он дает индикацию ограниченного сегмента блоку 36 для адресации, эта команда проверяется в блоке 37, чтобы определить, является ли эта команда требующей одну или более операций обращения к памяти. Если да, то эти адреса проверяются в блоке 38 для определения, не превышают ли они предел разъема. Если какие-либо адреса будут превышать предел разъема, то сообщение об ошибках посылается базисной системе 2 блоком 39, в противном случае эта команда исполняется блоком 40.
Хотя только определенные предпочтительные признаки этого изобретения были показаны методом иллюстрации, многие модификации и изменения будут представляться специалистам в данной области техники. Поэтому, следует понимать, что настоящие пункты формулы изобретения предназначаются, чтобы охватывать все такие модификации и изменения, которые попадают в пределы истинной сущности данного изобретения. (56) Компьютер 1ВМ PS/2 мод. 1980.
Claims (2)
1. ПЛАТА РАСШИРЕНИЯ ВЫЧИСЛИТЕЛЬНОЙ СИСТЕМЫ, содержащая разъем с первой группой контактов и дополнительную плату с второй группой контактов, выполненную с возможность соединения с первой группой контактов разъема при вставлении дополнительной платы в разъем, отличающаяся тем, что в дополнительную плату введен блок идентификации, первый вывод которого соединен с K-м контактом дополнительной платы, второй вывод - с локальной шиной дополнительной платы, при этом K-й контакт первой группы разъема соединен с шиной питания вычислительной системы.
2. Плата по п. 1, отличающаяся тем, что блок идентификации содержит делитель напряжения, первый вывод первого резистора которого является первым выводом блока, первый вывод второго резистора соединен с шиной нулевого потенциала, а объединенные вторые выводы резисторов образуют второй вывод блока.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US89365269 | 1989-06-12 | ||
US07/365,269 US5119498A (en) | 1989-06-12 | 1989-06-12 | Feature board with automatic adjustment to one of two bus widths based on sensing power level at one connection contact |
Publications (1)
Publication Number | Publication Date |
---|---|
RU2009539C1 true RU2009539C1 (ru) | 1994-03-15 |
Family
ID=23438162
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU904830249A RU2009539C1 (ru) | 1989-06-12 | 1990-06-11 | Плата расширения вычислительной системы |
Country Status (10)
Country | Link |
---|---|
US (1) | US5119498A (ru) |
EP (1) | EP0403117B1 (ru) |
JP (1) | JPH0324608A (ru) |
CA (1) | CA2018072C (ru) |
CZ (1) | CZ284019B6 (ru) |
DD (1) | DD295039A5 (ru) |
DE (2) | DE69023701T2 (ru) |
HU (1) | HUT57921A (ru) |
PL (1) | PL163268B1 (ru) |
RU (1) | RU2009539C1 (ru) |
Families Citing this family (40)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5329634A (en) * | 1991-12-02 | 1994-07-12 | International Business Machines Corp. | Computer system with automatic adapter card setup |
JPH0821015B2 (ja) * | 1992-01-20 | 1996-03-04 | インターナショナル・ビジネス・マシーンズ・コーポレイション | コンピュータならびにそのシステム再構成化装置および方法 |
US5454081A (en) * | 1992-08-28 | 1995-09-26 | Compaq Computer Corp. | Expansion bus type determination apparatus |
US5477860A (en) * | 1992-11-05 | 1995-12-26 | Synectics Medical, Inc. | Catheter for measuring respiration and respiratory effort |
US5810741A (en) * | 1992-11-05 | 1998-09-22 | Synectics Medical Ab | Method of measuring respiration and respiratory effort using plural catheters |
US5438985A (en) * | 1993-01-25 | 1995-08-08 | Synectics Medical, Incorporated | Ambulatory recording of the presence and activity of substances in gastro-intestinal compartments |
US5551425A (en) * | 1993-05-13 | 1996-09-03 | Synectics Medical, Inc. | Potential difference and perfusion pressure catheter |
US5657759A (en) * | 1993-05-13 | 1997-08-19 | Synectics Medical, Incorporated | Measurement of gastric emptying and gastrointestinal output |
JP3483594B2 (ja) * | 1993-07-20 | 2004-01-06 | 富士通株式会社 | 半導体装置 |
US5507289A (en) * | 1993-09-16 | 1996-04-16 | Synectics Medical, Inc. | System and method to diagnose bacterial growth |
US5477854A (en) * | 1993-09-16 | 1995-12-26 | Synectics Medical, Inc. | System and method to monitor gastrointestinal Helicobacter pylori infection |
US5479935A (en) * | 1993-10-21 | 1996-01-02 | Synectics Medical, Inc. | Ambulatory reflux monitoring system |
US5833625A (en) * | 1993-10-21 | 1998-11-10 | Synectics Medical Ab | Ambulatory reflux monitoring system |
US5630099A (en) * | 1993-12-10 | 1997-05-13 | Advanced Micro Devices | Non-volatile memory array controller capable of controlling memory banks having variable bit widths |
US6092139A (en) * | 1994-03-11 | 2000-07-18 | Crane, Jr.; Stanford W. | Passive backplane capable of being configured to a variable data path width corresponding to a data size of the pluggable CPU board |
WO1995024729A2 (en) | 1994-03-11 | 1995-09-14 | The Panda Project | Modular architecture for high bandwidth computers |
US5680536A (en) * | 1994-03-25 | 1997-10-21 | Tyuluman; Samuel A. | Dual motherboard computer system |
US5577213A (en) * | 1994-06-03 | 1996-11-19 | At&T Global Information Solutions Company | Multi-device adapter card for computer |
EP0685803B1 (en) | 1994-06-03 | 2001-04-18 | Hyundai Electronics America | Method of producing an electrical device adapter |
US5506815A (en) * | 1995-01-19 | 1996-04-09 | Etron Technology Inc. | Reconfigurable multi-user buffer memory particularly for signal processing system |
WO1996035177A1 (en) * | 1995-05-01 | 1996-11-07 | Apple Computer, Inc. | A modular system utilizing interchangeable processor cards |
US5909571A (en) * | 1995-05-01 | 1999-06-01 | Apple Computer, Inc. | Clock distribution for processor and host cards |
US5596169A (en) * | 1995-05-12 | 1997-01-21 | Iomega Corporation | Combined SCSI/parallel port cable |
JPH09204243A (ja) * | 1996-01-29 | 1997-08-05 | Fujitsu Ltd | データ転送方法 |
US5832244A (en) * | 1996-02-20 | 1998-11-03 | Iomega Corporation | Multiple interface input/output port for a peripheral device |
US5920731A (en) * | 1997-02-21 | 1999-07-06 | Vlsi Technology, Inc. | Single-housing electrical device self-configurable to connect to PCMCIA compliant or non-PCMCIA compliant host interfaces |
EP0887737B1 (en) * | 1997-06-26 | 2003-01-22 | Hewlett-Packard Company, A Delaware Corporation | Reversible connectors |
US5978861A (en) * | 1997-09-30 | 1999-11-02 | Iomega Corporation | Device and method for continuously polling for communication bus type and termination |
WO1999021127A1 (fr) * | 1997-10-17 | 1999-04-29 | I-O Data Device Inc. | Support sous forme de carte et carte pour ordinateur personnel |
US6146150A (en) * | 1998-11-24 | 2000-11-14 | International Business Machines Corporation | Circuit card with separate interfaces for different bus architectures |
US6487715B1 (en) * | 1999-04-16 | 2002-11-26 | Sun Microsystems, Inc. | Dynamic code motion optimization and path tracing |
GB2356715A (en) * | 1999-11-25 | 2001-05-30 | Nmi Electronics Ltd | Single board computer module |
US6640273B1 (en) | 2000-01-05 | 2003-10-28 | Tektronix, Inc. | Apparatus for data bus expansion between two instrument chassis |
US7672747B2 (en) * | 2000-03-30 | 2010-03-02 | Lam Research Corporation | Recipe-and-component control module and methods thereof |
US20020063716A1 (en) * | 2000-11-30 | 2002-05-30 | Palm, Inc. | Control of color depth in a computing device |
US6961790B2 (en) * | 2001-06-29 | 2005-11-01 | Motorola, Inc. | Self-extracting re-configurable interface used in modular electronic architecture |
US7362589B2 (en) * | 2005-01-18 | 2008-04-22 | Hewlett-Packard Development Company, L.P. | Circuit board adapted to couple to different types of add-in cards |
US7565220B2 (en) * | 2006-09-28 | 2009-07-21 | Lam Research Corporation | Targeted data collection architecture |
US7814046B2 (en) * | 2006-09-29 | 2010-10-12 | Lam Research Corporation | Dynamic component-tracking system and methods therefor |
US7995050B2 (en) * | 2006-12-27 | 2011-08-09 | Hewlett-Packard Development Company, L.P. | Power saving display |
Family Cites Families (27)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4126897A (en) * | 1977-07-05 | 1978-11-21 | International Business Machines Corporation | Request forwarding system |
JPS5454536A (en) * | 1977-10-08 | 1979-04-28 | Fujitsu Ltd | Data processor |
US4447878A (en) * | 1978-05-30 | 1984-05-08 | Intel Corporation | Apparatus and method for providing byte and word compatible information transfers |
US4291370A (en) * | 1978-08-23 | 1981-09-22 | Westinghouse Electric Corp. | Core memory interface for coupling a processor to a memory having a differing word length |
US4309754A (en) * | 1979-07-30 | 1982-01-05 | International Business Machines Corp. | Data interface mechanism for interfacing bit-parallel data buses of different bit width |
US4443864A (en) * | 1979-10-09 | 1984-04-17 | Texas Instruments Incorporated | Memory system for microprocessor with multiplexed address/data bus |
US4306298A (en) * | 1979-10-09 | 1981-12-15 | Texas Instruments Incorporated | Memory system for microprocessor with multiplexed address/data bus |
US4471458A (en) * | 1981-06-18 | 1984-09-11 | Allied Corporation | Computer interface |
GB2101370A (en) * | 1981-06-26 | 1983-01-12 | Philips Electronic Associated | Digital data apparatus with memory interrogation |
US4500933A (en) * | 1982-04-02 | 1985-02-19 | Ampex Corporation | Universal interface unit |
US4667305A (en) * | 1982-06-30 | 1987-05-19 | International Business Machines Corporation | Circuits for accessing a variable width data bus with a variable width data field |
US4751671A (en) * | 1983-02-14 | 1988-06-14 | Prime Computer, Inc. | Size configurable data storage system |
US4675808A (en) * | 1983-08-08 | 1987-06-23 | American Telephone And Telegraph Company At&T Bell Laboratories | Multiplexed-address interface for addressing memories of various sizes |
US4739475A (en) * | 1983-09-20 | 1988-04-19 | Mensch Jr William D | Topography for sixteen bit CMOS microprocessor with eight bit emulation and abort capability |
JPS60204052A (ja) * | 1984-03-28 | 1985-10-15 | Fanuc Ltd | 入出力ボ−ドのアドレス選択方式 |
KR900007564B1 (ko) * | 1984-06-26 | 1990-10-15 | 모토로라 인코포레이티드 | 동적 버스를 갖는 데이터 처리기 |
US4716527A (en) * | 1984-12-10 | 1987-12-29 | Ing. C. Olivetti | Bus converter |
US4683534A (en) * | 1985-06-17 | 1987-07-28 | Motorola, Inc. | Method and apparatus for interfacing buses of different sizes |
JPS6219904A (ja) * | 1985-07-18 | 1987-01-28 | Diesel Kiki Co Ltd | マイクロプロセツサを用いた制御装置 |
JPH0772886B2 (ja) * | 1986-08-01 | 1995-08-02 | インターナショナル・ビジネス・マシーンズ・コーポレーション | データ処理システム |
US5023823A (en) * | 1986-11-07 | 1991-06-11 | Norand Corporation | Multiple channel communications system and packaging configuration therefor |
US4803623A (en) * | 1986-10-31 | 1989-02-07 | Honeywell Bull Inc. | Universal peripheral controller self-configuring bootloadable ramware |
US4779190A (en) * | 1986-12-03 | 1988-10-18 | Ncr Corporation | Communication bus interface |
JPS6422107A (en) * | 1987-07-17 | 1989-01-25 | Oki Electric Ind Co Ltd | Voltage level detecting circuit |
JPH01180026A (ja) * | 1988-01-11 | 1989-07-18 | Nec Corp | 汎用入出力インタフェース接続方式 |
US4991085A (en) * | 1988-04-13 | 1991-02-05 | Chips And Technologies, Inc. | Personal computer bus interface chip with multi-function address relocation pins |
US4885482A (en) * | 1988-07-13 | 1989-12-05 | Compaq Computer Corporation | Multiple computer interface circuit board |
-
1989
- 1989-06-12 US US07/365,269 patent/US5119498A/en not_active Expired - Lifetime
-
1990
- 1990-05-31 DE DE69023701T patent/DE69023701T2/de not_active Expired - Fee Related
- 1990-05-31 EP EP90305965A patent/EP0403117B1/en not_active Expired - Lifetime
- 1990-06-01 CA CA002018072A patent/CA2018072C/en not_active Expired - Fee Related
- 1990-06-02 DE DE4017902A patent/DE4017902A1/de active Granted
- 1990-06-04 JP JP2144587A patent/JPH0324608A/ja active Granted
- 1990-06-07 DD DD90341423A patent/DD295039A5/de not_active IP Right Cessation
- 1990-06-11 HU HU903801A patent/HUT57921A/hu unknown
- 1990-06-11 RU SU904830249A patent/RU2009539C1/ru active
- 1990-06-12 PL PL90285595A patent/PL163268B1/pl unknown
- 1990-06-12 CZ CS902917A patent/CZ284019B6/cs unknown
Also Published As
Publication number | Publication date |
---|---|
PL163268B1 (en) | 1994-02-28 |
US5119498A (en) | 1992-06-02 |
DE4017902C2 (ru) | 1992-03-12 |
CA2018072C (en) | 1993-08-24 |
HU903801D0 (en) | 1990-11-28 |
CA2018072A1 (en) | 1990-12-12 |
EP0403117B1 (en) | 1995-11-22 |
DE69023701T2 (de) | 1996-06-20 |
JPH0324608A (ja) | 1991-02-01 |
CS9002917A2 (en) | 1991-11-12 |
EP0403117A1 (en) | 1990-12-19 |
JPH0580008B2 (ru) | 1993-11-05 |
CZ284019B6 (cs) | 1998-07-15 |
HUT57921A (en) | 1991-12-30 |
DE4017902A1 (de) | 1990-12-20 |
PL285595A1 (en) | 1991-04-08 |
DE69023701D1 (de) | 1996-01-04 |
DD295039A5 (de) | 1991-10-17 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
RU2009539C1 (ru) | Плата расширения вычислительной системы | |
US6501660B1 (en) | Reliable card detection in a CPCI system | |
CA2046356C (en) | Method and apparatus for improved initialization of computer system features | |
US6295565B1 (en) | RAID controller card coupled via first and second edge connectors to the system bus and on-board SCSI controller respectfully | |
KR100351653B1 (ko) | 메모리 모듈 식별 장치 및 방법 | |
CN213365380U (zh) | 一种服务器主板及服务器 | |
EP0775959A2 (en) | Method and apparatus for optimizing PCI interrupt binding and associated latency in extended/bridged PCI busses | |
CN111881074B (zh) | 电子系统、主机端装置及控制方法 | |
EP0493888A2 (en) | Personal computer with local memory expansion capability | |
US5276864A (en) | Personal computer with alternate system controller error detection | |
US6523071B1 (en) | Process and apparatus for configuring the direct memory access transfer mode of a motherboard or host computer | |
US5485585A (en) | Personal computer with alternate system controller and register for identifying active system controller | |
CN102063341A (zh) | 高密度服务器 | |
US6598109B1 (en) | Method and apparatus for connecting between standard mini PCI component and non-standard mini PCI component based on selected signal lines and signal pins | |
JP2585683B2 (ja) | Icカード及びicカードを使用する装置 | |
US6549027B1 (en) | Apparatus and method for testing for compatibility between circuit boards | |
US20220292045A1 (en) | Circuit structure with automatic pcie link configuration adjustment and method thereof | |
CN115168254A (zh) | 一种地址分配方法及电子设备 | |
CN113505033B (zh) | 线缆防插错系统、主板、子卡组件及方法 | |
KR900006547B1 (ko) | 컴퓨터용 메모리 구성장치 | |
CN115237839A (zh) | 一种在pcie外插卡中识别pcie设备的装置和方法 | |
CN116010315A (zh) | 一种硬盘背板识别系统、方法、设备及存储介质 | |
CN114138353A (zh) | 一种用于服务器的子板卡识别装置和服务器 | |
CN118210559A (zh) | 可插拔电路控制方法、装置、设备及可读存储介质 | |
CN115563040A (zh) | 一种固件信息获取方法及服务器 |