KR970078208A - Atm 네트워크에서의 atm 셀 루팅 방법 및 장치 - Google Patents

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Abstract

본 발명은 ATM 네트워크에서의 셀 루팅에 관한 것으로서, ATM 스위치에서, 셀이 전송될 때 상기 셀에 첨부된 헤더를 발생시키기 위해 입력 포트 번호, 입력 VPI 및 입력 VCI가 사용된다. 상기 입력 포트 번호 및 상기 입력 VPI는 조사 테이블(LUT)로의 포인터를 형성하기 위해 결합되고 상기 LUT 엔트리는 ITT(Input Translation Table)로의 포인터의 제1부분을 포함하고 있으며 ITT엔트리는 상기 헤더를 발생시키는데 충분한 정보를 제공한다. 상기 LUT 엔트리는 상기 ITT로의 포인터의 제2부분을 얻기 위해 상기 입력 VCI에 적용될 마스크 비트의 일부 또는 전체를 포함하고 있고 상기 마스크 비트의 갯수는 다양하며 상기 모든 마스크 비트는 1이다. 상기 마스크 비트는 0비트에 의해 상기 ITT 포인터의 제1부분과는 분리되어 있는 것을 특징으로 한다.

Description

ATM 네트워크에서의 ATM 셀 루팅 방법 및 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 입력 VPI, 입력 VCI 및 입력 포트 번호를 출력 VPI 및 출력 VCI로 번역하는 데이타 구조 및 회로 설계를 설명하는 블럭도, 제5도는 본 발명에 따른 ATM 스위치의 블럭도, 제8도는 이러한 테이블 중의 하나를 바꾸는 절차를 설정하기 위한 제1도의 상기 시스템의 두개의 테이블을 나타내는 도면이다.

Claims (14)

  1. 셀의 입력 VCI에 정보를 통합하는 신호(S1)를 발생하는 단계; 및 상기 입력 VCI가 크기 경계를 초과하는가를 결정하기 위해 상기 신호(S1)에 마스크를 사용하는 단계를 구비하는 것을 특징으로 하는 ATM 네트워크에서의 ATM 셀을 루팅하는 방법.
  2. 제1항에 있어서, 상기 셀의 입력 VPI에 정보를 구체화하는 신호(S2)를 발생하는 단계; 및 상기 마스크상의 정보를 포함하는 제1엔트리를 메모리에 저장된 제1테이블에 위치시키는데 상기 신호(S2)를 사용하는 단계를 더 구비하는 것을 특징으로 하는 방법.
  3. 제1항에 있어서, 상기 신호(S1)에 마스크를 사용하는 방법은, 상기 마스크를 변환하는 단계; 및 상기 변환된 마스크와 상기 신호(S1)를 비트식 AND 연산하는 단계를 구비하는 것을 특징으로 하는 방법.
  4. 제2항에 있어서, 상기 제1엔트리는 상기 셀의 출력 헤더상의 정보 주소인 메모리 주소(A1)상의 정보도 포함하고; 상기 방법은 적어도 상기 주소(A1)상의 정보의 일부와 상기 신호(A1)를 비트식 OR 연산하여 상기 주소(A1)를 발생시키는 단계를 더 구비하는 것을 특징으로 하는 방법.
  5. 제2항에 있어서, 상기 신호(S2)는 상기 셀의 입력 포트상의 정보도 통합하는 것을 특징으로 하는 방법.
  6. 제2항에 있어서, 상기 제1엔트리의 마스크상의 정보는 가변 길이로 되어 있는 것을 특징으로 하는 방법.
  7. 제2항에 있어서, 상기 제1엔트리의 마스크상의 정보는 제로 또는 1의 스트링을구비하고, 상기 제1엔트리는 상기 1의 스트링의 시작을 표시하는 제로 비트를 구비하는 것을 특징으로 하는 방법.
  8. 제7항에 있어서, 상기 마스크는 1의 스트링 및 미리 결정된 추가적인 1의 수를 구비하는 것을 특징으로 하는 방법.
  9. 셀의 입력 VCI에 정보를 통합하는 신호(S1)에 사용될 마스크상의 정보를 저장하는 메모리; 및 상기 입력 VCI가 크기 경계를 초과하는가를 결정하기 위해 상기 신호(S1)에 마스크를 사용하는 회로(C1)를 구비하는 것을 특징으로 하는 ATM 셀 루팅용 장치.
  10. 제9항에 있어서, 상기 정보를 상기 메모리의 마스크상에 위치시키기 위해, 상기 셀의 입력 VPI의 함수가 되는 주소(A2)를 발생하는 회로를 더 구비하는 것을 특징으로 하는 장치.
  11. 제10항에 있어서, 상기 주소(A2)는 상기 셀의 입력 포트의 함수이기도 한 것을 특징으로 하는 장치.
  12. 제10항에 있어서, 상기 주소(A2)에 상기 마스크상의 정보에 추가로 상기 메모리의 주소(A1)상에 정보가 위치될 수도 있고, 상기주소(A2)는 상기 셀의 출력 헤더상의 정보 주소이며, 상기 장치는 상기 신호(S1)와 상기 메모리의 상기 주소(A1)상의 정보를 결합하여 상기 주소(A1)를 발생시키는 회로(C2)를 더 구비하는 것을 특징으로 하는 장치
  13. 제12항에 있어서, 상기 회로(C1)는, 상기 마스크를 변환하는 변환기; 및 적어도 상기 변환된 마스크의 일부와 적어도 상기 신호(S1)의 일부를 비트식 AND 연산하는 다수의 AND 게이트를 구비하고, 상기 회로(C2)는 적어도 상기 메모리의 상기 주소(A1)상의 정보의 일부와 적어도 상기 신호(S1)의 일부를 비트식 OR 연산하는 다수의 OR 게이트를 구비하는 것을 특징으로 하는 장치.
  14. 제12항에 있어서, 상기 마스크상의 상기 정보는 제로 또는 1의 스트링을 구비하고, 상기 메모리는 상기 1의 스트링의 시작을 표시하는 제로 비트를 저장하는 것을 특징으로 하는 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019970022990A 1996-05-31 1997-05-31 Atm 네트워크에서의 atm 셀 루팅 방법 및 장치 KR970078208A (ko)

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