KR970051406A - 반도체 메모리의 기능시험방법 - Google Patents
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- G11C29/56004—Pattern generation
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Abstract
본 발명은 메모리가 고집적화됨에 따라 발생하는 다양한 형태의 불량을 검출하기 위한 반도체 메모리의 기능 시험방법 및 그 장치에 관한 것으로, 메모리에서 데이터가 0이나1로 고정되어 있는 고착형 불량(Stuck at fault)과 데이터를 1에서 0이나, 0에서 1로 변화시킬 때 데이터가 변화되지 않는 천이불량(Transition fault) 및 셀의 상태가 천이할 때 정적인 유도(Electrostatic coupling) 때문에 다른 셀에 상태 천이를 야기하는 유도성 불량(coupling fault)을 검출하기 위한 테스트 패턴으로 구성되어 Initialize→P1→P2→P3→P4→P5→P6→P7→P8→P9→P10의 순서로 동작하는 것을 특징으로 하는 반도체 메모리의 기능시험방법을 제고하여, 메모리의 대부분의 불량인 고착형 불량, 및 유도성 불량을 검출함으로써 불량 검출 효과가 탁월하며 이에 소요되는 시험 시간도 짧은 잇점이 있으며 시험절차도 간편하므로 메모리가 대용향화 되어도 효과적으로 사용할 수 있다는 효과가 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 패턴 발생기의 회로도.
제2도는 반도체 메모리 시험 절차.
Claims (2)
- 메모리에서 데이터가 0이나 1로 고정되어 있는 고착형 불량(Stuck at fault)과 데이터를 1에서 0이나, 0에서 1로 변화시킬때 데이터가 변화되지 않는 천이불량(Transition fault)을 검출하기 위한 테스트 패턴으로 구성되어 Initialize→P1→P2→P3의 순서로 동작하는 것을 특징으로 하는 반도에 메모리의 기능시험방법.
- 메모리에서 데이터가 0이나 1로 고정되어 있는 고착형 불량(Stuck at fault)과 데이터를 1에서 0이나, 0에서 1로 변화시킬때 데이터가 변화되지 않는 천이불량(Transition fault) 및 셀의 상태가 천이할 때 정적인 유도(Electrostatic coupling)때문에 다른 셀에 상태 천이를 야기하는 유도성 불량(Coupling fault)을 검출하기 위한 테스트 패턴으로 구성되어 메모리 기능시험에서 고착형 불량(Stuck at fault), 천이불량(Transition fault) 및 유도성불량(Coupling fault)을 검출하기 위하여 Initialize→P1→P2→P3→P4→P5→P6→P7→P8→P9→P10의 순서로 동작하는 것을 특징으로 하는 반도체 메모리의 기능시험방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950051475A KR100211944B1 (ko) | 1995-12-18 | 1995-12-18 | 반도체 메모리의 기능시험방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019950051475A KR100211944B1 (ko) | 1995-12-18 | 1995-12-18 | 반도체 메모리의 기능시험방법 |
Publications (2)
Publication Number | Publication Date |
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KR970051406A true KR970051406A (ko) | 1997-07-29 |
KR100211944B1 KR100211944B1 (ko) | 1999-08-02 |
Family
ID=19441076
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR1019950051475A KR100211944B1 (ko) | 1995-12-18 | 1995-12-18 | 반도체 메모리의 기능시험방법 |
Country Status (1)
Country | Link |
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KR (1) | KR100211944B1 (ko) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101778306B1 (ko) * | 2011-03-11 | 2017-09-13 | 한양대학교 에리카산학협력단 | 시공간적 개념을 사용하는 메모리 폴트 시뮬레이션 방법 및 장치 |
-
1995
- 1995-12-18 KR KR1019950051475A patent/KR100211944B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR100211944B1 (ko) | 1999-08-02 |
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