KR970029096A - 선입선출메모리를 이용한 램데이타 전송장치 및 그 방법 - Google Patents

선입선출메모리를 이용한 램데이타 전송장치 및 그 방법 Download PDF

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    • G06F5/06Methods or arrangements for data conversion without changing the order or content of the data handled for changing the speed of data flow, i.e. speed regularising or timing, e.g. delay lines, FIFO buffers; over- or underrun control therefor

Abstract

1. 청구범위에 기재된 발명이 속한 기술분야
램에 저장되어 있는 데이타를 전송하는 장치에 관한 것이다.
2. 발명이 해결하려고 하는 기술적 과제
램데이타를 전송할 시 램을 다른 용도에도 이용할 수 있도록 한다.
3. 발명의 해결방법의 요지
본 발명의 FIFO는 미리 설정된 저장영역을 가지고 있으며, 저장영역보다 작은 제1영역까지 램데이타가 라이트된 경우 제1플래그를 발생하고, 제1영역보다는 크고 저장영역보다는 작은 크기의 제2영역까지 램데이타가 라이트된 경우 제2플래그를 발생하고, 어떠한 램데이타도 라이트되어 있지 않은 경우 제2플래그를 발생하고, 어떠한 렘데이타도 라이트되어 있지 않은 경우 제3플래그를 발생한다. 그러면 본 발명의 램데이타 전송장치는 제1플래그가 발생하는 경우 제2플래그가 발생될 때까지 램데이타를 FIFO에 라이트하고, 제2플래그가 발생하는 경우에는 제3플래그가 발생될 때까지 FOFO에 라이트되어 있는 램데이타를 소정의 데이타억세스수단에 연속적으로 억세스시키는 것을 특징으로 한다.
4. 발명의 중요한 용도
시스템의 효율성을 높일 수 있다.

Description

선입선출메모리를 이용한 램데이타 전송장치 및 그 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 램데이타 전송장치에 대한 블럭다이아그램,
제2도는 본 발명에 따른 동작파형도.

Claims (6)

  1. 램데이타 전송장치에 있어서, 램과, 미리 설정된 저장영역을 가지고 있으며 상기 램에 저장되어 있는 램데이타를 라이트인에이블신호가 발생됨에 응답하여 상기 저장영역에 순차적으로 라이트하다가 상기 저장영역보다 작은 크기의 제1영역까지 램데이타가 라이트된 경우 제1플래그를 발생하고, 상기 제1영역보다는 크고 상기 저장영역보다는 작은 크기의 제2영역까지 램데이타가 라이트된 경우 제2플래그를 발생하고, 라이트된 램데이타가 없는 경우 제3플래그를 발생하는 선입선출메모리와, 상기 제1플래그가 발생되는 경우 제2플래그가 발생될 때까지 상기 라이트인에이블신호를 발생하여 상기 램에 저장되어 있는 램데이타가 상기 선입선출메모리에 라이트되도록 하는 제어수단과, 상기 제2플래그가 발생하는 경우 상기 제3플래그가 발생될 때까지 상기 선입선출메모리에 라이트되어 있는 램데이타를 연속적으로 억세스하는 데이타억세스수단으로 구성함을 특징으로 하는 장치.
  2. 제1항에 있어서, 상기 제2영역은 상기 저장영역보다 1바이트 작은 크기를 갖는 것을 특징으로 하는 장치.
  3. 램데이타 전송장치에 있어서, 램과, 미리 설정된 저장영역을 가지고 있으며 상기 램에 저장되어 있는 램데이타를 라이트인에이블신호가 발생됨에 응답하여 상기 저장영역에 순차적으로 라이트하다가 상기 저장영역보다 작은 크기의 제1영역까지 램데이타가 라이트된 경우 제1플래그를 발생하고, 상기 제1영역보다는 크고 상기 저장영역보다는 작은 크기의 제2영역까지 램데이타가 라이트된 경우 제2플래그를 발생하고, 라이트된 램데이타가 없는 경우 제3플래그를 발생하는 선입선출메모리와, 상기 제1플래그가 발생되는 경우 제2플래그가 발생될 때까지 램데이타 전송요구신호를 발생하다가 상기 제2플래그가 발생되는 경우에는 상기 제1플래그가 발생될 때까지 상기 램데이타 전송요구신호를 차단하는 램데이타 전송요구신호 발생수단과, 상기 램데이타 전송요구신호가 발생됨에 응답하여 상기 램에 저장되어 있는 램데이타중 상기 선입선출메모리에 라이트할 램데이타를 선택하고, 램데이타를 선택한 이후에는 상기 라이트인에이블신호를 발생하여 상기 선입선출메모리에 램데이타가 라이트되도록 하는 램제어수단과, 상기 제2플래그가 발생하는 경우 상기 제3플래그가 발생될 때까지 상기 선입선출메모리에 라이트되어 있는 램데이타를 연속적으로 억세스하는 데이타억세스수단으로 구성함을 특징으로 하는 장치.
  4. 제3항에 있어서, 상기 제2영역은 상기 저장영역보다 1바이트 작은 크기를 갖는 것을 특징으로 하는 장치.
  5. 램에 저장되어 있는 램데이타를 선입선출메모리에 라이트한 후 소정의 데이타억세스수단으로부터 억세스 요구가 있을 시 상기 데이타억세스수단으로 전송하는 방법에 있어서, 미리 설정된 저장영역을 가지는 상기 선입선출메모리에 제1영역까지 램데이타가 라이트된 경우 제1플래그를 발생하고, 상기 제1영역보다는 크고 상기 저장영역보다는 작은 크기의 제2영역까지 램데이타가 라이트된 경우 제2플래그를 발생하고, 어떠한 램데이타도 라이트되어 있지 않은 경우 제3플래그를 발생하는 플래그 발생과정과, 상기 제1플래그가 발생하는 경우 상기 램에 저장되어 있는 램데이타를 상기 선입선출메모리에 라이트하다가 상기 제2플래그가 발생하는 경우 그 라이트동작을 차단하는 램데이타 라이트과정과, 상기 제2플래그가 발생하는 경우 상기 데이타억세스수단의 억세스요구에 따라 상기 선입선출메모리에 라이트되어 있는 램데이타를 상기 데이타 억세스수단으로 억세스시키고 상기 제3플래그가 발생하는 경우 그 억세스 동작을 차단하는 데이타 억세스과정으로 구성함을 특징으로 하는 방법.
  6. 제5항에 있어서, 상기 제2영역은 상기 저장영역보다 1바이트 작은 크기를 갖는 것을 특징으로 하는 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100820442B1 (ko) * 2006-12-08 2008-04-10 현대자동차주식회사 차량의 도어 웨더스트립 장착구조

Families Citing this family (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6651074B1 (en) * 1999-12-20 2003-11-18 Emc Corporation Method and apparatus for storage and retrieval of very large databases using a direct pipe
US6668313B2 (en) 2001-12-21 2003-12-23 Agere Systems, Inc. Memory system for increased bandwidth
AU2003257056A1 (en) * 2002-08-22 2004-03-11 Thomson Licensing S.A. Fifo clock domain change
US7984210B2 (en) * 2006-06-20 2011-07-19 Freescale Semiconductor, Inc. Method for transmitting a datum from a time-dependent data storage means
EP2038744B1 (en) * 2006-06-22 2018-08-08 NXP USA, Inc. Method and system of grouping interrupts from a time-dependent data storage means
US20170329574A1 (en) * 2016-05-13 2017-11-16 Atmel Corporation Display controller

Family Cites Families (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4864543A (en) * 1987-04-30 1989-09-05 Texas Instruments Incorporated First-in, first-out memory with counter address pointers for generating multiple memory status flags
US4891788A (en) * 1988-05-09 1990-01-02 Kreifels Gerard A FIFO with almost full/almost empty flag
US4888739A (en) * 1988-06-15 1989-12-19 Cypress Semiconductor Corporation First-in first-out buffer memory with improved status flags
US5121346A (en) * 1989-03-31 1992-06-09 Sgs-Thomson Microelectronics, Inc. Difference comparison between two asynchronous pointers and a programmable value
US5084841A (en) * 1989-08-14 1992-01-28 Texas Instruments Incorporated Programmable status flag generator FIFO using gray code
JP3090330B2 (ja) * 1989-12-21 2000-09-18 エスジーエス―トムソン・マイクロエレクトロニクス・インコーポレイテッド 出力信号発生装置及びその方法並びにfifoメモリ
CA2065979C (en) * 1991-06-10 1999-01-19 Stephen Patrick Thompson Mode dependent minimum fifo fill level controls processor access to video memory
US5682554A (en) * 1993-01-15 1997-10-28 Silicon Graphics, Inc. Apparatus and method for handling data transfer between a general purpose computer and a cooperating processor
JPH0713898A (ja) * 1993-06-29 1995-01-17 Mitsubishi Electric Corp 半導体集積回路装置
US5406554A (en) * 1993-10-05 1995-04-11 Music Semiconductors, Corp. Synchronous FIFO having an alterable buffer store
KR950015207B1 (ko) * 1993-10-28 1995-12-23 대우전자주식회사 다단 선입 선출 버퍼 제어장치
US5506809A (en) * 1994-06-29 1996-04-09 Sharp Kabushiki Kaisha Predictive status flag generation in a first-in first-out (FIFO) memory device method and apparatus
US5434892A (en) * 1994-09-16 1995-07-18 Intel Corporation Throttling circuit for a data transfer system

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100820442B1 (ko) * 2006-12-08 2008-04-10 현대자동차주식회사 차량의 도어 웨더스트립 장착구조

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