KR960025112A - 다수의 프로세서가 하나의 캐쉬 메모리를 공유하는 시스템 장치 및 방법 - Google Patents
다수의 프로세서가 하나의 캐쉬 메모리를 공유하는 시스템 장치 및 방법 Download PDFInfo
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Abstract
본 발명은 다중 프로세서 시스템에서 하나의 보드내에 다수개의 프로세서가 존재할 시, 이 프로세서들이 사용하는 캐쉬(cache) 메모리와 스테이트(state) 및 태그(tag) 메모리를 서로 공유하도록 하여 각 프로세서에서 공급하는 어드레스를 하나의 경로를 통해 제어할 수 있도록 한 다수의 프로세서가 하나의 캐쉬 메모리를 공유하는 시스템 장치 및 방법에 관한 것으로, 종래 다수의 프로세서를 사용하는 시스템은 각 프로세서간에 캐쉬 코히어런시(coherency)를 충족시켜 주어야 하는 불편함이 있었는 바, 본 발명은 종래의 이런 문제점을 해결하기 위하여 다수의 프로세서가 하나의 공유 캐쉬 메모리 및 공유 스테이트, 태그 메모리를 두고서 이들을 제어하기 위해 각 프로세서에서 공급하는 어드레스 및 시스템 버스로 부터의 어드레스를 받아들여 하나의 경로를 통해 캐쉬 메모리와 스테이트 및 태그 메모리를 제어할 수 있도록 하는 시스템 장치 및 방법을 제공하므로써, 각 프로세서간의 캐쉬 코히어런스를 조정하기 위해 복잡한 설계를 할 필요가 없어졌으며, 기존의 2개의 프로세서가 각각의 프로세서를 관리할때 자신의 캐쉬 메모리를 수정하면서 다른쪽의 캐쉬 메모리도 수정해 주어야 하는 번거로움을 없애는 효과가 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 전체 시스템을 나타내는 블럭도이다.
Claims (3)
- 다수의 프로세서를 이용하는 시스템 장치에 있어서, 프로세서 내부에 캐쉬 메모리를 포함하는 제1프로세서부(10)와; 상기 프로세서부(10) 내부의 캐쉬 메모리와 외부의 캐쉬부(20) 사이의 스누핑 및 시스템 버스와의 스누핑을 필터링하는 제1프로세서 스누프부(10-1)와; 상기 제1프로세서부(10) 및 제1프로세서 스누프부(10-1)와 동일한 구조로 이루어진 제2프로세서부(70) 및; 제2프로세서 스누프부(70-1)와; 캐쉬 메모리(20-3)와 스테이트(20-2) 및 태그 메모리(20-1)로 이루어져 데이타를 저장하는 캐쉬부(20)와; 스테이트(30-2) 및 태그 메모리(30-1)로 이루어져 버스상에서 발생하는 동작을 스누핑하는 스누프(snoop)부(30)와; 상기 각 프로세서부(10,70)에서 출력된 어드레스와 시스템 버스로 부터 입력된 어드레스를 받아들여 캐쉬부(20)와, 스누프부(30)와 각 프로세서 스누프부(10-1, 70-10)를 제어하는 어드레스를 출력하는 어드레스 제어부(40)와; 시스템 버스로 부터 데이타를 제공받기 위해 출력된 어드레스를 잠시 저장하는 제1버퍼(50) 및; 상기 제1버퍼(50)를 통해 출력된 어드레스에 해당하는 데이타를 시스템 버스로 부터 입력받아 잠시 저장한 후, 어드레스 제어부(40)로 출력하는 제2버퍼(60)로 이루어진 것을 특징으로 하는 다수의 프로세서가 하나의 캐쉬 메모리를 공유하는 시스템 장치.
- 다수의 프로세서를 이용하는 시스템 방법에 있어서, 다수의 프로세서에서 각각 사용하는 캐쉬부의 캐쉬메모리와, 스테이트 및 태그 메모리를 서로 공유하도록 하고, 이를 제어하는 어드레스 제어부를 두어 데이타의 상태 변경시 다수의 프로세서에 내장되어 있는 캐쉬 메모리의 상태를 동시에 변경할 수 있도록 하여 각 프로세서 간의 캐쉬 코히어런스를 간단하게 조정할 수 있도록 하는 것을 특징으로 하는 다수의 프로세서가 하나의 캐쉬 메모리를 공유하는 시스템 방법.
- 제2항에 있어서, 각 프로세서 간에 캐쉬 코히어런스를 조정하는 방법은 각 프로세서(10, 70)의 데이타 요청이 완료되면, 어드레스 제어부(40)는 스누핑 어드레스(⑦)를 생성하여 각 프로세서 스누프(10-1, 70-1)로 입력하고, 상기 신호를 입력받은 각 프로세서 스누프부(10-1, 70-1)는 각 프로세서부(10, 70)의 스누핑 필요시 이에 대응하는 스누핑 어드레스(⑨,⑨')를 입력하여 각 프로세서부(10, 70) 간에 캐쉬 코히어런스를 조정하도록 하는 것을 특징으로 하는 다수의 프로세서가 하나의 캐쉬 메모리를 공유하는 시스템 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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Cited By (1)
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KR100322223B1 (ko) * | 1997-05-14 | 2002-03-08 | 포만 제프리 엘 | 대기행렬및스누프테이블을갖는메모리제어기 |
Families Citing this family (2)
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1994
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KR100322223B1 (ko) * | 1997-05-14 | 2002-03-08 | 포만 제프리 엘 | 대기행렬및스누프테이블을갖는메모리제어기 |
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KR0144093B1 (ko) | 1998-08-17 |
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