KR960018870A - 다치 논리곱 연산장치 - Google Patents
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Abstract
본 발명에서는 이진수끼리의 논리곱 연산을 포함하면서 다치 논리끼리의 논리곱 연산이 가능한 논리곱 연산법칙을 정의하고 이들의 논리곱 연산기를 제안한다.
3개의 다치 논리 입력을 갖는 논리곱 연산기는 각각 두개의 입력을 갖는 두개의 다치 논리곱 연산기로 구성된다.
이러한 다치 논리곱 연산기는 기존의 이진 논리곱 연산기의 연산기능 및 이진-다치 논리곱 연산기의 연산기능을 포함한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 따른 다치 논리곱 연산의 진리표.
제4도는 본 발명의 제1실시예.
제5도는 본 발명의 제2실시예.
Claims (1)
- 각각 소정 비트를 갖는 k(여기서, k는 임의의 양의 정수)개의 이진수 입력과 다른 하나의 이진수 입력의 다치 논리곱 연산을 수행하는 장치에 있어서; 상기 이진수 입력들의 각 비트별로 순차로 받아 들여 덧셈하는 것에 의해 상기 이진수 입력에 해당하는 다치 논리값을 구하는 산술 덧셈기와; 상기 산술 덧셈기의 출력과 이진 입력을 받아 들이는 이진-다치 논리곱 연산기를 포함하는 것을 특징으로 하는 다치 논리곱 연산장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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