KR940006366A - 디지탈 전기 통신 시스템의 고속 퍼실리티 보호 방법 및 시스템 - Google Patents

디지탈 전기 통신 시스템의 고속 퍼실리티 보호 방법 및 시스템 Download PDF

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Abstract

빠른 퍼실리티 보호 능력을 갖는 디지탈 전기 통신 시스템에 관한 것이다. 상기 시스템은 적어도 하나의 디지탈 교차 접속(2)을 포함하고, 이스트 및 웨스트 송신 포트(Eo, Wo)와 이시트 및 웨스트 수신 포트(EI,WI)를 통해 네트워크의 이스트 및 웨스트 루트(EAST, WEST)와 양방향 통신이 가능하게 된다. 상기 교차 접속(2)은 상기 이스트 및 웨스트 루트 모두에 걸쳐 퍼실리티를 방송하고, 상기루트중 하나의 루트에 걸쳐 복귀 퍼실리티를 수신한다. 상기 교차 접속(2)은 분산된 프로세스(16)에 의해 포트(E1)와 통신하여 하드 에러 조건과 초과의 에러율에 대해 수신되는 퍼실리티(E1)의 에러 상태를 감시한다. 에러의 경우 상기 교차 접속 블라인드는 제1실시예에 다라 수신 종료 절환에 의해 동작하지 않는 포트(WI)에 대해 상기 피실리티를 절환한다. 또다른 실시예에 따라 헤드 엔드 절환이 실행되어, 교차 접속(2)의 포트 할당에 대해 향상된 유연성을 가능하게 한다.

Description

디지탈 전기 통신 시스템의 고속 퍼시리티 보호 방법 및 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 바림직한 실시예가 적용되는 전기 통신 시스템의 블록도,
제3도는 본 발명의 바람직한 실시예가 실행되는 디지타교차 접소 시스템의 블록도.

Claims (16)

  1. 퍼실리티가 제1및 제2이 용장 네트워크 선로(EAST, WEST)로 부터 제1및 제2입력 포트(EI,WI)중 하나의 포트에서 교차 접속 (2)에 의해 수신되고, 헤트 출력 포트(Ho)로 통신되는 전기 통신 시스템의 교차 접속(2)에 의해 퍼실리티 보호 방법에 있어서, 에러 조건을 검출하기 위해 상기 제1입력 포트((EI)에서 수신되는 퍼실리티를 감시하는 단계(24,28,44,48)와; 상기 에러 조건을 검출에 응답하여 피실리트를 수신하기 위해 상기 헤드 출력 포트(Ho)를 상기 제2입력 포트(Wo)에 결합하는 단계936,50)를 포함하는 것을 특징으로 하는 퍼실리티 보호방법.
  2. 제2항에 있어서, 상기 감시 단계는 선정된 시간 주기에 걸쳐 수신되는 퍼실리티의 코딩 진동을 검출하는 단계(28,48)를 포함하고, 상기 에러조건은 제한을 초과하는 다수의 검출된 코딩 진동을 포함하는 것을 특징으로 하는 퍼실리티 보호방법.
  3. 제2항에 있어서, 상기 감시 단계는 수신된 퍼실리티내에서 하드 에러 신호를 검출하는 단계(24,44)를 포함 하는 것을 특징으로 하는 퍼실리티 보호방법.
  4. 제1항에 있어서, 상기 교차 접속(2)은 상기 제1및 제2의 용장 네트워크 선로(EAST, WEST)에 결합되고 헤드 입력 포트(HI)로 부터 디지탈 신호를 수신하기 위해 결합된 제1및 제2출력 포트(Eo, Wo)를 포함하고, 상기 헤등 입력 포트(HI)에서 수신되는 상기 디지탈 신호를 상기 제1및 제2네트워크 선로(ESAT, WEST), 제1및 제2출력 포트(Eo, Wo)의 모두로 방송하는 단계를 추가로 포함하는 것을 특징으로 하는 퍼실리티 보호방법.
  5. 제4항에 있어서, 상기 교차 접속(2)은 클로스 형태의 절환 매트릭스로 구성되고, 상기 방송 단계는 상기 절환 매트릭스의 제3스테이지(20n)에서 실행되게 하는 것을 특징으로 하는 퍼실리티 보호방법.
  6. 제1항에 있어서, 상기 교차 접속(2)은 클로스 형태의 절환 매트릭스로 구성되고, 상기 방송 단계는 상기 절환 매트릭스의 제3스테이지(20O)에서 실행되게 하는 것을 특징으로 하는 퍼실리티 보호방법.
  7. 제6항에 있어서, 상기 감시 단계(24,28)는 상기 제1입력 포트(EI)와 결합된 절환 매트릭스의 제1스테이지(201)에서 실행되고, 상기 절환 단계(36)는 상기 해드 출력 포트(Ho)와 결합된 절환 메트릭스의 제3스테이지(20S)에서 실행되며, 상기 제3스테이지(20S)는 상기 제1및 제2입력 포트(EI,WI)모두에 결합되어 있는 것을 특징으로 하는 퍼실리티 보호방법.
  8. 제7항에 있어서, 상기 감시 단계(48)는 상기 에러 조건의 검출후에 상기 제2입력 포트(WI)를 보호 출력 포트(PO)에 결합하는 단계(54)와; 상기 보호 출력포트(PO)에서 퍼실리티를 시험하는 단계(55)를 포함하고, 상기 절환 단계(50)는 상기 보호 출력 포트(PO)에서 퍼실리티를 감시하는 단계(55)에 응답하여 실행되는 것을 특징으로 하는 퍼실리티 보호방법.
  9. 퍼실리트 보호 능력을 갖는 교차 접속 시스템(2)에 있어서, 전기 통신 시스템의 이스트 및 웨스토 선로(EAST,WEST)로 부터 퍼실리티를 수신하는 이스트 입력 포트(EI)및 웨스트 입력 포트(WI)와, 상기 이스트 및 웨스트 입력 포트(EI,WI)중 하나의 포트에서 다른 네트워크로 수신되는 퍼실리티를 통신하기 위한 헤드 출력 포토(HO)를 포함하는 복수의 포트와; 버스(BUS)에 결합된 중앙 처리장치(12)와; 상기 버스(BUS)에 결합된 교차접속 매트릭스(20,22)와 상기 버스(BUS), 상기 이스트 및 웨스트 입력 포트(EI,WI)에 결합되고, 상기 이스트 및 웨스트 입력 포트중 하나의 포트(EI)에서 수신되는 퍼실리티를 상기 교차 접속 매트릭스(20,22)에 결합하며, 에러 조건을 검출하기 위해 수신된 퍼실리티를 감시하고, 상기 에러 조건 검출에 응답하여 상기 이스트 및 웨스트 입력 포트중 다른 포트(WO)를 상기 교차 접속 매트릭스(20,22)에 결합하기 위해 절환하는 입력/출력 처리 장치(16,18)를 포함하는 것을 특징으로 하는 교차 접속 시스템.
  10. 제9항에 있어서, 교차 접속 매트릭스는 제1스테이지(20), 중앙 스테이지(22)및 제3스테이지(20)를 갖는 클로스 매트릭스의 형태이고, 상기 입력/출력 처리 장치(16,18)는 상기 이스트 및 웨스트 입력 포트(EI,WI)와 결합되는 상기 교차 접속 매트릭스(20,22)의 제1스테이지(201)와 결합된 제1입력/출력 프로세서(161)를 구비하는데, 상기 제1입력/출력 프로세서(161)는 상기 이스트 및 웨스트 입력 포트중 동작하는 하나의 입력 포트(EI)에서 수신되는 퍼실리티를 교차 접속 매트릭시의 중앙 스테이지(221)에 결합하고, 에러 조건을 검출하기 위해 수신 되는 퍼실리티를 감시하며, 상기 에러 조건의 검출에 응답하여 상기 이스트 및 웨스트 입력 포트중 동작하지 않는 나머지 다른 하나의 입력 포트(WI)를 교차 접속 매트릭스의 중앙 스테이지(221)에 결합시키기 위해 절환하는 것을 특징으로 하는 교차 접속 시스템.
  11. 제10항에 있어서, 상기 입력/출력 처리 장치(16,18)는 상기 제1입력 입력/출력프로세서(161)에 의해 제1스테이지(201)가 결합되는 교차 접속 매트릭스의 중앙스테이지(221)에 결합된 제2입력/출력 프로세서(181)를 포함하는 것을 특징으로 하는 교차 접속 시스템.
  12. 제10항에 있어서, 교차 접속 매트릭스는 제1스테이지(20), 중앙 스테이지(22) 및 제3스테이지(20)를 갖는 클로스 매트릭스의 형태이고, 상기 입력/출력 처리 장치(16,18)는 복수의 입력/출력 프로세서(16,18)와; 상기 복수의 입력/출력 프로세서(16)중 하나의 프로세서에 각각 결합되는 복수의 제1/제3스테이지 회로(20)를 구비하며, 상기 제1/제3스테이지 회로중 첫번째 회로(201)에 대응하는 상기 이스트 입력 포트(EI)는 상기 복수의 입력/추력 프로세서중 첫번째 프로세서(161)에 의해 제어되고, 상기 제1/제3스테이지 회로중 두번째 회로(202)에 대응하는 상기 웨스트 입력 포트(WI)는 복수의 입력/출력 프로세서중 두번째 프로세서(162)에 의해 제어되며, 상기 제1/제3스테이지 회로의 상기 제1및 제2회로(201,202)는 상기 헤드 출력 포트(HO)에 대응하는 상기 제1/제3스테이지 회로중 세번째 회로(20S)에 결합되고, 상기 복수의 입력/출력 프로세서의 세번째 프로세서(163)에 의해 제어 되는 것을 특징으로 하는 교차 접속 시스템
  13. 제12항에 있어서, 상기 입력/출력 프로세서중 첫번째 프로세서(161)는 상기 복수의 제1/제3스테이지 회로의 첫번째 회로(201)에 서 수신되는 퍼실리티이 감시를 제어하며, 상기 복수의 입력/출력 프로세서중 세번째 프로세서(20S)는 상기 제1/제3스테이지 회로중 세번째 회로(20S)에서 상기 이스트 및 웨스트 포트중 동작하지 않는 하나의 포트(WI)로 절환을 제어하는 것을 특징으로 하는 교차 접속 시스템.
  14. 제13항에 있어서, 상기 제1/제3스테이지 회로중 세번째 회로(20S)는 보호 출력 포트(PO)를 추가로 구비하고, 에러 조건의 검출에 응답하여 상기 제1/제3스테이지 회로중 세번째 회로(20S)는 상기 이스트 및 웨스트 포트중 동작하지 않는 하나의 포트(WI)를 감시하기 위해 상기 보호 출력 포트(PO)로 절환하는 것을 특징으로 하는 퍼실리티 보호방법.
  15. 제1및 제2송신 선로(EAST,WEST)와; 제1교차 접속(2)을 구비하고, 상기 제1교차 접속(2)은 상기 제1및 제2송신 선로(EAST, WEST)로 부터 제1퍼실리티를 수신하기 위한 제1및 제2입력 포트(EI,WI)와, 제1퍼실리티를 나타내는 헤드 출력 포트(HOO)를 포함하는 복수의 포트와; 버스(BUS)에 결합되는 중앙 처리 장치(12)와; 상기 버스(BUS)에 결합되는 교차 접속 매트릭스(20,22)와; 상기 버스(BUS)에 결합되는 중앙 처리 장치(12)와; 상기 버스(BUS)에 결합되는 교차 접속 매트릭스(20,22)와; 상기 버스(BUS), 상기 제1및 제2입력 포트(EI,WI)에 결합되고, 상기 제1및 제2입력 포트중 하나의 포트(EI)에서 수신되는 퍼실리티를 상기 교차 접속 매트릭스(20,22)에 결합하며, 에러 조건을 검출하기 위해 상기 퍼실리티를 감시하고, 상기 에러 조건을 검출에 응답하겨 상기 제1및 제2입력 포트중 다른 포트(WI)를 상기 교차 접속 매트릭스(20,22)에 결합하기 위해 절환하는 입력/출력 처리 장치(16,18)를 포함하는 것을 특징으로 하는 디지탈 전기 통신 시스템.
  16. 용장 광섬유 선로를 제공하는 필요성을 제거하기 위한 방식으로 광섬유 선로(13)를 포함하는 전기 통신시스템을 위한 선로 보호를 제공하는 방법에 있어서, 상기 광섬유 선로(13)에 대해 용장 루트(15)를 제공하는 단계와; 상기 광섬유 선로(13)와 용장 루트(15)에 걸쳐 교차 접속(2)에 퍼실리티를 방송하는 단계를 포함하는데, 상기 교차 접속(2)은 각각 상기 광섬유 선로(13) 및 용장 루트(15)에 결합된 제1및 제2포트(6E,6W)와 상기 수신된 퍼실리티를 제공하며 교차 접속 매트릭스(20,22)를 통해 상기 제1포트(6E 또는 EI)에결합된 헤드 포트(HO)를 가지며;에러 조건을 검출하기 위해 상기 제1포트(EI)에서 수신된 퍼실리티를 감시하는 단계(24,28,4,48)와; 에러조건의 검출을 응답하여 상기 퍼실리티를 수신하기 위해 상기 헤드 포트(HO)를 상기 제2포트(WI)에 결합하는 단계(36,50)를 포함하는 것을 특징으로 하는 선로 보호 제공방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930013185A 1992-07-17 1993-07-14 디지탈 전기 통신 시스템의 고속 퍼실리티 보호 방법 및 시스템 KR940006366A (ko)

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