KR930020903A - 바이트트래킹 시스템 및 방법 - Google Patents

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KR930020903A
KR930020903A KR1019930004835A KR930004835A KR930020903A KR 930020903 A KR930020903 A KR 930020903A KR 1019930004835 A KR1019930004835 A KR 1019930004835A KR 930004835 A KR930004835 A KR 930004835A KR 930020903 A KR930020903 A KR 930020903A
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bus
buffer memory
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multiplexer
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KR1019930004835A
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English (en)
Inventor
슈-파이 쵸이 헨티
Original Assignee
로마스 더블류. 암스트롱
어드밴스드 마이크로 디바이스즈, 인코포레이티드
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    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38—Information transfer, e.g. on bus
    • G06F13/40—Bus structure
    • G06F13/4004—Coupling between buses
    • G06F13/4009—Coupling between buses with data restructuring
    • G06F13/4018—Coupling between buses with data restructuring with data-width conversion

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  • General Physics & Mathematics (AREA)
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Abstract

바이트트킹시스템(60)은 32-비트광역시스템 데이타베이스(34)를 가진다. 시스템버스 인터페이스유니트(48)는 시스템(34)를 송신 FIFO 버퍼메모리(42)에 연결해서 FIFO 버퍼메모리(42)에 4-바이트 데이타워드(62)를 공급한다. FIFO 버퍼메모리(42)는 워드 판독 및 기록접근성을 구비한다. 32-비트 광역버스(66)는 4:1 멀티플랙서(64)를 FIFO 버퍼메모리(42)의 출력측에 연결시킨다. 멀티플렉서(64)는 데이타워드(62)에서 8-비트출력버스(68)까지 수정바이트(63)를 다중화하는데 이용한다. 바이트트래커회로(70)는 멀티플렉서(64)를 제어하고, 출력버스(68)에 전송되는 바이트(63)를 결정한다. 출력버스(68)에 공급된 바이트(63)는 직렬비트연속으로 병렬 대 직렬컨버터(69)에 의해 직렬비트 연속으로 변환되어지고, 맨체스터 인코더/디코더(36)에 공급한다.

Description

바이트트래킹 시스템 및 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 시스템을 도시한 블럭도이다.
제2도는 제1도에 따른 시스템의 일부분을 더욱 상세히 도시한 블럭도이다.
제3도는 제1도에 따른 시스템을 이용한 데이타포멧을 나타낸 도면이다.

Claims (6)

  1. 서로 다른 폭을 가진 제1버스와 제2버스 사이에 다중바이트 워드데이타를 전송하는 시스템으로서, 상기 제1버스에 연결된 시스템인터페이스, 상기 제2버스에 연결된 멀티플렉서, 상기 멀티플렉서에 연결된 버퍼메모리 출력버스, 상기 제1버스와 부합하는 폭을 가진 시스템인터페이스버스에 의해 상기 시스템인터페이스에 연결된 입력을 구비하여, 관련된 다중비트바이트 유효영역으로 된 다중바이트데이타영역에서 각 다중바이트워드를 기억하도록 구조되며, 상기 제1버스와 부합하는 촉을 가진 상기 버퍼메모리출력버스에 연결된 출력을 구비한 선입선출버퍼 메모리 및, 상기 선입선출버퍼메모리의 바이트 유효영역과 상기 선입선출버퍼메모리에서 상기 제2버스까지 유효바이트를 제공하는 상기 멀티플렉서의 동작을 제어하기 위한 상기 멀티플렉서에 연결된 바이트트래커등으로 이루어짐을 특징으로 하는 바이트트래킹 시스템.
  2. 제1항에 있어서, 상기 제2버스에 연결되어 직렬비트연속과 같은 유효바이트를 제공하는 병렬대 직렬 컨버터로 또한 이루어짐을 특지으로 하는 바이트트래킹 시스템.
  3. 제1항에 잇어서, 상기 바이트트래커는 유효바이트를 결정하는 논리, 유효바이트를 결정하는 상기 논리에 연결된 마스크상태기 및 유효바이트를 결정하는 상기 논리에 연결된 우선인코더를 포함함을 특징으호 하는 바이트트래킹 시스템.
  4. 서로 다른 폭을 가진 제1버스와 제2버스 사이에 다중바이트 워드데이타를 전송하는 방법으로서, 선입선출버퍼메모리 다중바이트워드를 기억하는 방법, 선입선출버퍼메모리에 다중바이트워드 각각에 필요한 관련된 다중 비트바이트 유효데이타를 기억하는 방법, 다중비트바이트 유효데이타를 이용하는 유효데이타를 포함하고 다중 바이트워드의 바이트를 결정하는 방법 및 멀티플렉서에서 다중바이트워드로부터 제2버스까지 유효바이트를 공급하는 방법등으로 이루어짐을 특징으로 하는 바이트트래킹 방법.
  5. 제4항에 있어서, 병렬데이타연속에서 직렬비트연속까지 제2버스에 공급된 유효바이트를 전환하는 방법으로 또한 이루어짐을 특징으로 하는 바이트트래킹 방법.
  6. ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930004835A 1992-03-27 1993-03-26 바이트트래킹 시스템 및 방법 KR930020903A (ko)

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