KR930008812B1 - 엔진용 점화신호 분배회로 - Google Patents
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Abstract
내용 없음.
Description
제 1 도는 본 발명의 제 1 실시예에 관한 엔진용 점화신호 분배회로의 회로도.
제 2 도 및 제 3 도는 제 1의 실시예에 의한 회로 각부의 각 신호 파형도.
제 4 도는 본 발명의 제 2의 실시예에 관한 엔진용 점화신호 분배회로의 회로도.
제 5 도 및 제 6 도는 제 2의 실시예에 의한 회로 각부의 각 신호 파형도.
제 7 도는 종래의 엔진용 점화신호의 분배회로의 회로도.
제 9 도 및 제 10 도는 종래의 회로 각부의 각 신호 파형도.
본 발명은 엔진의 실린더별로 점화신호를 분배하는 엔진용 점화신호 분배회로에 관한 것이다.
종래의 엔진용 점화신호의 분배회로를 제 7 도에 도시한다. 제 7 도에 있어서, (1)은 RS 플립플롭의 리세트 입력단자(R)이 반전형 리세트 입력단자()로 구성되어 있는플립플롭(이하,-FF라 한다)로서, 세트 입력단자(S)에 실린더 식별센서(도시하지 않음)의 출력신호(SG)를, 또 반전형 리세트 입력단자()에 크랭크각 센서(도시하지 않음)의 출력신호(SCR)를 입력하도록 구성되어 있다. 상기 실린더 식별센서는 엔진의 제 1 실린더(#1) 및 제 4 실린더(#4)를 식별하였을 때에 그 출력신호(SG)를 논리「1」(이하 「1」이라 한다)레벨로 해서 실린더 식별신호를 출력하고, 상기 크랭크각 센서는 상기 엔진의 각 실린더의 소정 크랭크 각 구간마다 그 출력신호(SCR)을 「1」레벨로 해서 크랭크각 신호를 출력한다. (2)는 상기 실린더 식별센서 출력(SG)와 상기 크랭크각 센서출력(SCR)을 「1」레벨로 해서 크랭크각 신호를 출력한다. (2)는 상기 실린더 식별센서 출력(SG)와 상기 크랭크 센서출력(SCR)을 입력하고, 그들의 정보를 기본으로 양점화 신호용 신호(Sc),(Sd)를 연산 출력하는 점화신호 연산장치이다. (3)은 크랭크각 센서출력(SCR)을 입력함과 동시에-FF1의 반전출력단자()에서 출력되는신호(Sa)를 입력해서 신호(Sb)를 출력하는 NAND 게이트이다. (4),(5)는 NOR 게이트, (6),(7)은 1반전 입력형 AND 게이트로서, 각 1 입력 단자가 크랭킹 스위치신호(SSW)를 입력하도록 구성되어 있다. 또, NOR 게이트(4)는 신호(SC)를, NOR 게이트(5)는 신호(Sd)를 입력하도록 구성되어 있다. 1반전 입력형 AND 게이트(6)은 그 반전 입력단자에신호(Sa)를, 또 1반전 입력형 AND 게이트(7)은 그 반전 입력단자에 신호(Sb)를 입력하도록 구성되어 있다. (8)은 각 입력단자 NOR 게이트(4) 및 1반전 입력형 AND 게이트(6)의 각 출력단자에 접속된 OR 게이트로서, 엔진의 제 1 실린더(#1)과 제 4 실린더(#4)에 제 1의 점화신호(S1G1)을 분비한다. (9)는 각 입력단자가 NOR 게이트(5) 및 1반전 입력형 AND 게이트(7)의 각 출력단자에 접속된 OR 게이트로서, 엔진의 제 2 실린더(#2)와 제 3 실린더(#3)에 제 2의 점화신호(S1G2)를 분배한다.
제 9 도는 상기 구성의 엔진용 점화신호 분배회로의 각 부의 신호파형을 도시하고 있다. 동일 도면에 도시한 바와 같이 시점(t1)에서 전원이 ON으로 되고, 엔진의 시동을 개시시키는 스타터(도시하지 않음)에 전원을 공급하기 위한 크랭킹 스위치(도시하지 않음)가 시점(t1)후의 시점(t2)에서 OFF에서 ON으로 조작되어 크랭킹 스위칭신호(SSW)가 OFF에서 「1」의 ON 신호로 변화하였을 때에 크랭크각 센서출력(SCR)이 논리 「0」(이하, 「0」이라고 한다)레벨일때에는 그후 제 1, 제 2의 점화신호 (S1G1)(S1G2)가 OR 게이트(8),(9)에서 교대로 소정의 타이밍으로 출력된다.
더욱, 상세하게 설명하면 실린더식별 센서출력(SG)가 「O」이고 크랭크각 센서출력(SCR)이 「0」일때에는 이들의 출력신호를 입력하고 있는-FF1의신호(Sa)는 「1」이다. 그후, 크랭크각 센서출력(SCR)이 「1」로 되더라도신호(Sa)는 변화하지 않는다. 크랭킹 스위치(SSW)가 「1」일때에는 NOR 게이트(4),(5)가 무효로 되고, 1반전 입력형 AND 게이트(6),(7)이 유효로 된다. NAND 게이트(3)의 출력신호(Sb)는신호(Sb)가 「1」일때이고, 크랭크각 센서출력(SCR)이 「1」일때에만 「0」으로 된다. 따라서, 이 신호 (Sb)의 「0」을 반전하는 1반전 입력형 AND게이트(7)의 출력이 「1」로 되고, OR 게이트(9)에서 제 2의 점화신호(S1G2)가 출력된다. 또, 크랭킹 스위치신호(SSW)가 「0」일때에는 NOR 게이트(4),(5)가 유효로 되고, 반전 입력형 AND 게이트(6),(7)이 무효로 된다. 따라서, 신호(Sd)가 「0」일때에 NOR 게이트(5)의 출력이 「1」로 되고, OR 게이트(9)에서 제 2의 점화신호(S1G2)가 출력된다. 이 신호(Sd)는 신호(Sb)와 대략 동상으로 동파형을 이루고 있다.
또,-FF1의신호(Sa)는 양 입력이 「1」로 되고, 그후 실린더식별 센서출력(SG)와 크랭크각 센서출력(SCR)이 「1」로 되었을때에 「0」으로 되고, 그 크랭크각 센서출력(SCR)이 「0」으로 되면 재차 「1」로 된다. 크랭킹 스위치신호(SSW)가 「1」일때에는신호(Sa)가 「0」일때에 1반전 입력형 AND 게이트(6)의 출력이 「1」로 되고, OR 게이트(8)에서 제 1의 점화신호(S1G1)이 출력된다. 또, 크랭킹 스위치신호(SSW)가 「0」일때에는 신호(SC)가 「0」일때에는 NOR 게이트(4)의 출력이 「1」로 되고, OR 게이트(8)에서 제 1의 점화신호(S1G1)이 출력된다. 이 신호(SC)는 신호(Sa)와 대략 동상으로 동파형을 이루고 있다.
종래의 엔진용 점화신호 분배회로는 이상과 같이 구성되어 있으므로, 제 10 도에 도시한 바와 같이 시점(t3)에서 전원이 투입되고, 그후 시점(t6)보다 전의 시점(t5)에서 크랭킹 스위치신호(SSW)가 ON 신호로 변화하고, 크랭크각 센서출력(SCR)이 시점(t3)~(t6) 사이에서 「1」로 되면, 시점(t3)~(t6) 사이에서는 세트단자(S)에 「0」을 입력하고, 반전형 리스트 입력단자()에 「1」을 입력하면,-FF1에서 출력되는신호(Sa)는에서 「0」 또는 「1」로 되지만, 가령 「0」으로 되었다고 하면, 1반전 입력형 AND 게이트(6)의 출력신호는 크랭킹 스위치신호(SSW)의 상태에 의존하여 시점(t5)~(t6)사이에서 「1」로 되어 OR 게이트(8)에서 「1」의 제 1의 점화신호(S1G1)이 출력되고, 그후 시점(t6)에서-FF1의 양 입력이 「0」으로 되므로,신호(Sa)가 「1」로 되고, 1반전 입력형 AND 게이트(6)의 출력이 「0」으로 변화하고, 본래 제 1의 점화신호(S1G1)이 발생해서는 안되는 시점(t5)~(t6)사이에 발생해 버리는 등의 문제가 있었다.
본 발명의 목적은 상기한 문제를 해결하기 위해 이루어진 것으로 점화신호를 소정의 타이밍으로 발생해서 엔진의 실린더별로 분배하는 것에 의해 오동작하지 않도록 한 엔진용 점화신호 분배회로를 제공하는 것이다.
본 발명에 관한 엔진용 점화신호 분배회로는 실린더식별 센서출력, 크랭크각 출력 및 시동정보에 따라서 엔진의 실린더별로 점화신호를 분배하는 회로에 있어서, 전원투입시부터 크랭크각 신호가 발생하는 경우에는 이 크랭크각 신호 또는 시동정보를 상기 크랭크각 신호가 발생하고 있지 않는 영역까지 지연시키는 지연회로를 마련한 것이다.
본 발명에 있어서의 지연회로는 전원투입시부터 크랭크각 신호가 발생하는 경우에는 이 신호를 입력하는 플립플롭의 상태가 불안정하게 되어 에러 점화신호가 발생하므로, 처음에 크랭크각 신호를 제거해서 플립플롭의 상태를 특정하여 에러 점화신호의 발생을 방지하던가 또는 크랭크각 신호와 시동정보의 변화한 정보에서 에러 점화신호가 발생하므로, 처음의 크랭크각 신호의 발생영역외로 시동정보의 변화를 지연시켜서 에러점화신호의 발생을 방지한다.
이하, 본 발명의 1실시예를 도면에 다라서 설명한다. 제 1 도는 본 발명의 1실시예에 관한 엔진용 점화신호 분배회로를 도시한 것으로, 동일 도면에 있어서 제 7 도와 동일부호의 부분은 동일 또는 상당부분을 나타내고, 그 설명을 생략한다. (10)은 지연회로로서, 크랭크각 센서출력(SCR)을 입력단자(11)에 입력하고, 전원투입시의 초기에 「1」의 크랭크각 신호를 제거하고, 그후 크랭크각 센서출력(SCR)과 동상 동파형의 출력신호 (Sh1)을 출력단자(12)로 출력한다. 이 출력단자(12)는-FF1의 반전형 리세트 입력단자(), 점화신호 연산장치(2)의 1입력단자, NAND 게이트(3)의 1입력단자에 종래의 크랭크각 센서 출력(SCR)의 입력라인대신에 접속되어 있다. (13a)는 양 단자(11),(12)사이에 접속된 저항이고, 출력단자(12)와 접지사이에는 다이오드(14a), 저항(15), 콘덴서(16)이 직렬 접속되어 있다. (17)은 NAND게이트로서, 한쪽의 입력단자가 입력단자(11)에 접속되고, 다른쪽의 입력단자가 콘덴서(16)의 비접지측에 접속된 인버터(18)의 출력단자에 접속되고, 출력단자가 다이오드(14a)와 저항(15)의 접속점에 접속되어 있다. Se는 NAND 게이트(17)의 출력신호, Sf는 콘덴서(16)의 전압레벨, Sg는 인버터(18)의 출력신호이다. 지연회로(10)는 부호(11),(12),(13a),(14a),(15)~(18)의 구성요소로 구성되어 있다.
다음에, 동작에 대해서 설명한다. 제 2 도에 있어서, 시점(t1)에서 전원이 ON 하였을때에는, 크랭크각 센서출력(SCR)은 「0」이다. 이 때문에, NAND 게이트(17)의 출력(Se)가 「1」로 되어 저항(15)를 거쳐서 콘덴서(16)을 충전 개시한다. 그후, 시점(t10)으로 되면, 콘덴서(16)의 전압레벨(Sf)가 소정레벨에 도달해서 인버터(18)의 출력(Sg)가 「1」에서 「0」으로 반전한다. 인버터(18)에서 이 「0」의 신호를 입력하는 NAND 게이트(17)의 출력(Se)는 시점(t10) 이후에 크랭크각 센서출력(SCR)이 「1」로 되더라도 항상 「1」로 되고, 이 상태를 유지한다. 이것에 의해, 크랭크각 센서출력(SCR)이 「1」로 되더라도 다이오드(14a)를 거쳐서 풀다운되는 일없이 그대로 출력단자(12)에 신호(Sh1)로서 인가된다. 따라서, 크랭크각 센서출력(SCR)과 지연회로(10)의 출력(Sh1)은 동상 동파형으로되므로, 제 9 도와 마찬가지로 신호 파형으로 된다.
다음에, 제 3 도에 있어서 시점(t3)에서 전원이 투입되었다고 한다. 시점(t3)으로부터 시점(t11)까지는 크랭크각 센서출력(SCR)은 「1」로 되어 있다. 또, 콘덴서(16)의 전압레벨(Sf)는 「0」이므로, 인버터(18)의 출력(Sg)는 「1」이다. 따라서, NAND 게이트(17)의 출력(Se)는 「0」으로 되어 콘덴서(16)은 충전되지 않는다. 이 시점(t3)~(t11)사이의 크랭크각 센서출력(SCR)의 「1」레벨은 저항(13a)와 다이오드(14a)를 거쳐서 풀다운도므로, 지연회로(10)의 출력(Sh1)은 「0」으로 된다. 그후, 시점(t11)로 되면, 크랭크각 센서출력(SCR)이 「0」으로 변화하고, 시점(t11) 이후의 동작은 제 2 도의 시점(t1) 이후의 동작과 동일하게 되므로, 그 설명을 생략한다. 제 10 도와 비교하여도 알 수 있는 바와 같이 전원투입시부터 크랭킹 스위치신호(SSW)가 ON 신호로 되더라도 지연회로(10)의 출력(Sh1)은 초기에 「0」이므로, 제 10 도와 같은 에러 점화신호가 발생하지 않는다. 시점(t11) 이후의 상태는 제 9 도의 시점(t4) 이후와 동일하므로, 제 1, 제 2의 점화신호(S1G1),(S1G2)가 OR 게이트(8),(9)에서 소정의 정확한 타이밍으로 교대로 출력된다.
제 4 도는 본 발명의 제 2의 실시예에 의한 점화신호 분배회로의 회로도이다. 제 1 도의 제 1의 실시예와 다른 부분은 크랭크각 센서출력(SCR)의 입력라인에 저항(13a)와 다이오드(14a)를 접속하는 대신에 크랭킹 스위치신호(SSW)의 입력라인에 저항(13b)와 다이오드(14b)를 마찬가지로 접속한 부분이다. 지연회로(20)은 (11),(13b),(14b),(15)~(18)의 구성요소로 구성된다. 그 이외의 구성에 의해서는 제 1의 실시예와 마찬가지이므로, 제 1 도와 동일부호를 붙여서 그 설명을 설명한다.
다음에, 제 2의 실시예의 동작에 대해서 설명한다. 제 5 도에 있어서 제 2 도에서 설명한 것과 마찬가지인 동작에 의해 NANA 게이트(17)의 출력(Se)는 전원투입시점(t1)에서 「1」이므로, 시점(t1)후의 시점(t20)에서 크랭킹 스위치신호(SSW)가 「1」로 변화하여도 저항(13b)와 다이오드(14b)를 거쳐서 풀다운되는 일이 없고, 또 그 시점(t20)후도 동일하게 된다. 따라서, 크랭킹 스위치신호(SSW)가 저항(13b)를 통과하였을 때의 신호(Sh2)는 크랭킹 스위치신호(SSW)와 동일하게 되어 제 9 도와 동일한 신호파형을 얻을 수가 있다.
또, 제 6 도에 있어서, 제 3 도에서 설명한 것과 마찬가지인 동작에 의해 NAND 게이트(17)의 출력(Se)는 전원투입시점(t3)으로부터 시점(t11)까지의 사이는 「0」이고, 그후 「1」로 변화한다. 시점(t3)~(t11)사이의 시점(t21)에서 크랭킹 스위치신호(SSW)가 「1」로 변화하면, 저항(13b) 및 다이오드(14b)를 거쳐서 풀다운되므로, 신호(Sh2)는 「0」으로 된다. 그대로의 상태가 계속되고, 시점(t11) 이후에는 NAND 게이트(17)의 출력(Se)가 제 3 도에서 설명한 것과 마찬가지로 해서 「1」로 되므로, 「1」의 크랭킹 스위치신호(SSW)는 풀다운되지 않기 때문에 신호(Sh2)가 「1」로 된다. 따라서, 전원투입시점(t3)으로부터 시점(t11)까자의 초기기간, 크랭크각 센서출력(SCR)이 「1」일때에는 신호(Sh2)가 「0」이므로, 양 1반전 입력형 AND 게이트(6),(7)이 무효로 되고, 이 초기기간에는 에러 점화신호가 발생하지 않는다.
이상과 같이 본 발명에 의하면, 실린더식별 센서출력, 크랭크각 센서출력 및 스타터 스위치신호에 따라서 엔진에 분배하는 점화신호를 생성할 때에 전원투입시부터 크랭크각 센서출력이 발생하는 경우에 이 크랭크각 신호 또는 크랭킹 스위치신호등의 시동정보를 이 크랭크신호가 발생하지 않는 영역까지 무효로 시키도록 구성하였으므로, 초기기간의 크랭크각 신호에 의한 에러 점화신호의 발생을 방지할 수 있어 시동시의 정확한 점화 타이밍을 확보할 수 있고, 적은 점화챤스도 확실하게 반영할 수 있다는 효과가 있다.
Claims (4)
- 전력을 투입하는 전원, 소정의 실린더를 점화할 것인가를 식별하고, 검출된 결과에 따라서 신호를 출력하는 실린더 식별센서, 엔진이 시동되었을 때 엔진 시동정보를 출력하는 출력수단, 소정의 크랭크각을 검출하고, 그 검출된 크랭크 신호에 따라서 신호를 출력하는 크랭크각 센서, 상기 실린더 식별센서 및 크랭크각 센서의 출력신호를 입력으로 하는 플립플롭, 상기 실린더 식별센서 및 상기 크랭크각 센서의 출력신호, 상기 플립플롭의 출력, 상기 엔진 시동정보에 따라서 상기 엔진의 실린더별로 점화신호를 개별적으로 분배하는 연산회로, 상기 전원에 의한 전원투입시부터 상기 크랭크각 센서의 제 1의 출력신호의 종료까지의 기간동안 상기 크랭크각 센서의 출력신호를 지연시키는 지연회로를 포함하는 실린더 엔진용 점화신호 분배회로.
- 특허청구의 범위 제 1 항에 있어서, 상기 엔진 시동정보는 크랭킹 스위치신호인 실린더 엔진용 점화신호 분배회로.
- 전력을 투입하는 전원, 소정의 실린더를 점화할 것인가를 식별하고, 검출된 결과에 따라서 신호를 출력하는 실린더 식별센서, 엔진이 시동되었을 때 엔진 시동정보를 출력하는 출력수단, 소정의 크랭크각을 검출하고, 그 검출된 크랭크신호에 따라서 신호를 출력하는 크랭크각 센서, 상기 실린더 식별센서 및 상기 크랭크각 센서의 출력신호를 입력으로 하는 플립플롭, 상기 실린더 식별센서 및 크랭크각 센서의 출력신호, 상기 플립플롭의 출력, 상기 엔진 시동정보에 따라서 상기 엔진의 실린더별로 점화신호를 개별적으로 분배하는 연산회로, 상기 전원에 의한 전원투입시부터 상기 크랭크각 센서의 제 1의 출력신호의 종료까지의 기간동안 상기 엔진 시동정보를 지연시키는 지연회로를 포함하는 실린더 엔진용 점화신호 분배회로.
- 특허청구의 범위 제 3 항에 있어서, 상기 엔진 시동정보는 크랭킹 스위치신호인 실린더 엔진용 점화신호 분배회로.
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