KR920009194B1 - 위상 검출장치 - Google Patents

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KR920009194B1
KR920009194B1 KR1019840006402A KR840006402A KR920009194B1 KR 920009194 B1 KR920009194 B1 KR 920009194B1 KR 1019840006402 A KR1019840006402 A KR 1019840006402A KR 840006402 A KR840006402 A KR 840006402A KR 920009194 B1 KR920009194 B1 KR 920009194B1
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페트루스 마리아 비에르호프 마르티누스
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엔.브이.필립스 글로아이람펜파브리켄
아이.엠.레르너
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Abstract

내용 없음.

Description

위상 검출장치
제1도는 본 발명에 따라서 위상 검출기가 사용될 수가 있는 장치의 블럭선도.
제2도는 제1도에서 보여준 장치의 검출기(19)의 실시예.
제3도는 제2도의 검출기의 동작상태를 설명해 주기 위한 선도.
제4도는 제5도에서 보여준 회로의 동작 상태를 설명해 주기 위한 선도.
제5도는 신호 sl를 공급하는 회로(37)(제1도)의 일부분에 대한 실시예.
제6도는 제7도에서 보여준 회로의 동작상태를 보여주기 위한 선도.
제7도는 본 발명에 따른 위상 검출기(58)(제1도)의 실시예.
* 도면의 주요부분에 대한 부호의 설명
1 : 디스크형 기록 캐리어 2 : 기판
3 : 핏트 4 : 중간영역
5 : 반사층 7 : 레이저
8 : 렌즈 시스템 9 : 반투명 거울
10 : 비일 분할기 11 : 4개 광학 검출기
12 : 전류 전압 변환기 13 : 매트릭스
14 : 멀티플렉서 16 : 디 멀티플렉서
17 : 클럭 신호 생성 회로 18 : 발진기
19 : 검출기 25, 88, 81, 96 : 이퀄라이저
32, 33, 34, 35, 36, 94, 95 : 홀드 회로 37 : 처리 회로
56, 86, 87 : 비교기 58 : 위상 검출기
61 : 저역 필터 62 : 고역 필터
본 발명은 전송 매체를 경유하여 디지털 정보를 재생시키기 위한 장치, 특히 중간 영역과 교체되는 광학상 검출 가능 영역의 한 트랙의 형태로 디지털 정보가 기억되는 광학적으로 판독 가능한 기록 캐리어에 관한 것인바, 상기 장치는 클럭 신호를 생성하기 위한 발진기 수단과, 결정 레벨을 생성하기 위한 수단, 디지털 신호를 복원시키기 위해 결정 레벨과 더불어 전송 매체를 경유하여 얻어진 신호를 비교하기 위한 수단 등을 구비한다.
이러한 장치는 형식 표시 CD 100으로 N, V, Philips에 의해 제조 판매되는 ＂컴팩트 디스크 디지털 오디오＂ 플레이어 내에서 사용된다. 이 플레이어에 있어서 클럭 신호와 재생된 신호의 시간 베이스 사이 위상차를 측정한 신호가 생성되고, 위상 고정 루프에 의해서 재생 신호와 결정 레벨의 교차점에 클럭 신호의 위상을 록크시키기 위해서, 위상차는 상기 교차점에 의해서 결정된다. 위상차의 측정인 상기 신호는 상기 교차점과 클럭 신호의 엣지 사이의 시간 간역을 측정하므로써 결정된다 재생 신호가 예를 들어 디스크상의 지문 때문에, 비교적 약할 때, 이 시간 측정은 결정 레벨 잡음 등의 교차점에서 반응하기 때문에 매우 신뢰할 수가 없다. 이것은 잘못된 위상 검출과 클럭 발진기의 당연한 데튜닝(detuning)을 야기시킨다. 이 문제점을 완화시키기 위해, 위상 검출은 신호 드롭-아웃 경우에 중단된다. 그럼에도 불구하고 클럭 발진기가 데튜닝 될 수 있도록, 상기 중단 다소의 시간을 필요로 한다.
본 발명의 목적은 위상 검출이 신호 드롭 아웃동안에 덜 교란되어 제공된 서두에서 지정된 형태의 장치를 제공하는데 있다.
결국 본 발명은 상기 재생된 신호가 2개가 가능한 방향중 제1의 결정 레벨과 교차하고, 샘플이 클럭 신호와 위상 동기에 영향을 주는 제1순간의 양측상에서 재생된 신호의 진폭을 샘플링하기 위한 수단과, 상기 제1순간의 양측면상에서 결정 레벨과 샘플의 보간 사이의 진폭 차의 측정인 제1신호를 발생하기 위한 수단을 특징으로 한다.
위상차는 본 발명에 따라서 검출될 때, 위상차를 표시하는 제1신호는 교차점 둘레의 재생 신호의 경사에 비례하며 또한 이 재생 신호의 진폭에 비례한다. 신호 드롭-아웃의 경우에 있어서 이 진폭은 낮게 되어서 제1신호는 또한 작으며 클럭 발진기의 데튜닝을 발생하기가 어렵다.
본 발명에 따른 장치는 또한 샘플링을 위한 수단이 재생 신호가 제1방향에 대면한 제2방향의 결정 레벨과 교차하는, 제2순간의 양측면상에서 재생 신호의 진폭을 샘플하기 위해 채택되고, 제2신호는 상기 제2순간의 양측면에서 결정 레벨과 샘플의 보간 사이의 진폭 차의 측정을 발생하는 것을 특징으로 한다.
제1 및 제2신호의 생성에 따라서, 본 발명에 따른 장치는 제1 및 제2신호가 관계식 K+l-2m을 만족시키는 방법으로 발생되는 것을 특징으로 하며, 여기서 k 와l은 제1 혹은 제2순간의 양측면상의 샘플의 진폭이고, m은 결정 레벨의 진폭이다.
클록 발진기의 제어에 대해서, 본 발명에 따른 장치는 클럭 신호의 위상이 재생된 디지털 신호의 시간 베이스에 고정되는 방법으로 제1신호와 제2신호 사이의 차에 비례하는 신호가 발진기 수단을 제어하기 위해 상기 발진기 수단에 인가되는 것을 특징으로 한다.
디지털 신호 최정 상태의 복원을 위해 결정 레벨은 가능한 한 대칭적으로 배치되어야만 한다. 이를 달성하기 위해서 본 발명에 따른 장치는 제1신호와 제2신호의 합에 비례하는 신호가 부 궤환 신호로써 결정 레벨을 생성하기 위한 수단에 인가되는 것을 특징으로 한다.
제1 및 제2신호의 합은 양방향으로 결정 레벨과 더불어 클럭 신호와 교차점 사이의 위상차간의 차이에 비례한다. 이 차이는 부 궤환을 위해 최소화된다.
제1도는 본 발명에 따라서 위상 검출기가 사용될 수가 있는 장치를 보여준다.
제1도에 있어서 디스크형 기록 캐리어(1)는 개략 횡단면도로 나타낸다. 이 기록 캐리어는 트랙 구조가 형성되는 기판(2)을 구비하고, 트랙 구조는 피트(3)가 중간영역(4)을 구비한다. 상기 릴리프 형 트랙 구조는 반사층(5)과 투명 보호층(6)으로 도포된다. 릴리프 형 트랙 구조 안에 포함된 정보는 다음과 같이 판독된다. 레이저(7)에 의해 생성된 레이저 비임이 방출되며 렌즈 시스템(8)을 경유하여 트랙 위에 접속되고, 반사된 비임은 반투명 거울(9)과 빔 분할기(10)를 경유하여 4개 광학 검출기(11a), (11b), (11c) 및 (11d)의 인라인 어레이 상에 방출된다. 이들 광 검출기에 의해 공급된 전류는 전류 전압 변환기(12)에 의해 신호 전압 V1, V2, V3 및 V4로 변환된다.
정확한 정보 판독을 위해 렌즈 시스템(8)의 접속은 접속 제어 신호
Figure kpo00001
에 의해서 도시하지 않은 방법으로 제어된다. 방사상 트랙킹을 위해, 레이저 비임에 의해 발생된 휘점의 방사상 위치는 방사 제어 신호 RE▼에 의해서 제어된다. 이것은 정교한 제어 시스템이다. 제어 신호 CE▼의 지휘하에 방사상 방향으로 전 광학 시스템(7), (8), (9), (10), (11)을 움직이는 것은 조잡한 제어를 낳는다.
제어신호 CE▼, RE▼, 및 FE▼는 신호 전압 V1, V2, V3및 V4로 부터 유래된다. 고주파수 데이터 신호를 회복시키는데 요구된 합 V1+V2+V3+V4에 가산되어, 신호(V1+V4) - (V2+V3)는 신호 FE'에 대해 요구되고, 신호(V1+V4) - (V2+V3)는 신호 CEe'에 대해 요구된다. 모든 이들 제어 신호는 신호 V1, V2, V3및 V4를 조합하므로써 얻어진 세 신호 A', B' 및 C'로부터 유도될 수 있다. 본 실시 예에서 이들 신호들은 다음과 같다.
A' = V1+ V2
B' = V3+ V4
C' = V1+ V4
전술한 신호 V1, V2, V3및 V4의 조합은 매트릭스(13)에 의해서 구해진다. 이 조합은 네 신호 대신 세 신호만이 디지털 화되어야 하는 이점을 갖고 있어서, 이들 신호가 연속적으로 디지털화 된다면 좀 더 낮은 국부 클럭 주파수가 사용될 수가 있다. 이 목적을 위해 신호 A', V' 및 C'는 멀티플랙서(14)에 의해서 직렬 형태로 변환되고, 아날로그-디지털 변환기(15)에서 디지털화되며, 디멀티플렉서(16)에 의해 똑같은 디지털 샘플 A, B 및 C를 구하기 위한 병렬형으로 재변환된다. 멀티플렉서(14), 아날로그-디지털 변환기(15) 및 디멀티플렉서(16)는 클럭-신호 생성 회로(17)에서의 클럭 신호를 수신하고, 상기 클럭-신호 생성 회로(17)는 시료 A, B 및 C가 데이터 신호의 비트 주파수와 공기를 이루면서 공급되는 방법으로 발진기(18)의 제어하에 정확한 위상관계의 요청 클럭 신호를 제공한다.
여러 가지 제어 신호를 생성시키기 위해 가능한 한 데이터 신호 스펙트림을 억압하는 것이 중요하다. 이것은 데이터 패턴(핏트와 중간 영역)과 공기를 이루는 샘플을 선택하므로써 성취되어, 순간 샘플링 주파수는 데이터 신호의 순간 주파수와 동일하게 된다. 이 목적을 위해 각 핏트(13)과 각 중간 영역(14)에 대한 하나의 샘플은 샘플 A, B 및 C로부터 선정되고, 정보 판독의 광학 전달 함수의 효과를 최소화하기 위해서 (신호 진폭은 핏트와 관련 방출된 레이저 비임의 위치의 함수이며 핏트의 엣지를 향하여 감소된다). 샘플은 클럭 주기의 특정수보다 큰 본 실시 예에 있어서 5클럭 주기보다 큰 중간 영역과 핏트를 위해서만 취해진다. 이 목적을 위해 검출기(19)는 하나의 핏트 안에 제6샘플이 검출될 때 출력(20)에 펄스를 생성시키며 하나의 중간 영역 안에 제6샘플이 검출될 때 출력(21)에 펄스를 생성시킨다. 검출기(19)는 입력(22)에 발진기(18)에서의 클럭 신호를 수신하여 입력(23)에 가산기(25)에 의해서 구해지고 회로(24)에 의해 동등해진 신호 A와 B의 디지털 합을 수신한다.
샘플들 A,B 및 C는 각각 지연 회로(26), (27) 및 (28)에 의해 발진기(18)의 세 개의 클럭 주기(
Figure kpo00002
) 의해 각기 지연되며, 각기 이퀄라이저(29), (30) 및 (31)에 의하여 동등해지며, 각각 홀드 회로(32) 및 (33), (34) 및 (35), 그리고 (36)에 인가된다. 홀드 회로(32), (34) 및 (36)는 검출기(19)의 출력(21)상호 신호에 의해 클럭되고 홀드 회로(33)와 (35)는 출력(20)상의 신호에 의해 클럭된다. 다섯 주기보다 긴 각 중간 영역중에 샘플 A, B 및 C의 제3샘플, a, b 및 c 각각은 홀드 회로(32), (34) 및 (36) 각각의 출력(38), (40) 및 (42)상에 나타나고, 다섯 클럭 주기보다 긴 각 핏트중 샘플 A와 B의 제3샘플
Figure kpo00003
와
Figure kpo00004
각각은 홀드 회로(33)과 (35) 각각의 출력(39)와 (41)상에 나타난다.
신호 a,
Figure kpo00005
,b,
Figure kpo00006
및 c는 처리 회로(37)에 인가되고, 처리 회로는 출력(43), (44) 및 (45) 각각에 신호 RE, CE 및 FE를 공급하며, 출력(46), (47), (48) 및 (49) 각각에 트랙의 손실을 표시하는 신호 TL, 신호 드롭-아웃 표시하는 신호 DO, 고주파수 데이타 신호의 레벨이 너무 낮은 것을 표시하는 신호 HFL 및 데이터 신호 처리용 결정 레벨인 신호 SL등을 공급한다. 신호 RE, CE 및 FE는 디지털-아날로그 변환기(50), (51) 및 (52)에 의해서 아날로그 신호로 변환되고 그 후에 증폭기(53), (54) 및 (55)에 의해 증폭되고 나서 집속과 트랙킹 제어용 아날로그 제어 신호 RE', CE' 및 FE'를 형성한다.
가산기(25)와 이퀄라이저(24)에 의해 형성된 신호 A+B의 합은 검출기(19)에 인가될 뿐만 아니라 또한 비교기(56)에 인가되고, 비교기는 디지털 데이터 신호를 복원시키기 위한 결정 레벨 SL을 수신하고 상기 디지털 데이터 신호를 출력(57)에 그리고 위상 비교기 회로(58)에 인가시키고, 상기 비교기 회로는 기록 캐리어(1) 상에 데이터 신호의 위상과 샘플 A+B의 위상을 비교하며 출력(59)에 상기 위상의 측정인 신호를 공급하며 출력(60)에 신호 A+B에 비대칭의 측정 신호를 공급하고, 상기 신호 A+B의 비대칭의 측정인 신호는 회로(37)에 인가되고, 상기 회로(37)는 제8도를 참조하여 좀더 상세히 서술될 것이다. 출력(59)상의 위상 오차 신호는 저역필터(61)를 경유하여 발진기(18)를 제어한다.
제2도는 제1도에서 보여준 장치내 검출기(19)의 실시 예이고 제3도는 제2도에서 보여준 회로의 동작을 설명하기 위한 다소의 선도를 나타낸다. 제2도에서 보여준 회로에 있어서, 이퀄라이저(24)에서의 신호 A+B는 주주파수 성분을 제거하기 위해서 입력(23)을 경유하여 고역필터(62)에 인가되고 디지털 데이터 신호를 단순 비교기(63)에 의해서 복원되는데 사용 가능하다. 장방형 데이터 신호의 엣지는 미분기와 같은 회로(64)에 의해 검출된다. 이 엣지 검출기는 카운터(65)를 개시시키고 상기 카운터는 엣지 검출기(64)에서의 펄스에 의해 규정된 순간에서의 입력(22)상의 클럭 펄스를 카운트한다. 디코더 회로(66)는 본 예에서는 6인 특정 카운트를 해독한다. 카운트 ＂여섯＂이 도달될 때, 펄스는 AND게이트(67) 및 (68)에 인가된다. 또한 게이트(67)은 반전 입력상의 복원 데이터 신호를 수신하고 게이트(68)은 비반전 입력상의 복원 데이터 신호를 수신한다. 이 결과로써 펄스는 정의 데이터 신호(3c)중에 카운트 ＂여섯＂이 도달할 때 출력(21)에 나타날 것이며 부의 데이터 신호 중에 카운트 ＂여섯＂이 도달할 때는 출력(20)상에 나타날 것이다.
이를 설명하기 위해서, 제3a도는 기록 캐리어 상의 독자적인 데이터 트랙을 모여주고 있으며, 트랙은 핏트(3)와 이들 핏트 사이에 중간 증폭(4)을 구비한다. 제3b도는 제3a도에서 보여준 트랙에서 일어나는 샘플 A+B를 보여준다. 제3c도는 비교기(63) 이후의 복원된 데이터 신호를 나타내고, 상기 데이터 신호는 핏트와 중간 영역의 길이와 일치하는 주기와 더불어 거의 장방형 신호이다. 제3d도는 데이터 신호의 엣지상에 형성된 카운터(65)에 대한 시작 펄스를 나타내고, 카운터는 제3e도에서 보여준 클럭 신호의 펄스를 카운트한다. 카운터(65)는 매번 카운트 ＂여섯＂이 도달하는 펄스를 공급하고 중간 영역인 정의 데이터 신호 동안에 펄스는 제3f도에서 보여준 출력(21)상에 나타나는 반면에 핏트인 부의 데이터 신호 동안에 펄스는 제3g도에서 보여준 출력(20)상에 나타난다. 세 클럭 주기에 의해 지연되었던 신호 A, B 및 C가 샘플로 취해진다. 제3h도는 새 클럭 주기에 의해 지연되어온 신호 A를 나타내고 있으며 신호 A동안에 홀드 회로(32)는 다섯 클럭 주기(제31도에서 보여준 신호)보다 긴 각 중간 영역에서의 제3샘플을 보유하고, 샘플 및 홀드 회로(33)는 다섯 클럭 주기(제3j도에서 보여준 신호)보다 긴 각 핏트에서의 제3샘플을 홀드한다.
제1도에서 보여준 장치에 있어서, 데이터 신호 A+B는 데이터 신호를 복원시키기 위한 비교기(56)에 인가된다. 이 비교기에 있어서 샘플 A+B는 회로(37)의 출력(49)에 나타나는 결정 레벨 SL과 비교된다. 이 결정 레벨 SL은 복원 데이터 신호가 디스크상에 핏트 패넌과 엄밀하게 일치하도록 되어야 한다. 제5도에서 보여준 바와 같이, 신호 A+B는 레벨 +와 a+b 사이에서 변화하고, 이들 레벨은 긴 중간 영역 혹은 핏트 각각의 제3샘플중에 신호 A+B의 값이다. 결정 레벨 SL용으로 채택된 제1진입은 상기 레벨 a+b와 + 사이 중간에 있어서 관계식은 다음과 같다.
니=1/2(a+b++)
이 진입은 신호 A+B가 중간 영역 혹은 핏트중에 신호의 변동에 관련 대칭적이라면 정확하다. 그러므로 레벨은 신호 A+B의 비대칭의 한 분량인 인자
Figure kpo00007
에 의해 교정되어야 한다.
제5도는 결정 레벨 SL을 생성시키는 회로(37)의 일부분에 대한 실시 예이다. 가산기(77)에 의해서 샘플 a,
Figure kpo00008
,b 및
Figure kpo00009
의 합이 결정되고 합은 분할기(80)에 의해 절반이 된다 그 1/2(a+
Figure kpo00010
+b+
Figure kpo00011
)는 비대칭을 교정시키기 위해 인자
Figure kpo00012
만큼 곱해야 한다. 그러나 상기 인자
Figure kpo00013
만큼 곱하는 것은 빠른 승산기가 1/2(a+b+
Figure kpo00014
+
Figure kpo00015
)의 상대적으로 재빠른 변동에 대처하기 위해서 사용되어야 한다는 것을 의미한다. 인자
Figure kpo00016
대신에 인자
Figure kpo00017
= (1+e)만큼 곱해지는 것이 더욱 효과적이며 두 회로(80)의 소량의 출력 신호는 가산기(81)에 의해 상기 출력 신호에 더해져야 한다는 것을 의미한다. e는 승산기(82)에 의해서 구해진다. 저역 필터(83)를 경유하여 인자 e는 위상 비교기(58)의 출력(60) 상의 신호로부터 유도된다. 인자 e는 값 1/2(a+b+
Figure kpo00018
+
Figure kpo00019
)과 비교하여 상대적으로 천천히 변화하기 때문에, 승산기(82)는 빠를 필요가 없다는 장점을 갖는다. 이 해결점의 다른 장점은 하나의 긴 핏트와 하나의 긴 중간 영역 이후 레벨 a+b와
Figure kpo00020
+
Figure kpo00021
가 제어 시스템이 실시된 후 알려질 때, 합리적으로 신뢰할 수 있는 결정 레벨 SL=1/2(a+b+
Figure kpo00022
+
Figure kpo00023
)는 정정인자 e가 알려지기 전에 출력(49)상에 나타날 것이다.
제7도는 디스크상에 기록된 데이터와 관련된 클럭신호의 위상 오차의 한 분량인 신호와 신호 A+B의 비대칭의 한 분량이고 결정 레벨 SL을 교정시키기 위해 제5도에서 보여준 회로에 인가되어야 하는 신호등을 생성시키기 위한 회로(58)의 실시 예이다. 제7도안에서 보여준 회로의 동작은 제6도를 참조하여 서술될 것이며 여기서(A+B)n-1과 (A+B)n사이에서 아날로그 신호가 선형으로 변환한다면, 상기 결정 레벨과의 교차점 Pn은 선형 보간법에 의해 결정될 수가 있다.
샘플(A+B)n-1과 (A+B)n이 나타나는 순간 사이에 정확히 중간에 배치된 순간과 관련된 교차점 Pn의 상대적인 편차는 샘플(A+B)n과 (A+B)n-1이 동기되는 순간에서의 클럭 신호와 핏트(3)의 엣지 사이의 순간 위상차의 측정이며 기록 데이터 신호 비트 주파수와 순간 위상차의 측정이다. 제6도에서 이 클럭 신호는 참조부호 Sc로 하고 위상차는 참조부호 Qn으로 한다. 핏트(3)의 다른 엣지와 일치하는 샘플(A+B)n과 (A+B)n-1사이의 결정 레벨 SL과의 교차점 Pn에 대해 순간 위상차 Qp는 동일한 방법으로 결정될 수가 있다.
합 Qp+Qn은 두 엣지의 평균 위상 편차의 한 분량이며 클럭 발진기(18)의 위상 오차의 측정인 반면에 위상오차 Qp와 Qn 사이의 차는 소요 레벨에서의 결정 레벨 SL의 편차이다. 만일 SL이 상승한다면, Qp는 증가하고 Qn은 감소하여 차 Qp-Qn은 정의 방향으로 증가한다. 만일 SL이 요구 레벨이하로 감소한다면, 차 Qp-Qn은 부로 될 것이다.
그러므로 차 Qp-Qn은 제5도에서 보여준 회로에 대한 교정인자 e의 측정이다. 위상차 Qp와 Qn은 선형 보간법에 의해 다음과 같이 결정될 수가 있다.
aQn=(A+B)n-1(A+B)n-2sl
-aQp=(A+B)m-1+(A+B)m-2sl
여기서 a는 보간 선의 경사율에 관계되는 인자이며 판독되고 있는 데이터 신호의 진폭에 비례한다. 요구신호는 제7도에서 보여준 회로에 의해서 생성된다. 샘플 A+B는 하나의 클럭 주기
Figure kpo00024
에 의해 샘플을 지연시키는 장치(85)에 연결된 입력 (84)에 인가되어서, 샘플(A+B)m과 (A+B)m-1은 정의 엣지중에 결정 레벨 SL의 교차점의 경우에 있어서 상기 장치의 입력과 출력에 나타나며, 시료(A+B)n과 (A+B)n-1는 부의 엣지중에 결정 레벨의 교차점의 경우에 있어서 상기 장치의 입력과 출력에 나타난다. 제5도에서 보여준 회로에 의해 생성된 결정 레벨은 입력(89)에 인가된다. 입력(84)상의 신호와 함께 결정 레벨 SL은 비교기(66)에 인가되고, 입력(84)의 신호가 결정 레벨 SL을 초과할 때 비교기(86)은 출력신호를 발생시킨다.
그리고 지연회로(85)의 출력의 지연신호와 함께 결정 레벨이 비교기(87)에 인가되고, 이 비교기는 결정 레벨이 지연회로(85)의 출력상의 신호보다 높을 때 출력 신호를 발생시킨다. 두 개의 비교기(86)와 (87)의 출력 신호들은 AND게이트(90)과 NAND게이트(91)에 인가되어서 AND게이트(90)은 정의 엣지중에 결정 레벨 SL의 교차점의 경우에 있어서 신호를 발생시키고 NAND게이트(91)는 부의 엣지중에 결정 레벨 sl이 교차될 때 출력을 발생시킨다. 가산기(88)에 의하여 지연소자(85)의 양측에서 얻어진 신호는 서로 더해지며 승산기(92)에 의해 구해진 결정 레벨 SL의 2배가 감산기 회로(93)에 의해 감해진다. 그 결과는 게이트(90)의 지휘하에 홀드 회로(94)와 게이트(91)의 지휘하에 홀드 회로(95)에 의해서 이루어져, 홀드 회로(94)의 출력상의 신호는 aQn과 동일하고 회로(95)의 출력상의 신호는 aQp와 동일하다.
이들 신호는 감산기 회로(97)에 의해서 감산되어서, 이 회로의 출력(59)상에 a(Qn+Qp)와 동일한 신호가 나타나며, 이 신호는 클럭 신호의 위상 오차의 한 분량인 소요 신호가 되고, 클럭 신호가 기록 데이터 신호와 고정된 위상 관계를 갖고 있음을 보장하기 위해 저역필터(61)를 경유하여 신호가 발진기(18)에 의해 교정된다. 두 개의 홀드 회로의 출력상의 신호가 가산기(96)에 의해 더해지고 나서, 이 가산기의 출력(60) 상에 a(Qn-Qp)와 동일한 신호가 나타나며 비대칭의 한 분량인 신호가 된다. 이 신호는 임계 레벨을 생성하는 장치가 인가되어서, 신호 a(Qn-Qp)가 영으로 가는 즉 위상차 Qn이 위상차 Qp와 동일하게 되는 방법으로 임계 레벨의 높이를 제어하는 제어 루프가 구해진다.
출력(59)과 (60)에 나타나는 신호는 신호 A+B의 진폭에 비례한다. 이것은 발진기(18)와 제6도에서 보여준 장치가 상대적으로 큰 위조 신호 대신에 무신호를 수신할 수 있도록, 신호 드롭-아웃 동안 생성신호가 영으로 되는 장점이 있고, 상기 위조 신호는 통상의 위상 검출기내에서 자주 일어난다.

Claims (8)

  1. 클럭 신호를 발생하기 위한 발진기 수단(18)과, 결정 레벨(32)을 발생하기 위한 수단(17)과, 정보 신호와 결정 레벨을 비교하기 위한 수단(56)을 구비하고, 정보 신호와 클럭 신호간의 위상차를 검출하기 위한 위상 검출 장치에 있어서, 정보 시호가 2개의 가능한 방향중 하나로 결정 레벨(S1)과 상호 교차하고, 상기 샘플링은 클럭 신호와 함께 위상-동기에 영향을 주는 제1순간의 양측면상에서 정보 신호의 진폭을 샘플링하기 위한 수단(58)과, 상기 제1순간의 양측면상에서 결정 레벨과 샘플 보간 사이의 진폭의 차를 측정하는 제1신호 발생용 수단(58)을 구비하며, 상기는 클럭 신호와 정보 신호 사이의 위상차의 측정인 것을 특징으로 하는 위상 검출 장치.
  2. 제1항에 있어서, 상기 제1신호를 발생하기 위한 수단(58)은 함수 K+1-2m에 부합하는 제1신호를 발생하며, 여기서 K 및 1은 제1순간의 양측면상의 샘플 진폭이며 m은 결정 레벨(SL)의 진폭인 것을 특징으로 하는 위상 검출장치.
  3. 제1항 또는 제2항에 있어서, 상기 제1신호는 상기 클럭 신호 위상이 정보 신호에 고정되는 방법으로 발진기 수단(18)을 제어하기 위한 발진기 수단(18)에 인가되는 것을 특징으로 하는 위상 검출장치.
  4. 제1항 또는 제2항에 있어서, 샘플링용 수단(58)은 정보 신호가 상기 제1방향에 대향한 제2방향으로 결정 레벨과 상호 교차하는 제2순간의 양측면상에서 재생된 신호의 진폭을 샘플하기 위해 채택하고, 제2신호는 상기 2개의 순간의 양측면상의 결정 레벨(32)과 샘플의 보간 간의 진폭차 측정을 발생하는 것을 특징으로 하는 위상 검출장치.
  5. 제4항에 있어서, 상기 제1 및 제2신호는 그들의 진폭이 관련식 K+1-2m을 만족하는 방법으로 발생되며, 여기서 K 및 1은 제1 및 제2순간의 양측면상의 진폭이고, m은 결정 레벨의 진폭인 것을 특징으로 하는 위상 검출장치.
  6. 제4항에 있어서, 상기 제1 및 제2신호 사이의 차에 비례하는 신호는 상기 클럭 신호의 위상이 정보 신호의 시간 베이스에 고정되는 방법으로 상기 발진기 수단(18)을 제어하기 위한 발진기 수단(18)에 인가되는 것을 특징으로 하는 위상 검출장치.
  7. 제4항에 있어서, 상기 신호는 부 궤환 신호로서 결정 레벨을 발생하기 위한 수단(37)에 비례하는 것을 특징으로 하는 위상 검출장치.
  8. 제7항에 있어서, 상기 정보 신호의 클럭 신호 샘플 명령이 취해져, 상기 샘플들은 합적으로 2배인 결정 레벨이 감산되는 것으로부터, 상기 클럭 신호의 한 주기만큼 지연된 샘플에 가산되며, 그 다음에 결과 신호는 제1신호를 얻기 위해 매 제1순간후의 제1홀드 회로(94)와 제2신호를 얻기 위해 매 제2순간에 대해 제2홀드 회로(95)에 기억되는 것을 특징으로 하는 위상 검출장치.
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