KR920001916A - 디지털 방식에 의한 영상신호의 동기 분리회로 - Google Patents
디지털 방식에 의한 영상신호의 동기 분리회로 Download PDFInfo
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 블럭도.
제2도는 본 발명에 따른 제1도의 구체 회로도.
제3도는 본 발명에 따른 제2도의 타이밍도.
* 도면의 주요부분에 대한 부호의 설명
10 : 노이즈 필터부 20 : 0.5H 펄스제거부
30 : 수직동기, 수평동기 구간 부가부
Claims (5)
- 영상신호의 동기 분리회로에 있어서, 디지털 변환된 복합 영상신호를 입력단(Y)을 통하여 입력하여 영상신호의 흑레벨과 동기신호의 레벨간에 드레시 홀드값을 둔 비교기준전위(Vth)와의 차에 의해 복합 동기 신호롤 출력하는 비교기(5)와, 상기 뱨교기(5)에서 출력된 복합 동기 신호를 입력하여 기준치 이하인 노이즈 펄스를 제거하는 노이즈 필터부(10)와, 상기 노이즈 필터부(10)에서 노이즈 제거된 복합 동기신호를 입력하여 짧은 주기펄스 및 수직동기 구간의 0.5H 단위의 펄스를 제거하기 위한 0.5H의 펄스 제거부(20)와, 상기 0.5H 펄스제거부(20)의 처리된 복합 동기신호를 입력하고 수직동기 및 수평동기에 구간을 부가시켜 출력하는 수직동기, 수평동기 구간 부가부(30)로 구성됨을 특징으로 하는 디지털 방식에 의한 영상신호의 동기 분리회로.
- 제1항에 있어서, 상기 노이즈 필터부(10)가 복합 동기 신호 입력단(100)으로 상기 비교기(5)에서 출력된 복합동기 신호를 입력하고 색부반송파 4체배 주파수 입력단(200)으로 입력하는 4fsc의 클럭을 클럭단(CK)을 통해 입력하여 출력단(Q1-QN)으로 시프트 출력하는 시프트레지스터(10a)와, 상기 시프트레지스터(10a)의 시프트 출력된 복합동기신호를 입력하여 기준치 이하의 노이즈를 제거하기 위해 노아게이팅시키는 N입력 노아게이트(10b)로 구성함으로 특징으로 하는 디지털 방식에 의한 영상신호의 동기 분리회로.
- 제1항에 있어서, 상기 0.5H 펄스제거부(2D)가 상기 노아게이트(10b)의 노아 출력을 리세트단으로 입력하고 상기 색부반송파 4체배 주파수 입력단(200)의 4fsc의 클럭을 클럭단(CK)으로 입력하여 수평 동기신호를 카운팅하여 출력단(Q1-Qn)으로 출력시키는 제1카운터(20a)와, 상기 제1카운터(20a)의 출력을 인가받아 수평동기를 디코딩하여 게이트 펄스를 발생시키는 제1디코더(20b)와, 상기 복합 동기신호 입력단(100)으로 복합 동기 신호를 입력하여 인버팅시켜 출력하는 인버터(20c)와, 상기 제1디코더(20b)의 수평동기 펄스 출력과 상기 인버터(20c)의 인버팅 복합 동기 신호의 출력을 입력하여 짧은 주기 펄스 및 수직동기 구간의 0.5H 단위의 펄스를 제거하기 위해 앤드게이팅시켜 출력하는 앤드게이트(20d)로 구성함을 특징으로 하는 디지털 방식에 의한 영상신호의 동기 분리회로.
- 제1항에 있어서, 상기 수직동기,수평동기 구간 부가부(30)가 상기 앤드게이트(20d)의 출력을 입력하고, 상기 색부반송파 4체배 주파수 입력단(200)의 클럭을 입력하여 라이징 에지를 검출하는 제1검출부(30a)와, 상기 제1검출부(30a)의 출력을 입력단(R)으로 입력하여 래치출력하는 RS플립플롭(30b)과, 상기 제1검출부(30a)에서 검출된 출력이 수직 블랭크 구간에서 비어있을때 상기 제1검출부(30a)의 출력을 리세트단(Reset)으로 입력하고 상기 색부반송파 4체배 주파수 입력단(200)의 클럭을 클럭단(CK)으로 입력하여 자체적으로 동기 펄스를 발생시키기 위한 제2카운터(30c)와, 상기 제2카운터(30c)의 출력을 입력하고 상기 색부반송파 4체배 주파수 입력단(200)의 클럭을 클럭단(CK)으로 입력하여 최종 수평동기신호를 발생시킴과 동시에 D플립플롭의 클럭단(CK)으로 수직동기 신호를 입력시키는 제2디코더(30d)와, 상기 제2디코더(30d)의 수평동기 신호 출력단(I1)의 출력을 입력함과 동시에 상기 색부반송파 입력단(200)의 클럭을 클럭단(CK)으로 입력하여 라이징 에지를 검출하는 제2검출부(30e)와, 상기 제1검출부(30a)의 출력단 및 상기 RS플립플롭(30b)의 출력단(Q)과 상기 제2검출부(30e)의 출력 및 상기 제2카운터(30c)의 입력단(Reset)을 선택적으로 스위칭시켜 주는 스위칭부(30g)와, 상기 노아게이트(10b)의 출력을 입력단(D)으로 입력하고 상기 제2디코더(30d)의 출력단(I2)의 출력을 클럭단(CK)로 입력하여 출력단(Q)로 수직동기신호를 최종 출력하는 D플립플롭(30f)으로 구성함을 특징으로 하는 디지털 방식에 위한 영상신호의 동기 분리회로.
- 제4항에 있어서, 상기 제1검출부(30a) 및 제2검출부(30e)가 D플립플롭과 앤드게이트로 각각 구성함을 특징으로 하는 디지털 방식에 의한 영상신호의 동기 분리회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019900008923A KR930002109B1 (ko) | 1990-06-18 | 1990-06-18 | 디지털 방식에 의한 영상신호의 동기 분리회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019900008923A KR930002109B1 (ko) | 1990-06-18 | 1990-06-18 | 디지털 방식에 의한 영상신호의 동기 분리회로 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR920001916A true KR920001916A (ko) | 1992-01-30 |
| KR930002109B1 KR930002109B1 (ko) | 1993-03-26 |
Family
ID=19300200
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019900008923A KR930002109B1 (ko) | 1990-06-18 | 1990-06-18 | 디지털 방식에 의한 영상신호의 동기 분리회로 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR930002109B1 (ko) |
-
1990
- 1990-06-18 KR KR1019900008923A patent/KR930002109B1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR930002109B1 (ko) | 1993-03-26 |
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