KR910016155A - 다수의 심볼값을 갖는 입력 신호를 인코딩하는 장치 및 방법 - Google Patents
다수의 심볼값을 갖는 입력 신호를 인코딩하는 장치 및 방법 Download PDFInfo
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명이 사용되는 시스템 장치의 상세한 도시도, 제2도는 제1도의 시스템에 사용되는 인코더 유니트의 상세한 도시도.
Claims (17)
- 인코딩될 입력 신호원과, 상기 입력 신호의 확률 평가를 제공하는 수단과, 상기 입력 신호의 억압된 데이타 버젼과 제1캐리표시를 발생하는 산술 코딩 레지스터 및 출력 처리 유니트를 포함하며, 상기 입력신호와, 상기 입력 신호의 인코드된 버젼을 발생하는 상기 확률 평가가 제공되는 산술인코더 수단과, 상기 입력 신호의 상기 인코드된 버젼을 전송 및 기억 매체에 제공하는 수단을 구비하는 다수의 심볼값을 갖는 입력 신호를 인코딩하는 장치에 있어서, 상기 산술 인코더 출력 처리 유지트는 상기 억압된 데이타 버젼이 제공되고, 상기 산술코딩 레지스터로부터 제공된 제1종류의 규정된 논리 신호의 연속적인 세트 카운트를 누산하는 상기 제1 캐리 표시에 응답하는 수단과, 제1 캐리가 카운트되는 상기 세트의 논리 신호를 통과하는 것을 표시하는 제2캐리 표시를 얻은 수단과, 상기 세트의 카운트를 누산하기 전후에 발생되어 상기 산술 코딩 레지스터로부터 얻어진 논리 신호의 세트를 출력으로써 기억 및 제공하는 수단과, 상기 기억 및 제공 수단에 상기 제2 캐리 표시를 부가하는 수단과, 상기 제2 캐리 표시에 종속하여 제1 및 제2종류의 규정된 논리 신호를 포함하는 상기 누산된 카운트와 동일한 세트수를 출력으로 제공하는 수단을 특징으로 하는 입력 신호 인코딩 장치.
- 제1항에 있어서, 제1 종류의 규정된 논리 신호는 논리 1이고, 제2종류의 규정된 논리 신호는 논리0인 것을 특징으로 하는 입력 신호 인코딩 장치.
- 제1항에 있어서, 출력으로 제공하는 수단을 상기 카운트와 동일한 세트수를 출력으로 제공하는 수단을 포함하며, 각 세트는 상기 제2 캐리 표시와 상보성인 선기술된 논리 신호를 포함하는 것을 특징으로 하는 신호 인코딩장치.
- 제3항에 있어서, 논리 1인 제2캐리 표시는 캐리 있음을 표시하고, 논리 1인 제2캐리 표시는 캐리 없음을 표시하는 것을 특징으로 하는 입력 신호 인코딩 장치.
- 제1항에 있어서, 카운트 누산 수단은 상기 제공된 억압 데이타 버젼비트를 제공하기 위해 스테이지의 예정된 수를 갖는 제1 버퍼 수단과, 상기 제1버퍼 수단에서 제1종류의 연속 논리 신호 세트 카운트를 얻은 카운터 수다을 포함하며, 상기 제1캐리 표시는 상기 제1버퍼 수단의 제1스테이지에 부가되며 상기 억압된 데이타 버젼의 비트는 상기 스테이지로 시프트되는 것을 특징으로 하는 입력 신호 인코딩 장치.
- 제5항에 있어서, 상기 스테이지의 예정된 수는 상기 세트의 각각에서 비트수와 동등한 것을 특징으로 하는입력 신호 인코딩 장치.
- 제6항에 있어서, 상기 기억 및 제공 수단은 스테이지의 예정된 수를 갖는 제2 버터 수단을 포함하며, 비트 세트는 상기 제2버퍼 수단에 제공되여 기억되는 제1버터 수단으로 부터 상기 제1종류의 모든 논리 신호를 포함하지 않으며, 상기 제2캐리 표시는 상기 제2버퍼 수단의 제1 스테이지에 부가되는 것을 특징으로 하는 입력 신호 인코딩 장치.
- 제7항에 있어서, 출력으로써 제공하는 수단은 상기 제2버퍼 수단을 통해 상기카운트와 동일한 세트수를 제공하는 수단을 포함하는 것을 특징으로 하는 신호 인코딩 장치.
- 제8항에 있어서, 상기 제1종류의 규정된 논리 신호는 논리 1이고, 상기 제2종류의 규정된 논리 신호는 논리0인 것을 특징으로 하는 입력 신호 인코딩 장치.
- 제9항에 있어서, 상기 제1및 제2 버퍼 수단에서의 스페이지수는 같고 세트에서 비트수와 동등한 것을 특징으로 하는 입력 신호 인코딩 장치.
- 제10항에 있어서, 상기 세트 각각은 비트 바이트를 포함하는 것을 특징으로 하는 입력 신호 인코딩 장치.
- 신호원에서 인코드될 입력 신호를 제공하는 단계와, 상기 입력 신호의 확률 평가를 제공하는 단계와, 상기 입력 신호의 억압된 데이타 버젼과 제1 캐리 표시를 발생하고 상기 제1캐리 표시에 응답하여 상기 억압된 데이타 버젼을 처리하는 것을 포함하며 인코드된 버젼을 발생하기 위한 상기 활률 평가에 응답하여 상기 제공된 입력 신호를 산술 인코딩하는 단계와, 전송 및 기억 매체에 상기 입력 신호의 인코드된 비젼을 제공하는 단계를 구비하는 다수의 심볼값을 갖는 입력 신호를 인코딩하는 방법에 있어서, 상기 제1 캐리 표시에 의해 수정된 상기 억압된 데이타 비젼에서 제1종류의 연속적인 규성된 논리 신호의 세트 카운트를 누산하는 단계와, 제1 캐리가 카운트되는 상기세트에서 제1 종류의 규정된 논리 신호를 통과하는 것을 표시하는 제1 캐리 표시를 얻은 방법과, 상기 세트의 카운트를 누산하기 전후에 상기제1 캐리 표시에 의해 수정된 억압된 데이타 논리 신호의 임으의 세트를 출력으로써 기억 및 제공하는 단계와, 상기 세트의 카운트를 누산하기 전후에 발생되는 상기 세트에 상기 제2캐리 표시를 부가하는 단계와, 각 세트는 사이 제2캐리 표시에 종속하여 제1 및 제2종류의 규정된 논리 신호를 포함하고 상기 누산된 카운트와 동일한 세트수를 출력으로 제공하는 단계를 특징으로 하는 입력 신호 인코딩 방법.
- 제12항에 있어서, 제1 종류의 규정된 논리 신호는 논리 1이고, 제2 종류의 규정된 논리 신호는 논리 0인 것을 특징으로 하는 입력 신호 인코딩 방법.
- 제13항에 있어서, 상기 출력으로 제공하는 단계는 상기 카운트와 동일한 세트수를 출력으로 제공하는 단계를 포함하고, 각 세트는 사이 제2 캐리 표시와 상보상인 규성된 논리 신호를 포함하는 것을 특징으로 하는 입력 신호 인코딩 방법.
- 제14항에 있어서, 논리 1인 상기 제2 캐리 표시는 캐리 있음을 표시하고, 논리 0인 상기 제2 캐리 표시는 캐리 없음을 표시하는 것을 특징으로 하는 입력 신호 인코딩 방법.
- 제15항에 있어서, 상기 세트의 각각은 비트의 예정된 수를 포함하는 것을 특징으로 하는 입력 신호 인코딩 방법.
- 제16항에 있어서, 예정된 비트수는 바이트인 것을 특징으로 하는 입력 신호 인코딩 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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