KR910008939Y1 - 부가제어헤드를 갖춘 파인모드(fine mode) 전환제어회로 - Google Patents

부가제어헤드를 갖춘 파인모드(fine mode) 전환제어회로 Download PDF

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Abstract

내용 없음.

Description

부가제어헤드를 갖춘 파인모드(fine mode) 전환제어회로
제1도는 본 고안에 따른 VTR의 모드전환제어회로의 블록도.
제2도는 본 고안에 따른 모드전환 검출용 부가제어헤드가 설치된 VTR헤드의 평면도.
제3도는 파인모드 전환제어순서를 나타낸 흐름도.
제4도는 모드전환동작의 예를 나타낸 설명도.
* 도면의 주요부분에 대한 부호의 설명
10 : A/C헤드 메카니즘 12 : 주제어헤드
14 : 보조제어헤드 20 : 펄스증폭회로
30 : 논리 연산부 40 : 서어보 블록
본 고안의 VTR의 모드전환제어시스템, 특히 기존의 A/C헤드에 제2제어헤드를 부가하여 모드전환시 발생하는 전환노이즈를 제거한 파인모드 전환제어시스템에 관한 것이다.
종래의 VTR에 있어서는 플레이중에 모드전환을 할 경우 모드전환 타이밍의 2초이상 소요되었기 때문에 비디오신호와 오디오신호에 전환노이즈가 발생하여 매그러운 모드전환이 이루어지지 못하였다.
이는 테이프가 제어헤드를 통과해야만이 비로소 연주될 모드를 알수 있기 때문이다.
따라서 본 고안에 있어서는 상기 문제점을 해결하기 위하여 기존의 A/C헤드에서 기존의 주제어헤드와 일정 간격 앞에 보조제어헤드를 설치하여 모드전환 타이밍을 미리 감지하고, 보조제어헤드로 부터 감지된 제어펄스를 모드전환의 종류에 따라 계수하여 모드전환이 요구되는 부분이 주제어헤드 위치에 정확히 도달한때에 모드 전환을 하도록 서어보블록을 제어하도록 하였다.
이하에 도면을 참조하고 본원고안을 좀더 상세히 설명한다.
제1도는 본 고안에 따른 VTR의 모드전환제어회로의 블록도이다.
제1도에서 부재번호 10은 A/C헤드 메카니즘으로서, 12는 기존의 주제어헤드, 14는 보조제어헤드이며 20은 보조제어헤드(14)로 부터의 제어펄스(CTRL)를 증폭하기 위한 펄스증폭회로, 30은 마이컴으로 된 논리연산부, 40은 서어보 블록을 나타낸다.
제2도는 제1도외 A/C헤드(10)를 좀 더 상세하게 나타낸 것으로서, 12는 주제어헤드이고, 14는 새로추가된 보조제어헤드이며, 16과 18은 기존의 오디오헤드와 오디오 소거헤드이다.
헤드(14)사이의 간격은 8.892㎜이다.
이와같이 본 고안에 있어서는 주제어헤드(12)의 소정거리 전방에 보조제어헤드(14)를 설치함에 의해 주제어헤드(12)보다 미리 제어펄스를 감지하여, 이를 펄스증폭회로(20)에서 증폭하여 논리연산부(30)에 입력시킨다.
논리연산부(30)에 있어서는 내장된 제어프로그램에 의해 제3도에 표시된 흐름도에 따라서 입력된 제어신호를 처리한다.
제3도의 흐름도를 설명하면, 단계(50)에서 프로그램이 시작되어 단계(51)로 진행하여 PB인지를 검사하며, 만약 PB일 경우 단계(52)로 진행하고, PB가 아닐경우는 최초로 돌아간다.
단계(52)에서 보조제어헤드의 주파수를 검사하여 이값을 FCT.2로 한다.
그후 단계(53)에서 30㎐에서 FCT.2값을 빼어 Y값을 구한다.
Y값을 구한후, 단계(54)에서 Y의 절대치가 3보다 큰지 작은지를 판단하다.
만약 3보다 작을 경우는 단계(52)로 되돌아가며, 3보다 더큰경우는 단계(55)로 진행한다.
단계(55)에서는 보조제어헤드로 부터의 제어펄스를 모드전환시까지 계수하며, 이를 PCT.2로 한다.
그후 다음 단계(56)에서 현재의 모드를 검사하고 이를 K로 놓는다.
다음 판정단계(57)로 진행하여 현재의 모드(K)가 SLP, SP, LP중 어느것인지를 판단한다.
만약 SLP인 경우는 단계(58)로 진행하며, 단계(58)에서는 ｜Y｜를 Z로 설정하며, 그후 단계(59)로 진행하여 Z가 5보다 크고 14보다 작거나 같은지를 검사하여 만약 Z가 14보다 클때에는 단계(62)로 진행하고, 만약 Z가 5보다 크고 14보다 작거나 같을때에는 단계(62)로 진행하며, 만약 Z가 5보다 작거나 같은때에는 단계(51)로 되돌아 간다.
Z가 5＜Z≤14인 경우는 단계(60)에서 PCT.2가 16인지를 검사하고 만약 16인 경우에는 LP모드를 수행하고, 만약 16이 아닌경우에는 단계(55)로 돌아간다.
한편 Z＞14인 경우는 단계(62)로 진행하여 PCT.2가 8인지 검사하고 만약 8인 경우에는 SP모드를 수행하고, 만약 8이 아닌경우에는 단계(55)로 돌아간다.
한편 단계(57)에서 K가 LP인 경우에는 단계(64)로 진행하여 Y가 ｜Y｜＜3인지, Y＞3인지, 또는 Y＜-3인지를 검사한다.
만약 Y＞3인 경우에는 단계(65)로 진행하여 PCT.2가 8인지를 검사하고 만약 8인 경우에는 SP모드를 수행 하고, 만약 8이 아닌 경우에는 단계(55)로 돌아간다.
만약 Y＜-3인 경우에는 단계(67)로 진행하여 PCT.2가 24인지를 검사하고 만약 24가 아닌경우에는 단계(55)로 돌아간다.
그리고 ｜Y｜＜3인 경우에는 단계(51)로 돌아간다. 마지막으로 단계(57)에서 K가 SP인 경우에는 단계(69)로 진행하여 Y가 Y＜20인지, 20＜Y＜40인지, 또는 40＜Y인지를 판단한다.
만약 20＜Y＜40인 경우에는 단계(70)로 진행하여 PCT.2가 16인지를 검사하고 만약 16인 경우에는 LP모드를 수행하며, 만약 16이 아닌 경우에는 단계(55)로 돌아간다.
단계(69)에서 40＜Y인 경우에는 단계(72)로 진행하여 PCT.2가 24인지를 검사하고 만약 24인 경우에는 SLP모드를 수행하며, 만약 24가 아닌 경우에는 단계(55)로 돌아간다.
이상과 같이 모드전환시 모드전환을 미리 감지하여 과도현상을 방지하고 파인모드전환을 이룩하였다.
제4도는 SLP모드에서 SP모드로 전환되는 동작을 설명하기 위한 도면으로 제4도에서 주제어헤드의 주파수는 30㎐이고 보조제어헤드의 주파수는 10㎐이다. 따라서 두헤드의 주파수 차이는 20㎐이다.
이는 제3도 프로그램에 따라 단계(59, 62, 63)과 같이 정확한 SP위치에서 SP모드를 수행한다.
한편 SLP모드에서 LP모드로 전환시에는 보조제어헤드의 주파수(FCT.2)는 20㎐가 되며 8.892㎜안에 존재하는 제어펄스의 수는 16개이다.
따라서 단계(60, 61)와 같이 PCT.2가 16개 감지되는 점에서 LP모드로의 전환이 이루어진다.
또한 SP모드에서 SLP모드 또는 LP모드로 전환될때에는 보조제어헤드주파수 (FCT.2)가 각각 90㎐와 60㎐가 되며, 제어 펄스수는 각각 24개와 16개이다. 따라서 PCT.2는 24개가 카운트되는 지점과 16개가 카운트되는 점에서 각각 SLP모드 또는 LP모드로의 전환이 이루어진다. 한편, LP모드에서 SLP모두 또는 SP모드로 전환되는 경우에도 FCT.2가 40㎐와 20㎐로 되고, 8.892㎜안에 존재하는 제어펄스수가 24개와 8개가 된다.
따라서 PCT.2가 24개, PCT.2가 8개 카운트되는 시점에서 모드전환을 하게되면 파인모드전환이 이루어지게 된다.

Claims (3)

  1. 현재 동작중에 있는 모드에 대한 신호를 추출하는 제1제어헤드(12), 상기 제1제어헤드(12)의 소정거리 앞에 설치되어 다음에 동작될 모드에 대한 신호를 추출하는 제9제어헤드(14), 상기 제1제어헤드(12)의 출력신호에 따라 작동하는 서어보 블록(40), 및 상기 제2제어헤드(14)의 출력신호에 의해 전환될 모드의 주파수를 검사하고, 제1제어헤드(12)의 주파수와 비교하여, 그 차이에 따라 소정의 제어펄스수를 카운트한 후 모드전환을 수행하도록 제어하는 논리연산부(30)로 구성되는 것을 특징으로 하는 부가제어헤드를 갖춘 파인모드전환 제어회로.
  2. 제1항에 있어서, 상기 제1제어헤드(12)와 상기 제2제어헤드는 A/C헤드인 것을 특징으로 하는 부가제어헤드를 갖춘 파인모드전환 제어회로.
  3. 제2항에 있어서, 상기 제1제어헤드(12)와 상기 제2제어헤드(14)와외 거리는 8.892㎜인 것을 특징으로 하는 부가제어헤드를 갖춘 파인모드전환 제어회로.
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