KR900012453A - 듀얼포트 메모리를 이용한 프로세서간 통신회로 - Google Patents
듀얼포트 메모리를 이용한 프로세서간 통신회로 Download PDFInfo
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 듀얼포트 메모리를 이용한 프로세서간 통신회로의 구성도.
Claims (1)
16비트의 제1프로세서와, 8비트의 제2프로세서와, 상기 제1 및, 제2프로세서와 연결되어 데이터를 억세스 하느 듀얼포트 메모리를 구비하 프로세서간 통신회로에 있어서, 상기 제1프로세서의 상위 바이트데이타(AD8ㅡAD15)를 ALE신호에 의해 리치하여 상기 듀얼포트 메모리의 1어드레스로 공급하는 제1래치와, 상기 제1프로세서의 하위바이트 데이터(AD0-AD7)를 ALE신호에 의해 래치하는 제2래치와, 상기ALE신호를 반전하는 인버터와, 상기 제1 및 제2래치의 출력중 AD1-AD8데이타를 입력하여 상기 인버터를 통한신호에 의해 상기 듀얼포트 메모리의 어드레스신호로 공급하는 버퍼와신호와신호를 논리곱하는 게이트와, 상기 인버터의신호에 의해 세트되어 제1제어신호를 발생하고 상기 게이트의 출력에 의해 제2제어 신호를 발생하는 플립플롭과, 상기 플립플롭의 제2제어신호에 의해 출력 인에이블되어 상기 제1프로세서의 하위바이트 데이타 또는 듀얼포트 메모리의 기록 데이타 통로를 형성하는 양방향 버퍼와, 상기 듀얼포트 메모리의및신호를 논리합하여 상기 제1프로세서의신호로 공급하는 게이트로 구성됨을 특징으로 하는 듀얼포트 메모리를 이용한 프로세서간 통신회로.
※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019890000113A KR900012453A (ko) | 1989-01-07 | 1989-01-07 | 듀얼포트 메모리를 이용한 프로세서간 통신회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019890000113A KR900012453A (ko) | 1989-01-07 | 1989-01-07 | 듀얼포트 메모리를 이용한 프로세서간 통신회로 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| KR900012453A true KR900012453A (ko) | 1990-08-04 |
Family
ID=68051370
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019890000113A KR900012453A (ko) | 1989-01-07 | 1989-01-07 | 듀얼포트 메모리를 이용한 프로세서간 통신회로 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR900012453A (ko) |
-
1989
- 1989-01-07 KR KR1019890000113A patent/KR900012453A/ko not_active Application Discontinuation
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