KR880011660A - 다수의 에러 검출, 정정 방법 및 시스템 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 따른 에러 검출 및 정정 시스템의 양호한 실시예의 계통도.
제3도는 제2도에 도시한 시스템 내에 포함된 정정 검증 발생기의 계통도.
제4도는 제2도에 도시한 시스템 내에 포함된 블록의 크기가 510바이트까지인 엔코더/나머지 발생기의 계통도.
제5도는 제2도에 도시한 시스템 내에 포함된 블록크기가 511에서 1275바이트까지인 엔코더/나머지 발생기.
Claims (20)
- 모다항식(x)=go(xh){여기서, h는 인터리빙도이고, go(x)는 (여기서, v=2m-1-2이고, α는 갤로이스 필드 GF(2m)의 원시원이다.)형태의 모다항식이다)를 갖고 있는 인터리이브-솔로몬 코드로 데이터로부터 다수의 검사 기호를 발생시키는 수단, 및 데이터에 검사 기호를 부가시키는 수단을 포함하는 것을 특징으로 하는 데이터 블록 엔코딩 방법.
- 데이터를 나타내는 신호를 수신하고, 코드워드를 나타내는 신호를 발생시키기 위한 시스템에 있어서, 데이터 신호를 수신하도록 접속된 한 셋트의 입력, 및 정정 검증 발생기 장치가 최소한 1개의 제1검사 신호를 나타내는 신호를 발생시키는 한셋트의 출력을 포함하는 정정 검증 발생기장치, 및 제1검사 기호 신호가 뒤따르는 데이터 신호를 수신하도록 접속된 한셋트의 입력 및 코드워드 신호를 발생시키는 한셋트의 출력을 포함하고, 데이터 및 제 1검사기호로부터 "데이타"로서 모다항식 g(x)=go(xh){여기서, h는 인터리빙도이고, g(x)는(여기서, v=2m-1-2이고 α는 갤로이스 필드GF(2m)의 원시원이다)현태의 보다항식이다}갖고 있는 인터리브리드-솔로문 코드로 다수의 제2검사기호를 발생시키고, 코드워드를 발생시키도록 제1 및 제2검사기호를 데이터에 부가시키시 위한 장치를 포함하는 엔토더/나머지 발생기 장치로 구성되는 것을 특징으로 하는 시스템.
- 제2항에 있어서, m=8이고, α가 GF(2)에 걸친 원시 다항식 x8+x6+x5+x4+1의 제곱근인 것을 특징으로 하는 시스템.
- 제2항에 있어서, 정정 검증 발생기 장치가 갤로이스 필드 GF(2m)에 걸친 모다항식 gv(x)-xp+1(여기서, p는 양의 정수이다)을 갖고 있는 코드로 제1검사 기호를 발생시키기 위한 장치를 포함하는 것을 특징으로 하는 시스템.
- 제4항에 있어서, p=2이고, m=8인 것을 특징으로 하는 시스템.
- 제4항에 있어서, 정정 검증 발생기 장치가 한셋트의 입력과 한셋트의 출력을 갖고 있고, 출력셋트중 대응 출력에 신호를 각각 선택적으로 결합시키기 위한 다수의 입력 게이트, 한셋트의 입력과 한셋트의 출력을 갖고 있고, 압력셋트에서 발생된 신호를 툴력 셋트중 대응 출력에 각각 선택적으로 결합시키시 위한 다수의 궤환 게이트, 한셋트의 입력과 한셋트의 출력을 갖고 있고, 입력셋트에서 발생된 신호를 출력셋트에 접속된 제2입력셋트, 및 궤한 게이트의 출력셋트에 접속된 한셋트의 입력셋트에 접속된 한셋트의 출력을 갖고 있는 반가산기, 및 궤환 게이트의 출력셋트레 접속된 한셋트의 입력과 반가산기의 제1입력셋트에 접속된 한셋트의 출력을 갖고 있는 쉬프트 레지스터 장치로 구성되는 것을 특징으로 하는 시스템.
- 제2항에 있어서, 엔코더/나머지 발생기 장치가, 한셋트의 입력과 한셋트의 출력을 갖고 있고, 출력셋트중 대응 출력에 데이타와 제1검사 기호신호를 각각 선택적으로 결합시키기 위한 다수의 입력 게이트, 한셋트의 입력과 한셋트의 출력을 갖고 있고, 입력셋트에서 발생된 신호를 출력셋트중 대응 출력에 각각 선택적으로 결합시키기 위한 다수의 궤환 게이트, 한셋트의 입력과 한셋트의 출력을 갖고 있고, 입력셋트에서 발생된 신호를 출력셋트중 대응 출력에 각각 선??적으로 결합시키기 위한 다수의 출력게이트, 입력게이트의 출력 셋트에 접속된 제1입력 셋트, 제2입력셋트, 및 출력게이트의 입력셋트와 궤환게이트의 입력 셋트에 접속된 한셋트의 출력을 갖고 있는 제1반가산기, 제1입력셋트, 제2입력셋트, 및 한셋트의 출력을 갖고 있는 제2반가산기, 제1입력셋트, 제2입력셋트 및 한셋트의 출력을 갖고 있는 제3반가산기, 제1입력셋트, 제2입력셋트, 및 한 셋트의 출력을 갖고 있는 제4반가산기, 궤환게이트의 출력셋트에 접속된 한셋트의 입력, 및 제4반가산디의 제1입력셋트와 제2반가산기의 제1입력 셋트에 접속된 한셋트의 출력기를 갖고 있는 제1조합회로?? 궤환게이트의 출력셋트에 접속된 한셋트의 입력, 및 제3반가산기의 제1입력셋트에 접속된 한셋트의 출력을 갖고 있는 제2조합회로, 제2반가산기의 출력셋트에 접속된 한 셋트의 입력, 및 제1반가산기의 제2입력셋트에 접속된 한셋트의 출력을 갖고 있는 제1쉬프트레지스터 장치, 제3반가산기의 출력셋트에 접속된 한셋트의 입력, 및 제2반가산기의 제2입력셋트에 접속된 한셋트의 출력을 갖조 있는 제2쉬프트레지스터 장치, 제4반가산기의 출력 셋트에 접속된 한셋트의 입력, 및 제3반가산기의 제2입력 셋트에 접속된 한셋트의 출력을 갖고 있는 제3쉬프트레지스터 장치, 및 제1반가산기의 출력셋트에 접속된 한셋트의 입력, 및 제4반사간시의 제2입력 셋트에 접속된 한셋트의 출력을 갖고 있는 제4쉬프트 레지스터 장치로 구성되는 것을 특징으로 하는 시스템.
- 제7항에 있어서, 엔코더/나머지 발생기 장치가 데이터, 갤로이스필드 GF(2)에 걸친 모다항식gv(x)=xp+1(여기서 p눈 양의 정수이다)을 갖고 있는 코드로 데이터로부터 발생된 제1검사 기호, 및 데이터와 제1검사기호로부터 "데이타"로서 모다항식 g(x)=go(xh)[여기서, h는 인터리빙도이고, (여기서 v=2m-1-2)이고, α는 갤로이스 필드 GF(2m)의 원시원이가)이다]를 갖고 있는 인터리브리드-솔로몬 코드로 발생된 제2검사기호를 포함하는 코드 워드를 나타내는 신호를 수신하고?? 출력게이트의 입력셋트에 접속된 한셋트의 입력, 및 출력을 갖고 있고, 코드워드내의 에러의 존재를 표시하는 신호를 에러 검출기 출력에서 발생시키기 위한 에러검출기를 포함하는 것을 특징으로 하는 시스템.
- 제7항에 있어서, 제4쉬프트레지스터 장치가 h개의 직렬접속단(x0,xl…, 및 xN-1)를 갖고 있고, 제3쉬프트 레지스터 장치가 h개의 직력접속단(xh, xh-1,…,x2h-1)을 갖고 있으며, 제2쉬프트레지스터 장치가 h개의 직렬접속단(x2h, x3h+1,… 및 x4h-1)을 갖고 있고, 있으며, h가 1보다 큰 것을 특징으로 하는 시스템.
- 제7항에 있어서, 제1조합 장치가 겔로이스 필드GF(2m)내에서 αa에 의한 승산을 수행하기 위한 장치를 사용하는 것을 특징으로 하는 시스템.
- 제7항에 있어서, 제2조합 회로가 갤로이스 필드 GF(2h)내에서 αb에 의한 승산을 수행하기 위한 장치를 사용하는 것을 특징으로 하는 시스템.
- 데이터 및 최소한 일부분의 모다항식 g(x)=go(xh)[h는 인터리빙도이고,여기서, v=2m-1-2이고, α는 갤로이스 필드 GF(2m)의 원시원이다)이다]를 갖고 있는 인터리브 리드-솔로몬 코드로 최소한 데이터로부터 발생된 검사기호를 포함하는 코드워드내의 에러를 정정하기 위한 시스템에 있어서, 코드워드의 데이터부를 수신하도록 접속되고, 선정된 주기동안 데이터를 격납시키기 위한 데이터버퍼장치 코드워드를 수신하도록 접속되고, 모다항식으로 나머지를 발생시키기 위해 다수의 쉬프트 레지스터단(x0,x1,…, 및 x4-1)을 갖고 있는 쉬프트 레지스터 장치를 포함하는 엔코더/나머지 발생기 장치, I번째 반속(여기서, i=1,2… 및 h)을 포함하는 정정처리의 h회 반복을 계수하고, 정정처리를 종료시키기 위한 신호를 발생시키기 위한 정정 반복 계수기 장치, 엔코더/나머지 발생기 장치의 xi-1번째, xi-1+h번째, xi-1+2h번째 및 xi-1+3h번째단의 쉬프트레지스터 장치의 내용을 I번째 반복시에 수신하도록 엔코더/나머지 발생기 장치에 접속되고 다항식(여기서 S0,S1,S2, 및 S3는 정정 처리의 I번째 반복시에 엔코더/나머지 발생기 장치의 쉬프트 레지스터 장치의 xi-1, xi-1+h, xi-1+2h, 및 xi-1+3h번째단의 내용과 동일하다)로부터 4개의 신드롬(여기서 J=1,2,3 및 4)를 계산하기 위한 신드롬 계산기장치, 신드롬을 수신하기 위해 신드롬 계산디 장치에 접속되고, 에러위치 다항식를 계산하기 위한 에러위치 다항식 계산기 장치, 에러위치 다항식을 수신하기 위해 에러위치 다항식 계산기 장치에 접속되고, 관련된 에러위치를 계산하기 위해 에러위치 다항식의 최소한 한 개의 제곱근 X1을 계산하기 위한 에러위치 계산기 장치, 신드롬 계산기 장치와 에러위치 계산기 장치에 접속되고, 에러위치에 관련된 에러값을 계산하기 위한 에러값 계산기 장치, 및 데이터 버퍼 장치와 에러값 계산기 장치에 접속되고, 데이터내의 에러 위치에서의 에러값을 정정하기 위한 반가산기 장치로 구성되는 것을 특징으로 하는 시스템.
- 제12항에 있어서, 에러위치 계산기 장치가 방정식 X2=X1+σ1에 의해 에러위치 다항식의 제곱근 X2을 계산하는 것을 특징으로 하는 시스템.
- 제12항에 있어서, 엔코더/나머지 발생기 장치가 신호에 응답하고, 쉬프트레지스터단내의 내머지를 쉬프트시키도록 동작하고, 엔코더/나머지 발생기 장치와 신드롬 계산기 장치에 접속되고, 선정된 기간 동안 나머지를 수신하여 저장하기 위한 나머지 버퍼장치, 및 엔코더/나머지 발생기 장치와 반가산기 장치에 접속되고, Xh내지 X2h-1단들중 최소한 1개의 단내의 비 제로값을 검출하고, X0내지 S2h-1단들중 최소한 1개의 단내의 값이 비제로일 때 엔코더/나머지 발생기 장치가 나머지를 쉬프트시키도록 엔코더/나머지 발생기 장치쉬프팅 신호를 발생시키며, 모든 X0내지 X2h-1단들 내의 값이 0일 때 X4h-1내지 X2h단들의 내용을 단일 연속 패턴으로서 수신하고, 나머지가 쉬프트 레지스터단들내에서 쉬프트되는 횟수의 계수를 발생시키며, 이 계수부터 연속 위치를 발생시키며, 나머지가 선정된 횟수만큼 쉬프트된 때를 표시하는 신호를 발생시키기 위한 에러 트램필 정정 유니트 장치로 구성되는 것을 특징으로 하는 시스템.
- 데이터, 최소한 일부분이 갤로이스 필드 GF(2m)에 걸친 모다항식 gv(x)=xp+1(여기서 p는 양의 정수이다)를 갖고 있는 코드에 의해 발생된 검사 기호의 제1그루브 데이터와 "데이타"로서 모다항식 g(x)=go(xh){여기서 h는 인터리빙도이고,(여기서, v=2m-1-2이고 α는 갤로이스 필드 GF(2m)의 원시원이다)이다를 갖고 있는 인터리브리드-솔로몬 코드로 검사기호의 제1그룹으로부터 발생된 검사 기호의 제2그룹을 포함하는 코드워드내의 에러를 정정하기 위한 시스템에 있어서, 코드워드내의 데이타 및 검사기호의 제1그룹을 수신하도록 접속되고, 최소한 1개의 바이트를 포함하는 제1나머지를 모다항식 gv(x)를 갖고 있는 코드워드로부터 발생시키기 위한 정정 검증 발생기 장치, 코드워드를 수신하도록 접속되고, 모다항식 g(x)로 제2나머지를 발생하기 위한 다수의 쉬프트 레지스터단(x0,x1,… 및 x4h-1)을 갖고 있는 쉬프트 레지스터 장치를 포함하는 엔코더/나머지 발생기 장치, 코드워드의 데이터를 수신하도록 접속되고, 선정된 기간동안 데이터를 격납시키기 위한 데이터 버퍼장치,i번째 반복(여기서, j=1,2,…,h)을 포함하는 정정처리의 h회 반복을 계수하고, 정정처리를 종료시키기 위한 신호를 발생시키기 위한 정정 반복계수기장치, 엔코더/나머지 방생기 장치의 쉬프트레지스터 장치의 xi-1번째, xi-1+h번째, xi-1+2h번째 및 xi-1+3h번째단의 내용을 매 반복시에 수신하도록 엔코더/나머지 발생기 장치에 접속되고, 다항식(여기서, S0,S1,S2및 S3은 정정 처리의 i번째 반복시에 엔코더/나머지 발생기 장치의 쉬프트 레지스터 장치의 Xi-1, Xi-1+h단의 내용과 각각 동일하다)로부터 4개의 신드롬(여기서, J=1,2,3 및 4)를 계산하기 위한 에러위치 다항식계산기 장치, 에러위치 다항식을 수신하도록 에러위치 다항식 σ(x)=X2+σ2(x)+σ1(여기서 σ1=S1S2+S0S3/Δ, σ1=(S1S3+S2 2)/Δ, 및 Δ=S2 1+S0S2)를 계산하기 위한 에러위치 다항식 계산기 장치, 에러위치 다항식을 수신하도록 에러위치 다항식 계산기 장치에 접속되고, 관련된 에러위치를 계산하기 위해 에러위치 다항식의 최소한 1개의 제곱근 X1을 계산하기 위한 에러위치 계산기 장치, 데이터 버퍼장치와 에러값 계산디 장치에 접속되고?? 데이터내의 에러위피에서의 에러값을 계산하기 위한 반가산기장치 및 에러값이 데이터 및 제1검사기호를 포함하는 코드원드로부터 계산된때 에러값을 수신하돌고 에러값 계산기 장치에 접속되고, 제1나머지 바이트를 수신하도록 정정 검증 발생기 장치에 접속되며, 2진 순차를 격납시키고, 격납된 2진 순차를 에러값과, XOR시키며, 격납 2진순서를 XOR의 결과로 대체시키고, 격납된 XOR결과를 제1나머지 바이트와 비교하며, 격납된 XOR결과가 제1나머지 바이트와 상이할때를 표시하는 신호를 발생시키는 정정 검증 유니트 장치로 구성되는 것을 특징으로 하는 시스템.
- 데이터 및 최소한 일부분이 모다항식 g(x)=go(xh){여기서, h는 인터리빙도이도,(여기서 v=2m-1-2이고, α는 갤로이스 필드 GF(2m)의 원시이다)이다}를 갖고 있는 인터리브 리드-솔로몬 코드로 최소한 데이터로부터 발생되는 검사기호를 포함하는 코드워내의 에러를 정정하기 위한 시스템에 있어서, 코드워드의 데이터부를 수신하도록 접속되고, 모다항식으로 나머지를 발생시키기 위해 다수의 쉬프트 레지스터단(X0,X1, …,X4h-1)을 갖고 있는 쉬프트레지스터 장치를 포함하며, 신호에 응답하고 쉬프트 레지스터단내의 나머지를 쉬프트시키도록 동작하는 엔코더/나머지 발생기 장치 ; 엔코더/나머지 발생기 장치에 접속되고, 나머지를 수신하여 격납시키기 위한 나머지 버퍼장치 ; I번째 반복 (여기서 I=1,2,…,h를 포함하는 정정처리의 h회 반복을 계수하고 정정 처리를 종료시키기 위한 신호를 발생시키기 위한 정정 반속계수기 장치, 나머지 버퍼장치내에 격납된 엔코더/나머지 발생기 장치의 쉬프트 레지스터 장치의 Xi-1번째, Xi-1+h번째, Xh-1+2h번째 및 Xi-1+3h번째단의 내용을 매 반복시에 수신하도록 나머지 버퍼장치에 접속되고, 다항 식 S(X)=S3X3+S2X2+S1x+S0+S5(여기서 S0,S1,S2및 S3는 정정처리의 I번째 반복시의 엔코더/나머지 발생기 장치의 쉬프트 레지스터 장치의 Xi-1, Xi-1+h, Xi-1+2h및 Xi-1+3h단의 내용과 각각 동일하다)}로부터 4개의 신드롬 Sj=S(αv+j)/α4(v+j){여기서 j=1,2,3 및 4를 계산하기 위한 신드롬 계산기장치, 신드롬을 수신하도록 신드롬 계산기 장치에 접속되고, 에러위치 다항식 σ(x)=x2+σ1x+σ2(여기서 σ1=(S1S2+S0S3)/Δ, σ2=8S1S3+S2 2)/Δ 및 Δ=S2 1+S0S2)를 계산하기 위한 에러위치 다항식 계산기 장치, 에러위지 다항식을 수신하도록 에러 위치 다항식 계산기 장치에 접속되고 관련된 에러위치를 계산하기 위해 에러위치 다항식의 최소한 1개의 제곱근 X1을 계산하기 위한 에러위치 계산기 장치, 신드롬 계산기 장치와 에러위치 계산기 장치에 접속되고, 에러위치에 관련된 에러값을 계산하기 에러값 계산기 장치, 및 엔코더/나머지 발생기 장치와 반가산기 장치와 반가산기 장치에 접속되고, X0내지 X2h-1단들중 최소한 한 개의 단내의 비제로값을 검출하고, X0내지 X2h-1단들중 최소한 1개의 단내의 값이 비제로일 때 엔코더/나머지 발생기 장치가 나머지를 쉬프트시키도록 엔코더/나머지 발생기 장치쉬프팅 신호를 발생시키며, 모든 X0내지 X2h-1단내의 값이 0일 때 X4h-1내지 X2h단의 내용을 단일 연속 패턴으로서 수신하고, 나머지가 쉬프트 레지스터단내로 쉬프트되는 횟수의 계수를 발생시키며, 이 계수로부터 연속 위치를 발생시키고, 나머지다 선정된 횟수만큼 쉬프트된 때를 표시하는 신호를 발생시키기 위한 에르트랩핑 정정 유니트장치를 포함하는 펌웨어 정정 유니트 장치 ; 및 데이터 버퍼장치, 에러트랩핑 정정 유니트 장치, 및 에러값 계산기 장치에 접속되고, 데이터내의 에러위치에서의 에러값을 정정하기 위한 반가산기 장치로 구성되는 것을 특징으로 하는 시스템.
- 갤로이스 필드 GF(2m)에 걸쳐 환산 불가능하고 갤로이스 필드 GF(2m)로부터의 기호를 갖고 있는 (22m-1)-(2m-1)과 동일한 주기를 갖고 있는 모다항식 gd(X)=x2+ax+1을 갖고 있는 해밍 코드로 데이타로부터 다수의 검사기호를 발생시키는 수단, 및 코드워드의 검사 기호를 부가시키는 수단을 포함하는 것을 특징으로 하는 데이터 블록 엔코딩방법.
- 제17항에 있어서, m=8이고, a=α9(여기서 α는 GF(2)에 걸친 원시 다항식 X8+X6+X5+X4+1의 제곱근이다)인 것을 특징으로 하는 방법.
- 데이터 및 갤로이스 필드GF(2)에 걸쳐 환산불가능하고 (22m-1)/(2m-1)과 동일한 주기를 갖고 있는 모다항식 gd(x)=x+ax+1로 데이터로부터 발생되는 검사 기호를 포함하는 코드워드내의 에러를 검출하기 위한 시스템에 있어서, 한셋트의 입력과 한셋트의 출력을 갖고 있고, 출력셋트들 중 대응 출력에 외부 발생된 신호를 각각 선택적으로 결합시키기 위한 다수의 입력게이트, 한셋트의 입력과 한셋트의 출력을 갖고 있고, 출력셋트들 중 대응 출력에 입력셋트에서 발생된 신호를 각각 선택적으로 결합시키기 위한 다수의 궤환게이트, 한셋트의 입력과 한셋트의 출력을 갖고 있고, 출력셋트들 중 대응 출력에 입력 게이트에서 발생된 신호를 각각 선택적으로 결합시키기위한 다수의 출력게이트, 입력게이트의 출력 셋트에 접속된 제1입력셋트, 제2입력셋트 및 궤환 게이트의 입력셋트와 출력게이트의 입력셋트에 접속된 한셋트의 출력을 갖고 있는 제1반가산기, 제1입력셋트, 제2입력셋트, 및 한셋트의 출력을 갖고 있는 제2반가산기, 궤환게이트의 츨력셋트에 접속된 한셋트의 입력과 제2반가산기의 제1입력셋트에 접속된 한셋트의 출력을 갖고 있는 조합회로, 제2반가산기의 출력셋트에 접속된 한셋트의 입력과 제1반가산기의 제2입력셋트에 접속된 한셋트의 출력을 갖고 있는 제1쉬프트 레지스터 장치, 및 제1반가산기의 출력셋트에 접속된 한셋트의 입력과 제2반가산기의 제2입력셋트에 접속된 한셋트의 출력을 갖고 있는 제2쉬프트레지스터 장치를 포함하는 엔코더/나머지 발생기 및 출력게이트의 입력셋트에 접속된 에러검출기로 구성되는 것을 특징으로 하는 시스템.
- 제19항에 있어서, 조합회로가 갤로이스 필드 GF(2m)내의 α에 의한 승산을 수행하기 위한 장치를 사용하는 것을 특징으로 하는 시스템.※참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US025,978 | 1987-03-16 | ||
US07/025,978 US4782490A (en) | 1987-03-16 | 1987-03-16 | Method and a system for multiple error detection and correction |
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Publication Number | Publication Date |
---|---|
KR880011660A true KR880011660A (ko) | 1988-10-29 |
Family
ID=21829127
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019880001444A KR880011660A (ko) | 1987-03-16 | 1988-02-13 | 다수의 에러 검출, 정정 방법 및 시스템 |
Country Status (3)
Country | Link |
---|---|
US (1) | US4782490A (ko) |
JP (1) | JPS63244935A (ko) |
KR (1) | KR880011660A (ko) |
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