KR880003485A - 에러검출 및 교정시스템을 갖춘 주기형 d/a 변환기 - Google Patents

에러검출 및 교정시스템을 갖춘 주기형 d/a 변환기 Download PDF

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구니히꼬 고또오
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Abstract

내용 없음

Description

에러 검출 및 교정 시스템을 갖춘 주기형 D/A 변환기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 주기형 D/A 변환기의 일예의 개략 블록도.
제4도는 제3도에 도시된 회로도의 타이밍도.
제5도는 주기형 변환기의 다른예의 개략도.

Claims (10)

  1. 에러 검출 및 교정시스템을 갖춘 주기형 D/A변환기에 있어서, 바이너리 코드를 다(多) 상태 코드로 변환하는 코드변환수단; 상기 다상태코드를 아날로그치로 변환하며, 상기 코드 변환수단에 동작적으로 접속된 디지탈 두 아날로그 변환수단; 상기 아날로그치를 디지탈 코드로 변환하며, 상기 디지탈 투 아날로그 변환수단에 동작적으로 접속된 검출수단; 및 소정 코드값에서의 상기 아날로그치와 상기 소정 코드값에 근접한 다른 아날로그치 간의 전압차를 계산하고, 상기 디지탈 코드에 의하여 상기 전압차로부터 미분 비선형 에러를 계산하여, 상기 디지탈 투 아날로그 변환수단을 형성하는 콘덴서의 에러 및 교정치를 얻는 상기 코드 변환수단, 디지탈 투 아날로그 변환수단 및 검출수단에 동작적으로 접속된 제어수단으로 구성되는 주기형 D/A 변환기.
  2. 제1항에 있어서, 상기 디지탈 투 아날로그 변환수단은 적어도 비반전 입력단자, 반전 입력단자 및 출력단자를 갖춘 연산증폭기; 상기 반전 입력단자와 상기 출력단자 사이에 제공된 제1스위칭 수단; 그의 일단에 상기 반전입력단자에 접속되며 입력단자와 상기 변환기의 출력단자 사이에서 변화하는 제2스위칭수단에 접속되는 제1콘덴서; 적어도 하나의 콘덴서와 제3스위칭수단으로 구성되며, 상기 콘덴서의 각각이 그의 일단에 상기 반전입력 단자에 접속되며 상기 제1콘덴서의 용량치와 거의 동일한 용량치를 가지며, 상기 제3스위칭수단이 표본화 모드 또는 변환모드에 따라 상기 출력단자나 기준전압단자 또는 접지단자에 선택적으로 접속되는 충전/방전 유니트; 및 다수의 보상 콘덴서와 스위치로 구성되며, 상기 보상 콘덴서와 스위치가 직렬로 접속되고, 상기 충전/방전 유니트의 각각에 병렬로 접속되는 교정 수단으로 구성되는 것을 특징으로 하는 주기형 D/A 변환기.
  3. 제1항에 있어서, 상기 다상태 코드가 3상태 크도로 이루어지는 것을 특징으로 하는 주기형 D/A 변환기.
  4. 제1항에 있어서, 상기 제어수단이 마이크로 컴퓨터로 구성되는 것을 특징으로 하는 주기형 D/A 변환기.
  5. 제1항에 있어서. 상기 제어수단은 더욱이 에러 교정회로를 포함하는 것을 특징으로 하는 주기형 D/A 변환기.
  6. 제5항에 있어서, 상기 에러 교정회로는 기준 전압과 교정될 상기 콘덴서의 전위를 비교하는 비교기, 상기 비교기로부터 결과 데이타에 따라 카운터 업 또는 카운터 다운하는 업다운 카운터, 및 보상 콘덴서에 공급되는 아날로그 전압을 나누는 승산형 D/A 변환기로 구성되는 것을 특징으로 하는 주기형 D/A 변환기.
  7. 주기형 D/A 변환기에서 디지탈 투 아날로그 변환시의 에러를 검출하고 교정하는 방법에 있어서, 바이너리 코드를 다상태 코드로 변환하는 단계; 상기 다상태 코드를 아날로그치로 변환하는 단계; 상기 아날로그치를 검출하고 다시 상기 아날로그치를 디지탈 코드로 변환하는 단계; 소정 코드값에서의 상기 아날로그치와 상기 소정코드값에 인접한 다른 코드값에서의 다른 아날로그치간의 전압차를 상기 디지탈 코드에 의하여 계산하는 단계; 근사공식을 사용하여 상기 전압차로부터 미분 비선형성 에러를 계산하는 단계; 상기 미분 비선형 에러에 의하여 교정치를 얻는 단계; 및 상기 교정치에 의하여 디지탈 투 아날로그 변환 유니트를 형성하는 콘덴서의 용량을 교정하는 단계로 구성되는 것을 특징으로 하는 에러 검출 및 교정 방법.
  8. 제7항에 있어서, 상기 소정 코드값이 ¼풀 스케일(full scale)의 위치에 설정되고 상기 소정 코드값에 인접한 상기 다른 코드값이 ¼풀 스케일-1최저의 미비트의 위치에 설정되며, 상기 디지탈 투 아날로그 변환유니트가 상기 아날로그치를 반복적으로 계산하는 1계산 회로로 구성되는 것을 특징으로 하는 에러 검출 및 교정 방법.
  9. 제7항에 있어서, 상기 디지탈 투 아날로그 변환 유니트가 상기 아날로그치를 반복적으로 계산하는 2계산회로로 구성되는 경우 상기 소정 코드값이 ¼풀 스케일과 ⅛풀 스케일의 위치에 설정되고, 상기 다른 코드값이 ¼풀 스케일-1최저의 미비트와 ⅛풀 스케일-1최저의 미비트의 위치에 설정되는 것을 특징으로 하는 에러 검출 및 교정방법.
  10. 제7항에 있어서, 상기 다상태 코드가 3상태 코드로 구성되는 것을 특징으로 하는 에러 검출 및 교정방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR8708757A 1986-08-09 1987-08-10 Cyclic type d/a converter having error detection and correction system KR900005820B1 (en)

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JP61192073A JPS6348916A (ja) 1986-08-19 1986-08-19 素子値誤差補正回路
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KR900005820B1 KR900005820B1 (en) 1990-08-11

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