KR870003437A - 실시간 다중분해 신호처리장치 - Google Patents

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KR870003437A
KR870003437A KR1019860007735A KR860007735A KR870003437A KR 870003437 A KR870003437 A KR 870003437A KR 1019860007735 A KR1019860007735 A KR 1019860007735A KR 860007735 A KR860007735 A KR 860007735A KR 870003437 A KR870003437 A KR 870003437A
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Abstract

내용 없음

Description

실시간 다중분해 신호처리장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 피라미드 처리장치와 병합한 신호처리 시스템의 한 실시예를 도시한 도면.
제2도는 본 발명의 피라미드 처리장치에 대한 양호한 실시예의 블록선도.
제3도는 제2도의 필터 로직 유니트를 구비한 하나 또는 그 이상의 필터 로직 유니트 모듀울의 블록선도.
* 도면의 주요 부분에 대한 부호설명
100:피라미드 처리장치 102:외부프레임 기억장치 104:외부 ALU 및 멀티플렉서 106:외부애널로그 프로세서 200:필터 논리장치 214:RAM1 216:RAM2 230:명령 메모리 231:어드레스 카운터 234:CPU 인터페이스 238:명령 디코우드 244:루우프 카운터 300:mxm탭 2-D 디지틀 필터

Claims (1)

  1. n차원 정보 성분의 블록들을 형성하는 순차적으로 발생하는 일시 신호 샘플들을 처리하기 위한 디지틀 기술을 이용하여 여기서 n이 최소 1인 주어진 정수인 지연 실시간 처리장치에 있어서,
    상기 장치(100)가 상기 신호샘플들의 각 계열을 처리하기 위해 각 연속시간 사이클동안 다중분해 동작을 수행하고 상기 각 계열이 각각의 정보 성분 블록을 나타내며,
    상기 시간 사이클 각각이 적어도 상기 각 계열의 일시 신호 샘플들 수만큼 큰 어떤 수의 샘플 기간으로 이루어지고,
    상기 장처(100)가 인가된(202에서) 제1디지틀 제어신호의 값에 따라서 인가된(IN1 및 IN2에서) 한 세트의 하나 이상의 샘플된 신호입력의 특정된 선택가능한 기능을 나타내는 한 세트의하나 이상의 샘플된 신호출력(예를 들면, LO)을 유도하기 위한 프로그래머블 필터 논리장치(200),
    상기 n차원의 각가에서 분리되어 어드레스 가능하고 인가된(252-258을 경유하여) 제2디지틀 제어신호의 값에 따라서 제어할 수 있는 다수의 어드레스 가능한 리드/라이트 메모리 수단(214,216),
    상기 필터논리장치의 각 출력(OUT1, OUT2)에 각기 결합된 멀티플렉서(MUX)(210,212)의 제1세트 및 필터논리장치의 각 입력(IN1, IN2)에 각기 결합된 MUX(206,208)의 제2세트를 포함하는 프로그래머블 결합수단 및,
    상기 논리장치, 메모리 수단 및 MUX 각각에 상기 제1, 제2 및 제3 디지틀 제어신호를 유도 및 인가하고 상기 각 시간 사이클의 샘플기간의 상기 어떤 수 중 각 하나동안 상기 제1, 제2, 제3 디지틀 제어신호의 각 값을 결정하기 위한 어드레스 가능한 명령 메모리 수단(230)을 포함하는 타이밍 및 제어수단을 구비하며,
    상기 MUX가 이에 인가되는 (250을 경유하여) 제3디지틀 제어신호의 값에 따라서,
    상기 필터논리장치 출력과 각기 결합된 MUX의 상기 제1세트 중 하나를 통해서 적어도 두 개의 상기 메모리 수단 중 선택된 하나에 대한 라이트-입력으로서 어느 필터논리장치 출력,
    상기 필터논리장치 입력과 각기 결합된 MUX의 제2세트 중 하나를 통해서 상기 필터논리장치 입력의 선택된 하나에 대한 상기 적어도 두 개의 메모리 수단 중의 어느 하나의 리드-출력,
    상기 필터논리장치 입력 중 선택된 하나 및 필터논리장치 출력과 각기 결합된 MUX의 제1, 제2세트 중 각기 하나를 통해서 상기 필터논리장치 입력 중 어느 선택된 하나에 대해 똑바른 어느 필터논리장치 및,
    상기 필터논리장치 입력 중 선택된 하나와 각기 결합된 MUX의 상기 제2세트 중 하나를 통해서 상기 필터논리장치 입력 중 어느 선택된 하나에 인가된(222상에서) 상기 일시 신호 샘플의 외부 계열과 선택적으로 결합하는 지연 실시간 처리장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019860007735A 1985-09-16 1986-09-15 지연 실시간 다중분해 신호 처리장치 KR900005458B1 (ko)

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Families Citing this family (28)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5148497A (en) * 1990-02-14 1992-09-15 Massachusetts Institute Of Technology Fractal-based image compression and interpolation
US5359674A (en) * 1991-12-11 1994-10-25 David Sarnoff Research Center, Inc. Pyramid processor integrated circuit
US5325449A (en) * 1992-05-15 1994-06-28 David Sarnoff Research Center, Inc. Method for fusing images and apparatus therefor
US5276513A (en) * 1992-06-10 1994-01-04 Rca Thomson Licensing Corporation Implementation architecture for performing hierarchical motion analysis of video images in real time
EP0701758B1 (en) * 1993-06-04 2000-11-02 Sarnoff Corporation System and method for electronic image stabilization
TW321748B (ko) * 1994-02-23 1997-12-01 Rca Thomson Licensing Corp
US5594853A (en) * 1995-01-03 1997-01-14 University Of Washington Method and system for editing the general sweep and detail of a figure with a curve
US5892554A (en) * 1995-11-28 1999-04-06 Princeton Video Image, Inc. System and method for inserting static and dynamic images into a live video broadcast
US20010017658A1 (en) 1996-02-29 2001-08-30 Toshihisa Kuroiwa Frame memory device and method
US6124864A (en) * 1997-04-07 2000-09-26 Synapix, Inc. Adaptive modeling and segmentation of visual image streams
US6160907A (en) * 1997-04-07 2000-12-12 Synapix, Inc. Iterative three-dimensional process for creating finished media content
US6084590A (en) * 1997-04-07 2000-07-04 Synapix, Inc. Media production with correlation of image stream and abstract objects in a three-dimensional virtual stage
US5920495A (en) * 1997-05-14 1999-07-06 Cirrus Logic, Inc. Programmable four-tap texture filter
US6188381B1 (en) * 1997-09-08 2001-02-13 Sarnoff Corporation Modular parallel-pipelined vision system for real-time video processing
US6266053B1 (en) 1998-04-03 2001-07-24 Synapix, Inc. Time inheritance scene graph for representation of media content
US6297825B1 (en) 1998-04-06 2001-10-02 Synapix, Inc. Temporal smoothing of scene analysis data for image sequence generation
US6249285B1 (en) 1998-04-06 2001-06-19 Synapix, Inc. Computer assisted mark-up and parameterization for scene analysis
US6584235B1 (en) * 1998-04-23 2003-06-24 Micron Technology, Inc. Wide dynamic range fusion using memory look-up
JP3773155B2 (ja) * 1998-06-26 2006-05-10 富士写真フイルム株式会社 ズームレンズ
US6662200B2 (en) 2001-01-03 2003-12-09 Intel Corporation Multiplierless pyramid filter
US20020174154A1 (en) * 2001-03-26 2002-11-21 Tinku Acharya Two-dimensional pyramid filter architecture
US6766286B2 (en) * 2001-03-28 2004-07-20 Intel Corporation Pyramid filter
US20020184276A1 (en) * 2001-03-30 2002-12-05 Tinku Acharya Two-dimensional pyramid filter architecture
US6889237B2 (en) * 2001-03-30 2005-05-03 Intel Corporation Two-dimensional pyramid filter architecture
US7317841B2 (en) * 2003-12-22 2008-01-08 Ge Medical Systems Global Technology Company, Llc System and method for image noise reduction using a minimal error spatiotemporal recursive filter
EP2670130B1 (en) * 2012-06-01 2019-03-27 Alcatel Lucent Method and apparatus for mixing a first video signal and a second video signal
GB2511073B (en) * 2013-02-22 2017-03-08 Phabrix Ltd Monitoring video waveforms
CN111413725B (zh) * 2020-03-27 2022-03-29 南华大学 一种利用虚拟仪器技术实现γ-γ数字符合测量的系统及方法

Family Cites Families (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4083035A (en) * 1976-09-10 1978-04-04 Rockwell International Corporation Binary image minutiae detector
US4622632A (en) * 1982-08-18 1986-11-11 Board Of Regents, University Of Washington Data processing system having a pyramidal array of processors
US4602285A (en) * 1983-04-08 1986-07-22 Ampex Corporation System and method for transforming and filtering a video image
PT78772B (en) * 1983-06-27 1986-06-05 Rca Corp Real-time hierarchal pyramid signal processing apparatus
GB2143046B (en) * 1983-06-27 1986-12-10 Rca Corp Real-time hierarchal signal processing apparatus
GB8329109D0 (en) * 1983-11-01 1983-12-07 Rca Corp Perceived signal-to-noise ratio of displayed images
US4709394A (en) * 1985-08-23 1987-11-24 Rca Corporation Multiplexed real-time pyramid signal processing system

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CA1254659A (en) 1989-05-23
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GB8621445D0 (en) 1986-10-15
GB2180676A (en) 1987-04-01
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DE3631333C2 (ko) 1988-09-08
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