KR820002038B1 - Ohmic electrode formation method - Google Patents
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제1도는 반도체장치의 요부 종단면도.1 is a longitudinal sectional view of principal parts of a semiconductor device.
제2도 및 제3도는 종래의 반도체소자의 소자취부체의의 고착방법을 설명하기 위한 고착전의 분해 종단면도.2 and 3 are exploded longitudinal cross-sectional views of a conventional semiconductor device prior to fixing for explaining a method of fixing to an element mounting body of a conventional semiconductor device.
제4도는 본 발명의 방법을 설명하기 위한 반도체 웨이퍼의 요부 확대 종단면도.4 is an enlarged longitudinal sectional view of a main portion of a semiconductor wafer for explaining the method of the present invention.
제5도는 본 발명 방법의 일실시예를 설명하기 위한 반도체 웨이퍼의 요부 확대 단면도.5 is an enlarged cross-sectional view of a main portion of a semiconductor wafer for explaining an embodiment of the method of the present invention.
본 발명은 반도체장치의 오우믹 전극의 형성방법에 관한 것이다.The present invention relates to a method for forming an ohmic electrode of a semiconductor device.
일반적으로 반도체장치는, 제1도에 도시한 바와같이, 반도체소자(11)에 땜납(2)을 개재시켜 스템, 리이드 프레임등의 소자취부체(3)에 고착하여 제조된다. 이런경우, 제2도에 도시한 바와같이 소자취부체(3)를 가열하여 두고, 이 소자취부체(3)위에 땜납조각(2)을 재치하여 용융케하고, 이어서 이 용융된 땜납위에 반도체소자(1)를 재치하여 고착하는 것이 보통이다. 그런데, 이와같은 방법에 의하면, 용융된 땜납의 표면에 산화막이 생기므로, 반도체소자(1)와 땜납(2)과의 사이에 산화막이 개재되고, 반도체소자(1)의 고착성이 나쁘며, 반도체소자(1)가 박리하기 쉽다고 하는 문제점이 있었다. 그 때문에, 용융된 땜납의 표면을 긁어서 산화막을 제거한다든지, 스크라이빙이라 칭하는 반도체소자(1)를 용융 땜납위에서 회전시킨다든지하여 반도체소자(1)를 고착하는 등의 방법도 제안되고 있지만, 번잡하다.In general, as shown in FIG. 1, a semiconductor device is manufactured by attaching a
한편, 제3도에 도시한 바와같이, 반도체소자(1)를 용융 땜납중에 첨지하여 반도체소자(1)에 땜납(2b)을 피착해두고, 소자취부체(3)에 고착하는 방법도 제안되고 있다. 이 방법에 의하면, 전기한 반도체소자(1)와 납땜과의 박리 문제는 일어나지 않지만, 액상(液相)인 땜납이 고상으로 되기까지 땜납(2b)의 표면에 산화막이 형성되며, 땜납(2b)과 소자취부체(3)과의 고착성이 나빠진다. 또, 땜납(2b)은 용융시의 표면장력으로 도시한 바와같이, 중앙부가 두껍고 주변부가 얇아지므로, 반도체소자(1)가 경사하여 소자취부체(3)에 고착된다고 하는 문제점이 있었다.On the other hand, as shown in FIG. 3, a method of depositing the semiconductor element 1 in the molten solder to deposit the solder 2b on the semiconductor element 1 and fixing it to the element mounting body 3 is also proposed. have. According to this method, the problem of peeling between the semiconductor element 1 and solder described above does not occur, but an oxide film is formed on the surface of the solder 2b until the liquid solder becomes solid, and the solder 2b And adhesion between the element mounting body 3 and the like deteriorate. Further, the solder 2b has a problem that the semiconductor element 1 is inclined and adhered to the element mounting body 3 because the center portion becomes thick and the peripheral portion becomes thin, as shown by the surface tension during melting.
그로인하여, 본 발명의 주된 목적은, 반도체소자를 소자취부체에 용이하게 또한 확실하게 고착할 수 있는 오우믹 전극의 형성방법을 제공하는데 있다.Therefore, a main object of the present invention is to provide a method for forming an ohmic electrode which can easily and reliably adhere a semiconductor element to an element mounting body.
본 발명을 요약하면, 반도체 웨이퍼에 적어도 땜납을 증착 형성하는 공정을 포함하는 것을 특징으로 하는 것이다.In summary, the present invention includes a process of depositing and forming at least solder on a semiconductor wafer.
본 발명의 상술한 목적 및 기타의 목적과 특징은, 도면을 참조한 아래의 상세한 설명에서 한층 더 명확해질 것이다. 제4도는 본 발명 방법을 설명하기 위한 반도체 웨이퍼(10)의 표면에 실리콘과 친밀성이 좋고, 또한 땜납과 젖기 쉬운 밑바탕 금속층(11)을 증착형성하고, 이 밑바탕 금속층(11)의 위에 땜납층(12)을 증착형성하고, 이 땜납층(12)의 위에 땜납의 산화방지 금속층(13)을 증착 형성한다.The above and other objects and features of the present invention will become more apparent from the following detailed description with reference to the drawings. FIG. 4 shows a
제5도는 본 발명의 실시예 방법을 설명하기 위한 반도체 웨이퍼의 요부 확대 종단면도로서 실리콘 웨이퍼(10)의 표면을 호모닝에 의해서 조면화(粗面化)하고, 숫돌알맹이 및 실리콘 더스트를 N2블로오에 의해 붙여서 날리고, 조면(10a)에 직시 실리콘과 친밀하기 쉬운 Cr, Al의 어느 것인가를 200-1000℃정도의 두께로 증착하여 제1 금속층(111)을 형성하고, 다음에 이 제1 금속층(111)의 위에 땜납과 젖기쉬운 Ni를 3000-7000Å정도의 두께로 증착하여 제2 금속층(112)을 형성한다.5 is an enlarged longitudinal sectional view of a main portion of a semiconductor wafer for explaining the method of the embodiment of the present invention, roughening the surface of the
이 제1 금속층(111)과 제2 금속층(112)으로서 밑바탕 금속층(11)을 구성하고 있다. 이 다음, Pb-Sn또는 Pb-Ag-Sn등의 조성의 땜납을 1,000-100,000Å정도의 두께로 증착하여 땜납층(12)을 형성한다. 단, 땜납의 조성금속층, Pb와 Sn(및/또는 Ag)와는 증기압이 달라지기 때문에, 전기한 금속층(112)위에 먼저 증기압의 낮은 Pb층(121)이 증착되며 그위에 증기압이 높은 Sn층(및/또는 Ag층)(122)가 형성된다.The
이 Sn층(및/또는 Ag층)(122)의 위에 An, Ag의 어느 것인가를 5,000-10,000Å정도의 두께로 증착하여 산화방지 금속층(13)을 형성한다.An
이와같은 방법에 의하면, 모든층이 모두가 진공중에서 증착 형성되므로, 실리콘 웨이퍼(10)와 제1 금속층(111)과의 밀착성은 좋으며, 각층과 층의 사이에 산화막이 형성 개재되는 일이 없고, 층상호간의 밀착성도 좋다. 다시 땜납층(12)은 증착으로 형성되므로, 전면에 걸쳐서 균일한 두께이며, 더욱이 표면이 산화방지 금속층(13)으로서 피복되어 있으므로, 산화막이 형성되지 않는다. 이 반도체 웨이퍼는 개개의 반도체 웨이퍼는 개개의 반도체소자로 절단 분리되지만, 그와 같이하여 얻어진 반도체소자에 있어서도, 전재와 같이 땜납층(12)이 반도체소자의 중앙부와 주변부에서 균일한 두께를 갖는 것 및 산화방지 금속층(13)에 의해서 산화막을 일으키지 않는다는 것은 물론이다. 따라서 이와 같이하여 얻어진 반도체소자를소자취부체에 고착할 경우는, 반도체소자와 땜납과의 사이 및 땜납과 소자취부체의 사이의 어느것에도 산화막이 개재되는 일이 없이, 용이하고 또한 확실히 고착할 수 있다. 또 각 금속층을 도금으로 형성할 경우처럼 금속층중에 가스가 흡장되지 않으므로, 전기저항 및 열저항이 작아진다. 뿐만 아니고, 땜납층(12)의 두께가 균일하므로, 반도체소자가 경사하여 소자취부체에 고착되는 일도 없고 반도체소자와 소자취부체와의 사이의 전기저항 및 열저항이 균일해지므로, 파워사이클 강도가 큰 반도체장치가 얻어진다. 그리고, 땜납층(12)의 두께는, 상기한 실시예에 있어서는, 다이아몬드 포인트에 의해 스크라이브한 뒤 브레이킹하여 개개의 반도체소자로 분할할 것을 고려하여, 10,000-100,000Å정도로 했으나, 예를들면 다이싱소우를 사용하여 분할해야할 경우는 더욱 두껍게 하여도 좋다.According to this method, since all the layers are all formed by vacuum deposition, the adhesion between the
본 발명은 이상과 같이, 반도체 웨이퍼에 적어도 땜납을 증착하여 오우믹 전극을 형성하는 공정을 포함하는 것이므로, 반도체 소자를 소자취부체에 용이하게 또한 확실히 고착할 수 있고, 더욱이 반도체소자를 소자취부체에 고착할 무렵에 반도체소자가 경사하여 고착된다고 한 것이 방지되는 효과를 나타낸다.Since the present invention includes a step of forming at least solder on a semiconductor wafer to form an ohmic electrode, as described above, the semiconductor element can be easily and securely fixed to the element attaching body, and furthermore, the semiconductor element is attached to the element attaching body. The fact that the semiconductor element is inclined and adhered at the time of fixation to the film is effective.
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR7900637A KR820002038B1 (en) | 1979-03-02 | 1979-03-02 | Ohmic electrode formation method |
Applications Claiming Priority (1)
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KR7900637A KR820002038B1 (en) | 1979-03-02 | 1979-03-02 | Ohmic electrode formation method |
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KR820002038B1 true KR820002038B1 (en) | 1982-10-25 |
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Family Applications (1)
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KR7900637A KR820002038B1 (en) | 1979-03-02 | 1979-03-02 | Ohmic electrode formation method |
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KR (1) | KR820002038B1 (en) |
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1979
- 1979-03-02 KR KR7900637A patent/KR820002038B1/en active
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