KR20080096278A - 인쇄회로기판 및 그 제조 방법 - Google Patents

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Abstract

인쇄회로기판 및 그 제조방법이 개시된다. 회로패턴층과 절연층을 교대로 적층하되, 일부 영역의 소정의 두께는 절연층만으로 적층된 다층기판을 형성하는 단계, 및 상기 다층기판의 상기 일부 영역의 상기 절연층을 제거하는 단계를 포함하는 인쇄회로기판의 제조방법으로 슬림화된 모듈에 적합한 인쇄회로기판을 제조할 수 있다.
밀링머신, 이산화탄소 레이져, 인쇄회로기판

Description

인쇄회로기판 및 그 제조 방법{PCB and manufacturing method thereof}
도 1은 본 발명의 일 실시예에 따른 인쇄회로기판의 제조 순서도.
도 2는 본 발명의 일 실시예에 따른 인쇄회로기판의 제조 공정도.
도 3a은 본 발명의 다른 실시예에 따른 인쇄회로기판의 사시도.
도 3b는 본 발명의 다른 실시예에 따른 제1 다층기판의 사시도.
<도면의 주요부분에 대한 부호의 설명>
20: 다층기판 21: 절연층
22: 회로패턴층 23: 일부 영역
24: 소정의 두께 200: 인쇄회로기판
본 발명은 인쇄회로기판의 제조방법에 관한 것이다.
전가기기가 슬림(slim)화 됨에 따라 인쇄회로기판의 두께를 낮추려는 연구가 계속 진행되고 있다. 종래 방식은 인쇄회로기판을 슬림화하기 위해 층간 소재의 두께를 감소시키는 방향으로 개발되어 왔다. 기판의 층간 소재의 두께를 감소시키기 위해 기존보다 약해진 강도를 보상하기 위해 각 층의 강도 향상 작업이 필요하게 되고, 슬림화에 따른 전류의 임피던스 변화 및 층간 절연거리 확보 등의 문제점을 가지게 되었다.
본 발명은 강도가 확보되면서 슬림화된 전자기기에 적합한 인쇄회로기판 및 그 제조방법을 제공하고자 한다.
본 발명의 일 측면에 따르면, 회로패턴층과 절연층을 교대로 적층하되, 일부 영역의 소정의 두께는 절연층만으로 적층된 다층기판을 형성하는 단계, 및 상기 다층기판의 상기 일부 영역의 상기 절연층을 제거하는 단계를 포함하는 인쇄회로기판의 제조방법이 제공된다.
상기 일부 영역의 상기 절연층을 제거하는 단계는 기계적인 방법으로 이루어질 수 있으며, 상기 기계적인 방법은 밀링머신으로 이루어질 수 있다.
또한, 상기 일부영역의 절연층을 제거하는 단계는 기계적인 방법으로 상기 소정의 두께의 일부 두께를 제거하는 단계, 및 레이져를 이용하여 상기 소정의 두께의 나머지 두께를 제거하여 회로패턴층이 드러나도록 하는 단계를 포함할 수 있다. 이때, 레이져는 이산화탄소 레이져인 것이 좋다.
본 발명의 다른 측면에 따르면, 절연층과 회로패턴층으로 이루어진 제1 다층기판과, 상기 제1 기판부 상면에 일부 영역에만 회로패턴층과 절연층이 적층된 제2 다층기판을 포함하는 인쇄회로기판이 제공된다.
이하에서는, 첨부된 도면을 참조하여 본 발명에 따른 인쇄회로기판 및 그 제조방법의 실시예에 대하여 보다 상세하게 설명하도록 하며, 첨부 도면을 참조하여 설명함에 있어 도면 부호에 상관없이 동일하거나 대응하는 구성 요소는 동일한 참조번호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.
도 1은 본 발명의 일 실시예에 따른 인쇄회로기판의 제조 순서도이며, 도 2는 본 발명의 일 실시예에 따른 인쇄회로기판의 제조 공정도(단면도로 표시됨)이다. 도 2를 참조하면, 다층기판(20), 절연층(21), 회로패턴층(22), 일부 영역(23), 소정의 두께(24), 인쇄회로기판(200)이 도시되어 있다.
도 1의 S11은 회로패턴층과 절연층을 교대로 적층하되, 일부 영역의 소정의 두께는 절연층만으로 적층된 다층기판을 형성하는 단계이다. 본 단계는 도 2의 (a)와 상응하는 공정이다.
절연층(21)과 회로패턴층(22)을 교대로 적층한 결과 도 2의 (a)와 같은 다층기판(20)이 형성된다. 이러한 적층공정은 절연층(21)위에 회로패턴층(22)을 순차적으로 적층하는 방법으로 이루어질 수도 있고, 절연층(21)의 상면에 회로패턴층(22)이 이미 형성된 여러 개의 기판을 일괄적층하는 방법으로 이루어 질 수도 있다. 절연층(21)은 프리프레그를 비롯한 다양한 전기재료가 사용될 수 있으며, 회로패턴층(22)은 절연층(21) 위에 에디티브(additive) 방식으로 형성하는 방법과, 동박적층판을 서브트렉티브(subtractive)방식으로 제거하여 형성하는 방법 등 다양한 현 존하는 기술을 이용하여 형성할 수 있다.
한편, 이러한 적층공정에서 다층기판(20)의 일부 영역(23)에는 도 2의 (a)와 같이 절연층(21)만 적층되도록 하는 것이 좋다. 이러한 일부 영역(23)은 절연층(21)만으로 소정의 두께(24) 만큼 적층될 수 있다. 따라서, 이러한 일부 영역(23)의 소정의 두께(24)에는 회로패턴층(22)이 도 2의 (a)와 같이 형성되지 않는다. 이러한 일부 영역(23)은 추후 공정에서 제거될 부분으로 제거 공정을 쉽게 하기 위하여 금속으로 된 회로패턴층(22)을 형성하지 않았다.
한편, 본 실시예의 일부 영역(23)이라 함은 다층기판(20)의 상면에서 내려다 보았을 때 해당하는 영역(도 2의 도면은 단면도로 표시된 것임)으로, 이 부분은 추후 공정에서 제거될 부분으로 제거된 만큼 일부 영역(23)의 다층기판(20)의 두께는 얇아진다. 즉, 이러한 일부 영역(23)이 인쇄회로기판(200)이 전자기기(미도시)내부에 결합할 경우 전체 전자기기의 전체 두께를 좌우할 부품이 위치하는 영역이 된다. 이 경우 부품이 두껍더라도 일부 영역(23)의 소정의 두께(24) 만큼 인쇄회로기판(200)의 표면 위로 돌출되지 않게 된다.
한편, 본 실시예의 소정의 두께(24)라 함은 부품의 두께를 고려하여 제거될 분분으로, 인쇄회로기판의 설계시 제거될 것을 고려하여 소정의 두께(24)는 절연층(21)만으로 적층되어 있다.
도 1의 S12는 다층기판의 일부 영역의 절연층을 제거하는 단계로서, 도 2의 (b), (c)는 이에 상응하는 공정이다.
도 2의 (b)는 기계적인 방법으로 소정의 두께(24)의 일부 두께(24a)의 깊이 로 절연층(21)을 제거한다. 소정의 두께(24)를 모두 제거하지 않은 이유는 기계적인 방법, 즉 밀링머신(milling machine)을 이용하여 절연층(21)을 제거할 경우, 회로패턴층(22)이 드러날 때까지 밀링머신으로 작업하기에는 회로패턴층(22)의 두께(약 9~18um)가 너무 얇아 자칫 회로패턴층(22)에 손상될 수도 있기 때문이다. 즉, 회로패턴층(22)이 손상되지 않도록 제거하는 것은 밀링머신의 작업 오차를 넘어서는 범위이다.
따라서, 기계적인 방법으로 회로패턴층(22)이 드러날 때까지 소정의 두께(24)를 모두 제거하는 것은 바람직하지 않다. 그러나, 보다 정밀한 장비로서 회로패턴층(22)에 손상을 가하지 않고 소정의 두께(24)에 해당하는 모든 절연층(21)을 제거할 수 있다면 기계적인 방법으로 만으로 본 공정을 진행하는 것도 좋다. 본 공정을 진행한 결과 도 2의 (c)에 도시된 바와 같은 다층기판(20)이 형성된다. 도 2의 (c)에서는 나머지 두께(24b)에 해당하는 절연층(21)이 남아 있음을 알 수 있다.
도 2의 (b)의 공정만으로 충분한 두께의 절연층(21)을 제거하였고, 일부 영역(23)에 위치할 부품이 회로패턴층(22)과 전기적으로 연결될 필요가 없다면 도 2의 (b)공정만으로 충분할 수도 있다. 그러나, 일부 영역(23)의 소정의 두께(24)에 해당하는 절연층(21)을 모두 제거하여 회로패턴층(22)이 드러나길 원한다면 도2의 (c)와 같은 공정을 더 진행하는 것이 좋다.
도 2의 (c)의 공정은 레이져를 이용하여 나머지 두께(24b)를 제거하는 공정이다. 기계적으로 제거한 소정의 두께(24)의 일부 두께(24a)를 제거하고 남은 나머 지 두께(24b)는 회로패턴층(22)을 손상시키지 않도록 하기 위하여 정밀한 레이져를 이용한다. 이러한 레이져로는 이산화탄소 레이져를 사용하는 것이 좋다. 결과적으로 도 2의 (d)와 같은 회로패턴층(22)이 노출된 인쇄회로기판(200)이 완성된다.
이후, 도 2의 (e)와 같이 부품을 실장하는 단계를 더 진행할 수 있다. 일부 영역(23)에 해당하는 위치에 부품(25)을 실장할 경우, 부품의 두께가 있음에도 불구하고 전체적인 모듈의 두께는 일부 영역(23)의 소정의 두께(24)가 제거되었으므로 크게 증가하지 않게 된다. 도 2의 (e)에서는 부품(25)의 두께가 소정의 두께(24)보다 작아 인쇄회로기판(200)의 표면으로 드러나지 않는 상황을 보여준다.
도 3a은 본 발명의 다른 실시예에 따른 인쇄회로기판의 사시도이며, 도 3b는 본 발명의 다른 실시예에 따른 제1 다층기판의 사시도이다. 도 3a, 3b를 참조하면, 인쇄회로기판(30), 제1 다층기판(30a), 제2 다층기판(30b), 절연층(31a, 31b), 회로패턴층(32a, 32b), 회로패턴(33a, 33b), 나머지 영역(34), 일부 영역(35)이 도시되어 있다.
제1 다층기판(30a)은 절연층(31a)과 회로패턴층(32a)이 교대로 적층된 구조이다. 제1 다층기판(30a)은 일괄적층방식으로 형성될 수도 있으며, 절연층(31a)과 회로패턴층(32a)을 순차적인 방식으로 적층될 수도 있다.
제2 다층기판(30b)은 제1 다층기판(30a)의 일부 영역(35)에만 적층되는 구조로서, 절연층(31b)과 회로패턴층(32b)이 교대로 적층된 구조이다. 제2 다층기판(30b)은 제1 다층기판(30a)의 일부 영역(35)에만 적층되었으므로, 나머지 영역(34)에는 제2 다층기판(30b)이 존재하지 않게 된다. 결과적으로, 제1 다층기 판(30a)의 나머지 영역(34)에 해당하는 부분의 인쇄회로기판(30)의 두께는 얇아지게 된다.
이러한 제1 다층기판(30a)의 나머지 영역(34)에는 부품이 실장될 수 있다. 더구나, 제1 다층기판(30a)의 회로패턴(33a)과 부품은 전기적으로 연결될 수도 있다. 제1 다층기판(30a)의 나머지 영역(34)은 부품이 실장될 장소를 고려하여 형성된다. 이렇게 제1 다층기판(30a)의 나머지 영역(34)에 부품(미도시)이 실장되면, 부품의 두께가 두꺼워도 전체 모듈의 두께를 줄일 수 있다.
상기에서는 본 발명의 바람직한 실시예에 대해 설명하였지만, 해당기술 분야에서 통상의 지식을 가진 자라면 하기의 특허청구범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.
상술한 바와 같이 본 발명의 실시예에 따르면, 강도를 유지하면서 슬림화 전자기기에 적합한 인쇄회로기판을 제공할 수 있게 된다.

Claims (6)

  1. 회로패턴층과 절연층을 교대로 적층하되, 일부 영역의 소정의 두께는절연층만으로 적층된 다층기판을 형성하는 단계: 및
    상기 다층기판의 상기 일부 영역의 상기 절연층을 제거하는 단계를 포함하는 인쇄회로기판의 제조방법
  2. 제1항에 있어서,
    상기 일부 영역의 상기 절연층을 제거하는 단계는 기계적인 방법으로 이루어지는 것을 특징으로 하는 인쇄회로기판의 제조방법.
  3. 제2항에 있어서,
    상기 기계적인 방법은 밀링머신으로 이루어지는 인쇄회로기판의 제조방법.
  4. 제1항에 있어서,
    상기 일부영역의 절연층을 제거하는 단계는, 기계적인 방법으로 상기 소정의 두께의 일부 두께를 제거하는 단계; 및
    레이져를 이용하여 상기 소정의 두께의 나머지 두께를 제거하여 회로패턴층이 드러나도록 하는 단계를 포함하는 인쇄회로기판의 제조방법.
  5. 제4항에 있어서,
    상기 레이져는 이산화탄소 레이져인 것을 특징으로 하는 인쇄회로기판의 제조방법.
  6. 절연층과 회로패턴층으로 이루어진 제1 다층기판과;
    상기 제1 기판부 상면에 일부 영역에만 회로패턴층과 절연층이 적층된 제2 다층기판을 포함하는 인쇄회로기판.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN109848567A (zh) * 2019-01-30 2019-06-07 无锡深南电路有限公司 一种封装基板的镭射铣边设备和方法

Families Citing this family (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE102011105346A1 (de) 2011-06-21 2012-12-27 Schweizer Electronic Ag Elektronische Baugruppe und Verfahren zu deren Herstellung
DE102012203318A1 (de) * 2011-12-22 2013-06-27 Rohde & Schwarz Gmbh & Co. Kg Verfahren zum Freilegen einer Schicht einer Leiterplatte und entsprechend freigelegte Leiterplatte
US9648744B2 (en) * 2012-07-24 2017-05-09 Apple Inc. Ejectable component assemblies in electronic devices
CN203072246U (zh) * 2012-12-31 2013-07-17 奥特斯(中国)有限公司 用于生产印制电路板的半成品
US10219384B2 (en) 2013-11-27 2019-02-26 At&S Austria Technologie & Systemtechnik Aktiengesellschaft Circuit board structure
AT515101B1 (de) 2013-12-12 2015-06-15 Austria Tech & System Tech Verfahren zum Einbetten einer Komponente in eine Leiterplatte
AT515447B1 (de) 2014-02-27 2019-10-15 At & S Austria Tech & Systemtechnik Ag Verfahren zum Kontaktieren eines in eine Leiterplatte eingebetteten Bauelements sowie Leiterplatte
US11523520B2 (en) 2014-02-27 2022-12-06 At&S Austria Technologie & Systemtechnik Aktiengesellschaft Method for making contact with a component embedded in a printed circuit board
KR101720264B1 (ko) 2015-09-04 2017-04-03 대덕전자 주식회사 회로기판 제조방법
CN112038243B (zh) * 2020-09-10 2022-11-04 英华达(上海)科技有限公司 集成电路封装方法

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4800461A (en) * 1987-11-02 1989-01-24 Teledyne Industries, Inc. Multilayer combined rigid and flex printed circuits
JP2601182B2 (ja) * 1994-03-31 1997-04-16 日本電気株式会社 マイクロ波回路の多層回路基板
JPH07336055A (ja) * 1994-06-06 1995-12-22 Hitachi Seiko Ltd レーザ加工方法及びその装置
DE69626747T2 (de) * 1995-11-16 2003-09-04 Matsushita Electric Ind Co Ltd Gedruckte Leiterplatte und ihre Anordnung
JP3400634B2 (ja) * 1996-02-28 2003-04-28 富士通株式会社 プリント基板の配線パターン改造方法およびプリント基板の配線パターンの切断方法
JP2001244606A (ja) * 2000-03-01 2001-09-07 Cmk Corp 積層基板の孔明け方法
JP2006019441A (ja) * 2004-06-30 2006-01-19 Shinko Electric Ind Co Ltd 電子部品内蔵基板の製造方法
JP2007080976A (ja) * 2005-09-12 2007-03-29 Shinko Electric Ind Co Ltd 多層回路基板及びその製造方法ならびに電子部品パッケージ
CN1761378A (zh) * 2005-09-20 2006-04-19 沪士电子股份有限公司 直接co2激光钻孔方法
JP2007088058A (ja) * 2005-09-20 2007-04-05 Denso Corp 多層基板、及びその製造方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN109848567A (zh) * 2019-01-30 2019-06-07 无锡深南电路有限公司 一种封装基板的镭射铣边设备和方法

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